JP3481117B2 - 半導体装置及びその製造方法 - Google Patents
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Description
製造方法に関し、特にBGA及びCSPタイプのパッケ
ージ構造を有する半導体装置及びその製造方法に関す
る。
化の要求に伴い、半導体装置の小型化、軽量化、薄型化
の要求は著しいものがある。これらの要求に対処すべく
BGS及びCSPタイプのパッケージ構造を有する半導
体装置が開発されている。BGA及びCSPタイプのパ
ッケージ構造を有する半導体装置は、半導体チップと、
半導体チップを搭載すためのTABテープ等のFPCテ
ープと、TABテープに設けられたはんだボールとを含
む。半導体チップはダイス付け材によりTABテープに
固定される。TABテープはボンディングパッド及びボ
ールパッドを有し、これらのボンディングパッドやボー
ルパッドはそれぞれ配線パターンによりTABテープ内
で接続されている。半導体チップはワイヤによりTAB
テープのボンディングパッドに接続される。
ドに設けられ、はんだボールは外部電極として作用す
る。これにより、半導体チップとはんだボールとはTA
Bテープをインターポーザーとして電気的に接続され
る。BGA及びCSPタイプの半導体装置のように外部
端子としてはんだボールを有する表面実装型の半導体装
置をマザーボードに実装する場合、約250℃前後の雰
囲気を有するはんだリフロー装置において半導体装置を
加熱し、溶融したはんだボールをマザーボードの電極パ
ッドに接続するのが一般的である。
張係数の差による応力を低減させるための緩衝用樹脂シ
ートをTABテープに貼り付け、緩衝用樹脂シートの上
にダイス付け材を塗布して半導体チップをTABテープ
に固定する構成が考えられる。
付け材によりTABテープに固定し、封止樹脂により封
止してなる半導体装置においては、水分がTABテープ
を構成するポリイミドや、封止樹脂や、ダイス付け材等
に含まれる。特に、TABテープを構成するポリイミド
は非常に吸湿しやすい材料である。従って、半導体装置
をマザーボードに実装する場合にはんだボールをリフロ
ーする時に、TABテープや、封止樹脂や、ダイス付け
材に含まれる水分が温度の上昇により蒸気となり、半導
体装置にクラックや膨れが発生する。
をTABテープに搭載する前にTABテープに予め小さ
な穴を形成しておき、半導体チップをTABテープに搭
載した後ではんだボールのリフローを行う時に、半導体
装置内に含まれる水分がこれらの穴から抜けるようにす
る提案がある。半導体装置内に含まれる水分が半導体装
置から抜けると、半導体装置にクラックや膨れが発生す
るのを防止することができる。
穴を形成してあると、半導体チップとTABテープとの
間にあるダイス付け材が半導体装置の製造工程中の熱処
理により流動してTABテープの穴を埋めてしまい、水
蒸気抜きの穴として機能しなくなる場合がある。あるい
はダイス付け材がTABテープの穴から流れ出してしま
い、TABテープの裏面や治工具を汚す可能性がある。
また、TABテープに緩衝用樹脂シートを貼り付けた構
成においては、緩衝用樹脂シートがダイス付け材の流動
を防止するが、緩衝用樹脂シートが溶融し、TABテー
プの穴を埋めてしまい、水蒸気抜きの穴として機能しな
くなる場合がある。
るのを防止することができる半導体装置及びその製造方
法を提供することである。
の製造方法は、半導体チップと、該半導体チップを搭載
するためのテープと、該半導体チップと該テープとの間
に設けられた接着性樹脂層と、該テープに設けられたは
んだボールとを備えた半導体装置の製造方法であって、
半導体チップを接着性樹脂層を介してテープに固定する
工程と、はんだボールを該テープに付ける工程と、半導
体チップを接着性樹脂層を介してテープに固定する工程
の後で、該テープを貫通する少なくとも一つの穴を形成
する工程とを備えることを特徴とする。
なくとも一つの穴が設けられているので、はんだボール
のリフローを行う時に、半導体装置内に含まれる水分が
少なくとも一つの穴から抜け、半導体装置にクラックや
膨れが発生するのを防止することができる。そして、少
なくとも一つの穴は半導体チップを接着性樹脂層を介し
てテープに固定する工程の後で形成されるので、少なく
とも一つの穴が半導体製造工程中の熱処理により流動す
る接着性樹脂層により埋まることがなく、水蒸気抜き穴
として有効に作用する。
ける工程は、半導体チップを接着性樹脂層を介してテー
プに固定する工程の後で、該少なくとも一つの穴を形成
する工程の前に実施される。好ましくは、該少なくとも
一つの穴を形成する工程は、レーザーを使用して該少な
くとも一つの穴が該テープを貫通し且つ該接着性樹脂層
に通じるようにする。
り封止する工程をさらに含む。好ましくは、該半導体チ
ップを接着性樹脂層を介してテープに固定する工程は、
ダイス付け材を該テープに塗布する工程を含む。あるい
は、該半導体チップを接着性樹脂層を介してテープに固
定する工程は、該テープに緩衝材を付ける工程と、ダイ
ス付け材を該緩衝材に塗布する工程とを含む。あるい
は、該半導体チップを接着性樹脂層を介してテープに固
定する工程は、半導体チップを突起電極により該テープ
に接続する工程と、半導体チップと該テープとの間にア
ンダーフィル材を充填する工程とを含む。
と、該半導体チップを搭載するためのテープと、該半導
体チップと該テープとの間の接着性樹脂層と、該テープ
に設けられたはんだボールとを備え、該接着性樹脂層は
半導体チップと該テープの熱膨張係数の差による応力を
低減させるための緩衝材と、半導体チップを該緩衝材を
介して該テープに固定するためのダイス付け材とからな
り、該テープ及び該接着性樹脂層は該テープ及び該緩衝
材を貫通し該ダイス付け材に通じる少なくとも一つの穴
を有することを特徴とする。この構成において、テープ
及び緩衝材を貫通しダイス付け材に通じる少なくとも一
つの穴は、上記半導体装置の製造方法に従って製造され
たものであり、上記したのと同様の作用効果を奏する。
すなわち、はんだボールのリフローを行う時に、半導体
装置内に含まれる水分が少なくとも一つの穴から抜け、
半導体装置にクラックや膨れが発生するのを防止するこ
とができるとともに、少なくとも一つの穴が半導体製造
工程中の熱処理により流動する接着性樹脂層により埋ま
ることがなく、水蒸気抜き穴として有効に作用する。
FPCテープである。
例の半導体装置を示す図である。半導体装置10は、半
導体チップ12と、半導体チップ12を搭載するための
TABテープ14と、半導体チップ12とTABテープ
14との間の接着性樹脂層16とを備えている。接着性
樹脂層16は半導体チップ12とTABテープ14の熱
膨張係数の差による応力を低減させるための緩衝シート
材18と、半導体チップ12を緩衝シート材18を介し
てTABテープ14に固定するためのダイス付け材20
とからなる。製造においては、緩衝シート材18をTA
Bテープ14に貼りつけ、ダイス付け材20を緩衝シー
ト材18に塗布して、半導体チップ12をTABテープ
14に固定する。
ド22及びボールパッド24を有し、これらのボンディ
ングパッド22及びボールパッド24はそれぞれ配線パ
ターン(図示せず)によりTABテープ14内で接続さ
れている。半導体チップ12の電極はワイヤ26により
TABテープ14のボンディングパッド22に接続され
る。
ールパッド24に取り付けられ、はんだボール28は外
部電極として作用する。これにより、半導体チップ12
とはんだボール28とはTABテープ14をインターポ
ーザーとして電気的に接続される。ボールパッド24は
TABテープ14の上面に取り付けられており、はんだ
ボール28の取り付けのためにTABテープ14にはボ
ール取り付け穴30が設けられている。はんだボール2
8はボール取り付け穴30を通り、上端がボールパッド
24に固着され、下端がTABテープ14の下方に突出
している。
4を貫通し且つ緩衝シート材18及びダイス付け材20
に通じるように形成されている。さらに、半導体チップ
12を封止する封止樹脂34が設けられる。TABテー
プ14は複数層のポリイミドフィルムをエポキシ系の接
着剤で貼り合わせた構造のものである。ボール取り付け
穴30はレーザー、パンチング、ドリル、エッチング等
によりTABテープ14に予め形成される。一方、蒸気
抜き穴32は、TABテープ14に予め形成されるので
はなく、少くとも半導体チップ12をTABテープ14
に搭載した後でTABテープ14を貫通し且つ緩衝シー
ト材18及びダイス付け材20に通じるように形成され
る。
を説明する図である。半導体装置10の製造の基本的な
工程は公知の通りであるので簡単に説明する。TABテ
ープ14に緩衝シート材18を貼りつけ、緩衝シート材
18にダイス付け材20を塗布し、半導体チップ12を
TABテープ14に固定する。半導体チップ12の電極
とTABテープ14のボンディングパッド22とをワイ
ヤ26により接続する。トランスファモールドを実施
し、半導体チップ12を封止樹脂34によって封止す
る。それから、はんだボール28をTABテープ14の
ボールパッド24に固着する。
き穴32を、レーザー(LB)により、TABテープ1
4を貫通し且つ緩衝シート材18及びダイス付け材20
に通じるように形成する。それから、TABテープ14
を個別のチップ毎に切断する。なお、蒸気抜き穴32の
形成は、はんだボール28の固着の前又は後に行っても
よく、TABテープ14の切断後であってもよく、その
効果はいずれも同じである。
6に表面実装する例を示している。この場合、少なくと
もはんだボール28を加熱してリフローさせ、はんだボ
ール28をマザーボード36の電極パッド38に溶着さ
せる。BGA及びCSPタイプの半導体装置のように外
部端子としてはんだボール28を有する表面実装型の半
導体装置10をマザーボード36に実装する場合、約2
50℃前後の雰囲気を有するはんだリフロー装置におい
て半導体装置10を加熱し、溶融したはんだボール28
をマザーボード36の電極パッド38に接続するのが一
般的である。
Bテープ14、緩衝シート材18、ダイス付け材20、
及び封止樹脂34に含まれる水分が加熱され、それによ
って生じた水蒸気が蒸気抜き穴32から半導体装置10
の外部に抜ける。水蒸気が蒸気抜き穴32から半導体装
置10の外部に抜けるので、半導体装置10にクラック
や膨れが発生するのを防止することができる。
予め形成されていると、半導体装置10の製造工程中の
熱処理等により、緩衝シート材18、ダイス付け材2
0、及び封止樹脂34の一つ又は幾つかが蒸気抜き穴3
2から漏れたり、蒸気抜き穴32を埋めてしまい、蒸気
抜き穴32が水蒸気の抜け穴としての機能を果たさなく
なる。本発明のように、半導体装置10を形成した後で
(好ましくは封止樹脂34により半導体チップ12を封
止する工程より後に)蒸気抜き穴32を形成することに
より、緩衝シート材18、ダイス付け材20、及び封止
樹脂34が蒸気抜き穴32から漏れたり、蒸気抜き穴3
2を埋めてしまったりすることがなくなり、蒸気抜き穴
32はリフロー時に水蒸気の抜け穴としての機能を果た
すことができる。よって、はんだリフロー時に発生する
半導体装置のクラックや膨れを防止することができ、吸
湿後のはんだ耐熱性に優れるBGA及びCSPパッケー
ジを製造可能である。
抜き穴32をレーザーにより高速且つ高精度に形成する
ことができる。使用するレーザーはYAGレーザーの第
2高調波を使用するのが好ましい。YAGレーザーの第
2高調波は波長が0.532μmである。波長が1μm
以上のレーザーは半導体チップ12を透過し、半導体チ
ップ12の構成要素(例えばトランジスタ)を破壊する
可能性があるため、本発明では使用しにくい。因みに、
炭酸ガスレーザーの波長は10.6μmであり、YAG
レーザーの波長は1.06μmであり、エキシマレーザ
ーの波長は0.248μmである。
付け材20をほぼ貫通し、半導体チップ12の背面に到
達するようにしている。ただし、蒸気抜き穴32は必ず
しも半導体チップ12の背面に到達する深さにする必要
はない。実際には、構成される部材(TABテープ1
4、緩衝シート材18、ダイス付け材20、及び封止樹
脂34)によって密着力及び透水率が異なるため、蒸気
抜き穴32の深さはそのような特性を考慮して定めれば
よい。
だ耐熱性調査結果を示す。 表1 レーザー貫通穴仕様 PKG膨れ発生数 穴径(mm) 穴ピッチ(mm) 穴数 24H 48H 試料NO1 0.1 0.8 100 0/15 0/39 試料NO2 0.1 1.2 49 0/15 0/39 試料NO3 0.1 1.6 25 0/15 0/39 比較試料1 穴なし 15/15 サンプルは、0.8mmピッチの224ピンのテープタ
イプのBGA(パッケージサイズ16□)について、レ
ーザー貫通穴あけ処理の有無及び穴数による、はんだ耐
熱性を調査したものである。具体的には、図2のよう
に、224ピンのテープタイプのBGAの裏面中央部付
近に、穴径約0.1mmφの蒸気抜き穴32をYAGレ
ーザーの第2高調波にてあけたサンプルを作製した。今
回の調査では、穴数を100、49、25の3種類、穴
深さはダイス付け材20に通じるまでとし、穴あけ処理
はボール付け及びテープ切断後に実施したものである。
あけ処理を実施しないサンプル(比較試料1)を、85
℃/85%雰囲気にて24時間及び48時間放置後、I
Rリフロー(リフロー温度250℃、約10秒)を実施
し、半導体装置(PKG)の膨れについて観察した。そ
の結果、表1に示したように、貫通穴あけ処理を実施し
たサンプルは、48時間放置後も半導体装置の膨れは発
生しなかったが、穴あけ処理を実施しなかったサンプル
は、24時間放置後ですでに全数の半導体装置について
膨れが発生した。
示す図である。半導体装置10は、半導体チップ12
と、半導体チップ12を搭載するためのTABテープ1
4と、半導体チップ12とTABテープ14との間の接
着性樹脂層16とを備えている。この実施例では図1の
実施例の緩衝シート材18がなく、接着性樹脂層16は
半導体チップ12をTABテープ14に固定するための
ダイス付け材20とからなる。
Bテープ14に塗布し、半導体チップ12をTABテー
プ14に固定する。その他の構成は、図1の実施例の構
成とほぼ同じである。そして、図1の実施例と同様に、
蒸気抜き穴32がTABテープ14を貫通し且つダイス
付け材20に通じるように形成されている。蒸気抜き穴
32は半導体チップ12の背面には到達していない。
例の緩衝シート材18の接着工程がない点を除くと、図
1の実施例の製造方法と同様の工程で製造される。ま
た、この実施例の作用は図1の実施例の作用と同様であ
る。図6は本発明の第3実施例の半導体装置を示す図で
ある。半導体装置10は、半導体チップ12と、半導体
チップ12を搭載するためのTABテープ14と、半導
体チップ12とTABテープ14との間の接着性樹脂層
16とを備えている。この実施例は、本発明をフリップ
チップにより接続されたテープタイプのBGA及びCS
Pパッケージに応用した例である。半導体チップ12は
突起電極40を有し、突起電極40がTABテープ14
のボンディングパッド22に接続される。突起電極40
がボンディングパッド22に接続された後、アンダーフ
ィル材42が半導体チップ12とTABテープ14との
間に充填される。このアンダーフィル材42が接着性樹
脂層16である。半導体チップ12を封止樹脂で封止す
ることもできる。
化された後で、蒸気抜き穴32がTABテープ14を貫
通し且つアンダーフィル材42に通じるように形成され
る。蒸気抜き穴32は半導体チップ12の背面には到達
していない。蒸気抜き穴32は、リフロー時の水蒸気の
抜け道として機能し、はんだリフロー時に発生するパッ
ケージクラック及び膨れを防止することが可能である。
蒸気抜き穴32の穴あけ処理を、アンダーフィル材42
の充填、硬化後に実施することにより、蒸気抜き穴32
からアンダーフィル材42が漏れることがなくなる。た
だし、フリップチップの場合、ファイスダウン方式の接
合のため、半導体チップ12の表面側がTABテープ1
4を向くため、レーザーにてあける穴の深さを半導体チ
ップ12のチップ表面に届かないようにし、アンダーフ
ィル材42でとめるように制御する必要がある。
テープを貫通する少なくとも一つの穴が設けられている
ので、はんだボールのリフローを行う時に、半導体装置
内に含まれる水分が少なくとも一つの穴から抜け、半導
体装置にクラックや膨れが発生するのを防止することが
できる。そして、少なくとも一つの穴は半導体チップを
接着性樹脂層を介してテープに固定する工程の後で形成
されるので、少なくとも一つの穴が半導体製造工程中の
熱処理により流動する接着性樹脂層により埋まることが
なく、水蒸気抜き穴として有効に作用する。
る。
プに蒸気抜き穴32を形成するところを示す図である。
ところを示す図である。
る。
る。
Claims (9)
- 【請求項1】 半導体チップと、該半導体チップを搭載
するためのテープと、該半導体チップと該テープとの間
に設けられた接着性樹脂層と、該テープに設けられたは
んだボールとを備えた半導体装置の製造方法であって、 半導体チップを接着性樹脂層を介してテープに固定する
工程と、 はんだボールを該テープに付ける工程と、 半導体チップを接着性樹脂層を介してテープに固定する
工程の後で、該テープを貫通する少なくとも一つの穴を
形成する工程とを備えることを特徴とする半導体装置の
製造方法。 - 【請求項2】 はんだボールを該テープに付ける工程
は、半導体チップを接着性樹脂層を介してテープに固定
する工程の後で、該少なくとも一つの穴を形成する工程
の前に実施されることを特徴とする請求項1に記載の半
導体装置の製造方法。 - 【請求項3】 該少なくとも一つの穴を形成する工程
は、レーザーを使用して該少なくとも一つの穴が該テー
プを貫通し且つ該接着性樹脂層に通じるようにすること
を特徴とする請求項1に記載の半導体装置の製造方法。 - 【請求項4】 半導体チップを封止樹脂により封止する
工程をさらに含むことを特徴とする請求項1に記載の半
導体装置の製造方法。 - 【請求項5】 該半導体チップを接着性樹脂層を介して
テープに固定する工程は、ダイス付け材を該テープに塗
布する工程を含むことを特徴とする請求項1に記載の半
導体装置の製造方法。 - 【請求項6】 該半導体チップを接着性樹脂層を介して
テープに固定する工程は、該テープに緩衝材を付ける工
程と、ダイス付け材を該緩衝材に塗布する工程とを含む
ことを特徴とする請求項1に記載の半導体装置の製造方
法。 - 【請求項7】 該半導体チップを接着性樹脂層を介して
テープに固定する工程は、半導体チップを突起電極によ
り該テープに接続する工程と、半導体チップと該テープ
との間にアンダーフィル材を充填する工程とを含むこと
を特徴とする請求項1に記載の半導体装置の製造方法。 - 【請求項8】 半導体チップと、該半導体チップを搭載
するためのテープと、該半導体チップと該テープとの間
の接着性樹脂層と、該テープに設けられたはんだボール
とを備え、該接着性樹脂層は半導体チップと該テープの
熱膨張係数の差による応力を低減させるための緩衝材
と、半導体チップを該緩衝材を介して該テープに固定す
るためのダイス付け材とからなり、該テープ及び該接着
性樹脂層は該テープ及び該緩衝材を貫通し該ダイス付け
材に通じる少なくとも一つの穴を有することを特徴とす
る半導体装置。 - 【請求項9】 該テープはFPCテープであることを特
徴とする請求項8に記載の半導体装置。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP04358998A JP3481117B2 (ja) | 1998-02-25 | 1998-02-25 | 半導体装置及びその製造方法 |
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US09/335,878 US6291895B1 (en) | 1998-02-25 | 1999-06-18 | Method of fabricating semiconductor having through hole |
US09/836,182 US20010028101A1 (en) | 1998-02-25 | 2001-04-18 | Method of fabricating semiconductor having through hole |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP04358998A JP3481117B2 (ja) | 1998-02-25 | 1998-02-25 | 半導体装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH11243160A JPH11243160A (ja) | 1999-09-07 |
JP3481117B2 true JP3481117B2 (ja) | 2003-12-22 |
Family
ID=12667988
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP04358998A Expired - Fee Related JP3481117B2 (ja) | 1998-02-25 | 1998-02-25 | 半導体装置及びその製造方法 |
Country Status (2)
Country | Link |
---|---|
US (3) | US5953592A (ja) |
JP (1) | JP3481117B2 (ja) |
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-
1998
- 1998-02-25 JP JP04358998A patent/JP3481117B2/ja not_active Expired - Fee Related
- 1998-07-28 US US09/123,450 patent/US5953592A/en not_active Expired - Lifetime
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1999
- 1999-06-18 US US09/335,878 patent/US6291895B1/en not_active Expired - Lifetime
-
2001
- 2001-04-18 US US09/836,182 patent/US20010028101A1/en not_active Abandoned
Also Published As
Publication number | Publication date |
---|---|
US20010028101A1 (en) | 2001-10-11 |
JPH11243160A (ja) | 1999-09-07 |
US6291895B1 (en) | 2001-09-18 |
US5953592A (en) | 1999-09-14 |
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R350 | Written notification of registration of transfer |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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