JP2017092490A - 半導体装置 - Google Patents

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耕生 野田
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佑太 遠藤
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Abstract

【課題】酸化物半導体トランジスタを微細化する。また、微細化しても電気特性に優れ、
かつ信頼性が高い酸化物半導体トランジスタを提供する。
【解決手段】酸素放出可能な絶縁体によりフィン型の絶縁体を形成し、それを乗り越える
ように酸化物半導体の薄膜を設けた酸化物半導体トランジスタとする。またフィン型の絶
縁体に対し酸素添加処理により酸素を供給して、フィン型の絶縁体から酸化物半導体膜に
酸素をより放出しやすくする。同時に、フィン型の絶縁体の上面と側面の間に曲面を有し
た形状とする。
【選択図】図１

Description

本発明の一態様は、半導体装置および半導体装置の作製方法に関する。
絶縁表面を有する基板上に形成された半導体薄膜を用いてトランジスタ（薄膜トランジス
タともいう）を構成する技術が注目されている。
例えば、特許文献１にはトランジスタのチャネル形成領域に、インジウム（Ｉｎ）、ガリ
ウム（Ｇａ）、及び亜鉛（Ｚｎ）を含む非晶質酸化物半導体を用いたトランジスタが開示
されている。酸化物半導体はバンドギャップが広く、酸化物半導体をチャネル形成領域に
用いたトランジスタは非晶質シリコンを用いたトランジスタと比較して、電界効果移動度
を高くできる、オフ電流を低くできる等の多くの利点がある。
ところで、半導体装置の動作の高速化、低消費電力化、高集積化を達成するためにはトラ
ンジスタの微細化が必須である。
しかし、トランジスタの微細化に伴って、チャネル幅も縮小されるため、オン電流が低下
してしまう。これらの問題に対し、フィンのように形成された単結晶シリコンを包み込む
ようにゲート電極を形成することでチャネル形成領域が三次元構造を有するフィン型トラ
ンジスタが開発されている。
フィン型トランジスタでは、単結晶シリコンの上面だけでなく両側面にもゲート電極を設
け、チャネル形成領域としている。これによりトランジスタを微細化して半導体装置を高
集積化した場合でも、トランジスタのオン電流を高めることが可能となる。
特開２００６−１６５５２８号公報
しかしながら、酸化物半導体をフィンのように形成して一部をチャネル形成領域とし、フ
ィン型トランジスタに適用する場合、いくつかの重大な技術的問題が懸念される。
そこで本発明の一態様は、酸化物半導体をチャネル形成領域に用いたトランジスタを微細
化することを目的の一とする。また、微細化しても電気特性に優れ、かつ信頼性が高い酸
化物半導体トランジスタを提供することを目的の一とする。
上記の目的を解決するために本発明の一態様は、絶縁体をフィン型に形成して、それを乗
り越えるように酸化物半導体の薄膜を設けることとした。
本明細書等において、フィンとは、基板平面に対して隆起した部分をいう。例えばフィン
型の絶縁体の断面は、長方形、半円または逆さＵ字状等になる。また本明細書等において
、「乗り越える」と記載した場合、覆う、跨ぐ、または横切ると言い換えてもよい。
本発明の一態様は、絶縁表面上の、フィン型の絶縁体と、絶縁表面およびフィン型の絶縁
体と接し、フィン型の絶縁体を乗り越えるように設けられた酸化物半導体膜と、酸化物半
導体膜上のゲート絶縁膜と、ゲート絶縁膜上で、酸化物半導体膜と重畳し、フィン型の絶
縁体を乗り越えるように設けられているゲート電極と、を有し、フィン型の絶縁体の一方
向において、ゲート電極は酸化物半導体膜より長く、また酸化物半導体膜はフィン型の絶
縁体より長い、半導体装置である。
また、前述の一方向と直交する方向において、フィン型の絶縁体はゲート電極より長く、
フィン型の絶縁体は酸化物半導体膜より長くしてもよい。または、前述の一方向と直交す
る方向において、フィン型の絶縁体はゲート電極より長く、酸化物半導体膜はフィン型の
絶縁体より長くしてもよい。
酸化物半導体をフィン型トランジスタに適用する場合に懸念される問題の一つとして、チ
ャネル形成領域となる酸化物半導体層の厚さが、通常の薄膜トランジスタ、即ち、チャン
ネル形成領域が二次元平面に限られている場合と比較してはるかに大きくなるため、酸化
物半導体層中の酸素欠損を補償させることが難しくなることが挙げられる。
酸化物半導体膜を酸素放出可能な絶縁膜と接して形成することで、絶縁膜から放出された
酸素により、酸化物半導体膜中の酸素欠損を補償させることができる。特に酸化物半導体
が薄膜の場合は、酸化物半導体中の酸素の拡散係数が小さくとも、絶縁膜から十分に酸素
を供給することができる。
しかしフィン型トランジスタの場合は、酸化物半導体層の厚さが大きくなるため、絶縁膜
から十分に酸素が供給されない恐れがある。酸素が十分に供給されず、酸素欠損が残った
ままの酸化物半導体をチャネル領域に用いると、トランジスタのオフ電流が増大する恐れ
がある。
そこで、本発明の一態様のフィン型の絶縁体は、過剰酸素を含む絶縁体であることが好ま
しい。
また、絶縁表面は、フィン型の絶縁体よりも酸素の拡散係数が小さい絶縁体の表面である
ことが好ましい。また、フィン型の絶縁体は、フィン型の絶縁体の上面と側面の間に曲面
を有することが好ましい。
また、酸化物半導体をフィン型トランジスタに適用する場合に懸念される問題の他の一つ
として、酸化物半導体層の厚さが通常の薄膜トランジスタと比較して大きく、また、チャ
ンネル形成領域が三次元構造を有しているなるため、不純物をドーピングして均一に抵抗
値を下げることが難しくなることが挙げられる。
薄膜トランジスタの半導体中に形成されるソース領域およびドレイン領域の抵抗値を下げ
る手法として、半導体に不純物をドーピングする方法がある。
しかしフィン型酸化物半導体トランジスタのＳ値（サブスレッショルドスイング値）を小
さくするためにソース領域およびドレイン領域に不純物をドーピングする場合、ドーピン
グによる不純物は表面に偏在しやすいため、酸化物半導体の深さ方向に均一に抵抗を低下
させるのが難しい。
また、フィン型の絶縁体は、高さ（Ｈ）とチャネル長と垂直な方向の長さ、即ち幅（Ｗ）
の比Ｈ／Ｗが、０．５以上であることが好ましい。
また、本発明の別の一態様は、絶縁表面上に、フィン型の絶縁体を形成し、絶縁表面の上
面、ならびにフィン型の絶縁体の上面および側面と接する、酸化物半導体膜を形成し、酸
化物半導体膜上に、ゲート絶縁膜を形成し、ゲート絶縁膜上に、酸化物半導体膜と重畳し
、フィン型の絶縁体の上面および側面と重畳するゲート電極を形成する、半導体装置の作
製方法である。
また、絶縁表面上に、フィン型の絶縁体を形成した後、フィン型の絶縁体に対して加酸素
化処理を行うことで、フィン型の絶縁体に対して酸素を供給すると共に、フィン型の絶縁
体の上面と側面の間に曲面を有した形状に加工することが好ましい。
本発明の一態様により、酸化物半導体をチャネル形成領域に用いたトランジスタを微細化
することができる。また、微細化した場合でも電気特性に優れ、かつ信頼性が高い酸化物
半導体トランジスタを提供することができる。
トランジスタの一例を示す斜視図、上面図および断面図。 トランジスタの一例を示す斜視図、上面図および断面図。 トランジスタの一例を示す斜視図、上面図および断面図。 トランジスタの一例を示す斜視図、上面図および断面図。 トランジスタの一例を示す上面図および断面図。 トランジスタの一例を示す上面図および断面図。 トランジスタの一例を示す上面図および断面図。 トランジスタの一例を示す上面図および断面図。 トランジスタの作製工程の一例を示す断面図。 トランジスタの作製工程の一例を示す断面図。 トランジスタの作製工程の一例を示す断面図。 半導体装置の一例を示す断面図及び回路図。 半導体装置の一例を示す回路図および概念図。 半導体装置の一例を示す断面図及び回路図。 電子機器の例を示す図。
以下では、本発明の実施の形態について図面を用いて詳細に説明する。ただし、本発明は
以下の説明に限定されず、その形態および詳細を様々に変更し得ることは、当業者であれ
ば容易に理解される。また、本発明は以下に示す実施の形態の記載内容に限定して解釈さ
れるものではない。なお、図面を用いて発明の構成を説明するにあたり、同じものを指す
符号は異なる図面間でも共通して用いる。なお、同様のものを指す際にはハッチパターン
を同じくし、特に符号を付さない場合がある。
本明細書において、トランジスタのソースとドレインは、一方をドレインと呼ぶとき他方
をソースとする。すなわち、電位の高低によってそれらを区別しない。したがって、ソー
スとされている部分をドレインと読み替えることもできる。
なお、図面において、明示的にはソース電極層やドレイン電極層を有しない場合があるが
、便宜上、このような状態を含めてトランジスタと呼ぶ。また、この場合、トランジスタ
の接続関係を説明するために、ソース領域やドレイン領域を含めてソース電極層やドレイ
ン電極層と表現することがある。つまり、本明細書において、ソース電極層やドレイン電
極層との記載には、ソース領域やドレイン領域が含まれうる。
なお、第１、第２として付される序数詞は便宜上用いるものであり、工程順または積層順
を示すものではない。また、本明細書において発明を特定するための事項として固有の名
称を示すものではない。
（実施の形態１）
本実施の形態では、本発明の一態様に係るトランジスタの例について、図１乃至図４を用
いて説明する。
図１（Ａ）は本発明の一態様に係るトランジスタの一例である、トランジスタ２０１の斜
視図である。図１（Ｂ）はトランジスタ２０１の上面図である。図１（Ｃ）は図１（Ａ）
および（Ｂ）の一点鎖線Ａ−Ｂに対応する断面図である。図１（Ｄ）は図１（Ａ）および
（Ｂ）の一点鎖線Ｃ−Ｄに対応する断面図である。
トランジスタ２０１は、基板１００上の絶縁膜１０２と、絶縁膜１０２上のフィン型の絶
縁体１０４と、絶縁膜１０２およびフィン型の絶縁体１０４に接し、フィン型の絶縁体１
０４を乗り越えるように設けられた酸化物半導体膜１０６を有する。さらに酸化物半導体
膜１０６上のゲート絶縁膜１０８と、ゲート絶縁膜１０８上で酸化物半導体膜１０６と重
畳し、フィン型の絶縁体１０４を図中に矢印Ｘで示す方向（即ち、チャネル長方向に対し
て垂直な方向）に乗り越えるように設けられたゲート電極１１０を有する。また図中に矢
印Ｘで示す方向において、ゲート電極１１０は酸化物半導体膜１０６より長く、また酸化
物半導体膜１０６はフィン型の絶縁体１０４より長い。また矢印Ｘと直交する矢印Ｙで示
す方向（即ち、チャネル長方向）において、フィン型の絶縁体１０４はゲート電極１１０
より長く、フィン型の絶縁体１０４は酸化物半導体膜１０６より長い。
また酸化物半導体膜１０６は、チャネル形成領域１０６ａと、一対の低抵抗領域１０６ｂ
を有する。低抵抗領域１０６ｂは、トランジスタ２０１のソース領域およびドレイン領域
として機能する。
なお、図１（Ａ）および図１（Ｂ）では簡単のため、トランジスタ２０１の一部（ゲート
絶縁膜１０８、チャネル形成領域１０６ａ等）を省略している。
また図１（Ａ）、図１（Ｃ）および図１（Ｄ）ではフィン型の絶縁体１０４、酸化物半導
体膜１０６、ゲート電極１１０等の端部に傾斜をつけてもよい。言い換えれば、フィン型
の絶縁体１０４、酸化物半導体膜１０６、ゲート電極１１０等の端部はテーパー角を有し
てもよい。フィン型の絶縁体１０４、酸化物半導体膜１０６、ゲート電極１１０等の端部
がテーパー角を有することで、これらに積層して形成される膜の段切れを防止することが
できる。
基板１００として使用することができる基板に大きな制限はないが、少なくとも、後の熱
処理に耐えうる程度の耐熱性を有していることが必要となる。例えば、シリコンや炭化シ
リコンなどの単結晶半導体基板、多結晶半導体基板、シリコンゲルマニウムなどの化合物
半導体基板、ＳＯＩ基板などを適用することもできる。また、バリウムホウケイ酸ガラス
やアルミノホウケイ酸ガラスなどのガラス基板、セラミック基板、石英基板、サファイア
基板などを用いることができる。また基板１００として、可撓性基板を用いてもよい。
絶縁膜１０２としては、酸化シリコン、酸化窒化シリコン、酸化アルミニウム、酸化窒化
アルミニウム、酸化ハフニウム、酸化ガリウムなどの酸化物絶縁体、窒化シリコン、窒化
酸化シリコン、窒化アルミニウム、窒化酸化アルミニウムなどの窒化物絶縁体、又はこれ
らの混合材料を用いて形成することができる。特にフィン型の絶縁体１０４よりも酸素の
拡散係数が小さい膜が好ましい。中でも酸化アルミニウム膜は酸素の拡散係数が小さく、
また水素、水分などの不純物に対して膜を透過させない遮断効果（ブロック効果）が高い
ため好ましい。また、これらの化合物を単層構造または２層以上の積層構造で形成して用
いることができる。
なお、基板１００からの不純物の影響を無視できる場合は、絶縁膜１０２を形成しなくて
もよい。
フィン型の絶縁体１０４には、過剰酸素を含む材料を用いる。過剰酸素を含む材料とは、
化学量論的組成よりも酸素が多い材料をいう。具体的には、酸化シリコン、酸化ガリウム
、酸化アルミニウム、酸化窒化シリコン、酸化窒化アルミニウム、等を用いることができ
る。また、多くの過剰酸素をフィン型の絶縁体１０４に含ませたい場合には、イオン注入
法やイオンドーピング法やプラズマ処理によって酸素を添加する。
または、過剰酸素を含む材料とは、ＴＤＳ（Ｔｈｅｒｍａｌ Ｄｅｓｏｒｐｔｉｏｎ Ｓ
ｐｅｃｔｒｏｓｃｏｐｙ：昇温脱離ガス分光法）分析にて、基板を５２０℃まで加熱した
際の酸素原子に換算しての酸素の放出量が１．０×１０１８ｃｍ−３以上、または１．０
×１０２０ｃｍ−３以上である材料をいう。
ここで、ＴＤＳ分析にて、酸素の放出量の測定方法について、以下に説明する。
ＴＤＳ分析したときの気体の放出量は、イオン強度の積分値に比例する。このため、測定
したイオン強度の積分値と、標準試料の基準値との比により、気体の放出量を計算するこ
とができる。標準試料の基準値とは、所定の密度の原子を含む試料において、当該原子に
相当するイオン強度の積分値に対する当該原子の密度の割合である。
例えば、標準試料である所定の密度の水素を含むシリコンウェハのＴＤＳ分析結果、およ
び絶縁膜のＴＤＳ分析結果から、絶縁膜の酸素分子の放出量（ＮＯ２）は、数式１で求め
ることができる。ここで、ＴＤＳ分析で得られる質量数３２で検出されるガスの全てが酸
素分子由来と仮定する。質量数３２のものとしてほかにＣＨ３ＯＨがあるが、存在する可
能性が低いものとしてここでは考慮しない。また、酸素原子の同位体である質量数１７の
酸素原子および質量数１８の酸素原子を含む酸素分子についても、自然界における存在比
率が極微量であるため考慮しない。
ＮＯ２＝ＮＨ２／ＳＨ２×ＳＯ２×α （数式１）
ＮＨ２は、標準試料から脱離した水素分子を密度で換算した値である。ＳＨ２は、標準試
料をＴＤＳ分析したときのイオン強度の積分値である。ここで、標準試料の基準値を、Ｎ
Ｈ２／ＳＨ２とする。ＳＯ２は、絶縁膜をＴＤＳ分析したときのイオン強度の積分値であ
る。αは、ＴＤＳ分析におけるイオン強度に影響する係数である。数式１の詳細に関して
は、特開平６−２７５６９７公報を参照する。なお、上記絶縁膜の酸素の放出量は、例え
ば電子科学株式会社製の昇温脱離分析装置ＥＭＤ−ＷＡ１０００Ｓ／Ｗを用い、標準試料
として１×１０１６ａｔｏｍｓ／ｃｍ２の水素原子を含むシリコンウェハを用いることで
測定できる。
また、ＴＤＳ分析において、酸素の一部は酸素原子として検出される。酸素分子と酸素原
子の比率は、酸素分子のイオン化率から算出することができる。なお、上述のαは酸素分
子のイオン化率を含むため、酸素分子の放出量を評価することで、酸素原子の放出量につ
いて見積もることができる。
なお、ＮＯ２は酸素分子の放出量である。酸素原子に換算したときの放出量は、酸素分子
の放出量の２倍となる。
または、過剰酸素を含む材料とは、電子スピン共鳴（ＥＳＲ：Ｅｌｅｃｔｒｏｎ Ｓｐｉ
ｎ Ｒｅｓｏｎａｎｃｅ）にてｇ値が２．０１に信号が現れる材料をいう。
過剰酸素を含む材料の水素濃度が、７．２×１０２０ａｔｏｍｓ／ｃｍ３以上である場合
には、トランジスタの初期特性のバラツキの増大、トランジスタの電気特性に関するチャ
ネル長依存性の増大、さらにＢＴストレス試験などの外部環境によって大きく劣化するた
め、過剰酸素を含む材料の水素濃度は、７．２×１０２０ａｔｏｍｓ／ｃｍ３未満とする
。即ち、酸化物半導体膜の水素濃度は５×１０１９ａｔｏｍｓ／ｃｍ３以下、且つ、過剰
酸素を含む材料の水素濃度は、７．２×１０２０ａｔｏｍｓ／ｃｍ３未満とすることが好
ましい。
過剰酸素を含む材料からなるフィン型の絶縁体１０４に接して薄膜の酸化物半導体膜１０
６が設けられているため、厚いチャネル形成領域が要求される一般的なフィン型トランジ
スタと比較して、酸化物半導体膜１０６に十分に供給することができる。これにより、酸
化物半導体膜１０６において化学量論的組成とほぼ一致するような状態、または化学量論
的組成より酸素が多い状態とすることができる。例えば、酸化物半導体膜１０６がＩｎ−
Ｇａ−Ｚｎ系酸化物である場合、化学量論的組成の一例はＩｎ：Ｇａ：Ｚｎ：Ｏ＝１：１
：１：４［原子数比］であるため、酸素の原子数比が４以上含む状態となる。過剰酸素に
より酸化物半導体膜１０６中の酸素欠損を補償し、トランジスタの信頼性を向上させるこ
とができる。
さらにフィン型の絶縁体１０４を乗り越えるように酸化物半導体膜１０６およびゲート電
極１１０が設けられているため、酸化物半導体膜１０６およびゲート電極１１０を平面状
に設けた場合よりも、占有面積を増大させなくても、チャネル幅を大きくすることができ
る。さらに、フィン型の絶縁体１０４が設けられているためチャネル形成領域を薄く形成
することができる。このため、チャネル形成領域が厚い一般的なフィン型トランジスタの
場合よりも完全空乏化しやすい。そのためトランジスタのＳ値を小さくすることができ、
またオフ電流を低減することができる。
またフィン型の絶縁体１０４は、図１（Ｄ）に示す高さ（Ｈ）と、チャネル長方向と垂直
な方向の長さ、即ち幅（Ｗ）の比Ｈ／Ｗを、０．５以上とすることが好ましく、より好ま
しくは１以上、さらに好ましくは２以上とする。Ｗに対してＨを大きくすることで、トラ
ンジスタ２０１のチャネル幅をより大きくすることができ、トランジスタ２０１の占有面
積をより縮小することができる。
酸化物半導体膜１０６としては、例えば、Ｉｎ−Ｍ−Ｚｎ系酸化物材料を用いればよい。
ここで、金属元素Ｍは酸素との結合エネルギーがＩｎおよびＺｎよりも高い元素である。
または、Ｉｎ−Ｍ−Ｚｎ系酸化物材料から酸素が脱離することを抑制する機能を有する元
素である。金属元素Ｍの作用によって、酸化物半導体膜の酸素欠損の生成がある程度抑制
される。そのため、酸素欠損に起因するトランジスタの電気特性の変動を低減することが
でき、信頼性の高いトランジスタを得ることができる。
金属元素Ｍは、具体的にはＡｌ、Ｓｃ、Ｔｉ、Ｖ、Ｃｒ、Ｍｎ、Ｆｅ、Ｃｏ、Ｎｉ、Ｇｅ
、Ｙ、Ｚｒ、Ｎｂ、Ｍｏ、Ｓｎ、Ｌａ、Ｃｅ、Ｐｒ、Ｎｄ、Ｓｍ、Ｅｕ、Ｇｄ、Ｔｂ、Ｄ
ｙ、Ｈｏ、Ｅｒ、Ｔｍ、Ｙｂ、Ｌｕ、Ｈｆ、ＴａまたはＷとすればよく、好ましくはＡｌ
、Ｔｉ、Ｇａ、Ｙ、Ｚｒ、ＣｅまたはＨｆとする。金属元素Ｍは、前述の元素から一種ま
たは二種以上選択すればよい。また、金属元素Ｍの代わりにＧａまたはＳｉを用いても構
わない。
例えば、酸化物半導体として、酸化インジウム、酸化スズ、酸化亜鉛、二元系金属の酸化
物であるＩｎ−Ｚｎ系酸化物、Ｉｎ−Ｍｇ系酸化物、Ｉｎ−Ｇａ系酸化物、三元系金属の
酸化物であるＩｎ−Ｇａ−Ｚｎ系酸化物（ＩＧＺＯとも表記する）、Ｉｎ−Ａｌ−Ｚｎ系
酸化物、Ｉｎ−Ｓｎ−Ｚｎ系酸化物、Ｉｎ−Ｈｆ−Ｚｎ系酸化物、Ｉｎ−Ｌａ−Ｚｎ系酸
化物、Ｉｎ−Ｃｅ−Ｚｎ系酸化物、Ｉｎ−Ｐｒ−Ｚｎ系酸化物、Ｉｎ−Ｎｄ−Ｚｎ系酸化
物、Ｉｎ−Ｓｍ−Ｚｎ系酸化物、Ｉｎ−Ｅｕ−Ｚｎ系酸化物、Ｉｎ−Ｇｄ−Ｚｎ系酸化物
、Ｉｎ−Ｔｂ−Ｚｎ系酸化物、Ｉｎ−Ｄｙ−Ｚｎ系酸化物、Ｉｎ−Ｈｏ−Ｚｎ系酸化物、
Ｉｎ−Ｅｒ−Ｚｎ系酸化物、Ｉｎ−Ｔｍ−Ｚｎ系酸化物、Ｉｎ−Ｙｂ−Ｚｎ系酸化物、Ｉ
ｎ−Ｌｕ−Ｚｎ系酸化物、四元系金属の酸化物であるＩｎ−Ｓｎ−Ｇａ−Ｚｎ系酸化物、
Ｉｎ−Ｈｆ−Ｇａ−Ｚｎ系酸化物、Ｉｎ−Ａｌ−Ｇａ−Ｚｎ系酸化物、Ｉｎ−Ｓｎ−Ａｌ
−Ｚｎ系酸化物、Ｉｎ−Ｓｎ−Ｈｆ−Ｚｎ系酸化物、Ｉｎ−Ｈｆ−Ａｌ−Ｚｎ系酸化物を
用いることができる。
なお、ここで、例えば、Ｉｎ−Ｇａ−Ｚｎ系酸化物とは、ＩｎとＧａとＺｎを主成分とし
て有する酸化物という意味であり、ＩｎとＧａとＺｎの比率は問わない。また、ＩｎとＧ
ａとＺｎ以外の金属元素が入っていてもよい。
また、酸化物半導体として、ＩｎＭＯ３（ＺｎＯ）ｍ（ｍ＞０、且つ、ｍは整数でない）
で表記される材料を用いてもよい。なお、Ｍは、Ｇａ、Ｆｅ、Ｍｎ及びＣｏから選ばれた
一の金属元素又は複数の金属元素を示す。また、酸化物半導体として、Ｉｎ２ＳｎＯ５（
ＺｎＯ）ｎ（ｎ＞０、且つ、ｎは整数）で表記される材料を用いてもよい。
例えば、Ｉｎ：Ｇａ：Ｚｎ＝１：１：１、Ｉｎ：Ｇａ：Ｚｎ＝２：２：１、あるいはＩｎ
：Ｇａ：Ｚｎ＝３：１：２の原子数比のＩｎ−Ｇａ−Ｚｎ系酸化物やその組成の近傍の酸
化物を用いることができる。あるいは、Ｉｎ：Ｓｎ：Ｚｎ＝１：１：１、Ｉｎ：Ｓｎ：Ｚ
ｎ＝２：１：３あるいはＩｎ：Ｓｎ：Ｚｎ＝２：１：５の原子数比のＩｎ−Ｓｎ−Ｚｎ系
酸化物やその組成の近傍の酸化物を用いるとよい。
しかし、インジウムを含む酸化物半導体は、これらに限られず、必要とするトランジスタ
の電気特性（移動度、しきい値、ばらつき等）に応じて適切な組成のものを用いればよい
。また、必要とする電気特性を得るために、キャリア濃度や不純物濃度、欠陥密度、金属
元素と酸素の原子数比、原子間距離、密度等を適切なものとすることが好ましい。
例えば、Ｉｎ−Ｓｎ−Ｚｎ系酸化物では比較的容易に高い移動度が得られる。しかしなが
ら、Ｉｎ−Ｇａ−Ｚｎ系酸化物でも、バルク内欠陥密度を低くすることにより移動度を上
げることができる。
なお、例えば、Ｉｎ、Ｇａ、Ｚｎの原子数比がＩｎ：Ｇａ：Ｚｎ＝ａ：ｂ：ｃ（ａ＋ｂ＋
ｃ＝１）である酸化物の組成が、原子数比がＩｎ：Ｇａ：Ｚｎ＝Ａ：Ｂ：Ｃ（Ａ＋Ｂ＋Ｃ
＝１）の酸化物の組成の近傍であるとは、ａ、ｂ、ｃが、（ａ−Ａ）２＋（ｂ−Ｂ）２＋
（ｃ−Ｃ）２≦ｒ２を満たすことをいい、ｒは、例えば、０．０５とすればよい。他の酸
化物でも同様である。
酸化物半導体膜１０６は、単結晶、多結晶（ポリクリスタルともいう。）または非晶質な
どの状態をとる。
好ましくは、酸化物半導体膜１０６は、ＣＡＡＣ−ＯＳ（Ｃ Ａｘｉｓ Ａｌｉｇｎｅｄ
Ｃｒｙｓｔａｌｌｉｎｅ Ｏｘｉｄｅ Ｓｅｍｉｃｏｎｄｕｃｔｏｒ）膜とする。
ＣＡＡＣ−ＯＳ膜は、完全な単結晶ではなく、完全な非晶質でもない。ＣＡＡＣ−ＯＳ膜
は、非晶質相に結晶部を有する結晶−非晶質混相構造の酸化物半導体膜である。なお、当
該結晶部は、一辺が１００ｎｍ未満の立方体内に収まる大きさであることが多い。また、
透過型電子顕微鏡（ＴＥＭ：Ｔｒａｎｓｍｉｓｓｉｏｎ Ｅｌｅｃｔｒｏｎ Ｍｉｃｒｏ
ｓｃｏｐｅ）による観察像では、ＣＡＡＣ−ＯＳ膜に含まれる非晶質部と結晶部との境界
は明確ではない。また、ＴＥＭによってＣＡＡＣ−ＯＳ膜には粒界（グレインバウンダリ
ーともいう。）は確認できない。そのため、ＣＡＡＣ−ＯＳ膜は、粒界に起因する電子移
動度の低下が抑制される。
ＣＡＡＣ−ＯＳ膜に含まれる結晶部は、ｃ軸がＣＡＡＣ−ＯＳ膜の被形成面の法線ベクト
ルまたは表面の法線ベクトルに平行な方向に揃い、かつａｂ面に垂直な方向から見て三角
形状または六角形状の原子配列を有し、ｃ軸に垂直な方向から見て金属原子が層状または
金属原子と酸素原子とが層状に配列している。なお、異なる結晶部間で、それぞれａ軸お
よびｂ軸の向きが異なっていてもよい。本明細書において、単に垂直と記載する場合、８
５°以上９５°以下の範囲も含まれることとする。また、単に平行と記載する場合、−５
°以上５°以下の範囲も含まれることとする。
なお、ＣＡＡＣ−ＯＳ膜において、結晶部の分布が一様でなくてもよい。例えば、ＣＡＡ
Ｃ−ＯＳ膜の形成過程において、酸化物半導体膜の表面側から結晶成長させる場合、被形
成面の近傍に対し表面の近傍では結晶部の占める割合が高くなることがある。また、ＣＡ
ＡＣ−ＯＳ膜へ不純物を添加することにより、当該不純物添加領域において結晶部が非晶
質化することもある。
ＣＡＡＣ−ＯＳ膜に含まれる結晶部のｃ軸は、ＣＡＡＣ−ＯＳ膜の被形成面の法線ベクト
ルまたは表面の法線ベクトルに平行な方向に揃うため、ＣＡＡＣ−ＯＳ膜の形状（被形成
面の断面形状または表面の断面形状）によっては互いに異なる方向を向くことがある。な
お、結晶部のｃ軸の方向は、ＣＡＡＣ−ＯＳ膜が形成されたときの被形成面の法線ベクト
ルまたは表面の法線ベクトルに平行な方向となる。結晶部は、成膜時に、または成膜後に
熱処理などの結晶化処理を行うことにより形成される。
ＣＡＡＣ−ＯＳ膜を用いたトランジスタは、可視光や紫外光の照射による電気特性の変動
が小さい。よって、当該トランジスタは、信頼性が高い。
なお、酸化物半導体膜を構成する酸素の一部は窒素で置換されてもよい。
また、ＣＡＡＣ−ＯＳのように結晶部を有する酸化物半導体では、よりバルク内欠陥を低
減することができ、表面の平坦性を高めればアモルファス状態の酸化物半導体以上の移動
度を得ることができる。表面の平坦性を高めるためには、平坦な表面上に酸化物半導体を
形成することが好ましく、具体的には、平均面粗さ（Ｒａ）が１ｎｍ以下、好ましくは０
．３ｎｍ以下、より好ましくは０．１ｎｍ以下の表面上に形成するとよい。
なお、Ｒａは、ＪＩＳ Ｂ０６０１：２００１（ＩＳＯ４２８７：１９９７）で定義され
ている算術平均粗さを曲面に対して適用できるよう三次元に拡張したものであり、「基準
面から指定面までの偏差の絶対値を平均した値」で表現でき、以下の式にて定義される。
ここで指定面とは、粗さ計測の対象となる面であり、座標（ｘ１，ｙ１，ｆ（ｘ１，ｙ１
）），（ｘ１，ｙ２，ｆ（ｘ１，ｙ２）），（ｘ２，ｙ１，ｆ（ｘ２，ｙ１）），（ｘ２
，ｙ２，ｆ（ｘ２，ｙ２））の４点で表される四角形の領域とし、指定面をｘｙ平面に投
影した長方形の面積をＳ０、基準面の高さ（指定面の平均の高さ）をＺ０とする。Ｒａは
原子間力顕微鏡（ＡＦＭ：Ａｔｏｍｉｃ ＦｏｒｃｅＭｉｃｒｏｓｃｏｐｅ）にて測定可
能である。
酸化物半導体膜１０６の膜厚は、１ｎｍ以上３０ｎｍ以下（特に５ｎｍ以上１０ｎｍ以下
）とすることが好ましい。
ゲート絶縁膜１０８は、酸化シリコン膜、酸化ガリウム膜、酸化アルミニウム膜、窒化シ
リコン膜、酸化窒化シリコン膜、酸化窒化アルミニウム膜、または窒化酸化シリコン膜を
用いて形成することができる。
また、ゲート絶縁膜１０８の材料として酸化ハフニウム、酸化イットリウム、ハフニウム
シリケート（ＨｆＳｉｘＯｙ（ｘ＞０、ｙ＞０））、窒素が添加されたハフニウムシリケ
ート（ＨｆＳｉｘＯｙＮｚ（ｘ＞０、ｙ＞０、ｚ＞０））、ハフニウムアルミネート（Ｈ
ｆＡｌｘＯｙ（ｘ＞０、ｙ＞０））、酸化ランタンなどのｈｉｇｈ−ｋ材料を用いること
で、ゲートリーク電流を低減できる。さらにゲート絶縁膜１０８は、単層構造としても良
いし、積層構造としても良い。
また、ゲート絶縁膜１０８は、過剰酸素を含む絶縁層で構成されることが好ましい。ゲー
ト絶縁膜１０８が酸素を過剰に含むことで、酸化物半導体膜１０６に酸素を供給すること
ができる。
ゲート絶縁膜１０８の膜厚は、フィン型の絶縁体１０４の高さ（Ｈ）よりも小さいことが
好ましい。より好ましくはＨの二分の一以下、さらに好ましくはＨの三分の一以下とする
。ゲート絶縁膜１０８の膜厚をＨよりも小さくすることで、フィン型の絶縁体１０４の側
面に接する部分の酸化物半導体膜１０６にも十分に電界をかけることができる。
ゲート電極１１０は、モリブデン、チタン、タンタル、タングステン、アルミニウム、銅
、クロム、ネオジム、スカンジウム等の金属材料またはこれらを主成分とする合金材料を
用いて形成することができる。また、ゲート電極１１０としてリン等の不純物元素をドー
ピングした多結晶シリコン膜に代表される半導体膜、ニッケルシリサイドなどのシリサイ
ド膜を用いてもよい。ゲート電極１１０は、単層構造としてもよいし、積層構造としても
よい。
また、ゲート電極１１０は、酸化インジウム酸化スズ、酸化タングステンを含むインジウ
ム酸化物、酸化タングステンを含むインジウム亜鉛酸化物、酸化チタンを含むインジウム
酸化物、酸化チタンを含むインジウム錫酸化物、酸化インジウム酸化亜鉛、酸化ケイ素を
添加したインジウム錫酸化物などの導電性材料を用いて形成してもよい。また、上記導電
性材料と、上記金属材料の積層構造とすることもできる。
また、ゲート電極１１０として、窒素を含む金属酸化物、具体的には、窒素を含むＩｎ−
Ｇａ−Ｚｎ系酸化物膜や、窒素を含むＩｎ−Ｓｎ系酸化物膜や、窒素を含むＩｎ−Ｇａ系
酸化物膜や、窒素を含むＩｎ−Ｚｎ系酸化物膜や、窒素を含むＳｎ系酸化物膜や、窒素を
含むＩｎ系酸化物膜や、金属窒化膜（ＩｎＮ、ＳｎＮなど）を用いることができる。これ
らの膜は５ｅＶ以上、好ましくは５．５ｅＶ以上の仕事関数を有し、ゲート電極として用
いた場合、トランジスタの電気特性のしきい値電圧をプラスにすることができ、所謂ノー
マリーオフのスイッチング素子を実現できる。
なお、フィン型の絶縁体１０４を乗り越えるように設けられた酸化物半導体膜１０６は、
フィン型の絶縁体１０４の段差を乗り越えるように設けられた酸化物半導体膜１０６と言
い換えてもよい。同様にフィン型の絶縁体１０４の上面および側面と接する酸化物半導体
膜１０６と言い換えてもよい。
さらに、フィン型の絶縁体１０４を乗り越えるように設けられたゲート電極１１０は、フ
ィン型の絶縁体１０４の段差を乗り越えるように設けられたゲート電極１１０と言い換え
ても良い。同様にフィン型の絶縁体１０４の上面および側面と対向して設けられたゲート
電極１１０と言い換えてもよい。同様にフィン型の絶縁体１０４の上面および側面と重畳
するゲート電極１１０と言い換えてもよい。
上記構成のトランジスタ２０１とすることで、小面積でもオン特性の高いトランジスタと
することができる。また、酸化物半導体膜の酸素欠損を補償することで、信頼性の向上し
たトランジスタとすることができる。また、酸化物半導体をフィンのように形成して一部
をチャネル形成領域とするよりも、酸化物半導体膜を十分薄く形成できるため、トランジ
スタのチャネル形成領域を完全空乏化しやすい。そのため、Ｓ値が低く、オフ電流の低い
トランジスタとすることができる。
また、図１では１つのトランジスタ２０１を示したが、複数のトランジスタ２０１を連続
して作製してもよい。たとえば複数のトランジスタ２０１のゲート電極１１０を同一の導
電層で形成してもよい。または、あるトランジスタ２０１の一対の低抵抗領域１０６ｂを
、隣り合うもう一つのトランジスタ２０１の低抵抗領域１０６ｂと兼ねて用いてもよい。
さらに、複数のトランジスタ２０１を積層させてもよい。たとえばあるトランジスタ２０
１の上に層間膜を設け、層間膜の上にもう一つのトランジスタ２０１を形成してもよい。
図２（Ａ）は本発明の一態様に係るトランジスタの別の一例である、トランジスタ２０２
の斜視図である。図２（Ｂ）はトランジスタ２０２の上面図である。図２（Ｃ）は図２（
Ａ）および（Ｂ）の一点鎖線Ａ−Ｂに対応する断面図である。図２（Ｄ）は図２（Ａ）お
よび（Ｂ）の一点鎖線Ｃ−Ｄに対応する断面図である。
図１のトランジスタ２０１と、図２のトランジスタ２０２の主な相違点は、フィン型の絶
縁体１０４の上部の形状である。トランジスタ２０２のフィン型の絶縁体１０４は、上面
と側面の間に曲面を有している。これはトランジスタ２０２のフィン型の絶縁体１０４は
稜が曲線状である、断面形状が逆Ｕ字状または逆Ｖ字状である、上部側端が丸みを帯びて
いる、または上部が角丸の直方体である等と言い換えることもできる。
フィン型の絶縁体１０４を、上面と側面の間に曲面を有した形状とすることで、酸化物半
導体膜１０６、ゲート絶縁膜１０８およびゲート電極１１０の段切れを防止することがで
きる。また、電界集中を抑制することができるため、トランジスタ２０２の劣化を抑制で
きる。
トランジスタ２０２の他の構成要素は、図１およびトランジスタ２０１の記載を参酌する
ことができる。
図３（Ａ）は本発明の一態様に係るトランジスタの別の一例である、トランジスタ２０３
の斜視図である。図３（Ｂ）はトランジスタ２０３の上面図である。図３（Ｃ）は図３（
Ａ）および（Ｂ）の一点鎖線Ａ−Ｂに対応する断面図である。図３（Ｄ）は図３（Ａ）お
よび（Ｂ）の一点鎖線Ｃ−Ｄに対応する断面図である。
図１のトランジスタ２０１と、図３のトランジスタ２０３の主な相違点は、フィン型の絶
縁体１０４の矢印Ｙの方向の長さである。トランジスタ２０１のフィン型の絶縁体１０４
は、酸化物半導体膜１０６よりも矢印Ｙの方向（即ち、チャンネル長方向）について長い
のに対して、トランジスタ２０３のフィン型の絶縁体１０４は、酸化物半導体膜１０６よ
りも矢印Ｙの方向について短い。これは、トランジスタ２０３のフィン型の絶縁体１０４
は、酸化物半導体膜１０６よりもチャネル長方向について短いと言い換えてもよい。さら
にフィン型の絶縁体１０４を完全に覆うように酸化物半導体膜１０６が設けられていると
言い換えてもよい。
このようなフィン型の絶縁体１０４とすることで、フィン型の絶縁体１０４から放出され
た酸素をより効果的に酸化物半導体膜１０６に供給することができる。
トランジスタ２０３の他の構成要素は、図１およびトランジスタ２０１の記載を参酌する
ことができる。
図４（Ａ）は本発明の一態様に係るトランジスタの別の一例である、トランジスタ２０４
の斜視図である。図４（Ｂ）はトランジスタ２０４の上面図である。図４（Ｃ）は図４（
Ａ）および（Ｂ）の一点鎖線Ａ−Ｂに対応する断面図である。図４（Ｄ）は図４（Ａ）お
よび（Ｂ）の一点鎖線Ｃ−Ｄに対応する断面図である。
図１のトランジスタ２０１と、図４のトランジスタ２０４の主な相違点は、フィン型の絶
縁体１０４の上部の形状および矢印Ｙの方向の長さである。トランジスタ２０４のフィン
型の絶縁体１０４は、上面と側面の間に曲面を有した形状となっている。さらにトランジ
スタ２０１のフィン型の絶縁体１０４は、酸化物半導体膜１０６よりも矢印Ｙの方向（即
ち、チャンネル長方向）について長いのに対して、トランジスタ２０４のフィン型の絶縁
体１０４は、酸化物半導体膜１０６よりも矢印Ｙの方向について短い。これは、トランジ
スタ２０４のフィン型の絶縁体１０４は、酸化物半導体膜１０６よりもチャネル長方向に
ついて短いと言い換えてもよい。さらにフィン型の絶縁体１０４を完全に覆うように酸化
物半導体膜１０６が設けられていると言い換えてもよい。
このような形状のフィン型の絶縁体１０４とすることで、酸化物半導体膜１０６、ゲート
絶縁膜１０８およびゲート電極１１０の段切れを防止することが容易となる。さらにフィ
ン型の絶縁体１０４から放出された酸素をより効果的に酸化物半導体膜１０６に供給する
ことができる。
トランジスタ２０４の他の構成要素は、図１およびトランジスタ２０１の記載を参酌する
ことができる。
（実施の形態２）
本実施の形態では、本発明の一態様に係るトランジスタの別の一例について、図５乃至図
８を用いて説明する。
図５（Ａ）は本発明の一態様に係るトランジスタの別の一例である、トランジスタ２０５
の上面図である。図５（Ｂ）は図５（Ａ）の一点鎖線Ａ−Ｂに対応する断面図である。図
５（Ｃ）は図５（Ａ）の一点鎖線Ｃ−Ｄに対応する断面図である。
トランジスタ２０５は、基板１００上の絶縁膜１０２と、絶縁膜１０２上のフィン型の絶
縁体１０４と、絶縁膜１０２およびフィン型の絶縁体１０４に接し、フィン型の絶縁体１
０４を乗り越えるように設けられた酸化物半導体膜１０６を有する。さらに酸化物半導体
膜１０６上で電気的に接続されるソース電極またはドレイン電極１１２およびドレイン電
極またはソース電極１１３を有する。さらに酸化物半導体膜１０６上のゲート絶縁膜１０
８と、ゲート絶縁膜１０８上で酸化物半導体膜と重畳し、フィン型の絶縁体１０４を乗り
越えるように設けられたゲート電極１１０を有する。
トランジスタ２０５ではゲート電極１１０がソース電極またはドレイン電極１１２および
ドレイン電極またはソース電極１１３と重畳している。これによりソース抵抗およびドレ
イン抵抗を低減することができ、オン電流を大きくすることが可能となる。
なお、図５（Ａ）では簡単のため、トランジスタ２０５の一部（ゲート絶縁膜１０８、チ
ャネル形成領域１０６ａ等）を省略している。
トランジスタ２０５の他の構成要素は、図１およびトランジスタ２０１の記載を参酌する
ことができる。
図６（Ａ）は本発明の一態様に係るトランジスタの別の一例である、トランジスタ２０６
の上面図である。図６（Ｂ）は図６（Ａ）の一点鎖線Ａ−Ｂに対応する断面図である。図
６（Ｃ）は図６（Ａ）の一点鎖線Ｃ−Ｄに対応する断面図である。
図５のトランジスタ２０５と図６のトランジスタ２０６の主な相違点の一つは、ゲート電
極１１０の形状である。トランジスタ２０６ではゲート電極１１０と、ソース電極または
ドレイン電極１１２およびドレイン電極またはソース電極１１３は重畳していない。
またトランジスタ２０６の酸化物半導体膜１０６は、チャネル形成領域１０６ａを挟むよ
うに一対の低抵抗領域１０６ｃを有する。一対の低抵抗領域１０６ｃは、ゲート電極１１
０、ソース電極またはドレイン電極１１２およびドレイン電極またはソース電極１１３を
マスクとして、ゲート絶縁膜１０８を介して不純物を酸化物半導体膜１０６に添加するこ
とで形成することができる。なお図示しないが、酸化物半導体膜１０６は一対の低抵抗領
域１０６ｃを有さなくてもよい。
ゲート電極１１０と、ソース電極またはドレイン電極１１２およびドレイン電極またはソ
ース電極１１３は重畳せず、また一対の低抵抗領域１０６ｃを有する構造とすることで、
チャネル形成領域１０６ａの端の電界集中を防ぎ、チャネル形成領域１０６ａがホットキ
ャリアにより劣化することを防ぐことができる。そのためトランジスタ２０６の信頼性を
向上させることができる。
トランジスタ２０６の他の構成要素は、図５およびトランジスタ２０５の記載を参酌する
ことができる。
図７（Ａ）は本発明の一態様に係るトランジスタの別の一例である、トランジスタ２０７
の上面図である。図７（Ｂ）は図７（Ａ）の一点鎖線Ａ−Ｂに対応する断面図である。図
７（Ｃ）は図７（Ａ）の一点鎖線Ｃ−Ｄに対応する断面図である。
トランジスタ２０７は、基板１００上の絶縁膜１０２と、絶縁膜１０２上のフィン型の絶
縁体１０４と、ソース電極またはドレイン電極１１２およびドレイン電極またはソース電
極１１３を有する。さらに絶縁膜１０２およびフィン型の絶縁体１０４に接し、フィン型
の絶縁体１０４を乗り越えるように設けられ、ソース電極またはドレイン電極１１２およ
びドレイン電極またはソース電極１１３上で電気的に接続された酸化物半導体膜１０６を
有する。さらに酸化物半導体膜１０６上のゲート絶縁膜１０８と、ゲート絶縁膜１０８上
で酸化物半導体膜１０６と重畳し、フィン型の絶縁体１０４を乗り越えるように設けられ
たゲート電極１１０を有する。
トランジスタ２０７ではゲート電極１１０がソース電極またはドレイン電極１１２および
ドレイン電極またはソース電極１１３と重畳している。これにより酸化物半導体膜１０６
の広い領域をチャネル形成領域とすることができ、オン電流を大きくすることが可能とな
る。
なお、図７（Ａ）では簡単のため、トランジスタ２０７の一部（ゲート絶縁膜１０８、チ
ャネル形成領域１０６ａ等）を省略している。
トランジスタ２０７の他の構成要素は、図５およびトランジスタ２０５の記載を参酌する
ことができる。
図８（Ａ）は本発明の一態様に係るトランジスタの別の一例である、トランジスタ２０８
の上面図である。図８（Ｂ）は図８（Ａ）の一点鎖線Ａ−Ｂに対応する断面図である。図
８（Ｃ）は図８（Ａ）の一点鎖線Ｃ−Ｄに対応する断面図である。
図７のトランジスタ２０７と図８のトランジスタ２０８の主な相違点の一つは、ゲート電
極１１０の形状である。トランジスタ２０８ではゲート電極１１０と、ソース電極または
ドレイン電極１１２およびドレイン電極またはソース電極１１３は重畳していない。
また酸化物半導体膜１０６は、チャネル形成領域１０６ａを挟むように一対の低抵抗領域
１０６ｃを有していてもよい。一対の低抵抗領域１０６ｃは、ゲート電極１１０をマスク
として、ゲート絶縁膜１０８を介して不純物を酸化物半導体膜１０６に添加することで形
成することができる。
ゲート電極１１０と、ソース電極またはドレイン電極１１２およびドレイン電極またはソ
ース電極１１３は重畳せず、また一対の低抵抗領域１０６ｃを有する構造とすることで、
チャネル形成領域１０６ａの端の電界集中を防ぎ、チャネル形成領域１０６ａがホットキ
ャリアにより劣化することを防ぐことができる。そのためトランジスタ２０８の信頼性を
向上させることができる。
トランジスタ２０８の他の構成要素は、図６およびトランジスタ２０６の記載を参酌する
ことができる。
本実施の形態は、他の実施の形態と組み合わせて用いることができる。
（実施の形態３）
本実施の形態では、本発明の一態様に係るトランジスタの作製方法の例について、図９乃
至図１１を用いて説明する。
まず、図１に示すトランジスタ２０１の作製方法について、図９および図１０を用いて説
明する。図９および図１０では、左に図１（Ｂ）の一点鎖線Ａ−Ｂに対応する断面図、右
に図１（Ｂ）の一点鎖線Ｃ−Ｄに対応する断面図を示す。
まず基板１００を用意する。可撓性を有する半導体装置を作製する場合は、可撓性基板上
にトランジスタ２０１を直接作製してもよいし、他の作製基板にトランジスタ２０１を作
製し、その後可撓性基板に剥離、転置してもよい。なお、作製基板から可撓性基板に剥離
、転置するために、作製基板とトランジスタ２０１との間に剥離層を設けるとよい。
基板１００（又は基板１００及び絶縁膜１０２等）に熱処理を行ってもよい。例えば、高
温のガスを用いて熱処理を行うＧＲＴＡ（Ｇａｓ Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎ
ｅａｌ）装置により、６５０℃、１分〜５分間、熱処理を行えばよい。なお、ＧＲＴＡに
おける高温のガスには、アルゴンなどの希ガス、または窒素のような、熱処理によって被
処理物と反応しない不活性気体が用いられる。また、電気炉により、５００℃、３０分〜
１時間、熱処理を行ってもよい。
次に、基板１００上に絶縁膜１０２を形成する（図９（Ａ）参照）。絶縁膜１０２の膜厚
は、１０ｎｍ以上３００ｎｍ以下とし、スパッタリング法、ＣＶＤ法、塗布法などで形成
することができる。なお、基板１００からの不純物の影響を無視できる場合などは、絶縁
膜１０２を形成しなくてもよい。
本実施の形態では、絶縁膜１０２として、スパッタリング法により膜厚５０ｎｍの酸化ア
ルミニウム膜を形成することとする。
なお、基板１００および絶縁膜１０２に熱処理による脱水化又は脱水素化処理を行うこと
が好ましい。
熱処理の温度は、３００℃以上７００℃以下、または基板の歪み点未満とする。熱処理の
温度は、絶縁膜１０２の成膜温度より高い方が、脱水化または脱水素化の効果が高いため
好ましい。例えば、熱処理装置の一つである電気炉に基板を導入し、基板１００および絶
縁膜１０２に対して減圧下４５０℃において１時間の熱処理を行う。なお本明細書におい
て、減圧とは１０Ｐａ以下をいう。
なお、熱処理装置は電気炉に限られず、抵抗発熱体などの発熱体からの熱伝導または熱輻
射によって、被処理物を加熱する装置を用いてもよい。例えば、ＧＲＴＡ装置、ＬＲＴＡ
（Ｌａｍｐ Ｒａｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌｉｎｇ）装置等のＲＴＡ（Ｒａ
ｐｉｄ Ｔｈｅｒｍａｌ Ａｎｎｅａｌｉｎｇ）装置を用いることができる。ＬＲＴＡ装
置は、ハロゲンランプ、メタルハライドランプ、キセノンアークランプ、カーボンアーク
ランプ、高圧ナトリウムランプ、高圧水銀ランプなどのランプから発する光（電磁波）の
輻射により、被処理物を加熱する装置である。
例えば、熱処理として、６５０℃〜７００℃の高温に加熱した不活性ガス中に基板を入れ
、数分間加熱した後、基板を不活性ガス中から出すＧＲＴＡを行ってもよい。
熱処理は、減圧下、窒素雰囲気下、又は希ガス雰囲気下で行えばよい。また、上記窒素、
または希ガス等の雰囲気に水、水素などが含まれないことが好ましい。また、熱処理装置
に導入する窒素、または希ガスの純度を、６Ｎ（９９．９９９９％）以上好ましくは７Ｎ
（９９．９９９９９％）以上（即ち不純物濃度を１ｐｐｍ以下、好ましくは０．１ｐｐｍ
以下）とすることが好ましい。
次に、絶縁膜１０２上に絶縁層１０３を形成する（図９（Ｂ）参照）。絶縁層１０３の膜
厚は、１０ｎｍ以上１０００ｎｍ以下とし、成膜ガスを用いたＣＶＤ法を用いることがで
きる。ＣＶＤ法としては、ＬＰＣＶＤ法、プラズマＣＶＤ法などを用いることができ、ま
た他の方法としては、スパッタリング法、塗布法なども用いることができる。
次に、絶縁層１０３をエッチングにより加工してフィン型の絶縁体１０４を形成する（図
９（Ｃ）参照）。
次に、フィン型の絶縁体１０４に熱処理による脱水化又は脱水素化処理を行ってもよい。
フィン型の絶縁体１０４に行う熱処理による脱水化又は脱水素化処理の方法は、基板１０
０および絶縁膜１０２に行う同処理を参酌することができる。
熱処理によって、フィン型の絶縁体１０４の脱水化または脱水素化を行うことができ、ト
ランジスタの特性変動を引き起こす水素、又は水などの不純物が排除されたフィン型の絶
縁体１０４を形成することができる。
また、フィン型の絶縁体１０４に形成する前の絶縁層１０３に、熱処理による脱水化又は
脱水素化処理を行っても良い。
次に、絶縁膜１０２よびフィン型の絶縁体１０４上に、酸化物半導体膜１０５を形成する
（図９（Ｄ）参照）。なお、本実施の形態では、酸化物半導体膜１０５は島状に形成され
る前の酸化物半導体膜であり、完成したトランジスタ２０１に含まれる酸化物半導体膜１
０６は島状に形成された酸化物半導体膜である。
なお、酸化物半導体膜１０５は、成膜時に酸素が多く含まれるような条件（例えば、酸素
１００％の雰囲気下でスパッタリング法により成膜を行うなど）で成膜して、酸素を多く
含む（好ましくは酸化物半導体が結晶状態における化学量論的組成に対し、酸素の含有量
が過剰な領域が含まれている）膜とすることが好ましい。
なお、本実施の形態において、酸化物半導体膜１０５として、ＡＣ電源装置を有するスパ
ッタリング装置を用いたスパッタリング法を用い、膜厚３５ｎｍのＩｎ−Ｇａ−Ｚｎ系酸
化物膜（ＩＧＺＯ膜）を成膜する。本実施の形態において、Ｉｎ：Ｇａ：Ｚｎ＝１：１：
１の原子比のＩｎ−Ｇａ−Ｚｎ系酸化物ターゲットを用いる。なお、成膜条件は、酸素及
びアルゴン雰囲気下（酸素流量比率５０％）、圧力０．６Ｐａ、電源電力５ｋＷ、基板温
度１７０℃とする。この成膜条件での成膜速度は、１６ｎｍ／ｍｉｎである。
酸化物半導体膜１０５を、成膜する際に用いるスパッタリングガスは水素、水、水酸基を
有する化合物、又は水素化物などの不純物が除去された高純度ガスを用いることが好まし
い。
減圧状態に保持された成膜室内に基板を保持する。そして、成膜室内の残留水分を除去し
つつ水素及び水分が除去されたスパッタガスを導入し、上記ターゲットを用いて基板１０
０上に酸化物半導体膜１０５を成膜する。成膜室内の残留水分を除去するためには、吸着
型の真空ポンプ、例えば、クライオポンプ、イオンポンプ、チタンサブリメーションポン
プを用いることが好ましい。また、排気手段としては、ターボ分子ポンプにコールドトラ
ップを加えたものであってもよい。クライオポンプを用いて排気した成膜室は、例えば、
水素（水素原子）、水（Ｈ２Ｏ）など水素（水素原子）を含む化合物（より好ましくは炭
素原子を含む化合物も）等が効率的に排気されるため、当該成膜室で成膜した酸化物半導
体膜１０５に含まれる不純物の濃度を低減できる。
また、フィン型の絶縁体１０４を大気に解放せずにフィン型の絶縁体１０４と酸化物半導
体膜１０５を連続的に形成することが好ましい。フィン型の絶縁体１０４を大気に曝露せ
ずにフィン型の絶縁体１０４と酸化物半導体膜１０５を連続して形成すると、フィン型の
絶縁体１０４表面に水素や水分などの不純物が吸着することを防止することができる。
続いて、酸化物半導体膜１０５及びフィン型の絶縁体１０４に酸素添加処理を行い、酸素
を過剰に含む酸化物半導体膜１０５及びフィン型の絶縁体１０４を形成することが好まし
い。酸素添加処理を行うことにより、酸化物半導体膜１０５及びフィン型の絶縁体１０４
中、および／又は該界面近傍に酸素を含有させることができる。
添加される酸素（酸素ラジカル、酸素原子、酸素分子、オゾン、酸素イオン（酸素分子イ
オン）、及び／又は酸素クラスタイオン）は、イオン注入法、イオンドーピング法、プラ
ズマイマージョンイオンインプランテーション法、プラズマ処理などを用いることができ
る。また、イオン注入法にはガスクラスタイオンビームを用いてもよい。酸素の添加処理
は、全面を一度に行ってもよいし、線状のイオンビーム等を用いて移動（スキャン）させ
行ってもよい。
例えば、添加される酸素（酸素ラジカル、酸素原子、酸素分子、オゾン、酸素イオン（酸
素分子イオン）、及び／又は酸素クラスタイオン）は、酸素を含むガスを用いてプラズマ
発生装置により供給されてもよいし、又はオゾン発生装置により供給されてもよい。より
具体的には、例えば、半導体装置に対してエッチング処理を行うための装置や、レジスト
マスクに対してアッシングを行うための装置などを用いて酸素を発生させ、酸化物半導体
膜１０５及びフィン型の絶縁体１０４を処理することができる。
酸素添加処理には、酸素を含むガスを用いることができる。酸素を含むガスとしては、酸
素、一酸化二窒素、二酸化窒素、二酸化炭素、一酸化炭素などを用いることができる。ま
た、酸素添加処理は、希ガス存在下で行ってもよい。
酸素添加処理は、例えば、イオン注入法で酸素イオンの注入を行う場合、ドーズ量を１×
１０１３ｉｏｎｓ／ｃｍ２以上５×１０１６ｉｏｎｓ／ｃｍ２以下とすればよい。
酸化物半導体膜１０５と接するフィン型の絶縁体１０４が、酸素の供給源となる酸素を多
く（過剰に）含むので、該フィン型の絶縁体１０４から酸化物半導体膜１０５へ酸素を供
給することができる。
フィン型の絶縁体１０４から酸化物半導体膜１０５へ酸素を供給する方法としては、酸化
物半導体膜１０５とフィン型の絶縁体１０４とを接した状態で熱処理を行う。熱処理によ
ってフィン型の絶縁体１０４から酸化物半導体膜１０５への酸素の供給を効果的に行うこ
とができる。
なお、フィン型の絶縁体１０４から酸化物半導体膜１０５への酸素の供給のための熱処理
を、酸化物半導体膜１０５が島状に加工される前に行うことで、フィン型の絶縁体１０４
に含まれる酸素が効果的に酸化物半導体膜１０５に供給されるため好ましい。
酸化物半導体膜１０５へ酸素を供給することにより、酸化物半導体膜１０５中の酸素欠損
を補填することができる。
次に、酸化物半導体膜１０５をエッチングにより島状に加工して酸化物半導体膜１０６を
形成する（図１０（Ａ）参照）。なお、酸化物半導体膜１０５のエッチングは、ドライエ
ッチングでもウェットエッチングでもよく、両方を用いてもよい。例えば、酸化物半導体
膜１０５のウェットエッチングに用いるエッチング液としては、燐酸と酢酸と硝酸を混ぜ
た溶液などを用いることができる。また、ＩＴＯ−０７Ｎ（関東化学社製）を用いてもよ
い。また、ＩＣＰ（Ｉｎｄｕｃｔｉｖｅｌｙ Ｃｏｕｐｌｅｄ Ｐｌａｓｍａ：誘導結合
型プラズマ）エッチング法によるドライエッチングによってエッチング加工してもよい。
次に、酸化物半導体膜１０６上にゲート絶縁膜１０８を形成する（図１０（Ｂ）参照）。
ゲート絶縁膜１０８の膜厚は０．５ｎｍ以上１００ｎｍ以下とする。ゲート絶縁膜１０８
の形成方法は絶縁層１０３の形成方法を参酌することができる。
なお、ゲート絶縁膜１０８に熱処理による脱水化又は脱水素化処理を行うことが好ましい
。熱処理によって、ゲート絶縁膜１０８の脱水化または脱水素化を行うことができ、トラ
ンジスタの特性変動を引き起こす水素、又は水などの不純物が排除されたゲート絶縁膜１
０８を形成することができる。
ゲート絶縁膜１０８に行う熱処理による脱水化又は脱水素化処理の方法は、基板１００お
よび絶縁膜１０２に行う同処理を参酌することができる。
ゲート絶縁膜１０８に熱処理による脱水化又は脱水素化処理を行ってから、さらに、ゲー
ト絶縁膜１０８に酸素添加処理を行った後、熱処理を行ってゲート絶縁膜１０８から酸化
物半導体膜１０６に酸素を供給することが好ましい。酸化物半導体膜１０６へ酸素を供給
することにより、酸化物半導体膜１０６中の酸素欠損を補填することができる。
ゲート絶縁膜１０８に行う酸素添加処理および熱処理の方法は、フィン型の絶縁体１０４
から酸化物半導体膜１０５に行う同処理を参酌することができる。
次に、ゲート絶縁膜１０８上に、フィン型の絶縁体１０４を乗り越えるようにゲート電極
１１０を設ける（図１０（Ｃ）参照）。ゲート電極１１０は、ゲート絶縁膜１０８上に導
電層を形成し、該導電層をエッチングにより加工することで形成することができる。
なお、ゲート絶縁膜１０８に行う酸素添加処理および熱処理は、ゲート電極１１０形成後
に行っても良い。
次に、ゲート電極１１０をマスクとして酸化物半導体膜１０６にドーパントを導入し、酸
化物半導体膜１０６に一対の低抵抗領域１０６ｂを形成する（図１０（Ｄ）参照）。図１
０（Ｄ）図中の矢印はドーパントを示す。
ドーパントは、酸化物半導体膜１０６の導電率を変化させる不純物である。ドーパントと
しては、１５族元素（代表的には窒素（Ｎ）、リン（Ｐ）、砒素（Ａｓ）、およびアンチ
モン（Ｓｂ））、ホウ素（Ｂ）、アルミニウム（Ａｌ）、アルゴン（Ａｒ）、ヘリウム（
Ｈｅ）、ネオン（Ｎｅ）、インジウム（Ｉｎ）、フッ素（Ｆ）、塩素（Ｃｌ）、チタン（
Ｔｉ）、及び亜鉛（Ｚｎ）のいずれかから選択される一以上を用いることができる。
ドーパントは、注入法により、他の膜（例えばゲート絶縁膜１０８）を通過して、酸化物
半導体膜１０６に導入することができる。ドーパントの導入方法としては、イオン注入法
、イオンドーピング法、プラズマイマージョンイオンインプランテーション法などを用い
ることができる。その際には、ドーパントの単体のイオンあるいはフッ化物、塩化物のイ
オンを用いると好ましい。
ドーパントの導入工程は、加速電圧、ドーズ量などの注入条件、また通過させる膜の膜厚
を適宜設定して制御すればよい。たとえばドーパントのドーズ量は１×１０１３ｉｏｎｓ
／ｃｍ２以上５×１０１６ｉｏｎｓ／ｃｍ２以下とすることができる。
低抵抗領域におけるドーパントの濃度は、５×１０１８／ｃｍ３以上１×１０２２／ｃｍ
３以下であることが好ましい。
本実施の形態では、イオン注入法により酸化物半導体膜１０６に、リンイオンを注入する
こととする。またリンイオンの注入条件は加速電圧３０ｋＶ、ドーズ量を１．０×１０１
５ｉｏｎｓ／ｃｍ２とする。
ドーパントを導入する際に、基板１００を加熱しながら行ってもよい。
なお、酸化物半導体膜１０６にドーパントを導入する処理は、複数回行ってもよく、ドー
パントの種類も複数種用いてもよい。
また、ドーパントの導入処理後、熱処理を行ってもよい。加熱条件としては、温度３００
℃以上７００℃以下、好ましくは３００℃以上４５０℃以下で１時間、酸素雰囲気下で行
うことが好ましい。また、窒素雰囲気下、減圧下、大気（超乾燥エア）下で熱処理を行っ
てもよい。またドーパント導入処理後の熱処理は、図１０（Ａ）および図１０（Ｂ）にお
いて行うことのできる酸素添加処理後の熱処理と兼ねて行ってもよい。
酸化物半導体膜１０６をＣＡＡＣ−ＯＳ膜とした場合、ドーパントの導入により、一部非
晶質化する場合がある。この場合、ドーパントの導入後に加熱処理を行うことによって、
酸化物半導体膜１０６の結晶性を回復することができる。
このようにして酸化物半導体膜１０６に、チャネル形成領域１０６ａを挟んだ一対の低抵
抗領域１０６ｂを形成することができる。
次に、図２乃至図４に示すトランジスタ２０２乃至トランジスタ２０４の作製方法につい
て、図１１を用いて説明する。
図１１（Ａ）では、左に図２（Ｂ）のトランジスタ２０２の一点鎖線Ａ−Ｂに対応する断
面図を示し、右に一点鎖線Ｃ−Ｄに対応する断面図を示す。
トランジスタ２０１の作製方法と、トランジスタ２０２の作製方法の主な相違点は、トラ
ンジスタ２０２では、フィン型の絶縁体１０４の上面と側面の間に曲面を有した形状に形
成している点である。
トランジスタ２０２の作製方法としてはまず、トランジスタ２０１と同様に、基板１００
上に絶縁膜１０２、絶縁層１０３を形成し、絶縁層１０３をエッチングにより加工してフ
ィン型の絶縁体１０４を形成する。
次に、フィン型の絶縁体１０４に酸素添加処理を行う。該酸素添加処理としては、酸素プ
ラズマ処理、酸素イオンインプランテーション処理、酸素ドーピング処理、アッシング処
理等により行うことができる。
酸素添加処理を行うことで、フィン型の絶縁体１０４の上面と側面の間に曲面を有した形
状とすると共に、フィン型の絶縁体１０４に酸素を添加することができる。
フィン型の絶縁体１０４の上面と側面の間に曲面を有した形状とすることで、酸化物半導
体膜１０６、ゲート絶縁膜１０８およびゲート電極１１０の段切れを防止することが容易
となる。またフィン型の絶縁体１０４に酸素を添加することで、フィン型の絶縁体１０４
から酸化物半導体膜１０５へ酸素を供給することができる。
トランジスタ２０２の他の要素の作製方法は、図９および図１０ならびにトランジスタ２
０１の作製方法の記載を参酌することができる。
図１１（Ｂ）では、左に図３（Ｂ）のトランジスタ２０３の一点鎖線Ａ−Ｂに対応する断
面図を示し、右に一点鎖線Ｃ−Ｄに対応する断面図を示す。
トランジスタ２０１の作製方法と、トランジスタ２０３の作製方法の主な相違点は、トラ
ンジスタ２０３では、フィン型の絶縁体１０４を、酸化物半導体膜１０６よりも矢印Ｙの
方向（即ち、チャネル長方向）について短く形成している点である。
これはフィン型の絶縁体１０４を形成する際のマスクを変更することで、上記のような形
状に絶縁層１０３を加工することができる。
フィン型の絶縁体１０４を、酸化物半導体膜１０６よりも矢印Ｙの方向について短く形成
することで、フィン型の絶縁体１０４から放出される酸素を効率的に酸化物半導体膜１０
６に供給することができる。
トランジスタ２０３の他の要素の作製方法は、図９および図１０ならびにトランジスタ２
０１の作製方法の記載を参酌することができる。
図１１（Ｃ）では、左に図４（Ｂ）のトランジスタ２０４一点鎖線Ａ−Ｂに対応する断面
図を示し、右に一点鎖線Ｃ−Ｄに対応する断面図を示す。
トランジスタ２０１の作製方法と、トランジスタ２０４の作製方法の主な相違点は、トラ
ンジスタ２０４では、フィン型の絶縁体１０４を、酸化物半導体膜１０６よりも矢印Ｙの
方向（即ち、チャネル長方向）について短く形成し、かつ上面と側面の間に曲面を有した
形状に形成している点である。
これはトランジスタ２０２およびトランジスタ２０３と同様に、フィン型の絶縁体１０４
に酸素添加処理を行い、かつフィン型の絶縁体１０４を形成する際のマスクを変更するこ
とで、上記のような形状に絶縁層１０３を加工することができる。
フィン型の絶縁体１０４の上面と側面の間に曲面を有した形状とすることで、酸化物半導
体膜１０６、ゲート絶縁膜１０８およびゲート電極１１０の段切れを防止することができ
る。またフィン型の絶縁体１０４に酸素を添加することで、フィン型の絶縁体１０４から
酸化物半導体膜１０５へ酸素を供給することができる。
またフィン型の絶縁体１０４を、酸化物半導体膜１０６よりも矢印Ｙの方向について短く
形成することで、フィン型の絶縁体１０４から放出される酸素を効果的に酸化物半導体膜
１０６に供給することができる。
トランジスタ２０４の他の要素の作製方法は、図９および図１０ならびにトランジスタ２
０１の作製方法の記載を参酌することができる。
図５乃至図８に示すトランジスタ２０５乃至トランジスタ２０８の作製方法は、トランジ
スタ２０１の作製方法を参酌することができる。
（実施の形態４）
本実施の形態では、本明細書に示すトランジスタを使用し、電力が供給されない状況でも
記憶内容の保持が可能で、かつ、書き込み回数にも制限が無い半導体装置（記憶装置）の
一例を、図面を用いて説明する。
図１２は、半導体装置の構成の一例である。図１２（Ａ）に、半導体装置の断面図を、図
１２（Ｂ）に半導体装置の回路図をそれぞれ示す。
図１２（Ａ）及び図１２（Ｂ）に示す半導体装置は、下部に第１の半導体材料を用いたト
ランジスタ３２００を有し、上部に第２の半導体材料を用いたトランジスタ３２０２を有
するものである。トランジスタ３２０２としては、実施の形態１で示すトランジスタ２０
１の構造を適用する例である。
ここで、第１の半導体材料と第２の半導体材料は異なる禁制帯幅を持つ材料とすることが
望ましい。例えば、第１の半導体材料を酸化物半導体以外の半導体材料（シリコンなど）
とし、第２の半導体材料を酸化物半導体とすることができる。酸化物半導体以外の材料を
用いたトランジスタは、高速動作が可能である。一方で、実施の形態１または実施の形態
２で示した酸化物半導体を用いたトランジスタは、その特性により長時間の電荷保持を可
能とする。
なお、上記トランジスタは、ｎチャネル型トランジスタとｐチャネル型トランジスタのど
ちらを用いても構わない。また、情報を保持するために酸化物半導体を用いた実施の形態
１および実施の形態２に示すようなトランジスタを用いる他は、半導体装置に用いられる
材料や半導体装置の構造など、半導体装置の具体的な構成をここで示すものに限定する必
要はない。
図１２（Ａ）におけるトランジスタ３２００は、半導体材料（例えば、シリコンなど）を
含む基板３０００に設けられたチャネル形成領域と、チャネル形成領域を挟むように設け
られた不純物元素領域と、不純物元素領域に接する金属間化合物領域と、チャネル形成領
域上に設けられたゲート絶縁膜と、ゲート絶縁膜上に設けられたゲート電極層と、を有す
る。
基板３０００上にはトランジスタ３２００を囲むように素子分離絶縁層３１０６が設けら
れており、トランジスタ３２００を覆うように絶縁層３２２０が設けられている。
単結晶半導体基板を用いたトランジスタ３２００は、高速動作が可能である。このため、
当該トランジスタを読み出し用のトランジスタとして用いることで、情報の読み出しを高
速に行うことができる。トランジスタ３２０２および容量素子３２０４の形成前の処理と
して、トランジスタ３２００を覆う絶縁層３２２０にＣＭＰ処理を施して、絶縁層３２２
０を平坦化すると同時にトランジスタ３２００のゲート電極層の上面を露出させる。
図１２（Ａ）に示すトランジスタ３２０２は、酸化物半導体をチャネル形成領域に用いた
ボトムゲート型トランジスタである。ここで、トランジスタ３２０２に含まれる酸化物半
導体膜は、高純度化されたものであることが望ましい。即ち、実施の形態３で示したよう
に、酸化物半導体膜は不純物を可能な限り含まず、且つ酸素欠損が極めて少ないことが望
ましい。高純度化された酸化物半導体を用いることで、極めて優れたオフ特性のトランジ
スタ３２０２を得ることができる。
トランジスタ３２０２は、オフ電流が小さいため、これを用いることにより長期にわたり
記憶内容を保持することが可能である。つまり、リフレッシュ動作を必要としない、或い
は、リフレッシュ動作の頻度が極めて少ない半導体装置とすることが可能となるため、消
費電力を十分に低減することができる。
トランジスタ３２０２のソース電極層又はドレイン電極層の一方は、トランジスタ３２０
０のゲート電極層と電気的に接続されている。
また、電極３２０８と、トランジスタ３２０２のソース電極層またはドレイン電極層の一
方とによって、容量素子３２０４が構成される。すなわち、電極３２０８は容量素子３２
０４の一方の電極として機能し、トランジスタ３２０２のソース電極層またはドレイン電
極層の一方は容量素子３２０４の他方の電極として機能する。なお、容量が不要の場合に
は、容量素子３２０４を設けない構成とすることもできる。また、容量素子３２０４は、
別途、トランジスタ３２０２の上方に設けてもよい。
図１２（Ａ）において、トランジスタ３２０２及び容量素子３２０４が、トランジスタ３
２００の少なくとも一部と重畳するように設けられている。例えば、容量素子３２０４の
電極３２０８は、トランジスタ３２００のゲート電極層と少なくとも一部が重畳して設け
られている。このような平面レイアウトを採用することにより、半導体装置の占有面積の
低減を図ることができるため、高集積化を図ることができる。
図１２（Ａ）に対応する回路構成の一例を図１２（Ｂ）に示す。
図１２（Ｂ）において、第１の配線（１ｓｔ Ｌｉｎｅ）とトランジスタ３２００のソー
ス電極層とは、電気的に接続され、第２の配線（２ｎｄ Ｌｉｎｅ）とトランジスタ３２
００のドレイン電極層とは、電気的に接続されている。また、第３の配線（３ｒｄ Ｌｉ
ｎｅ）とトランジスタ３２０２のソース電極層またはドレイン電極層の他方とは、電気的
に接続され、第４の配線（４ｔｈ Ｌｉｎｅ）と、トランジスタ３２０２のゲート電極層
とは、電気的に接続されている。そして、トランジスタ３２００のゲート電極層と、トラ
ンジスタ３２０２のソース電極層またはドレイン電極層の一方は、容量素子３２０４の電
極の他方と電気的に接続され、第５の配線（５ｔｈ Ｌｉｎｅ）と、容量素子３２０４の
電極の一方は電気的に接続されている。
図１２（Ｂ）に示す半導体装置では、トランジスタ３２００のゲート電極層の電位が長時
間に渡って保持可能という特徴を生かすことで、次のように、情報の書き込み、保持、読
み出しが可能である。
情報の書き込みおよび保持について説明する。まず、第４の配線の電位を、トランジスタ
３２０２がオン状態となる電位にして、トランジスタ３２０２をオン状態とする。これに
より、第３の配線の電位が、トランジスタ３２００のゲート電極層、および容量素子３２
０４に与えられる。すなわち、トランジスタ３２００のゲート電極層には、所定の電荷が
与えられる（書き込み）。ここでは、異なる二つの電位レベルを与える電荷（以下Ｌｏｗ
レベル電荷、Ｈｉｇｈレベル電荷という）のいずれかが与えられるものとする。その後、
第４の配線の電位を、トランジスタ３２０２がオフ状態となる電位にして、トランジスタ
３２０２をオフ状態とすることにより、トランジスタ３２００のゲート電極層に与えられ
た電荷が保持される（保持）。
トランジスタ３２０２のオフ電流は極めて小さいため、トランジスタ３２００のゲート電
極層の電荷は長時間にわたって保持される。
次に情報の読み出しについて説明する。第１の配線に所定の電位（定電位）を与えた状態
で、第５の配線に適切な電位（読み出し電位）を与えると、トランジスタ３２００のゲー
ト電極層に保持された電荷量に応じて、第２の配線は異なる電位をとる。一般に、トラン
ジスタ３２００をｐチャネル型とすると、トランジスタ３２００のゲート電極層にＨｉｇ
ｈレベル電荷が与えられている場合の見かけのしきい値Ｖｔｈ＿Ｈは、トランジスタ３２
００のゲート電極層にＬｏｗレベル電荷が与えられている場合の見かけのしきい値Ｖｔｈ
＿Ｌより低くなるためである。ここで、見かけのしきい値電圧とは、トランジスタ３２０
０を「オン状態」とするために必要な第５の配線の電位をいうものとする。したがって、
第５の配線の電位をＶｔｈ＿ＨとＶｔｈ＿Ｌの間の電位Ｖ０とすることにより、トランジ
スタ３２００のゲート電極層に与えられた電荷を判別できる。例えば、書き込みにおいて
、Ｈｉｇｈレベル電荷が与えられていた場合には、第５の配線の電位がＶ０（＜Ｖｔｈ＿
Ｌ）となれば、トランジスタ３２００は「オフ状態」となる。Ｌｏｗレベル電荷が与えら
れていた場合には、第５の配線の電位がＶ０（＞Ｖｔｈ＿Ｈ）となっても、トランジスタ
３２００は「オン状態」のままである。このため、第２の配線の電位を見ることで、保持
されている情報を読み出すことができる。
なお、メモリセルをアレイ状に配置して用いる場合、所望のメモリセルの情報のみを読み
出せることが必要になる。このように情報を読み出さない場合には、ゲート電極層の状態
にかかわらずトランジスタ３２００が「オフ状態」となるような電位、つまり、Ｖｔｈ＿
Ｌより高い電位を第５の配線に与えればよい。または、ゲート電極層の状態にかかわらず
トランジスタ３２００が「オン状態」となるような電位、つまり、Ｖｔｈ＿Ｈより低い電
位を第５の配線に与えればよい。
本実施の形態に示す半導体装置では、チャネル形成領域に酸化物半導体を用いたオフ電流
の極めて小さいトランジスタを適用することで、極めて長期にわたり記憶内容を保持する
ことが可能である。つまり、リフレッシュ動作が不要となるか、または、リフレッシュ動
作の頻度を極めて低くすることが可能となるため、消費電力を十分に低減することができ
る。また、電力の供給がない場合（ただし、少なくとも第４の配線の電位は固定されてい
ることが望ましい）であっても、長期にわたって記憶内容を保持することが可能である。
また、本実施の形態に示す半導体装置では、情報の書き込みに高い電圧を必要とせず、素
子の劣化の問題もない。例えば、従来の不揮発性メモリのように、フローティングゲート
への電子の注入や、フローティングゲートからの電子の引き抜きを行う必要がないため、
ゲート絶縁膜の劣化といった問題が全く生じない。すなわち、開示する発明に係る半導体
装置では、従来の不揮発性メモリで問題となっている書き換え可能回数に制限はなく、信
頼性が飛躍的に向上する。さらに、トランジスタのオン状態、オフ状態によって、情報の
書き込みが行われるため、高速な動作も容易に実現しうる。
以上のように、微細化及び高集積化を実現し、かつ高い電気的特性を付与された半導体装
置、及び該半導体装置の作製方法を提供することができる。
以上、本実施の形態に示す構成、方法などは、他の実施の形態に示す構成、方法などと適
宜組み合わせて用いることができる。
（実施の形態５）
本実施の形態においては、実施の形態１または実施の形態２に示すトランジスタを使用し
、電力が供給されない状況でも記憶内容の保持が可能で、かつ、書き込み回数にも制限が
無い半導体装置について、図１３及び図１４を用いて説明を行う。
図１３（Ａ）は、半導体装置の回路構成の一例を示し、図１３（Ｂ）は半導体装置の一例
を示す概念図である。まず、図１３（Ａ）に示す装置について説明を行い、続けて図１３
（Ｂ）に示す半導体装置について、以下説明を行う。
図１３に示す半導体装置は、ｎ本のビット線ＢＬと、ｍ本のワード線ＷＬと、メモリセル
４０３が縦ｍ個（行）×横ｎ個（列）のマトリクス状に配置されたメモリセルアレイと、
ｎ本のビット線ＢＬに接続する第１の駆動回路４１０と、ｍ本のワード線ＷＬに接続する
第２の駆動回路４１１と、を有する。
メモリセル４０３は、トランジスタ４０１及び容量素子４０２を有する。ビット線ＢＬは
、トランジスタ４０１のソース電極又はドレイン電極の一方と電気的に接続され、ワード
線ＷＬは、トランジスタ４０１のゲート電極と電気的に接続され、トランジスタ４０１の
ソース電極又はドレイン電極の他方と容量素子４０２の第１の端子とは電気的に接続され
ている。
次に、図１３（Ａ）に示す半導体装置（メモリセル４０３）に、情報の書き込みおよび保
持を行う場合について説明する。
まず、容量線ＣＬを接地電位とし、ワード線ＷＬの電位を、トランジスタ４０１がオン状
態となる電位として、トランジスタ４０１をオン状態とする。これにより、ビット線ＢＬ
の電位が、容量素子４０２の第１の端子に与えられる（書き込み）。その後、ワード線Ｗ
Ｌの電位を、トランジスタ４０１がオフ状態となる電位として、トランジスタ４０１をオ
フ状態とすることにより、容量素子４０２の第１の端子の電位が保持される（保持）。
酸化物半導体を用いたトランジスタ４０１は、オフ電流が極めて小さいという特徴を有し
ている。このため、トランジスタ４０１をオフ状態とすることで、容量素子４０２の第１
の端子の電位（あるいは、容量素子４０２に蓄積された電荷）を極めて長時間にわたって
保持することが可能である。
次に、情報の読み出しについて説明する。トランジスタ４０１がオン状態となると、浮遊
状態であるビット線ＢＬと、容量素子４０２とが導通し、ビット線ＢＬと容量素子４０２
の間で電荷が再分配される。その結果、ビット線ＢＬの電位が変化する。ビット線ＢＬの
電位の変化量は、容量素子４０２の第１の端子の電位（あるいは容量素子４０２に蓄積さ
れた電荷）によって、異なる値をとる。
例えば、容量素子４０２の第１の端子の電位をＶ、容量素子４０２の容量をＣ、ビット線
ＢＬが有する容量成分（以下、ビット線容量とも呼ぶ）をＣＢ、電荷が再分配される前の
ビット線ＢＬの電位をＶＢ０とすると、電荷が再分配された後のビット線ＢＬの電位は、
（ＣＢ×ＶＢ０＋Ｃ×Ｖ）／（ＣＢ＋Ｃ）となる。従って、メモリセル４０３の状態とし
て、容量素子４０２の第１の端子の電位がＶ１とＶ０（Ｖ１＞Ｖ０）の２状態をとるとす
ると、電位Ｖ１を保持している場合のビット線ＢＬの電位（＝（ＣＢ×ＶＢ０＋Ｃ×Ｖ１
）／（ＣＢ＋Ｃ））は、電位Ｖ０を保持している場合のビット線ＢＬの電位（＝（ＣＢ×
ＶＢ０＋Ｃ×Ｖ０）／（ＣＢ＋Ｃ））よりも高くなることがわかる。
そして、ビット線ＢＬの電位を所定の電位と比較することで、情報を読み出すことができ
る。
このように、図１３（Ａ）に示す半導体装置は、トランジスタ４０１のオフ電流が極めて
小さいという特徴から、容量素子４０２に蓄積された電荷は長時間にわたって保持するこ
とができる。つまり、リフレッシュ動作が不要となるか、または、リフレッシュ動作の頻
度を極めて低くすることが可能となるため、消費電力を十分に低減することができる。ま
た、電力の供給がない場合であっても、長期にわたって記憶内容を保持することが可能で
ある。
次に、図１３（Ｂ）に示す半導体装置について、説明を行う。
図１３（Ｂ）に示す半導体装置は、上部に記憶回路として図１３（Ａ）に示したメモリセ
ル４０３を複数有するメモリセルアレイ４２０ａ及び４２０ｂを有し、下部に、メモリセ
ルアレイ４３０（メモリセルアレイ４２０ａ及び４２０ｂ）を動作させるために必要な周
辺回路４３１を有する。なお、周辺回路４３１は、メモリセルアレイ４２０ａ、メモリセ
ルアレイ４２０ｂとそれぞれ電気的に接続されている。
図１３（Ｂ）に示した構成とすることにより、周辺回路４３１をメモリセルアレイ４３０
（メモリセルアレイ４２０ａ及び４２０ｂ）の真下に設けることができるため半導体装置
の小型化を図ることができる。
周辺回路４３１に設けられるトランジスタは、トランジスタ４０１とは異なる半導体材料
を用いることがより好ましい。例えば、シリコン、ゲルマニウム、シリコンゲルマニウム
、炭化シリコン、またはガリウムヒ素等を用いることができ、単結晶半導体を用いること
が好ましい。このような半導体材料を用いたトランジスタは、十分な高速動作が可能であ
る。したがって、該トランジスタにより、高速動作が要求される各種回路（論理回路、駆
動回路など）を好適に実現することが可能である。他に、有機半導体材料などを用いても
よい。トランジスタ４０１については、実施の形態１および実施の形態２におけるトラン
ジスタ２０１乃至トランジスタ２０８の記載を参酌できる。
なお、図１３（Ｂ）に示した半導体装置では、メモリセルアレイ４３０（メモリセルアレ
イ４２０ａと、メモリセルアレイ４２０ｂ）が積層された構成を例示したが、積層するメ
モリセルアレイの数はこれに限定されない。３つ以上のメモリセルアレイを積層する構成
としても良い。
次に図１４（Ａ）および図１４（Ｂ）を用いて、メモリセル４０３の具体的な構成につい
て説明する。
図１４は、メモリセル４０３の構成の一例である。図１４（Ａ）に、メモリセル４０３の
断面図を、図１４（Ｂ）にメモリセル４０３回路図を示す。
図１４（Ａ）及び図１４（Ｂ）に示すトランジスタ４０１は、実施の形態１および実施の
形態２で示したトランジスタ２０１乃至トランジスタ２０８と同様の構成とすることがで
きるため、詳細な説明は省略する。
また、容量素子４０２は、絶縁膜４０４上に、電極４０５を形成することより、形成され
る。電極４０５の材料や方法については、トランジスタ２０１乃至トランジスタ２０８の
ゲート電極１１０の記載を参酌することができる。図１４に示す容量素子４０２では、電
極４０５が絶縁膜４０４およびソース電極またはドレイン電極４０６の一方を介してフィ
ン型の絶縁体４０７を乗り越えている。このような構成の容量素子４０２とすることで、
平面状に容量素子を形成する場合よりも小さな面積で必要な容量を得ることができ、高集
積な半導体装置とすることができる。
なお、メモリセルアレイを積層構造とする場合には、絶縁膜４０４上にさらに絶縁膜を形
成し、該絶縁膜上にトランジスタ４０１と同様の酸化物半導体を用いたトランジスタを形
成すればよい。
以上のように、多層に形成された複数のメモリセルは、酸化物半導体を用いたトランジス
タにより形成されている。酸化物半導体を用いたトランジスタは、オフ電流が小さいため
、これを用いることにより長期にわたり記憶内容を保持することが可能である。つまり、
リフレッシュ動作の頻度を極めて低くすることが可能となるため、消費電力を十分に低減
することができる。
このように、酸化物半導体以外の材料を用いたトランジスタ（換言すると、十分な高速動
作が可能なトランジスタ）を用いた周辺回路と、酸化物半導体を用いたトランジスタ（よ
り広義には、十分にオフ電流が小さいトランジスタ）を用いた半導体装置とを一体に備え
た半導体装置を実現することができる。
以上、本実施の形態に示す構成、方法などは、他の実施の形態に示す構成、方法などと適
宜組み合わせて用いることができる。
（実施の形態６）
本実施の形態では、上述の実施の形態で説明した半導体装置を電子機器に適用する場合に
ついて、図１５を用いて説明する。本実施の形態では、コンピュータ、携帯電話機（携帯
電話、携帯電話装置ともいう）、携帯情報端末（携帯型ゲーム機、音響再生装置なども含
む）、デジタルカメラ、デジタルビデオカメラなどのカメラ、電子ペーパー、テレビジョ
ン装置（テレビ、またはテレビジョン受信機ともいう）などの電子機器に、上述の半導体
装置を適用する場合について説明する。
図１５（Ａ）は、ノート型のパーソナルコンピュータであり、筐体５０１、筐体５０２、
表示部５０３、キーボード５０４などによって構成されている。筐体５０１と筐体５０２
の内部には、電子回路が設けられており、電子回路には、先の実施の形態に示す半導体装
置が設けられている。そのため、情報の演算、書き込みおよび読み出しが高速で、且つ消
費電力が十分に低減されたノート型のパーソナルコンピュータが実現される。
図１５（Ｂ）は、タブレット型端末５１０である。タブレット型端末５１０は、表示部５
１２を有する筐体５１１と、表示部５１４を有する筐体５１３と、操作ボタン５１５と、
外部インターフェイス５１６を有する。また、タブレット型端末５１０を操作するスタイ
ラス５１７などを備えている。筐体５１１と筐体５１３の内部には、電子回路が設けられ
ており、電子回路には、先の実施の形態に示す半導体装置が設けられている。そのため、
情報の演算、書き込みおよび読み出しが高速で、且つ消費電力が十分に低減された携帯情
報端末が実現される。
図１５（Ｃ）は、電子ペーパーを実装した電子書籍５２０であり、筐体５２１と筐体５２
３の２つの筐体で構成されている。筐体５２１および筐体５２３には、それぞれ表示部５
２５および表示部５２７が設けられている。筐体５２１と筐体５２３は、軸部５３７によ
り接続されており、該軸部５３７を軸として開閉動作を行うことができる。また、筐体５
２１は、電源５３１、操作キー５３３、スピーカー５３５などを備えている。筐体５２１
、筐体５２３の少なくとも一つの内部には、メモリ回路が設けられており、メモリ回路に
は、先の実施の形態に示す半導体装置が設けられている。そのため、情報の演算、書き込
みおよび読み出しが高速で、且つ消費電力が十分に低減された電子書籍が実現される。
図１５（Ｄ）は、携帯電話機であり、筐体５４０と筐体５４１の２つの筐体で構成されて
いる。さらに、筐体５４０と筐体５４１は、スライドし、図１５（Ｄ）のように展開して
いる状態から重なり合った状態とすることができ、携帯に適した小型化が可能である。ま
た、筐体５４１は、表示パネル５４２、スピーカー５４３、マイクロフォン５４４、操作
キー５４５、ポインティングデバイス５４６、カメラ用レンズ５４７、外部接続端子５４
８などを備えている。また、筐体５４０は、携帯電話機の充電を行う太陽電池セル５４９
、外部メモリスロット５５０などを備えている。また、アンテナは、筐体５４１に内蔵さ
れている。筐体５４０と筐体５４１の少なくとも一つの内部には、電子回路が設けられて
おり、電子回路には、先の実施の形態に示す半導体装置が設けられている。そのため、情
報の演算、書き込みおよび読み出しが高速で、且つ消費電力が十分に低減された携帯電話
機が実現される。
図１５（Ｅ）は、デジタルカメラであり、本体５６１、表示部５６７、接眼部５６３、操
作スイッチ５６４、表示部５６５、バッテリー５６６などによって構成されている。本体
５６１内部には、電子回路が設けられており、電子回路には、先の実施の形態に示す半導
体装置が設けられている。そのため、情報の演算、書き込みおよび読み出しが高速で、且
つ消費電力が十分に低減されたデジタルカメラが実現される。
図１５（Ｆ）は、テレビジョン装置５７０であり、筐体５７１、表示部５７３、スタンド
５７５などで構成されている。テレビジョン装置５７０の操作は、筐体５７１が備えるス
イッチや、リモコン操作機５８０により行うことができる。筐体５７１およびリモコン操
作機５８０のいずれか一方の内部には、電子回路が設けられており、電子回路には、先の
実施の形態に示す半導体装置が搭載されている。そのため、情報の演算、書き込みおよび
読み出しが高速で、且つ消費電力が十分に低減されたテレビジョン装置が実現される。
以上のように、本実施の形態に示す電子機器には、先の実施の形態に係る半導体装置が搭
載されている。このため、消費電力を低減した電子機器が実現される。
１００ 基板
１０２ 絶縁膜
１０３ 絶縁層
１０４ フィン型の絶縁体
１０５ 酸化物半導体膜
１０６ 酸化物半導体膜
１０６ａ チャネル形成領域
１０６ｂ 低抵抗領域
１０６ｃ 低抵抗領域
１０８ ゲート絶縁膜
１１０ ゲート電極
１１２ ソース電極またはドレイン電極
１１３ ドレイン電極またはソース電極
２０１ トランジスタ
２０２ トランジスタ
２０３ トランジスタ
２０４ トランジスタ
２０５ トランジスタ
２０６ トランジスタ
２０７ トランジスタ
２０８ トランジスタ
４０１ トランジスタ
４０２ 容量素子
４０３ メモリセル
４０４ 絶縁膜
４０５ 電極
４０６ ソース電極またはドレイン電極
４０７ フィン型の絶縁体
４１０ 駆動回路
４１１ 駆動回路
４２０ａ メモリセルアレイ
４２０ｂ メモリセルアレイ
４３０ メモリセルアレイ
４３１ 周辺回路
５０１ 筐体
５０２ 筐体
５０３ 表示部
５０４ キーボード
５１０ タブレット型端末
５１１ 筐体
５１２ 表示部
５１３ 筐体
５１４ 表示部
５１５ 操作ボタン
５１６ 外部インターフェイス
５１７ スタイラス
５２０ 電子書籍
５２１ 筐体
５２３ 筐体
５２５ 表示部
５２７ 表示部
５３１ 電源
５３３ 操作キー
５３５ スピーカー
５３７ 軸部
５４０ 筐体
５４１ 筐体
５４２ 表示パネル
５４３ スピーカー
５４４ マイクロフォン
５４５ 操作キー
５４６ ポインティングデバイス
５４７ カメラ用レンズ
５４８ 外部接続端子
５４９ 太陽電池セル
５５０ 外部メモリスロット
５６１ 本体
５６３ 接眼部
５６４ 操作スイッチ
５６５ 表示部
５６６ バッテリー
５６７ 表示部
５７０ テレビジョン装置
５７１ 筐体
５７３ 表示部
５７５ スタンド
５８０ リモコン操作機
３０００ 基板
３１０６ 素子分離絶縁層
３２００ トランジスタ
３２０２ トランジスタ
３２０４ 容量素子
３２０８ 電極
３２２０ 絶縁層

Claims (4)

  1. 上部に丸みを帯びた絶縁体と、
    前記絶縁体の側面及び前記上部と重なる半導体膜と、
    前記半導体膜と重なるゲート絶縁膜と、
    前記ゲート絶縁膜と重なるゲート電極と、を有することを特徴とする半導体装置。
  2. 側面にテーパー角を有し、且つ上部に丸みを帯びた絶縁体と、
    前記絶縁体の前記側面及び前記上部と重なる半導体膜と、
    前記半導体膜と重なるゲート絶縁膜と、
    前記ゲート絶縁膜と重なるゲート電極と、を有することを特徴とする半導体装置。
  3. 上部に丸みを帯びた絶縁体と、
    前記絶縁体の側面及び前記上部と重なる酸化物半導体膜と、
    前記酸化物半導体膜と重なるゲート絶縁膜と、
    前記ゲート絶縁膜と重なるゲート電極と、を有することを特徴とする半導体装置。
  4. 側面にテーパー角を有し、且つ上部に丸みを帯びた絶縁体と、
    前記絶縁体の前記側面及び前記上部と重なる酸化物半導体膜と、
    前記酸化物半導体膜と重なるゲート絶縁膜と、
    前記ゲート絶縁膜と重なるゲート電極と、を有することを特徴とする半導体装置。
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