JP2014063121A - ステージ回路およびこれを用いた有機電界発光表示装置 - Google Patents

ステージ回路およびこれを用いた有機電界発光表示装置 Download PDF

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Abstract

【課題】本発明は、安定性を向上できるようにしたステージ回路に関するものである。
【解決手段】本発明のステージ回路は、第１ノードおよび第２ノードに印加された電圧に対応して出力端子に第１電源または第３入力端子の電圧を供給するための出力部と、第１入力端子、第２入力端子および前記第３入力端子の信号に対応して前記第２ノードの電圧を制御するための第１駆動部と、前記第２入力端子および第２ノードの電圧に対応して前記第１ノードの電圧を制御するための第２駆動部とを備える。
【選択図】図３

Description

本発明は、ステージ回路およびこれを用いた有機電界発光表示装置に関するものであり、特に、安定性を向上できるようにしたステージ回路およびこれを用いた有機電界発光表示装置に関するものである。
最近、陰極線管（Cathode Ray Tube）の欠点である重量と体積を減少させることができる各種平板表示装置が開発されている。平板表示装置には、液晶表示装置（Liquid Crystal Display）、電界放出表示装置（Field Emission Display）、プラズマ表示パネル（Plasma Display Panel）および有機電界発光表示装置（Organic Light Emitting Display Device）などがある。
平板表示装置のうち、有機電界発光表示装置は、電子と正孔との再結合によって光を発生する有機発光ダイオードを用いて映像を表示する。このような有機電界発光表示装置は、速い応答速度を有すると同時に、低消費電力で駆動されるという利点がある。一般的な有機電界発光表示装置は、画素ごとに形成されるトランジスタを用いてデータ信号に対応する電流を有機発光ダイオードに供給することにより、有機発光ダイオードで光が発生するようにする。
このような従来の有機電界発光表示装置は、データ線にデータ信号を供給するためのデータ駆動部と、走査線に走査信号を順次に供給するための走査駆動部と、走査線およびデータ線に接続される複数の画素を含む画素部とを備える。
画素部に含まれた画素は、走査線に走査信号が供給される時に選択され、データ線からデータ信号を受ける。データ信号を受けた画素は、データ信号に対応する所定輝度の光を生成しながら、映像を表示する。
一方、走査駆動部は、走査線にそれぞれ接続されるステージ回路を備える。ステージは、自身に供給される信号に対応して自身に接続された走査線に走査信号を供給する。ここで、従来のステージ回路は、走査信号を供給するために複数のトランジスタ（例えば、１０個以上）およびキャパシタが含まれ、これにより、安定性が低下する問題がある。つまり、ステージに複数のトランジスタが含まれる場合、工程収率(歩留まり)が低下し、これにより、駆動の安定性が低下する問題が発生する。
したがって、本発明の実施形態の目的は、安定性を向上できるようにしたステージ回路およびこれを用いた有機電界発光表示装置を提供することである。
本発明の実施形態にかかるステージ回路は、第１ノードおよび第２ノードに印加された電圧に対応して出力端子に第１電源または第３入力端子の電圧を供給するための出力部と、第１入力端子、第２入力端子および前記第３入力端子の信号に対応して前記第２ノードの電圧を制御するための第１駆動部と、前記第２入力端子および第２ノードの電圧に対応して前記第１ノードの電圧を制御するための第２駆動部とを備える。
好ましくは、前記第１入力端子は前段ステージの出力信号または開始信号、前記第２入力端子は第１クロック信号、前記第３入力端子は第２クロック信号を受ける。前記第１クロック信号および第２クロック信号は、同一の周期を有し、位相が互いに重畳しない。前記第１クロック信号および第２クロック信号は、２水平期間２Ｈの周期を有し、ロー信号が互いに異なる水平期間に供給される。前記開始信号は、前記第１クロック信号と重畳して供給される。
前記第１駆動部は、前記第１入力端子と前記第２ノードとの間に位置し、ゲート電極が前記第２入力端子に接続される第１トランジスタと、前記第２ノードと前記第１電源との間に直列に位置する第２トランジスタおよび第３トランジスタとを備え、前記第２トランジスタのゲート電極は前記第３入力端子に接続され、前記第３トランジスタのゲート電極は前記第１ノードに接続される。
前記出力部は、前記第１電源と前記出力端子との間に位置し、ゲート電極が前記第１ノードに接続される第４トランジスタと、前記出力端子と前記第３入力端子との間に接続され、ゲート電極が前記第２ノードに接続される第５トランジスタと、前記第２ノードと前記出力端子との間に接続される第１キャパシタと、前記第１ノードと前記第１電源との間に接続される第２キャパシタとを備える。
前記第２駆動部は、前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、前記第１ノードと前記第１電源より低い電圧に設定される第２電源との間に位置し、ゲート電極が前記第２入力端子に接続される第７トランジスタとを備える。
前記第２駆動部は、前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、前記第１ノードと前記第２入力端子との間にダイオード形態で接続される第７トランジスタとを備える。前記第７トランジスタは、前記第１ノードから前記第２入力端子に電流が流れ得るように接続される。前記第１入力端子および第５入力端子と前記第１駆動部との間に接続される双方向駆動部をさらに備える。
前記双方向駆動部は、前記第１入力端子と前記第１駆動部との間に位置し、第１制御信号が供給される時にターンオンされる第１０トランジスタと、前記第５入力端子と前記第１駆動部との間に位置し、第２制御信号が供給される時にターンオンされる第１１トランジスタとを備える。前記第１入力端子は、前段ステージの出力信号または開始信号を受け、前記第５入力端子は、次段ステージの出力信号または開始信号を受ける。
本発明の実施形態にかかる有機電界発光表示装置は、走査線およびデータ線によって区画された領域に位置する画素と、前記データ線にデータ信号を供給するためのデータ駆動部と、前記走査線に走査信号を供給するために前記走査線にそれぞれ接続されるステージを含む走査駆動部とを備え、前記ステージのそれぞれは、第１ノードおよび第２ノードに印加された電圧に対応して出力端子に第１電源または第３入力端子の電圧を供給するための出力部と、第１入力端子、第２入力端子および前記第３入力端子の信号に対応して前記第２ノードの電圧を制御するための第１駆動部と、前記第２入力端子および第２ノードの電圧に対応して前記第１ノードの電圧を制御するための第２駆動部とを備える。
好ましくは、前記第３入力端子に供給されるクロック信号が前記走査信号として用いられる。前記第１入力端子は、前段ステージの走査信号または開始信号を受ける。奇数番目ステージの第２入力端子は第１クロック信号、第３入力端子は第２クロック信号を受け、偶数番目ステージの第２入力端子は第２クロック信号、第３入力端子は第１クロック信号を受ける。前記第１クロック信号および第２クロック信号は、同一の周期を有し、位相が互いに重畳しない。
前記第１駆動部は、前記第１入力端子と前記第２ノードとの間に位置し、ゲート電極が前記第２入力端子に接続される第１トランジスタと、前記第２ノードと前記第１電源との間に直列に位置する第２トランジスタおよび第３トランジスタとを備え、前記第２トランジスタのゲート電極は前記第３入力端子に接続され、前記第３トランジスタのゲート電極は前記第１ノードに接続される。
前記出力部は、前記第１電源と前記出力端子との間に位置し、ゲート電極が前記第１ノードに接続される第４トランジスタと、前記出力端子と前記第３入力端子との間に接続され、ゲート電極が前記第２ノードに接続される第５トランジスタと、前記第２ノードと前記出力端子との間に接続される第１キャパシタと、前記第１ノードと前記第１電源との間に接続される第２キャパシタとを備える。
前記第２駆動部は、前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、前記第１ノードと前記第１電源より低い電圧に設定される第２電源との間に位置し、ゲート電極が前記第２入力端子に接続される第７トランジスタとを備える。
前記第２駆動部は、前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、前記第１ノードと前記第２入力端子との間にダイオード形態で接続される第７トランジスタとを備える。前記第７トランジスタは、前記第１ノードから前記第２入力端子に電流が流れ得るように接続される。前記第１入力端子および第５入力端子と前記第１駆動部との間に接続される双方向駆動部をさらに備える。
前記双方向駆動部は、前記第１入力端子と前記第１駆動部との間に位置し、第１制御信号が供給される時にターンオンされる第１０トランジスタと、前記第５入力端子と前記第１駆動部との間に位置し、第２制御信号が供給される時にターンオンされる第１１トランジスタとを備える。前記第１入力端子は、前段ステージの出力信号または開始信号を受け、前記第５入力端子は、次段ステージの出力信号または開始信号を受ける。前記第１入力端子に供給される前段ステージの走査信号または開始信号は、前記第２入力端子に供給されるクロック信号と重畳する。
本発明のステージ回路およびこれを用いた有機電界発光表示装置によれば、比較的簡略な回路でステージを実現することができ、これにより、安定性を向上させることができる利点がある。また、本願発明のステージ回路は、２つのクロック信号のみを用いて走査信号を生成し、これにより、走査信号の幅を広く設定することができる利点がある。
本発明の実施形態にかかる有機電界発光表示装置を示す図である。 図１に示された走査駆動部の実施形態を示す図である。 図２に示されたステージの実施形態を示す回路図である。 図３に示されたステージ回路の駆動方法を示す波形図である。 図３のステージ回路のシミュレーション結果を示す波形図である。 本発明の他の実施形態にかかるステージを示す回路図である。 本発明のさらに他の実施形態にかかるステージ回路を示す回路図である。
以下、本発明の属する技術分野における通常の知識を有する者が本発明を容易に実施できる好ましい実施形態を、添付した図１ないし図７を参照して詳細に説明する。
図１は、本発明の実施形態にかかる有機電界発光表示装置を示す図である。
図１を参照すれば、本発明の実施形態にかかる有機電界発光表示装置は、走査線Ｓ１〜Ｓｎおよびデータ線Ｄ１〜Ｄｍの交差部に位置する画素３０を含む画素部４０と、走査線Ｓ１〜Ｓｎを駆動するための走査駆動部１０と、データ線Ｄ１〜Ｄｍを駆動するためのデータ駆動部２０と、走査駆動部１０およびデータ駆動部２０を制御するためのタイミング制御部５０とを備える。
走査駆動部１０は、走査線Ｓ１〜Ｓｎに走査信号を供給する。一例として、走査駆動部１０は、走査線Ｓ１〜Ｓｎに走査信号を順次に供給することができる。この場合、画素３０が水平ライン単位で選択される。このために、走査駆動部１０は、走査線Ｓ１〜Ｓｎのそれぞれに接続されるステージ回路（図示せず）を備える。
データ駆動部２０は、走査信号に同期するようにデータ線Ｄ１〜Ｄｍにデータ信号を供給する。すると、走査信号によって選択された画素３０に、データ信号に対応する電圧が充電される。
タイミング制御部５０は、走査駆動部１０およびデータ駆動部２０を制御する。また、タイミング制御部５０は、外部からのデータ（図示せず）をデータ駆動部２０に伝達する。
画素３０は、走査信号が供給される時に選択され、データ信号に対応する電圧を充電し、充電された電圧に対応する電流を有機発光ダイオード（図示せず）に供給しながら、所定輝度の光を生成する。
図２は、図１に示された走査駆動部の実施形態を示す図である。図２では、説明の便宜のために、４つのステージを示すものとする。
図２を参照すれば、本発明の実施形態にかかる走査駆動部１０は、複数のステージＳＴ１〜ＳＴ４を備える。ステージＳＴ１〜ＳＴ４のそれぞれは、走査線Ｓ１〜Ｓ４のいずれか１つに接続され、クロック信号ＣＬＫ１、ＣＬＫ２に対応して駆動される。このようなステージＳＴ１〜ＳＴ４は、同一の回路で構成される。
ステージＳＴ１〜ＳＴ４のそれぞれは、第１入力端子１０１ないし第３入力端子１０３と、出力端子１０４とを備える。
ステージＳＴ１〜ＳＴ４それぞれの第１入力端子１０１は、前段ステージの出力信号（すなわち、走査信号）または開始信号ＳＳＰを受ける。一例として、一番目ステージＳＴ１の第１入力端子１０１は、開始信号ＳＳＰを受け、残りのステージＳＴ２〜ＳＴ４の第１入力端子１０１は、前段ステージの出力信号を受ける。
ｉ（ｉは奇数または偶数）番目ステージＳＴｉの第２入力端子１０２は第１クロック信号ＣＬＫ１、第３入力端子１０３は第２クロック信号ＣＬＫ２を受ける。ｉ＋１番目ステージＳＴｉの第２入力端子１０２は第２クロック信号ＣＬＫ２、第３入力端子１０３は第１クロック信号ＣＬＫ１を受ける。
例えば、ｉが最小の自然数である１であるとき、図２に示すように、奇数である１番目ステージＳＴ１の第２入力端子１０２は第１クロック信号ＣＬＫ１、第３入力端子１０３は第２クロック信号ＣＬＫ２を受ける。これに対して、ｉが偶数である２番目ステージＳＴ２の第２入力端子１０２は第２クロック信号ＣＬＫ２、第３入力端子１０３は第１クロック信号ＣＬＫ１を受ける。
同様に、奇数である３番目ステージＳＴ３の第２入力端子１０２は第１クロック信号ＣＬＫ１、第３入力端子１０３は第２クロック信号ＣＬＫ２を受ける。偶数である４番目ステージＳＴ２の第２入力端子１０２は第２クロック信号ＣＬＫ２、第３入力端子１０３は第１クロック信号ＣＬＫ１を受ける。
第１クロック信号ＣＬＫ１および第２クロック信号ＣＬＫ２は、同一の周期を有し、位相が互いに重畳しない。一例として、１つの走査線に走査信号が供給される期間を１水平期間１Ｈとする時、クロック信号ＣＬＫ１、ＣＬＫ２のそれぞれは、２Ｈの周期を有し、互いに異なる水平期間に供給される。
図３は、図２に示されたステージの実施形態を示す回路図である。図３では、説明の便宜のために、第１ステージＳＴ１および第２ステージＳＴ２を示すものとする。そして、図３では、トランジスタをＰＭＯＳで形成して示すが、本願発明はこのトランジスタタイプに限定されるものではない。一例として、トランジスタは、ＮＭＯＳで形成されてもよい。
図３を参照すれば、本発明の第１実施形態にかかるステージＳＴ１は、第１駆動部２１０と、第２駆動部２２０と、出力部２３０とを備える。
出力部２３０は、第１ノードＮ１および第２ノードＮ２に印加される電圧に対応して出力端子１０４に供給される電圧を制御する。このために、出力部２３０は、第４トランジスタＭ４と、第５トランジスタＭ５と、第１キャパシタＣ１と、第２キャパシタＣ２とを備える。
第４トランジスタＭ４は、第１電源ＶＤＤと出力端子１０４との間に位置し、ゲート電極が第１ノードＮ１に接続される。このような第４トランジスタＭ４は、第１ノードＮ１に印加される電圧に対応して第１電源ＶＤＤと出力端子１０４との接続を制御する。ここで、第１電源ＶＤＤは、ゲートオフ電圧、例えば、ハイレベルの電圧に設定される。
第５トランジスタＭ５は、出力端子１０４と第３入力端子１０３との間に位置し、ゲート電極が第２ノードＮ２に接続される。このような第５トランジスタＭ５は、第２ノードＮ２に印加される電圧に対応して出力端子１０４と第３入力端子１０３との接続を制御する。
第１キャパシタＣ１は、第２ノードＮ２と出力端子１０４との間に接続される。このような第１キャパシタＣ１は、第５トランジスタＭ５のターンオンおよびターンオフに対応する電圧を充電する。
第２キャパシタＣ２は、第１ノードＮ１と第１電源ＶＤＤとの間に接続される。このような第２キャパシタＣ２は、第１ノードＮ１に印加される電圧を充電する。
第１駆動部２１０は、第１入力端子１０１ないし第３入力端子１０３に供給される信号に対応して第２ノードＮ２の電圧を制御する。つまり、第１入力端子１０１、第２入力端子１０２及び第３入力端子の信号に対応して第２ノードＮ２の電圧を制御する。このために、第１駆動部２１０は、第１トランジスタＭ１ないし第３トランジスタＭ３を備える。
第１トランジスタＭ１は、第１入力端子１０１と第２ノードＮ２との間に位置し、ゲート電極が第２入力端子１０２に接続される。このような第１トランジスタＭ１は、第２入力端子１０２に供給される電圧に対応して第１入力端子１０１と第２ノードＮ２との接続を制御する。
第２トランジスタＭ２および第３トランジスタＭ３は、第２ノードＮ２と第１電源ＶＤＤとの間に直列に接続される。実際に、第２トランジスタＭ２は、第３トランジスタＭ３と第２ノードＮ２との間に位置し、ゲート電極が第３入力端子１０３に接続される。このような第２トランジスタＭ２は、第３入力端子１０３に供給される電圧に対応して第３トランジスタＭ３と第２ノードＮ２との接続を制御する。
第３トランジスタＭ３は、第２トランジスタＭ２と第１電源ＶＤＤとの間に位置し、ゲート電極が第１ノードＮ１に接続される。このような第３トランジスタＭ３は、第１ノードＮ１の電圧に対応して第２トランジスタＭ２と第１電源ＶＤＤとの接続を制御する。
第２駆動部２２０は、第２入力端子１０２および第２ノードＮ２の電圧に対応して第１ノードＮ１の電圧を制御する。このために、第２駆動部２２０は、第６トランジスタＭ６と、第７トランジスタＭ７とを備える。
第６トランジスタＭ６は、第１ノードＮ１と第２入力端子１０２との間に位置し、ゲート電極が第２ノードＮ２に接続される。このような第６トランジスタＭ６は、第２ノードＮ２の電圧に対応して第１ノードＮ１と第２入力端子１０２との接続を制御する。
第７トランジスタＭ７は、第１ノードＮ１と第２電源ＶＳＳとの間に位置し、ゲート電極が第２入力端子１０２に接続される。このような第７トランジスタＭ７は、第２入力端子１０２の電圧に対応して第１ノードＮ１と第２電源ＶＳＳとの接続を制御する。ここで、第２電源ＶＳＳは、ゲートオン電圧、例えば、ローレベルの電圧に設定される。
なお、第２ステージＳＴ２も、同様の構成の第１駆動部２１０と、第２駆動部２２０と、出力部２３０とを備える。ただし、第１入力端子１０１には第１ステージＳＴ１の出力部２３０からの出力信号が供給され、また第２入力端子１０２には第２クロック信号ＣＬＫ２が供給され、またさらに第３入力端子１０３には第１クロック信号ＣＬＫ１が供給されるという点が、第１ステージＳＴ１とは異なる。
図４は、図３に示されたステージ回路の駆動方法を示す波形図である。図４では、説明の便宜のために、第１ステージＳＴ１を用いて動作過程を説明する。
図４を参照すれば、第１クロック信号ＣＬＫ１および第２クロック信号ＣＬＫ２は、２水平期間２Ｈの周期を有し、互いに異なる水平期間に供給される。そして、第２入力端子１０２に供給されるクロック信号ＣＬＫ１またはＣＬＫ２に同期するように開始信号ＳＳＰが供給される。
動作過程を詳細に説明すると、まず、第１クロック信号ＣＬＫ１に同期するように開始信号ＳＳＰが供給される。
第１クロック信号ＣＬＫ１が供給されると、第１トランジスタＭ１および第７トランジスタＭ７がターンオンされる。第１トランジスタＭ１がターンオンされると、第１入力端子１０１と第２ノードＮ２とが電気的に接続される。この場合、第１入力端子１０１に供給される開始信号ＳＳＰによって第２ノードＮ２がロー電圧に設定される。第２ノードＮ２がロー電圧に設定されると、第５トランジスタＭ５および第６トランジスタＭ６がターンオンされる。
第５トランジスタＭ５がターンオンされると、第３入力端子１０３と出力端子１０４とが電気的に接続される。ここで、第３入力端子１０３は、ハイ電圧に設定（すなわち、第２クロック信号ＣＬＫ２が供給されない）され、これにより、出力端子１０４にもハイ電圧が出力される。第６トランジスタＭ６がターンオンされると、第２入力端子１０２と第１ノードＮ１とが電気的に接続される。すると、第２入力端子１０２に供給される第１クロック信号ＣＬＫ１の電圧、すなわち、ロー電圧が第１ノードＮ１に供給される。追加的に、第１クロック信号ＣＬＫ１に対応して第７トランジスタＭ７がターンオンされ、第１ノードＮ１には第２電源ＶＳＳの電圧が供給される。ここで、第２電源ＶＳＳの電圧は、第１クロック信号ＣＬＫ１と同一（または類似）の電圧に設定され、これにより、第１ノードＮ１は安定的にロー電圧を維持する。
第１ノードＮ１にロー電圧が供給されると、第４トランジスタＭ４および第３トランジスタＭ３がターンオンされる。第３トランジスタＭ３がターンオンされると、第１電源ＶＤＤと第２トランジスタＭ２とが電気的に接続される。ここで、第２トランジスタＭ２がターンオフ状態に設定されるため、第３トランジスタＭ３がターンオンされても、第２ノードＮ２は安定的にロー電圧を維持する。第４トランジスタＭ４がターンオンされると、出力端子１０４に第１電源ＶＤＤの電圧が供給される。ここで、第１電源ＶＤＤの電圧は、第３入力端子１０３に供給されるハイ電圧と同一の電圧に設定され、これにより、出力端子１０４は安定的にハイ電圧を維持する。
以後、開始信号ＳＳＰおよび第１クロック信号ＣＬＫ１の供給が中断される。第１クロック信号ＣＬＫ１の供給が中断されると、第１トランジスタＭ１および第７トランジスタＭ７がターンオフされる。この時、第１キャパシタＣ１に格納された電圧に対応して、第５トランジスタＭ５および第６トランジスタＭ６はターンオン状態を維持する。
第５トランジスタＭ５がターンオン状態を維持する場合、出力端子１０４と第３入力端子１０３とは電気的接続を維持する。したがって、出力端子１０４は、第３入力端子１０３からハイ電圧を受ける。
一方、第６トランジスタＭ６がターンオン状態を維持するため、第１ノードＮ１と第２入力端子１０２とは電気的に接続される。ここで、第２入力端子１０２の電圧は、第１クロック信号ＣＬＫ１の供給中断に対応してハイ電圧に設定され、これにより、第１ノードＮ１もハイ電圧に設定される。第１ノードＮ１にハイ電圧が供給されると、第４トランジスタＭ４がターンオフされる。
以後、第３入力端子１０３に第２クロック信号ＣＬＫ２が供給される。この時、第５トランジスタＭ５がターンオン状態に設定されるため、第３入力端子１０３に供給された第２クロック信号ＣＬＫ２は出力端子１０４に供給される。この場合、出力端子１０４は、第２クロック信号ＣＬＫ２を走査信号として走査線Ｓ１に出力する。
走査線Ｓ１に走査信号が出力された後、第１クロック信号ＣＬＫ１が供給される。第１クロック信号ＣＬＫ１が供給されると、第１トランジスタＭ１および第７トランジスタＭ７がターンオンされる。第１トランジスタＭ１がターンオンされると、第１入力端子１０１と第２ノードＮ２とが電気的に接続される。この時、第１入力端子１０１には開始信号ＳＳＰが供給されず、これにより、ハイ電圧に設定される。したがって、第１トランジスタＭ１がターンオンされると、第２ノードＮ２にハイ電圧が供給され、これにより、第５トランジスタＭ５および第６トランジスタＭ６がターンオフされる。
第７トランジスタＭ７がターンオンされると、第２電源ＶＳＳが第１ノードＮ１に供給され、これにより、第３トランジスタＭ３および第４トランジスタＭ４がターンオンされる。第４トランジスタＭ４がターンオンされると、出力端子１０４に第１電源ＶＤＤの電圧が供給される。以後、第４トランジスタＭ４および第３トランジスタＭ３は、第２キャパシタＣ２に充電された電圧に対応してターンオン状態を維持し、これにより、出力端子１０４は第１電源ＶＤＤの電圧を安定的に受ける。
追加的に、第２クロック信号ＣＬＫ２が供給される時、第２トランジスタＭ２がターンオンされる。この時、第３トランジスタＭ３がターンオン状態に設定されるため、第２ノードＮ２に第１電源ＶＤＤの電圧が供給される。この場合、第５トランジスタＭ５および第６トランジスタＭ６は安定的にターンオフ状態を維持する。
一方、第２ステージＳＴ２は、第２クロック信号ＣＬＫ２に同期するように第１ステージＳＴ１の出力信号（すなわち、走査信号）を受ける。この場合、第２ステージＳＴ２は、第１クロック信号ＣＬＫ１に同期するように第２走査線Ｓ２に走査信号を出力する。実際に、本願発明のステージＳＴは、前述した過程を繰り返しながら走査線に走査信号を順次に出力する。
図５は、図３のステージ回路のシミュレーション結果を示す波形図（過度的な分析、Transient Analysis）である。
図５を参照すれば、本発明の実施形態にかかるステージ回路を用いた走査駆動部は、走査線に走査信号を順次に供給する。また、本願発明のステージ回路は、第１クロック信号ＣＬＫ１および第２クロック信号ＣＬＫ２のみを用いて走査線に走査信号を出力する。すなわち、本願発明のステージ回路は、別の初期化信号を受けず、これにより、走査信号の幅を広く設定（例えば、１Ｈ期間）できる利点がある。
図６は、本発明の他の実施形態にかかるステージを示す回路図である。図６において、図３と同様の構成については、同一の図面符号を割り当てると共に、詳細な説明は省略する。
図６を参照すれば、本発明の他の実施形態にかかるステージにおいて、第７トランジスタＭ７’は、第１ノードＮ１と第２入力端子１０２との間にダイオード形態で接続される。つまり、第７トランジスタＭ７’は、第１ノードＮ１から第２入力端子１０２に電流が流れ得るようにダイオード形態で接続される。この場合、第２入力端子１０２にロー電圧が供給される場合、第１ノードＮ１の電圧がロー電圧まで下降する。それ以外の動作過程は、図３に示された本発明の実施形態にかかるステージと同一であるので省略する。
図７は、本発明のさらに他の実施形態にかかるステージ回路を示す回路図である。図７において、図３と同様の構成については、同一の図面符号を割り当てると共に、詳細な説明は省略する。
図７を参照すれば、本発明のさらに他の実施形態にかかるステージ回路は、双方向駆動部２４０をさらに備える。双方向駆動部２４０は、走査信号が第１方向（第１走査線Ｓ１から第ｎ走査線Ｓｎ）または第２方向（第ｎ走査線Ｓｎから第１走査線Ｓ１）に供給できるように制御する。このために、双方向駆動部２４０は、第１０トランジスタＭ１０と、第１１トランジスタＭ１１とを備える。
第１０トランジスタＭ１０は、第１入力端子１０１と第１駆動部２１０との間に接続される。このような第１０トランジスタＭ１０は、第１制御信号ＣＳ１が供給される時にターンオンされる。ここで、第１入力端子１０１は、前段ステージの走査信号（または開始信号）を受ける。
第１１トランジスタＭ１１は、第５入力端子１０５と第１駆動部２１０との間に接続される。このような第１１トランジスタＭ１１は、第２制御信号ＣＳ２が供給される時にターンオンされる。ここで、第５入力端子１０５は、次段ステージの走査信号（または開始信号）を受ける。
動作過程を説明すると、第１制御信号ＣＳ１が供給される場合、第１０トランジスタＭ１０がターンオンされる。第１０トランジスタＭ１０がターンオンされると、ステージのそれぞれは、前段ステージの走査信号に対応して駆動され、これにより、第１方向に走査信号が順次に出力される。
そして、第２制御信号ＣＳ２が供給される場合、第１１トランジスタＭ１１がターンオンされる。第１１トランジスタＭ１１がターンオンされると、ステージのそれぞれは、次段ステージの走査信号に対応して駆動され、これにより、第２方向に走査信号が出力される。それ以外の駆動過程は、図３に示された本願発明の実施形態にかかるステージと同一であるので、詳細な説明は省略する。
本発明の技術思想は、上記の好ましい実施形態によって具体的に記述されたが、上記の実施形態は、その説明のためのものであって、それを制限するためのものではないことに気を付けなければならない。また、本発明の技術分野における通常の知識を有する者であれば、本発明の技術思想の範囲内で多様な変形例が可能であることを理解することができる。
１０：走査駆動部
２０：データ駆動部
３０：画素
４０：画素部
５０：タイミング制御部
１０１、１０２、１０３：入力端子
１０４：出力端子
２１０、２２０：駆動部
２３０：出力部
２４０：双方向駆動部

Claims (27)

  1. 第１ノードおよび第２ノードに印加された電圧に対応して出力端子に第１電源または第３入力端子の電圧を供給するための出力部と、
    第１入力端子、第２入力端子および前記第３入力端子の信号に対応して前記第２ノードの電圧を制御するための第１駆動部と、
    前記第２入力端子および第２ノードの電圧に対応して前記第１ノードの電圧を制御するための第２駆動部とを備えることを特徴とするステージ回路。
  2. 前記第１入力端子は前段ステージの出力信号または開始信号、前記第２入力端子は第１クロック信号、前記第３入力端子は第２クロック信号を受けることを特徴とする請求項１に記載のステージ回路。
  3. 前記第１クロック信号および第２クロック信号は、同一の周期を有し、位相が互いに重畳しないことを特徴とする請求項１または２に記載のステージ回路。
  4. 前記第１クロック信号および第２クロック信号は、２水平期間２Ｈの周期を有し、ロー信号が互いに異なる水平期間に供給されることを特徴とする請求項１〜３のいずれか一項に記載のステージ回路。
  5. 前記開始信号は、前記第１クロック信号と重畳して供給されることを特徴とする請求項２に記載のステージ回路。
  6. 前記第１駆動部は、
    前記第１入力端子と前記第２ノードとの間に位置し、ゲート電極が前記第２入力端子に接続される第１トランジスタと、
    前記第２ノードと前記第１電源との間に直列に位置する第２トランジスタおよび第３トランジスタとを備え、
    前記第２トランジスタのゲート電極は前記第３入力端子に接続され、前記第３トランジスタのゲート電極は前記第１ノードに接続されることを特徴とする請求項２〜５のいずれか一項に記載のステージ回路。
  7. 前記出力部は、
    前記第１電源と前記出力端子との間に位置し、ゲート電極が前記第１ノードに接続される第４トランジスタと、
    前記出力端子と前記第３入力端子との間に接続され、ゲート電極が前記第２ノードに接続される第５トランジスタと、
    前記第２ノードと前記出力端子との間に接続される第１キャパシタと、
    前記第１ノードと前記第１電源との間に接続される第２キャパシタとを備えることを特徴とする請求項２〜６のいずれか一項に記載のステージ回路。
  8. 前記第２駆動部は、
    前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、
    前記第１ノードと前記第１電源より低い電圧に設定される第２電源との間に位置し、ゲート電極が前記第２入力端子に接続される第７トランジスタとを備えることを特徴とする請求項２〜７のいずれか一項に記載のステージ回路。
  9. 前記第２駆動部は、
    前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、
    前記第１ノードと前記第２入力端子との間にダイオード形態で接続される第７トランジスタとを備えることを特徴とする請求項２〜７のいずれか一項に記載のステージ回路。
  10. 前記第７トランジスタは、前記第１ノードから前記第２入力端子に電流が流れ得るように接続されることを特徴とする請求項９に記載のステージ回路。
  11. 前記第１入力端子および第５入力端子と前記第１駆動部との間に接続される双方向駆動部をさらに備えることを特徴とする請求項１〜８のいずれか一項に記載のステージ回路。
  12. 前記双方向駆動部は、
    前記第１入力端子と前記第１駆動部との間に位置し、第１制御信号が供給される時にターンオンされる第１０トランジスタと、
    前記第５入力端子と前記第１駆動部との間に位置し、第２制御信号が供給される時にターンオンされる第１１トランジスタとを備えることを特徴とする請求項１１に記載のステージ回路。
  13. 前記第１入力端子は、前段ステージの出力信号または開始信号を受け、
    前記第５入力端子は、次段ステージの出力信号または開始信号を受けることを特徴とする請求項１２に記載のステージ回路。
  14. 走査線およびデータ線によって区画された領域に位置する画素と、
    前記データ線にデータ信号を供給するためのデータ駆動部と、
    前記走査線に走査信号を供給するために前記走査線にそれぞれ接続されるステージを含む走査駆動部とを備え、
    前記ステージのそれぞれは、
    第１ノードおよび第２ノードに印加された電圧に対応して出力端子に第１電源または第３入力端子の電圧を供給するための出力部と、
    第１入力端子、第２入力端子および前記第３入力端子の信号に対応して前記第２ノードの電圧を制御するための第１駆動部と、
    前記第２入力端子および第２ノードの電圧に対応して前記第１ノードの電圧を制御するための第２駆動部とを備えることを特徴とする有機電界発光表示装置。
  15. 前記第３入力端子に供給されるクロック信号が前記走査信号として用いられることを特徴とする請求項１４に記載の有機電界発光表示装置。
  16. 前記第１入力端子は、前段ステージの走査信号または開始信号を受けることを特徴とする請求項１４又は１５に記載の有機電界発光表示装置。
  17. 奇数番目ステージの第２入力端子は第１クロック信号、第３入力端子は第２クロック信号を受け、
    偶数番目ステージの第２入力端子は第２クロック信号、第３入力端子は第１クロック信号を受けることを特徴とする請求項１６に記載の有機電界発光表示装置。
  18. 前記第１クロック信号および第２クロック信号は、同一の周期を有し、位相が互いに重畳しないことを特徴とする請求項１７に記載の有機電界発光表示装置。
  19. 前記第１駆動部は、
    前記第１入力端子と前記第２ノードとの間に位置し、ゲート電極が前記第２入力端子に接続される第１トランジスタと、
    前記第２ノードと前記第１電源との間に直列に位置する第２トランジスタおよび第３トランジスタとを備え、
    前記第２トランジスタのゲート電極は前記第３入力端子に接続され、前記第３トランジスタのゲート電極は前記第１ノードに接続されることを特徴とする請求項１７又は１８に記載の有機電界発光表示装置。
  20. 前記出力部は、
    前記第１電源と前記出力端子との間に位置し、ゲート電極が前記第１ノードに接続される第４トランジスタと、
    前記出力端子と前記第３入力端子との間に接続され、ゲート電極が前記第２ノードに接続される第５トランジスタと、
    前記第２ノードと前記出力端子との間に接続される第１キャパシタと、
    前記第１ノードと前記第１電源との間に接続される第２キャパシタとを備えることを特徴とする請求項１７〜１９のいずれか一項に記載の有機電界発光表示装置。
  21. 前記第２駆動部は、
    前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、
    前記第１ノードと前記第１電源より低い電圧に設定される第２電源との間に位置し、ゲート電極が前記第２入力端子に接続される第７トランジスタとを備えることを特徴とする請求項１７〜２０のいずれか一項に記載の有機電界発光表示装置。
  22. 前記第２駆動部は、
    前記第１ノードと前記第２入力端子との間に位置し、ゲート電極が前記第２ノードに接続される第６トランジスタと、
    前記第１ノードと前記第２入力端子との間にダイオード形態で接続される第７トランジスタとを備えることを特徴とする請求項１７〜２０のいずれか一項に記載の有機電界発光表示装置。
  23. 前記第７トランジスタは、前記第１ノードから前記第２入力端子に電流が流れ得るように接続されることを特徴とする請求項２２に記載の有機電界発光表示装置。
  24. 前記第１入力端子および第５入力端子と前記第１駆動部との間に接続される双方向駆動部をさらに備えることを特徴とする請求項１４〜２１のいずれか一項に記載の有機電界発光表示装置。
  25. 前記双方向駆動部は、
    前記第１入力端子と前記第１駆動部との間に位置し、第１制御信号が供給される時にターンオンされる第１０トランジスタと、
    前記第５入力端子と前記第１駆動部との間に位置し、第２制御信号が供給される時にターンオンされる第１１トランジスタとを備えることを特徴とする請求項２４に記載の有機電界発光表示装置。
  26. 前記第１入力端子は、前段ステージの出力信号または開始信号を受け、
    前記第５入力端子は、次段ステージの出力信号または開始信号を受けることを特徴とする請求項２５に記載の有機電界発光表示装置。
  27. 前記第１入力端子に供給される前段ステージの走査信号または開始信号は、前記第２入力端子に供給されるクロック信号と重畳することを特徴とする請求項１７に記載の有機電界発光表示装置。
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