TWI611391B - 級電路及使用其之有機發光顯示器 - Google Patents

級電路及使用其之有機發光顯示器 Download PDF

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Abstract

一種級電路包含具有第一節點與第二節點的輸出單元，輸出單元配置以根據施加至第一節點與第二節點階段電壓而供給第一電源供應器之電壓或第三輸入端之電壓給輸出端；配置以根據第一輸入端、第二輸入端與第三輸入端之訊號而控制第二節點之電壓的第一驅動器；配置以根據第二輸入端之訊號以及第二節點之電壓而控制第一節點之電壓的第二驅動器。

Description

級電路及使用其之有機發光顯示器
相關申請案之交互參照
本申請案主張於2012年9月20日向韓國智慧財產局提出之韓國專利申請號第10-2012-0104512號之優先權及效益，其全部內容係於此併入作為參考。
實施例係有關於一種級電路以及使用此級電路的有機發光顯示器。
近年來，已經發展出各種能夠減少重量與體積，此為陰極射線管(CRT)之缺點，的平面顯示器(FPD)。FPD包含液晶顯示器(LCD)、場射顯示器(FED)、電漿顯示面板(PDP)以及有機發光顯示器。
在FPD之中，有機發光顯示器係使用藉由電子與電洞再結合而產生光的有機發光二極體(OLED)來顯示影像。有機發光顯示器有高反應速度與低電力消耗。典型的有機發光顯示器係使用像素中形成的電晶體以供應對應於數據訊號之電流給OLED致使OLED發光。
傳統的有機發光顯示器包含用於供應數據訊號給數據線的數據驅動器、用於依序地供應掃描訊號給掃描線的掃描驅動器、以及含有耦接複數條掃描線與複數條數據線之複數個像素的像素單元。
當複數個掃描訊號供應至複數條掃描線時，係選擇像素單元中所包含的像素以接收來自數據線的數據訊號。接收數據訊號之像素係產生具有對應於數據訊號之預設亮度成分的光成分以顯示影像。
掃描驅動器包含耦接複數條掃描線之複數個級電路。此些級電路 係供給掃描訊號給耦接級電路的掃描線，以對應於供應至級電路的訊號。
一個或更多實施例係針對提供一種級電路，其包含具有第一節點與第二節點的輸出單元，輸出單元係配置以根據施加至第一節點與第二節點的電壓而供給第一電源供應器之電壓或第三輸入端之訊號給輸出端；配置以根據第一輸入端之訊號控制第二節點之電壓的第一驅動器；配置以根據第一輸入端之訊號控制第二節點之電壓的第一驅動器；第二輸入端；第三輸入端；以及配置以根據第二輸入端之訊號與第二節點之電壓來控制第一節點之電壓的第二驅動器。
第一輸入端可接收前級之輸出訊號或開始訊號。第二輸入端可接收第一時脈訊號。第三輸入端可接收第二時脈訊號。第一時脈訊號與第二時脈訊號有相同周期以及不相重疊的相位。第一時脈訊號與第二時脈訊號可具有二水平周期之周期，且可在不同水平周期供應低位準訊號。開始訊號可供應以重疊第一時脈訊號。
第一驅動器可包含位於第一輸入端與第二節點之間且具有耦接第二輸入端的閘極電極的第一電晶體、以及串聯設置於第二節點與第一電源供應器之間的第二電晶體與第三電晶體。第二電晶體的閘極電極可耦接第三輸入端，而第三電晶體的閘極電極可耦接第一節點。
輸出單元可包含位於第一電源供應器與輸出端之間且具有耦接第一節點之閘極電極的第四電晶體、耦接在輸出端與第三輸入端之間且具有耦接第二節點之閘極電極的第五電晶體、耦接在第二節點與輸出端之間的第一電容、以及耦接在第一節點與第一電源供應器之間的第二電容。
第二驅動器可包含位於第一節點與第二輸入端之間且具有耦接第二節點之閘極電極的第六電晶體、以及位於第一節點與第二電源供應器之間的第七電晶體，第二電源供應器具有比第一電源供應器更低的電壓，第七電晶體具有耦接第二輸入端的閘極電極。
第二驅動器可包含在第一節點與第二輸入端之間且具有耦接第二節點的閘極電極的第六電晶體、以及耦接在第一節點與第二輸入端之間且為 二極體形式連接的第七電晶體。第七電晶體係耦接在第一節點與第二輸入端之間，致使電流可從第一節點流向第二輸入端。
級電路可進一步包含耦接第一輸入端、第五輸入端以及第一驅動器的雙向驅動器。
雙向驅動器可包含在第一輸入端與第一驅動器之間的第十電晶體，當供應第一控制訊號時第十電晶體係開啟；以及包含在第五輸入端與第一驅動器之間的第十一電晶體，當供應第二控制訊號時第十一電晶體係開啟。第一輸入端可接收前級之輸出訊號或一開始訊號，而第五輸入端可接收下一級之輸出訊號或者一開始訊號。
一個或更多實施例係針對一種有機發光顯示器，其包含位於由複數條掃描線與複數條數據線分隔之複數區中的複數個像素、用於供應數據訊號給數據線的數據驅動器、以及含有為了供給複數個掃描訊號給掃描線而耦接掃描線之複數級的掃描驅動器。一個或更多實施例係針對一種有機發光顯示器，其包含位於由複數條掃描線與複數條數據線分隔之複數區中的複數個像素、用於供應數據訊號給數據線的數據驅動器、以及含有為了供給複數個掃描訊號給掃描線而耦接掃描線之複數級的掃描驅動器。
供應至第三輸入端之時脈訊號可用作掃描訊號。第一輸入端可接收開始訊號或前一級的掃描訊號。奇數級之第二輸入端可接收第一時脈訊號，而奇數級之第三輸入端係接收第二時脈訊號。偶數級之第二輸入端可接收第二時脈訊號，而偶數級之第三輸入端係接收第一時脈訊號。第一時脈訊號與第二時脈訊號可具有相同周期以及不相重疊的相位。
第一驅動器可包含位於第一輸入端與第二節點之間且具有耦接第二輸入端的閘極電極的第一電晶體、以及依序位於第二節點與第一電源供應器之間的第二電晶體與第三電晶體。第二電晶體的閘極電極可耦接第三輸入端，而第三電晶體的閘極電極可耦接第一節點。
供應至第一輸入端之開始訊號或前一級的掃描訊號可與供應至第二輸入端之時脈訊號相重疊。
10‧‧‧掃描驅動器
101‧‧‧第一輸入端
102‧‧‧第二輸入端
103‧‧‧第三輸入端
104‧‧‧輸出端
105‧‧‧第五輸入端
20‧‧‧數據驅動器
210‧‧‧第一驅動器
220、220a‧‧‧第二驅動器
230‧‧‧輸出單元
240‧‧‧雙向驅動器
30‧‧‧像素
40‧‧‧像素單元
50‧‧‧時序控制器
ST1、ST2、ST3、ST4‧‧‧級
VDD‧‧‧第一電源供應器
VSS‧‧‧第二電源供應器
M1‧‧‧第一電晶體
M2‧‧‧第二電晶體
M3‧‧‧第三電晶體
M4‧‧‧第四電晶體
M5‧‧‧第五電晶體
M6‧‧‧第六電晶體
M7、M7’‧‧‧第七電晶體
M10‧‧‧第十電晶體
M11‧‧‧第十一電晶體
N1‧‧‧第一節點
N2‧‧‧第二節點
C1‧‧‧第一電容
C2‧‧‧第二電容
CLK1‧‧‧第一時脈訊號
CLK2‧‧‧第二時脈訊號
SSP‧‧‧開始訊號
S1、S2…Sn‧‧‧掃描線
D1、D2…Dm‧‧‧數據線
CS1‧‧‧第一控制訊號
CS2‧‧‧第二控制訊號
1H‧‧‧水平周期
藉由參考附圖詳細描述例示性實施例可讓對此技術領域中的通常知識者對本發明之特性更為清晰，其中：第1圖繪示根據實施例之有機發光顯示器之圖式；第2圖係繪示繪示在第1圖中掃描驅動器之實施例之圖式；第3圖係繪示在第2圖中繪示的該級之第一實施例之電路圖；第4圖係繪示驅動第3圖中繪示之級電路的方法之波形圖；第5圖係繪示第3圖之級電路的模擬結果之波形圖；第6圖係繪示根據第二實施例之級電路圖；以及第7圖係繪示根據第三實施例之級電路之電路圖。
現在下文中係參考附圖以更完整地描述複數個實施例範例；然而，此些實施例可用不同的形式來體現而不應解釋成受上述複數個實施例限制。相反地，提供此些實施例是為了使本發明揭露徹底完全，且可將其實現方式完整地傳達給熟悉此領域之技術者。說明書中相似參考符號係參考至相似元件。亦可理解的將，當一元件被稱為「連接(connected)」、「耦接(coupled)」至另一元件，或者一元件係在另一元件「之間(between)」時，其可以是直接連接或耦接至其他元件，或是直接在其他元件之間，或者其間可存在中介元件。相反的，當一元件係指「直接連接(directly connected)」、或「直接耦接(directly coupled)」至"另一元件、或者一元件「直接」在另一元件「之間(directly between)」時，其間並無存在中介元件中介層。下文中，將參考第1圖至第7圖詳細描述級電路以及使用此級電路之有機發光顯示器，第1圖至第7圖係包含熟悉此領域之技術者可輕易實施的例示性實施例。
第1圖繪示根據實施例之有機發光顯示器之圖式。請參閱第1圖，根據實施例之有機發光顯示器包含具有位於掃描線S1至Sn與數據線D1至Dm交叉處之複數個像素30的像素單元40、用於驅動掃描線S1至Sn的掃描驅動器10、用於驅動數據線D1至Dm的數據驅動器20、以及用於控制掃描驅動器10與數據驅動器20的時序控制器50。
掃描驅動器10係供應複數個掃描訊號給複數條掃描線S1至Sn。 例如，掃描驅動器10可依序地供給複數個掃描訊號給複數條掃描線S1至Sn。在此情形中，係選擇在水平線單元中的像素30。為此目的，掃描驅動器10包含耦接複數條掃描線S1至Sn之級電路(在第2圖所示)。
數據驅動器20係與掃描訊號同步而供應數據訊號給數據線D1至Dm。然後，對應於數據訊號之電壓係對掃描訊號所選之像素30充電。
時序控制器50係控制掃描驅動器10與數據驅動器20。此外，時序控制器50係傳送來自外部的數據(圖中未顯示)給數據驅動器20。
當複數個掃描訊號供應以充電對應於數據訊號之電壓時，係選擇像素30，並供給對應於充電電壓的電流給有機發光二極體(圖中未顯示)以產生具有預設亮度要素的光要素。
第2圖係繪示繪示在第1圖中掃描驅動器之實施例之圖式。在第2圖中，為了方便，將僅繪示四個級。
請參閱第2圖，掃描驅動器10包含複數個級ST1至ST4。級ST1至ST4係分別地耦接複數條掃描線S1至S4，並根據時脈訊號CLK1與CLK2驅動。級ST1至ST4可具有相同電路布局。每一級ST1至ST4包含第一輸入端101、第二輸入端102、第三輸入端103以及輸出端104。
每一級ST1至ST4之第一輸入端101係接收前一級之輸出訊號，即掃描訊號，或開始訊號SSP。例如，第一級ST1之第一輸入端101係接收開始訊號SSP，而其他級ST2至ST4之第一輸入端101係接收前一級的輸出訊號。
第i級STi之第二輸入端102(i係奇數或偶數)係接收第一時脈訊號CLK1，而第i級STi之第三輸入端103係接收第二時脈訊號CLK2。第i+1級STi+1之第二輸入端102係接收第二時脈訊號CLK2，而第i+1級STi+1之第三輸入端103係接收第一時脈訊號CLK1。
第一時脈訊號CLK1與第二時脈訊號CLK2有相同周期以及不相重疊的相位。例如，當掃描訊號供應至一掃描線的周期係稱為一水平周期1H，時脈訊號CLK1與CLK2有二水平周期2H且係在不同水平周期供應。特別的是，雖然不供應第一時脈訊號CLK1與第二時脈訊號CLK2的時間可重疊，例如第一時脈訊號CLK1與第二時脈訊號CLK2可在同一時間有高位準，但是供應第一時脈訊號CLK1與第二時脈訊號CLK2的時間，例如第一時脈訊號CLK1與第二時脈訊號CLK2有低位準，係不重疊。
第3圖係繪示在第2圖中繪示的該級之第一實施例之電路圖。在第3圖中，為了方便，將繪示第一級ST1與第二級ST2。在第3圖中，電晶體係為PMOS電晶體。然而，實施例非受上述之限制。例如，電晶體可為NMOS電晶體。請參閱第3圖，根據第一實施例之級ST1包含第一驅動器210、第二驅動器220以及輸出單元230。
輸出單元230係根據施加至第一節點N1與第二節點N2之電壓而控制供應至輸出端104的電壓。為此目的，輸出單元230包含第四電晶體M4、第五電晶體M5、第一電容C1以及第二電容C2。
第四電晶體M4係位於第一電源供應器VDD與輸出端104之間。第四電晶體M4的閘極電極係耦接第一節點N1。第四電晶體M4係根據施加至第一節點N1之電壓而控制第一電源供應器VDD與輸出端104之間的耦合(coupling)。在此，第一電源供應器VDD係設定為截止電壓(gate off voltage)，例如，高位準電壓。
第五電晶體M5係位於輸出端104與第三輸入端103之間。第五電晶體M5的閘極電極係耦接第二節點N2。第五電晶體M5係根據施加至第二節點N2之電壓而控制輸出端104與第三輸入端103之間的耦合。
第一電容C1係耦接在第二節點N2與輸出端104之間。第一電容C1係充電對應於第五電晶體M5之開啟與關閉之電壓。
第二電容C2係耦接在第一節點N1與第一電源供應器VDD之間。第二電容C2係充電施加至第一節點N1之電壓。
第一驅動器210係根據供應給第一輸入端101至第三輸入端103的訊號而控制第二節點N2之電壓。為此目的，第一驅動器210包含第一電晶體M1、第二電晶體M2以及第三電晶體M3。
第一電晶體M1係位於第一輸入端101與第二節點N2之間。第一電晶體M1的閘極電極係耦接第二輸入端102。第一電晶體M1係根據供應至第二輸入端102之電壓而控制第一輸入端101與第二節點N2之間的耦合。
第二電晶體M2與第三電晶體M3係串聯耦接在第二節點N2與第一電源供應器VDD之間。特別的是，第二電晶體M2係位於第三電晶體M3與第二節點N2之間。第二電晶體M2的閘極電極係耦接第三輸入端103。第二電晶體M2係根據供應至第三輸入端103之電壓而控制第三電晶體M3與第二節點 N2之間的耦合。
第三電晶體M3係位於第二電晶體M2與第一電源供應器VDD之間。第三電晶體M3的閘極電極係耦接第一節點N1。第三電晶體M3係根據第一節點N1之電壓而控制第二電晶體M2與第一電源供應器VDD之間的耦合。
第二驅動器220係根據供應至第二輸入端102與第二節點N2之訊號而控制第一節點N1之電壓。為此目的，第二驅動器220包含第六電晶體M6與第七電晶體M7。
第六電晶體M6係位於第一節點N1與第二輸入端102之間。第六電晶體M6的閘極電極係耦接第二節點N2。第六電晶體M6係根據之第二節點N2之電壓而控制第一節點N1與第二輸入端102之間的耦合。
第七電晶體M7係位於第一節點N1與第二電源供應器VSS之間。第七電晶體M7的閘極電極係耦接第二輸入端102。第七電晶體M7係根據第二輸入端102之電壓而控制第一節點N1與第二電源供應器VSS之間的耦合。在此，第二電源供應器VSS係設定為導通電壓，例如，低位準電壓。
第4圖係繪示驅動第3圖中繪示之級電路的方法之波形圖。在第4圖中，為了方便，將使用第一級ST1描述操作過程。
請參閱第4圖，第一時脈訊號CLK1與第二時脈訊號CLK2有二水平周期且係在不同水平周期供應。開始訊號SSP(或前一級的輸出訊號)係與供應至第二輸入端102與第三輸入端103之時脈訊號CLK1或時脈訊號CLK2同步供應。
詳細地說明，在第三水平周期期間，開始訊號SSP係與第一時脈訊號CLK1同步供應。當供應第一時脈訊號CLK1時，第一電晶體M1與第七電晶體M7開啟。當第一電晶體M1開啟時，第一輸入端101與第二節點N2係彼此電性耦接。在此情形中，藉由供應至第一輸入端101的開始訊號SSP，第二節點N2係設定為低電壓。當第二節點N2設定為低電壓時，第五電晶體M5與第六電晶體M6係開啟。
當第五電晶體M5開啟，第三輸入端103與輸出端104係彼此電性耦接。在此，第三輸入端103係設定為高電壓，即，第二時脈訊號CLK2，如此高電壓係輸出至輸出端104。當第六電晶體M6開啟時，第二輸入端102與第一節點N1係彼此電性耦接。然後，供應至第二輸入端102的第一時脈訊號CLK1 之電壓，其為低電壓，係供應至第一節點N1。另外，因為第七電晶體M7開啟，第二電源供應器VSS之電壓係供應至第一節點N1。在此，第二電源供應器VSS之電壓係設定為與第一時脈訊號CLK1相同電壓(或相似電壓)，致使第一節點N1穩定地維持低電壓。
當低電壓供應至第一節點N1時，第四電晶體M4與第三電晶體M3開啟。當第三電晶體M3開啟，第一電源供應器VDD與第二電晶體M2係彼此電性耦接。在此，因為第二電晶體M2係設定為關閉狀態，雖然第三電晶體M3開啟，但是第二節點N2係穩定地維持低電壓。當第四電晶體M4開啟，第一電源供應器VDD之電壓係供應至輸出端104。在此，第一電源供應器VDD之電壓係設定為與供應至第三輸入端103之高電壓相同的電壓，致使輸出端104穩定地維持高電壓。
然後，停止開始訊號SSP與第一時脈訊號CLK1之供給。當停止第一時脈訊號CLK1之供給，第一電晶體M1與第七電晶體M7關閉。在此時，第五電晶體M5與第六電晶體M6係根據儲存在第一電容C1之電壓而維持開啟狀態。
當第五電晶體M5維持開啟狀態，輸出端104與第三輸入端103係維持電性耦合。因此，輸出端104係接收來自第三輸入端103的高電壓。
在另一方面，因為第六電晶體M6維持開啟狀態，第一節點N1與第二輸入端102係彼此電性耦接。在此，停止第一時脈訊號CLK1之供給時，第二輸入端102之電壓係設定為高電壓，致使第一節點N1係設定在高電壓。當高電壓供應至第一節點N1時，第四電晶體M4係關閉。
然後，在第四水平周期，第二時脈訊號CLK2係供應至第三輸入端103。在此時，因為第五電晶體M5係設定在開啟狀態，供應至第三輸入端103的第二時脈訊號CLK2係供應至輸出端104。在此情形中，輸出端104係輸出作為掃描訊號之第二時脈訊號CLK2給掃描線S1。
掃描訊號輸出至掃描線S1之後，在第五水平周期供應第一時脈訊號CLK1。當供應第一時脈訊號CLK1時，第一電晶體M1與第七電晶體M7開啟。當第五電晶體M5開啟時，第一輸入端101與第二節點N2係彼此電性耦接。在此時，開始訊號SSP係不供應至第一輸入端101，致使第一輸入端101設定成高電壓。因此，當第一電晶體M1開啟，高電壓係供應至第二節點N2， 致使第五電晶體M5與第六電晶體M6關閉。
當第七電晶體M7開啟，第二電源供應器VSS係供應至第一節點N1，致使第三電晶體M3與第四電晶體M4開啟。當第四電晶體M4開啟，第一電源供應器VDD之電壓係供應至輸出端104。然後，第四電晶體M4與第三電晶體M3根據在第二電容C2充電之電壓而維持在開啟狀態，致使輸出端104穩定地接收第一電源供應器VDD之電壓。
此外，當供應第二時脈訊號CLK2時，第二電晶體M2開啟。在此時，因為第三電晶體M3係設定在開啟狀態，第一電源供應器VDD的電壓係供應至第二節點N2。在此情形中，第五電晶體M5與第六電晶體M6係穩定地維持在關閉狀態。
第二級ST2係與第二時脈訊號CLK2同步地接收第一級ST1之輸出訊號(其為掃描訊號)。在此情形中，在第五水平周期期間，第二級ST2係與第一時脈訊號CLK1同步地輸出掃描訊號至第二掃描線S2。實施上，複數級ST係重複上述的流程以輸出掃描訊號至掃描線。
第5圖係繪示第3圖之級電路的模擬結果之波形圖。請參閱第5圖，根據第一實施例之使用級電路的掃描驅動器係依序地供應複數個掃描訊號給複數條掃描線。此外，根據第一實施例之級電路僅使用第一時脈訊號CLK1與第二時脈訊號CLK2便能輸出複數個掃描訊號至複數條掃描線。亦即，根據本發明之級電路不接收額外的初始化訊號，致使掃描訊號的寬度可設定為較大的(例如1H)。
第6圖係繪示根據第二實施例之級電路圖。在第6圖中，與第3圖所示相同的元件將以相同之參考符號標示，而將不再重複其詳細的描述。
請參閱第6圖，在根據第二實施例之級中，第二驅動器220a包含第七電晶體M7’，其在第一節點N1與第二輸入端102之間以二極體形式連接。亦即，第七電晶體M7’係接成二極體形式，致使電流可從第一節點N1流向第二輸入端102。在此情形中，當低電壓供應至第二輸入端102時，第一節點N1之電壓係降低至低電壓。因為其他操作流程係與根據第一實施例之級的操作流程相同，故將不再重複操作流程之敘述。
第7圖係繪示根據第三實施例之級電路之電路圖。在第7圖中，與第3圖所示相同的元件係以相同之參考符號標示，而將不再重複其詳細的描 述。
請參閱第7圖，根據第三實施例之級電路進一步包含雙向驅動器240。雙向驅動器240係執行控制致使掃描訊號可在第一方向上(從第一條掃描線S1至第n條掃描線Sn)或在第二方向上(從第n條掃描線Sn至第一條掃描線S1)供應。為此目的，雙向驅動器240包含第十電晶體M10以及第十一電晶體M11。
第十電晶體M10係耦接在第一輸入端101與第一驅動器210之間。當供應第一控制訊號CS1時，第十電晶體M10係開啟。在此，第一輸入端101係接收前一級的掃描訊號(或開始訊號)。
第十一電晶體M11係耦接在第五輸入端105與第一驅動器210之間。當供應第二控制訊號CS2時，第十一電晶體M11係開啟。在此，第五輸入端105係接收下一級的掃描訊號(或開始訊號)。
在所述之操作流程中，當供應第一控制訊號CS1，則第十電晶體M10開啟。當第十電晶體M10開啟，複數級係根據前一級的掃描訊號而被驅動，致使複數個掃描訊號係在第一方向上依序地輸出。
當供應第二控制訊號CS2時，第十一電晶體M11係開啟。當第十一電晶體M11開啟，複數級係根據下一級的掃描訊號而被驅動，致使複數個掃描訊號係在第二方向上輸出。因為其他驅動流程係與根據第一實施例之級的驅動流程相同，故將不再重複其描述。
藉由總結與回顧之方式，多個實施例係提供具有減少電晶體數量且僅使用第一時脈訊號與第二時脈訊號輸出掃描訊號的級電路。相反地，傳統級電路包含複數個電晶體，例如，至少十個電晶體，以供給掃描訊號，以及/或者除了第一時脈訊號與第二時脈訊號以外還需要使用初始化訊號。當級電路的電晶體數量增加，製成良率係下降，如此驅動穩定性會惡化。當需要更多初始化訊號時，則僅更少的時間能用於供應掃描訊號，從而減少穩定性。當電晶體數量增加以及/或者需要更多初始化訊號，會增加複雜度。因此，根據實施例之級電路以及使用此級電路的有機發光顯示器可改進穩定性以及減少複雜度。
在此已揭露複數個複數個實施例範例，雖然使用特定的用語，但其非為限制之目的而應僅以一般性與描述性語意解釋。在一些範例，對於本發明申請的技術領域中的通常知識者係明顯的是，除非另有具體說明，否則在特定實施例中描述的特徵、特性及/或元件係可單獨使用或是與其他實施例中描述 的特徵、特性及/或元件結合使用。因此，此技術領域中的技能者將理解的是在未脫離下列申請專利範圍中闡述之精神與範圍下形式上與細節上的各種改變皆為可行。
101‧‧‧第一輸入端
102‧‧‧第二輸入端
103‧‧‧第三輸入端
104‧‧‧輸出端
210‧‧‧第一驅動器
220‧‧‧第二驅動器
230‧‧‧輸出單元
ST1、ST2‧‧‧級
VDD‧‧‧第一電源供應器
VSS‧‧‧第二電源供應器
M1‧‧‧第一電晶體
M2‧‧‧第二電晶體
M3‧‧‧第三電晶體
M4‧‧‧第四電晶體
M5‧‧‧第五電晶體
M6‧‧‧第六電晶體
M7‧‧‧第七電晶體
N1‧‧‧第一節點
N2‧‧‧第二節點
C1‧‧‧第一電容
C2‧‧‧第二電容
CLK1‧‧‧第一時脈訊號
CLK2‧‧‧第二時脈訊號
SSP‧‧‧開始訊號
S1、S2‧‧‧掃描線

Claims (20)

  1. 一種級電路，包含：一輸出單元，具有一第一節點與一第二節點，該輸出單元係配置以根據施加至該第一節點與該第二節點之電壓而供給一第一電源供應器之電壓或一第三輸入端之訊號給一輸出端；一第一驅動器，係配置以根據一第一輸入端、一第二輸入端以及該第三輸入端之訊號而控制該第二節點之該電壓；以及一第二驅動器，係配置以根據該第二輸入端之該訊號與該第二節點之電壓而控制該第一節點之該電壓，其中該第三輸入端之訊號控制該第一驅動器之一第二電晶體之開啟及關閉操作。
  2. 如申請專利範圍第1項所述之級電路，其中該第一輸入端係接收一前一級之一輸出訊號或一開始訊號，其中該第二輸入端係接收一第一時脈訊號，以及其中該第三輸入端係接收一第二時脈訊號。
  3. 如申請專利範圍第2項所述之級電路，其中該第一時脈訊號與該第二時脈訊號有相同周期以及不重疊的相位。
  4. 如申請專利範圍第3項所述之級電路，其中該第一時脈訊號與該第二時脈訊號有等於二個水平周期之周期，且在不同水平周期供應為低訊號。
  5. 如申請專利範圍第2項所述之級電路，其中該開始訊號係供應以重疊該第一時脈訊號。
  6. 如申請專利範圍第2項所述之級電路，其中該第一驅動器包含：一第一電晶體，係在該第一輸入端與該第二節點之間，該第一電晶體具有耦接該第二輸入端的一閘極電極；以及該第二電晶體與一第三電晶體，係串聯於該第二節點與該第一電源供應器之間，其中該第二電晶體的一閘極電極係耦接該第三輸入端，以及其中該第三電晶體的一閘極電極係耦接該第一節點。
  7. 如申請專利範圍第2項所述之級電路，其中該輸出單元包含：一第四電晶體，係位在該第一電源供應器與該輸出端之間，該第四電晶體具有耦接該第一節點的閘極電極；一第五電晶體，係位在該輸出端與該第三輸入端之間，該第五電晶體具有耦接該第二節點的閘極電極；一第一電容，係位在該第二節點與該輸出端之間；以及一第二電容，係位在該第一節點與該第一電源供應器之間。
  8. 如申請專利範圍第2項所述之級電路，其中該第二驅動器包含：一第六電晶體，係位在該第一節點與該第二輸入端之間，該第六電晶體具有耦接該第二節點之閘極電極；以及一第七電晶體，係位在該第一節點與一第二電源供應器之間，該第二電源供應器具有比該第一電源供應器更低的電壓，該第七電晶體具有耦接該第二輸入端之閘極電極。
  9. 如申請專利範圍第2項所述之級電路，其中該第二驅動器包 含：一第六電晶體，係位在該第一節點與該第二輸入端之間，該第六電晶體具有耦接該第二節點之一閘極電極；以及一第七電晶體，係位在該第一節點與該第二輸入端之間，該第七電晶體係以二極體形式連接。
  10. 如申請專利範圍第9項所述之級電路，其中該第七電晶體係耦接在該第一節點與該第二輸入端之間，致使一電流從該第一節點流向該第二輸入端。
  11. 如申請專利範圍第1項所述之級電路，進一步包含耦接該第一輸入端、一第五輸入端以及該第一驅動器的一雙向驅動器。
  12. 如申請專利範圍第11項所述之級電路，其中該雙向驅動器包含：一第十電晶體，係位於該第一輸入端與該第一驅動器之間，當供應一第一控制訊號時該第十電晶體係開啟；以及一第十一電晶體，係位於該第五輸入端與該第一驅動器之間，當供應一第二控制訊號時該第十一電晶體係開啟。
  13. 如申請專利範圍第12項所述之級電路，其中該第一輸入端係接收一前一級之一輸出訊號或該開始訊號，以及其中該第五輸入端係接收一下一級之一輸出訊號或該開始訊號。
  14. 一種有機發光顯示器，包含：複數個像素，係位於藉由複數條掃描線與複數條數據線分隔的複數區中； 一數據驅動器，用於供應複數個數據訊號至複數條數據線；以及一掃描驅動器，係含有為了供給複數個掃描訊號至該複數條掃描線而耦接該複數條掃描線的複數級，其中該每一級包含：一輸出單元，係具有一第一節點與一第二節點，該輸出單元係配置以根據施加至該第一節點與該第二節點之電壓而供給一第一電源供應器之電壓或一第三輸入端之訊號給一輸出端，一第一驅動器，係配置以根據一第一輸入端、一第二輸入端與該第三輸入端之訊號而控制該第二節點之該電壓，以及一第二驅動器，係配置以根據該第二輸入端之該訊號與該第二節點之該電壓而控制該第一節點之該電壓，其中該第三輸入端之訊號控制該第一驅動器之一第二電晶體之開啟及關閉操作。
  15. 如申請專利範圍第14項所述之有機發光顯示器，其中供應至該第三輸入端的一時脈訊號係用作為該掃描訊號。
  16. 如申請專利範圍第14項所述之有機發光顯示器，其中該第一輸入端係接收一前一級的一掃描訊號或一開始訊號。
  17. 如申請專利範圍第16項所述之有機發光顯示器，其中複數個奇數級之複數個第二輸入端係接收一第一時脈訊號，而該複數個奇數級之複數個第三輸入端係接收一第二時脈訊號，以及 其中複數個偶數級之複數個第二輸入端係接收該第二時脈訊號，而該複數個偶數級之複數個第三輸入端係接收該第一時脈訊號。
  18. 如申請專利範圍第17項所述之有機發光顯示器，其中該第一時脈訊號與該第二時脈訊號有相同周期以及不相重疊的相位。
  19. 如申請專利範圍第17項所述之有機發光顯示器，其中該第一驅動器包含：一第一電晶體，係在該第一輸入端與該第二節點之間，該第一電晶體具有耦接該第二輸入端的一閘極電極；以及該第二電晶體與一第三電晶體，係串聯於該第二節點與該第一電源供應器之間，其中該第二電晶體之閘極電極係耦接該第三輸入端，以及其中該第三電晶體之閘極電極係耦接該第一節點。
  20. 如申請專利範圍第17項所述之有機發光顯示器，其中供應至該第一輸入端的該前一級之該掃描訊號或該開始訊號係重疊於供應至該第二輸入端之該時脈訊號。
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