KR102586039B1 - 표시장치 - Google Patents

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Abstract

본 발명의 실시예들은 표시장치를 개시한다.
본 발명의 일 실시예에 따른 표시장치는, 기판의 표시 영역에, 제1 방향으로 연장된 복수의 게이트선들; 및 상기 기판의 비표시 영역에, 상기 복수의 게이트선들에 연결된 복수의 스테이지들과, 상기 복수의 스테이지들과 연결되어 상기 복수의 스테이지들로 제1 직류전압을 공급하는 제1 전압선 및 제2 직류전압을 공급하는 제2 전압선을 포함하는 구동부;를 포함하고, 상기 구동부가, 상기 복수의 스테이지들 중 적어도 하나의 스테이지에 연결되고, 한 쌍의 전극들 중 적어도 하나의 전극이 상기 제1 전압선 및 상기 제2 전압선 중 적어도 하나의 일부와 전기적으로 연결된 적어도 하나의 커패시터;를 포함한다.

Description

표시장치{Display apparatus}
본 발명의 실시예들은 표시장치, 보다 구체적으로 구동부를 포함하는 표시장치에 관한 것이다.
유기 발광 표시장치, 액정 표시장치 등과 같은 표시 장치는 복수의 화소들을 포함하는 표시부와 표시부를 구동하는 구동부를 포함한다. 구동부는 표시부의 화소들에 주사신호를 공급하는 주사 구동부 및 표시부의 화소들에 데이터 신호를 공급하는 데이터 구동부 등을 포함할 수 있다. 화소들은 주사 구동부 및 데이터 구동부로부터 수신된 주사신호 및 데이터신호에 기초하여 영상을 표시하도록 발광할 수 있다.
본 발명의 실시예들은 표시특성을 향상시킬 수 있는 표시장치를 제공하는 것이다.
본 발명의 일 실시예에 따른 표시장치는, 기판의 표시 영역에, 제1 방향으로 연장된 복수의 게이트선들; 및 상기 기판의 비표시 영역에, 상기 복수의 게이트선들에 연결된 복수의 스테이지들과, 상기 복수의 스테이지들과 연결되어 상기 복수의 스테이지들로 제1 직류전압을 공급하는 제1 전압선 및 제2 직류전압을 공급하는 제2 전압선을 포함하는 구동부;를 포함하고, 상기 구동부가, 상기 복수의 스테이지들 중 적어도 하나의 스테이지에 연결되고, 한 쌍의 전극들 중 적어도 하나의 전극이 상기 제1 전압선 및 상기 제2 전압선 중 적어도 하나의 일부와 전기적으로 연결된 적어도 하나의 커패시터;를 포함한다.
상기 적어도 하나의 커패시터는, 상기 제1 방향과 수직인 제2 방향으로 연장된 상기 제1 전압선의 일부를 포함하는 제1 전극과, 상기 제2 전압선과 전기적으로 연결되고 상기 제1 전압선을 따라 상기 제1 전극과 중첩하는 제2 전극을 포함하는 제1 커패시터; 및 상기 제1 방향과 수직인 제2 방향으로 연장된 상기 제2 전압선의 일부를 포함하는 제3 전극과, 상기 제1 전압선과 전기적으로 연결되고 상기 제2 전압선을 따라 상기 제3 전극과 중첩하는 제4 전극을 포함하는 제2 커패시터; 중 적어도 하나를 포함할 수 있다.
상기 제1 전압선은, 상기 제2 방향으로 연장된 제1 메인선, 및 상기 제1 방향으로 연장되며 상기 제1 메인선과 상기 복수의 스테이지들을 연결하는 복수의 제1 연결선들을 포함하고, 상기 제2 전압선은, 상기 제2 방향으로 연장된 제2 메인선, 및 상기 제1 방향으로 연장되며 상기 제2 메인선과 복수의 스테이지들을 연결하는 복수의 제2 연결선들을 포함할 수 있다.
상기 제1 연결선들의 상기 제2 메인선과 교차하는 부분은 상기 제2 전극의 일부일 수 있다.
상기 적어도 하나의 커패시터는 인접한 제1 연결선들 사이에 배치될 수 있다.
상기 적어도 하나의 커패시터는 적어도 두 개의 스테이지들이 공유할 수 있다.
상기 제1 커패시터와 상기 제2 커패시터가 상기 제2 방향을 따라 교대로 배치될 수 있다.
상기 제1 연결선들 중 적어도 하나는 상기 제1 커패시터와 상기 제2 커패시터 사이에 배치될 수 있다.
상기 표시장치는, 상기 제1 전압선과 병렬 배치되고 제3 직류전압을 인가받는 제3 전압선; 및 상기 제2 전압선과 병렬 배치된 제4 직류전압을 인가받는 제4 전압선;을 더 포함하고, 상기 적어도 하나의 커패시터는, 상기 제3 전압선의 일부를 포함하는 제5 전극과, 상기 제1 전압선과 전기적으로 연결되고 상기 제3 전압선을 따라 상기 제5 전극과 중첩하는 제6 전극을 포함하는 제3 커패시터; 및 상기 제4 전압선의 일부를 포함하는 제7 전극과, 상기 제2 전압선과 전기적으로 연결되고 상기 제4 전압선을 따라 상기 제7 전극과 중첩하는 제8 전극을 포함하는 제4 커패시터;를 포함할 수 있다.
상기 제3 전압선 또는 상기 제4 전압선은 상기 제1 전압선과 상기 제2 전압선 사이에 배치될 수 있다.
상기 제1 직류전압과 상기 제3 직류전압이 동일할 수 있다.
상기 제2 직류전압과 상기 제4 직류전압이 동일할 수 있다.
상기 제3 커패시터 또는 상기 제4 커패시터는 적어도 두 개의 스테이지들이 공유할 수 있다.
상기 제3 커패시터와 상기 제4 커패시터가 상기 제2 방향을 따라 교대로 배치될 수 있다.
본 발명의 일 실시예에 따른 표시장치는, 기판 상에 제2 방향으로 배열되고 게이트 신호를 출력하는 복수의 스테이지들; 상기 제2 방향으로 연장된 제1 메인선, 및 상기 제1 메인선과 다른 층에 배치되며 상기 제2 방향에 수직인 제1 방향으로 연장되고, 상기 제1 메인선과 상기 복수의 스테이지들을 연결하는 복수의 제1 연결선들을 포함하고, 상기 복수의 스테이지들로 제1 직류전압을 공급하는 제1 전압선; 상기 제2 방향으로 연장되고 상기 제1 메인선과 동일층에 배치된 제2 메인선, 및 상기 제2 메인선으로부터 상기 제1 방향으로 연장되고, 상기 제2 메인선과 상기 복수의 스테이지들을 연결하는 복수의 제2 연결선들을 포함하고, 상기 복수의 스테이지들로 제2 직류전압을 공급하는 제2 전압선; 및 상기 복수의 스테이지들 중 적어도 하나의 스테이지에 연결되고, 상기 제1 연결선들과 동일층에 배치되며 상기 제1 메인선 및 상기 제2 메인선 중 적어도 하나의 일부와 전기적으로 연결된 전극을 포함하는 적어도 하나의 커패시터;를 포함한다.
상기 적어도 하나의 커패시터는, 상기 제1 메인선의 일부를 포함하는 제1 전극과, 상기 제2 메인선과 전기적으로 연결되고 상기 제1 메인선을 따라 상기 제1 전극과 중첩하는 제2 전극을 포함하는 제1 커패시터; 및 상기 제2 메인선의 일부를 포함하는 제3 전극과, 상기 제1 메인선과 전기적으로 연결되고 상기 제2 메인선을 따라 상기 제3 전극과 중첩하는 제4 전극을 포함하는 제2 커패시터; 중 적어도 하나를 포함할 수 있다.
상기 제1 커패시터 또는 상기 제2 커패시터는 적어도 두 개의 스테이지들이 공유할 수 있다.
상기 표시장치는, 상기 제1 전압선과 병렬 배치되고 제3 직류전압이 인가되는 제3 전압선; 및 상기 제2 전압선과 병렬 배치되고 제4 직류전압이 인가되는 제4 전압선;을 더 포함하고, 상기 적어도 하나의 커패시터는, 상기 제3 전압선의 일부를 포함하는 제5 전극과, 상기 제1 메인선과 전기적으로 연결되고 상기 제3 전압선을 따라 상기 제5 전극과 중첩하는 제6 전극을 포함하는 제3 커패시터; 및 상기 제4 전압선의 일부를 포함하는 제7 전극과, 상기 제2 메인선과 전기적으로 연결되고 상기 제4 전압선을 따라 상기 제7 전극과 중첩하는 제8 전극을 포함하는 제4 커패시터;를 포함할 수 있다.
상기 제1 직류전압과 상기 제3 직류전압이 동일할 수 있다.
상기 제2 직류전압과 상기 제4 직류전압이 동일할 수 있다.
상기 제3 커패시터 또는 상기 제4 커패시터는 적어도 두 개의 스테이지들이 공유할 수 있다.
본 발명의 실시예들은 구동부와 연결되는 배선들의 전압 왜곡을 방지하여 구동부를 안정적으로 동작시킴으로써 표시장치의 표시특성을 향상시킬 수 있다.
도 1은 본 발명의 일 실시예에 따른 표시장치의 구조를 개략적으로 나타낸 도면이다.
도 2는 본 발명의 다른 실시예에 따른 표시장치의 구조를 개략적으로 나타낸 도면이다.
도 3은 본 발명의 일 실시예에 따른 주사 구동부와 발광제어 구동부를 개략적으로 나타낸 블록도이다.
도 4는 본 발명의 일 실시예에 따른 주사 구동부와 발광제어 구동부의 배선을 구체적으로 나타낸 평면도이다.
도 5는 본원발명의 일 실시예에 따른 주사 구동부의 임의의 스테이지를 나타낸 도면이다.
도 6은 본원발명의 일 실시예에 따른 발광제어 구동부의 임의의 스테이지를 나타낸 도면이다.
도 7은 주사 구동부 및/또는 발광제어 구동부가 구동 개시시에 제1 구동전압(VGH)과 제2 구동전압(VGL)이 쇼트되는 현상의 시뮬레이션 결과이다.
도 8은 본 발명의 일 실시예에 따른 주사 구동부 및/또는 발광제어 구동부를 개략적으로 나타낸 블록도이다.
도 9는 주사 구동부 및/또는 발광제어 구동부가 홀드 커패시터(Ch)를 구비하는 경우, 구동 개시시에 제1 구동전압(VGH)과 제2 구동전압(VGL)이 안정적으로 인가됨을 보여주는 시뮬레이션 결과이다.
도 10 내지 도 15는 도 8에 도시된 홀드 커패시터의 구현 예를 나타낸 평면도이다.
도 11은 도 10의 A-A'를 따라 자른 단면도이다.
도 16은 본 발명의 다른 실시예에 따른 주사 구동부 및/또는 발광제어 구동부를 개략적으로 나타낸 블록도이다.
도 17 및 도 18은 도 16에 도시된 홀드 커패시터의 구현 예를 나타낸 평면도이다.
도 19는 본 발명의 일 실시예에 따른 표시장치를 개략적으로 나타낸 도면이다.
도 20은 도 19에 도시된 주사 구동부 및/또는 발광제어 구동부를 구성하는 임의의 스테이지를 개략적으로 나타낸 도면이다.
본 발명은 다양한 변환을 가할 수 있고 여러 가지 실시예를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 상세한 설명에 상세하게 설명하고자 한다. 본 발명의 효과 및 특징, 그리고 그것들을 달성하는 방법은 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 다양한 형태로 구현될 수 있다.
이하의 실시예에서, 제1, 제2 등의 용어는 한정적인 의미가 아니라 하나의 구성 요소를 다른 구성 요소와 구별하는 목적으로 사용되었다.
이하의 실시예에서, 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
이하의 실시예에서, 포함하다 또는 가지다 등의 용어는 명세서상에 기재된 특징, 또는 구성요소가 존재함을 의미하는 것이고, 하나 이상의 다른 특징들 또는 구성요소가 부가될 가능성을 미리 배제하는 것은 아니다.
이하의 실시예에서, 막, 영역, 구성 요소 등의 부분이 다른 부분 위에 또는 상에 있다고 할 때, 다른 부분의 바로 위에 있는 경우뿐만 아니라, 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 있는 경우도 포함한다.
도면에서는 설명의 편의를 위하여 구성 요소들이 그 크기가 과장 또는 축소될 수 있다. 예컨대, 도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 임의로 나타내었으므로, 본 발명이 반드시 도시된 바에 한정되지 않는다.
본 명세서에서 "대응하는" 또는 "대응하게"라는 용어는 문맥에 따라서 동일한 열 또는 행에 배치된다 또는 연결된다는 것을 의미할 수 있다. 예컨대, 제1 부재가 복수의 제2 부재들 중에서 "대응하는" 제2 부재에 연결된다는 것은 제1 부재와 동일 열 또는 동일 행에 배치된 제2 부재에 연결된다는 것을 의미한다.
이하, 첨부된 도면을 참조하여 본 발명의 실시예들을 상세히 설명하기로 하며, 도면을 참조하여 설명할 때 동일하거나 대응하는 구성 요소는 동일한 도면부호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
도 1은 본 발명의 일 실시예에 따른 표시장치의 구조를 개략적으로 나타낸 도면이다.
도 1을 참조하면, 일 실시예에 따른 표시장치(1)는 표시부(10A), 구동부(20A) 및 전원공급부(30)를 포함할 수 있다.
표시장치(1)는 액정 표시장치(Liquid crystal display), 유기발광표시장치 (organic light emitting display), 전기영동 표시장치(electrophoretic display), 또는 일렉트로웨팅 표시장치(electrowetting display panel) 등일 수 있다. 이하에서는 유기발광표시장치를 예로서 설명한다.
표시부(10A)는 복수의 데이터선들(DL1 내지 DLm), 복수의 주사선들(SL1 내지 SLn), 및 복수의 화소(PX)들을 포함할 수 있다. 복수의 주사선들(SL1 내지 SLn)은 제1 방향을 따라 배치되고, 복수의 데이터선들(DL1 내지 DLm)은 제2 방향을 따라 배치될 수 있다. 복수의 화소(PX)들 각각은 복수의 데이터선들(DL1 내지 DLm) 중 대응하는 데이터선과 복수의 주사선들(SL1 내지 SLn) 중 대응하는 주사선에 연결되어, 데이터신호 및 주사신호를 공급받을 수 있다. 화소(PX)는 발광소자 및 발광소자에 전기적으로 연결된 화소회로를 포함할 수 있다.
구동부(20A)는 표시부(10A)의 영상 표시 동작을 제어할 수 있다. 구동부(20)는 주사 구동부(110), 데이터 구동부(120) 및 제어부(150)를 포함한다.
주사 구동부(110)는 제어부(150)로부터 주사 구동부 제어신호(SCS)를 공급받고, 그에 대응하여 주사신호를 생성하고, 주사신호를 주사선들(SL1 내지 SLn)로 공급할 수 있다.
데이터 구동부(120)는 제어부(150)로부터 영상 데이터(DATA) 및 데이터 구동부 제어신호(DCS)를 공급받고, 그에 대응하여 데이터신호를 생성하고, 데이터신호를 데이터선들(DL1 내지 DLm)로 공급할 수 있다.
제어부(150)는 주사 구동부(110), 데이터 구동부(120) 및 전원공급부(30)를 제어할 수 있다. 제어부(150)는 외부로부터의 제어신호를 기초로 주사 구동부 제어신호(SCS), 데이터 구동부 제어신호(DCS), 전원 공급 제어신호(PCS)를 생성하여, 주사 구동부(110), 데이터 구동부(120) 및 전원공급부(30)를 제어할 수 있다.
일 실시예에서, 구동부(20A)는 표시부(10A) 외측의 기판의 비표시 영역에 직접 위치할 수 있다. 다른 실시예에서, 구동부(20A)는 별도의 구성 요소(예를 들어, 회로 기판(circuit board))를 통해 표시부(10A)와 연결될 수 있다. 다른 실시예에서, 구동부(20A)의 일부(예를 들어, 주사 구동부)는 비표시 영역에 직접 위치하고, 구동부(20A)의 나머지는 별도의 구성 요소(예를 들어, 회로 기판(circuit board))를 통해 표시부(10A)와 연결될 수 있다. 비표시 영역에 위치하는 구동부(20A)는 표시부(10A)의 화소회로 형성과 동시에 형성될 수 있다.
전원 공급부(30)는 제1 전원선(171) 및 제2 전원선(172)을 통해 각 화소(PX)로 제1 전원전압(ELVDD) 및 제2 전원전압(ELVSS)을 공급할 수 있다. 제1 전원전압(ELVDD) 및 제2 전원전압(ELVSS)은 상이한 전압일 수 있다. 제2 전원전압(ELVSS)은 제1 전원전압(ELVDD)보다 낮은 전압일 수 있다. 예를 들어,제1 전원전압(ELVDD)은 양전압이고, 제2 전원전압(ELVSS)은 음전압 또는 그라운드 전압일 수 있다.
전원 공급부(30)는 주사 구동부(110)로 제1 구동전압(VGH) 및 제2 구동전압(VGL)을 공급할 수 있다. 제1 구동전압(VGH) 및 제2 구동전압(VGL)은 상이한 전압일 수 있다. 예를 들어, 제1 구동전압(VGH)은 제1 전원전압(ELVDD) 보다 높은 양전압이고, 제2 구동전압(VGL)은 제2 전원전압(ELVSS) 보다 낮은 음전압일 수 있다.
도 2는 본 발명의 다른 실시예에 따른 표시장치의 구조를 개략적으로 나타낸 도면이다.
도 2를 참조하면, 일 실시예에 따른 표시장치(2)는 표시부(10B), 구동부(20B), 발광제어 구동부(160) 및 전원공급부(30)를 포함할 수 있다.
표시장치(2)는 액정 표시장치(Liquid crystal display), 유기발광표시장치 (organic light emitting display), 전기영동 표시장치(electrophoretic display), 또는 일렉트로웨팅 표시장치(electrowetting display panel) 등일 수 있다. 이하에서는 유기발광표시장치를 예로서 설명한다.
표시부(10B)는 복수의 데이터선들(DL1 내지 DLm), 복수의 주사선들(SL1 내지 SLn), 복수의 발광제어선들(EL1 내지 ELn) 및 복수의 화소(PX)들을 포함할 수 있다. 복수의 주사선들(SL1 내지 SLn) 및 복수의 발광제어선들(EL1 내지 ELn)은 제1 방향을 따라 배치되고, 복수의 데이터선들(DL1 내지 DLm)은 제2 방향을 따라 배치될 수 있다. 복수의 화소(PX)들 각각은 복수의 주사선들(SL1 내지 SLn) 중 대응하는 주사선, 복수의 데이터선들(DL1 내지 DLm) 중 대응하는 데이터선, 및 복수의 발광제어선들(EL1 내지 ELn) 중 대응하는 발광제어선에 연결되어, 주사신호, 데이터신호 및 발광제어신호를 공급받을 수 있다.
구동부(20B)는 표시부(10B)의 영상 표시 동작을 제어할 수 있다. 구동부(20B)는 주사 구동부(110), 데이터 구동부(120), 발광제어 구동부(160) 및 제어부(150)를 포함한다.
주사 구동부(110)는 제어부(150)로부터 주사 구동부 제어신호(SCS)를 공급받고, 그에 대응하여 주사신호를 생성하고, 주사신호를 주사선들(SL1 내지 SLn)로 공급할 수 있다.
데이터 구동부(120)는 제어부(150)로부터 영상 데이터(DATA) 및 데이터 구동부 제어신호(DCS)를 공급받고, 그에 대응하여 데이터신호를 생성하고, 데이터신호를 데이터선들(DL1 내지 DLm)로 공급할 수 있다.
발광제어 구동부(160)는 제어부(150)로부터 발광제어 구동부 제어신호(ECS)를 공급받고, 그에 대응하여 발광제어신호를 생성하고, 발광제어신호를 발광제어선들(EL1 내지 ELn)로 공급할 수 있다.
제어부(150)는 주사 구동부(110), 데이터 구동부(120), 발광제어 구동부(160) 및 전원공급부(30)를 제어할 수 있다. 제어부(150)는 외부로부터의 제어신호를 기초로 주사 구동부 제어신호(SCS), 데이터 구동부 제어신호(DCS), 전원 공급 제어신호(PCS), 발광제어 구동부 제어신호(ECS)를 생성하여, 주사 구동부(110), 데이터 구동부(120), 발광제어 구동부(160) 및 전원공급부(30)를 제어할 수 있다.
일 실시예에서, 구동부(20B)는 표시부(10B) 외측의 기판의 비표시 영역에 직접 위치할 수 있다. 다른 실시예에서, 구동부(20B)는 별도의 구성 요소(예를 들어, 회로 기판(circuit board))를 통해 표시부(10B)와 연결될 수 있다. 다른 실시예에서, 구동부(20B)의 일부(예를 들어, 주사 구동부 및/또는 발광제어 구동부)는 비표시 영역에 직접 위치하고, 구동부(20B)의 나머지는 별도의 구성 요소(예를 들어, 회로 기판(circuit board))를 통해 표시부(10B)와 연결될 수 있다. 비표시 영역에 위치하는 구동부(20B)는 표시부(10B)의 화소회로 형성과 동시에 형성될 수 있다.
전원 공급부(30)는 제1 전원선(171) 및 제2 전원선(172)을 통해 각 화소(PX)로 제1 전원전압(ELVDD) 및 제2 전원전압(ELVSS)을 공급할 수 있다. 제1 전원전압(ELVDD) 및 제2 전원전압(ELVSS)은 상이한 전압일 수 있다. 제2 전원전압(ELVSS)은 제1 전원전압(ELVDD)보다 낮은 전압일 수 있다. 예를 들어,제1 전원전압(ELVDD)은 양전압이고, 제2 전원전압(ELVSS)은 음전압 또는 그라운드 전압일 수 있다.
전원 공급부(30)는 주사 구동부(110) 및 발광제어 구동부(160)로 제1 구동전압(VGH) 및 제2 구동전압(VGL)을 공급할 수 있다. 제1 구동전압(VGH) 및 제2 구동전압(VGL)은 상이한 전압일 수 있다. 예를 들어, 제1 구동전압(VGH)은 제1 전원전압(ELVDD) 보다 높은 양전압이고, 제2 구동전압(VGL)은 제2 전원전압(ELVSS) 보다 낮은 음전압일 수 있다.
도 2에서 전원 공급부(30)는 주사 구동부(110)와 발광제어 구동부(160)로 동일한 제1 구동전압(VGH) 및 제2 구동전압(VGL)을 공급하고 있으나, 다른 실시예에서, 전원 공급부(30)는 주사 구동부(110)로 공급하는 제1 구동전압(VGH) 및 제2 구동전압(VGL)과 상이한 제3 구동전압 및 제4 구동전압을 발광제어 구동부(160)로 공급할 수 있다.
도 1 및 도 2에 도시된 주사 구동부(110)와 발광제어 구동부(160)는 각각 복수의 스테이지들(ST1 내지 STn)을 포함하는 쉬프트 레지스터로 구현될 수 있다.
도 3은 본 발명의 일 실시예에 따른 주사 구동부와 발광제어 구동부를 개략적으로 나타낸 블록도이다. 도 4는 본 발명의 일 실시예에 따른 주사 구동부와 발광제어 구동부의 배선을 구체적으로 나타낸 평면도이다.
주사 구동부(110) 및 발광제어 구동부(160)는 기판 상에 직접 형성될 수 있다. 주사 구동부(110) 및 발광제어 구동부(160)는 각각 복수의 스테이지들(ST1 내지 STn)을 포함하고, 복수의 스테이지들(ST1 내지 STn) 각각은 출력단자(OT)를 통해 출력신호(OUT1 내지 OUTn)를 출력할 수 있다. 주사 구동부(110)인 경우 출력단자(OT)들은 주사선들(SL1 내지 SLn)에 연결되고, 주사신호를 출력신호(OUT)로서 주사선들(SL1 내지 SLn)로 공급할 수 있다. 주사신호는 주사선들(SL1 내지 SLn)을 통해 화소(PX)들로 공급될 수 있다. 발광제어 구동부(160)인 경우 출력단자(OT)들은 발광제어선들(EL1 내지 ELn)에 연결되고, 발광제어신호를 출력신호(OUT)로서 발광제어선들(EL1 내지 ELn)로 공급할 수 있다. 발광제어신호는 발광제어선들(EL1 내지 ELn)을 통해 화소(PX)들로 공급될 수 있다.
스테이지들(ST1 내지 STn) 각각은 스테이지들(ST1 내지 STn) 외측에 배열된 복수의 배선들에 연결될 수 있다. 복수의 배선들은 제1 구동전압선(301)과 제2 구동전압선(305)을 포함하는 전압선들, 및 제1 클락선(401)과 제2 클락선(405)을 포함하는 클락선들을 포함할 수 있다. 복수의 배선들 각각은 연결선들을 통해 스테이지들(ST1 내지 STn)에 연결될 수 있다. 도 3에서는 두 개의 전압선들 및 두 개의 클락선들만이 도시되어 있으나, 스테이지를 구성하는 회로 구성에 따라 두 개 이상의 전압선들 및/또는 두 개 이상의 클락선들이 스테이지에 연결될 수 있다.
전압선들의 연결선들이 클락선들과 중첩하지 않도록 전압선들과 클락선들은 좌우 분리 배치될 수 있다. 일 실시예에서, 제1 구동전압선(301)과 제2 구동전압선(305)은 스테이지들(ST1 내지 STn)의 좌측에 병렬로 이격 배치될 수 있다. 제1 클락선(401) 및 제2 클락선(405)은 스테이지들(ST1 내지 STn)의 우측에 병렬로 이격 배치될 수 있다. 다른 실시예에서, 제1 구동전압선(301)과 제2 구동전압선(305)은 스테이지들(ST1 내지 STn)의 우측에 병렬로 이격 배치될 수 있다. 제1 클락선(401) 및 제2 클락선(405)은 스테이지들(ST1 내지 STn)의 좌측에 병렬로 이격 배치될 수 있다.
일 실시예에서, 제2 구동전압선(305)이 제1 구동전압선(301)보다 스테이지들(ST1 내지 STn)에 더 가깝게 위치할 수 있다. 다른 실시예에서, 제1 구동전압선(301)이 제2 구동전압선(305)보다 스테이지들(ST1 내지 STn)에 더 가깝게 위치할 수 있다.
제1 구동전압선(301)은 전원공급부(30)와 스테이지들(ST1 내지 STn) 사이에 연결되어, 전원공급부(30)로부터의 제1 구동전압(VGH)을 스테이지들(ST1 내지 STn)로 전달할 수 있다. 제1 구동전압선(301)은 제1 메인선(302) 및 복수의 제1 연결선(303)들을 포함할 수 있다. 제1 메인선(302)은 제2 방향으로 연장될 수 있다. 제1 연결선(303)들은 제1 메인선(302)과 다른 층에 배치되어 제1 메인선(302)과 전기적으로 연결될 수 있다. 제1 연결선(303)들은 제1 방향으로 연장되며 제2 구동전압선(305)의 제2 메인선(306)을 교차할 수 있다. 제1 연결선(303)들 각각은 제1 메인선(302)과 스테이지들(ST1 내지 STn) 중 대응하는 스테이지를 연결할 수 있다. 제1 연결선(303)들의 개수는 스테이지들(ST1 내지 STn)의 개수와 동일할 수 있다.
제2 구동전압선(305)은 전원공급부(30)와 스테이지들(ST1 내지 STn) 사이에 연결되어, 전원공급부(30)로부터의 제2 구동전압(VGL)을 스테이지들(ST1 내지 STn)로 전달할 수 있다. 제2 구동전압선(305)은 제2 메인선(306) 및 제2 연결선(307)들을 포함할 수 있다. 제2 메인선(306)은 제2 방향으로 연장될 수 있다. 제2 연결선(307)들은 제2 메인선(306)으로부터 돌출되어 제1 방향으로 연장될 수 있다. 제2 연결선(307)들 각각은 제2 메인선(306)과 스테이지들(ST1 내지 STn) 중 대응하는 스테이지를 연결할 수 있다. 제2 연결선(307)들의 개수는 스테이지들(ST1 내지 STn)의 개수와 동일할 수 있다.
제1 클락선(401)은 제어부(150)와 스테이지들(ST1 내지 STn) 사이에 연결되어, 제어부(150)로부터의 제1 클락신호(CK1)를 스테이지들(ST1 내지 STn)로 전달할 수 있다. 제1 클락선(401)은 제3 메인선(402) 및 제3 연결선(403)들을 포함할 수 있다. 제3 메인선(402)은 제2 방향으로 연장될 수 있다. 제3 연결선(403)들은 제3 메인선(402)으로부터 돌출되어 제1 방향으로 연장될 수 있다. 제3 연결선(403)들 각각은 제3 메인선(402)과 스테이지들(ST1 내지 STn) 중 대응하는 스테이지를 연결할 수 있다. 제3 연결선(403)들의 개수는 스테이지들(ST1 내지 STn)의 개수와 동일할 수 있다.
제2 클락선(405)은 제어부(150)와 스테이지들(ST1 내지 STn) 사이에 연결되어, 제어부(150)로부터의 제2 클락신호(CK2)를 스테이지들(ST1 내지 STn)로 전달할 수 있다. 제2 클락선(405)은 제4 메인선(406) 및 제4 연결선(407)들을 포함할 수 있다. 제4 메인선(406)은 제2 방향으로 연장될 수 있다. 제4 연결선(407)들은 제4 메인선(406)과 다른 층에 배치되어 제4 메인선(406)과 전기적으로 연결될 수 있다. 제4 연결선(407)들은 제1 방향으로 연장되며 제1 클락선(401)의 제3 메인선(402)을 교차할 수 있다. 제4 연결선(407)들 각각은 제4 메인선(406)과 스테이지들(ST1 내지 STn) 중 대응하는 스테이지를 연결할 수 있다. 제4 연결선(407)들의 개수는 스테이지들(ST1 내지 STn)의 개수와 동일할 수 있다.
스테이지들(ST1 내지 STn) 중 제1 스테이지(ST1)는 시작신호선(601)으로부터 입력단자(IN)를 통해 시작신호(FLM)를 전달받을 수 있다. 제1 스테이지(ST1) 외의 나머지 스테이지들(ST2 내지 STn)은 입력단자(IN)를 통해 이전 스테이지들(ST1 내지 STn-1)의 캐리 출력단자(CR)와 연결된 캐리선(602)으로부터 캐리신호를 시작신호로서 전달받을 수 있다. 캐리신호는 이전 스테이지의 출력신호(OUT)일 수 있다.
시작신호선(601) 및 캐리선(602)은 제1 메인선 내지 제4 메인선(302, 306, 402, 406)과 동일층에 배치될 수 있다.
복수의 스테이지들(ST1 내지 STn)의 출력단자(OT)들과 연결된 출력선(501)들은 제1 방향으로 연장되고, 제1 메인선 내지 제4 메인선(302, 306, 402, 406)과 다른 층에 배치될 수 있다. 출력선(501)들은 제1 연결선(303)들과 동일층 또는 다른 층에 배치될 수 있다. 일 실시예에서, 출력선(501)들은 주사선들(SL1 내지 SLn) 또는 발광제어선들(EL1 내지 ELn)과 전기적으로 연결될 수 있다. 다른 실시예에서, 출력선(501)들은 주사선들(SL1 내지 SLn) 또는 발광제어선들(EL1 내지 ELn)일 수 있다.
도 5는 본원발명의 일 실시예에 따른 주사 구동부의 임의의 스테이지를 나타낸 도면이다. 이하에서는 제k 스테이지(STk)를 중심으로 설명하며, 구성 및 동작은 나머지 스테이지에 동일하게 적용할 수 있다.
도 5를 참조하면, 본 발명의 실시예에 의한 주사 구동부(110)의 제k 스테이지 회로(ST_k)는 제1 트랜지스터(Ms1), 제2 트랜지스터(Ms2), 제3 트랜지스터(Ms3), 제4 트랜지스터(Ms4), 제5 트랜지스터(Ms5), 제6 트랜지스터(Ms6), 제7 트랜지스터(Ms7), 제1 커패시터(Cs1), 및 제2 커패시터(Cs2)를 포함할 수 있다.
제1 트랜지스터(Ms1)는 제3 입력단자(Is3)와 제1 노드(Ns1) 사이에 연결되고, 제1 입력단자(Is1)에 연결되는 게이트 전극을 포함할 수 있다. 제1 트랜지스터(Ms1)는 제1 입력단자(Is1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제2 트랜지스터(Ms2)는 제2 노드(Ns2)와 제1 전압단자(Vs1) 사이에 연결되고, 제3 노드(Ns3)에 연결되는 게이트 전극을 포함할 수 있다. 제2 트랜지스터(Ms2)는 제3 노드(Ns3)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제3 트랜지스터(Ms3)는 제1 노드(Ns1)와 제2 노드(Ns2) 사이에 연결되고, 제2 입력단자(Is2)에 연결되는 게이트 전극을 포함할 수 있다. 제3 트랜지스터(Ms3)는 제2 입력단자(Is2)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제4 트랜지스터(Ms4)는 제3 노드(Ns3)와 제1 입력단자(Is1) 사이에 연결되고, 제1 노드(Ns1)에 연결되는 게이트 전극을 포함할 수 있다. 제4 트랜지스터(Ms4)는 제1 노드(Ns1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제5 트랜지스터(Ms5)는 제3 노드(Ns3)와 제2 전압단자(Vs2) 사이에 연결되고, 제1 입력단자(Is1)에 연결되는 게이트 전극을 포함할 수 있다. 제5 트랜지스터(Ms5)는 제1 입력단자(Is1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제6 트랜지스터(Ms6)는 제1 전압단자(Vs1)와 출력단자(OT) 사이에 연결되고, 제3 노드(Ns3)에 연결되는 게이트 전극을 포함할 수 있다. 제6 트랜지스터(Ms6)는 제3 노드(Ns3)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제7 트랜지스터(Ms7)는 출력단자(OT)와 제2 입력단자(Is2) 사이에 연결되고, 제1 노드(Ns1)에 연결되는 게이트 전극을 포함할 수 있다. 제7 트랜지스터(Ms7)는 제1 노드(Ns1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
출력단자(OT)는 제k 주사선(SLk)에 연결될 수 있다.
제1 커패시터(Cs1)는 제1 노드(Ns1)와 출력단자(Os) 사이에 연결될 수 있다. 제2 커패시터(Cs2)는 제1 전압단자(Vs1)와 제3 노드(Ns3) 사이에 연결될 수 있다.
제1 전압단자(Vs1)는 제1 구동전압선(301)에 연결되어 제1 구동전압(VGH)을 입력받을 수 있다. 제2 전압단자(Vs2)는 제2 구동전압선(305)에 연결되어 제2 구동전압(VGL)을 입력받을 수 있다. 홀수번째 스테이지에서, 제1 입력단자(Is1)는 제1 클락선(401)에 연결되어 제1 클락신호(CK1)를 입력받고, 제2 입력단자(Is2)는 제2 클락선(405)에 연결되어 제2 클락신호(CK2)를 입력받을 수 있다. 짝수번째 스테이지에서, 제1 입력단자(Is1)는 제2 클락선(405)에 연결되어 제2 클락신호(CK2)를 입력받고, 제2 입력단자(Is2)는 제1 클락선(401)에 연결되어 제1 클락신호(CK1)를 입력받을 수 있다. 스테이지들(ST1 내지 STn) 중 제1 스테이지 회로(ST1)의 제3 입력단자(Is3)는 시작신호선(601)에 연결되어 시작신호(FLM1)를 입력받을 수 있다. 제1 스테이지(ST1)를 제외한 나머지 스테이지들(ST2 내지 STn)의 제3 입력단자(Is3)는 캐리선(602)에 의해 이전 스테이지들(ST1 내지 STn-1)의 캐리 출력단자(CR)에 연결되어 캐리신호(CARRY)를 시작신호로서 전달받을 수 있다.
도 6은 본원발명의 일 실시예에 따른 발광제어 구동부의 임의의 스테이지를 나타낸 도면이다. 이하에서는 제g 스테이지(STg)를 중심으로 설명하며, 구성 및 동작은 나머지 스테이지에 동일하게 적용할 수 있다.
도 6을 참조하면, 본 발명의 실시예에 의한 발광제어 구동부(160)의 제g 스테이지 회로(STg)는 제1 트랜지스터(Me1), 제2 트랜지스터(Me2), 제3 트랜지스터(Me3), 제4 트랜지스터(Me4), 제5 트랜지스터(Me5), 제6 트랜지스터(Me6), 제7 트랜지스터(Me7), 제1 커패시터(Ce1), 제2 커패시터(Ce2), 및 제3 커패시터(Ce3)를 포함할 수 있다.
제1 트랜지스터(Me1)는 제3 입력단자(Ie3)와 제1 노드(Ne1) 사이에 연결되고, 제1 입력단자(Ie1)에 연결되는 게이트 전극을 포함할 수 있다. 제1 트랜지스터(Me1)는 제1 입력단자(Ie1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제2 트랜지스터(Me2)는 제2 노드(Ne2)와 제1 입력단자(Ie1) 사이에 연결되고, 제1 노드(Ne1)에 연결되는 게이트 전극을 포함할 수 있다. 제2 트랜지스터(Ms2)는 제1 노드(Ne1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제3 트랜지스터(Me3)는 제2 노드(Ne2)와 제2 전압단자(Ve2) 사이에 연결되고, 제1 입력단자(Ie1)에 연결되는 게이트 전극을 포함할 수 있다. 제3 트랜지스터(Me3)는 제1 입력단자(Ie1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제4 트랜지스터(Me4)는 제1 노드(Ne1)와 제3 노드(Ne3) 사이에 연결되고, 제2 입력단자(Ie2)에 연결되는 게이트 전극을 포함할 수 있다. 제4 트랜지스터(Me4)는 제2 입력단자(Ie2)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제5 트랜지스터(Me5)는 제1 전압단자(Ve1)와 제3 노드(Ne3) 사이에 연결되고, 제2 노드(Ne2)에 연결되는 게이트 전극을 포함할 수 있다. 제5 트랜지스터(Me5)는 제2 노드(Ne2)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제6 트랜지스터(Me6)는 제4 노드(Ne4)와 제2 입력단자(Ie2) 사이에 연결되고, 제2 노드(Ne2)에 연결되는 게이트 전극을 포함할 수 있다. 제6 트랜지스터(Me6)는 제2 노드(Ne2)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제7 트랜지스터(Me7)는 제4 노드(Ne4)와 제5 노드(Ne5) 사이에 연결되고, 제2 입력단자(Ie2)에 연결되는 게이트 전극을 포함할 수 있다. 제7 트랜지스터(Me7)는 제2 입력단자(Ie2)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제8 트랜지스터(Me8)는 제1 전압단자(Ve1)와 제5 노드(N5) 사이에 연결되고, 제1 노드(Ne1)에 연결되는 게이트 전극을 포함할 수 있다. 제8 트랜지스터(Me8)는 제1 노드(Ne1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제9 트랜지스터(Me9)는 제1 전압단자(Ve1)와 출력단자(Oe) 사이에 연결되고, 제5 노드(Ne5)에 연결되는 게이트 전극을 포함할 수 있다. 제9 트랜지스터(Me9)는 제5 노드(Ne5)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
제10 트랜지스터(Me10)는 출력단자(Oe)와 제2 전압단자(Ve2) 사이에 연결되고, 제1 노드(Ne1)에 연결되는 게이트 전극을 포함할 수 있다. 제10 트랜지스터(Me10)는 제1 노드(Ne1)의 전압 레벨에 따라 턴-온 또는 턴-오프될 수 있다.
출력단자(OT)는 제g 발광 제어선(ELg)에 연결될 수 있다.
제1 커패시터(Ce1)는 제1 노드(Ne1)와 제2 입력단자(Ie2) 사이에 연결될 수 있다. 제2 커패시터(Ce2)는 제2 노드(Ne2)와 제4 노드(Ne4) 사이에 연결될 수 있다. 제3 커패시터(Ce3)는 제1 전압단자(Ve1)와 제5 노드(Ne5) 사이에 연결될 수 있다.
제1 전압 단자(Ve1)는 제1 구동 전압선(301)에 연결되고, 스테이지 회로들(500_1~500_n)의 제2 전압 단자(Ve2)는 제4 구동 전압선(214)에 연결될 수 있다.
제1 전압단자(Ve1)는 제1 구동전압선(301)에 연결되어 제1 구동전압(VGH)을 입력받을 수 있다. 제2 전압단자(Ve2)는 제2 구동전압선(305)에 연결되어 제2 구동전압(VGL)을 입력받을 수 있다. 홀수번째 스테이지에서, 제1 입력단자(Ie1)는 제1 클락선(401)에 연결되어 제1 클락신호(CK1)를 입력받고, 제2 입력단자(Ie2)는 제2 클락선(405)에 연결되어 제2 클락신호(CK2)를 입력받을 수 있다. 짝수번째 스테이지에서, 제1 입력단자(Ie1)는 제2 클락선(405)에 연결되어 제2 클락신호(CK2)를 입력받고, 제2 입력단자(Ie2)는 제1 클락선(401)에 연결되어 제1 클락신호(CK1)를 입력받을 수 있다. 스테이지들(ST1 내지 STn) 중 제1 스테이지 회로(ST1)의 제3 입력단자(Ie3)는 시작신호선(601)에 연결되어 시작신호(FLM1)를 입력받을 수 있다. 제1 스테이지(ST1)를 제외한 나머지 스테이지들(ST2 내지 STn)의 제3 입력단자(Ie3)는 캐리선(602)에 의해 이전 스테이지들(ST1 내지 STn-1)의 캐리 출력단자(CR)에 연결되어 캐리신호(CARRY)를 시작신호로서 전달받을 수 있다.
도 5 및 도 6에 도시된 바와 같이, 스테이지들(ST1 내지 STn) 각각에는 하이 전압을 출력하기 위한 풀업스위치(Ms6)(Me9) 및 로우 전압을 출력하기 위한 풀다운스위치(Ms7)(Me10)를 포함할 수 있다. 풀업스위치(Ms6)(Me9)가 턴-오프일 때 풀다운스위치(Ms7)(Me10)를 턴-온시키고, 풀다운스위치(Ms7)(Me10)가 턴-오프일 때 풀업스위치(Ms6)(Me9)가 턴-온시켜 스테이지를 동작시킨다.
스테이지들(ST1 내지 STn)의 풀업스위치(Ms6)(Me9)들을 턴-온 또는 턴-오프시키는 노드(Ns3)(Ne5)들에 연결된 커패시터(Cs2)(Ce3)들과 풀다운스위치(Ms7)(Me10)들을 턴-온 또는 턴-오프시키는 노드(Ns1)(Ne1)들에 연결된 커패시터(Cs1)(Ce1)들은 구동 개시 시에 동시에 초기 전압으로 충전되어야 한다. 이로 인해 제1 구동전압선(301)과 제2 구동전압선(303)을 통해 큰 인 러시 전류(in-rush current)가 흐르게 된다.
제1 구동전압선(301)과 제2 구동전압선(303)은 제1 구동전압(VGH)과 제2 구동전압(VGL)의 입력단으로부터 멀어질수록 전압 강하(IR-drop) 및 신호 지연(RC-delay)에 의한 전압 왜곡이 발생한다.
제1 구동전압선(301)과 제2 구동전압선(303)에 순간적으로 흐르는 인 러시 전류와 제1 구동전압선(301)과 제2 구동전압선(303)의 전압 강하(IR-drop)에 의해 제1 구동전압(VGH)은 하강하고 제2 구동전압(VGL)은 상승하게 된다. 이에 따라 노드(Ns3)(Ne5)에 연결된 커패시터(Cs2)(Ce3)와 노드(Ns1)(Ne1)에 연결된 커패시터(Cs1)(Ce1)가 충분히 초기화되지 못함으로써, 풀업스위치(Ms6)(Me9)와 풀다운스위치(Ms7)(Me10)가 동시에 턴-온되어 제1 구동전압(VGH)과 제2 구동전압(VGL)이 쇼트될 수 있다.
도 7은 주사 구동부(110) 및/또는 발광제어 구동부(160)가 구동 개시시에 제1 구동전압(VGH)과 제2 구동전압(VGL)이 쇼트되는 현상의 시뮬레이션 결과이다.
본 발명의 실시예는 구동부의 구동 개시시에 발생하는 전압선들 간의 쇼트를 방지하기 위해 구동부의 스테이지들에 인접한 홀드 커패시터를 구비한다.
도 8은 본 발명의 일 실시예에 따른 주사 구동부 및/또는 발광제어 구동부를 개략적으로 나타낸 블록도이다.
도 8을 참조하면, 주사 구동부(110) 및/또는 발광제어 구동부(160)는 복수의 스테이지들(ST1 내지 STn) 중 적어도 하나의 스테이지에 인접하여 연결된 적어도 하나의 홀드 커패시터(Ch)를 포함할 수 있다.
홀드 커패시터(Ch)는 제1 구동전압선(301)에 연결된 제1 전극과 제2 구동전압선(305)에 연결된 제2 전극을 포함할 수 있다.
홀드 커패시터(Ch)는 복수의 스테이지들(ST1 내지 STn)에 시작신호(FLM) 및 캐리신호(CARRY)가 인가되기 전에 제1 구동전압선(301)으로 인가되는 제1 구동전압(VGH)과 제2 구동전압선(305)으로 인가되는 제2 구동전압(VGL)에 의해 충전될 수 있다.
홀드 커패시터(Ch)가 충전된 후, 복수의 스테이지들(ST1 내지 STn)에 시작신호(FLM)가 인가되며 주사 구동부(110) 및/또는 발광제어 구동부(160)가 구동하게 된다. 구동 개시 시 홀드 커패시터(Ch)를 이용하여 복수의 스테이지들(ST1 내지 STn) 각각은 노드(Ns3)(Ne5)에 연결된 커패시터(Cs2)(Ce3)와 노드(Ns1)(Ne1)에 연결된 커패시터(Cs1)(Ce1)를 충전시킴으로써 제1 구동전압선(301)과 제2 구동전압선(305)의 전압 강하로 인한 순간적인 전압 왜곡을 완화시켜 제1 구동전압(VGH)과 제2 구동전압(VGL)의 쇼트 현상을 방지할 수 있다.
도 9는 주사 구동부(110) 및/또는 발광제어 구동부(160)가 홀드 커패시터(Ch)를 구비하는 경우, 구동 개시시에 제1 구동전압(VGH)과 제2 구동전압(VGL)이 안정적으로 인가됨을 보여주는 시뮬레이션 결과이다.
도 10 내지 도 15는 도 8에 도시된 홀드 커패시터의 구현 예를 나타낸 평면도이다.
도 10을 참조하면, 복수의 스테이지들(ST1 내지 STn) 각각에는 제1 홀드 커패시터(Ch1) 및 제2 홀드 커패시터(Ch2)가 병렬 연결될 수 있다. 제1 홀드 커패시터(Ch1)와 제2 홀드 커패시터(Ch2)는 제2 방향을 따라 교대로 배치될 수 있다. 제1 홀드 커패시터(Ch1) 및 제2 홀드 커패시터(Ch2)는 복수의 스테이지들(ST1 내지 STn) 각각에 인접하여 배치될 수 있다.
제1 홀드 커패시터(Ch1)는 제1 구동전압선(301)의 제1 메인선(302)의 일부를 포함하는 제1 전극(C11) 및 제1 전극(C11)과 중첩하는 제2 전극(C12)을 포함할 수 있다. 제1 전극(C11)은 제1 구동전압선(301)의 제1 메인선(302)의 일부로서 라인 형상일 수 있다. 제1 전극(C11)은 적어도 제1 메인선(302)의 폭 이상의 폭 및 제1 길이(L1)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C12)은 제1 메인선(302)을 따르는 라인 형상일 수 있다. 제2 전극(C12)은 제1 전극(C11)을 커버하는 제1 폭(W1) 및 제1 길이(L1)를 갖고 소정의 면적을 가질 수 있다. 제1 폭(W1)은 제1 메인선(302)의 폭 또는 제1 전극(C11)의 폭과 동일할 수 있다. 제2 전극(C12)은 제2 구동전압선(305)의 제2 메인선(306)의 일부와 제2 컨택홀(CH2)을 통해 전기적으로 연결될 수 있다. 제2 메인선(306)은 제2 연결선(307)을 통해 스테이지에 연결될 수 있다. 따라서 제1 홀드 커패시터(Ch1)의 제1 전극(C11)은 제1 구동전압선(301)과 연결되고, 제2 전극(C12)은 제2 구동전압선(305)과 연결될 수 있다.
제2 홀드 커패시터(Ch2)는 제2 구동전압선(305)의 제2 메인선(306)의 일부를 포함하는 제1 전극(C21) 및 제1 전극(C21)과 중첩하는 제2 전극(C22)을 포함할 수 있다. 제1 전극(C21)은 제2 구동전압선(305)의 제2 메인선(306)의 일부로서 라인 형상일 수 있다. 제1 전극(C21)은 제2 메인선(306)의 폭 이상의 폭 및 제2 길이(L2)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C22)은 제2 메인선(306)을 따르는 라인 형상일 수 있다. 제2 전극(C22)은 제1 전극(C21)을 커버하는 제2 폭(W2) 및 제2 길이(L2)를 갖고 소정의 면적을 가질 수 있다. 제2 폭(W2)은 제2 메인선(306)의 폭 또는 제1 전극(C21)의 폭과 동일할 수 있다. 제1 폭(W1)과 제2 폭(W2)은 동일 또는 상이할 수 있다. 제2 전극(C22)은 제1 구동전압선(301)의 제1 메인선(302)의 일부와 제3 컨택홀(CH3)을 통해 전기적으로 연결될 수 있다. 제2 전극(C22)은 제1 구동전압선(301)의 제1 연결선(303)으로부터 연장된 전극일 수 있다. 즉, 제2 전극(C22)은 제1 연결선(303)이 제2 메인선(306)과 교차하는 부분을 포함하며, 제1 연결선(303)과 제2 전극(C22)은 일체로 형성될 수 있다. 따라서, 제3 컨택홀(CH3)은 제1 컨택홀(CH1)일 수 있다. 제1 메인선(302)은 제1 연결선(303)을 통해 스테이지에 연결된다. 따라서 제2 홀드 커패시터(Ch2)의 제1 전극(C21)은 제2 구동전압선(305)과 연결되고, 제2 전극(C22)은 제1 구동전압선(301)과 연결될 수 있다.
도 11은 도 10의 A-A'를 따라 자른 단면도이다.
도 11을 참조하면, 기판(50) 상에 버퍼층(51)이 배치되고, 버퍼층(51) 상에 제1 구동전압선(301)의 제1 메인선(302), 제2 구동전압선(305)의 제2 메인선(306) 및 제2 연결선(307), 제1 홀드 커패시터(Ch1)의 제1 전극(C11), 및 제2 홀드 커패시터(Ch2)의 제1 전극(C21)이 배치될 수 있다.
버퍼층(51) 상에 제1 절연층(52)이 배치되고, 제1 절연층(52) 상에 제1 구동전압선(301)의 제1 연결선(303), 제1 홀드 커패시터(Ch1)의 제2 전극(C12), 및 제2 홀드 커패시터(Ch2)의 제2 전극(C22)이 배치될 수 있다. 제1 절연층(52) 상에 제2 절연층(53)이 배치될 수 있다. 제1 절연층(52) 및 제2 절연층(53)은 단층 또는 복수층일 수 있다.
제1 구동전압선(301)의 제1 연결선(303)은 제1 절연층(52)의 제1 컨택홀(CH1)을 통해 제1 메인선(302)과 전기적으로 연결될 수 있다. 제2 홀드 커패시터(Ch2)의 제2 전극(C22)은 제3 컨택홀(CH3)을 통해 제1 메인선(302)과 전기적으로 연결될 수 있다. 제1 컨택홀(CH1)은 제3 컨택홀(CH3)과 동일할 수 있다. 제1 홀드 커패시터(Ch1)의 제2 전극(C12)은 제2 컨택홀(CH2)을 통해 제2 메인선(306)과 전기적으로 연결될 수 있다.
제1 구동전압선(301), 제2 구동전압선(305), 제1 홀드 커패시터(Ch1), 및 제2 홀드 커패시터(Ch2)는 화소(PX)를 구성하는 발광소자 및 회로소자의 일 전극과 동일층에 배치될 수 있다. 제1 구동전압선(301), 제2 구동전압선(305), 제1 홀드 커패시터(Ch1), 및 제2 홀드 커패시터(Ch2)는 화소(PX)를 구성하는 발광소자 및 회로소자의 일 전극과 동일 물질을 포함할 수 있다.
도 12에 도시된 실시예에서, 복수의 스테이지들(ST1 내지 STn) 각각에는 제1 홀드 커패시터(Ch1) 또는 제2 홀드 커패시터(Ch2)가 연결될 수 있다. 제1 홀드 커패시터(Ch1)와 제2 홀드 커패시터(Ch2)는 제2 방향을 따라 교대로 배치될 수 있다. 제1 홀드 커패시터(Ch1) 및 제2 홀드 커패시터(Ch2)는 복수의 스테이지들(ST1 내지 STn) 각각에 인접하여 배치될 수 있다.
도 12를 참조하면, k번째 스테이지(STk)와 k+2번째 스테이지(STk+2)에는 제1 홀드 커패시터(Ch1)가 연결되고, k-1번째 스테이지(STk-1)와 k+1번째 스테이지(STk+1)에는 제2 홀드 커패시터(Ch2)가 연결되고 있다.
k번째 스테이지(STk)와 k+2번째 스테이지(STk+2)에는 제1 구동전압선(301)의 제1 연결선(303)이 제1 홀드 커패시터(Ch1)의 제2 전극(C12)과 동일층에 이격 배치될 수 있다.
k-1번째 스테이지(STk-1)와 k+1번째 스테이지(STk+1)에는 제2 홀드 커패시터(Ch2)의 제2 전극(C22)이 제1 구동전압선(301)의 제1 연결선(303)으로부터 연장되어, 제1 연결선(303)은 제2 홀드 커패시터(Ch2)의 제2 전극(C22)의 일부일 수 있다. k번째 스테이지(STk)와 k+2번째 스테이지(STk+2)에 연결된 제1 구동전압선(301)의 제1 연결선(303)은 제1 홀드 커패시터(Ch1)와 제2 홀드 커패시터(Ch2) 사이에 구비될 수 있다.
제1 홀드 커패시터(Ch1)는 제1 구동전압선(301)의 제1 메인선(302)의 일부를 포함하는 제1 전극(C11) 및 제1 전극(C11)과 중첩하는 제2 전극(C12)을 포함할 수 있다. 제1 전극(C11)은 제1 구동전압선(301)의 제1 메인선(302)의 일부로서 라인 형상일 수 있다. 제1 전극(C11)은 제1 메인선(302)의 폭 이상의 폭 및 제3 길이(L3)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C12)은 제1 메인선(302)과 제2 메인선(306)을 커버하는 사각 형상일 수 있다. 제2 전극(C12)은 제1 전극(C11)을 커버하는 제3 폭(W1) 및 제3 길이(L3)를 갖고 소정의 면적을 가질 수 있다. 제3 폭(W3)은 제1 메인선(302)의 폭 및 제2 메인선(306)의 폭의 합보다 클 수 있다. 제2 전극(C12)은 제2 구동전압선(305)의 제2 메인선(306)의 일부와 제2 컨택홀(CH2)을 통해 전기적으로 연결될 수 있다. 제2 메인선(306)은 제2 연결선(307)을 통해 스테이지에 연결될 수 있다. 따라서 제1 홀드 커패시터(Ch1)의 제1 전극(C11)은 제1 구동전압선(301)과 연결되고, 제2 전극(C12)은 제2 구동전압선(305)과 연결될 수 있다.
제2 홀드 커패시터(Ch2)는 제2 구동전압선(305)의 제2 메인선(306)의 일부를 포함하는 제1 전극(C21) 및 제1 전극(C21)과 중첩하는 제2 전극(C22)을 포함할 수 있다. 제1 전극(C21)은 제2 구동전압선(305)의 제2 메인선(306)의 일부로서 라인 형상일 수 있다. 제1 전극(C21)은 제2 메인선(306)의 폭 이상의 폭 및 제4 길이(L4)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C22)은 제1 메인선(302)과 제2 메인선(306)을 커버하는 사각 형상일 수 있다. 제2 전극(C22)은 제1 전극(C21)을 커버하는 제4 폭(W4) 및 제4 길이(L4)를 갖고 소정의 면적을 가질 수 있다. 제4 폭(W4)은 제1 메인선(302)의 폭 및 제2 메인선(306)의 폭의 합보다 클 수 있다. 제3 폭(W3)과 제4 폭(W4)은 동일 또는 상이할 수 있다. 제2 전극(C22)은 제1 구동전압선(301)의 제1 메인선(302)의 일부와 제3 컨택홀(CH3)을 통해 전기적으로 연결될 수 있다. 제2 전극(C22)은 제1 구동전압선(301)의 제1 연결선(303)으로부터 연장된 전극일 수 있다. 즉, 제2 전극(C22)은 제1 연결선(303)이 제2 메인선(306)과 교차하는 부분을 포함하며, 제1 연결선(303)과 제2 전극(C22)은 일체로 형성될 수 있다. 따라서, 제3 컨택홀(CH3)은 제1 컨택홀(CH1)일 수 있다. 제1 메인선(302)은 제1 연결선(303)을 통해 스테이지에 연결될 수 있다. 따라서 제2 홀드 커패시터(Ch2)의 제1 전극(C21)은 제2 구동전압선(305)과 연결되고, 제2 전극(C22)은 제1 구동전압선(301)과 연결될 수 있다.
도 13에 도시된 실시예에서, 복수의 스테이지들(ST1 내지 STn) 중 하나 이상의 스테이지들이 공유하는 제2 홀드 커패시터(Ch2)가 복수의 스테이지들(ST1 내지 STn)에 인접하여 배치될 수 있다.
제2 홀드 커패시터(Ch2)는 제2 구동전압선(305)의 제2 메인선(306)의 일부를 포함하는 제1 전극(C21) 및 제1 전극(C21)과 중첩하는 제2 전극(C22)을 포함할 수 있다. 제1 전극(C21)은 제2 구동전압선(305)의 제2 메인선(306)의 일부로서 라인 형상일 수 있다. 제1 전극(C21)은 제2 메인선(306)의 폭 이상의 폭 및 제5 길이(L5)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C22)은 제1 메인선(302)과 제2 메인선(306)을 커버하는 사각 형상일 수 있다. 제2 전극(C22)은 제1 전극(C21)을 커버하는 제5 폭(W5) 및 제5 길이(L5)를 갖고 소정의 면적을 가질 수 있다. 제5 폭(W5)은 제1 메인선(302)의 폭 및 제2 메인선(306)의 폭의 합보다 클 수 있다. 제5 길이(L5)는 제2 방향으로 하나 이상의 스테이지들을 따라 연장된 길이일 수 있다. 도 13의 실시예는 4개의 스테이지들이 공유하며 4개의 스테이지들에 인접하는 제5 길이(L5)를 갖는 제2 홀드 커패시터(Ch2)의 예이다.
제2 전극(C22)은 제1 구동전압선(301)의 제1 메인선(302)의 일부와 제3 컨택홀(CH3)을 통해 전기적으로 연결될 수 있다. 제2 전극(C22)은 제1 구동전압선(301)의 적어도 하나의 제1 연결선(303)으로부터 연장되며 연결된 전극일 수 있다. 즉, 제2 전극(C22)은 제1 연결선(303)이 제2 메인선(306)과 교차하는 부분을 포함하며, 적어도 하나의 제1 연결선(303)과 제2 전극(C22)은 일체로 형성될 수 있다. 따라서, 제3 컨택홀(CH3)은 제1 컨택홀(CH1)일 수 있다. 제1 메인선(302)은 제1 연결선(303)을 통해 스테이지에 연결될 수 있다. 따라서 제2 홀드 커패시터(Ch2)의 제1 전극(C21)은 제2 구동전압선(305)과 연결되고, 제2 전극(C22)은 제1 구동전압선(301)과 연결될 수 있다.
도 14에 도시된 실시예에서, 복수의 스테이지들(ST1 내지 STn) 각각에는 제1 홀드 커패시터(Ch1)가 연결될 수 있다. 제1 홀드 커패시터(Ch1)는 인접하는 제1 연결선(303)들 사이에 구비될 수 있다.
제1 홀드 커패시터(Ch1)는 제1 구동전압선(301)의 제1 메인선(302)의 일부를 포함하는 제1 전극(C11) 및 제1 전극(C11)과 중첩하는 제2 전극(C12)을 포함할 수 있다. 제1 전극(C11)은 제1 구동전압선(301)의 제1 메인선(302)의 일부로서 라인 형상일 수 있다. 제1 전극(C11)은 제1 메인선(302)의 폭 이상의 폭 및 제6 길이(L6)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C12)은 제1 메인선(302)과 제2 메인선(306)을 커버하는 사각 형상일 수 있다. 제2 전극(C12)은 제1 전극(C11)을 커버하는 제6 폭(W6) 및 제6 길이(L6)를 갖고 소정의 면적을 가질 수 있다. 제6 폭(W6)은 제1 메인선(302)의 폭 및 제2 메인선(306)의 폭의 합보다 클 수 있다. 제2 전극(C12)은 제2 구동전압선(305)의 제2 메인선(306)의 일부와 제2 컨택홀(CH2)을 통해 전기적으로 연결될 수 있다. 제2 메인선(306)은 제2 연결선(307)을 통해 스테이지에 연결될 수 있다. 따라서 제1 홀드 커패시터(Ch1)의 제1 전극(C11)은 제1 구동전압선(301)과 연결되고, 제2 전극(C12)은 제2 구동전압선(305)과 연결될 수 있다.
도 15에 도시된 실시예에서, 복수의 스테이지들(ST1 내지 STn) 각각에는 제2 홀드 커패시터(Ch2)가 연결될 수 있다. 제2 홀드 커패시터(Ch2)는 인접하는 제1 연결선(303)들 사이에 구비될 수 있다.
제2 홀드 커패시터(Ch2)는 제2 구동전압선(305)의 제2 메인선(306)의 일부를 포함하는 제1 전극(C21) 및 제1 전극(C21)과 중첩하는 제2 전극(C22)을 포함할 수 있다. 제1 전극(C21)은 제2 구동전압선(305)의 제2 메인선(306)의 일부로서 라인 형상일 수 있다. 제1 전극(C21)은 제2 메인선(306)의 폭 이상의 폭 및 제7 길이(L7)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C22)은 제1 메인선(302)과 제2 메인선(306)을 커버하는 사각 형상일 수 있다. 제2 전극(C22)은 제1 전극(C21)을 커버하는 제7 폭(W7) 및 제7 길이(L7)를 갖고 소정의 면적을 가질 수 있다. 제7 폭(W7)은 제1 메인선(302)의 폭 및 제2 메인선(306)의 폭의 합보다 클 수 있다. 제2 전극(C22)은 제1 구동전압선(301)의 제1 메인선(302)의 일부와 제3 컨택홀(CH3)을 통해 전기적으로 연결될 수 있다. 제1 메인선(302)은 제1 연결선(303)을 통해 스테이지에 연결될 수 있다. 따라서 제2 홀드 커패시터(Ch2)의 제1 전극(C21)은 제2 구동전압선(305)과 연결되고, 제2 전극(C22)은 제1 구동전압선(301)과 연결될 수 있다.
도 16은 본 발명의 일 실시예에 따른 주사 구동부 및/또는 발광제어 구동부를 개략적으로 나타낸 블록도이다.
도 16을 참조하면, 주사 구동부(110) 및/또는 발광제어 구동부(160)는 복수의 스테이지들(ST1 내지 STn) 중 적어도 하나의 스테이지에 인접하여 연결된 적어도 하나의 제3 홀드 커패시터(Ch3) 및 적어도 하나의 제4 홀드 커패시터(Ch4)를 포함할 수 있다.
제3 홀드 커패시터(Ch3)는 제1 구동전압선(301)에 연결된 제1 전극과 제1 직류전압선(701)에 연결된 제2 전극을 포함할 수 있다. 제1 직류전압선(701)은 제1 구동전압선(301)과 병렬로 인접 배치될 수 있다. 제1 직류전압선(701)은 전원공급부(30)로부터 제1 직류전압(V1)을 인가받을 수 있다. 일 실시예에서, 제1 직류전압(V1)은 제1 구동전압(VGH)일 수 있다. 다른 실시예에서, 제1 직류전압(V1)은 제1 구동전압(VGH)과 상이한 전압일 수 있다. 제3 홀드 커패시터(Ch3)는 복수의 스테이지들(ST1 내지 STn)에 시작신호(FLM) 및 캐리신호(CARRY)가 인가되기 전에 제1 구동전압선(301)으로 인가되는 제1 구동전압(VGH)과 제1 직류전압선(701)으로 인가되는 제1 직류전압(V1)에 의해 충전될 수 있다.
제4 홀드 커패시터(Ch4)는 제2 구동전압선(305)에 연결된 제1 전극과 제2 직류전압선(705)에 연결된 제2 전극을 포함할 수 있다. 제2 직류전압선(705)은 제2 구동전압선(305)과 병렬로 인접 배치될 수 있다. 제2 직류전압선(705)은 전원공급부(30)로부터 제2 직류전압(V2)을 인가받을 수 있다. 일 실시예에서, 제2 직류전압(V2)은 제2 구동전압(VGL)일 수 있다. 다른 실시예에서, 제2 직류전압(V2)은 제2 구동전압(VGL)과 상이한 전압일 수 있다. 제4 홀드 커패시터(Ch4)는 복수의 스테이지들(ST1 내지 STn)에 시작신호(FLM) 및 캐리신호(CARRY)가 인가되기 전에 제2 구동전압선(305)으로 인가되는 제2 구동전압(VGL)과 제2 직류전압선(705)으로 인가되는 제2 직류전압(V2)에 의해 충전될 수 있다.
제1 직류전압(V1) 및 제2 직류전압(V2)은 표시부(10A)(10B)로 공급되는 전압들 중 하나일 수 있다.
도 17 및 도 18은 도 16에 도시된 홀드 커패시터의 구현 예를 나타낸 평면도이다.
도 17을 참조하면, 복수의 스테이지들(ST1 내지 STn) 중 하나 이상의 스테이지들이 공유하는 제3 홀드 커패시터(Ch3)가 복수의 스테이지들(ST1 내지 STn)에 인접하여 배치될 수 있다. 그리고, 복수의 스테이지들(ST1 내지 STn) 각각에는 제4 홀드 커패시터(Ch4)가 병렬 연결될 수 있다. 제4 홀드 커패시터(Ch4)는 인접하는 제1 연결선(303)들 사이에 구비될 수 있다.
제3 홀드 커패시터(Ch3)는 제1 직류전압선(701)의 일부를 포함하는 제1 전극(C31) 및 제1 전극(C31)과 중첩하는 제2 전극(C32)을 포함할 수 있다. 제1 전극(C31)은 제1 직류전압선(701)의 일부로서 라인 형상일 수 있다. 제1 전극(C31)은 제1 직류전압선(701)의 폭 이상의 폭 및 제8 길이(L8)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C32)은 제1 직류전압선(701)과 제1 메인선(302)을 커버하는 사각 형상일 수 있다. 제2 전극(C32)은 제1 전극(C31)을 커버하는 제8 폭(W8) 및 제8 길이(L8)를 갖고 소정의 면적을 가질 수 있다. 제8 폭(W8)은 제1 직류전압선(701)의 폭 및 제1 메인선(302)의 폭의 합보다 클 수 있다. 제8 길이(L8)는 제2 방향으로 하나 이상의 스테이지들을 따라 연장된 길이일 수 있다. 도 17의 실시예는 4개의 스테이지들에 인접하는 제8 길이(L8)를 갖는 제3 홀드 커패시터(Ch3)의 예이다.
제2 전극(C32)은 제1 구동전압선(301)의 제1 메인선(302)의 일부와 제4 컨택홀(CH4)을 통해 전기적으로 연결될 수 있다. 제2 전극(C32)과 제1 구동전압선(301)의 제1 연결선(303)은 일체로 형성될 수 있다. 따라서, 제4 컨택홀(CH4)은 제1 컨택홀(CH1)일 수 있다. 제1 메인선(302)은 제1 연결선(303)을 통해 스테이지에 연결될 수 있다. 따라서 제3 홀드 커패시터(Ch3)의 제1 전극(C31)은 제1 직류전압선(701)과 연결되고, 제2 전극(C32)은 제1 구동전압선(301)과 연결될 수 있다.
제4 홀드 커패시터(Ch4)는 제2 직류전압선(705)의 일부를 포함하는 제1 전극(C41) 및 제1 전극(C41)과 중첩하는 제2 전극(C42)을 포함할 수 있다. 제1 전극(C41)은 제2 직류전압선(705)의 일부로서 라인 형상일 수 있다. 제1 전극(C41)은 제2 직류전압선(705)의 폭 이상의 폭 및 제9 길이(L9)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C42)은 제2 직류전압선(705)과 제2 메인선(306)을 커버하는 사각 형상일 수 있다. 제2 전극(C42)은 제1 전극(C41)을 커버하는 제9 폭(W9) 및 제9 길이(L9)를 갖고 소정의 면적을 가질 수 있다. 제9 폭(W9)은 제2 직류전압선(705)의 폭 및 제2 메인선(306)의 폭의 합보다 클 수 있다. 제2 전극(C42)은 제2 구동전압선(305)의 제2 메인선(306)의 일부와 제5 컨택홀(CH5)을 통해 전기적으로 연결될 수 있다. 제2 메인선(306)은 제2 연결선(307)을 통해 스테이지에 연결될 수 있다. 따라서 제4 홀드 커패시터(Ch4)의 제1 전극(C41)은 제2 직류전압선(705)과 연결되고, 제2 전극(C42)은 제2 구동전압선(305)과 연결될 수 있다.
제1 직류전압선(701) 및 제2 직류전압선(705)은 제1 메인선(302) 및 제2 메인선(306)과 동일층에 구비될 수 있다. 제1 직류전압선(701) 및 제2 직류전압선(705)은 제1 메인선(302) 및 제2 메인선(306)과 동일 물질을 포함할 수 있다.
도 18을 참조하면, 복수의 스테이지들(ST1 내지 STn) 각각에는 제3 홀드 커패시터(Ch3) 및 제4 홀드 커패시터(Ch4)가 병렬 연결될 수 있다. 제4 홀드 커패시터(Ch4)는 인접하는 제1 연결선(303)들 사이에 구비될 수 있다.
제3 홀드 커패시터(Ch3)는 제1 직류전압선(701)의 일부를 포함하는 제1 전극(C31) 및 제1 전극(C31)과 중첩하는 제2 전극(C32)을 포함할 수 있다. 제1 전극(C31)은 제1 직류전압선(701)의 일부로서 라인 형상일 수 있다. 제1 전극(C31)은 제1 직류전압선(701)의 폭 이상의 폭 및 제10 길이(L10)를 갖고 소정의 면적을 가질 수 있다. 제2 전극(C32)은 제1 직류전압선(701)과 제1 메인선(302)을 커버하는 사각 형상일 수 있다. 제2 전극(C32)은 제1 전극(C31)을 커버하는 제10 폭(W10) 및 제10 길이(L10)를 갖고 소정의 면적을 가질 수 있다. 제10 폭(W8)은 제1 직류전압선(701)의 폭 및 제1 메인선(302)의 폭의 합보다 클 수 있다. 제2 전극(C32)은 제1 구동전압선(301)의 제1 메인선(302)의 일부와 제4 컨택홀(CH4)을 통해 전기적으로 연결될 수 있다. 제2 전극(C32)과 제1 구동전압선(301)의 제1 연결선(303)은 일체로 형성될 수 있다. 따라서, 제4 컨택홀(CH4)은 제1 컨택홀(CH1)일 수 있다. 제1 메인선(302)은 제1 연결선(303)을 통해 스테이지에 연결될 수 있다. 따라서 제3 홀드 커패시터(Ch3)의 제1 전극(C31)은 제1 직류전압선(701)과 연결되고, 제2 전극(C32)은 제1 구동전압선(301)과 연결될 수 있다.
제4 홀드 커패시터(Ch4)는 도 17에 도시된 제4 홀드 커패시터(Ch4)와 동일하므로 상세한 설명은 생략한다.
도 19는 본 발명의 일 실시예에 따른 표시장치를 개략적으로 나타낸 도면이다. 도 1 내지 도 18을 참조하여 설명된 내용은 도 19에 도시된 표시장치에 동일하게 적용될 수 있다.
도 19를 참조하면, 일 실시예에 따른 표시장치(2)는 기판(50)의 표시 영역에 형성된 표시부(10) 및 표시 영역 주변의 비표시 영역에 형성된 주사 구동부(110) 및/또는 발광제어 구동부(160)를 포함할 수 있다. 비표시 영역의 실장영역(130)에는 데이터 구동부(120), 제어부(150) 및 전원공급부(30)를 포함하는 집적 칩(IC)이 실장될 수 있다.
실장영역(130)의 전원 공급부(30)로부터 주사 구동부(110) 및 발광제어 구동부(160)로 제1 구동전압선(301) 및 제2 구동전압선(305)이 제2 방향으로 연장될 수 있다. 주사 구동부(110) 및/또는 발광제어 구동부(160)의 복수의 스테이지들 중 적어도 하나의 스테이지에는 적어도 하나의 홀드 커패시터가 구비될 수 있다. 홀드 커패시터의 일 전극은 제1 구동전압선(301) 및 제2 구동전압선(305) 중 적어도 하나의 일부와 전기적으로 연결될 수 있다. 일 실시예(도 10 내지 도 15 참조)에서, 홀드 커패시터의 타 전극은 제1 구동전압선(301) 및 제2 구동전압선(305) 중 나머지의 적어도 일부일 수 있다. 다른 실시예(도 17 및 도 18 참조)에서, 홀드 커패시터의 타 전극은 임의의 직류전압이 인가되는 직류전압선의 적어도 일부일 수 있다.
도 20은 도 19에 도시된 주사 구동부(110) 및/또는 발광제어 구동부(160)를 구성하는 임의의 스테이지를 개략적으로 나타낸 도면이다.
도 20을 참조하면, 임의의 스테이지(STi)는 하이 전압을 출력하기 위한 풀업스위치(SW_FU) 및 로우 전압을 출력하기 위한 풀다운스위치(SW_FD)를 포함하는 버퍼부(212) 및 버퍼부(212)와 연결된 로직회로부(214)를 포함할 수 있다. 로직회로부(214)는 복수의 트래지스터 및 복수의 커패시터를 포함할 수 있다.
홀드 커패시터(Ch)는 각 스테이지(STi)에 시작신호(FLM) 또는 캐리신호(CARRY)가 인가되기 전에 제1 구동전압선(301)으로 인가되는 제1 구동전압(VGH)과 제2 구동전압선(305)으로 인가되는 제2 구동전압(VGL)에 의해 충전될 수 있다.
홀드 커패시터(Ch)가 충전된 후, 각 스테이지(STi)에 시작신호(FLM) 또는 캐리신호(CARRY)가 인가되며 주사 구동부(110) 및 발광제어 구동부(160)가 구동하게 된다. 구동 개시 시 홀드 커패시터(Ch)를 이용하여 각 스테이지(STi)는 노드(QB)에 연결된 커패시터(C_QB)와 노드(Q)에 연결된 커패시터(C_Q)를 충전시킴으로써 제1 구동전압선(301)과 제2 구동전압선(305)의 인 러시 전류 및 전압 강하로 인한 순간적인 전압 왜곡을 완화시켜 제1 구동전압(VGH)과 제2 구동전압(VGL)의 쇼트 현상을 방지할 수 있다.
본 발명의 일 실시예에 따른 표시장치는 태블릿 PC, 스마트폰, PDA(Personal Digital Assistant), PMP(Portable Multimedia Player), 게임기, 손목시계형 전자 기기 등의 휴대용 단말기에 적용될 수 있다. 표시장치는 휴대용 단말기에 한정되지 않고, 텔레비전 또는 외부 광고판과 같은 대형 전자 장비, 퍼스널 컴퓨터, 노트북 컴퓨터, 자동차 네비게이션 유닛, 카메라와 같은 중소형 전자 장비 등에 사용될 수 있다. 본 발명의 실시예는 전술된 예에 한정되지 않고, 본 발명의 개념에서 벗어나지 않은 이상 다른 전자 기기에도 채용될 수 있음은 물론이다.
이와 같이 본 발명은 도면에 도시된 일 실시예를 참고로 하여 설명하였으나 이는 예시적인 것에 불과하며 당해 분야에서 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 실시예의 변형이 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.

Claims (20)

  1. 표시 영역 및 비표시 영역을 포함하는 기판; 및
    상기 기판의 비표시 영역에 배치된 구동부;를 포함하고,
    상기 구동부가,
    복수의 스테이지들;
    상기 복수의 스테이지들과 연결되어 상기 복수의 스테이지들로 제1 직류전압을 공급하는 제1 전압선 및 제2 직류전압을 공급하는 제2 전압선; 및
    상기 복수의 스테이지들 외측에 인접하여 배치되고, 상기 복수의 스테이지들 중 적어도 하나의 스테이지에 연결되고, 한 쌍의 전극들 중 적어도 하나의 전극이 상기 제1 전압선 및 상기 제2 전압선 중 적어도 하나의 일부와 전기적으로 연결된 적어도 하나의 커패시터;를 포함하고,
    상기 적어도 하나의 커패시터는,
    상기 제1 전압선의 일부를 포함하는 제1 전극과, 상기 제2 전압선과 전기적으로 연결되고 상기 제1 전압선을 따라 상기 제1 전극에 중첩하는 제2 전극을 포함하는 제1 커패시터; 및
    상기 제2 전압선의 일부를 포함하는 제3 전극과, 상기 제1 전압선과 전기적으로 연결되고 상기 제2 전압선을 따라 상기 제3 전극에 중첩하는 제4 전극을 포함하는 제2 커패시터; 중 적어도 하나를 포함하는 표시장치.
  2. 삭제
  3. 제1항에 있어서,
    상기 제1 전압선은, 상기 복수의 스테이지들이 배열된 방향인 제2 방향으로 연장된 제1 메인선, 및 상기 제2 방향과 수직인 제1 방향으로 연장되며 상기 제1 메인선과 상기 복수의 스테이지들을 연결하는 복수의 제1 연결선들을 포함하고,
    상기 제2 전압선은, 상기 제2 방향으로 연장된 제2 메인선, 및 상기 제1 방향으로 연장되며 상기 제2 메인선과 복수의 스테이지들을 연결하는 복수의 제2 연결선들을 포함하는, 표시장치.
  4. 제3항에 있어서,
    상기 제1 연결선들의 상기 제2 메인선과 교차하는 부분은 상기 제2 전극의 일부인, 표시장치.
  5. 제3항에 있어서,
    상기 적어도 하나의 커패시터는 인접한 제1 연결선들 사이에 배치된, 표시장치.
  6. 제1항에 있어서,
    상기 적어도 하나의 커패시터는 적어도 두 개의 스테이지들이 공유하는, 표시장치.
  7. 제1항에 있어서,
    상기 제1 커패시터와 상기 제2 커패시터가 상기 복수의 스테이지들이 배열된 방향을 따라 교대로 배치된, 표시장치.
  8. 제3항에 있어서,
    상기 제1 연결선들 중 적어도 하나는 상기 제1 커패시터와 상기 제2 커패시터 사이에 배치된, 표시장치.
  9. 표시 영역 및 비표시 영역을 포함하는 기판; 및
    상기 기판의 비표시 영역에 배치된 구동부;를 포함하고,
    상기 구동부가,
    복수의 스테이지들;
    상기 복수의 스테이지들과 연결되어 상기 복수의 스테이지들로 제1 직류전압을 공급하는 제1 전압선 및 제2 직류전압을 공급하는 제2 전압선; 및
    상기 복수의 스테이지들 외측에 인접하여 배치되고, 상기 복수의 스테이지들 중 적어도 하나의 스테이지에 연결되고, 한 쌍의 전극들 중 적어도 하나의 전극이 상기 제1 전압선 및 상기 제2 전압선 중 적어도 하나의 일부와 전기적으로 연결된 적어도 하나의 커패시터;를 포함하고,
    상기 제1 전압선과 병렬 배치되고 제3 직류전압을 인가받는 제3 전압선; 및
    상기 제2 전압선과 병렬 배치된 제4 직류전압을 인가받는 제4 전압선;을 더 포함하고,
    상기 적어도 하나의 커패시터는,
    상기 제3 전압선의 일부를 포함하는 제5 전극과, 상기 제1 전압선과 전기적으로 연결되고 상기 제3 전압선을 따라 상기 제5 전극과 중첩하는 제6 전극을 포함하는 제3 커패시터; 및
    상기 제4 전압선의 일부를 포함하는 제7 전극과, 상기 제2 전압선과 전기적으로 연결되고 상기 제4 전압선을 따라 상기 제7 전극과 중첩하는 제8 전극을 포함하는 제4 커패시터;를 포함하는 표시장치.
  10. 제9항에 있어서,
    상기 제3 전압선 또는 상기 제4 전압선은 상기 제1 전압선과 상기 제2 전압선 사이에 배치된, 표시장치.
  11. 제9항에 있어서,
    상기 제1 직류전압과 상기 제3 직류전압이 동일한, 표시장치.
  12. 제9항에 있어서,
    상기 제2 직류전압과 상기 제4 직류전압이 동일한, 표시장치.
  13. 제9항에 있어서,
    상기 제3 커패시터 또는 상기 제4 커패시터는 적어도 두 개의 스테이지들이 공유하는, 표시장치.
  14. 제9항에 있어서,
    상기 제3 커패시터와 상기 제4 커패시터가 상기 복수의 스테이지들이 배열된 방향을 따라 교대로 배치된, 표시장치.
  15. 기판 상에 제2 방향으로 배열되고 게이트 신호를 출력하는 복수의 스테이지들;
    상기 제2 방향으로 연장된 제1 메인선, 및 상기 제1 메인선과 다른 층에 배치되며 상기 제2 방향에 수직인 제1 방향으로 연장되고, 상기 제1 메인선과 상기 복수의 스테이지들을 연결하는 복수의 제1 연결선들을 포함하고, 상기 복수의 스테이지들로 제1 직류전압을 공급하는 제1 전압선;
    상기 제2 방향으로 연장되고 상기 제1 메인선과 동일층에 배치된 제2 메인선, 및 상기 제2 메인선으로부터 상기 제1 방향으로 연장되고, 상기 제2 메인선과 상기 복수의 스테이지들을 연결하는 복수의 제2 연결선들을 포함하고, 상기 복수의 스테이지들로 제2 직류전압을 공급하는 제2 전압선; 및
    상기 복수의 스테이지들 외측에 인접하여 배치되고, 상기 복수의 스테이지들 중 적어도 하나의 스테이지에 연결되고, 상기 제1 연결선들과 동일층에 배치되며 상기 제1 메인선 및 상기 제2 메인선 중 적어도 하나의 일부와 전기적으로 연결된 전극을 포함하는 적어도 하나의 커패시터;를 포함하는 표시장치.
  16. 제15항에 있어서, 상기 적어도 하나의 커패시터는,
    상기 제1 메인선의 일부를 포함하는 제1 전극과, 상기 제2 메인선과 전기적으로 연결되고 상기 제1 메인선을 따라 상기 제1 전극과 중첩하는 제2 전극을 포함하는 제1 커패시터; 및
    상기 제2 메인선의 일부를 포함하는 제3 전극과, 상기 제1 메인선과 전기적으로 연결되고 상기 제2 메인선을 따라 상기 제3 전극과 중첩하는 제4 전극을 포함하는 제2 커패시터; 중 적어도 하나를 포함하는 표시장치.
  17. 제16항에 있어서,
    상기 제1 커패시터 또는 상기 제2 커패시터는 적어도 두 개의 스테이지들이 공유하는, 표시장치.
  18. 제15항에 있어서,
    상기 제1 전압선과 병렬 배치되고 제3 직류전압이 인가되는 제3 전압선; 및
    상기 제2 전압선과 병렬 배치되고 제4 직류전압이 인가되는 제4 전압선;을 더 포함하고,
    상기 적어도 하나의 커패시터는,
    상기 제3 전압선의 일부를 포함하는 제5 전극과, 상기 제1 메인선과 전기적으로 연결되고 상기 제3 전압선을 따라 상기 제5 전극과 중첩하는 제6 전극을 포함하는 제3 커패시터; 및
    상기 제4 전압선의 일부를 포함하는 제7 전극과, 상기 제2 메인선과 전기적으로 연결되고 상기 제4 전압선을 따라 상기 제7 전극과 중첩하는 제8 전극을 포함하는 제4 커패시터;를 포함하는 표시장치.
  19. 제18항에 있어서,
    상기 제1 직류전압과 상기 제3 직류전압이 동일하고,
    상기 제2 직류전압과 상기 제4 직류전압이 동일한, 표시장치.
  20. 제18항에 있어서,
    상기 제3 커패시터 또는 상기 제4 커패시터는 적어도 두 개의 스테이지들이 공유하는, 표시장치.
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