JP2009048319A - 基準電圧回路 - Google Patents
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- G05F1/56—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices
Abstract
【解決手段】 電源端子10の電源電圧が低くなり、NMOS71が非飽和動作し、NMOS71の出力抵抗ro71が低くなっても、差動増幅回路60の増幅度Aoが大きければ、電源電圧変動除去比PSRRLFも大きくなる。よって、基準電圧回路の最低動作電圧が低くても、電源電圧変動除去比PSRRLFは大きくなることができる。つまり、差動増幅回路60の増幅度Aoが電源電圧変動除去比PSRRLFに寄与するので、差動増幅回路60の増幅度Aoが大きければ、その分、電源電圧変動除去比PSRRLFも大きくなる。
【選択図】 図2
Description
PSRRLF=gm85×ro84・・・(2)
によって算出される。
PSRRLF={(gm88+gmb88)×ro88}×(gm85×ro84)・・・(3)
によって算出される。つまり、電源電圧変動除去比PSRRLFは、(gm88+gmb88)×ro88倍される。
PSRRLF=(gmb91×ro91)×(gm85×ro84)・・・(4)
によって算出される。つまり、電源電圧変動除去比PSRRLFは、gmb91×ro91倍される。
まず、一定の基準電圧を発生する基準電圧回路の概念の構成について説明する。図1は、基準電圧回路の概念を示す図である。
[第一実施形態]
次に、第一実施形態の基準電圧回路の構成について説明する。図2は、第一実施形態の基準電圧回路を示す図である。第一実施形態において、図示しないが、P型基板が用いられ、NMOSはP型基板に形成され、PMOSはP型基板に設けられたNWELLに形成されている。
PSRRLF=[(gm71+gmb71)×Ao×ro71]×(gm52×ro51)
・・・(1)
によって算出され、従来よりも大きくなる。
[第二実施形態]
次に、第二実施形態の基準電圧回路の構成について説明する。図3は、第二実施形態の基準電圧回路を示す図である。第二実施形態において、図示しないが、P型基板が用いられ、NMOSはP型基板に形成され、PMOSはP型基板に設けられたNWELLに形成されている。
[第三実施形態]
次に、第三実施形態の基準電圧回路の構成について説明する。図4は、第三実施形態の基準電圧回路を示す図である。第三実施形態において、図示しないが、N型基板が用いられ、PMOSはN型基板に形成され、NMOSはN型基板に設けられたPWELLに形成されている。
[第四実施形態]
次に、第四実施形態の基準電圧回路の構成について説明する。図5は、第四実施形態の基準電圧回路を示す図である。第四実施形態において、図示しないが、N型基板が用いられ、PMOSはN型基板に形成され、NMOSはN型基板に設けられたPWELLに形成されている。
[第五実施形態]
次に、第五実施形態の基準電圧回路の構成について説明する。図6は、第五実施形態の基準電圧回路を示す図である。
30 基準電圧出力端子 40 内部電源端子
50 内部基準電圧回路 60 差動増幅回路
70 制御トランジスタ
Claims (4)
- 一定の基準電圧を発生する基準電圧回路において、
電源端子と、
前記電源端子の電源電圧に基づき、一定の内部基準電圧回路の電源電圧を内部電源端子に出力する制御トランジスタと、
前記内部電源端子と、
デプレッション型トランジスタ及びエンハンスメント型トランジスタを有し、前記内部基準電圧回路の電源電圧に基づき、前記デプレッション型トランジスタによって一定の電流を前記エンハンスメント型トランジスタに流し、前記エンハンスメント型トランジスタによって前記基準電圧を基準電圧出力端子に発生する前記内部基準電圧回路と、
前記基準電圧出力端子と、
所定の増幅度を有し、前記デプレッション型トランジスタが飽和動作するような入力オフセット電圧を有し、前記基準電圧及び前記内部基準電圧回路の電源電圧に基づいて動作し、前記内部基準電圧回路の電源電圧が一定になるよう前記制御トランジスタを制御する差動増幅回路と、
を備えていることを特徴とする基準電圧回路。 - 前記差動増幅回路及び前記制御トランジスタは、前記内部電源端子において、負帰還回路を形成していることを特徴とする請求項1記載の基準電圧回路。
- 一定の基準電圧を発生する基準電圧回路において、
電源端子と、
前記電源端子の電源電圧に基づき、一定の内部基準電圧回路の電源電圧を内部電源端子に出力する制御トランジスタと、
前記内部電源端子と、
接合型トランジスタ及び抵抗を有し、前記内部基準電圧回路の電源電圧に基づき、前記接合型トランジスタによって一定の電流を前記抵抗に流し、前記抵抗によって前記基準電圧を基準電圧出力端子に発生する前記内部基準電圧回路と、
前記基準電圧出力端子と、
所定の増幅度を有し、前記接合型トランジスタが飽和動作するような入力オフセット電圧を有し、前記基準電圧及び前記内部基準電圧回路の電源電圧に基づいて動作し、前記内部基準電圧回路の電源電圧が一定になるよう前記制御トランジスタを制御する差動増幅回路と、
を備えていることを特徴とする基準電圧回路。 - 前記差動増幅回路及び前記制御トランジスタは、前記内部電源端子において、負帰還回路を形成していることを特徴とする請求項3記載の基準電圧回路。
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