JP2000323436A - 銅相互接続部に用いるバリア層の形成方法 - Google Patents
銅相互接続部に用いるバリア層の形成方法Info
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- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 title claims abstract description 152
- 229910052802 copper Inorganic materials 0.000 title claims abstract description 152
- 239000010949 copper Substances 0.000 title claims abstract description 152
- 230000004888 barrier function Effects 0.000 title claims abstract description 99
- 238000000034 method Methods 0.000 title claims abstract description 78
- 238000005477 sputtering target Methods 0.000 claims abstract description 5
- 238000000151 deposition Methods 0.000 claims description 47
- 239000000463 material Substances 0.000 claims description 44
- 230000008021 deposition Effects 0.000 claims description 38
- NJPPVKZQTLUDBO-UHFFFAOYSA-N novaluron Chemical compound C1=C(Cl)C(OC(F)(F)C(OC(F)(F)F)F)=CC=C1NC(=O)NC(=O)C1=C(F)C=CC=C1F NJPPVKZQTLUDBO-UHFFFAOYSA-N 0.000 claims description 35
- 229910052715 tantalum Inorganic materials 0.000 claims description 32
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 claims description 32
- 238000012545 processing Methods 0.000 claims description 31
- 239000002245 particle Substances 0.000 claims description 23
- 230000015572 biosynthetic process Effects 0.000 claims description 17
- 239000003870 refractory metal Substances 0.000 claims description 10
- 239000011248 coating agent Substances 0.000 claims description 9
- 238000000576 coating method Methods 0.000 claims description 9
- 150000004767 nitrides Chemical class 0.000 claims description 6
- 238000005530 etching Methods 0.000 claims description 4
- 239000004020 conductor Substances 0.000 claims 3
- 238000004519 manufacturing process Methods 0.000 abstract description 8
- 238000013461 design Methods 0.000 abstract description 5
- 235000012431 wafers Nutrition 0.000 description 152
- 239000010410 layer Substances 0.000 description 137
- 230000008569 process Effects 0.000 description 49
- 229910052782 aluminium Inorganic materials 0.000 description 30
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 30
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 22
- 238000004544 sputter deposition Methods 0.000 description 22
- 238000012546 transfer Methods 0.000 description 17
- 239000004065 semiconductor Substances 0.000 description 14
- 239000007789 gas Substances 0.000 description 13
- 238000011109 contamination Methods 0.000 description 12
- MZLGASXMSKOWSE-UHFFFAOYSA-N tantalum nitride Chemical compound [Ta]#N MZLGASXMSKOWSE-UHFFFAOYSA-N 0.000 description 12
- 229910052786 argon Inorganic materials 0.000 description 11
- 238000005137 deposition process Methods 0.000 description 11
- 239000002131 composite material Substances 0.000 description 10
- 230000009977 dual effect Effects 0.000 description 10
- 230000006872 improvement Effects 0.000 description 10
- 238000000746 purification Methods 0.000 description 10
- 239000000126 substance Substances 0.000 description 9
- 239000000758 substrate Substances 0.000 description 9
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 8
- 239000000919 ceramic Substances 0.000 description 8
- 238000001465 metallisation Methods 0.000 description 8
- 230000002093 peripheral effect Effects 0.000 description 7
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 5
- 230000008901 benefit Effects 0.000 description 5
- 230000003750 conditioning effect Effects 0.000 description 5
- 230000000694 effects Effects 0.000 description 5
- 238000007747 plating Methods 0.000 description 5
- 238000005498 polishing Methods 0.000 description 5
- 239000010453 quartz Substances 0.000 description 5
- 229910052710 silicon Inorganic materials 0.000 description 5
- 239000010703 silicon Substances 0.000 description 5
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 5
- 230000002411 adverse Effects 0.000 description 4
- 238000004140 cleaning Methods 0.000 description 4
- 238000007872 degassing Methods 0.000 description 4
- 230000005684 electric field Effects 0.000 description 4
- 229910052757 nitrogen Inorganic materials 0.000 description 4
- 230000003247 decreasing effect Effects 0.000 description 3
- 230000032798 delamination Effects 0.000 description 3
- 239000003989 dielectric material Substances 0.000 description 3
- 238000009713 electroplating Methods 0.000 description 3
- 239000011261 inert gas Substances 0.000 description 3
- 230000010354 integration Effects 0.000 description 3
- 150000002500 ions Chemical class 0.000 description 3
- 229910052751 metal Inorganic materials 0.000 description 3
- 239000002184 metal Substances 0.000 description 3
- 238000012986 modification Methods 0.000 description 3
- 230000004048 modification Effects 0.000 description 3
- 229910052724 xenon Inorganic materials 0.000 description 3
- FHNFHKCVQCLJFQ-UHFFFAOYSA-N xenon atom Chemical compound [Xe] FHNFHKCVQCLJFQ-UHFFFAOYSA-N 0.000 description 3
- 229910052581 Si3N4 Inorganic materials 0.000 description 2
- 238000009825 accumulation Methods 0.000 description 2
- 239000006117 anti-reflective coating Substances 0.000 description 2
- 239000005380 borophosphosilicate glass Substances 0.000 description 2
- 239000006227 byproduct Substances 0.000 description 2
- 238000007772 electroless plating Methods 0.000 description 2
- 238000010849 ion bombardment Methods 0.000 description 2
- 238000012423 maintenance Methods 0.000 description 2
- 150000002739 metals Chemical class 0.000 description 2
- 239000005360 phosphosilicate glass Substances 0.000 description 2
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 2
- 239000007921 spray Substances 0.000 description 2
- 238000012876 topography Methods 0.000 description 2
- 241001504639 Alcedo atthis Species 0.000 description 1
- JBRZTFJDHDCESZ-UHFFFAOYSA-N AsGa Chemical compound [As]#[Ga] JBRZTFJDHDCESZ-UHFFFAOYSA-N 0.000 description 1
- 229910000881 Cu alloy Inorganic materials 0.000 description 1
- JPVYNHNXODAKFH-UHFFFAOYSA-N Cu2+ Chemical compound [Cu+2] JPVYNHNXODAKFH-UHFFFAOYSA-N 0.000 description 1
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- BPQQTUXANYXVAA-UHFFFAOYSA-N Orthosilicate Chemical compound [O-][Si]([O-])([O-])[O-] BPQQTUXANYXVAA-UHFFFAOYSA-N 0.000 description 1
- BOTDANWDWHJENH-UHFFFAOYSA-N Tetraethyl orthosilicate Chemical class CCO[Si](OCC)(OCC)OCC BOTDANWDWHJENH-UHFFFAOYSA-N 0.000 description 1
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 description 1
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 239000011324 bead Substances 0.000 description 1
- 229910010293 ceramic material Inorganic materials 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 238000012993 chemical processing Methods 0.000 description 1
- 238000004581 coalescence Methods 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 230000006835 compression Effects 0.000 description 1
- 238000007906 compression Methods 0.000 description 1
- 238000001816 cooling Methods 0.000 description 1
- 229910001431 copper ion Inorganic materials 0.000 description 1
- 230000005574 cross-species transmission Effects 0.000 description 1
- 230000001627 detrimental effect Effects 0.000 description 1
- ALKZAGKDWUSJED-UHFFFAOYSA-N dinuclear copper ion Chemical compound [Cu].[Cu] ALKZAGKDWUSJED-UHFFFAOYSA-N 0.000 description 1
- 238000001035 drying Methods 0.000 description 1
- 238000011049 filling Methods 0.000 description 1
- 229910052732 germanium Inorganic materials 0.000 description 1
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
- 238000002955 isolation Methods 0.000 description 1
- 239000007769 metal material Substances 0.000 description 1
- 239000012299 nitrogen atmosphere Substances 0.000 description 1
- 230000000737 periodic effect Effects 0.000 description 1
- 238000007517 polishing process Methods 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 230000003334 potential effect Effects 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
- 238000005546 reactive sputtering Methods 0.000 description 1
- 229910021332 silicide Inorganic materials 0.000 description 1
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 description 1
- 229910010271 silicon carbide Inorganic materials 0.000 description 1
- 238000009751 slip forming Methods 0.000 description 1
- 239000010935 stainless steel Substances 0.000 description 1
- 229910001220 stainless steel Inorganic materials 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 239000010937 tungsten Substances 0.000 description 1
- 239000011800 void material Substances 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 1
- 239000002023 wood Substances 0.000 description 1
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-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B01—PHYSICAL OR CHEMICAL PROCESSES OR APPARATUS IN GENERAL
- B01D—SEPARATION
- B01D46/00—Filters or filtering processes specially modified for separating dispersed particles from gases or vapours
- B01D46/66—Regeneration of the filtering material or filter elements inside the filter
- B01D46/68—Regeneration of the filtering material or filter elements inside the filter by means acting on the cake side involving movement with regard to the filter elements
- B01D46/681—Regeneration of the filtering material or filter elements inside the filter by means acting on the cake side involving movement with regard to the filter elements by scrapers, brushes or the like
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
- H01L21/76846—Layer combinations
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B01—PHYSICAL OR CHEMICAL PROCESSES OR APPARATUS IN GENERAL
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- B01D46/00—Filters or filtering processes specially modified for separating dispersed particles from gases or vapours
- B01D46/0002—Casings; Housings; Frame constructions
- B01D46/0005—Mounting of filtering elements within casings, housings or frames
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B01—PHYSICAL OR CHEMICAL PROCESSES OR APPARATUS IN GENERAL
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- B01D46/00—Filters or filtering processes specially modified for separating dispersed particles from gases or vapours
- B01D46/10—Particle separators, e.g. dust precipitators, using filter plates, sheets or pads having plane surfaces
- B01D46/12—Particle separators, e.g. dust precipitators, using filter plates, sheets or pads having plane surfaces in multiple arrangements
- B01D46/121—V-type arrangements
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- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C14/00—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material
- C23C14/22—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material characterised by the process of coating
- C23C14/50—Substrate holders
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- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C14/00—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material
- C23C14/22—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material characterised by the process of coating
- C23C14/56—Apparatus specially adapted for continuous coating; Arrangements for maintaining the vacuum, e.g. vacuum locks
- C23C14/564—Means for minimising impurities in the coating chamber such as dust, moisture, residual gases
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
- H01L21/76804—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics by forming tapered via holes
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
- H01L21/76807—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics for dual damascene structures
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- H—ELECTRICITY
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- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
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Abstract
方法を提供する。 【解決手段】 最初に、チャンバ(10)内においてイ
ンレイド構造上にRF予備浄化処理(408)を行う。
RF予備浄化で構造の角部(210a,206a)を丸
めることによって、ボイディングを減少させ、ステップ
・カバレッジを改善するが、下側に露出する銅相互接続
部表面(202a)から銅原子を大量に移転させない。
次に、タンタル・バリア(220)を堆積する。この場
合、タンタル・バリアの一部分は、タンタル・バリアの
他の部分よりも張力が高い。バリア層(220)の形成
後、バリア層の上面に銅シード層(222)を形成す
る。銅シード層を形成する間、改良クランプ(85)に
よってウエハをクランプし、銅の剥離およびウエハ・エ
ッジにおける汚染を低減する。次に、銅の電気めっきお
よび化学機械式研摩(CMP)プロセスを用いて、銅相
互接続構造を完成する。
Description
の製造に関し、更に特定すれば、銅相互接続部のバリア
/シード堆積(barrier/seed deposition)プロセスに関
するものである。
相互接続部におけるアルミニウムに代わる材料として、
銅の相互接続部が開発されている。銅は、その製造がア
ルミニウムよりも安価であるので、銅相互接続部は全体
としてアルミニウム相互接続部よりも優れている。加え
て、銅相互接続部は、アルミニウム相互接続部よりも抵
抗が少なく、したがって、発熱量も少ない。また、銅の
抵抗が小さいために、ICが動作することができる動作
周波数を高めることが可能となり、このために性能が向
上する。加えて、銅は、アルミニウムと比較すると、電
気移動抵抗(electromigration resistance)も改善され
ている。
の利点にも拘らず、銅が実現可能な代替物となるために
は、克服しなければならない多数の欠点がある。銅の欠
点の1つに、その移動イオン汚染源となり得ることが含
まれる。銅イオンは、半導体の製造に用いられる従来の
誘電体物質を介して容易に拡散する。適正な含有量でな
いと、銅は素子のアクティブ・エリアに拡散することに
よって、素子の信頼性に影響を及ぼす可能性がある。加
えて、銅はエッチングが容易でない。したがって、相互
接続はインレイド構造(inlaid structure)として形成し
なければならず、このため一層複雑化し、化学機械式研
摩(CMP)プロセスの使用が必要となる。更に、銅の
処理には、新たな材料や新たなプロセスの使用も必要で
あり、製造プロセスに適正に統合されない場合、種々の
問題や合併作用が生ずる可能性がある。
的にバリア層が必要となる。バリア層は、銅を封じ込め
るためにその周囲に形成され、これによって銅が隣接す
る層やアクティブ・エリアを汚染することを防止する。
これらのバリア層は、通常アルミニウムには不要であ
り、新たな製造および統合上の問題が生じ、これらに対
処しなければならない。これらのバリアを形成するため
に用いられる材料やプロセスは、よく理解されていな
い。したがって、これらを形成するための材料やプロセ
スにおける一層の改良によって、ウエハの歩留まり、素
子の信頼性、および機器のアップタイム(uptime)を格段
に向上させる潜在的な可能性がある。
(例えば、耐熱金属)の多くは、素子の信頼性に悪影響
を及ぼす可能性を有する。これら信頼性の問題は、部分
的に、隣接する膜に対するバリア層の応力に起因するも
のである。したがって、バリアの応力制御によっても、
IC全体の歩留まり改善および信頼性向上の潜在的な可
能性がある。
に用いられているプロセスやチャンバは、厚さおよび均
一性制御に関しては、最適化されていない。制御の欠如
は問題である。堆積された銅膜の均一性が大きくばらつ
く場合、歩留まりに悪影響を及ぼす可能性があり、非均
一に堆積された膜を補うために調節が必要になることに
よって、後続の処理が更に複雑化する虞れがある。
構成部品に対する接着性欠如が、堆積の間およびウエハ
運搬の間に、問題を生ずる可能性がある。これらの材料
は、潜在的な粒子源となる。堆積プロセスを最適化し、
これらの材料の接着性を高めることができれば、歩留ま
りを改善し、処理チャンバ内における粒子汚染を減少さ
せるという利点が得られよう。
ッジ(step coverage)の問題があり、ビアやトレンチの
側壁は、平坦な表面よりも銅膜の被覆が少ない。加え
て、開口上部の堆積膜が余りに高いレートで堆積された
場合、その結果銅のボイディング(voiding)の問題も生
ずる可能性がある。これは、開口を完全に充填する前
に、フィルムの最上部が挟み取られ(pinch off)、その
結果開口内部にボイドが形成される可能性がある。ステ
ップ・カバレッジを改善し、ボイディングを極力抑える
プロセスは、銅相互接続部を有する素子の歩留まり改善
および信頼性向上をもたらす潜在的な可能性を有する。
ニウムでは必ずしも問題とはならない、材料のバック・
スパッタリング(back-sputtering)が、先に引用した移
動イオンの懸念のため、銅では気掛かりとなる。露出し
たウエハ表面上にアルミニウムがバック・スパッタされ
ても、それを除去する化学物質およびプロセスが存在す
る。加えて、このアルミニウムは、種々の層を介して容
易に拡散することはない。逆に、バック・スパッタされ
た銅は、化学的にもそれ以外の方法でも除去するのは容
易ではない。バリアによって封じ込めない限り、隣接す
る膜を通過して拡散し、歩留まりおよび信頼性に影響を
及ぼす可能性が高い。したがって、下地の銅層を露出さ
せるあらゆる相互接続プロセスは、露出領域からの銅の
移転を最少に止めることを保証するように設計しなけれ
ばならない。
良によって、銅相互接続部を大量に、低コストで製造
し、しかも歩留まりおよび信頼性を向上させることが、
当業界では求められている。
図面と関連付けた以下の詳細な説明から一層明確に理解
されよう。図面において、同様の参照番号は同様の部分
および対応する部分を示すこととする。
明確化のために、示されており、必ずしも同一拡大率で
描かれている訳ではないことを、当業者は認めよう。例
えば、図面におけるエレメントの中には、本発明の実施
例の理解の促進を助けるために、その寸法が他のエレメ
ントよりも誇張されているものもある。
イド相互接続構造を形成するための、改良された方法を
教示するものである。概して言えば、本方法は、インレ
イドまたはデュアル・インレイド構造の予備金属堆積処
理の改良,インレイド構造内部における銅バリアの堆積
処理の改良,およびバリア層上のシード層の堆積処理の
改良を教示する。
バでは、電気的にバイアスされた構成部品が、他の導電
性構成部品に密接して共に配置されている。場合によっ
ては、これらは偶発的に回路を短絡し、印加されたバイ
アスを変化させ、その結果処理の一貫性を損なうことに
なる。電気的にバイアスされたウエハ・ペデスタル(支
持部材)および他の導電性チャンバ部分間でこれが発生
するのを防止するために、ペデスタルおよびその他の導
電性チャンバ構成部品間に、誘電体またはセラミック性
絶縁リングを配置する。ウエハをアークおよび短絡回路
から保護することに加えて、絶縁リングは、印加したバ
イアスが、ウエハに近接するチャンバの他の導電性部分
ではなく、ウエハに向かうことを保証するのにも役立
つ。これによって、更に、ウエハが正しく効率的に処理
され、一貫性のある結果が得られることを保証する。
る場合、これはセラミック性絶縁リングにはよく接着し
ないことがわかった。この結果、タンタル粒子がセラミ
ック絶縁リングから剥離し、ウエハ上に付着する。これ
らの粒子は、集積回路の歩留まりに重大な影響を及ぼ
す。粒子のレベルを低下させるために、セラミック絶縁
リング全体にアルミニウム・コーティングをフレーム溶
射(flame spray)またはアーク溶射(arc spray)する設計
が組み込まれた。アルミニウム・コーティングは、タン
タルの絶縁リングへの接着性を高め、粒子数を大幅に減
少させることがわかった。
するために用いていた従来のクランプは、当技術では不
適当であることがわかった。クランプの隆起影領域(ele
vated shadow region)が、ウエハの表面上に余りに高く
なるように設計されたために、影領域の下で、銅がウエ
ハ上に大量に堆積する可能性がある。このために銅の小
結節(nodule)が形成され、更にウエハ上に、ウエハの周
囲に向かうに連れて銅の厚さが徐々に減少するエリアが
生じた(傾斜銅領域(graded copper region))。続くめ
っきおよび/または化学機械式研摩(CMP)処理の
間、これら銅小結節や傾斜銅領域は粒子源となり、ウエ
ハ表面から剥がれ易いために、ダイの歩留まりを低下さ
せることがわかった。加えて、銅をスパッタしたエリア
においてクランプをウエハに接触させると、スパッタし
た銅がクランプ表面およびウエハ表面双方に付着する可
能性があり、クランプおよびウエハを互いに分離する
と、これらの表面上でこのスパッタした銅が裂けたり剥
ぎ取られる可能性がある。これらの問題を回避するため
に、改良したクランプが開発され、前述の望ましくない
現象を防止することによって、歩留まりが大幅に改善さ
れることをここに記載する。
ングをバリア堆積チャンバの構成部品上に塗着すると、
チャンバ・メンテナンスの後、粒子のためのチャンバ・
ダウン・タイムが大幅に短縮することもわかった。チャ
ンバにTaNを被覆しなかった場合、チャンバの内部コ
ンポネント上にスパッタした残留タンタルは、容易に剥
がれ、チャンバ内部およびウエハ上に粒子を発生させ
た。この結果、チャンバ浄化の頻度を高める必要性が生
じ、対応して機器のダウンタイムが増大した。周期的に
TaNをチャンバに被覆/乾燥させることによって、タ
ンタルの内部チャンバ構成部品に対する接着性を高め、
粒子を減少させ、これによってチャンバのダウン・タイ
ムを短縮し、半導体素子のダイの歩留まりが改善するこ
とが発見された。
よび予備金属堆積プロセスは、典型的に、露出した下地
のアルミニウム移転(removal)を減少させることを保証
するようには最適化されていなかった。典型的に、再度
堆積したアルミニウムは隣接した層を介して容易に拡散
せず、しかもアルミニウムは後続の化学処理によって容
易に除去されるので、アルミニウム移転の減少は懸念で
はなかった。しかしながら、銅の膜ではそうはいかな
い。この場合、銅の移動イオンによる汚染を生ずる潜在
的な可能性のために、エッチングおよび予備金属堆積プ
ロセスを進める際、その目的とする作業を遂行する間
に、露出した銅を大量に移転させないことが有利であ
る。したがって、ここでは、バック・スパッタリングお
よび露出した相互接続領域からの銅の移転に起因する銅
関連汚染に伴う問題を抑えることにより、歩留まり改善
および信頼性向上を図る、新たなビア処理技術を教示す
る。加えて、予備金属堆積処理の間に移転する銅の量
は、大幅に減少し、しかも開口の角部は十分に予備浄化
され、輪郭を明確にし、即ち、丸くすることができるた
め、接触抵抗が改善し、ステップ・カバレッジが改善
し、後続の金属堆積処理の間ボイドの形成が減少する。
られる耐熱金属の多くは、その膜応力特性が、上下に位
置する導電層および誘電体層に関して、大幅に変動する
可能性がある。これらの応力差のために、重大な信頼性
および歩留まりの問題が生ずる虞れがある。ここでは、
複合タンタル・バリア層の堆積を教示する方法を記載す
る。この場合、互いに対して、層の一部分の張力(tensi
le)を大きくし、層の他の部分の張力を小さくすること
によって、応力に関連する合併作用(complication)を減
少させる。この張力設計複合層(tensile-engineered co
mposite layer)を形成するには、バリア・チャンバのコ
イルに供給する電力のデューティ・サイクルを、バリア
・チャンバのターゲットに供給する電力に対して変化さ
せる。加えて、ターゲットと共に、ウエハ上に物質をス
パッタするためのソースとしてコイルも利用し、複合膜
(例えば、コイルから1つの材料、ターゲットから別の
材料)を形成し、ウエハ全体にわたる堆積層の全体的な
均一性を改善することができる。
より、銅相互接続部に用いるバリアおよびシード層プロ
セスの著しい改善がもたらされる。前述の統合的改善
は、図1ないし図14を具体的に参照することにより、
一層理解を深めることができよう。
ステム1を示す。システム1は、ウエハを一地点から別
の地点に移動させるように設計された、2つのロボット
制御転送チャンバを含む。第1ロボティック・チャンバ
はバッファ・チャンバ3であり、第2ロボティック・チ
ャンバは転送チャンバ2である。
の1つにウエハを配置することによって、システム1に
入れる。ロード・ロック7が適切な温度,圧力等におい
て安定化した後、バッファ・チャンバ3がウエハをロー
ド・ロック7から脱気および整合チャンバ5に移動させ
る。脱気および整合チャンバ5は、半導体ウエハ内に形
成されているフラット(flat)またはノッチを用いて、シ
ステム1内部での処理のために、回転によりウエハを整
合させる。加えて、ウエハを種々の処理チャンバの1つ
に導入する前に、脱気および整合チャンバ5はウエハに
熱またはエネルギを加え、有機的な汚染,水,またはそ
の他の望ましくない物質をウエハから除去する。かかる
除去は、これらの物質がシステム1内のチャンバのいず
れかを汚染するという可能性を低下させるために行われ
る。
チャンバ3を介して、図1に示す(図2も参照)高周波
(RF)予備浄化チャンバ10の1つに、ウエハを移動
させる。RF予備浄化チャンバ10は、インレイド・ビ
アおよび/またはトレンチ開口の角部分を丸めるために
用いられる。加えて、予備浄化チャンバでは、後続の銅
バリアおよび銅シード層形成の準備として、半導体ウエ
ハの露出した導電面を浄化する。
チャンバ9を介して、転送チャンバ2にウエハを転送す
る。次いで、転送チャンバ2は、ウエハをバリア堆積チ
ャンバ40(図3も参照)に導入する。転送チャンバ2
を介した処理チャンバ間のウエハの転送は、制御された
状態の下で、制御された環境で行われ、これによってウ
エハ転送の間ウエハ上の汚染が減少する。バリア堆積チ
ャンバ40は、ウエハ上に銅を堆積する前に、半導体ウ
エハ上に銅バリア層を堆積する。バリアは、好ましく
は、タンタル,あるいはその他の何らかの耐熱金属また
は耐熱金属窒化物である。あるいは、バリア層の形成に
有用な他の種類の単一材料または複合材料を用いて形成
することも可能である。
ンバ70(図4も参照)にウエアを移送する。チャンバ
70において、銅シード層を形成し、その上に、電気め
っき、無電解めっき、堆積、スパッタ等で銅を形成する
ことができる。銅シード層を形成した後、チャンバ9を
介してオプションの冷却チャンバ(図示せず)にウエハ
を移送し、バッファ・チャンバ3に移動させる前にウエ
ハを冷却する。次に、バッファ・チャンバ3は、チャン
バ9からロード・ロック7に逆にウエハを転送すること
により、ウエハをシステム1から取り出す。取り出す時
点で、処理された半導体ウエハは、その露出表面上に、
導電性バリア層および銅シード層が形成されており、バ
ルク銅堆積およびCMPの準備が整っている。
々のチャンバおよびそれらの副構成部品については、図
3ないし図7において更に詳しく論ずる。システム1
が、先に論じたシーケンスによって移送される半導体ウ
エハに対して有する効果については、ここの図8ないし
図11に詳しく示す。加えて、図1のシステム1が半導
体ウエハ上で行う工程については、ここの図12ないし
図14を参照しながら、更に例示し論ずることにする。
したがって、図2ないし図14の論述によって、先に論
じたプロセスを一層深く理解することができよう。
バ10を更に詳しく示す。チャンバ10は、ドーム12
を含み、これを用いてRF予備浄化チャンバ10内部に
RF予備浄化環境を封じ込める。通常、ドーム12は、
ビーズ噴射クオーツ(bead blasted quartz)で作られ、
粒子の接着を促進する。加えて、クオーツは誘電体材料
であり、外部電界(例えば、以下で論ずるコイル16か
らの電界)が、予備浄化処理環境に影響を及ぼし、ウエ
ハの処理を行うことを可能にする。したがって、クオー
ツが好ましい材料ではあるが、外部電界の通過を妨げな
いのであれば、他の材料も使用可能である。
および上面に沿って密封(encase)され、更にベース・プ
レート18によって底面に沿って密封されている。エレ
メント14,18は通常アルミニウム,または無線周波
数(RF)を遮蔽可能な同様の金属材料で作られる。シ
ールド14およびドーム12間に位置するのはコイル1
6である。コイル16は、その形状が円筒状であり、ク
オーツ・ドーム12を包囲する。コイル16には、コイ
ル電源26によって、低周波RF電力が供給される。
エハ・ペデスタル20(ウエハ・チャック)上に置か
れ、ここで続いて処理される。ウエハ・ペデスタル20
には、ペデスタル電源24によって、高周波RF電力が
供給される。ウエハ22は、真空,機械式クランプ,静
電力等を用いて、ペデスタル20に固着することができ
る。あるいは、システムによっては、ウエハを固着せず
に放置してもよい。図2は、ガス供給ライン28を示
す。ガス供給ライン28は、クオーツ・ドーム12によ
って封じ込められている内部チャンバ環境にガスを供給
する。内部チャンバ環境に供給されるガスは、通常不活
性スパッタリング・ガスであり、典型的に、アルゴン,
窒素,またはキセノンが含まれる。加えて、図2は、排
気ポート30を示す。排気ポート30は、反応後の副産
物および未反応の副産物をチャンバ10から除去し、ウ
エハ処理の間圧力を維持する。通常、チャンバ10は、
ウエハ22の予備処理および予備浄化を行い、バリア層
およびシード層を堆積する前に、インレイド開口の角部
を丸め、開口内部の露出されている導電面を浄化する。
予備浄化プロセスについては、図9および図12を参照
しながら更に詳しく説明する。
40を更に詳細に示す。図3のバリア堆積チャンバ40
は、アルミニウムまたはアルミニウム・アーク溶射ステ
ンレス鋼で作られたシールド42を含む。シールド42
の上面上には、トップ・プレート44がある。トップ・
プレート44は、回転磁気アセンブリ46を収容即ち支
持する。回転磁気アセンブリ46は、ターゲット48か
らウエハ22上にバリア材料をスパッタする間、原子を
スパッタリング・ターゲット48に放射する。スパッタ
リング・ターゲット48は、トップ・プレート44の底
面に取り付けられており、好ましくはタンタル(Ta)
で作られる。あるいは、バリア層ターゲットは、窒化タ
ンタル(TaN),窒化チタン(TiN),タンタル・
タングステン(TiW)等のような、その他の材料で構
成することも可能である。ターゲット48には、典型的
に、図3に示すようなターゲット電源50によって供給
される、直流(DC)を給電する。
る。コイル52は、コイル電源54に接続されており、
これによって、ウエハ処理の間コイル52にバイアスを
かけることができる。ウエハ22は、チャンバ40のウ
エハ・ペデスタル56(ウエハ・チャック)上に置かれ
る。真空,機械式クランプ,静電力等を用いて、ウエハ
をウエハ・ペデスタル56に固着することができる。し
かしながら、ここに記載中の実施例では、ウエハ・ペデ
スタル56にウエハを固着しない。ペデスタル56に
は、ペデスタル電源58によってバイアスがかけられ
る。具体的なバイアス条件については、後に図14を参
照しながら詳細に論ずることにする。
あり、図3に示すように、これを通じて入力ガス・ソー
ス62がチャンバ内に供給される。入力ガス・ソース・
ポート62は、窒素,アルゴン,および/またはキセノ
ンというような種々のガスを、処理チャンバ40内に導
入し、スパッタリング処理を一層効果的に行うことを可
能にする。加えて、図3は、排気ポート64も示す。排
気ポート64は、スパッタリング処理の残留副産物を除
去するため、およびウエハ22のスパッタ処理の間チャ
ンバ内の圧力を規制するために用いられる。
効率的にバイアスされることを保証するために、図3に
示す誘電体絶縁リング53を用いて、ウエハ・ペデスタ
ルおよびその他の導電性チャンバ構成部品間の電気的接
触を防止する。誘電体絶縁リング53は、セラミック材
料で作ることが好ましい。しかしながら、タンタル・タ
ーゲット48からセラミック絶縁リング53上に本来ス
パッタされるタンタル(Ta)は、強く接着せず、この
ため、タンタルのセラミック絶縁リング53からの剥離
が頻繁に生じ、ウエハ22上の粒子汚染を増大すること
がわかっている。この粒子汚染は、ダイの歩留まりを著
しく低下させる。したがって、本発明の一実施例によれ
ば、セラミック即ち誘電体絶縁リング53の上面の露出
面に、アーク溶射アルミニウムまたはフレーム溶射アル
ミニウムの層を被覆する。このようにセラミック絶縁リ
ング53上に表面を追加することにより、タンタル堆積
の間、タンタルの絶縁リング53への接着性が高くな
り、これによって、従来技術において用いられていた絶
縁リングに対して、チャンバ内の粒子制御が大幅に改善
される。
るタンタル(Ta)はチャンバ40内部の他のコンポネ
ント上にも容易に堆積することがわかっている。一例と
して、タンタルは、シールド42,クランプ55,また
はチャンバ40内部にあるその他のコンポネント上に堆
積することができる。通常、タンタルは、時間が経過か
しても、これらのコンポネントに直接適当に接着しな
い。スパッタされたタンタルがこれらのコンポネントに
強く接着しない場合、剥離して粒子量の増大を招き、歩
留まりに悪影響を及ぼし、システムのダウンタイムが増
大する。
40を浄化する際に、ウエハをチャンバ40に再度導入
する前に、チャンバ40にコンディショニング工程を実
行するとよいことがわかっている。このコンディショニ
ング工程は、ガス入力ライン62を通じてチャンバ40
に窒素を導入しつつ、窒素雰囲気内でターゲット48か
らTaを反応的にスパッタすることから成る。一例とし
て、一実施例では、これは、ターゲット48に約130
0ないし1700ワット(W)の範囲の電力を供給し、
コイル52に約1300ないし1700Wの範囲の電力
を供給し、電源50,54および/または58によって
ペデスタル56に電力を供給することによって、チャン
バ40の内面部分およびその構成部品全体に、窒化タン
タル膜の堆積が形成されるようにすることによって、反
応性スパッタリング堆積システムにおいて行われる。窒
化タンタル膜は、約0.25ないし0.75ミクロンの
範囲の厚さに堆積される。コンディショニング工程の
間、ペデスタル上に金属ディスクを配置し、スパッタさ
れた物質がヒータ上に堆積するのを防止する。このコン
ディショニング工程によって、クリティカルな内部チャ
ンバ構成部品にTaNを被覆することによって、ウエハ
処理の間にチャンバ構成部品上に続いて堆積されるタン
タルの接着性を高める。チャンバ40によって指定数の
ウエハを処理し終えた後、別のチャンバ・メンテナンス
浄化過程,および内部チャンバ構成部品上に窒化タンタ
ル(TaN)を堆積する別のコンディショニング処理を
再度行う。代替実施例では、窒素環境においてターゲッ
トからのTaをスパッタしTaN層を形成する代わり
に、複合TaNターゲットを代わりに用いて、内部チャ
ンバ構成部品上に窒化タンタル層を堆積することも可能
である。
70を更に詳細に示す。図3と同様に、チャンバ70
は、これまでに論じたエレメントと同様のシールド7
2,トップ・プレート74,回転磁気アセンブリ76,
銅ターゲット78,ターゲット電源80,コイル82,
コイル電源84,ウエハ・ペデスタル86,ペデスタル
電源88,ボトム・プレート90,入力ガス・ソース9
2,排気ポート94を備えている。しかしながら、図4
のウエハ支持およびクランプ構造は、図3のチャンバ4
0に示すそれとは異なる。図3におけるウエハはチャン
バ40内において自由放置状態であったのに対して、図
4におけるウエハは、改良クランプ85を用いて、図4
のウエハ・ペデスタル86にクランプされている。
ゴン(Ar)または同様の不活性ガスを入力92を通じ
てチャンバ70に供給する間、システムに給電する。こ
の結果、銅がターゲット78からウエハ22上にスパッ
タされる。ここに述べる改良は、プロセスにおいては、
図4において用いられている具体的な改良クランプ85
における程多くない。したがって、図5ないし図7によ
って、クランプ85の詳細な論述を行うことにする。
領域における銅の剥離を減少させることによってIC製
造の間における粒子および粒子に関連する歩留まりの問
題を減ずるために、設計し直されたものである。図5
は、図4に示すクランプの内周部分の拡大断面図を示
し、更にウエハ22に対するその位置および機能を示
す。クランプ85の接触部分100は、基礎となるウエ
ハ・ペデスタル即ち支持部材(図示せず)にウエハを固
着するために用いられる。クランプの内径に位置する隆
起領域を、シャドウ部分(shadow portion)と呼ぶ。これ
は、ウエハ22の周辺部分の領域102上に位置する。
図5は、クランプ85のシャドウ部分が、ウエハ22の
表面から距離104だけ上に位置することを示す。図5
に示すクランプの設計における重要な点は、クランプ8
5がウエハ22に接触する、または近接する点105に
ある。通常、点105がクランプの他の寸法に対して適
正に設計されていない場合、スパッタされた銅の望まし
くない堆積が生ずる。これは、ウエハを外す(unclamp)
ときに問題となり得る。ウエハを外す際、点105付近
でウエハおよびクランプ双方に連続して形成された銅
は、これらの表面双方から剥がれ易い。これは、粒子を
発生する可能性があり、更に後の処理の間にウエハから
銅膜が後から剥がれる原因ともなり得る。
示す従来技術のクランプ99に関して、最良に理解し論
述することができる。クランプ99がウエハ22を固着
している間、銅または銅シード層108が上に位置する
ターゲットからスパッタされる。シャドウ部分の高さ1
14が高過ぎる場合、銅は、経路116のような経路に
沿ってスパッタされ、ウエハのシャドウ部分の下の領域
に形成される可能性がある。これらの領域に形成される
銅は、(厚い層から薄い層へ)段階的な厚さを有し、最
終的にシャドウ部分115の下の最外側エリアにおいて
銅の小結節として終結する可能性がある。このシャドウ
部分は、ウエハ22の周辺部分に向かって位置する。銅
小結節110および傾斜銅部分112は、後続の銅めっ
き処理において非均一にめっきされるため、問題であ
る。加えて、銅めっきおよび化学機械式研摩(CMP)
処理が銅小結節110および傾斜銅部分112上で行わ
れるために、時が経つに連れてウエハからかなり剥離す
る潜在的な可能性があり好ましくない。したがって、当
技術分野では、可能な限り常に銅小結節110および傾
斜銅領域112の形成を減少させる必要性がある。
すように、十分に広くないシャドウ領域115を生ずる
場合がある。この領域115が狭すぎ、高さ114が大
きすぎると、典型的にクランプ99をウエハ22に接触
させる点117も、その上およびその周囲に銅を堆積さ
せる潜在的な可能性がある。その結果、十分な銅が点1
17上に形成し、クランプをウエハから分離するとき
に、点117において、銅層108が裂けたり剥ぎ取ら
れることになる。これは、ウエハ22のエッジから粒子
が発生することによって、歩留まりに影響を及ぼす可能
性がある。したがって、銅または銅シード層の形成に用
いるために改良された機能的なクランプを開発するため
には、寸法115,114は、当技術分野に現在存在す
るものよりも注意深く設計しなければならない。
示す。寸法104は、図7の高さ寸法114よりも小さ
い。即ち、従来技術は、寸法114が8ミル未満のシャ
ドウ部分を有するクランプを作成していない。ウエハ2
2から離れたかかる「高い」シャドウ部分は、少なくと
も部分的には、クランプ99に対して先に論じた問題の
原因となる。図5では、クランプ85の寸法104は、
8ミル未満と設計されている。好適実施例では、寸法1
04は5ミル未満であり、場合によっては3ミル未満と
する。通常、図5の寸法104は、殆どの場合、おおま
かに2ないし5ミルの範囲にあるいずれかの値である。
寸法104を小さくすると、シャドウ部分の下に形成さ
れる銅の量が減少し、これに対応して、シャドウ部分の
下に生ずる傾斜した銅や銅の小結節に伴う問題も減少す
る。図5のクランプの内周107とウエハを接触させな
いことは重要である。これは重要であり、そうでないと
図7の点117に関して先に論じた引裂の問題が生ず
る。ただし、この場合は、かかる銅の蓄積および引き裂
きは、図5の点105ではなく、107において発生す
る。したがって、スタンドオフ寸法104を、ウエハ・
トポグラフィ(wafer topography)および堆積したバリア
の厚さ,シードおよび/または銅層に依存するなんらか
のスレシホルド未満の点に下げないことには、正当な理
由がある。
的に20ミル以上に設定し、対角線堆積経路116(図
7に示す)による銅材料の好ましくない蓄積が点105
において生じないことを保証する。この寸法104に対
する102の相対的な寸法の延長によって、更に、シー
ド層の周辺部分の引裂が回避されるか、あるいは大幅に
減少することを保証する。要約すると、改良クランプ8
5は、図7に示す、銅の傾斜112および銅の小結節1
10を減少させることによって、周辺の銅剥離および粒
子を大幅に減少させる。加えて、新たに設計したクラン
プ85は、ウエハに接触するクランプ85の表面付近に
銅の蓄積が発生せず、銅シード層の形成の間に、意に反
してウエハ22の表面から銅が引裂かれることがないよ
うに保証する。
5,114によって既定される矩形二次元形状によるも
のである。図5に既定する矩形領域の形状を、寸法10
2,104によって変更することによって、銅シード層
の形成に改良が得られる。したがって、前述の具体的な
寸法102,104によるクランプの改良について説明
する代わりに、寸法102、即ち、オーバーハングは、
ウエハの表面から上に、シャドウ部分の寸法104即ち
高さの少なくとも2.5倍となるようにしなければなら
ないことを代わりに述べることができよう。内輪に見積
もって、距離102は、寸法104の少なくとも4.0
倍とすべきであろう。かかる幾何学的関係により、図7
の傾斜した銅112の形成および小結節110の形成を
減少させるかまたは回避することを保証し、同時に図5
の接触点105または外周点107においてウエハから
銅シード層が引裂かれないことも保証する。
られるクランプ85を上から見た図を示す。殆どの半導
体ウエハ22は、英数字識別領域106を含み、典型的
にウエハの表面を横切ってレーザで刻印された文字を含
む。図3のチャンバ40では、これらの英数字を処理
し、Taバリア層で被覆した。バリア層は非常に薄く、
これに比して、英数字は非常に深く形成されているの
で、英数字は、英数字のトポグラフィ内のバリア層の堆
積によって、歪んだり、埋まったり、事実上消去される
ことはない。しかしながら、銅シード層は、続いて潜在
的に0.4ミクロン以上の厚さに形成され得るので、英
数字識別領域106を完全に隠すか、あるいは実質的に
歪める可能性がある。したがって、図4および図5に示
すクランプ85は、図6において、クランプがウエハ上
に位置する場合に、英数字識別領域106を覆う部分を
有するリング形状に加工される。こうすることによっ
て、銅シード層は、英数字識別領域を除いた領域に形成
され、これによって銅めっきを行った後でも、これら識
別記号は保存される。
て、図4のシード層堆積チャンバ70内部で用い、銅相
互接続部の処理を改良する、改良クランプ構造を示す。
に示したシステムを用いて、デュアル・インレイド銅相
互接続構造を形成する方法を断面図で示す。
00を示す。好適な形態では、基板はシリコン・ウエハ
である。しかしながら、シリコン・カーバイド,ゲルマ
ニウム・シリコン,ゲルマニウム,ガリウム砒素,その
他のIII−V化合物、絶縁物上シリコン(SOI)基
板,および同様の半導体材料のような、その他の基板
も、本願の教示によれば使用可能である。この基板の上
面上には、種々の導電層および誘電体層が形成される。
これらの層は、金属,耐熱金属,シリサイド,ポリシリ
コン,窒化物,酸化物等のような材料を含むが、これら
に限定されるという訳ではない。基板上面上のこれらの
層は、種々の能動素子,受動素子,および基板表面上の
電気素子間の相互接続領域を形成する。
を相互接続部202として示す。好適な形態では、相互
接続部202は銅材料で作られ、適切なバリア層(図8
には具体的に示されていない)を有するデュアル・イン
レイドまたは単一インレイド構造であることが好まし
い。相互接続部202の上面上には、窒化シリコン,シ
リコン濃厚窒化シリコン,酸窒化シリコン,プラズマ・
エンハンス窒化物,および/または同様の材料あるいは
複合材のような、エッチ・ストップ層204を形成す
る。エッチ・ストップ層204上には、1つ以上の誘電
体層206を形成する。誘電体層206は、1つ以上の
テトラエチルオルトシリケート(TEOS:tetraethyl
orthosilicate),ボロフォスフォシリケート・ガラス
(BPSG:borophosphosilicate glass),フォスフ
ォシリケート・ガラス(PSG:phosphosilicate glas
s),フッ素ドープTEOS,低誘電率誘電体(low-k di
electrics),酸窒化物,および/または同様の誘電体あ
るいはその複合体を含む。層206上には、第2エッチ
・ストップおよび反射防止コーティング(ARC:anti
reflective coating)層208を形成する。層208
を形成するために用いる材料は、層204を形成するた
めに用いる材料と同様である。層208の上面上には、
別の誘電体層210があり、誘電体層206について先
に論じたのと同様の材料および処理によって形成する。
ソグラフ・プロセスをエッチング・プロセスと共に用い
て、図8に示すように、層204ないし210を貫通す
る単一インレイドまたはデュアル・インレイド開口を形
成する。図8では、トレンチ部212aおよびビア部2
12bを有するデュアル・インレイド開口が示されてい
る。開口212は、「ビア最初/トレンチ最後」、「ト
レンチ最初/ビア最後」、または図8に示す構造全体を
結果的に形成するその他のいずれかの方法で形成可能で
ある。
に、システム1のロード・ロック7内にウエハ22を配
置する。ここで教示したように、RF予備浄化チャンバ
10にウエハを転送する。RF予備浄化チャンバ10内
において、図9に示すように、アルゴンまたはキセノン
のような不活性ガスを電界の存在の下でイオン化し、イ
オン化粒子214をウエハ表面に向かわせることによっ
て、ウエハ22をエッチングする。イオン化粒子214
は、図9に示すように、層210,206,202の表
面上で衝突する。しかしながら、露出表面202aから
露出された銅層202の部分を大量にスパッタまたは除
去することなく、丸い角部210a,206aが形成さ
れるように、イオン化粒子214に給電する。深さに基
づいてかかる選択的除去を行うには、コイル電源26を
用いてコイル16に高レベルのRF電力を給電し、ペデ
スタル電源24を用いてウエハ・ペデスタルに比較的低
いレベルのRFパワーを給電する(図13も参照)。こ
の電力差によって、下側の露出表面部分に対して、上側
の露出表面部分に沿った方に、イオン衝撃からの高いエ
ッチング・レートが得られることを保証する(例えば、
角部210aは、角部206よりも大きく丸められる。
何故なら、表面210は表面206よりも高いレートで
エッチングされるからである)。更に、開口底面におけ
る露出表面202は、受けるイオン衝撃量が最も少ない
ので、開口の部分からは最少量の材料が除去即ちスパッ
タされる。更に、角部210a,206aの端部から除
去される材料の量は、表面202aから除去される材料
の量よりも多い。角部を丸めることによって、その後に
堆積するバリアおよび導電膜のステップ・カバレッジを
改善し、開口内においてこれらの膜を一層均一に堆積可
能とすることによって、開口底面におけるボイド発生の
低減に供することになる。
びウエハ・ペデスタル電力(ウエハ電力)は、200ワ
ットのような等しいレベルに設定されていた(例えば、
図13参照)。このように等しいレベルが用いられてい
たのは、アルミニウム相互接続部における露出アルミニ
ウムの移転即ちスパッタリングが、集積回路の歩留まり
および信頼性に対して有害ではないからである。しかし
ながら、図9において表面202aからバック・スパッ
タされ移転され、更に誘電体層210,206上に再度
堆積される銅は、従来技術のアルミニウムとは異なり、
歩留まりに悪影響を及ぼす可能性がある。層210,2
06上に堆積されたいずれの銅も、層210,206を
介して容易に拡散し、潜在的に素子の汚染および歩留ま
りの低下を招く可能性がある。加えて、銅の汚染は、ア
ルミニウムの場合のように、化学処理やエッチングによ
って容易に除去することができない。したがって、図9
のプロセスによって、相互接続部202の表面202a
からの銅の移転率を減少させることが、素子の信頼性に
とって有効である。
れる図9のプロセスは、丸めた角部210a,206a
を形成し、ステップ・カバレッジを改善し、その後の銅
相互接続部のボイディングを減少させる一方、同時に表
面202aからの銅のスパッタリングの割合を低下させ
ることによって、歩留まり低下を招く銅の汚染を発生す
る可能性を低下させる。
した後、ウエハ22を図1のチャンバ10から図1のバ
リア堆積チャンバ40に移動させる。尚、図1のチャン
バ40は、図3にも更に詳しく示されていることを注記
しておく。図10は、図1および図3に示すチャンバ4
0を用いて、図9に以前に示したウエハの表面上に、バ
リア層220を堆積する工程を示す。典型的に、層22
0は、厚さ約200オングストロームないし750オン
グストロームに形成し、タンタル(Ta)層であること
が好ましい。好適な形態では、複合層220の応力を設
計する際、層210の部分は張力が徐々に減少する層と
して堆積し、一方層210の他の部分は張力が徐々に増
大する層として堆積する。言い換えると、図10におい
て、層220の張力が高い部分を少なくとも1箇所形成
し、層220の張力が低い部分を少なくとも1箇所形成
し、完全なTaバリア層を形成する。かかるバリア層2
20の形成によって、IC製造における、ストレスに関
連する信頼性の懸念が減少し、全体的にICの歩留まり
が改善する。高張力および低張力複合層220を形成す
るために使用可能な具体的な方法については、以下で図
12および図14を参照しながら更に具体的に明記す
る。
20の形成の後、ウエハをチャンバ40からチャンバ7
0に移動させる。尚、チャンバ70は、本明細書の図4
に更に詳細に示されていることを注記しておく。図4で
は、図5および図6に示し先に論じた改良クランプを用
いて、図10のバリア層220上に、改良された銅シー
ド層222を形成する。通常、層222は銅層として形
成し、通常厚さ100オングストロームないし2000
オングストロームの間に形成する。時として、特にほぼ
垂直なビア側壁では、シード層の厚さは、平坦面の方が
側壁表面よりも大きくなる場合がある。しかしながら、
先に図9に示した丸い角部210a,206aのため
に、かかるステップ・カバレッジを改善することができ
る。加えて、図10のプロセスにおける図5および図6
の改良クランプの使用により、特にウエハ周囲におい
て、従来技術において用いられていたハードウエアおよ
びプロセスに対して、歩留まりが大幅に改善する。
ターゲット双方からシード層および/またはバリア層を
スパッタすることによって、均一性が格段に改善するこ
とがわかった。加えて、50ミクロン未満の粒度(grain
size)を有する銅シード層のコイルは、銅シード層の品
質を高め、電気移動および信頼性に対して潜在的に効果
があることがわかった。通常、従来技術では、コイルの
粒度は、銅シード層の品質には殆ど影響を及ぼさないと
考えられていた。
図的にコイルおよびターゲット双方から物質をスパッタ
することによって、制御され改善される。これは、コイ
ルから偶発的に生ずる残留スパッタリングと同一ではな
い。当技術分野では、コイルから物質をスパッタするこ
とは望ましくない。何故なら、当技術分野では、かかる
スパッタリングには何ら利点が見出されず、しかもかか
るスパッタリングはコイルの寿命を縮めるだけに過ぎな
いからである。しかしながら、あらゆるスパッタリング
・システムにおいても、常にチャンバ構成部品から物質
に対して、微量のスパッタリングおよび取るに足らない
スパッタリングがある。ここに教示するプロセスは、コ
イルからのスパッタリングの割合を意図的に高めるによ
って、堆積した層の大部分を、コイルから移転された材
料とすることを教示する。例えば、本発明の実施例は、
銅シード層における材料全体の少なくとも最少5%がコ
イルから得たものであるとするが、一方、従来技術で
は、典型的に、銅シード層内の材料の内、コイルから得
るのは1ないし2%以下である。加えて、コイルおよび
ターゲットは、いずれも、銅,銅合金,または異なる材
料で形成し、ウエハ上に複合層を形成することも可能で
ある。要約すると、故意的に給電しコイルからスパッタ
することによって、堆積される層の均一性に対する制御
性を更に高めるという予期しない効果が得られた。
アル・インレイド相互接続構造を形成した後の図10の
デュアル・インレイド開口を示す。図11では、無電
解,電気めっき,またはCVDプロセスを用いて、シー
ド層222上およびデュアル・インレイド開口内部に、
銅膜224を堆積した。したがって、銅層224は、ほ
ぼ開口を充填し、ボイディングが減少または排除され、
シード層22上に形成される。典型的に、銅層224の
厚さは、5000オングストロームないし1.2ミクロ
ンの間である。層224の形成後、化学機械式研摩(C
MP)プロセスを実行し、デュアル・インレイド開口内
に含まれない銅層224,シード層222,およびバリ
ア220の部分を除去する。この研磨プロセスによっ
て、図10に示すような、デュアル・インレイド相互接
続構造が形成される。
置する時点から、図1のシステム1からウエアを取り出
す時点までの統合化プロセスを、フロー・チャートで示
す。第1ステップ400において、図1のロード・ロッ
ク7にウエハ22を配置する。ステップ402におい
て、ロード・ロック7からバッファ・チャンバ3を介し
て脱気チャンバ5にウエハを転送する。チャンバ5にお
いて、ウエハを加熱し有機物や水分をウエハの表面から
除去し、他のチャンバにおける後続処理のために準備し
ておく。加えて、チャンバ5は、ウエハをウエハ・ノッ
チまたはウエハ・フラットと空間的に整合する。
バッファ・チャンバ3を介してチャンバ10にウエハを
転送する。チャンバ10を用いて、ウエハ22をRF予
備浄化する。ステップ408の具体的な予備浄化条件
を、従来技術の予備浄化条件と、図13において比較す
る。このプロセスおよびその効果について、更に図9の
断面図に示す。図13において、従来技術の予備浄化プ
ロセスは、コイルおよびウエハをおおまかに同じ電力レ
ベルに給電する。これらの電力設定は、スループットの
理由のために行われる。コイルおよびウエハの電力が双
方共高い電力(例えば、200ワット)に設定された場
合、予備浄化プロセスによって、高速でウエハの全表面
から物質を除去する。したがって、スループットの理由
からは、高電力プロセスは望ましいものであり、これに
よって、開口内部で、露出した下地のアルミニウムが大
量に、偶然にウエハの表面上にスパッタされた。しかし
ながら、従来技術のプロセスでは、アルミニウムのスパ
ッタリングを問題にしていない。何故なら、スパッタさ
れたアルミニウムは除去することができ、アルミニウム
の汚染は懸念されなかったからである。
は、図9に示す表面202a上に露出した銅が存在する
状態での予備浄化プロセスである。本発明の一実施例に
よれば、この目的のためにコイル電力を300ワット以
上に高め、一方ウエハ電力は100ワット以下に落と
し、電力勾配を形成した。これらの電力は概算値(conse
rvatve number)であり、単にコイル電力からウエハ電力
に対しておおまかに2:1の電力比を維持するために必
要であるに過ぎない。この電力勾配によって、層210
の露出上面からの物質のスパッタリング即ち移転が、層
206の露出表面からの物質の移転またはスパッタリン
グよりも多いことを保証する。一方、これら双方は、図
9における開口の底面の露出銅表面202aからスパッ
タされる物質の量よりは多い。したがって、図9におけ
る角部210a,206aの有利な丸めが、この場合に
も得られ(角部210aは角部206aよりも多少丸み
が大きい)、かかる丸みによってステップ・カバレッジ
が改善し、ボイディングが減少する。利点である丸め形
状(rounded profile)が得られることに加えて、電力勾
配によって、図9の表面202aからの銅の移転が最少
に抑えられるので、従来技術のアルミニウム処理では全
く問題にならなかった汚染が、銅接続部についても最小
となる。
の後にステップ408が続く。ステップ410では、ウ
エハ22を図1および図2の予備浄化チャンバ10か
ら、図1および図3のチャンバ40に移動させる。ステ
ップ412では、図3のチャンバ40が、図10に示す
バリア層220を堆積する。バリア膜の堆積は、図14
に示しかつ説明したプロセス・シーケンスにしたがって
行う。
を配置し、チャンバを安定化させた後、図3のターゲッ
ト48に1000ワット(ターゲット・バイアス)の電
力を印加する。図10のバリア層220の堆積の間、電
力を継続的に印加する。ターゲット電力は、具体的に1
00ワットの印加電力を有するものとして示すが、所望
の処理結果,および使用する堆積機器の種類に応じて、
他のいずれの電力設定でも使用可能である。バリア堆積
プロセスの処理期間の間、ターゲット・バイアスに印加
する電力は1000ワットであり、図3のペデスタル電
源58によってウエハ22に印加する電力(ウエハ・バ
イアス)は、低い値即ち0ワットに設定する。初期期間
の後、ウエハ・バイアスを約0ワットから450ワット
に変化させ、相互接続開口の底面から開口の側壁にバリ
ア物質をバック・スパッタし、開口内部のバリア膜のカ
バレッジ全体を改善する。ウエハ・バイアスに印加する
波形は、図14に示すものとは別にすることができる。
更に、所望のプロセス結果および使用する機器の種類に
応じて、450ワット以外の他の電力レベルに傾斜させ
ることも可能である。システムの中には、バリア堆積プ
ロセスの間、ウエハには全くバイアスしない場合もあ
る。
力波形およびウエハ・バイアス電力波形と共に、3つの
可能なコイル電力波形600,602,604の1つを
使用可能であることを示す。第1コイル電力波形600
は、図3のコイル52にターゲット48とほぼ同じ時点
に電源を入れることを示す。したがって、波形600
は、ターゲット48に最初に約1000ワット給電する
のとほぼ同時に、コイルに約1500ワット給電するこ
とを示す。波形600では約1500ワットを示すが、
必要であれば、種々のプロセスおよび機器に対処するた
めに、他の電力レベルも使用可能である。指定した時間
期間が過ぎた後、図14における波形600で示すよう
に、バリア堆積プロセスを終了する前に、コイル電力を
停止するかまたは低下させる。言い換えると、高コイル
電力処理シーケンスの間に図10のバリア膜220の初
期部分を堆積し、低コイル電力またはゼロ・コイル電力
処理シーケンスの間に、膜220の別の部分を堆積す
る。コイルに給電している初期時間期間の間に形成した
タンタル・バリアの部分は、比較的低い電力量をコイル
に印加したときに形成されたタンタル・バリアの部分と
比較すると、異なる応力特性を有する。コイルに給電し
ている間では、低張力のタンタル・バリア膜が堆積され
る。コイル電力を停止または低下させた時間では、張力
が高いタンタル・バリア膜が堆積される。したがって、
バリアの堆積の間、コイルへの電力を選択的に制御する
ことによって、上側および下側の層の各応力に対処し
て、バリアの応力を設計することができ、これによって
接着性およびIC全体の歩留まりを改善する。
差は、堆積したバリア部分へのアルゴン(または同様の
不活性ガス)の合体の割合が、コイルに印加する電力上
昇の結果として、異なることに起因すると考えられる。
即ち、コイルに給電している場合、チャンバ内のアルゴ
ンはイオン化される度合いが大きく、バリア膜内に堆積
される量も多くなる。コイルに給電しない場合、チャン
バ40(図3参照)においてイオン化されるアルゴンは
減少し、したがってバリア膜内に合体するアルゴンも減
少する。したがって、この膜の厚さによるアルゴンの差
/勾配は、コイルのデューティ・サイクル曲線(図14
における曲線600,602,または604の1つ)に
比例する。最終的なバリア膜におけるこれらアルゴンの
勾配が、図10のバリア膜220の応力特性の改善に寄
与すると考えられる。
2を示す。このコイル電力波形602では、図3のコイ
ル52を最初にオフにしておき、一方ターゲット電力を
イネーブルする。コイル電力を印加しない初期バリア堆
積期間の後、図14の曲線602に示すように、コイル
電力をイネーブルする。したがって、波形602は、基
本的に、波形600の逆であり、これによって、波形6
02は、曲線600によって形成される膜と比較して、
逆の応力特性を有するバリア膜を生成する。波形602
の処理シーケンスを用いる場合、堆積プロセスの第1段
階の間に張力の高いタンタル膜が最初に堆積され、堆積
プロセスの第2段階の間に張力の低いタンタル膜が堆積
される。
の形成に使用することができる、第3の可能な波形60
4も示す。波形604は、コイル52にパルス状電力
(周期的または非周期的のいずれか)を印加することを
示す。図14におけるようなパルス状コイル電力波形を
用いる場合、ウエハ22上には、張力が低いタンタルの
部分および張力が高いタンタルの部分の交互層を徐々に
堆積し、図10のバリア層220を形成することができ
る。したがって、堆積プロセスの間に少なくとも1回選
択的にコイルの電源をオンおよびオフすると、バリア層
の応力を調整し、複数の異なる制約または条件に対応す
ることが可能となることがわかる。加えて、図14は主
にステップ・カバレッジ波形を示すが、コイル,ターゲ
ット,および/またはウエハ上で使用可能な波形は、経
時的にステップ関数曲線である必要はない。例えば、三
角形(鋸歯)波形,正弦波形,対数電力曲線,指数電力
曲線,その組み合わせ,あるいは他のあらゆる種類のア
ナログ,連続,量子化波形を用いて、図10のタンタル
(または耐熱金属系)バリア層220の異なる種類の応
力特性を形成することができる。あるいは、この処理方
法論は、金属,耐熱金属,および耐熱金属窒化物のよう
に、応力に関連する問題を生じ易いその他の種々の導電
性膜と共に用いることも可能である。加えて、この明細
書全体を通じて張力の高低を用いて物質の相対的な応力
を説明したが、張力減少および圧縮増大は、相互交換可
能に使用できることを、当業者は認めよう。
うに、一旦ステップ412を完了したならば、ステップ
414においてウエハ22をチャンバ40からチャンバ
70に転送する。チャンバ70は、図1に示され、更に
図4に一層詳細に示されている。ステップ414によっ
てウエハ22をチャンバ70に転送した後、ステップ4
16を用いて、図10の銅シード層222をウエハ22
上に堆積する。この堆積プロセスは、図4ないし図6に
関して論じた、改良クランプ85を利用する。したがっ
て、銅シード層が堆積され、CMPおよび/または銅め
っき処理の間、ウエハの周辺付近において後になって剥
離する銅層が減少することにより、半導体素子の歩留ま
りが改善する潜在的な可能性がある。
6の堆積後、チャンバ70からチャンバ2を介してチャ
ンバ3にウエハ22を転送し、更に図1にロード・ロッ
ク7に戻す。この時点で、ロード・ロック7を大気圧状
態に安定化させ、ウエハ22をシステム1から除去す
る。次いで、銅電気めっき,無電解めっき,またはCV
Dチャンバ(ここでは図示せず)にウエハを転送するこ
とによって、銅相互接続メタルルジを堆積する。かかる
メタルルジ処理が完了した後、化学機械式研摩(CM
P)プロセスを用いて、図11に示すような、インレイ
ドまたはデュアル・インレイド相互接続構造を形成す
る。
について説明したが、更に別の変更や改良も当業者には
想起されよう。したがって、本発明は、特許請求の範囲
に既定した本発明の精神および範囲から逸脱しない変更
を全て包含することは、理解されるものとする。
テムを上から見た図。
F)予備浄化チャンバを示す断面図。
ンバを示す断面図。
ャンバを示す断面図。
細に示す、図4のクランプ部分の拡大断面図。
の好ましくない波及を示す断面図。
システムを用いて銅相互接続部を形成する方法を示す断
面図。
システムを用いて銅相互接続部を形成する方法を示す断
面図。
たシステムを用いて銅相互接続部を形成する方法を示す
断面図。
たシステムを用いて銅相互接続部を形成する方法を示す
断面図。
びシード層を形成する方法を示すフロー・チャート。
発明にしたがって用いられる新たな銅予備浄化技法との
比較を示す表。
するために、バリア層堆積チャンバ内においてコイル,
ターゲット,およびウエハに用いる給電シーケンスを示
すXYプロット。
ィング層 210 誘電体層 210a,206a 丸い角部 214 イオン化粒子 220 バリア層 222 シード層 224 銅膜 600,602,604 コイル電力波形
Claims (10)
- 【請求項1】ウエハ(200)上にバリア層(220)
を形成する方法であって:処理チャンバ(40)内に前
記ウエハ(200)を配置する段階;第1時間期間にわ
たりスパッタリング・ターゲット(48)に給電する段
階;第2時間期間にわたりコイル(52)に給電する段
階であって、該第2時間期間が前記第1時間期間とは異
なる、段階;および前記バリア層(220)の堆積の
間、前記スパッタリング・ターゲット(48)および前
記コイル(52)双方に対する電力を制御する段階;か
ら成ることを特徴とする方法。 - 【請求項2】ウエハ(200)上にタンタル・バリア
(220)層を形成する方法であって:第1引張応力を
有する前記タンタル・バリア層(220)の第1部分を
形成する段階;第2引張応力を有する前記タンタル・バ
リア層(220)の第2部分を形成する段階であって、
該第2引張応力が前記第1引張応力とは異なる、段階;
および前記タンタル・バリア層(220)上に導電性材
料(222)を形成する段階であって、該導電性材料
(222)が殆ど銅から成る、段階;から成ることを特
徴とする方法。 - 【請求項3】少なくとも1つのウエハ(200)上にバ
リア層(220)を形成する方法であって:処理チャン
バ(40)の表面に、耐熱金属窒化物膜を被覆する段
階;少なくとも1つのウエハ(200)上にバリア層
(220)を形成する段階であって、該バリア層(22
0)が耐熱金属から成る、段階;およびある時間期間
後、前記処理チャンバ(40)の前記表面に、別の耐熱
金属窒化物膜を被覆する段階;から成ることを特徴とす
る方法。 - 【請求項4】ウエハ(200)上に層を形成する方法で
あって:チャンバ(70)内に前記ウエハを配置する段
階であって、前記チャンバがターゲット(78)および
コイル(82)を有する、段階;および前記ターゲット
(78)から第1物質を移転し、前記コイル(82)か
ら第2物質を移転し、前記ウエハ(200)上に前記第
1物質および前記第2物質を堆積する段階;から成るこ
とを特徴とする方法。 - 【請求項5】前記第2物質の粒度は、約50ミクロン以
下であることを特徴とする請求項4記載の方法。 - 【請求項6】ウエハ(200)上に層(220)を形成
する方法であって:誘電体層内に開口(212)を形成
する段階であって、該開口が下地の相互接続部(20
2)を露出させ、前記開口(212)は、当該開口の側
壁部分が該側壁部分と実質的に垂直な前記誘電体層の表
面と交差する領域に形成された角部分を有する、段階;
および開口(212)をエッチングする段階であって、
コイル(26)に印加する第1電力を、ウエハ・ペデス
タル(24)に印加する第2電力の少なくとも2倍と
し、前記開口をエッチングすることによって前記角部分
(206a,210a)を丸める段階;から成ることを
特徴とする方法。 - 【請求項7】前記開口(212)をエッチングした後
に、該開口(212)内にバリア層(220)を形成す
る段階;および前記バリア層(220)上に銅含有層
(222)を形成する段階;を更に含むことを特徴とす
る請求項6記載の方法。 - 【請求項8】ウエハ(200)上に層(222)を形成
する方法であって:露出したバリア領域(220)を有
する前記ウエハ(200)をチャンバ(70)内に配置
する段階;および前記ウエハ(200)を基礎の支持部
材(86)に固着する段階;から成り、該ウエハの固着
が、クランプ(85)の使用を含み、該クランプ(8
5)が接触部分(100)を有し、該接触部分(10
0)が、前記ウエハと、該ウエハ(200)上で前記接
触部分に隣接して位置するシャドウ部分とを接触させ、
前記シャドウ部分が、前記ウエハ(200)の表面から
約8ミル未満の距離に位置することを特徴とする方法。 - 【請求項9】前記クランプ(85)は、前記ウエハ(2
00)の英数字識別領域(106)上における前記層
(222)の形成を防止することを特徴とする請求項8
記載の方法。 - 【請求項10】ウエハ(200)上に層(220)を形
成する方法であって:チャンバ(40)内にあるペデス
タル(56)上に前記ウエハ(200)を配置する段階
であって、前記チャンバ(40)が、前記ペデスタル
(56)の周囲に沿って配置された絶縁リング(53)
を含み、前記ペデスタル(56)に第1バイアス電力を
バイアスする段階;および前記チャンバの第2領域に第
2バイアス電力をバイアスする段階であって、前記絶縁
リング(53)が前記第1バイアス電力を前記第2バイ
ス電力から電気的に切断し、前記ウエハ(200)上に
前記層(220)を形成する前に、前記層(220)の
形成の間チャンバ環境に露出される前記絶縁リング(5
3)の部分に、導電性物質を被覆する段階;から成るこ
とを特徴とする方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
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US09/261,879 US6451181B1 (en) | 1999-03-02 | 1999-03-02 | Method of forming a semiconductor device barrier layer |
US261879 | 1999-03-02 |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2000323436A true JP2000323436A (ja) | 2000-11-24 |
JP2000323436A5 JP2000323436A5 (ja) | 2007-04-26 |
JP4909454B2 JP4909454B2 (ja) | 2012-04-04 |
Family
ID=22995276
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000051583A Expired - Lifetime JP4909454B2 (ja) | 1999-03-02 | 2000-02-28 | ウエハ上にバリア層を形成する方法 |
Country Status (8)
Country | Link |
---|---|
US (2) | US6451181B1 (ja) |
EP (1) | EP1033745B1 (ja) |
JP (1) | JP4909454B2 (ja) |
KR (1) | KR100761226B1 (ja) |
CN (1) | CN1169199C (ja) |
AT (1) | ATE342580T1 (ja) |
DE (1) | DE60031191T2 (ja) |
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- 2000-02-28 JP JP2000051583A patent/JP4909454B2/ja not_active Expired - Lifetime
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KR20000062671A (ko) | 2000-10-25 |
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DE60031191D1 (de) | 2006-11-23 |
US20020092763A1 (en) | 2002-07-18 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A711 | Notification of change in applicant |
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|
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Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20100218 |
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A131 | Notification of reasons for refusal |
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A601 | Written request for extension of time |
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|
A602 | Written permission of extension of time |
Free format text: JAPANESE INTERMEDIATE CODE: A602 Effective date: 20101018 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20101027 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20110920 |
|
A521 | Request for written amendment filed |
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|
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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