ES2708125T3 - Decodificación ciega para un canal físico de control de enlace descendente mejorado (EPDCCH) - Google Patents

Decodificación ciega para un canal físico de control de enlace descendente mejorado (EPDCCH) Download PDF

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Seunghee Han
Yuan Zhu
Qinghua Li
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Abstract

Un aparato para utilizar en un equipo de usuario (UE) configurado para la decodificación ciega de información de control de enlace descendente (DCI) de un canal físico de control de enlace descendente mejorado (EPDCCH), el aparato que comprende circuitería configurada para: recibir, desde una estación base, el EPDCCH que incluye la DCI; y intentar decodificar una o más veces la DCI de los elementos del canal de control mejorado (ECCE) del EPDCCH de los candidatos de la región del bloque de recursos físicos (PRB) en un conjunto de PRB utilizando un conjunto seleccionado de asignaciones de índices del grupo de elementos de recursos mejorados (EREG) para el ECCE hasta que la DCI se decodifique con éxito, en donde los elementos de recursos (RE) de un par de PRB incluye un bloque de símbolos asignados en secuencia a los elementos de recursos en un puerto asociado cuando los RE son parte de los EREG asignados para la transmisión de EPDCCH.

Description

DESCRIPCION
Decodificacion ciega para un canal fisico de control de enlace descendente mejorado (EPDCCH) Antecedentes
La tecnologia de comunicacion movil inalambrica utiliza diversos estandares y protocolos para transmitir datos entre un nodo (p. ej., una estacion de transmision o un nodo transceptor) y un dispositivo inalambrico (p. ej., un dispositivo movil). Algunos dispositivos inalambricos se comunican utilizando el acceso multiple por division de frecuencia ortogonal (OFDMA) en una transmision de enlace descendente (DL) y el acceso multiple por division de frecuencia de portadora unica (SC-FDMA) en una transmision de enlace ascendente (UL). Los estandares y protocolos que utilizan la multiplexacion por division de frecuencia ortogonal (OFDM) para la transmision de senales, incluyen la evolucion a largo plazo (LTE) del proyecto de asociacion de tercera generacion (3GPP), el estandar 802.16 del Instituto de Ingenieros Electricos y Electronicos (IEEE) (p. ej., 802.16e, 802.16m), que es comunmente conocido por los grupos de la industria como WiMAX (Interoperabilidad mundial para Acceso por Microondas) y el estandar IEEE 802.11, que es comunmente conocido por los grupos de la industria como WiFi.
En los sistemas de LTE de red de acceso de radio (RAN) de 3GPP, el nodo puede ser una combinacion de Nodos B de Red de Acceso de Radio Terrestre Universal (E-UTRAN) (tambien denominados comunmente como Nodos B evolucionados, Nodos B mejorados, eNodoB o eNB) y Controladores de Red de Radio (RNC), que se comunican con el dispositivo inalambrico, conocido como equipo de usuario (UE). La transmision de enlace descendente (DL) puede ser una comunicacion desde el nodo (p. ej., eNodoB) al dispositivo inalambrico (p. ej., UE) y la transmision de enlace ascendente (UL) puede ser una comunicacion desde el dispositivo inalambrico al nodo.
En LTE, los datos pueden transmitirse desde el eNodoB al UE a traves de un canal fisico compartido de enlace descendente (PDSCH). Se puede utilizar un canal fisico de control de enlace descendente (PDCCH) para transferir informacion de control de enlace descendente (DCI) que informa al UE sobre las asignaciones de recursos o la planificacion relacionada con las asignaciones de recursos de enlace descendente en el PDSCH, las concesiones de recursos de enlace ascendente y los comandos de control de potencia de enlace ascendente. El PDCCH se puede transmitir antes del PDSCH en cada una de las subtramas transmitida desde el eNodoB al UE.
El documento WO 2012/109542 A1 se refiere a metodos y sistemas para enviar y recibir un canal de control de enlace descendente mejorado (EPDCCH). El metodo incluye recibir informacion del canal de control a traves del canal de control mejorado, utilizar la informacion del canal de control para recibir un canal compartido y detectar la presencia del canal de control mejorado en una subtrama determinada. El canal de control mejorado puede transmitirse a traves de multiples puertos de antena. Por ejemplo, se puede utilizar multiplexacion y demultiplexacion divisional de codigo y utilizar senales de referencia comunes y especificas del UE. Se pueden definir nuevos elementos del canal de control y se puede utilizar la retroalimentacion de la informacion de estado de canal (CSI) de control mejorado. La presencia o ausencia de canales de control heredados puede afectar a la demodulacion y/o a los metodos de decodificacion.
El documento Tdoc R1-123120 de 3GPP, “Search space design for ePDCCH”, WG1 RAN TSG 3GPP Reunion # 70, agosto de 2012, propone que se utilice un indice global de elemento de canal de control mejorado (ECCE) para definir el espacio de busqueda especifico del UE (USS). El indice n de ECCE que se satisface de candidatos de EPDCCH con nivel L de agregacion debe cumplir con el requisito n mod L = 0 y el ECCE inicial y los siguientes L - 1 ECCE en el conjunto de correspondientes ECCE estan dispuestos para un candidato de EPDCCH.
Breve descripcion de los dibujos
Las caracteristicas y ventajas de la divulgacion seran evidentes a partir de la descripcion detallada que sigue tomada en conjunto con los dibujos adjuntos, que juntos ilustran, a modo de ejemplo, las caracteristicas de la divulgacion; y, en donde:
la FIG. 1, ilustra un diagrama de recursos de trama de radio (p. ej., una tabla de recursos) para una transmision de enlace descendente (DL) que incluye un canal fisico de control de enlace descendente (PDCCH) heredado de acuerdo con un ejemplo;
la FIG. 2, ilustra un diagrama de diversos anchos de banda de portadora de componente (CC) de acuerdo con un ejemplo;
la FIG. 3, ilustra un diagrama de multiplexacion de canal fisico de control de enlace descendente (EPDCCH) y de canal fisico compartido de enlace descendente (PDSCH) de acuerdo con un ejemplo;
la FIG. 4, ilustra un diagrama de cuatro elementos de canal de control mejorado (ECCE) en un par de bloques de recursos ffsicos (PRB) que muestra un fndice de grupo de elementos de recursos mejorados (EREG) para cada uno de los elementos de recursos (RE) de acuerdo con un ejemplo;
la FIG. 5, ilustra un ejemplo de ambiguedad del nivel de agregacion (AL) para el canal ffsico de control de enlace descendente mejorado (EPDCCH) distribuido de acuerdo con un ejemplo;
la FIG. 6, ilustra un ejemplo de ambiguedad del nivel de agregacion (AL) en la decodificacion ciega de un equipo de usuario (UE) de acuerdo con un ejemplo;
la FIG. 7A, ilustra un diagrama de la asignacion de primero frecuencia especffica del nivel de agregacion (AL) para AL 2 de acuerdo con un ejemplo;
la FIG. 7B, ilustra un diagrama de la asignacion de primero frecuencia especffica del nivel de agregacion (AL) para AL 1 de acuerdo con un ejemplo;
la FIG. 8, ilustra un diagrama de flujo para el procesamiento del canal ffsico de control de enlace descendente mejorado (EPDCCH) en un nodo con desplazamiento de fase especffico del nivel de agregacion (AL) de acuerdo con un ejemplo;
la FIG. 9, ilustra un diagrama de flujo para el procesamiento del canal ffsico de control de enlace descendente mejorado (EPDCCH) en un nodo con aleatorizacion especffica del nivel de agregacion (AL) de la informacion de control de enlace descendente (DCI) de acuerdo con un ejemplo;
la FIG. 10, ilustra un diagrama de flujo para el procesamiento del canal ffsico de control de enlace descendente mejorado (EPDCCH) en un nodo con un intercalador despues del ajuste de tasa de acuerdo con un ejemplo;
la FIG. 11, ilustra un diagrama de flujo para el procesamiento del canal ffsico de control de enlace descendente mejorado (EPDCCH) en un nodo con un intercalador despues de la modulacion de acuerdo con un ejemplo;
la FIG. 12, representa un diagrama de flujo de un metodo para la decodificacion ciega de la informacion de control de enlace descendente (DCI) de un canal ffsico de control de enlace descendente mejorado (EPDCCH) de acuerdo con un ejemplo;
la FIG. 13, muestra la funcionalidad de la circuiterfa de computadora de un nodo operable para asignar elementos de recursos (RE) a elementos de canal de control mejorado (ECCE) de un canal ffsico de control de enlace descendente mejorado (EPDCCH) en base a un nivel de agregacion (AL) de acuerdo con un ejemplo;
la FIG. 14, ilustra un diagrama de bloques de un nodo (p. ej., eNB) y un dispositivo inalambrico (p. ej., UE) de acuerdo con un ejemplo; y
la FIG. 15, ilustra un diagrama de un dispositivo inalambrico (p. ej., UE) de acuerdo con un ejemplo.
Resumen
La invencion se define por la materia objeto de las reivindicaciones independientes. Las realizaciones ventajosas son sujeto de las reivindicaciones dependientes y se exponen en los siguientes parrafos a continuacion.
Descripcion detallada
Se debe entender que la terminologfa empleada en el presente documento se utiliza con el proposito de describir solamente ejemplos particulares y no pretende ser limitante. Los mismos numeros de referencia en diferentes dibujos representan el mismo elemento. Los numeros proporcionados en los diagramas de flujo y los procesos, se proporcionan para mayor claridad al ilustrar los pasos y las operaciones y, no necesariamente, indican un orden o secuencia particular.
Realizaciones de ejemplo
A continuacion se proporciona una descripcion general inicial de las realizaciones tecnologicas y, luego, se describen con mas detalle las realizaciones tecnologicas especfficas. Este resumen inicial tiene la intencion de ayudar a los lectores a comprender la tecnologfa mas rapidamente, pero no pretende identificar caracterfsticas clave o caracterfsticas esenciales de la tecnologfa, ni pretende limitar el alcance de la materia objeto reivindicada.
La comunicacion de datos en el canal fisico compartido de enlace descendente (PDSCH) se puede controlar a traves de un canal de control, denominado canal fisico de control de enlace descendente (PDCCH). El PDCCH se puede utilizar para asignaciones de recursos de enlace descendente (DL) y de enlace ascendente (UL), transmitir comandos de potencia e indicadores de paginacion. La concesion de planificacion de PDSCH se puede designar a un dispositivo inalambrico particular (p. ej., UE) para la asignacion de recursos de PDSCH dedicados para transportar trafico especifico del UE, o la concesion de planificacion de PDSCH se puede designar a todos los dispositivos inalambricos en la celula para la asignacion de recursos de PDSCH comun a transportar informacion de control de difusion, tal como informacion del sistema o de paginacion.
En un solo ejemplo, el PDCCH y el PDSCH pueden representar elementos de una estructura de trama de radio transmitida en la capa fisica (PHY) en una transmision de enlace descendente entre un nodo (p. ej., eNodoB) y el dispositivo inalambrico (p. ej., UE) utilizando una estructura de trama de evolucion a largo plazo (LTE) de 3GPP generica, como se ilustra en la FIG. 1.
La FIG. 1 ilustra una estructura de trama de radio de enlace descendente de tipo 1. En el ejemplo, una trama 100 de radio de una senal utilizada para transmitir los datos puede estar configurada para que tenga una duracion, Tf, de 10 milisegundos (ms). Cada una de las tramas de radio puede estar segmentada o dividida en diez subtramas 110i que cada una es de 1 ms de duracion. Cada una de las subtramas puede subdividirse adicionalmente en dos ranuras 120a y 120b, cada una con una duracion, Tslot, de 0,5 ms. La primera ranura (#0) 120a puede incluir un canal 160 fisico de control de enlace descendente (PDCCH) heredado y/o un canal 166 fisico compartido de enlace descendente (PDSCH) y, la segunda ranura (#1) 120b, puede incluir datos transmitidos utilizando el PDSCH.
Cada una de las ranuras para una portadora de componente (CC) utilizada por el nodo y el dispositivo inalambrico, puede incluir multiples bloques 130a, 130b, 130i, 130m y 130n de recursos (RB) en base al ancho de banda de frecuencia del CC. El CC puede tener una frecuencia de portadora que tiene un ancho de banda y una frecuencia central. Cada una de las subtramas del CC puede incluir informacion de control de enlace descendente (DCI) que se encuentra en el PDCCH heredado. El PDCCH heredado en la region de control puede incluir de una a tres columnas de los primeros simbolos de OFDM en cada una de las subtramas o los RB fisicos (PRB), cuando se utiliza un PDCCH heredado. Los simbolos 11 a 13 de OFDM restantes (o 14 simbolos de OFDM, cuando no se utiliza el PDCCH heredado) en la subtrama pueden asignarse al PDSCH para datos (para el prefijo ciclico normal o corto). La region de control puede incluir un canal fisico indicador de formato de control (PCFICH), un canal indicador de solicitud de repeticion automatica hibrida (ARQ-hibrida) (PHICH) y el PDCCH. La region de control tiene un diseno de control flexible para evitar sobrecargas innecesarias. El numero de simbolos de OFDM en la region de control utilizado para el PDCCH se puede determinar mediante el indicador de formato de canal de control (CFI) transmitido en el canal fisico indicador de formato de control (PCFICH). El PCFICH se puede ubicar en el primer simbolo OFDM de cada una de las subtramas. El PCFICH y el PHICH pueden tener prioridad sobre el PDCCH, por lo que el PCFICH y el PHICH se planifican antes del PDCCH.
Cada uno de los RB 130i (RB fisico o PRB) puede incluir 12 subportadoras 136 de 15 kHz (en el eje de frecuencia) y 6 o 7 simbolos 132 de multiplexacion por division de frecuencia ortogonal (OFDM) (en el eje de tiempo) por ranura. El RB puede utilizar siete simbolos de OFDM si se emplea un prefijo ciclico corto o normal. El RB puede utilizar seis simbolos de OFDM si se utiliza un prefijo ciclico extendido. El bloque de recursos se puede asignar a 84 elementos 140i de recursos (RE) utilizando un prefijo ciclico corto o normal, o el bloque de recursos se puede asignar a 72 RE (no mostrados) utilizando el prefijo ciclico extendido. El RE puede ser una unidad de un simbolo 142 de OFDM por una subportadora 146 (es decir, 15 kHz).
Cada uno de los RE puede transmitir dos bits 150a y 150b de informacion en el caso de modulacion por desplazamiento de fase en cuadratura (QPSK). Se pueden utilizar otros tipos de modulacion, como modulacion de amplitud de cuadratura de 16 (QAM) o QAM de 64 para transmitir un mayor numero de bits en cada uno de los RE, o modulacion por desplazamiento de fase binaria (BPSK) para transmitir un menor numero de bits (un unico bit) en cada uno de los RE. El RB puede configurarse para una transmision de enlace descendente desde el eNodoB al UE, o el RB puede configurarse para una transmision de enlace ascendente desde el UE al eNodoB.
Cada uno de los dispositivos inalambricos puede utilizar al menos un ancho de banda. El ancho de banda puede denominarse ancho de banda de senal, ancho de banda de portadora o ancho de banda de portadora de componente (CC), como se ilustra en la FIG. 2. Por ejemplo, los anchos de banda de CC de LTE pueden incluir: 1,4 MHz 310, 3 MHz 312, 5 MHz 314, 10 MHz 316, 15 MHz 318 y 20 MHz 320. El CC de 1,4 MHz puede incluir 6 RB que comprenden 72 subportadoras. El CC de 3 MHz puede incluir 15 RB que comprenden 180 subportadoras. El CC de 5 MHz puede incluir 25 RB que comprenden 300 subportadoras. El CC de 10 MHz puede incluir 50 RB que comprenden 600 subportadoras. El CC de 15 MHz puede incluir 75 RB que comprenden 900 subportadoras. El Cc de 20 MHz puede incluir 100 RB que comprenden 1200 subportadoras.
Los datos transportados en el PDCCH pueden denominarse informacion de control de enlace descendente (DCI). Se pueden planificar multiples dispositivos inalambricos en una subtrama de una trama de radio. Por lo tanto, se pueden enviar multiples mensajes de DCI utilizando multiples PDCCH. La informacion de DCI en un PDCCH se puede transmitir utilizando uno o mas elementos de canal de control (CCE). Un CCE puede estar compuesto por un grupo de grupos de elementos de recursos (REG). Un CCE heredado puede incluir hasta nueve REG. Cada uno de los REG heredados puede estar compuesto por cuatro elementos de recursos (RE). Cada uno de los elementos de recursos puede incluir dos bits de informacion cuando se utiliza la modulacion en cuadratura. Por lo tanto, un CCE heredado puede incluir hasta 72 bits de informacion. Cuando se necesitan mas de 72 bits de informacion para transmitir el mensaje de DCI, se pueden emplear multiples CCE. El uso de multiples CCE se puede denominar como un nivel de agregacion. En un solo ejemplo, los niveles de agregacion se pueden definir como 1, 2, 4 u 8 CCE consecutivos asignados a un PDCCH heredado.
El PDCCH heredado puede crear limitaciones a los avances realizados en otras areas de la comunicacion inalambrica. Por ejemplo, la asignacion de CCE a subtramas en simbolos de OFDM puede extenderse tipicamente sobre la region de control para proporcionar diversidad de frecuencia. Sin embargo, no es posible una diversidad de formacion de haz con los procedimientos de asignacion actuales del PDCCH. Ademas, la capacidad del PDCCH heredado puede no ser suficiente para la senalizacion de control avanzado.
Para superar las limitaciones del PDCCH heredado, un PDCCH mejorado (EPDCCH) puede utilizar los RE en un PRB completo o par de PRB (donde un par de PRB puede ser dos p Rb contiguos que utilicen la misma subtrama de la subportadora), en lugar de solo de la columna uno a la tres de simbolos de OFDM en un primera ranura de PRB en una subtrama como en el PDCCH heredado. En consecuencia, el EPDCCH puede estar configurado con una mayor capacidad para permitir avances en el diseno de redes celulares y para minimizar los desafios y limitaciones conocidos actualmente.
A diferencia del PDCCH heredado, el EPDCCH puede asignarse a los mismos RE o region en un PRB como el PDSCH, pero en diferentes PRB. En un ejemplo, el PDSCH y el EPDCCH no puede multiplexarse dentro de un mismo PRB (o un mismo par de PRB). Por lo tanto, si un solo PRB (o un solo par de PRB) contiene un EPDCCH, los RE no utilizados en el PRB (o par de PRB) pueden estar en blanco, ya que los RE pueden no utilizarse para el PDSCH. El EPDCCH puede ser localizado (p. ej., EPDCCH localizado) o distribuido (p. ej., EPDCCH distribuido). El EPDCCH localizado puede referirse al EPDc Ch completo (p. ej., Er EG o ECc E) dentro del par de PRB. El EPDCCH distribuido puede referirse a EPDCCH (p. ej., EREG o ECCE) distribuidos en una pluralidad de pares de PRB.
Se puede utilizar la decodificacion ciega para detectar una DCI del UE, que incluye la DCI transmitida en el PDCCH heredado. El UE puede ser informado solo del numero de simbolos de OFDM dentro de la region de control de una subtrama y puede no ser proporcionado con una ubicacion exacta del correspondiente PDCCH del UE. El PDCCH o el EPDCCH pueden proporcionar informacion de control a multiples UE en una celula para cada una de las k subtramas. El UE puede realizar la decodificacion ciega ya que el UE puede conocer la estructura detallada del canal de control, incluyendo el numero de canales de control (CCH) y el numero de elementos del canal de control (CCE) a los que se asigna cada uno de los canales de control. Se pueden transmitir multiples PDCCH en una unica subtrama k que puede o puede no ser relevante para un UE particular. Debido a que el UE no conoce la ubicacion precisa de la informacion de DCI en un PDCCH, el UE puede buscar y decodificar los CCE en el PDCCH hasta que se encuentre la DCI para los CC del UE. Los PDCCH candidatos para la deteccion de la DCI se pueden denominar como un espacio de busqueda. El UE puede encontrar el PDCCH especifico para el UE (o los CC del UE) al monitorizar un conjunto de PDCCH candidatos (un conjunto de CCE consecutivos en los que se podria asignar el PDCCH) en un espacio de busqueda de PDCCH en cada una de las subtramas.
En la especificacion de LTE del 3GPP, tal como en las versiones 8, 9, 10 u 11, el UE puede utilizar un identificador temporal de red de radio (RNTI), que el eNB puede asignar al UE para intentar y decodificar los candidatos. El RNTI se puede utilizar para desenmascarar la comprobacion de redundancia ciclica (CRC) de un PDCCH candidato que se ha enmascarado originalmente por el eNB utilizando el RNTI del UE. Si el PDCCH es para un UE especifico, el CRC puede enmascararse con un identificador unico del UE, por ejemplo, un RNTI de celula (C-RNTI) utilizado en un enlace descendente. Si no se detecta un error de CRC, el UE puede determinar que un PDCCH candidato transporta la DCI para el UE. Si se detecta un error de CRC, entonces el UE puede determinar que el PDCCH candidato no transporta la DCI para el UE y el UE puede aumentar al siguiente PDCCH candidato. El UE puede aumentar al siguiente PDCCH candidato en el espacio de busqueda en base al nivel de agregacion (AL) del CCE.
El numero de CCE utilizados para transmitir una pieza de informacion de control se puede determinar de acuerdo con el modo de transmision, la calidad de recepcion del PDCCH asignado al UE o la calidad del canal del UE, y el numero de CCE se conoce como un nivel de agregacion de CCE, un nivel de agregacion heredado L £ {1,2,4,8}, un nivel de agregacion de elementos de canal de control mejorados (ECCE) L £ {1,2,4,8,16,32}, o simplemente nivel de agregacion (AL). El nivel de agregacion se puede utilizar para determinar el tamano de un espacio de busqueda o el numero de CCE (o ECCE) que forman un espacio de busqueda y/o el numero de candidatos del canal de control (CCH) en un espacio de busqueda. El nivel de agregacion de la DCI del UE puede no ser conocido en el UE, lo que se puede denominar ambiguedad del nivel de agregacion. Durante la decodificacion ciega, el UE puede asumir un AL. Para decodificar los ECCE, el UE tambien puede asumir un valor del ECCE mas bajo utilizado para transmitir las DCI. El valor del ECCE mas bajo de las DCI puede no conocerse en el UE, lo que se puede denominar como ambiguedad del ECCE mas bajo. El ECCE y un grupo de elementos de recursos mejorados (EREG) pueden asociarse con EPDCCH y, el CCE y el REG, pueden asociarse con el PDCCH.
La ambiguedad del nivel de agregacion (ALA) puede causar una degradacion del rendimiento para PDSCH, especialmente, cuando los EPDCCH se transmiten con los PDSCH. Cuando un UE detecta la asignacion de DL del UE que define una asignacion de PDSCH que puede solaparse con el (los) par(es) de PRB que contiene(n) la asignacion de DL (p. ej., EPDCCH), el UE puede asumir que el PDSCH planificado por la asignacion de DL esta ajustado en tasa en torno al (de los) par(es) de PRB que contiene(n) la asignacion DL del UE, como se ilustra en la FIG. 3. Una asignacion de recursos puede incluir tres pares de PRB (p. ej., dos ranuras contiguas). Un par 302A 0 de PRB puede incluir el EPDCCH 320 utilizado para transmitir la asignacion 322 de recursos (RA) de la DCI para el par 0, 1 y 2 de PRB. Un par 302B 1 de PRB y un par 302C 2 de PRB pueden incluir el PDSCH 310A-B.
El proceso de ajuste de tasa (RM) puede adaptar la tasa de codigo de las transmisiones de datos de LTE, de tal manera que el numero de bits de informacion y de paridad a transmitir coincida con la asignacion de recursos. Por ejemplo, en base a una tasa de codigo madre de 1/3 del codificador turbo, el ajuste de tasa de LTE puede utilizar un bufer circular, bien para repetir los bits para disminuir la tasa de codigo o para pinchar bits para aumentar la tasa de codigo.
Si la DCI indica que los PRB 0, 1, 2 estan asignados para el PDSCH y la propia DCI se detecta en el PRB 0, el UE puede ajustar la tasa en torno al PRB 0 y puede decodificar solo el PDSCH del PRB 1,2. Un solo par de PRB puede contener 2 o 4 ECCE. La FIG. 4 ilustra un ejemplo de cuatro ECCE (p. ej., ECCE 0-4) en un solo par de PRB (p. ej., ranura 120c n y ranura 120d n 1). La FIG. 4 ilustra la asignacion secuencial de primero frecuencia del RE en todos los RE para los ECCE ocupados por la DCI. Los RE para el ECCE se pueden asignar en torno a las senales de referencia de demodulacion (DMRS). El numero etiquetado en cada uno de los RE es el indice de EREG. En un ejemplo, se puede utilizar el mismo indice de EREG para cada uno de los niveles de agregacion. En otro ejemplo (no mostrado), se puede utilizar la asignacion secuencial de primero tiempo del RE en todos los RE para los ECCE ocupados por la DCI.
La FIG. 3 ilustra un desafio debido a la ambiguedad del nivel de agregacion. Para el EPDCCH localizado, si tanto el PRB 0 como el PRB 1 se asignan para la transmision de EPDCCH y, si el eNB utiliza el tipo 0 o 2 de asignacion de recursos para asignar pares de PRB para un UE, el eNB puede transmitir una DCI con nivel 4 de agregacion (AL4) en el PRB 302A 0 y el UE puede decodificar con exito la DCI con nivel 8 de agregacion (AL8) a partir del PRB 302A 0 y del PRB1 302B. Con una DCI decodificada con exito en el PRB 0 y el PRB1, el UE puede asumir que el PRB 0 y 1 se utilizan para EPDCCH, por lo que el UE solo puede intentar decodificar PDSCH a partir del PRB 2. Por lo tanto, el PDSCH en PRB 1 puede no decodificarse (p. ej., puede perderse), por lo que es posible que la informacion necesite reenviarse, lo que puede causar una degradacion del rendimiento del PDSCH.
La FIG. 5 ilustra un desafio debido a la ambiguedad del nivel de agregacion para la transmision de EPDCCH distribuido. Para la transmision de EPDCCH distribuido, cuando un numero de pares de PRB en un conjunto de EPDCCH distribuido es mayor que un numero de EREG que contiene un ECCE distribuido, el UE puede decodificar los EREG a partir de los pares de PRB en el conjunto de EPDCCH distribuido. Por ejemplo, como se muestra en la FIG. 5, un conjunto 304 de EPDCCH contiene ocho pares 302 de PRB y un ECCE puede contener cuatro EREG 332 en el EPDCCH 320A-D. Si el eNB transmite la DCI con el nivel 3321 de agregacion (AL1) y el UE decodifica la DCI con exito, asumiendo el nivel 3342 de agregacion (AL2), AL4 o AL8, dado que un nivel de agregacion mayor que AL1 (p. ej., AL2, AL4 o AL8), puede ocupar todos los pares de PRB en el conjunto de EPDCCH distribuido, entonces el UE puede ajustar la tasa en torno a todos los PRB para la decodificacion del PDSCH. Por lo tanto, el PDSCH 310C-F puede no decodificarse (p. ej., puede perderse), por lo que es posible que la informacion necesite reenviarse, lo que nuevamente puede causar una degradacion del rendimiento del PDSCH.
No solo la ambiguedad del nivel de agregacion presenta algunos desafios, sino que la ambiguedad del ECCE mas bajo tambien puede generar algunas ineficiencias en la decodificacion ciega. En base a una definicion heredada del espacio de busqueda de PDCCH (p. ej., como se define en la especificacion tecnica (TS) 36.213 version 8 de estandar de LTE de 3GPP), los recursos de un nivel de agregacion que el UE monitoriza para la deteccion ciega de PDCCH pueden solaparse con los recursos de otro nivel de agregacion. Por ejemplo, la FIG. 6 muestra CCE solapados, donde el UE puede monitorizar los CCE {1,2,3,4,5,6} para detectar la DCI con nivel 1 de agregacion y monitorizar los CCE {1&2,3&4,5&6} para detectar la DCI con nivel 2 de agregacion.
Dado que el ajuste de tasa se puede utilizar para generar la DCI, las cargas utiles en CCE 2 (AL1 342), en un ejemplo, pueden ser una repeticion exacta de las cargas utiles en CCE 1. Del mismo modo, las cargas utiles en CCE 3-4 (AL2 344B), en un ejemplo, pueden ser una repeticion exacta de las cargas utiles en CCE 1-2 (AL2 344A). Puede producirse un problema de confusion de indice de CCE mas bajo o de ambiguedad del ECCE mas bajo. Para el PDCCH heredado, se pueden utilizar bits cero de relleno para hacer que el tamano de la carga util de DCI no sea igual a alguno de {12, 14, 16, 20, 24, 26, 32, 40, 44, 56} como se define en el TS 36.212 version 8 de estandar de LTE de 3GPP. Los bits cero de relleno pueden no estar disponibles para EPDCCH.
El tamano de la carga util {12, 14, 16, 20, 24, 26, 32, 40, 44, 56} esta optimizado en el TS 36.212 version 8 de estandar de LTE de 3GPP con un supuesto de que el tamano de CCE es de 36 RE. Sin embargo, en el diseno de EPDCCH, el tamano de ECCE puede ser variable debido a la diferente configuracion de las senales de referencia especificas de la celula (CRS), las senales de referencia de informacion de estado del canal (CSI-RS) y/o el control heredado. Por lo tanto, el tamano de la DCI se puede optimizar para EPDCCH considerando diferentes tamanos de ECCE.
Por ejemplo, un tamano de carga util que puede resultar en problema de confusion del nivel de agregacion, puede satisfacer los criterios representados por n * 3/2 * k = m * n_cce, k donde y m son numeros enteros, y m = {1 248 16}, n representa un tamano de carga util, m representa un numero de CCE ocupados, k representa un punto de inicio de repeticiones del bloque codificado, n_cce representa un tamano de un ECCE y n es menor que (16 - m) * n_cce *2 * 3/4. La tasa de codificacion puede ser menor que %, de lo contrario, el UE no puede decodificar la carga util.
En base a los criterios del ejemplo, en la Tabla 1 se ilustran los tamanos de carga util (p. ej., el tamano de carga util sin procesar 48 o 28) que pueden causar confusion del nivel de agregacion para diferentes tamanos de ECCE (p. ej., 12, 24 o 33). La Tabla 1 ilustra tamanos de carga util que pueden causar confusion de agregacion para diferentes tamanos de ECCE (m = 1,2,4,8,16).
Tabla 1
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Para ayudar a resolver cierta confusion del nivel de agregacion, la Tabla 5.3.3.1.2-1 de la Especificacion Tecnica (TS) 36.212 version 11 de estandar de LTE de 3GPP (p. ej., V11.1.0 (2012-12)) puede modificarse para incluir 28 y 48 bits de informacion para tamanos ambiguos, representados en la Tabla 2.
Tabla 2
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En otro ejemplo, se puede utilizar una tabla compatible hacia adelante para incluir m = 1, 2, 3,..., 16, como se muestra en la Tabla 3, en lugar de los niveles de agregacion que monitoriza el UE (m = 1,2,4,8,16). La Tabla 3 ilustra los tamanos de carga util que pueden causar confusion de agregacion para diferentes tamanos de ECCE (m = 1,2,3....16). La Tabla 2 se define incluyendo los tamanos de carga util que pueden llevar a la ambiguedad del nivel de agregacion dados los diferentes niveles de agregacion.
Tabla 3
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Se pueden utilizar diversos metodos para resolver la ambiguedad del nivel de agregacion y la ambiguedad del ECCE mas bajo. Por ejemplo, para cada uno de los niveles de agregacion (p. ej., uno alternativo) se puede utilizar una unica asignacion secuencial de primero frecuencia o primera de tiempo en todos los RE ocupados por la DCI. La FIG. 7A ilustra un mapa de indices de EREG para un AL 354 2. La FIG. 7B ilustra un mapa de indices de EREG para un AL 3521. La FIG. 4 ilustra un mapa de indices de EREG que se puede utilizar para un AL 4 o AL 8. El mapa de indices de EREG (no mostrado) tambien puede utilizar un mapa de indices de EREG secuencial de primero tiempo separado para AL 1, AL 2, o AL 4 o AL 8.
En lugar de asignar simbolos modulados a los RE en un solo ECCE y luego asignarlos a los RE en otro ECCE como se utiliza para un PDCCH heredado, el eNB puede utilizar una asignacion de primero frecuencia o de primero tiempo en todos los RE que se utilizan para transmitir la DCI (es decir, la asignacion en todo el ECCE y el EREG). Dado que cada uno de los EREG/ECCE se puede distribuir en un par de PRB, la asignacion del nivel de agregacion puede resultar en un orden de asignacion de simbolos diferente para diferentes niveles de agregacion y diferentes EREG. Incluso si existe repeticion en los bits codificados (ver la FIG. 6), el UE puede no decodificar la DCI correctamente con una suposicion de AL incorrecta (p. ej., resolver la ambiguedad del AL) o una suposicion inicial de ECCE incorrecta (p. ej., resolver la ambiguedad del ECCE mas bajo). El uso de un mapa de indices de EREG del nivel de agregacion, puede resolver tanto la ambiguedad del AL como la ambiguedad del ECCE mas bajo.
En otro ejemplo, la ambiguedad del nivel de agregacion se puede resolver utilizando un desplazamiento de fase especifico del nivel de agregacion para todos los simbolos 470 modulados (p. ej., alternativamente dos), como se ilustra en la FIG. 8. La FIG. 8 ilustra el procesamiento 400 de canal fisico para un eNB. Como se discutio anteriormente, se puede utilizar un identificador unico de UE, tal como una celula-RNTI (C-RNTI), para enmascarar la DCI. Se puede utilizar una comprobacion de redundancia ciclica (CRC) para la deteccion de errores en los mensajes de DCI. La carga util de PDCCH completa se puede utilizar para calcular un conjunto de bits de paridad de CRC. Los bits de paridad de CRC se pueden agregar al final de la carga util del PDCCH. Durante la agregacion 430 de CRC, la informacion 410 de control (p. ej., DCI) para un UE puede enmascararse con el RNTI 432 del UE.
El RNTI se puede utilizar para cifrar la comprobacion de redundancia ciclica (CRC) agregada a un formato de DCI especifico. La comprobacion de redundancia ciclica (CRC) puede ser un codigo de deteccion de errores que se agrega a un bloque de datos a ser transmitido. El valor del CRC se puede calcular a partir del bloque de datos. La longitud del CRC puede determinar el numero de errores que pueden detectarse en el bloque de datos en la recepcion de los datos. Es posible que un CRC no pueda corregir errores o determinar que bits son erroneos.
Luego, el mensaje de DCI con el adjunto de CRC puede someterse a una codificacion de canal, como la codificacion 440 convolucional (CC) de mordedura de cola, por un codificador de canal. La codificacion convolucional es una forma de correccion de errores hacia adelante. La codificacion convolucional puede mejorar la capacidad del canal agregando informacion redundante cuidadosamente seleccionada. Por ejemplo, LTE puede utilizar un codificador de tasa de 1/3 de bits de cola con una longitud k = 7 de restriccion, lo que significa que uno de cada tres bits de la salida contiene informacion ‘util’ mientras que los otros dos agregan redundancia. Un codificador convolucional de mordedura de cola puede inicializar su registro de desplazamiento interno a los ultimos k bits del bloque de entrada actual, en lugar de a un estado de ‘todo ceros’, lo que significa que los estados de inicio y de fin pueden ser los mismos, sin la necesidad de rellenar con ceros el bloque de entrada. La sobrecarga de “terminar” el codificador puede eliminarse, por lo que el bloque de salida puede contener menos bits que un codificador convolucional estandar.
En el UE, el diseno del decodificador convolucional de mordedura de cola puede ser mas complicado ya que el estado inicial puede ser desconocido, pero el decodificador sabe que los estados de inicio y de fin son los mismos. En otro ejemplo, un decodificador de canal puede implementarse utilizando un algoritmo de Viterbi.
Un modulo 450 de ajuste de tasa puede crear un flujo de bits de salida con una tasa de codigo deseada, como se discutio previamente. Se puede utilizar un modulador para modular el flujo de bits de salida. El modulador puede utilizar diversos esquemas de modulacion y de codificacion (MCS), como la modulacion 460 por desplazamiento de fase en cuadratura (QPSK). La modulacion es el proceso de variar una o mas propiedades de una forma de onda periodica, llamada senal portadora, con una senal de modulacion que tipicamente contiene informacion para ser transmitida (p. ej., DCI).
Un modulo (p. ej., desplazador de fase especifica de AL) puede proporcionar desplazamiento de fase especifico del nivel de agregacion para todos los simbolos 470 modulados. Por ejemplo, se puede anadir el desplazamiento de fase especifica del AL ademas de un procedimiento de generacion de EPDCCH. Por ejemplo, si se pueden utilizar cuatro niveles de agregacion para la transmision de EPDCCH, a cada uno de los AL se le puede asignar uno de los cuatro factores de desplazamiento de fase (p. ej., {1 j -1 -j}). El eNB puede seleccionar un factor de desplazamiento de acuerdo con el nivel de agregacion y multiplicarse en todos los simbolos modulados (p. ej., simbolos modulados de QPSK). El factor de desplazamiento de fase se puede utilizar para resolver el problema de ambiguedad del AL. En otro ejemplo, ademas del desplazamiento de fase especifico del AL, tambien puede utilizarse el desplazamiento de fase especifico del EREG para los EREG dentro de un par de PRB. El desplazamiento de fase especifico del EREG para los EREG puede resolver el problema de la ambiguedad del ECCE mas bajo. El factor de desplazamiento del EREG puede ser el mismo o diferente con factores de desplazamiento especificos del nivel de agregacion.
Despues del desplazamiento de fase especifico del nivel de agregacion, los simbolos modulados por desplazamiento de fase se pueden asignar a los elementos 480 de recursos mediante un asignador en una o diversas capas (p. ej., los RE se pueden mostrar en la FIG.4).
En otro ejemplo, la ambiguedad del nivel de agregacion se puede resolver utilizando una cifrado especifico del nivel de agregacion en los bits 420 de DCI no codificados (p. ej., en bruto) (p. ej., alternativa tres) utilizando un cifrador especifico del nivel de agregacion, como se ilustra en la FIG. 9. La FIG. 9 ilustra el procesamiento 402 del canal fisico para un eNB. La secuencia de cifrado puede tener la misma longitud que los bits de DCI no codificados. Por ejemplo, para cuatro niveles de agregacion, las secuencias podrian ser:
[00 ... 0]
[1 1... 1]
[0 101 .... 01]
[10 10 ... 10].
Tambien se pueden utilizar otros patrones (no mostrados) de secuencia de cifrado. Cada uno de los niveles (p. ej., 1, 2, 4, 8, 16 o 32) de agregacion puede utilizar un patron de secuencia de cifrado diferente y unico. Despues del cifrado 420 especifico del nivel de agregacion de bits de DCI en bruto, los bits de DCI pueden someterse al adjunto 430 de CRC y a otras operaciones de procesamiento 402 del canal fisico, como se describio anteriormente.
En otra configuracion (p. ej., alternativa cuatro), para la transmision de EPDCCH distribuido, la ambiguedad del AL solamente puede producirse cuando el eNB transmite con AL1 y el UE decodifica correctamente con AL2, AL4 o AL8, en el caso donde el numero de pares de PRB en el conjunto de EPDCCH distribuido es mayor que el numero de EREG que incluye un solo ECCE. Por lo tanto, se pueden utilizar dos factores especificos del AL para la transmision de EPDCCH distribuido (p. ej., {1 -1}) para el desplazamiento de fase (p. ej., similar a la alternativa dos excepto el numero de factores de desplazamiento) o utilizar dos secuencias para cifrar la DCI (p. ej., similar a la alternativa tres, excepto el uso de dos secuencias de cifrado). Por ejemplo, una de las dos secuencias de cifrado puede utilizar una secuencia todo “ceros” (p. ej., secuencia A) y la otra secuencia de cifrado puede utilizar una secuencia todo “unos” (p. ej., secuencia B). La alternativa cuatro puede combinar y utilizar las alternativas dos y tres. La alternativa cuatro puede proporcionar optimizacion de reduccion de complejidad para un tamano de conjunto de EPDCCH distribuido particular. Las diversas alternativas (p. ej., alternativas 1, 2, 3 y 4) tambien se pueden aplicar directamente tanto al conjunto de EPDCCH localizado como distribuido, independientemente de un numero de pares de PRB por conjunto y de un numero de EREG por ECCE.
En otro ejemplo, la ambiguedad del nivel de agregacion o la ambiguedad del ECCE mas bajo se puede resolver utilizando un intercalador 490 despues del ajuste 450 de tasa (p. ej., alternativa cinco) donde los bits 422 de DCI se proporcionan para el adjunto 430 de CRC, como se ilustra en la FIG. 10. El intercalador se puede utilizar para intercalar contra un fenomeno de desvanecimiento. Para hacer que el UE no pueda decodificar el EPDCCH correctamente bajo un supuesto de nivel de agregacion incorrecto, se puede insertar un intercalador 490 de nivel de bits entre el bloque 450 de ajuste de tasa y el bloque 460 de modulacion, como se muestra en la FIG. 10. Puede ser aplicable cualquier intercalador siempre que el intercalado destruya una cadena de codificacion si el UE asume un nivel de agregacion incorrecto en la decodificacion ciega. Como el PDCCH heredado puede utilizar un intercalador para el intercalado de REG, el mismo intercalador puede reutilizarse por simplicidad (es decir, se puede reutilizar un intercalador de subbloques). En un ejemplo, los elementos <NULL> en la salida sn del intercalador se pueden eliminar antes de la modulacion.
En otro ejemplo, la ambiguedad del nivel de agregacion o la ambiguedad del ECCE mas bajo se puede resolver utilizando un intercalador 492 despues de la modulacion (p. ej., QPSK 460) (p. ej., alternativa seis), como se ilustra en la FIG. 11. Similar a la alternativa cinco, se puede insertar un intercalador de nivel de simbolo entre el bloque de modulacion de QPSK 460 y el bloque 480 de asignacion de simbolo a RE, como se muestra en la FIG. 11. Por ejemplo, se puede reutilizar un intercalador de subbloques. Por ejemplo, los elementos <NULL> en la salida del intercalador pueden eliminarse antes de la asignacion de RE.
Otro ejemplo proporciona un metodo 500 para la decodificacion ciega de la informacion de control de enlace descendente (DCI) de un canal fisico de control de enlace descendente mejorado (EPDCCH), como se muestra en el diagrama de flujo en la FIG. 12. El metodo puede ejecutarse como instrucciones en una maquina o circuiteria de computadora, donde las instrucciones se incluyen en al menos un medio legible por computadora o un medio de almacenamiento legible por maquina no transitorio. El metodo incluye la operacion de recibir el EPDCCH desde un Nodo B evolucionado (eNB) en un equipo de usuario (UE), como en el bloque 510. La operacion de intentar decodificar recursivamente la DCI de los elementos del canal de control mejorado (ECCE) del EPDCCH de un par de bloques de recursos fisicos (PRB) utilizando un conjunto seleccionado de mapas de indices del grupo de elementos de recursos mejorados (EREG) para el ECCE hasta que la DCI se decodifique con exito, en donde cada uno de los mapas de indices de EREG esta configurado de acuerdo con un nivel de agregacion (AL) diferente, como en el bloque 520. La siguiente operacion del metodo puede ser decodificar correctamente la DCI cuando se utiliza el mapa de indices de EREG asociado con un nivel de agregacion especificado, en donde el nivel de agregacion especificado se utiliza para codificar la DCI, como en el bloque 530.
Cada una de las asignaciones de indices de EREG se puede utilizar para determinar que elementos de recursos (RE) en un par de bloques de recursos fisicos (PRB) estan asociados con cada uno de los ECCE. Por ejemplo, los RE de un par de bloques de recursos fisicos (PRB) incluyen un bloque de simbolos y(0), ..., y(Msymb -1) de valores complejos asignados en secuencia comenzando con y(0) hasta los elementos de recursos (k,l) en un puerto de antena asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH, donde Msymb es un numero de simbolos de modulacion para transmitir en un canal fisico y la asignacion a elementos de recursos (k,l) en el puerto p de antena es un orden creciente de primero un indice k y luego un indice /, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama.
En un ejemplo, cada uno de los ECCE se puede distribuir con otros ECCE en frecuencia o tiempo en el par de PRB o multiples pares de PRB, o cada uno de los EREG se puede distribuir con otros EREG en frecuencia o tiempo en el par de PRB o multiples pares de PRB. La operacion de decodificar correctamente la DCI puede incluir ademas determinar el nivel de agregacion y determinar el valor del ECCE mas bajo.
En otro ejemplo, el metodo puede incluir, ademas, omitir decodificar la DCI cuando un nivel de agregacion asumido difiere de un nivel de agregacion codificado. Un equipo de usuario (UE) puede intentar decodificar con un mapa de indices de EREG asociado con el supuesto nivel de agregacion, y el nivel de agregacion codificado puede ser el nivel de agregacion utilizado por un Nodo B evolucionado (eNB) para codificar la DCI para la transmision en el EPDCCH. El metodo puede incluir ademas intentar decodificar la DCI utilizando otro mapa de indices de EREG asociado con otro nivel de agregacion.
Otro ejemplo proporciona la funcionalidad 600 de la circuiteria de computadora de un nodo operable para asignar elementos de recursos (RE) a elementos de canal de control mejorado (ECCE) de un canal fisico de control de enlace descendente mejorado (EPDCCH) en base a un nivel de agregacion (AL), como se muestra en la diagrama de flujo en la FIG. 13. La funcionalidad puede implementarse como un metodo o la funcionalidad puede ejecutarse como instrucciones en una maquina, donde las instrucciones se incluyen en al menos un medio legible por computadora o un medio de almacenamiento legible por maquina no transitorio. La circuiteria de computadora puede estar configurada para determinar un numero de ECCE utilizados para transmitir informacion de control de enlace descendente (DCI), como en el bloque 610. La circuiteria de computadora puede estar configurada ademas para determinar el nivel de agregacion utilizado para transmitir la DCI en base al numero de ECCE utilizados para transmitir la DCI, como en el bloque 620. La circuiteria de la computadora tambien puede estar configurada para asignar elementos de recursos (RE) a grupos de elementos de recursos mejorados (EREG) del ECCE asignado a la DCI utilizando un indice de EREG, en donde el indice de EREG se selecciona en base a un esquema de transmision de EPDCCH localizado o a un esquema de transmision de EPDCCH distribuido, como en el bloque 630.
En un ejemplo, la circuiteria de computadora configurada para asignar el RE puede estar configurada ademas para asignar el RE a un par de bloques de recursos fisicos (PRB) para un esquema de transmision de EPDCCH localizado utilizando una asignacion secuencial de primero frecuencia en todos los RE ocupados por la DCI, o asignar el RE a una pluralidad de pares de PRB para un esquema de transmision de EPDCCH distribuido utilizando una asignacion secuencial de primero frecuencia en todos los RE ocupados por la DCI, donde se transporta una sola DCI para el esquema de transmision de EPDCCH distribuido utilizando los EREG de la pluralidad de pares de PRB. En otro ejemplo, la circuiteria de computadora configurada para asignar el RE puede estar configurada ademas para asignar el RE a un par de bloques de recursos fisicos (PRB) para un esquema de transmision de EPDCCH localizado utilizando una asignacion secuencial de primero tiempo en todos los Re ocupados por la DCI, o asignar el RE a una pluralidad de pares de PRB de un esquema de transmision de EPDCCH distribuido utilizando una asignacion secuencial de primero tiempo en todos los RE ocupados por la DCI, donde se transporta una sola DCI para el esquema de transmision de EPDCCH distribuido utilizando los EREG de la pluralidad de pares de PRB.
En una configuracion, el ECCE puede transmitirse en un par de bloques de recursos fisicos (PRB), donde cada uno de los pares de PRB incluye cuatro ECCE o dos ECCE. Los RE de un par de bloques de recursos fisicos (PRB) pueden incluir un bloque de simbolos y(0),..., y(Msymb -1) de valores complejos asignados en secuencia comenzando con y(0) a los elementos (k,/) de recursos en un puerto de antena asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH, donde Msymb es un numero de simbolos de modulacion para transmitir en un canal fisico y la asignacion a los elementos (k,l) de recursos en el puerto p de antena es un orden creciente de primero un indice k y luego un indice /, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama.
La circuiteria de computadora puede estar configurada ademas para asignar recursos a un canal fisico compartido de enlace descendente (PDSCH) con el recursos asignado de EPDCCH a un canal fisico compartido de enlace descendente (PDSCH) con el EPDCCH y transmitir el PDSCH en la asignacion de recurso. El EPDCCH puede ser un EPDCCH localizado o un EPDCCH distribuido
La FIG. 14 ilustra un nodo 710 (p. ej., eNB) de ejemplo y un dispositivo 720 inalambrico (p. ej., UE) de ejemplo. El nodo puede incluir un dispositivo 712 de nodo. El dispositivo de nodo o el nodo puede estar configurado para comunicarse con el dispositivo inalambrico (p. ej., UE). El dispositivo de nodo puede incluir un procesador 714 y un transceptor 716. El procesador 714 y/o el transceptor 716 pueden estar configurados para asignar elementos de recursos (RE) a elementos de canal de control mejorado (ECCE) de un canal fisico de control de enlace descendente mejorado (EPDCCH) en base a un nivel de agregacion (AL), como se describe en 600 de la FIG. 13.
El dispositivo 720 inalambrico (p. ej., UE) puede incluir un transceptor 724 y un procesador 722. El dispositivo inalambrico (es decir, dispositivo) puede estar configurado para la decodificacion ciega de informacion de control de enlace descendente (DCI) de un canal fisico de control de enlace descendente mejorado (EPDCCH), como se describe en 500 de la FIG. 12.
Con referencia de nuevo a la FIG. 14, el procesador 722 puede estar configurado para: intentar decodificar recursivamente la DCI de los elementos del canal de control mejorado (ECCE) del EPDCCH a partir de los candidatos de region del bloque de recursos fisicos (PRB) en un conjunto de PRB utilizando un conjunto seleccionado mapas de indices de grupo de elementos de recursos mejorados (EREG) para el ECCE hasta que la DCI se decodifique con exito; y decodificar la DCI con un mapa de indices de EREG asociado con un mismo nivel de agregacion utilizado para codificar la DCI. Cada una de las asignaciones de indices de EREG puede estar configurado para un nivel de agregacion (AL) diferente.
Cada una de las asignaciones de indices de EREG se puede utilizar para determinar que elementos de recursos (RE) en un par de bloques de recursos fisicos (PRB) estan asociados con el ECCE para el nivel de agregacion. Por ejemplo, los RE de un par de bloques de recursos fisicos (PRB) pueden incluir un bloque de simbolos y(0),..., y(Msymb -1) de valores complejos asignados en secuencia comenzando con y(0) a los elementos (k,/) de recursos en un puerto de antena asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH, donde Msymb es un numero de simbolos de modulacion para transmitir en un canal fisico y la asignacion a elementos (k,/) de recursos en el puerto p de antena es un orden creciente de primero un indice k y luego un indice /, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama.
En otro ejemplo, el procesador 714 puede estar configurado ademas para omitir decodificar la DCI cuando un nivel de agregacion asumido difiere de un nivel de agregacion codificado. El procesador puede intentar decodificar con un mapa de indices de EREG asociado con el nivel de agregacion asumido y el nivel de agregacion codificado puede ser el mismo nivel de agregacion utilizado por un Nodo B evolucionado (eNB) para codificar la DCI para la transmision en el EPDCCH.
El transceptor 716 puede estar configurado para recibir el EPDCCH desde un nodo. El nodo puede incluir una estacion base (BS), un Nodo B (NB), un Nodo B evolucionado (eNB), una unidad de banda base (BBU), un cabezal de radio remoto (RRH), un equipo de radio remoto (RRE), un unidad de radio remota (RRU) o un modulo de procesamiento central (CPM).
En otra configuracion, el transceptor 716 puede estar configurado para recibir un canal fisico compartido de enlace descendente (PDSCH) con el EPDCCH en una asignacion de recursos (RA). La RA es una RA tipo 0, RA tipo 1 o una RA tipo 2 definida en el estandar de Evolucion a Largo Plazo (LTE) version 11 del Proyecto de Asociacion de Tercera Generacion (3GPP).
En otro ejemplo, se utiliza el mismo nivel de agregacion para codificar la DCI en 1, 2, 4, 8, 16, o 32 ECCE. En otra configuracion, el procesador configurado para decodificar la DCI, puede estar configurado ademas para resolver una ambiguedad del nivel de agregacion; y resolver una ambiguedad del ECCE mas bajo.
La FIG. 15 proporciona una ilustracion de ejemplo del dispositivo inalambrico, tal como un equipo de usuario (UE), una estacion movil (MS), un dispositivo inalambrico movil, un dispositivo de comunicacion movil, una tableta, un telefono u otro tipo de dispositivo inalambrico. El dispositivo inalambrico puede incluir una o mas antenas configuradas para comunicarse con un nodo o estacion de transmision, tal como una estacion base (BS), un Nodo B evolucionado (eNB), una unidad de banda base (BBU), un cabezal de radio remoto (RRH), un equipo de radio remoto (RRE), una estacion de retransmision (RS), un equipo de radio (RE), una unidad de radio remota (RRU), un modulo de procesamiento central (CPM) u otro tipo de punto de acceso de red inalambrica de area amplia (WWAN). El dispositivo inalambrico puede estar configurado para comunicarse utilizando al menos un estandar de comunicacion inalambrica que incluya LTE de 3GPP, WiMAX, Acceso a paquetes de alta velocidad (HSPA), Bluetooth y WiFi. El dispositivo inalambrico puede comunicarse utilizando antenas separadas para cada uno del os estandares de comunicacion inalambrica o antenas compartidas para multiples estandares de comunicacion inalambrica. El dispositivo inalambrico puede comunicarse en una red de area local inalambrica (WLAN), una red de area personal inalambrica (WPAN) y/o una WWAN.
La FIG. 15 tambien proporciona una ilustracion de un microfono y uno o mas altavoces que pueden utilizarse para la entrada y salida de audio desde el dispositivo inalambrico. La pantalla de visualizacion puede ser una pantalla de cristal liquido (LCD), u otro tipo de pantalla de visualizacion, tal como una pantalla de diodo organico emisor de luz (OLED). La pantalla de visualizacion puede estar configurada como una pantalla tactil. La pantalla tactil puede utilizar tecnologia capacitiva, resistiva u otro tipo de tecnologia de pantalla tactil. Un procesador de aplicaciones y un procesador grafico pueden estar acoplados a la memoria interna para proporcionar capacidades de procesamiento y de visualizacion. Tambien se puede utilizar un puerto de memoria no volatil para proporcionar opciones de entrada/salida de datos para un usuario. El puerto de memoria no volatil tambien se puede utilizar para ampliar las capacidades de memoria del dispositivo inalambrico. Un teclado puede estar integrado con el dispositivo inalambrico o conectado de manera inalambrica al dispositivo inalambrico para proporcionar entrada de usuario adicional. Tambien se puede proporcionar un teclado virtual utilizando la pantalla tactil.
Diversas tecnicas, o ciertos aspectos o partes de los mismos, pueden tomar la forma de codigo de programa (es decir, instrucciones) incorporado en medios tangibles, como disquetes, memoria de discos compactos de solo lectura (CD-ROM), discos duros, medios de almacenamiento legibles por computadora no transitorios o cualquier otro medio de almacenamiento legible por maquina, en donde, cuando se le carga el codigo de programa y se ejecuta por una maquina, tal como una computadora, la maquina se convierte en un aparato para practicar las diversas tecnicas. La circuiteria puede incluir hardware, firmware, codigo de programa, codigo ejecutable, instrucciones de computadora, y/o software. Un medio de almacenamiento legible por computadora no transitorio puede ser un medio de almacenamiento legible por computadora que no incluye senal. En el caso de ejecucion del codigo de programa en computadoras programables, el dispositivo de computacion puede incluir un procesador, un medio de almacenamiento legible por el procesador (incluidos los elementos de memoria y/o de almacenamiento volatiles y no volatiles), al menos un dispositivo de entrada y al menos un dispositivo de salida. Los elementos de memoria y/o de almacenamiento volatiles y no volatiles pueden ser una memoria de acceso aleatorio (RAM), una memoria de solo lectura programable y borrable (EPROM), una unidad flash, una unidad optica, una unidad de disco duro magnetica, una unidad de estado solido u otro medio para almacenar datos electronicos. El nodo y el dispositivo inalambrico tambien pueden incluir un modulo transceptor (es decir, un transceptor), un modulo contador (es decir, contador), un modulo de procesamiento (es decir, un procesador) y/o un modulo de reloj (es decir, reloj) o un modulo de temporizador (es decir, temporizador). Uno o mas programas que pueden implementar o utilizar las diversas tecnicas descritas en el presente documento pueden utilizar una interfaz de programacion de aplicaciones (API), controles reutilizables y similares. Dichos programas pueden implementarse en un lenguaje de programacion de alto nivel procedimental u orientado a objetos para comunicarse con un sistema informatico. Sin embargo, el (los) programa(s) puede(n) implementarse en ensamblador o en lenguaje maquina, si se desea. En cualquier caso, el lenguaje puede ser un lenguaje compilado o interpretado, y combinado con implementaciones de hardware.
Se debe entender que muchas de las unidades funcionales descritas en esta memoria descriptiva han sido etiquetadas como modulos, con el fin de enfatizar mas particularmente su independencia de implementacion. Por ejemplo, un modulo puede implementarse como un circuito de hardware que comprende circuitos personalizados de integracion a gran escala (VLSI) o matriz de puertas, semiconductores estandar tales como chips logicos, transistores u otros componentes discretos. Un modulo tambien puede implementarse en dispositivos de hardware programables tales como matrices de puertas programables, logica de matriz programable, dispositivos logicos programables o similares.
Los modulos tambien pueden implementarse en software para ejecucion por diversos tipos de procesadores. Un modulo identificado de codigo ejecutable puede, por ejemplo, comprender uno o mas bloques fisicos o logicos de instrucciones de computadora, que, por ejemplo, pueden organizarse como un objeto, procedimiento o funcion. Sin embargo, los ejecutables de un modulo identificado no necesitan estar fisicamente ubicados juntos, sino que pueden comprender instrucciones dispares almacenadas en diferentes ubicaciones que, cuando se unen logicamente, comprenden el modulo y logran el proposito establecido para el modulo.
De hecho, un modulo de codigo ejecutable puede ser una sola instruccion, o muchas instrucciones, y puede incluso distribuirse en varios segmentos de codigo diferentes, entre diferentes programa y a traves de varios dispositivos de memoria. De manera similar, los datos operacionales pueden identificarse e ilustrarse en el presente documento dentro de modulos, y pueden incorporarse en cualquier forma adecuada y organizarse dentro de cualquier tipo adecuado de estructura de datos. Los datos operacionales pueden recopilarse como un unico conjunto de datos, o pueden distribuirse en diferentes ubicaciones, incluyendo en diferentes dispositivos de almacenamiento, y pueden existir, al menos parcialmente, simplemente como senales electronicas en un sistema o red. Los modulos pueden ser pasivos o activos, incluyendo los agentes operables para realizar las funciones deseadas.
El Ejemplo 1 Adicional proporciona un equipo de usuario (UE) configurado para la decodificacion ciega de la informacion de control de enlace descendente (DCI) de un canal fisico de control de enlace descendente mejorado (EPDCCH), que comprende: un procesador para: intentar decodificar recursivamente la DCI de los elementos del canal de control mejorados (ECCE) del EPDCCH de los candidatos de region del bloque de recursos fisicos (PRB) en un conjunto de PRB utilizando un conjunto seleccionado de asignaciones de indices del grupo de elementos de recursos mejorados (EREG) para el ECCE hasta que la DCI se decodifique con exito, en donde cada una de las asignaciones de indices de EREG esta configurado para un nivel de agregacion (AL) diferente; y decodificar la DCI con un mapa de indices de EREG asociado con un mismo nivel de agregacion utilizado para codificar la DCI.
El Ejemplo 2 Adicional se refiere al UE del Ejemplo 1 Adicional, en donde cada una de las asignaciones de indices de EREG se utiliza para determinar que elementos de recursos (RE) en un par de bloques de recursos fisicos (PRB) estan asociados con el ECCE para el nivel de agregacion.
El Ejemplo 3 Adicional se refiere al UE del Ejemplo 2 Adicional, en donde los RE de un par de bloques de recursos fisicos (PRB) incluyen un bloque de simbolos de valores complejos asignados en secuencia, comenzando con los elementos de recursos en un puerto de antena asociado cuando los RE son parte del EREG asignado para la transmision de EPDCCH, donde, hay una cantidad de simbolos de modulacion para transmitir en un canal fisico y la asignacion a los elementos de recursos en el puerto p de antena es un orden creciente de primero un indice k y luego un indice l, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama. El Ejemplo 4 Adicional se refiere al UE del Ejemplo 1 Adicional, en donde el procesador esta configurado ademas para: omitir decodificar la DCI cuando un nivel de agregacion asumido difiere de un nivel de agregacion codificado, en donde el procesador intenta decodificar con un mapa de indices de EREG asociado con el nivel de agregacion asumido y el nivel de agregacion codificado es el mismo nivel de agregacion utilizado por un Nodo B evolucionado (eNB) para codificar la DCI para la transmision en el EPDCCH.
El Ejemplo 5 Adicional se refiere al UE del Ejemplo 1 Adicional, que comprende ademas: un transceptor para: recibir el EPDCCH desde un nodo, en donde el nodo se selecciona del grupo que consiste en una estacion base (BS), un Nodo B (NB), un Nodo B evolucionado (eNB), una unidad de banda base (BBU), un cabezal de radio remoto (RRH), un equipo de radio remoto (RRE), una unidad de radio remota (RRU) y un modulo de procesamiento central (CPM). El Ejemplo 6 Adicional se refiere al UE del Ejemplo 1 Adicional, que comprende ademas: un transceptor para: recibir un canal fisico compartido de enlace descendente (PDSCH) con el EPDCCH en una asignacion de recursos (RA), en donde la RA es una RA tipo 0, RA tipo 1 o una RA tipo 2 definida en el estandar de Evolucion a Largo Plazo (LTE) version 11 del Proyecto de Asociacion de Tercera Generacion (3GPP); y en donde el procesador esta configurado ademas para: ajustar la tasa del PDSCH en torno a un par de bloques de recursos fisicos (PRB) que incluyen la DCI en el EPDCCH.
El Ejemplo 7 Adicional se refiere al UE del Ejemplo 1 Adicional, en donde el mismo nivel de agregacion se utiliza para codificar la DCI en 1,2, 4, 8, 16 o 32 Ec Ce .
El Ejemplo 8 Adicional se refiere al UE del Ejemplo 1 Adicional, en donde el procesador configurado para decodificar la DCI esta configurado ademas para: resolver una ambiguedad del nivel de agregacion; y resolver una ambiguedad del ECCE mas bajo.
El Ejemplo 9 Adicional se refiere al UE del Ejemplo 1 Adicional, en donde el UE incluye al menos una de una antena, una pantalla tactil, un altavoz, un microfono, un procesador grafico, un procesador de aplicaciones, una memoria interna o un puerto de memoria no volatil.
El Ejemplo 10 Adicional proporciona un metodo para la decodificacion ciega de la informacion de control de enlace descendente (DCI) de un canal fisico de control de enlace descendente mejorado (EPDCCH), que comprende: recibir el EPDCCH desde un Nodo B evolucionado (eNB) en un equipo de usuario (UE); intentar decodificar recursivamente la DCI de los elementos del canal de control mejorado (ECCE) del EPDCCH de un par de bloques de recursos fisicos (PRB) utilizando un conjunto seleccionado de asignaciones de indices del grupo de elementos de recursos mejorados (EREG) para el ECCE hasta que la DCI se decodifique con exito, en donde cada una de las asignaciones de indices de EREG esta configurada para un nivel de agregacion (AL) diferente; y decodificar correctamente la DCI cuando se utiliza el mapa de indices de EREG asociado con un nivel de agregacion especificado, en donde el nivel de agregacion especificado se utiliza para codificar la DCI.
El Ejemplo 11 Adicional se refiere al metodo del Ejemplo 10 Adicional, en donde cada una de las asignaciones de indices de EREG se utiliza para determinar que elementos de recursos (RE) en un par de bloques de recursos fisicos (PRB) estan asociados con cada uno de los ECCE.
El Ejemplo 12 Adicional se refiere al metodo del Ejemplo 11 Adicional, en donde los RE de un par de bloques de recursos fisicos (PRB) incluyen un bloque de simbolos de valores complejos asignados en secuencia, comenzando con los elementos de recursos en un puerto de antena asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH, donde, hay una cantidad de simbolos de modulacion para transmitir en un canal fisico y la asignacion a los elementos de recursos en el puerto p de antena es un orden creciente de primero un indice k y luego un indice l, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama.
El Ejemplo 13 Adicional se refiere al metodo del Ejemplo 10 Adicional, en donde cada uno de los ECCE se distribuye con otros ECCE en frecuencia o en tiempo en el par de PRB o en multiples pares de PRB o, cada uno de los EREG se distribuye con otros EREG en frecuencia o en tiempo en el par de PRB o en multiples pares de PRB.
El Ejemplo 14 Adicional se refiere al metodo del Ejemplo 10 Adicional, en donde la decodificacion correcta de la DCI comprende ademas: determinar el nivel de agregacion; y determinar un valor del ECCE mas bajo.
El Ejemplo 15 Adicional se refiere al metodo del Ejemplo 10 Adicional, que ademas comprende: omitir decodificar la DCI cuando un nivel de agregacion asumido difiere de un nivel de agregacion codificado, en donde un equipo de usuario (UE) intenta decodificar con un mapa de indices de EREG asociado con el nivel de agregacion asumido y el nivel de agregacion codificado es el nivel de agregacion utilizado por un Nodo B evolucionado (eNB) para codificar la DCI para la transmision en el EPDCCH; e intentar decodificar la DCI utilizando otro mapa de indices de EREG asociado con otro nivel de agregacion.
El Ejemplo 16 Adicional se refiere a al menos un medio de almacenamiento legible por maquina no transitorio que comprende una pluralidad de instrucciones adaptadas para ejecutarse para implementar el metodo del Ejemplo 10 Adicional.
El Ejemplo 17 Adicional se refiere a un nodo operable para asignar elementos de recursos (RE) a elementos de canal de control mejorado (ECCE) de un canal fisico de control de enlace descendente mejorado (EPDCCH) en base a un nivel de agregacion (AL), que tiene circuiteria de computadora configurada para: determinar un numero de ECCE utilizados para transmitir la informacion de control de enlace descendente (DCI); determinar el nivel de agregacion utilizado para transmitir la DCI en base al numero de ECCE utilizados para transmitir la DCI; y asignar elementos de recursos (RE) a grupos de elementos de recursos mejorados (EREG) del ECCE asignado a la DCI utilizando un indice de EREG, en donde el indice de EREG se selecciona en base a un esquema de transmision de EPDCCH localizado o un esquema de transmision de EPDCCH distribuido.
El Ejemplo 18 Adicional se refiere a la circuiteria de computadora del nodo del Ejemplo 17 Adicional, en donde la circuiteria de computadora configurada para asignar el RE esta configurada ademas para: asignar el RE a un par de bloques de recursos fisicos (PRB) para el esquema de transmision de EPDCCH localizado utilizando una asignacion secuencial de primero frecuencia en todos los RE ocupados por la DCI; o asignar el RE a una pluralidad de pares de PRB para el esquema de transmision de EPDCCH distribuido utilizando una asignacion secuencial de primero frecuencia en todos los RE ocupados por la DCI, en donde se transporta una sola DCI para el esquema de transmision de EPDCCH distribuido utilizando los EREG de la pluralidad de pares de PRB.
El Ejemplo 19 Adicional se refiere a la circuiteria de computadora del nodo del Ejemplo 17 Adicional, en donde la circuiteria de computadora configurada para asignar el RE esta configurada ademas para: asignar el RE a un par de bloques de recursos fisicos (PRB) para el esquema de transmision de EPDCCH localizado utilizando una asignacion secuencial de primero tiempo en todos los RE ocupados por la DCI; o asignar el RE a una pluralidad de pares de PRB para el esquema de transmision de EPDCCH distribuido utilizando una asignacion secuencial de primero tiempo en todos los RE ocupados por la DCI, en donde se transporta una sola DCI para el esquema de transmision de EPDCCH distribuido utilizando los EREG de la pluralidad de pares de PRB.
El Ejemplo 20 Adicional se refiere a la circuiteria de computadora del nodo del Ejemplo 17 Adicional, en donde el ECCE se transmite en un par de bloques de recursos fisicos (PRB), en donde cada uno de los pares de PRB incluye cuatro ECCE o dos ECCE.
El Ejemplo 21 Adicional se refiere a la circuiteria de computadora del nodo del Ejemplo 17 Adicional, en donde los RE de un par de bloques de recursos fisicos (PRB) incluyen un bloque de simbolos de valores complejos asignados en secuencia, comenzando con los elementos de recursos en un puerto de antena asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH, donde hay una cantidad de simbolos de modulacion para transmitir en un canal fisico y la asignacion a elementos de recursos en el puerto p de antena es un orden creciente primero de un indice k y luego un indice l, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama.
El Ejemplo 22 Adicional se refiere a la circuiteria de computadora del nodo del Ejemplo 17 Adicional, ademas configurada para: asignar recursos a un canal fisico compartido de enlace descendente (PDSCH) con el EPDCCH; y transmitir el PDSCH en la asignacion de recursos.
El Ejemplo 23 Adicional se refiere a la circuiteria de computadora del nodo del Ejemplo 17 Adicional, en donde el EPDCCH es un EPDCCH localizado o un EPDCCH distribuido.
El Ejemplo 24 Adicional se refiere a la circuiteria de computadora del nodo del Ejemplo 17 Adicional, en donde el nodo se selecciona del grupo que consiste en una estacion base (BS), un nodo B (NB), un nodo evolucionado B (eNB), una unidad de banda base (BBU), un cabezal de radio remoto (RRH), un equipo de radio remoto (RRE), una unidad de radio remota (RRU) y un modulo de procesamiento central (CPM).
La referencia en esta memoria descriptiva a “un ejemplo” o “ejemplar” significa que una particularidad, estructura o caracteristica particular descrita en relacion con el ejemplo se incluye en al menos una sola realizacion de la presente invencion. Por lo tanto, las apariencias de las frases “en un ejemplo” o la palabra “ejemplar” en diversos lugares a lo largo de esta memoria descriptiva no se refieren necesariamente a la misma realizacion.
Como se utiliza en el presente documento, una pluralidad de articulos, elementos estructurales, elementos de composicion y/o materiales se pueden presentar en una lista comun por conveniencia. Sin embargo, estas listas deben interpretarse como si cada uno de los miembros de la lista se identificara individualmente como un miembro separado y unico. Por lo tanto, ningun miembro individual de dicha lista debe interpretarse como un equivalente de facto de ningun otro miembro de la misma lista unicamente en base a su presentacion en un grupo comun sin indicaciones de lo contrario. Ademas, varias realizaciones y ejemplos de la presente invencion pueden referirse en el presente documento junto con alternativas para los diversos componentes de la misma. Se entiende que tales realizaciones, ejemplos y alternativas no deben interpretarse como hechos de facto equivalentes entre si, pero deben considerarse representaciones separadas y autonomas de la presente invencion.
Ademas, las particularidades, estructuras, o caracteristicas descritas se pueden combinar de cualquier manera adecuada en una o mas realizaciones. En la siguiente descripcion, se proporcionan numerosos detalles especificos, tales como ejemplos de disenos, distancias, ejemplos de red, etc., para proporcionar una comprension completa de las realizaciones de la invencion.

Claims (15)

REIVINDICACIONES
1. Un aparato para utilizar en un equipo de usuario (UE) configurado para la decodificacion ciega de informacion de control de enlace descendente (DCI) de un canal ffsico de control de enlace descendente mejorado (EPDCCH), el aparato que comprende circuiterfa configurada para:
recibir, desde una estacion base, el EPDCCH que incluye la DCI; y
intentar decodificar una o mas veces la DCI de los elementos del canal de control mejorado (ECCE) del EPDCCH de los candidatos de la region del bloque de recursos ffsicos (PRB) en un conjunto de PRB utilizando un conjunto seleccionado de asignaciones de fndices del grupo de elementos de recursos mejorados (EREG) para el ECCE hasta que la DCI se decodifique con exito, en donde los elementos de recursos (RE) de un par de PRB incluye un bloque de sfmbolos asignados en secuencia a los elementos de recursos en un puerto asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH.
2. El aparato de la reivindicacion 1, en donde la circuiterfa esta configurada ademas para:
decodificar la DCI con un mapa de fndices de EREG asociado con un mismo nivel de agregacion utilizado para codificar la DCI; u
omitir decodificar la DCI cuando un nivel de agregacion asumido difiere de un nivel de agregacion codificado, en donde el procesador intenta decodificar con un mapa de fndices de EREG asociado con el nivel de agregacion asumido y el nivel de agregacion codificado es el mismo nivel de agregacion utilizado por un Nodo evolucionado B (eNB) para codificar la DCI para la transmision en el EPDCCH.
3. El aparato de cualquiera de las reivindicaciones 1 a 2, en donde:
cada una de las asignaciones de fndices de EREG esta configurada para un nivel de agregacion (AL) diferente y los RE del par de PRB incluyen un bloque de sfmbolos y(0),..., y(Msymb -1) de valores complejos asignados en secuencia comenzando con y(0) a los elementos (k,l) de recursos en el puerto de antena asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH, donde Msymb es un numero de sfmbolos de modulacion para transmitir en un canal ffsico y la asignacion a los elementos (k,l) de recursos en el puerto p de antena es un orden creciente de primero un fndice k y luego un fndice /, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama ; o
cada una de las asignaciones de fndices de EREG se utiliza para determinar que elementos de recursos (RE) en un par de bloques de recursos ffsicos (PRB) estan asociados con el ECCE para el nivel de agregacion; o
el mismo nivel de agregacion se utiliza para codificar la DCI en 1,2, 4, 8, 16 o 32 ECCE.
4. El aparato de cualquiera de las reivindicaciones 1 a 3, en donde la circuiterfa esta configurada ademas para: recibir un canal ffsico compartido de enlace descendente (PDSCH) con el EPDCCH en una asignacion de recursos (RA), en donde la RA es una RA tipo 0, RA tipo 1 o una RA tipo 2 definida en un estandar de Evolucion a Largo Plazo (LTE) version 11 del Proyecto de Asociacion de Tercera Generacion (3GPP); y
ajustar la tasa del PDSCH en torno a un par de bloques de recursos ffsicos (PRB) que incluye la DCI en el EPDCCH.
5. El aparato de cualquiera de las reivindicaciones 1 a 4, en donde la circuiterfa configurada para decodificar la DCI esta configurada ademas para:
resolver una ambiguedad del nivel de agregacion; y
resolver una ambiguedad del ECCE mas bajo.
6. Un aparato para utilizar en un equipo de usuario (UE) operable para realizar la decodificacion ciega de la informacion de control de enlace descendente (DCI) de canal ffsico de control de enlace descendente mejorado (EPDCCH), el aparato que comprende circuiterfa configurada para:
recibir, en el UE desde un Nodo B evolucionado (eNB), el EPDCCH junto con un canal ffsico compartido de enlace descendente (PDSCH) en una asignacion de recursos (RA); y
intentar, en el UE, decodificar una o mas veces la DCI de los elementos del canal de control mejorado (ECCE) del EPDCCH de un par de bloques de recursos ffsicos (PRB) utilizando un conjunto seleccionado de asignaciones de fndices del grupo de elementos de recursos mejorados (EREG) para el ECCE hasta que la DCI se decodifique con exito, en donde cada uno de los mapas de fndices de EREG esta configurado para un nivel de agregacion (AL) diferente, en donde el ajuste de tasa se realiza en el PDSCH en torno al par de PRB que incluye la DCI en el EPDCCH.
7. El aparato de la reivindicacion 6, en donde:
la RA que incluye el EPDCCH y el PDSCH es una RA tipo 0, RA tipo 1 o una RA tipo 2 definida en el estandar de Evolucion a Largo Plazo (LTE) version 11 del Proyecto de Asociacion de Tercera Generacion (3GPP); o cada una de las asignaciones de fndices de EREG se utiliza para determinar que elementos de recursos (RE) en un par de bloques de recursos ffsicos (PRB) estan asociados con cada uno de los ECCE; o
los RE del par de PRB incluyen un bloque de sfmbolos y(0),..., y(Msymb -1) de valores complejos asignados en secuencia comenzando con y(0) a los elementos (k,/) de recursos en un puerto de antena asociado cuando los RE son parte del EREG asignado para la transmision de EPDCCH, donde Msymb es un numero de sfmbolos de modulacion para transmitir en un canal ffsico y la asignacion a los elementos (k,/) de recursos en el puerto p de antena es un orden creciente de primero un fndice k y luego un fndice /, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama ; o
cada uno de los ECCE se distribuye con otros ECCE en frecuencia o en tiempo en el par de PRB o los multiples pares de PRB o cada uno de los EREG se distribuye con otros EREG en frecuencia o en tiempo en el par de PRB o los multiples pares de PRB.
8. El aparato de cualquiera de las reivindicaciones 6 a 7, en donde la circuiterfa esta ademas configurada para decodificar la DCI con exito cuando se utiliza el mapa de fndices de EREG asociado con un nivel de agregacion especificado, en donde el nivel de agregacion especificado se utiliza para codificar la DCI.
9. El aparato de cualquiera de las reivindicaciones 6 a 8, en donde la circuiterfa configurada para decodificar la DCI estan configurada ademas para:
determinar el nivel de agregacion; y
determinar un valor del ECCE mas bajo.
10. El aparato de cualquiera de las reivindicaciones 6 a 9, en donde la circuiterfa esta configurada ademas para: omitir decodificar con exito la DCI cuando un nivel de agregacion asumido difiere de un nivel de agregacion codificado, en donde un equipo de usuario (UE) entones intenta decodificar con un mapa de fndices de EREG asociado con el nivel de agregacion asumido, y el nivel de agregacion codificado es el nivel de agregacion utilizado por un Nodo B evolucionado (eNB) para codificar la DCI para la transmision en el EPDCCH; y
intentar decodificar la DCI utilizando otro mapa de fndices de EREG asociado con otro nivel de agregacion.
11. Un medio de almacenamiento legible por maquina no transitorio que tiene instrucciones incorporadas para asignar, en una estacion base, los elementos de recursos (RE) a los elementos del canal de control mejorado (ECCE) de un canal ffsico de control de enlace descendente mejorado (EPDCCH), las instrucciones cuando se ejecutan realizan lo siguiente:
determinar, utilizando al menos un procesador de la estacion base, un numero de ECCE utilizados para transmitir la informacion de control de enlace descendente (DCI);
determinar, utilizando el al menos un procesador de la estacion base, un nivel de agregacion utilizado para transmitir la DCI en base al numero de ECCE utilizados para transmitir la DCI; y
asignar, utilizando el al menos un procesador de la estacion base, los elementos de recursos (RE) a grupos de elementos de recursos mejorados (EREG) del ECCE asignado a la DCI utilizando un fndice de EREG.
12. El unico medio de almacenamiento legible por maquina no transitorio de la reivindicacion 11, en donde: el indice de EREG se selecciona en base a un esquema de transmision de EPDCCH localizado o un esquema de transmision de EPDCCH distribuido; o
el ECCE se transmite en un par de bloques de recursos fisicos (PRB) y cada uno de los pares de PRB incluye cuatro ECCE o dos ECCE; o
los RE del par de PRB incluyen un bloque de simbolos y(0),..., y(Msymb -1) de valores complejos asignados en secuencia que comienzan con y(0) a los elementos (k,/) de recursos en un puerto de antena asociado cuando los RE son parte de los EREG asignados para la transmision de EPDCCH, donde Msymb es un numero de simbolos de modulacion para transmitir en un canal fisico y la asignacion a los elementos (k,/) de recursos en el puerto p de antena es un orden creciente de primero un indice k y luego un indice /, comenzando con una primera ranura y terminando con una segunda ranura en una subtrama.
13. El unico medio de almacenamiento legible por maquina no transitorio de cualquiera de las reivindicaciones 11 a 12, que comprende ademas instrucciones que cuando se ejecutan por el al menos un procesador de la estacion base realizan lo siguiente:
asignar el RE a un par de bloques de recursos fisicos (PRB) para el esquema de transmision de EPDCCH localizado utilizando una asignacion secuencial de primero frecuencia en todos los RE ocupados por la DCI; o
asignar el RE a una pluralidad de pares de PRB para el esquema de transmision de EPDCCH distribuido utilizando una asignacion secuencial de primero frecuencia en todos los RE ocupados por la DCI, en donde se transporta una sola DCI para el esquema de transmision de EPDCCH distribuido utilizando los EREG de la pluralidad de pares de PRB.
14. El unico medio de almacenamiento legible por maquina no transitorio de cualquiera de las reivindicaciones 11 a 13, que comprende ademas instrucciones que, cuando se ejecutan por el al menos un procesador de la estacion base, realizan lo siguiente:
asignar el RE a un par de bloques de recursos fisicos (PRB) para el esquema de transmision de EPDCCH localizado utilizando una asignacion secuencial de primero tiempo en todos los RE ocupados por la DCI; o
asignar el RE a una pluralidad de pares de PRB para el esquema de transmision de EPDCCH distribuido utilizando una asignacion secuencial de primero tiempo en todos los RE ocupados por la DCI, en donde se transporta una DCI para el esquema de transmision de EPDCCH distribuido utilizando los EREG de la pluralidad de pares de PRB.
15. El unico medio de almacenamiento legible por maquina no transitorio de cualquiera de las reivindicaciones 11 a 14, que comprende ademas instrucciones que cuando se ejecutan por el al menos un procesador de la estacion base, realiza lo siguiente:
asignar recursos a un canal fisico compartido de enlace descendente (PDSCH) con el EPDCCH; y
transmitir el PDSCH en la asignacion de recursos.
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