DE19727397B4 - Verfahren zum Herstellen eines Flashspeicherelementes mit Hochspannungs-Transistorbereich und Niederspannungs-Transistorbereich - Google Patents
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Abstract
Verfahren zur Herstellung eines Flashspeicherelementes, aufweisend die folgenden Schritte:
Bildung eines Oxidfilms (13) auf einem Siliciumsubstrat (11), das in einen Speicherzellenbereich (A), einen Hochspannungs-Transistorbereich (B) und einen Niederspannungs-Transistorbereich (C) durch Feldoxidfilme (12) unterteilt ist;
Entfernung des am Speicherzellenbereich (A) gebildeten Oxidfilms (13) und Bildung eines Tunneloxidfilms (14) am freigelegten Siliciumsubstrat;
ganzflächige Bildung einer ersten Polysiliciumschicht (15), einschliesslich auf den Feldoxidfilmen (12), und Entfernung eines Teiles der ersten Polysiliciumschicht, so dass die erste Polysiliciumschicht an aktiven Zonen des Speicherzellenbereichs (A) und Hochspannungs-Transistorbereichs (B) verbleibt;
ganzflächige Bildung eines dielektrischen Films (16) mit einer ONO Struktur, einschliesslich auf den Feldoxidfilmen (12);
Entfernung des auf dem Niederspannungs-Transistorbereich (C) gebildeten dielektrischen Films (16) und Durchführung einer Reinigungsbehandlung;
Bildung eines Gateoxidfilms (17) am Niederspannungs-Transistorbereich (C) und ganzflächige Bildung einer zweiten Polysiliciumschicht (18);
Entfernung der zweiten Polysiliciumschicht (18) und des am Hochspannungs-Transistorbereich (B) gebildeten dielektrischen Films (16) und Durchführung einer...
Bildung eines Oxidfilms (13) auf einem Siliciumsubstrat (11), das in einen Speicherzellenbereich (A), einen Hochspannungs-Transistorbereich (B) und einen Niederspannungs-Transistorbereich (C) durch Feldoxidfilme (12) unterteilt ist;
Entfernung des am Speicherzellenbereich (A) gebildeten Oxidfilms (13) und Bildung eines Tunneloxidfilms (14) am freigelegten Siliciumsubstrat;
ganzflächige Bildung einer ersten Polysiliciumschicht (15), einschliesslich auf den Feldoxidfilmen (12), und Entfernung eines Teiles der ersten Polysiliciumschicht, so dass die erste Polysiliciumschicht an aktiven Zonen des Speicherzellenbereichs (A) und Hochspannungs-Transistorbereichs (B) verbleibt;
ganzflächige Bildung eines dielektrischen Films (16) mit einer ONO Struktur, einschliesslich auf den Feldoxidfilmen (12);
Entfernung des auf dem Niederspannungs-Transistorbereich (C) gebildeten dielektrischen Films (16) und Durchführung einer Reinigungsbehandlung;
Bildung eines Gateoxidfilms (17) am Niederspannungs-Transistorbereich (C) und ganzflächige Bildung einer zweiten Polysiliciumschicht (18);
Entfernung der zweiten Polysiliciumschicht (18) und des am Hochspannungs-Transistorbereich (B) gebildeten dielektrischen Films (16) und Durchführung einer...
Description
- Die Erfindung betrifft ein Verfahren zum Herstellen eines Flashspeicherelementes, inbesondere eines solchen mit Hochspannungs- und Niederspannungs-Transistorbereichen.
- Im allgemeinen muss bei einem Speicherbauelement eine Gateelektrode eine zweischichtige Struktur, bestehend aus einer Polysiliciumschicht und einer Silicidschicht, haben, um rasche Programmier- und Löschungsvorgänge vornehmen zu können. Ferner müssen bei einer Flash-EEPROM-Zelle ein Niederspannungs-Transistor mit einem Gateoxidfilm mit einer Dicke von 3 bis 15 nm und ein Hochspannungs-Transistor mit einem Gateoxidfilm mit einer Dicke von 15 bis 30 nm vorgesehen werden.
- Ein Verfahren zur Herstellung eines herkömmlichen Flashspeicherelementes mit einem Hochspannungs- und einem Niederspannungs-Transistor, die Gateelektroden haben, die aus einer Polysiliciumschicht/Silicidschicht bestehen, wird nachfolgend im Detail anhand von
1A bis1L erläutert, die geschnittene Ansichten zur Darstellung der einzelnen Verfahrensschritte bei der Herstellung des herkömmlichen Flashspeicherelementes zeigen. - Ein Oxidfilm
3 wird auf einem Siliciumsubstrat1 gebildet, das in einen Speicherzellenbereich A, einen Hochspannungs-Transistorbereich B und einen Niederspannungs- Transistorbereich C durch Feldoxidfilme2 unterteilt ist (1A ). - Der Oxidfilm
3 des Speicherzellenbereichs A wird entfernt, so dass das Siliciumsubstrat1 am Speicherzellenbereich A freigelegt wird (1B ). Ein Tunneloxidfilm4 wird am Speicherzellenbereich A gebildet, und dann wird eine erste Polysiliciumschicht5 auf der gesamten Struktur einschliesslich der Feldoxidfilme2 vorgesehen (1C ). Dann wird die an den Hochspannungs- und Niederspannungs-Transitorbereichen B und C gebildete erste Polysiliciumschicht5 entfernt. Es verbleibt daher die erste Polysiliciumschicht5 am Tunneloxidfilm4 (1D ). - Ein dielektrischer Film
6 mit einer sog. ONO Struktur, d.h. bestehend aus einem unteren Oxidfilm6A , einem Nitridfilm6B und einem oberen Oxidfilm6C , wird auf der gesamten Anordnung einschliesslich der Feldoxidschichten2 gebildet (1E ). Danach wird der an den Hochspannungs- und Niederspannungs-Transistorbereichen B und C gebildete dielektrische Film6 selektiv entfernt und eine erste Reinigungsbehandlung vorgenommen (1F ). Dann werden Ionen in die Hochspannungs- und Niederspannungs-Transistorbereiche B und C injiziert und eine zweite Reinigungsbehandlung durchgeführt. Der an den Hochspannungs- und Niederspannungs-Transistorbereichen B und C gebildete Oxidfilm3 wird mittels HF entfernt (1G ). Zu diesem Zeitpunkt wird, wie1G zu entnehmen ist, der obere Oxidfilm6C der auf dem Speicherzellenbereich A gebildeten dielektrischen Schicht6 bei der Entfernung des Oxidfilms3 mittels HF ebenfalls entfernt. - Anschliessend wird ein mittlerer Oxidfilm
6D auf der gesamten Struktur mit Ausnahme der Feldoxidfilme2 (1H ) gebildet, der mittlere auf dem Speicherzellenbereich A und dem Niederspannungs-Transistorbereich C gebildete Oxidfilm6D entfernt und eine dritter Reinigungsbehandlung durchgeführt (1I ). Während der dritten Reinigung erleidet der Nitridfilm6B des auf dem Speicherzellenbereich A gebildeten dielektrischen Films6 gewisse Beschädigungen. - Anschliessend wird ein Gateoxidfilm
7 am Niederspannungs-Transistorbereich C geschaffen. Zu diesem Zeitpunkt wird erneut ein oberer Oxidfilm6C auf dem Nitridfilm6B gebildet, so dass der dielektrische Film6 mit einer ONO Struktur am Speicherzellenbereich A entsteht. - Eine zweite Polysiliciumschicht
8 und eine Silicidschicht9 werden nacheinander auf der gesamten Struktur einschliesslich des Feldoxidfilms2 (1K ) gebildet und die zweite Polysiliciumschicht8 und die Silicidschicht9 gemustert, so dass am Hochspannung- und Niederspannungs-Transistorbereich B und C die Gateelektroden10B und10C entstehen (1L ). Eine Gateelektrode10A wird an der aktiven Zone des Speicherzellenbereichs A durch einen Musterungsprozess geschaffen. - Wie erwähnt, wird bei dem Verfahren zur Bildung der Gateelektroden
10A ,10B und10C am Speicherzellenbereich A, Hochspannungs-Transistorbereich B bzw. Niederspannungs-Transistorbereich C der am Speicherzellenbereich A vorgesehene dielektrische Film6 durch die Reinigungslösungen beschädigt, die für die diversen Reinigungsbehandlungen zur Anwendung kommen. Dadurch werden die Eigenschaften des Bauelementes beeinträchtigt. - Aufgabe der Erfindung ist die Schaffung eines Verfahrens der eingangs erwähnten Art zur Herstellung eines Flashspeicherelementes, bei dem die Gefahr einer Schädigung eines dielektrisches Films bei der Herstellung eines Hochspannungs-Transistors und eines Niederspannungs-Transistors mit Gateelektorden vermieden wird. bzw. minimiert ist.
- Diese Aufgabe wird durch die Merkmale des Patentanspruches 1 gelöst. Dabei ist es aus der
DE 4 114 344 A bekannt, auf einem Siliciumsubstrat, das in einen Speicherzellenbereich und einen Schaltkreisbereich durch Feldoxidfilme unterteilt ist, einen Oxidfilm zu bilden, den am Speicherzellenbereich gebildeten Oxidfilm zu entfernen und einen Tunneloxidfilm am freigelegten Siliciumsubstrat vorzusehen, ganzflächig, einschliesslich der Feldoxidfilme eine erste Polysiliciumschicht auszubilden, einen Teil der ersten Polysiliciumschicht zu entfernen, so dass die erste Polysiliciumschicht an aktiven Zonen des Spreicherzellenbereichs verbleibt, einen dielektrischen Film mit einer ONO-Struktur auf der gesamten Anordnung, einschliesslich der Feldoxidfilme zu bilden, den dielektrischen Film auf dem peripheren Schaltkreisbereich zu entfernen, einen Gateoxidfilm am peripheren Schaltkreisbereich zu bilden, und ganzflächig eine zweite Polysiliciumschicht vorzusehen. Verfahren zur Herstellung von nicht-flüchtigen Speicherelementen mit peripheren Schaltungsbereichen sind ferner aus folgenden Druckschriften bekannt:US 5 514 889 A ,US 5 223 451 A ,US 5 158 902 A ,US 5 104 819 A . - Ein Merkmal des erfindungsgemässen Verfahrens ist, dass eine dritte Polysiliciumschicht ganzflächig gebildet wird. Gemäss einer Weiterbildung der Erfindung kann nach der Bildung der dritten Polysiliciumschicht ganzflächig eine Silicidschicht vorgesehen werden. Wenn jedoch eine erste und zweite Polysiliciumschicht eine ausreichende Dicke haben, kann die dritte Polysiliciumschicht wegfallen.
- Die Erfindung wird nachfolgend anhand eines Ausführungsbeispieles und der Zeichnung näher erläutert. Es zeigen:
-
1A bis1L geschnittene Ansichten zur Erläuterung eines herkömmlichen Verfahrens zur Herstellung eines Flashspeicherelementes, -
2A bis2K geschnittene Ansichten zur Erläuterung eines Verfahrens zur Herstellung eines Flashspeicherelementes gemäss der vorliegenden Erfindung. - Die Erfindung wird nachfolgend im Detail anhand von
2A bis2K erläutert. - Ein Oxidfilm
13 wird auf einem Siliciumsubstrat11 gebildet, das in einen Speicherzellenbereich A, einen Hochspannungs-Transistorbereich B und einen Niederspannungs-Transistorbereich C durch Feldoxidfilme12 unterteilt ist (2A ). Der auf dem Speicherzellenbereich A gebildete Oxidfilm13 wird entfernt, so dass das Siliciumsubstrat11 freigelegt wird, und ein Tunnelxidfilm14 wird auf dem freigelegten Siliciumsubstrat11 (2B ) geschaffen. Danach wird eine erste Polysiliciumschicht15 ganzflächig, d.h. auf der gesamten Struktur einschliesslich der Feldoxidfilme12 (2C ) gebildet und ein Teil der ersten Polysiliciumschicht15 entfernt, so dass die erste Polysiliciumschicht15 an den aktiven Zonen des Speicherzellenbereichs A und des Hochspannungs-Transistorbereichs B verbleibt (2D ). - Ein dielektrischer Film
16 mit einer ONO-Struktur, bestehend aus einem unteren Oxidfilm16A , einen Nitridfilm16B und einem oberen Oxidfilm16C , wird ganzflächig, einschliesslich auf den Feldoxidfilmen12 gebildet (2E ). Danach wird der dielektrische am Niederspannungs-Transistorbereich C gebildete Film16 entfernt und anschliessend eine Reinigungsbehandlung durchgeführt (2F ). Zu diesem Zeitpunkt wird die obere Oxidschicht16C des dielektrischen, am Speicherzellenbereich A gebildeten Films16 durch die Reinigungslösung angegriffen. - Ein Gateoxidfilm
17 wird auf dem Niederspannungs-Transistorbereich C und eine zweite Polysiliciumschicht18 auf der gesamten Struktur gebildet (2G ). Dann werden die zweite Polysiliciumschicht18 und der dielektrische Film16 , die am Hochspannungs-Transistorbereich B geschaffen wurden, nacheinander entfernt, und wird anschliessend eine Reinigungsbehandlung durchgeführt (2H ). - Eine dritte Polysiliciumschicht
21 und eine Silicidschicht19 werden nacheinander auf der gesamten Struktur gebildet (2I ). Eine Gateelektrode20B , bestehend aus dem Oxidfilm13 , der ersten Polysiliciumschicht15 , der dritten Polysiliciumschicht21 und der Silicidschicht19 , wird auf dem Hochspannungs-Transistorbereich B geschaffen und eine Gateelektrode20C , bestehend aus dem Gateoxidfilm17 , der zweiten Polysiliciumschicht18 , der dritten Polysiliciumschicht21 und der Silicidschicht19 , wird am Niederspannungs-Transistorbereich C geschaffen, jeweils durch eine betreffende Musterungsbehandlung. Eine Gateelektrode20A , bestehend aus dem Tunneloxidfilm14 , der ersten Polysiliciumschicht15 , der dielektrischen Schicht16 , der zweiten und dritten Polysiliciumschichten18 und21 sowie der Siliciumschicht19 , welche übereinander angeordnet sind, wird ebenfalls am Speicherzellenbereich A (2K ) durch die Musterungsbehandlung geschaffen. - Da, wie vorerwähnt, während der Behandlung zur Bildung der Gateelektroden
20A ,20B und20C nur der dielektrische, am Speicherzellenbereich A geschaffene Film16 , insbesondere der obere Oxidfilm16C , der Reinigungslösung ausgesetzt wird, die bei der Reinigungsbehandlung nach Entfernung des dielektrischen am Niederspannungs-Transistorbereich C gebildeten Films zur Anwendung kommt, lässt sich die Anzahl an Schädigungen am dielektrischen Film16 minimieren und wird dadurch ein qualitativ hochwertiger dielektrischer Film erhalten. - Obgleich vorausgehend beschrieben wurde, dass die dritte Polysiliciumschicht
21 auf der zweiten Polysiliciumschicht18 (bei den Gateelektroden20A und20C ) oder auf der ersten Polysiliciumschicht15 (bei der Gateelektrode20B ) gebildet wird, braucht die dritten Polysiliciumschicht21 nicht vorgesehen werden, wenn die Dicke der ersten und zweiten Polysiliciumschichten15 und18 ausreichend ist.
Claims (2)
- Verfahren zur Herstellung eines Flashspeicherelementes, aufweisend die folgenden Schritte: Bildung eines Oxidfilms (
13 ) auf einem Siliciumsubstrat (11 ), das in einen Speicherzellenbereich (A), einen Hochspannungs-Transistorbereich (B) und einen Niederspannungs-Transistorbereich (C) durch Feldoxidfilme (12 ) unterteilt ist; Entfernung des am Speicherzellenbereich (A) gebildeten Oxidfilms (13 ) und Bildung eines Tunneloxidfilms (14 ) am freigelegten Siliciumsubstrat; ganzflächige Bildung einer ersten Polysiliciumschicht (15 ), einschliesslich auf den Feldoxidfilmen (12 ), und Entfernung eines Teiles der ersten Polysiliciumschicht, so dass die erste Polysiliciumschicht an aktiven Zonen des Speicherzellenbereichs (A) und Hochspannungs-Transistorbereichs (B) verbleibt; ganzflächige Bildung eines dielektrischen Films (16 ) mit einer ONO Struktur, einschliesslich auf den Feldoxidfilmen (12 ); Entfernung des auf dem Niederspannungs-Transistorbereich (C) gebildeten dielektrischen Films (16 ) und Durchführung einer Reinigungsbehandlung; Bildung eines Gateoxidfilms (17 ) am Niederspannungs-Transistorbereich (C) und ganzflächige Bildung einer zweiten Polysiliciumschicht (18 ); Entfernung der zweiten Polysiliciumschicht (18 ) und des am Hochspannungs-Transistorbereich (B) gebildeten dielektrischen Films (16 ) und Durchführung einer Reinigungsbehandlung; ganzflächige Bildung einer dritten Polysiliciumschicht (21 ); und Bildung von Gateelektroden (20A ,20B ,20C ) am Speicherzellenbereich (A), Hochspannungs-Transistorbereich (B) und Niederspannungs-Transistorbereich (C) durch eine betreffende Musterungsbehandlung. - Verfahren nach Anspruch 1, dadurch gekennzeichnet, dass ferner ganzflächig eine Silicidschicht (
19 ) nach der Bildung der dritten Polisiliciumschicht (21 ) vorgesehen wird.
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Families Citing this family (32)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE69734278D1 (de) * | 1997-07-03 | 2006-02-09 | St Microelectronics Srl | Herstellungsverfahren eines nichtflüchtigen Halbleiterspeicherbauelementes mit abgeschirmtem Einpolysiliziumgate-Speicherabschnitt |
US6040216A (en) * | 1997-08-11 | 2000-03-21 | Mosel Vitelic, Inc. | Method (and device) for producing tunnel silicon oxynitride layer |
AU735045B2 (en) * | 1997-10-30 | 2001-06-28 | Texas Instruments Incorporated | A process flow to integrate high and low voltage peripheral transistors with a floating gate array |
TW374939B (en) * | 1997-12-19 | 1999-11-21 | Promos Technologies Inc | Method of formation of 2 gate oxide layers of different thickness in an IC |
EP0975022A1 (de) * | 1998-07-22 | 2000-01-26 | STMicroelectronics S.r.l. | Herstellungsverfahren für elektronische Bauelemente mit Festwertspeicherzellen und Niederspannungstransistoren, die selbstjustierte Silizidübergänge aufweisen |
US6191444B1 (en) | 1998-09-03 | 2001-02-20 | Micron Technology, Inc. | Mini flash process and circuit |
KR100268894B1 (ko) * | 1998-09-29 | 2000-10-16 | 김영환 | 플래쉬 메모리 소자의 제조방법 |
EP1005079B1 (de) * | 1998-11-26 | 2012-12-26 | STMicroelectronics Srl | Integrationsverfahren eines Festwertspeichers und eines Hochleistungslogikschaltkreises auf einem Chip |
US6362049B1 (en) * | 1998-12-04 | 2002-03-26 | Advanced Micro Devices, Inc. | High yield performance semiconductor process flow for NAND flash memory products |
US6180456B1 (en) * | 1999-02-17 | 2001-01-30 | International Business Machines Corporation | Triple polysilicon embedded NVRAM cell and method thereof |
TW445620B (en) * | 1999-03-05 | 2001-07-11 | United Microelectronics Corp | Method for manufacturing the source line of nonvolatile memory |
US6130168A (en) * | 1999-07-08 | 2000-10-10 | Taiwan Semiconductor Manufacturing Company | Using ONO as hard mask to reduce STI oxide loss on low voltage device in flash or EPROM process |
US6159802A (en) * | 1999-07-14 | 2000-12-12 | United Microelectronics Corp. | Method of forming a stack-gate of a non-volatile memory on a semiconductor wafer |
TW415045B (en) * | 1999-08-10 | 2000-12-11 | United Microelectronics Corp | Manufacture of embedded flash memory |
US6177362B1 (en) * | 1999-08-17 | 2001-01-23 | United Microelectronics Corp. | Fabrication method for gate structure having gate dielectric layers of different thickness |
US6238984B1 (en) * | 2000-05-05 | 2001-05-29 | United Microelectronics Corp. | Integrating high voltage and low voltage device with silicide block mask |
DE10110150A1 (de) * | 2001-03-02 | 2002-09-19 | Infineon Technologies Ag | Verfahren zum Herstellen von metallischen Bitleitungen für Speicherzellenarrays, Verfahren zum Herstellen von Speicherzellenarrays und Speicherzellenarray |
US6399443B1 (en) * | 2001-05-07 | 2002-06-04 | Chartered Semiconductor Manufacturing Ltd | Method for manufacturing dual voltage flash integrated circuit |
KR100399350B1 (ko) * | 2001-08-09 | 2003-09-26 | 삼성전자주식회사 | 부유 트랩형 소자를 가지는 비휘발성 반도체 메모리 장치및 그 제조방법 |
KR100407573B1 (ko) * | 2001-08-09 | 2003-11-28 | 삼성전자주식회사 | 부유 트랩형 비휘발성 메모리 장치 형성 방법 |
US6551883B1 (en) * | 2001-12-27 | 2003-04-22 | Silicon Integrated Systems Corp. | MOS device with dual gate insulators and method of forming the same |
KR100437451B1 (ko) * | 2002-05-07 | 2004-06-23 | 삼성전자주식회사 | 트랩형 비휘발성 메모리 장치의 제조 방법 |
US6797568B1 (en) * | 2002-11-21 | 2004-09-28 | Lattice Semiconductor Corp. | Flash technology transistors and methods for forming the same |
JP2004228358A (ja) * | 2003-01-23 | 2004-08-12 | Fujitsu Ltd | 半導体装置の製造方法 |
KR100518577B1 (ko) * | 2003-05-26 | 2005-10-04 | 삼성전자주식회사 | 원 타임 프로그래머블 메모리 소자 및 이를 포함하는반도체 집적회로와 그 제조방법 |
KR100557995B1 (ko) * | 2003-07-30 | 2006-03-06 | 삼성전자주식회사 | 부유트랩형 비휘발성 메모리 셀을 갖는 반도체 장치 및그의 제조방법 |
CN100361292C (zh) * | 2004-12-30 | 2008-01-09 | 旺宏电子股份有限公司 | 快闪存储单元制造方法 |
US8642441B1 (en) * | 2006-12-15 | 2014-02-04 | Spansion Llc | Self-aligned STI with single poly for manufacturing a flash memory device |
US7439134B1 (en) * | 2007-04-20 | 2008-10-21 | Freescale Semiconductor, Inc. | Method for process integration of non-volatile memory cell transistors with transistors of another type |
KR100957873B1 (ko) * | 2007-12-28 | 2010-05-13 | 매그나칩 반도체 유한회사 | 반도체 소자의 게이트 산화막 형성 방법 |
CN103367255A (zh) * | 2012-03-26 | 2013-10-23 | 上海宏力半导体制造有限公司 | 可多次编程的硅氧化氮氧化硅的制造方法 |
CN104952734B (zh) * | 2015-07-16 | 2020-01-24 | 矽力杰半导体技术(杭州)有限公司 | 半导体结构及其制造方法 |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE4114344A1 (de) * | 1990-09-22 | 1992-04-02 | Samsung Electronics Co Ltd | Herstellungsverfahren und aufbau einer nicht-fluechtigen halbleiterspeichereinrichtung mit einer speicherzellenanordnung und einem peripheren schaltkreis |
US5104819A (en) * | 1989-08-07 | 1992-04-14 | Intel Corporation | Fabrication of interpoly dielctric for EPROM-related technologies |
US5158902A (en) * | 1989-04-28 | 1992-10-27 | Kabushiki Kaisha Toshiba | Method of manufacturing logic semiconductor device having non-volatile memory |
US5223451A (en) * | 1989-10-06 | 1993-06-29 | Kabushiki Kaisha Toshiba | Semiconductor device wherein n-channel MOSFET, p-channel MOSFET and nonvolatile memory cell are formed in one chip and method of making it |
US5514889A (en) * | 1992-08-18 | 1996-05-07 | Samsung Electronics Co., Ltd. | Non-volatile semiconductor memory device and method for manufacturing the same |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5183773A (en) * | 1989-04-13 | 1993-02-02 | Mitsubishi Denki Kabushiki Kaisha | Method of manufacturing semiconductor device including such input protection transistor |
US5175120A (en) * | 1991-10-11 | 1992-12-29 | Micron Technology, Inc. | Method of processing a semiconductor wafer to form an array of nonvolatile memory devices employing floating gate transistors and peripheral area having CMOS transistors |
US5292681A (en) * | 1993-09-16 | 1994-03-08 | Micron Semiconductor, Inc. | Method of processing a semiconductor wafer to form an array of nonvolatile memory devices employing floating gate transistors and peripheral area having CMOS transistors |
US5478767A (en) * | 1994-09-30 | 1995-12-26 | United Microelectronics Corporation | Method of making a flash EEPROM memory cell comprising polysilicon and textured oxide sidewall spacers |
JPH08167705A (ja) * | 1994-12-15 | 1996-06-25 | Toshiba Corp | 不揮発性半導体記憶装置及びその製造方法 |
US5723355A (en) * | 1997-01-17 | 1998-03-03 | Programmable Microelectronics Corp. | Method to incorporate non-volatile memory and logic components into a single sub-0.3 micron fabrication process for embedded non-volatile memory |
-
1996
- 1996-06-27 KR KR1019960024393A patent/KR100199382B1/ko not_active IP Right Cessation
-
1997
- 1997-06-16 TW TW086108329A patent/TW339471B/zh not_active IP Right Cessation
- 1997-06-19 GB GB9712952A patent/GB2314678B/en not_active Expired - Fee Related
- 1997-06-20 US US08/879,419 patent/US5888869A/en not_active Expired - Lifetime
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- 1997-06-27 CN CN97111869A patent/CN1085412C/zh not_active Expired - Fee Related
- 1997-06-27 DE DE19727397A patent/DE19727397B4/de not_active Expired - Fee Related
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5158902A (en) * | 1989-04-28 | 1992-10-27 | Kabushiki Kaisha Toshiba | Method of manufacturing logic semiconductor device having non-volatile memory |
US5104819A (en) * | 1989-08-07 | 1992-04-14 | Intel Corporation | Fabrication of interpoly dielctric for EPROM-related technologies |
US5223451A (en) * | 1989-10-06 | 1993-06-29 | Kabushiki Kaisha Toshiba | Semiconductor device wherein n-channel MOSFET, p-channel MOSFET and nonvolatile memory cell are formed in one chip and method of making it |
DE4114344A1 (de) * | 1990-09-22 | 1992-04-02 | Samsung Electronics Co Ltd | Herstellungsverfahren und aufbau einer nicht-fluechtigen halbleiterspeichereinrichtung mit einer speicherzellenanordnung und einem peripheren schaltkreis |
US5514889A (en) * | 1992-08-18 | 1996-05-07 | Samsung Electronics Co., Ltd. | Non-volatile semiconductor memory device and method for manufacturing the same |
Also Published As
Publication number | Publication date |
---|---|
KR100199382B1 (ko) | 1999-06-15 |
GB2314678B (en) | 2001-04-25 |
US5888869A (en) | 1999-03-30 |
GB2314678A (en) | 1998-01-07 |
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TW339471B (en) | 1998-09-01 |
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CN1177212A (zh) | 1998-03-25 |
GB9712952D0 (en) | 1997-08-20 |
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