CN1308906C - 液晶显示装置 - Google Patents

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Abstract

一种液晶显示装置，其包括多个在基板显示区上以矩阵形式排列的像素电极和多个分别对应多个像素电极的薄膜晶体管。分别布置在像素电极中的奇数列线和偶数列线间的多个数据线共同连接至相应的奇数列和偶数列的薄膜晶体管上。通过与像素电极的各行对应而排列的多个第一栅极线共同连接到对应行以外的奇数薄膜晶体管上，通过与像素电极的各行对应而排列的多个第二栅极线共同连接至对应行以外的偶数薄膜晶体管上。数据驱动电路驱动数据线，第一栅极驱动电路排列在显示区一周边区中以驱动第一栅极线，且第二栅极驱动电路排列在显示区其它周边区中，以第一栅极驱动电路和显示区为中心而左右对称。

Description

液晶显示装置
                    技术领域
本发明涉及一种液晶显示装置，尤其涉及一种能通过将第一和第二栅极驱动电路设置成相对于有源矩阵液晶显示(AM-LCD)装置的非晶硅(a-Si)的玻璃基板上的显示区对称而进一步方便安装的液晶显示装置。
                    背景技术
近年来，信息处理设备已经得以快速发展而具有多种形式和功能以及更快的信息处理速度。这种信息处理设备需要用于用户界面的显示装置。
当前，LCD装置作为下一代显示装置吸引了更多的注意力，因为在使之能实现优于典型CRT型显示装置的全色化的同时具有重量轻、尺寸小、高分辨、低功耗和适合环境的优点。
如图1所示，AM-CD装置以一种方式构造，即数据驱动电路12和栅极驱动电路14靠近形成有像素阵列的玻璃基板10上的显示区11而形成，且接线端部分16和印刷电路板20借助薄膜电缆18彼此连接。由于此种结构，制造成本可以降低，且通过整合驱动电路可以将功耗减至最小。
然而，栅极驱动电路14被设置到显示区11的仅一侧上，使得LCD模块相对于显示区11的中心可以是非对称的。
因而，LCD模块的非对称结构不可避免地导致显示装置宽度增大的问题，因为显示装置被制造得相对于其中心对称。于是，当前述LCD模块被提供为诸如笔记本电脑、移动电话和PDA等便携式设备的显示装置时，该LCD模块成为抑制便携式设备轻薄短小的主要因素。
                    发明内容
为了解决相关领域的上述问题，本发明的第一目的是提供一种LCD装置，该装置用于当在玻璃基板的显示区周围布置周边电路时，将玻璃基板显示区左和右部分上的周边电路布置成相对于显示区对称，从而实现安装中的便利。
本发明的第二目的是提供一种LCD装置，该装置通过考虑到左右对称而具有双栅极驱动电路。
本发明的第三目的是提供一种LCD装置，用以随着栅极线增加为数据驱动电路芯片数量的两倍以安装双栅极驱动电路，而借助减少一半数据驱动电路通道来减少该芯片的数量。
为了实现本发明的以上目的，提供一种液晶显示装置，该装置包括多个像素电极，该像素电极在基板的显示区上以矩阵形式进行排列。像素电极具有像素电极的多个列线和像素电极的多个行线。多个薄膜晶体管分别对应该多个像素电极，并具有分别连接对应像素电极的第一电流电极。在多个像素电极的奇数列线和偶数列线间分别布置多个数据线，并将其共同连接至相应奇数列线和偶数列线的薄膜晶体管的第二电流电极上。通过与多个像素电极的各行线对应而排列多个第一栅极线，多个像素电极的各列线共同连接到对应行线的奇数薄膜晶体管的栅电极上。多个第二栅极线通过对应多个像素电极的各行线而排列，并且共同连接至对应行线的偶数薄膜晶体管的栅电极上。此外，还提供驱动多个数据线的数据驱动电路、排列在显示区的第一周边区中用以驱动多个第一栅极线的第一栅极驱动电路、以及排列在相对于显示区而与显示区的第一周边区对称的显示区第二周边区中用以驱动多个第二栅极线的第二栅极驱动电路。每个第一和第二栅极驱动电路包括多个级，并根据各级的输出信号顺序选择多个栅极线，同时，第一栅极驱动电路被提供第一时钟信号，而第二栅极驱动电路被提供第二时钟信号，第二时钟信号具有与第一时钟信号相反的相位，且每个级包括：与前一栅极线连接的输入接线端；与相应栅极线连接的输出接线端；与下一栅极线连接的控制接线端；接收相应时钟信号的时钟接线端；正偏装置，连接在时钟接线端和输出接线端之间，用以在导通状态下在时钟信号的工作周期中正偏对应的栅极线；反偏装置，连接在输出接线端和第一电源电压之间，以允许在导通状态下使对应的栅极线反偏至所述第一电源电压；正偏驱动装置，连接到正偏装置的输入节点上，用以响应提供给输入接线端的输入信号的先端而导通正偏装置，或者用以响应提供给控制接线端的控制信号的先端而截止正偏装置；反偏驱动装置，连接到反偏装置的输入节点上，用以响应输入信号的先端而截止反偏装置，或者用以响应控制信号的先端而导通反偏装置；以及浮置旁路装置，连接在反偏装置的输入节点和第二电源电压之间，用以恒定地将第二电源电压连接至反偏装置的输入节点上，防止所述反偏装置的输入节点被浮置。
此时，第一和第二栅极驱动电路驱动像素电极的多个行线，以响应通过第一和第二栅极线接收的变换信号而按之字形扫描。
根据本发明的另一方面，提供一种液晶显示装置，此装置包括在显示区第一周边区中排列的用以驱动多个数据线的数据驱动电路、在相对于显示区而与第一周边区对称的显示区第二周边区的第一侧中排列而用以驱动多个第一栅极线的第一栅极驱动电路、以及在相反于第二周边区第一侧的显示区第二周边区的第二侧中排列而用以驱动多个第二栅极线的第二栅极驱动电路。
根据本发明的再一个方面，提供一种液晶显示装置，该装置包括在显示区周边区中排列而用以驱动多个数据线的数据驱动电路、排列在数据驱动电路的第一周边区中而用以驱动第一栅极线的第一栅极驱动电路，以及在相对于数据驱动电路而与数据驱动电路的第一周边区对称的数据驱动电路的第二周边区中排列以驱动多个第二栅极线的第二栅极驱动电路。
                    附图说明
通过参照附图而详细描述其优选实施例，本发明的以上目的和其它优点将变得更清楚，其中：
图1是示出以栅极驱动电路包围的传统非对称型液晶显示模块的示意图；
图2是示出根据本发明一优选实施例的用双栅极驱动电路包围的对称型液晶显示模块的示意图；
图3是示出用于连接到图2的薄膜电缆上的外部接线端部分的布线图；
图4是示出图2的液晶显示模块的结构图；
图5示出形成图4的液晶显示装置的各电路的波形；
图6是示出根据本发明一优选实施例的图4所示的栅极驱动电路各级的电路图；
图7是示出根据本发明另一优选实施例的图4所示的栅极驱动电路各级的电路图；
图8示出了根据本发明一实施例的对称型液晶显示装置的显示区和栅极驱动电路的布局图；
图9至13示出图8各层的布局图；
图14是示出根据本发明另一优选实施例的用双栅极驱动电路包围的对称型液晶显示模块的示意图；以及
图15是示出根据本发明再一实施例的用双栅极驱动电路包围的对称型液晶显示模块的示意图。
                    具体实施方式
以下，将参照附图详细描述本发明的优选实施例。
图2是示出根据本发明一优选实施例的用双栅极驱动电路包围的对称型液晶显示模块的示意图。
参照图2，LCD模块包括下基板100和上基板102。下基板100被分成与上基板102重叠的第一区100a和不与之重叠的第二区100b。
第一区100a包括显示区104和周边区106。液晶注入下基板100和上基板102之间后，显示区104和周边区106的外围边缘部分用密封材料密封。第一和第二栅极驱动电路108和110排列在相对于显示区104对称的周边区106的左和右部分上。
第二区100b用数据驱动电路112和依次与薄膜电缆116的一端连接的外部连接接线端114形成。薄膜电缆116的另一端联接到集成电路板(未示出)上。数据驱动电路112按芯片的形式制造，并固定到下基板100上。
图3是示出用于连接到图2的薄膜电缆上的外部接线端部分的布局图。
如图3所示，外部连接接线端114具有第一接线端组114a、第二接线端组114b和信道接线端组114c。第一接线端组114a包括起始信号输入端ST、第一时钟信号输入端CK、第一电源电压端VOFF或VSS以及第二电源电压端VON或VDD，并且被连接到第一栅极驱动电路106上。此外，第二接线端组114b包括第二时钟信号输入端CKB、第一电源电源端VOFF或VSS和第二电源电压端VON或VDD，并被连接到第二栅极驱动电路110上。信道接线端组114c被连接到数据驱动电路112上。
图4是示出图2的液晶显示模块的结构图。
参照图4，位于显示区104的左部周边区中具有向其延伸的奇数栅极线GL1至GLn+1的第一栅极驱动电路108由多个分别与输出接线端连接的变换寄存器SRC1至SRCn+1形成。位于显示区104的右部周边区中具有向其延伸的偶数栅极线GL2至GLn的第二栅极驱动电路110由多个分别连接输出接线端的变换寄存器SRC2至SRCn形成。
奇数变换寄存器SRCi的输出信号被提供作为下一个偶数变换寄存器SRCi的输入接线端的起始信号，相对于显示区104而与奇数变换寄存器SRCi对称地设置该偶数变换寄存器SRCj。同时，奇数变换寄存器SRCi的输出信号被提供为先前偶数变换寄存器SRCj-1的控制接线端的控制信号。相似地，偶数变换寄存器SRCj的输出信号被提供为下一个奇数变换寄存器SRCj+1的输入接线端的起始信号，同时被提供至先前的奇数变换寄存器SRCi的控制接线端作为控制信号。
上一个奇数变换寄存器SRCn+1被添加为向上一个偶数变换寄存器SRCn的控制接线端提供控制信号的伪寄存器。
图5示出形成图4的液晶显示装置的各电路的波形。
参照图5，公开了图4所示的各电路的同步关系。此处，可注意到的是，奇数栅极线和偶数栅极线被交替激活，以通过在被起始信号ST顺序改变的同时与时钟信号CK和CKB同步而扫描。
形成被定义为行线的单一水平线的多个像素的奇数像素被对应的奇数栅极线GL1驱动，而偶数像素被对应的偶数栅极线GL2驱动。
于是，驱动两栅极线GL1和GL2以显示单一水平线的所有像素。因而，当垂直分辨率为160条水平线时，栅极线的数量增加了两倍而需要320条栅极线。
根据以上栅极驱动系统，在水平方向上邻近的两个薄膜晶体管共同分享一单根数据线，且两个薄膜晶体管被连接至彼此分离的栅极线上。结果，虽然像素被设置成相同的水平线，但是奇数像素首先被第一栅极驱动电路充电，然后在被延迟一个时钟脉冲那么久后，偶数像素又通过第二栅极驱动电路充电。
因而，当一条水平线的彩色像素数目为240时，数据驱动电路总共需要720条数据线，因为各像素需要三个像素构成一个RGB单元。于是，不可避免地应当采用两个具有360个数据输出接线端的数据驱动芯片以驱动720条数据线。
然而，根据本发明一实施例，因为奇数360个单元像素可以首先根据上述的双栅极驱动系统充电，而偶数360个单元像素可以在延迟一时钟脉冲后充电，所以本来为720的数据驱动线的数目可以减少到360。因为这个原因，可以单独采用一个具有360个数据输出接线端的数据驱动芯片。因而，可以容易地设计周边区的用以连接数据驱动芯片和数据线的线形布置。
图6是示出根据本发明一优选实施例的图4所示的栅极驱动电路各级的电路图。
图4的各级包括正偏单元(pull-up unit)120、反偏单元(pull-downunit)122、正偏驱动单元124、反偏驱动单元126、浮置旁路单元(floatingblocking unit)128和导通旁路单元(turn-on blocking unit)130。
正偏单元120由正偏NMOS晶体管NT1构成，此晶体管具有连接到时钟信号输入接线端CK的漏极、连接到第一节点N1的栅极和连接到输出接线端OUT的源极。
反偏单元122由反偏NMOS晶体管NT2构成，此晶体管具有连接到输出接线端OUT的漏极、连接到第二节点N2的栅极和连接到第一电源电压VSS的源极。
正偏驱动单元124用电容C和NMOS晶体管NT3、NT4和NT5形成。电容C连接到第一节点N1和输出接线端OUT上。晶体管NT3具有共同连接到输入接线端IN上的漏极和栅极，以及连接到第一节点N1上的源极。晶体管NT4具有连接到第一节点N1上的漏极、连接到第二节点N2上的栅极和连接到第一电源电压VSS上的源极。晶体管NT5具有连接到第一节点N1上的漏极、连接到控制接线端CT上的栅极，以及连接到第一电源电压VSS上的源极。
反偏驱动单元126用两个NMOS晶体管NT6和NT7形成。晶体管NT6具有连接到第二电源电压VDD上的漏极、连接到控制接线端CT上的栅极，以及连接到第二节点N2上的源极。晶体管NT7具有连接到第二节点N2上的漏极、连接到输入接线端IN上的栅极，以及连接到第一电源电压VSS上的源极。
浮置旁路单元120用一个NMOS晶体管NT8形成，此晶体管具有共同连接到第二电源电压VDD上的漏极和栅极，以及连接到第二节点N2上的源极。晶体管NT8形成的大小要以按照例如1∶20的比率而小于晶体管NT7。
导通旁路单元130用NMOS晶体管NT9形成，此晶体管具有连接到第二节点N2的漏极、连接到输出接线端OUT的栅极和连接到第一电源电压VSS上的源极。在尺寸上，晶体管NT9和晶体管NT7具有约1∶2的比率关系。
一旦第一时钟信号CK和扫描起始信号ST提供给图5所示的栅极驱动电路108的变换寄存器170上，第一级SRC1响应扫描起始信号ST的先端而延迟第一时钟信号CK的高电平间隔，以使之成为到连接至输出接线端的栅极线GL1的输出信号。
扫描起始信号ST的工作间隔具有超前第一时钟信号CK的高电平间隔大约1/4周期那么长的相位。起始信号ST的工作间隔被分成从脉冲先端，即从上升边开始的准备时间和到脉冲后边，即下降边的维持时间。
因而，输出信号OUT1的先端具有延迟2-4微秒预定时间那么久的先端，该时间从维持时间的起点，即上升边开始。也就是说，第一时钟信号CK的工作间隔，即高电平间隔被延迟预定时间那么久，以传输给输出接线端。
这是因为，正偏驱动单元124的电容C在起始信号ST的先端在晶体管NT4截止的状态下通过晶体管NT3开始充电，正偏晶体管NT1在电容C的充电电压变得高于正偏晶体管NT1的栅极和源极之间的阈值电压后导通，以及第一时钟信号CK的高电平间隔开始在输出接线端出现。
一旦时钟信号的高电平间隔在输出接线端OUT上显现，则将输出电压自举到电容C上以将正偏晶体管NT1的栅极电压升高至高于导通电压VDD。于是，作为NMOS晶体管的正偏晶体管NT1维持全导通状态。
同时，关于反偏驱动单元126，因为晶体管NT7在起始信号ST的先端在晶体管NT6截止的状态下导通，所以第二节点N2的电位降低至第一电源电压VSS。此时，在浮置旁路单元128的晶体管NT8维持导通状态的同时时，导通晶体管NT7的尺寸大于晶体管NT8约20倍，第二节点N2从第二电源电压VDD状态降低到第一电源电压VSS。因而，反偏晶体管NT2由导通态转变为截止态。
当导通电压VON(即VDD)在输出接线端OUT上形成时，导通旁路单元130的晶体管NT9导通以借助第一电源电压VSS将驱动第二节点N2的电容量提高约50％。结果，第二节点N2的电压在输出信号的上升转变过程中因反偏晶体管的漏极和源极间的寄生电容而已经得以提高。因此，可以可靠地防止使在输出信号的上升转变过程中使反偏晶体管导通的故障。
输出接线端OUT的输出信号OUT1在被供给前被延迟第一时钟信号CK的工作周期那么久。
一旦输出接线端OUT输出信号的电压下降至截止电压VOFF(即VSS)，晶体管NT9则截止。这样，第二节点N2处于通过晶体管NT8仅被提供第二电源电压VDD的状态，使得第二节点N2的电位从第一电源电压VSS升高至第二电源电压VDD。当第二节点N2的电位被提高时，晶体管NT4由于经由晶体管NT4将电容器的充电电压释放而导通。因而，正偏晶体管NT1截止。
接着，被供给至控制接线端CT的下一级输出信号被提高至导通电压，从而将晶体管NT5和NT6导通。这样，第二节点N2的电位通过由晶体管NT6和NT8提供的第二电源电压VDD而迅速升高，且第一节点N1的电位通过晶体管NT4和NT5迅速降低至第一电源电压VSS。
于是，正偏晶体管NT1截止，而反偏晶体管NT2导通，以使输出接线端OUT从导通电压VON降低至第二电源电压VDD的截止电压VOFF。
即使提供至控制接线端CT的下一级输出信号降低至低电平以截止晶体管NT6，第二节点N2仍通过晶体管NT8维持被偏置至第二电源电压VDD的状态，而第一节点N1通过保持导通状态的晶体管NT4维持被偏置至第一电源电压VSS的状态。于是，因为即使晶体管NT2和NT4的阈值电压通过数小时的使用而升高，而第二节点N2的电位仍保持第二电源电压VDD，所以稳定的运行无需考虑截止反偏晶体管NT2的故障。
按之字形运行各级SRC1至SRC4，以如以上详细描述的那样顺序地操作栅线。
图7是示出根据本发明另一优选实施例的图4所示的栅极驱动电路各级的电路图。
参照图7，该级包括正偏单元132、反偏单元134、正偏驱动单元136和反偏驱动单元138。
正偏单元132通过正偏NMOS晶体管NT11形成，此晶体管具有与时钟信号输入接线端CK相连的漏极、与第三节点N3相连的栅极和与输出接线端OUT相连的源极。
反偏单元134由反偏NMOS晶体管NT12形成，此晶体管具有与输出接线端OUT相连的漏极、与第四节点N4相连的栅极和与第一电源电压VSS相连的源极。
正偏驱动单元136包括电容C和NMOS晶体管NT13、NT14和NT15。电容C在第三节点N3和输出接线端OUT之间连接。晶体管NT13具有与第二电源电压VDD相连的漏极、与输入接线端IN相连的栅极和与第三节点N3相连的源极。晶体管NT14具有与第三节点N3相连的漏极、与控制接线端CT相连的栅极和与第一电源电压VSS相连的源极。晶体管NT15具有与第三节点N3相连的漏极、与第四节点N4相连的栅极和与第一电源电压VSS相连的源极。此时，晶体管NT13形成为晶体管NT15的尺寸的两倍。
反偏驱动单元138由两个NMOS晶体管NT16和NT17形成。晶体管NT16具有共同连接至第二电源电压VDD的漏极和栅极，以及连接至第四节点N4的源极。晶体管NT17具有连接至第四节点N4的漏极、连接至第三节点N3的栅极和连接至第一电源电压VSS的源极。此时，晶体管NT16的尺寸大于晶体管NT17的尺寸约16倍。
当提供第一时钟信号CK和扫描起始信号ST时，第一时钟信号CK的高电平间隔响应扫描起始信号ST的先端而延迟一预定时间，以将其作为输出信号传输到输出接线端。
扫描起始信号ST的工作间隔具有超前第一时钟信号CK的高电平间隔约1/4周期的相位。起始信号ST的工作间隔被分成脉冲的先端，即从上升边开始的准备时间Ts1，和后边，即到下降边的维持时间Ts2。
这种延迟特性因如下事实而发生，即正偏驱动单元136的电容C在起始信号ST的先端开始通过晶体管NT13充电，正偏晶体管NT11在电容C的充电电压被充至高于正偏晶体管NT11的栅极和源极间的阈值电压后导通，以及第一时钟信号CK的高电平间隔在输出接线端出现。
一旦时钟信号的高电平间隔在输出接线端OUT出现，则将输出电压自举到电容C上以允许正偏晶体管NT11的栅极电压高于导通电压VDD。于是，作为NMOS晶体管的正偏晶体管NT11维持全导通状态。此时，因为晶体管NT13的尺寸大于晶体管NT15的尺寸约两倍，所以晶体管NT11转变成导通状态，即使晶体管NT15被起始信号ST导通。
同时，关于反偏驱动单元138，晶体管NT17被输入信号截止以允许第四节点N4升至第二电源电压VDD，从而使晶体管NT12导通。因而，来自输出接线端OUT的输出信号的电压维持第一电源电压VSS的状态。此时，因为晶体管NT17被起始信号导通，所以第四节点N4的电位被降低到第一电源电压VSS。即使晶体管NT16导通，第四节点N4连续维持第一电源电压VSS状态，因为晶体管NT17的尺寸大于晶体管NT16的尺寸约16倍。于是，反偏晶体管NT12从导通态转变成截止态。
输出接线端OUT的输出信号OUT1在被延迟第一时钟信号CK的工作周期那么久后被提供。
当来自输出接线端OUT的输出信号的电压降至截止电压VOFF(＝VSS)时，晶体管NT17截止。于是，因为仅通过晶体管NT16而将第二电源电压VDD提供给第四节点N4，所以第四节点N4的电位开始从第一电源电压VSS升高至第二电源电压VDD。当第四节点N4的电压开始上升时，晶体管NT15导通。这样，电容C的充电电压通过晶体管NT15释放。因此，正偏晶体管NT11截止。
接着，供给至控制接线端CT的下一级输出信号被升高至导通电压，使得晶体管NT14导通。此时，因为晶体管NT14的尺寸大于晶体管NT15的尺寸约两倍，所以第三节点N3的电位比单独导通晶体管NT15的状态更快地降低至第一电源电压VSS。
于是，正偏晶体管NT11截止，而反偏晶体管NT12导通，以允许输出接线端OUT从导通电压VON下降至第二电源电压VDD。
虽然供给至控制接线端CT的下一级输出信号下降至低电平以截止晶体管NT14，但是，第四节点N4维持通过晶体管NT16而被偏置至第二电源电压VDD的状态，且第三节点N3允许保持导通状态的晶体管NT15维持被偏置至第一电源电压VSS的状态。由于这种结构，第四节点N4的电位维持第二电源电压VDD，使得在不引发反偏晶体管NT12被截止的故障的情况下，确保稳定的运行。
如上所述，晶体管NT15和晶体管NT17被布置成根据另一实施例的锁存器(latch)形，以能在第三节点N3和第四节点N4维持稳定状态。此外，在与前述一实施例相比时，不仅消除了两个晶体管，还减小了晶体管的尺寸，使得周边区中转换寄存器所占的面积可以减少约10％。
另外，当与一实施例比较时，前述另一实施例使稳定运行成为可能，而不管扫描起始信号ST的脉冲宽度。
更具体地，根据一实施例，当扫描起始信号ST的脉冲宽度比时钟信号的窄时，电容在接收时钟信号之前开始放电。由于此原因，反偏晶体管导通而未产生输出。于是，输出信号未转换至下一级而倾向于导致非工作状态。
然而，在另一实施例中，扫描起始信号ST被闭锁，以使之可以稳定地操作，而不管扫描起始信号ST的脉冲宽度的宽度。
图8示出了根据本发明一实施例的对称型液晶显示装置的显示区和栅极驱动电路的布局图。图9至13示出图8各层的布局图。图8的布局图中的相似部件用与图6所示栅极驱动电路中被表示的那些部件相同的附图标记表示。
栅线驱动晶体管NT1和NT2布置在邻近第一栅极驱动电路108的显示区的部分上，而外部信号线CK、VDD、VSS和ST布置在离该显示区最远的部分上。
控制晶体管NT3、NT4、NT5、NT6、NT7、NT8和NT9布置在布置驱动晶体管和信号线的区域之间。
电容C包括设置在驱动晶体管NT1和NT2之间同时被设置在驱动晶体管NT1的栅电极的栅电极下延伸部分上的下电极、设置在驱动晶体管NT2的漏电极的上延伸部分上的上电极，以及设置在下和上电极之间的栅极绝缘层SiNx。
图9所示的栅极金属构图放置在玻璃基板上。栅极金属构图形成显示区的栅线GL、栅极驱动电路区的各晶体管的栅电极、电容的下电极、信号线和用于互连转换寄存器各级的部分信号线。
栅极金属构图涂覆有诸如SiNx的作为栅极绝缘层的材料。在涂覆的SiNx材料层上，将图10所示的非晶硅物质的有源构图与下构图对准。图10中，有源构图外的用附图标记SP表示的片是为保护与下部栅极构图交叉的源极构图而添加的伪构图。该伪构图协助使表面的下倾变缓，作为上部结构的源极构图在该表面上形成，从而防止上部源极金属线被切割。
图11所示的源极构图在对准图10的有源构图后得以设置。该源极构图形成显示区中数据线和像素电极的接触区、晶体管的源和漏电极、部分信号线和电容上电极。
驱动晶体管的分别成形为梳齿的源和漏电极被形成来交替位于该梳齿的行间，并彼此面对。
驱动晶体管NT1和NT2的这种源-漏电极结构在有限的面积中增加了驱动晶体管的信道宽度，以使能充分确保由非晶硅形成的晶体管的驱动能力。
图12的布局图显示了各构图的接触孔区，该接触孔用于将栅极金属构图和源极构图彼此电连接。在根据本发明的栅极驱动电路区内，形成相互对应的栅极接触区和源极接触区以彼此毗邻。
形成为彼此毗邻的接触对CA和CB借助接触构图CP而彼此电连接，接触构图CP同时还提供有设置给显示区的像素电极构图PE，如图13所示。
也就是说，根据本发明，形成接触孔，以电连接由栅极金属构图和源极构图形成的信号线，并且，接触构图由等同于像素电极构图的导电材料形成，以通过接触孔连接它们。
一般地，像素电极在透光型LCD装置中由ITO透明导电层制造，而在反射型LCD装置中则由金属反射层制造。
于是，在透光型的情形下，透明导电层被设置为接触构图。因为这一事实，优选的是，为了将由接触电阻导致的栅极驱动电路电特性的影响减至最小的目的，将互连接触孔设置成最为接近，而不管是否应用透明导电层，当与金属构图的电导率相比时，此透明接触层具有相对下降的电导率。
另外，优选的是，在接触构图的尺寸上确保充足的边缘，以充分覆盖接触孔，从而防止失准导致的增加的接触电阻或不良接触。
图14是示出根据本发明另一实施例的用双栅极驱动电路包围的对称型液晶显示模块的示意图。
参照图14，根据本发明另一实施例的液晶显示模块包括下基板100和上基板102。下基板100被分成与上基板102重叠的第一区100a和不与之重叠的第二区100b。
第一区100a包括显示区104和周边区106，在用密封材料进行密封前其中注入液晶。分别在显示区104的周边区106的左和右侧上将用于连接显示区104的栅线以及第一和第二栅极驱动电路108a和110a的线形构图彼此对称设置。
第二区100b由数据驱动电路112、第一和第二栅极驱动电路108a和110a，以及与薄膜电缆116的一端连接的外部连接接线端114构成。薄膜电缆116的另一端联接在集成印刷电路板(未示出)上。数据驱动电路112被制造成芯片型以安装到下基板上。
即，上述另一实施例不同于第一实施例的布置，因为第一和第二栅极驱动电路108a和110a被相对于数据驱动电路112对称地设置在数据驱动电路112的左和右侧上。
图15是示出根据本发明再一实施例的用双栅极驱动电路包围的对称型液晶显示模块的示意图。
图15中，LCD模块包括下基板100和上基板102。下基板100被分成与上基板102重叠的第一区100a和不与之重叠的第二区100b。
第一区100a包括显示区104和周边区106。于是，显示区104和周边区106在用密封材料沿其边缘密封前注入液晶。第一和第二栅极驱动电路108b和110b整体形成为被设置在显示区104上的上部周边区106中。分别在显示区104的周边区106的左和右侧上将用于连接第一和第二栅极驱动电路108b和110b以及显示区104的栅线的线形构图放置成彼此对称。
第二区100b由数据驱动电路112，以及与薄膜电缆116的一端连接的外部连接接线端114构成。薄膜电缆116的另一端联接在集成印刷电路板(未示出)上。数据驱动电路112被制造成芯片型以安装到下基板上。
栅极驱动电路108b和110b通过从下部延伸到上部的外部连接接线端114而连接到薄膜电缆116上。
本发明的再一个实施例与第一和第二实施例不同，因为栅极驱动电路被布置在与数据驱动电路相对的区域上，即上部周边区上。
总之，根据本发明的LCD模块分别设置有第一和第二栅极驱动电路，该栅极电路在显示区的周边区的左和右侧上被布置成彼此对称。
在上述的本发明中，栅极驱动电路对称布置在显示区的周边区的左和右侧上，以在左和右侧上构成对称型LCD模块，从而将安装有LCD模块的装置的左和右侧宽度减至最小。
虽然本发明已经参照其具体实施例而得以具体显示和描述，但是，本领域的技术人员将理解到，在不超出所附权利要求规定的本发明的实质和范围的情况下，可在其中实现各种形式和细节的变化。

Claims (14)

1.一种液晶显示装置，包括：
多个像素电极，该像素电极在基板的显示区上以矩阵形式排列，所述像素电极具有像素电极的多个列线和像素电极的多个行线；
多个薄膜晶体管，该薄膜晶体管分别对应所述多个像素电极，每个所述薄膜晶体管具有被连接至所述像素电极的对应像素电极的第一电流电极；
分别布置在所述多个像素电极的奇数列线和偶数列线间的多个数据线，并且该数据线共同连接至相应于所述奇数列线和偶数列线的所述薄膜晶体管的第二电流电极上；
多个第一栅极线，其通过与所述多个像素电极的所述各行线对应而排列，并且共同连接到对应行线的奇数薄膜晶体管的栅电极上；
多个第二栅极线，其通过与所述多个像素电极的所述各行线对应而排列，并且共同连接至对应行线的偶数薄膜晶体管的栅电极上；
驱动所述数据线的数据驱动电路；
排列在所述显示区的第一周边区中用以驱动所述多个第一栅极线的第一栅极驱动电路；以及
排列在相对于所述显示区而与第一周边区相对的所述显示区的第二周边区中用以驱动所述第二栅极线的第二栅极驱动电路，
其特征在于，每个所述第一和第二栅极驱动电路包括多个级，并根据各级的输出信号顺序选择所述多个栅极线，同时，所述第一栅极驱动电路被提供第一时钟信号，而所述第二栅极驱动电路被提供第二时钟信号，该第二时钟信号具有与所述第一时钟信号相反的相位，且每个所述级包括：
与前一栅极线连接的输入接线端；
与相应栅极线连接的输出接线端；
与下一栅极线连接的控制接线端；
接收相应时钟信号的时钟接线端；
正偏装置，连接在所述时钟接线端和输出接线端之间，用以在导通状态下在所述时钟信号的工作周期中正偏所述对应的栅极线；
反偏装置，连接在所述输出接线端和第一电源电压之间，以允许在导通状态下使所述对应的栅极线反偏至所述第一电源电压；
正偏驱动装置，连接到所述正偏装置的输入节点上，用以响应提供给所述输入接线端的输入信号的先端而导通所述正偏装置，或者用以响应提供给所述控制接线端的控制信号的先端而截止所述正偏装置；
反偏驱动装置，连接到所述反偏装置的输入节点上，用以响应所述输入信号的先端而截止所述反偏装置，或者用以响应所述控制信号的先端而导通所述反偏装置；以及
浮置旁路装置，连接在所述反偏装置的所述输入节点和第二电源电压之间，用以恒定地将所述第二电源电压连接至所述反偏装置的所述输入节点上，防止所述反偏装置的所述输入节点被浮置。
2.如权利要求1所述的液晶显示装置，其特征在于，所述第一和第二栅极驱动电路驱动像素电极的所述行线，以响应通过所述第一和第二栅极线接收的变换信号而按之字形扫描。先端先端先端先端
3.如权利要求1所述的液晶显示装置，其特征在于，每个所述级还包括导通旁路装置，此导通旁路装置连接在所述反偏装置的所述输入节点和所述第一电源电压之间，用以将所述第一电源电压连接至所述反偏装置的所述输入节点上，从而防止所述反偏装置的导通。
4.如权利要求3所述的液晶显示装置，其特征在于，所述导通旁路装置包括NMOS晶体管，此晶体管具有连接至所述反偏装置的所述输入节点上的漏极、连接到所述输出接线端的栅极和连接到所述第一电源电压上的源极。
5.如权利要求4所述的液晶显示装置，其特征在于，所述正偏驱动装置包括：
电容，连接到所述正偏装置的所述输入节点和所述输出接线端上；
第一晶体管，具有共同连接到所述输入接线端上的漏极和栅极，以及连接到所述正偏装置的所述输入节点上的源极；
第二晶体管，具有连接到所述正偏装置的所述输入节点上的漏极、连接到所述反偏装置的所述输入节点上的栅极和连接到所述第一电源电压上的源极；以及
第三晶体管，具有连接到所述正偏装置的所述输入节点上的漏极、连接到所述控制接线端上的栅极和连接到所述第一电源电压上的源极。
6.如权利要求5所述的液晶显示装置，其特征在于，所述反偏驱动装置包括：
第四晶体管，具有连接到所述第二电源电压上的漏极、连接到所述控制接线端上的栅极和连接到所述反偏装置的所述输入节点上的源极；以及
第五晶体管，具有连接到所述反偏装置的所述输入节点上的漏极、连接到所述输入接线端上的栅极和连接到所述第一电源电压上的源极。
7.如权利要求6所述的液晶显示装置，其特征在于，所述浮置旁路装置包括第六晶体管，此晶体管具有连接到所述第二电源电压上的漏极和栅极，以及连接到所述反偏装置的所述输入节点上的源极，以此方式所述第六晶体管被形成得尺寸较小于所述第五晶体管的尺寸。
8.如权利要求7所述的液晶显示装置，其特征在于，所述第五晶体管和第六晶体管之间的尺寸比约为20∶1。
9.如权利要求1所述的液晶显示装置，其特征在于，所述显示区的所述薄膜晶体管和所述栅极驱动电路的薄膜晶体管包括非晶硅NMOS薄膜晶体管。
10.一种液晶显示装置，包括：
多个像素电极，该像素电极在基板的显示区上以矩阵形式排列，所述像素电极具有像素电极的多个列线和像素电极的多个行线；
多个薄膜晶体管，该薄膜晶体管分别对应所述多个像素电极，每个所述薄膜晶体管具有被连接至所述像素电极的对应像素电极的第一电流电极；
分别布置在所述多个像素电极的奇数列线和偶数列线间的多个数据线，并且该数据线共同连接至相应于所述奇数列线和偶数列线的所述薄膜晶体管的第二电流电极上；
多个第一栅极线，其通过与所述多个像素电极的所述各行线对应而排列，并且共同连接到对应行线的奇数薄膜晶体管的栅电极上；
多个第二栅极线，其通过与所述多个像素电极的所述各行线对应而排列，并且共同连接至对应行线的偶数薄膜晶体管的栅电极上；
驱动所述数据线的数据驱动电路；
排列在所述显示区的第一周边区中用以驱动所述多个第一栅极线的第一栅极驱动电路；以及
排列在相对于所述显示区而与第一周边区相对的所述显示区的第二周边区中用以驱动所述第二栅极线的第二栅极驱动电路，
其特征在于，所述第一和第二栅极驱动电路包括根据各级的输出信号顺序选择所述多个栅极线的非独立地与多个级连接的转换寄存器，同时，所述第一栅极驱动电路被提供第一时钟信号，而所述第二栅极驱动电路被提供第二时钟信号，该第二时钟信号具有与所述第一时钟信号相反的相位，且每个所述级包括：
与前一栅极线连接的输入接线端；
与相应栅极线连接的输出接线端；
与下一栅极线连接的控制接线端；
接收相应时钟信号的时钟接线端；
正偏装置，用以将所述第一和第二时钟信号间的每个对应时钟信号提供给所述输出接线端；
反偏装置，用以将所述第一电源电压提供给所述输出接线端；
正偏驱动装置，连接到所述正偏装置的输入节点上，用于使电容充电以响应输入信号的先端而导通所述正偏装置，或者用于使所述电容放电以响应下一栅极线的驱动信号的先端而截止所述正偏装置；以及
反偏驱动装置，连接到所述反偏装置的所述输入节点上，用以响应下一栅极线的所述驱动信号的先端而截止所述反偏装置或者导通所述反偏装置。
11.如权利要求10所述的液晶显示装置，其特征在于，所述正偏驱动装置包括：
电容，连接到所述正偏装置的所述输入节点和所述输出接线端上；
第一晶体管，具有与第二电源电压相连的漏极、与所述输入信号相连的栅极和与所述正偏装置的所述输入节点相连的源极；
第二晶体管，具有与所述正偏装置的所述输入节点相连的漏极、与下一栅极线的所述驱动信号相连的栅极和与所述第一电源电压相连的源极；以及
第三晶体管，具有与所述正偏装置的所述输入节点相连的漏极、与所述反偏装置的所述输入节点相连的栅极和与所述第一电源电压相连的源极。
12.如权利要求11所述的液晶显示装置，其特征在于，所述第一晶体管和第三晶体管的尺寸比约为2∶1。
13.如权利要求12所述的液晶显示装置，其特征在于，所述反偏驱动装置包括：
第四晶体管，具有共同连接至所述第二电源电压的漏极和栅极，以及连接至所述反偏装置的所述输入节点的源极；以及
第五晶体管，具有连接至所述反偏装置的所述输入节点的漏极、连接至所述正偏装置的所述输入节点的栅极和连接至所述第一电源电压的源极。
14.如权利要求13所述的液晶显示装置，其特征在于，所述第四晶体管和第五晶体管的尺寸比约为16∶1。
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