CN113257134B - 显示面板及显示装置 - Google Patents

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Abstract

本申请公开了一种显示面板及显示装置，该显示面板的第N个辅助单元位于显示面板的显示区，第N个辅助单元的输出端与第N条扫描线连接，通过位于显示区中的辅助单元与对应的扫描线连接，可以使扫描线中传输的扫描信号的下降沿快速拉低或者扫描信号的上升沿快速拉高，能够缓解显示区中传输延时导致的扫描信号失真问题。

Description

显示面板及显示装置
技术领域
本申请涉及显示技术领域，具体涉及一种显示面板及显示装置。
背景技术
显示装置作为电子设备的显示部件已经广泛应用于各种电子产品中，其中，各种驱动模块作为显示装置的一个重要组成部分，其大多位于显示装置的外围区域，需要通过驱动信号线传输驱动信号至显示装置的显示区。
随着当前显示应用的不断发展，显示面板的外观、尺寸也在不断的突破。越来越多的应用场景对显示面板的需求也越发多样。然而，随着显示面板的尺寸不断扩大，这些驱动信号的传输延时也越来越大，驱动信号的失真也愈发严重，难以保证显示品质。
发明内容
本申请提供一种显示面板及显示装置，以缓解显示区中传输延时导致的扫描信号失真的技术问题。
第一方面，本申请提供一种显示面板，其包括第一走线、第N条扫描线以及第N个辅助单元；第N条扫描线的至少部分位于显示面板的显示区，用于传输第N级扫描信号，N为正整数；第N个辅助单元位于显示面板的显示区，第N个辅助单元的输出端与第N条扫描线电性连接，第N个辅助单元的输入端与第一走线电性连接，第N个辅助单元的控制端与第N+M条扫描线电性连接，M为正整数。
在其中一些实施方式中，第N个辅助单元包括至少一个薄膜晶体管，薄膜晶体管的源极/漏极中的一个与第N条扫描线电性连接，薄膜晶体管的源极/漏极中的另一个与第一走线电性连接，薄膜晶体管的栅极与第N+M条扫描线电性连接。
在其中一些实施方式中，第N条扫描线与多个薄膜晶体管的源极/漏极中的一个电性连接，以在第N条扫描线上构造对应的多个连接节点；第N级扫描信号从第N条扫描线的至少一端输入；其中，若第N级扫描信号从第N条扫描线的一端输入，则多个连接节点在靠近第N条扫描线的另一端的密度，大于多个连接节点在靠近第N条扫描线的一端的密度。
在其中一些实施方式中，若第N级扫描信号从第N条扫描线的两端输入，则多个连接节点在第N条扫描线的中部的密度，大于多个连接节点在靠近第N条扫描线的任一端的密度。
在其中一些实施方式中，若薄膜晶体管为N沟道型薄膜晶体管，第一走线用于传输恒压低电位信号。
在其中一些实施方式中，若薄膜晶体管为N沟道型薄膜晶体管，薄膜晶体管打开时，第一走线用于传输低电位信号。
在其中一些实施方式中，若第N个辅助单元的控制端与第N+1条扫描线电性连接，则第一走线为第N+X条扫描线，X为大于或者等于2的整数；若第N个辅助单元的控制端与第N+2条扫描线连接，第一走线为第N+Y条扫描线，Y为等于1，或者Y为等于或者大于3的整数。
在其中一些实施方式中，若薄膜晶体管为P沟道型薄膜晶体管，第一走线用于传输恒压高电位信号。
在其中一些实施方式中，若薄膜晶体管为P沟道型薄膜晶体管，薄膜晶体管打开时，第一走线用于传输高电位信号。
在其中一些实施方式中，若第N个辅助单元的控制端与第N+1条扫描线电性连接，则第一走线为第N+X条扫描线，X为大于或者等于2的整数；若第N个辅助单元的控制端与第N+2条扫描线连接，第一走线为第N+Y条扫描线，Y为等于1，或者Y为等于或者大于3的整数。
第二方面，本申请提供一种显示装置，其包括上述任一实施方式中的显示面板。
本申请提供的显示面板及显示装置，通过位于显示区中的辅助单元与对应的扫描线连接，可以使扫描线中传输的扫描信号的下降沿快速拉低或者扫描信号的上升沿快速拉高，能够缓解显示区中传输延时导致的扫描信号失真问题。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1为本申请实施例提供的显示面板的第一种结构示意图。
图2为本申请实施例提供的显示面板的第二种结构示意图。
图3为本申请实施例提供的显示面板的第三种结构示意图。
图4为本申请实施例提供的显示面板的第四种结构示意图。
图5为本申请实施例提供的显示面板的第五种结构示意图。
图6为本申请实施例提供的不同驱动信号的一种对比示意图。
图7为本申请实施例提供的不同驱动信号的另一种对比示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
请参阅图1至图7，本实施例提供一种显示面板，其包括第一走线DDL、第N条扫描线以及第N个辅助单元210；第N条扫描线的至少部分位于显示面板的显示区AA，用于传输第N级扫描信号，N为正整数；第N个辅助单元210位于显示面板的显示区AA，第N个辅助单元210的输出端与第N条扫描线电性连接，第N个辅助单元210的输入端与第一走线DDL电性连接，第N个辅助单元210的控制端与第N+M条扫描线电性连接，M为正整数。
可以理解的是，本实施例提供的显示面板，通过位于显示区AA中的辅助单元与对应的扫描线连接，可以使扫描线中传输的扫描信号的下降沿快速拉低或者扫描信号的上升沿快速拉高，能够缓解显示区AA中传输延时导致的扫描信号失真问题。
其中，当M等于1时，第N+M条扫描线可以为第N+1条扫描线。当M等于2时，第N+M条扫描线可以为第N+2条扫描线。
在其中一些实施例中，第N个辅助单元210包括至少一个薄膜晶体管，薄膜晶体管的源极/漏极中的一个与第N条扫描线电性连接，薄膜晶体管的源极/漏极中的另一个与第一走线DDL电性连接，薄膜晶体管的栅极与第N+1条扫描线或者第N+2条扫描线电性连接。
在其中一些实施例中，第N条扫描线与多个薄膜晶体管的源极或者漏极连接，以在第N条扫描线上构造对应的多个连接节点；第N级扫描信号从第N条扫描线的至少一端输入；其中，若第N级扫描信号从第N条扫描线的一端输入，则多个连接节点在靠近第N条扫描线的另一端的密度，大于多个连接节点在靠近第N条扫描线的一端的密度。
在其中一些实施例中，若第N级扫描信号从第N条扫描线的两端输入，则多个连接节点在第N条扫描线的中部的密度，大于多个连接节点在靠近第N条扫描线的任一端的密度。
需要进行说明的是，随着扫描信号在对应的扫描线中传输的距离越远，扫描信号的传输延迟也愈发严重，因此，本实施例在扫描信号传输的末端配置较多的薄膜晶体管，以增加末端区域中扫描信号的下拉作用，能够进一步快速地拉低扫描信号的下降沿。
需要进行说明的是，显示面板还可以包括驱动模块100，该驱动模块100可以为GOA电路或者栅极驱动电路。如果第N级扫描信号从第N条扫描线的一端输入，则该驱动模块100位于显示区AA的一侧。如果第N级扫描信号从第N条扫描线的两端输入，则其中一个驱动模块100位于显示区AA的一侧，同时，其中另一个驱动模块100位于显示区AA的另一侧。
在其中一些实施例中，若薄膜晶体管为N沟道型薄膜晶体管，第一走线DDL用于传输恒压低电位信号。
可以理解的是，在本实施例中，可以采用恒压低电位信号去对应拉低扫描信号的下降沿，由于采用了恒压低电位信号，其低电位具有恒定保持作用，对扫描信号的下降沿可以具有更好的下拉作用。
在其中一些实施例中，若薄膜晶体管为N沟道型薄膜晶体管，薄膜晶体管打开时，第一走线DDL用于传输低电位信号。
可以理解的是，在本实施例中，第一走线DDL也可以用于传输脉冲信号，当N沟道型薄膜晶体管打开时，脉冲信号处于低电位状态。同理可以拉低扫描信号的下降沿。
在其中一些实施例中，若第N个辅助单元210的控制端与第N+1条扫描线电性连接，则第一走线DDL为第N+X条扫描线，X为大于或者等于2的整数；若第N个辅助单元210的控制端与第N+2条扫描线连接，第一走线DDL为第N+Y条扫描线，Y为等于1，或者Y为等于或者大于3的整数。
在其中一些实施例中，第一走线DDL的至少部分位于显示区AA。
在其中一些实施例中，若薄膜晶体管为P沟道型薄膜晶体管，第一走线DDL用于传输恒压高电位信号。
可以理解的是，在本实施例中，可以采用恒压高电位信号去对应拉高扫描信号的上升沿，由于采用了恒压高电位信号，其高电位具有恒定保持作用，对扫描信号的上升沿可以具有更好的上拉作用。
在其中一些实施例中，若薄膜晶体管为P沟道型薄膜晶体管，薄膜晶体管打开时，第一走线DDL用于传输高电位信号。
可以理解的是，在本实施例中，第一走线DDL也可以用于传输脉冲信号，当P沟道型薄膜晶体管打开时，脉冲信号处于高电位状态。同理可以拉高扫描信号的上升沿。
在其中一些实施例中，本实施例提供一种显示装置，其包括上述任一实施例中的显示面板。
可以理解的是，本实施例提供的显示装置，通过位于显示区AA中的辅助单元与对应的扫描线连接，可以使扫描线中传输的扫描信号的下降沿快速拉低或者扫描信号的上升沿快速拉高，能够缓解显示区AA中传输延时导致的扫描信号失真问题。
如图1所示，本实施例提供了一种显示面板，显示面板还包括驱动模块100、多条驱动线SL以及辅助模块200；驱动模块100位于显示面板的非显示区，驱动模块100包括多个级联的驱动单元，其中，第N级驱动单元110用于输出第N级驱动信号G(N)；驱动线SL位于显示面板的显示区AA，其中，第N条驱动线与第N级驱动单元110的输出端连接；辅助模块200位于显示区AA，辅助模块200包括多个辅助单元，其中，第N个辅助单元210的输出端与第N条驱动线连接，以拉低第N级驱动信号G(N)的下降沿或者拉高第N级驱动信号G(N)的上升沿。
可以理解的是，本实施例提供的显示面板，通过位于显示区AA中的辅助模块200与对应的驱动线SL连接，可以使驱动线SL中传输的驱动信号的下降沿快速拉低或者驱动信号的上升沿快速拉高，能够缓解非显示区中驱动模块100传输驱动信号至显示区AA时存在的驱动信号失真问题。
需要进行说明的是，在该显示面板中，非显示区位于显示区AA的外围，非显示区可以包括第一非显示子区NA1、第二非显示子区NA2、第三非显示子区NA3以及第四非显示子区NA4。当正面俯视该显示面板时，第一非显示子区NA1可以位于显示区AA的上侧，第二非显示子区NA2可以位于显示区AA的下侧，第三非显示子区NA3可以位于显示区AA的左侧，第四非显示子区NA4可以位于显示区AA的右侧。
其中，该显示面板还可以包括源极驱动器300和多条数据线DL，源极驱动器300与多条数据线DL电性连接。该源极驱动器300位于第二非显示子区NA2，数据线DL可以从第二非显示子区NA2延伸至显示区AA。其中，该源极驱动器300可以为源极驱动集成电路，用于输出对应的数据信号。
其中，该显示面板可以包括一个或者多个驱动模块100，当该显示面板包括一个驱动模块100时，该驱动模块100可以位于第三非显示子区NA3或者第四非显示子区NA4。当该显示面板包括两个驱动模块100时，其中一个驱动模块100可以位于第三非显示子区NA3和第四非显示子区NA4中的一个，其中另一个驱动模块100可以位于第三非显示子区NA3和第四非显示子区NA4中的另一个。
在其中一个实施例中，一条驱动线SL可以与一个或者多个驱动单元电性连接，例如，一条驱动线SL可以与两个驱动单元电性连接，该两个驱动单元可以为不同驱动模块中的驱动单元。
在其中一个实施例中，一个驱动单元可以与一条或者多条驱动线SL电性连接，例如，一个驱动单元可以但不限于与两条驱动线SL电性连接，一个驱动单元还可以与四条驱动线SL电性连接。对应地，该驱动单元可以为驱动模块100中一个驱动单元，一条驱动线SL可以为一条扫描线。
可以理解的是，级联的每个驱动单元可以输出频率相同且相位不同的驱动信号，例如，第N级驱动信号G(N)的下降沿与第N+1级驱动信号G(N+1)的上升沿同步，或者第N+1级驱动信号G(N+1)的上升沿略微滞后于第N级驱动信号G(N)的下降沿。其中，N可以为正整数。或者，第N级驱动信号G(N)的上升沿与第N+1级驱动信号G(N+1)的下降沿同步，或者第N+1级驱动信号G(N+1)的下降沿沿略微滞后于第N级驱动信号G(N)的上升沿。其中，N可以为正整数。
在其中一个实施例中，该驱动模块100可以但不限于为GOA(Gate Driver OnArray，集成在阵列基板上的行扫描技术)电路，对应地，驱动单元可以为GOA单元，驱动线SL可以为扫描线，驱动信号可以扫描信号，用于控制数据信号的写入与否。
在其中一个实施例中，该驱动模块100还可以为发光控制电路，对应地，驱动单元可以为发光控制单元，驱动线SL可以为发光控制信号线，驱动信号可以发光控制信号，用于控制发光器件的发光与否。
如图2所示，在其中一个实施例中，驱动模块100可以包括第N级驱动单元110、第N+1级驱动单元120以及第N+2级驱动单元130；第N级驱动单元110用于输出第N级驱动信号G(N)，第N级驱动单元110的输出端与第N条驱动线连接；第N+1级驱动单元120用于输出第N+1级驱动信号G(N+1)，第N+1级驱动单元120的输出端与第N+1条驱动线连接；第N+2级驱动单元130用于输出第N+2级驱动信号G(N+2)，第N+2级驱动单元130的输出端与第N+2条驱动线连接。
其中，第N个辅助单元210的输出端与第N条驱动线电性连接。第N+1个辅助单元220的输出端与第N+1条驱动线电性连接。
其中，第N个辅助单元210的控制端与第N+1条驱动线连接；第N级驱动信号G(N)的下降沿与第N+1级驱动信号G(N+1)的上升沿位于同一时刻，或者，第N+1级驱动信号G(N+1)的上升沿滞后于第N级驱动信号G(N)的下降沿。第N+1个辅助单元220的控制端与第N+2条驱动线连接；第N+1级驱动信号G(N+1)的下降沿与第N+2级驱动信号G(N+2)的上升沿位于同一时刻，或者，第N+2级驱动信号G(N+2)的上升沿滞后于第N+1级驱动信号G(N+1)的下降沿。
该显示面板还可以包括第一走线DDL，该第一走线DDL与第N个辅助单元210的输入端和/或第N+1个辅助单元220的输入端连接。可以理解的是，该第一走线DDL中可以传输低电位信号，该低电位信号至少存在部分的低电位状态。
如图3所示，在其中一个实施例中，驱动模块100可以包括第N级驱动单元110、第N+1级驱动单元120、第N+2级驱动单元130、第N+3级驱动单元140以及第N+4级驱动单元150。第N级驱动单元110用于输出第N级驱动信号G(N)，第N级驱动单元110的输出端与第N条驱动线连接。第N+1级驱动单元120用于输出第N+1级驱动信号G(N+1)，第N+1级驱动单元120的输出端与第N+1条驱动线连接。第N+2级驱动单元130用于输出第N+2级驱动信号G(N+2)，第N+2级驱动单元130的输出端与第N+2条驱动线连接。第N+3级驱动单元140用于输出第N+3级驱动信号G(N+3)，第N+3级驱动单元140的输出端与第N+3条驱动线连接。第N+4级驱动单元150用于输出第N+4级驱动信号G(N+4)，第N+4级驱动单元150的输出端与第N+4条驱动线连接。
其中，第N个辅助单元210的输出端与第N条驱动线电性连接。第N+1个辅助单元220的输出端与第N+1条驱动线电性连接。第N+2个辅助单元230的输出端与第N+2条驱动线电性连接。第N+3个辅助单元240的输出端与第N+3条驱动线电性连接。
其中，第N个辅助单元210的控制端与第N+2条驱动线连接；第N级驱动信号G(N)的下降沿与第N+2级驱动信号G(N+2)的上升沿位于同一时刻，或者，第N+2级驱动信号G(N+2)的上升沿滞后于第N级驱动信号G(N)的下降沿。第N+1个辅助单元220的控制端与第N+3条驱动线连接；第N+1级驱动信号G(N+1)的下降沿与第N+3级驱动信号G(N+3)的上升沿位于同一时刻，或者，第N+3级驱动信号G(N+3)的上升沿滞后于第N+1级驱动信号G(N+1)的下降沿。第N+2个辅助单元230的控制端与第N+4条驱动线连接；第N+2级驱动信号G(N+2)的下降沿与第N+4级驱动信号G(N+4)的上升沿位于同一时刻，或者，第N+4级驱动信号G(N+4)的上升沿滞后于第N+2级驱动信号G(N+2)的下降沿。第N+3个辅助单元240的控制端与第N+5条驱动线连接；第N+3级驱动信号G(N+3)的下降沿与第N+5级驱动信号的上升沿位于同一时刻，或者，第N+5级驱动信号的上升沿滞后于第N+3级驱动信号G(N+3)的下降沿。第一走线DDL与第N个辅助单元210的输入端、第N+1个辅助单元220的输入端、第N+2个辅助单元230的输入端以及第N+3个辅助单元240的输入端连接。该第一走线DDL中可以传输低电位信号，该低电位信号至少存在部分的低电位状态。
如图4所示，在其中一个实施例中，驱动模块100可以包括第N级驱动单元110、第N+1级驱动单元120、第N+2级驱动单元130、第N+3级驱动单元140以及第N+4级驱动单元150。第N级驱动单元110用于输出第N级驱动信号G(N)，第N级驱动单元110的输出端与第N条驱动线连接。第N+1级驱动单元120用于输出第N+1级驱动信号G(N+1)，第N+1级驱动单元120的输出端与第N+1条驱动线连接。第N+2级驱动单元130用于输出第N+2级驱动信号G(N+2)，第N+2级驱动单元130的输出端与第N+2条驱动线连接。第N+3级驱动单元140用于输出第N+3级驱动信号G(N+3)，第N+3级驱动单元140的输出端与第N+3条驱动线连接。第N+4级驱动单元150用于输出第N+4级驱动信号G(N+4)，第N+4级驱动单元150的输出端与第N+4条驱动线连接。
其中，第N个辅助单元210的输出端与第N条驱动线电性连接。第N+1个辅助单元220的输出端与第N+1条驱动线电性连接。第N+2个辅助单元230的输出端与第N+2条驱动线电性连接。第N+3个辅助单元240的输出端与第N+3条驱动线电性连接。
其中，第N个辅助单元210的控制端与第N+1条驱动线连接；第N级驱动信号G(N)的下降沿与第N+1级驱动信号G(N+1)的上升沿位于同一时刻，或者，第N+1级驱动信号G(N+1)的上升沿滞后于第N级驱动信号G(N)的下降沿。第N+1个辅助单元220的控制端与第N+2条驱动线连接；第N+1级驱动信号G(N+1)的下降沿与第N+2级驱动信号G(N+2)的上升沿位于同一时刻，或者，第N+2级驱动信号G(N+2)的上升沿滞后于第N+1级驱动信号G(N+1)的下降沿。第N+2个辅助单元230的控制端与第N+3条驱动线连接；第N+2级驱动信号G(N+2)的下降沿与第N+3级驱动信号G(N+3)的上升沿位于同一时刻，或者，第N+3级驱动信号G(N+3)的上升沿滞后于第N+2级驱动信号G(N+2)的下降沿。第N+3个辅助单元240的控制端与第N+4条驱动线连接；第N+3级驱动信号G(N+3)的下降沿与第N+4级驱动信号G(N+4)的上升沿位于同一时刻，或者，第N+4级驱动信号G(N+4)的上升沿滞后于第N+3级驱动信号G(N+3)的下降沿。
第N个辅助单元210的输入端与第N+2条驱动线连接。第N+1个辅助单元220的输入端与第N+3条驱动线连接。第N+2个辅助单元230的输入端与第N+4条驱动线连接。第N+3个辅助单元240的输入端与第N+5条驱动线连接。
如图5所示，在其中一个实施例中，驱动模块100可以包括第N级驱动单元110、第N+1级驱动单元120以及第N+2级驱动单元130；第N级驱动单元110用于输出第N级驱动信号G(N)，第N级驱动单元110的输出端与第N条驱动线连接；第N+1级驱动单元120用于输出第N+1级驱动信号G(N+1)，第N+1级驱动单元120的输出端与第N+1条驱动线连接；第N+2级驱动单元130用于输出第N+2级驱动信号G(N+2)，第N+2级驱动单元130的输出端与第N+2条驱动线连接。
其中，第N-1个辅助单元209的输出端与第N-1条驱动线电性连接。第N个辅助单元210的输出端与第N条驱动线电性连接。第N+1个辅助单元220的输出端与第N+1条驱动线电性连接。
其中，第N-1个辅助单元209的控制端与第N条驱动线连接；第N-1级驱动信号的下降沿与第N级驱动信号G(N)的上升沿位于同一时刻，或者，第N级驱动信号G(N)的上升沿滞后于第N-1级驱动信号的下降沿。第N个辅助单元210的控制端与第N+1条驱动线连接；第N级驱动信号G(N)的下降沿与第N+1级驱动信号G(N+1)的上升沿位于同一时刻，或者，第N+1级驱动信号G(N+1)的上升沿滞后于第N级驱动信号G(N)的下降沿。第N+1个辅助单元220的控制端与第N+2条驱动线连接；第N+1级驱动信号G(N+1)的下降沿与第N+2级驱动信号G(N+2)的上升沿位于同一时刻，或者，第N+2级驱动信号G(N+2)的上升沿滞后于第N+1级驱动信号G(N+1)的下降沿。
在本实施例中，第一走线DDL可以为恒压低电位线VGL，该恒压低电位线VGL用于接入恒压低电位信号。该恒压低电位线VGL与第N-1个辅助单元209的输入端、第N个辅助单元210的输入端以及第N+1个辅助单元220的输入端。
其中，第N-1个辅助单元209可以包括第一晶体管T1和第二晶体管T2；恒压低电位线VGL与第一晶体管T1的源极/漏极中的一个和第二晶体管T2的源极/漏极中的一个连接；第N条驱动线与第一晶体管T1的栅极和第二晶体管T2的栅极连接；第N-1条驱动线与第一晶体管T1的源极/漏极中的另一个和第二晶体管T2的源极/漏极中的另一个连接。
其中，第N+1个辅助单元220可以包括第五晶体管T5和第六晶体管T6；恒压低电位线VGL与第五晶体管T5的源极/漏极中的一个和第六晶体管T6的源极/漏极中的一个连接；第N+2条驱动线与第五晶体管T5的栅极和第六晶体管T6的栅极连接；第N+1条驱动线与第五晶体管T5的源极/漏极中的另一个和第六晶体管T6的源极/漏极中的另一个连接。
可以理解的是，在该实施例中，一个辅助单元可以包括两个晶体管或者多个晶体管，该多个晶体管可以为三个晶体管、四个晶体管、五个晶体管或者六个晶体管中的一种，该两个晶体管或者多个晶体管可以为薄膜晶体管，便于制作与阵列基板上的显示区AA。其中，该薄膜晶体管可以但不限于为N沟道型薄膜晶体管，也可以为P沟道型薄膜晶体管。
如图5所示，在其中一个实施例中，辅助模块200可以包括一个或者多个第N个辅助单元210，多个第N个辅助单元210可以为两个第N个辅助单元210、三个第N个辅助单元210、四个第N个辅助单元210或者五个第N个辅助单元210中的一种。其中，每个第N个辅助单元210可以包括一个或者多个薄膜晶体管。例如，当多个第N个辅助单元210为两个第N个辅助单元210时，其中一个第N个辅助单元210可以包括第三晶体管T3，其中另一个第N个辅助单元210可以包括第四晶体管T4。恒压低电位线VGL与第三晶体管T3的源极/漏极中的一个和第四晶体管T4的源极/漏极中的一个连接；第N+1条驱动线与第三晶体管T3的栅极和第四晶体管T4的栅极连接；第N条驱动线与第三晶体管T3的源极/漏极中的另一个和第四晶体管T4的源极/漏极中的另一个连接。
在其中一个实施例中，第一走线DDL可以为第N+1条驱动线和第N+2条驱动线中的至少一个；当第N个辅助单元210的控制端与第N+1条驱动线连接时，第N个辅助单元210的输入端与第N+2条驱动线连接；或者，当第N个辅助单元210的控制端与第N+2条驱动线连接时，第N个辅助单元210的输入端与第N+1条驱动线连接。
在其中一个实施例中，第N个辅助单元210包括至少一个薄膜晶体管；至少一个薄膜晶体管的源极/漏极中的一个与第N条驱动线连接。
在其中一个实施例中，至少一个薄膜晶体管的栅极与第N+1条驱动线或者第N+2条驱动线连接。
在其中一个实施例中，显示面板还包括至少一条第一走线DDL；第一走线DDL与至少一个薄膜晶体管的源极/漏极中的另一个连接；其中，第一走线DDL用于接入恒压低电位信号。
在其中一个实施例中，至少一条第一走线DDL中的任一第一走线DDL至少部分位于显示区AA。
在其中一个实施例中，第N个辅助单元210包括第一薄膜晶体管和第二薄膜晶体管；第N条驱动线与第一薄膜晶体管的源极/漏极中的一个连接以在第N条驱动线上构造第一连接节点；第N条驱动线与第二薄膜晶体管的源极/漏极中的一个连接以在第N条驱动线上构造第二连接节点；第N条驱动线的一端至第一连接节点的距离、第一连接节点至第二连接节点的距离以及第二连接节点至第N条驱动线的另一端的距离中的至少两个是相等或者近似相等的。
需要进行说明的是，在同一个和/或不同的第N个辅助单元210中的所有薄膜晶体管在第N条驱动线构造出来的不同连接节点，相邻两个连接节点之间的距离可以相等或者近似相等，同时，第N条驱动线的一端至与其相邻的连接节点之间的距离也可以等于或者近似等于相邻两个连接节点之间的距离，以及第N条驱动线的另一端至与其相邻的连接节点之间的距离也可以等于或者近似等于相邻两个连接节点之间的距离。
需要进行说明的是，第N条驱动线的一端可以但不限于为第N级驱动单元的输出端，也可以为第N条驱动线位于其中一个非显示区与显示区的交界处的一个点；第N条驱动线的另一端可以为其中另一个非显示区与显示区的交界处的一个点。
可以理解的是，如此可以等距离同时拉低第N级驱动信号的下降沿，能够更快速且均匀地拉低第N级驱动信号的下降沿。
可以理解的是，随着显示面板的长度或者宽度的增加，对应的驱动线SL也会随之增长，对应的驱动信号在驱动线SL中传输也会受到越来越大的容抗和/或阻抗，那么驱动信号的波形也会产生对应的延迟，例如，驱动信号的下降沿会从某一时刻延长至某一时间段，对应地，下降沿也将从直线状态改变为曲线状态，进而致使驱动信号的下降沿不能够快速下拉，基于此，有必要通过不同下降沿的对比，可以更为明了本申请不同的实施例所带来的技术改进。
如图6所示，图6展示出了驱动信号的理想型波形图P1、传统型波形图P2以及本申请不同实施例改进型波形图P3，在理想型波形图P1、传统型波形图P2以及改进型波形图P3中，分别提供了第N级驱动信号G(N)、第N+1级驱动信号G(N+1)以及第N+2级驱动信号G(N+2)的波形图。
在理想型波形图P1中，第N级驱动信号G(N)、第N+1级驱动信号G(N+1)以及第N+2级驱动信号G(N+2)的上升沿或者下降沿均是直线状态，或者均是在同一时刻进行的上升或者下降，这种波形是显示面板所需的理想型波形，但是受限于容抗和/或阻抗的影响，总是会存在一定的延时。
例如，传统型波形图P2与改进型波形图P3的对比可知，传统型波形图P2中第N级驱动信号G(N)、第N+1级驱动信号G(N+1)以及第N+2级驱动信号G(N+2)的下降沿比改进型波形图P3中对应的第N级驱动信号G(N)、第N+1级驱动信号G(N+1)以及第N+2级驱动信号G(N+2)的下降沿经历了更长时间后才得以下拉至低电位。换句话说，上述实施例可以使得驱动信号的下降沿快速拉低，已改善驱动信号在显示区AA中受到容抗和/或阻抗导致的延迟。
可以理解的是，虽然对应的驱动单元中也可能存在对应的下拉电路，但是由于对应的下拉电路所在的驱动单元位于非显示区，所以这种具有下拉电路的驱动单元甚至驱动模块100也不可能达到与上述实施例相同的技术效果，而且本领域所属的技术人员普遍认为这些驱动模块100应该位于非显示区，因此，通常情况下，本领域所属的技术人员不容易想到可以将本实施例中的辅助模块200设置在显示区AA，且可以取得意料不到的技术效果。因此，本申请的发明构思在一定程度上克服了本领域长期以来形成的技术偏见，并且可以明显改善驱动信号的下降沿在显示区AA中的下拉速度或者驱动信号的上升沿在显示区AA中的上拉速度。
如图7所示，本申请提供了另一种驱动信号的波形对比示意图，其中，驱动信号S1为传统技术方案中的驱动信号，驱动信号S2为上述实施例中的驱动信号，驱动信号S3为较为理想状态的驱动信号；横轴可以表示为时间T，其单位可以为微秒(μs)，纵轴可以表示电压值U，其单位可以为伏特(V)。
其中，驱动信号S3的上升沿的上升速度明显高于驱动信号S1的上升沿的上升速度和驱动信号S2的上升沿的上升速度，而驱动信号S1的上升沿的上升速度与驱动信号S2的上升沿的上升速度相近或者近似。驱动信号S3的下降沿的下降速度明显高于驱动信号S1的下降沿的下降速度和驱动信号S2的下降沿的下降速度；而驱动信号S1的下降沿的下降速度明显低于驱动信号S2的下降沿的下降速度；同时，在一些可能的情况下，驱动信号S1的低电位状态由于未收到辅助模块200的持续下拉作用，会容易出现一些比低电位状态稍高的一些电位状态，这会更加重驱动信号S1的波形恶化，进而影响显示面板的稳定性。
在其中一个实施例中，本实施例提供一种显示装置，其包括上述任一实施例中的显示面板。
可以理解的是，本实施例提供的显示装置，通过位于显示区中的辅助模块与对应的驱动线连接，可以使驱动线中传输的驱动信号的下降沿快速拉低，能够缓解非显示区中驱动模块传输驱动信号至显示区时存在的驱动信号失真问题。
需要进行说明的是，该显示装置还可以包括像素电路，该像素电路位于该显示装置的显示区，且该像素电路通过驱动线与驱动模块电性连接。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述的部分，可以参见其他实施例的相关描述。
以上对本申请实施例所提供的显示面板及显示装置进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想；本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。

Claims (11)

1.一种显示面板，其特征在于，包括：
第一走线；
第N条扫描线，所述第N条扫描线的至少部分位于所述显示面板的显示区，用于传输第N级扫描信号，N为正整数；以及
第N个辅助单元，所述第N个辅助单元位于所述显示面板的显示区，所述第N个辅助单元的输出端与所述第N条扫描线电性连接以在所述第N条扫描线上构造对应的多个连接节点，所述第N个辅助单元的输入端与所述第一走线电性连接，所述第N个辅助单元的控制端与第N+M条扫描线电性连接，M为正整数，用于快速拉低所述第N级扫描信号的下降沿或者快速拉高所述第N级扫描信号的上升沿；
其中，若所述第N级扫描信号从所述第N条扫描线的一端输入，则所述多个连接节点在靠近所述第N条扫描线的另一端的密度，大于所述多个连接节点在靠近所述第N条扫描线的一端的密度。
2.根据权利要求1所述的显示面板，其特征在于，所述第N个辅助单元包括：
至少一个薄膜晶体管，所述薄膜晶体管的源极/漏极中的一个与所述第N条扫描线电性连接，所述薄膜晶体管的源极/漏极中的另一个与所述第一走线电性连接，所述薄膜晶体管的栅极与所述第N+M条扫描线电性连接。
3.根据权利要求2所述的显示面板，其特征在于，所述第N条扫描线与多个所述薄膜晶体管的源极/漏极中的一个电性连接，以在所述第N条扫描线上构造对应的多个连接节点；所述第N级扫描信号从所述第N条扫描线的至少一端输入。
4.根据权利要求3所述的显示面板，其特征在于，若所述第N级扫描信号从所述第N条扫描线的两端输入，则所述多个连接节点在所述第N条扫描线的中部的密度，大于所述多个连接节点在靠近所述第N条扫描线的任一端的密度。
5.根据权利要求2所述的显示面板，其特征在于，若所述薄膜晶体管为N沟道型薄膜晶体管，所述第一走线用于传输恒压低电位信号。
6.根据权利要求2所述的显示面板，其特征在于，若所述薄膜晶体管为N沟道型薄膜晶体管，所述薄膜晶体管打开时，所述第一走线用于传输低电位信号。
7.根据权利要求6所述的显示面板，其特征在于，若所述第N个辅助单元的控制端与第N+1条扫描线电性连接，则所述第一走线为第N+X条扫描线，X为大于或者等于2的整数；
若所述第N个辅助单元的控制端与第N+2条扫描线连接，所述第一走线为第N+Y条扫描线，Y为等于1，或者Y为等于或者大于3的整数。
8.根据权利要求2所述的显示面板，其特征在于，若所述薄膜晶体管为P沟道型薄膜晶体管，所述第一走线用于传输恒压高电位信号。
9.根据权利要求2所述的显示面板，其特征在于，若所述薄膜晶体管为P沟道型薄膜晶体管，所述薄膜晶体管打开时，所述第一走线用于传输高电位信号。
10.根据权利要求9所述的显示面板，其特征在于，若所述第N个辅助单元的控制端与第N+1条扫描线电性连接，则所述第一走线为第N+X条扫描线，X为大于或者等于2的整数；
若所述第N个辅助单元的控制端与第N+2条扫描线连接，所述第一走线为第N+Y条扫描线，Y为等于1，或者Y为等于或者大于3的整数。
11.一种显示装置，其特征在于，包括如权利要求1至10任一项所述的显示面板。
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