CN108320717B - 一种goa驱动电路及其制备的液晶显示面板 - Google Patents

一种goa驱动电路及其制备的液晶显示面板 Download PDF

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Abstract

本发明提供一种GOA驱动电路及其制备的液晶显示面板，通过设置两条直流低电压走线，并增设TFT器件，使该TFT器件的栅极连接至第一直流低电压信号，源极接入第二直流低电压信号，漏极连接至第一节点。并在关机瞬间使第N‑1级GOA单元的时钟触发信号电位由最初的低频交流信号缓慢拉高至零电位，所述第二直流低电压信号电位由最初的低电位缓慢拉高至零电位。以实现关机时GOA电路和像素电极的有效放电，改善液晶面板的可靠性和稳定性。

Description

一种GOA驱动电路及其制备的液晶显示面板
技术领域
本发明涉及液晶显示领域，尤其涉及一种GOA驱动电路及其制备的液晶显示面板。
背景技术
GOA(Gate Driver on Array)的基本概念是将TFT LCD的栅极驱动电路集成在玻璃基板上，形成对液晶面板的扫描驱动。GOA相比传统的利用COF的驱动技术可以大幅度节约制造成本，而且省去了Gate侧COF的Bonging制程，对产能提升也是极为有利的。
为了实现液晶面板关机快速放电，现有常用手段是使液晶面板中的全部GOA信号(时钟信号、时钟触发信号、低电平信号、高电平信号)拉高以实现像素的快速放电。当上述信号全部被拉高时，液晶面板中的全部栅极信号被拉至高电位，此时，像素中TFT的栅极处于高电位，像素电极可以实现快速放电功能，在上述关机电位设置情况下，像素电极是可以实现有效放电的，但是由于所有GOA信号均被拉至高电位，各级Q点也同样处于高电位，当进行快速开、关机动作时，在下一次开机时，由于多级Q点处于高电位，导致上拉单元中与Q点耦接并电性连接时钟信号且用于生成扫描信号的多级薄膜晶体管被打开，由此将有可能引发时钟信号的大电流现象，触发OCP(over current protect)，导致画面异常的现象。
发明内容
本发明提供一种GOA驱动电路及其制备的液晶显示面板，能够实现关机时GOA驱动电路和像素电极的有效放电，改善液晶面板的可靠性和稳定性，从而避免触发OCP导致画面异常的现象。
为解决上述问题，本发明提供的技术方案如下：
本发明提供一种GOA驱动电路，应用于显示面板中，包括：
至少两个相互级联的GOA单元，其中第N级GOA单元包括：上拉单元、上拉控制单元、下传单元、下拉单元、下拉维持单元、辅助单元以及自举电容单元；其中，
所述上拉控制单元，耦接第一节点并电性连接于第N-1级GOA单元的扫描信号以及第N-1级GOA单元的时钟触发信号，用于根据所述第N-1级GOA单元的扫描信号以及所述第N-1级GOA单元的时钟触发信号生成第一节点控制信号；
所述自举电容单元，用于存储所述第一节点控制信号的电位；
所述上拉单元，耦接所述第一节点并电性连接时钟信号，用于根据所述第一节点控制信号和所述时钟信号生成第N级GOA单元的扫描信号；
所述下传单元，耦接所述第一节点并电性连接所述时钟信号，用于根据所述第一节点控制信号与所述时钟信号生成第N级GOA单元的时钟触发信号；
所述下拉单元，耦接所述第一节点并电性连接所述第N级GOA单元的扫描信号，用于拉低所述第一节点控制信号的电位，以及拉低所述第N级GOA单元的扫描信号的电位；
所述下拉维持单元，耦接所述第一节点并电性连接所述第N级GOA单元的扫描信号，用于维持所述第一节点控制信号的电位，以及维持所述第N级GOA单元的扫描信号的电位；
所述辅助单元，耦接所述第一节点并电性连接第一直流低电压信号和第二直流低电压信号，用于在所述显示面板关机的瞬间，根据所述第一直流低电压信号和所述第二直流低电压信号拉低所述第一节点控制信号的电位。
根据本发明一优选实施例，所述上拉控制单元包括第一薄膜晶体管；
所述第一薄膜晶体管的栅极接入所述第N-1级GOA单元的时钟触发信号，源极接入所述第N-1级GOA单元的扫描信号，漏极与所述第一节点连接。
根据本发明一优选实施例，所述上拉单元包括第二薄膜晶体管；
所述第二薄膜晶体管的栅极与所述第一节点连接，源极接入所述时钟信号，漏极与所述第N级GOA单元的扫描信号的输出端连接。
根据本发明一优选实施例，所述下传单元包括第三薄膜晶体管；
所述第三薄膜晶体管的栅极与所述第一节点连接，源极接入所述时钟信号，漏极与所述第N级GOA单元的时钟触发信号的输出端连接。
根据本发明一优选实施例，所述下拉单元包括：第四薄膜晶体管、第五薄膜晶体管；
所述第四薄膜晶体管的栅极接入所述第N+1级GOA单元的扫描信号，源极接入所述第一直流低电压信号，漏极与所述第N级GOA单元的扫描信号的输出端连接；
所述第五薄膜晶体管的栅极接入所述第N+1级GOA单元的扫描信号，源极接入所述第二直流低电压信号，漏极与所述第一节点连接。
根据本发明一优选实施例，所述下拉维持单元包括：第六薄膜晶体管、第七薄膜晶体管、第八薄膜晶体管、第九薄膜晶体管、第十薄膜晶体管、第十一薄膜晶体管；
所述第六薄膜晶体管的栅极与源极均接入直流高电压信号，漏极与所述第七薄膜晶体管的漏极以及所述第八薄膜晶体管的栅极连接；
所述第七薄膜晶体管的栅极与所述第一节点和所述第九薄膜晶体管的栅极连接，源极接入所述第一直流低电压信号；
所述第八薄膜晶体管的源极接入所述直流高电压信号，漏极与所述第九薄膜晶体管的漏极、所述第十薄膜晶体管的栅极以及所述第十一薄膜晶体管的栅极连接；
所述第九薄膜晶体管源极接入所述第一直流低电压信号；
所述第十薄膜晶体管的源极接入所述第一直流低电压信号，漏接与所述第N级GOA单元的扫描信号的输出端连接；
所述第十一薄膜晶体管的源极接入所述第二直流低电压信号，漏极与所述第一节点连接。
根据本发明一优选实施例，所述辅助单元包括第十二薄膜晶体管；
所述第十二薄膜晶体管的栅极接入所述第一直流低电压信号，源极接入所述第二直流低电压信号，漏极与所述第一节点连接。
根据本发明一优选实施例，所述自举电容单元包括自举电容；
所述自举电容的的一端与所述第一节点连接，另一端与所述第N级GOA单元的扫描信号的输出端连接。
根据本发明一优选实施例，所述第一直流低电压信号的电位大于所述第二直流低电压信号的电位，且在所述显示面板关机的瞬间，所述第一直流低电压信号的电位被拉至高电位后缓慢降低至零电位，所述第N-1级GOA单元的时钟触发信号由最初的高电位缓慢降低至零电位。
本发明还提供一种采用以上所述的GOA驱动电路制备的液晶显示面板。
本发明的有益效果为：相较于现有液晶显示面板的GOA驱动电路，本发明的GOA驱动电路及其制备的液晶显示面板，通过将直流低电压信号由一条走线拆分为两条走线，并通过在GOA驱动电路中增设TFT来辅助拉低第一节点电位，同时在所述显示面板关机的瞬间，设计所述时钟信号、所述时钟触发信号、所述直流低电压信号、所述第一直流低电压信号以及所述第二直流低电压信号的电位变化，在关机动作的瞬间将所有第一节点拉至低电位，相比级传结构有利于提高响应速度，避免在下一次开机时，触发OCP而导致画面异常的现象。实现关机时GOA电路和像素电极的有效放电，改善液晶面板的可靠性和稳定性。
附图说明
为了更清楚地说明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单介绍，显而易见地，下面描述中的附图仅仅是发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的GOA电路的电路图；
图2为本发明实施例提供的GOA电路的时序图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
下面结合附图详细介绍本发明具体实施例提供的GOA驱动电路。
参阅图1，图1为本发明实施例提供的GOA电路的电路图。如图1所示，本发明实施例提供一种GOA电路，包括至少两个相互级联的GOA单元，其中第N级GOA单元包括：上拉控制单元1、上拉单元2、下传单元3、下拉单元4、下拉维持单元5、自举电容单元6以及辅助单元7。所述第N级GOA单元输入有第N-1级GOA单元的扫描信号G(N-1)、第N-1级GOA单元的时钟触发信号STV(N-1)、时钟信号CK(N)、第一直流低电压信号VSSG、第二直流低电压信号VSSQ以及直流高电压信号LC：其中，所述第一直流低电压信号VSSG的电位大于所述第二直流低电压信号VSSQ的电位。
其中，所述上拉控制单元1，耦接第一节点Q(N)并电性连接于所述第N-1级GOA单元的扫描信号G(N-1)以及所述第N-1级GOA单元的时钟触发信号STV(N-1)，用于根据所述第N-1级GOA单元的扫描信号G(N-1)以及所述第N-1级GOA单元的时钟触发信号STV(N-1)生成第一节点控制信号；所述第N-1级GOA单元的扫描信号G(N-1)以及所述第N-1级GOA单元的时钟触发信号STV(N-1)是由第N-1级的GOA单元产生，用于触发所述第N级的GOA单元，主要为所述第一节点Q(N)实现预充电。
具体的，所述上拉控制单元1包括：第一薄膜晶体管T11；所述第一薄膜晶体管T11的栅极接入所述第N-1级GOA单元的时钟触发信号STV(N-1)，源极接入所述第N-1级GOA单元的扫描信号G(N-1)，漏极与所述第一节点Q(N)连接。
所述自举电容单元6，用于存储所述第一节点控制信号的电位；具体地，所述自举电容单元6包括自举电容Cbt；所述自举电容Cbt的一端与所述第一节点Q(N)连接，另一端与第N级GOA单元的扫描信号G(N)的输出端连接。
所述上拉单元2耦接所述第一节点Q(N)并电性连接所述时钟信号CK(N)，用于根据所述第一节点控制信号和所述时钟信号CK(N)生成所述第N级GOA单元的扫描信号G(N)。
具体地，所述上拉单元2包括第二薄膜晶体管T21；所述第二薄膜晶体管T21的栅极与所述第一节点Q(N)连接，源极接入所述时钟信号CK(N)，漏极与所述第N级GOA单元的扫描信号G(N)的输出端连接。
所述下传单元3，耦接所述第一节点Q(N)并电性连接所述时钟信号CK(N)，用于根据所述第一节点控制信号与所述时钟信号CK(N)生成第N级GOA单元的时钟触发信号ST(N)；所述第N级GOA单元的所述时钟触发信号ST(N)用于触发第N+1级的GOA单元。
具体地，所述下传单元3包括第三薄膜晶体管T22；所述第三薄膜晶体管T22的栅极与所述第一节点Q(N)连接，源极接入所述时钟信号CK(N)，漏极与所述第N级GOA单元的所述时钟触发信号ST(N)的输出端连接。
所述下拉单元4，耦接所述第一节点Q(N)并电性连接所述第N级GOA单元的扫描信号G(N)，用于拉低所述第一节点控制信号的电位，以及拉低所述第N级GOA单元的扫描信号G(N)的电位。
具体地，所述下拉单元4包括：第四薄膜晶体管T31、第五薄膜晶体管T41；所述第四薄膜晶体管T31的栅极接入所述第N+1级GOA单元的扫描信号G(N+1)，源极接入所述第一直流低电压信号VSSG，漏极与所述第N级GOA单元的扫描信号G(N)的输出端连接；所述第五薄膜晶体管T41的栅极接入所述第N+1级GOA单元的扫描信号G(N+1)，源极接入所述第二直流低电压信号VSSQ，漏极与所述第一节点Q(N)连接。
所述下拉维持单元5，耦接所述第一节点Q(N)并电性连接第N级GOA单元的所述扫描信号G(N)，用于维持所述第一节点控制信号的电位，以及维持所述第N级GOA单元的所述扫描信号G(N)的电位。所述下拉维持单元5中的电子元件实际上是一种反相器，包括高电平信号、低电平信号，当输入端输入高电位信号时，输出端输出低电位信号，当输入端输入低电位信号时，输出端输出高电位信号。
具体地，所述下拉维持单元5包括：第六薄膜晶体管T51、第七薄膜晶体管T52、第八薄膜晶体管T53、第九薄膜晶体管T54、第十薄膜晶体管T32、第十一薄膜晶体管T42；
所述第六薄膜晶体管T51的栅极与源极均接入所述直流高电压信号LC，漏极与所述第七薄膜晶体管T52的漏极以及所述第八薄膜晶体管T53的栅极连接；
所述第七薄膜晶体管T52的栅极与所述第一节点Q(N)和所述第九薄膜晶体管T54的栅极连接，源极接入所述第一直流低电压信号VSSG；
所述第八薄膜晶体管T53的源极接入所述直流高电压信号LC，漏极与所述第九薄膜晶体管T54的漏极、所述第十薄膜晶体管T32的栅极以及所述第十一薄膜晶体管T42的栅极连接；
所述第九薄膜晶体管T54源极接入所述第一直流低电压信号VSSG；
所述第十薄膜晶体管T32的源极接入所述第一直流低电压信号VSSG，漏接与所述第N级GOA单元的扫描信号G(N)的输出端连接；
所述第十一薄膜晶体管T42的源极接入所述第二直流低电压信号VSSQ，漏极与所述第一节点Q(N)连接。
所述辅助单元7，耦接所述第一节点Q(N)并电性连接第一直流低电压信号VSSG和第二直流低电压信号VSSQ，用于在所述显示面板关机的瞬间，根据所述第一直流低电压信号VSSG和所述第二直流低电压信号VSSQ拉低所述第一节点控制信号的电位。
具体地，所述辅助单元7包括第十二薄膜晶体管Tgq；所述第十二薄膜晶体管Tgq的栅极接入所述第一直流低电压信号VSSG，源极接入所述第二直流低电压信号VSSQ，漏极与所述第一节点Q(N)连接。
如图2所示，为本发明实施例提供的GOA电路的时序图。在所述显示面板关机的瞬间，GOA电路的关机电位情况如下：时钟信号CK由最初的高频交流信号被拉至高电位后缓慢降低至零电位，时钟触发信号STV由最初的低频交流信号缓慢拉高至零电位，直流高电压信号LC由最初的高电位缓慢降低至零电位，第一直流低电压信号VSSG由最初的低电位被拉至高电位后缓慢降低至零电位，第二直流低电压信号VSSQ由最初的低电位缓慢拉高至零电位。以实现在所述显示面板关机的瞬间，所述显示面板能够快速的放电。
具体地，将所述显示面板分为显示单元及GOA电路单元，当所述显示面板正常工作时，所述第十二薄膜晶体管Tgq的栅极输入电压Vgs始终小于0而处于关闭状态，所述第二直流低电压信号VSSQ不会对所述第一节点的波形造成影响。当进行关机动作时，对于所述GOA电路单元的放电，应维持第一节点Q的低电位(至少不要形成一个高电位)；对于所述显示单元的电路放电，应将所有栅极信号均拉至高电位(至少要形成一个高电位)。以第N级GOA单元为例，在上述电位情况的设计下，其中所述GOA电路单元的放电：当第N-1级GOA单元输出的时钟触发信号STV(N-1)为低电位时，所述第一薄膜晶体管T11为关闭状态，第N-1级GOA单元输出的扫描信号G(N-1)的高电位不会影响第一节点Q(N)点的电位；当输入的所述第一直流低电压信号VSSG为高电位、所述第二直流低电压信号VSSQ为低电位时，所述辅助单元的所述第十二薄膜晶体管Tgq为开启状态，所述第一节点Q(N)被所述第二直流低电压信号VSSQ持续拉低；当所述第一节点Q(N)点为低电位、所述直流高电压信号LC为高电位时，所述第十一薄膜晶体管T42为开启状态，所述第一节点Q(N)被所述第二直流低电压信号VSSQ持续拉低；当所述第N+1级GOA单元的扫描信号G(N+1)点为高电位时，所述第五薄膜晶体管T41为开启状态，所述第一节点Q(N)被所述第二直流低电压信号VSSQ持续拉低。
所述显示单元的电路放电：当所述第一节点Q(N)为低电位时，所述第二薄膜晶体管T21为关闭状态，所述时钟信号CK不会影响所述第N级GOA单元的扫描信号G(N)的电位；当所述第一节点Q(N)为低电位、所述直流高电压信号LC为高电位时，所述第十薄膜晶体管T32为开启状态，所述第N级GOA单元的扫描信号G(N)被所述第一直流低电压信号VSSG持续拉高；当所述第N+1级GOA单元的扫描信号G(N+1)为高电位时，所述第四薄膜晶体管T31为开启状态，所述第N级GOA单元的扫描信号G(N)被所述第一直流低电压信号VSSG持续拉高。
其中，所述时钟信号CK的波形对放电并不会造成明显影响，因而，本发明的GOA电路结构中所述时钟信号CK的波形较传统设置并不需做改动。此外，需要补充说明的是GOA电路是级传的，本发明中为了实现快速的放电，所述辅助单元的所述第十二薄膜晶体管Tgq可以在所述第一直流低电压信号VSSG、所述第二直流低电压信号VSSQ电位变化的瞬间将所有第一节点Q点拉至低电位，相比级传结构有利于提高响应速度。
本发明还提供一种采用上述GOA驱动电路制备的液晶显示面板。
相较于现有液晶显示面板的GOA驱动电路，本发明的GOA驱动电路及其制备的液晶显示面板，通过将直流低电压信号由一条走线拆分为两条走线，并通过在GOA驱动电路中增设TFT来辅助拉低第一节点电位，同时在所述显示面板关机的瞬间，设计所述时钟信号、所述时钟触发信号、所述直流低电压信号、所述第一直流低电压信号以及所述第二直流低电压信号的电位变化，在关机动作的瞬间将所有第一节点拉至低电位，相比级传结构有利于提高响应速度，避免在下一次开机时，触发OCP而导致画面异常的现象。实现关机时GOA电路和像素电极的有效放电，改善液晶面板的可靠性和稳定性
综上所述，虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (10)

1.一种GOA驱动电路，应用于显示面板中，其特征在于，包括：
至少两个相互级联的GOA单元，其中第N级GOA单元包括：上拉单元、上拉控制单元、下传单元、下拉单元、下拉维持单元、辅助单元以及自举电容单元；其中，
所述上拉控制单元，耦接第一节点并电性连接于第N-1级GOA单元的扫描信号以及第N-1级GOA单元的时钟触发信号，用于根据所述第N-1级GOA单元的扫描信号以及所述第N-1级GOA单元的时钟触发信号生成第一节点控制信号；
所述自举电容单元，用于存储所述第一节点控制信号的电位；
所述上拉单元，耦接所述第一节点并电性连接时钟信号，用于根据所述第一节点控制信号和所述时钟信号生成第N级GOA单元的扫描信号；
所述下传单元，耦接所述第一节点并电性连接所述时钟信号，用于根据所述第一节点控制信号与所述时钟信号生成第N级GOA单元的时钟触发信号；
所述下拉单元，耦接所述第一节点并电性连接所述第N级GOA单元的扫描信号，用于拉低所述第一节点控制信号的电位，以及拉低所述第N级GOA单元的扫描信号的电位；
所述下拉维持单元，耦接所述第一节点并电性连接所述第N级GOA单元的扫描信号，用于维持所述第一节点控制信号的电位，以及维持所述第N级GOA单元的扫描信号的电位；
所述辅助单元，耦接所述第一节点并电性连接第一直流低电压信号和第二直流低电压信号，用于在所述显示面板关机时，根据所述第一直流低电压信号拉低所述第一节点控制信号的电位至所述第二直流低电压信号的电位；在所述显示面板关机时，所述第一直流低电压信号的电位大于所述第二直流低电压信号的电位；
其中，所述辅助单元包括第十二薄膜晶体管；
所述第十二薄膜晶体管的栅极接入所述第一直流低电压信号，所述第十二薄膜晶体管的源极接入所述第二直流低电压信号，所述第十二薄膜晶体管的漏极与所述第一节点连接。
2.根据权利要求1所述的GOA驱动电路，其特征在于，所述上拉控制单元包括第一薄膜晶体管；
所述第一薄膜晶体管的栅极接入所述第N-1级GOA单元的时钟触发信号，源极接入所述第N-1级GOA单元的扫描信号，漏极与所述第一节点连接。
3.根据权利要求1所述的GOA驱动电路，其特征在于，所述上拉单元包括第二薄膜晶体管；
所述第二薄膜晶体管的栅极与所述第一节点连接，源极接入所述时钟信号，漏极与所述第N级GOA单元的扫描信号的输出端连接。
4.根据权利要求1所述的GOA驱动电路，其特征在于，所述下传单元包括第三薄膜晶体管；
所述第三薄膜晶体管的栅极与所述第一节点连接，源极接入所述时钟信号，漏极与所述第N级GOA单元的时钟触发信号的输出端连接。
5.根据权利要求1所述的GOA驱动电路，其特征在于，所述下拉单元包括：第四薄膜晶体管、第五薄膜晶体管；
所述第四薄膜晶体管的栅极接入第N+1级GOA单元的扫描信号，源极接入所述第一直流低电压信号，漏极与所述第N级GOA单元的扫描信号的输出端连接；
所述第五薄膜晶体管的栅极接入所述第N+1级GOA单元的扫描信号，源极接入所述第二直流低电压信号，漏极与所述第一节点连接。
6.根据权利要求1所述的GOA驱动电路，其特征在于，所述下拉维持单元包括：第六薄膜晶体管、第七薄膜晶体管、第八薄膜晶体管、第九薄膜晶体管、第十薄膜晶体管、第十一薄膜晶体管；
所述第六薄膜晶体管的栅极与源极均接入直流高电压信号，漏极与所述第七薄膜晶体管的漏极以及所述第八薄膜晶体管的栅极连接；
所述第七薄膜晶体管的栅极与所述第一节点和所述第九薄膜晶体管的栅极连接，源极接入所述第一直流低电压信号；
所述第八薄膜晶体管的源极接入所述直流高电压信号，漏极与所述第九薄膜晶体管的漏极、所述第十薄膜晶体管的栅极以及所述第十一薄膜晶体管的栅极连接；
所述第九薄膜晶体管源极接入所述第一直流低电压信号；
所述第十薄膜晶体管的源极接入所述第一直流低电压信号，漏接与所述第N级GOA单元的扫描信号的输出端连接；
所述第十一薄膜晶体管的源极接入所述第二直流低电压信号，漏极与所述第一节点连接。
7.根据权利要求1所述的GOA驱动电路，其特征在于，所述第十二薄膜晶体管为N沟道型薄膜晶体管。
8.根据权利要求1所述的GOA驱动电路，其特征在于，所述自举电容单元包括自举电容；
所述自举电容的一端与所述第一节点连接，另一端与所述第N级GOA单元的扫描信号的输出端连接。
9.根据权利要求1-8任一项所述的GOA驱动电路，其特征在于，在所述显示面板关机的瞬间，所述第一直流低电压信号的电位被拉至高电位后缓慢降低至零电位，所述第N-1级GOA单元的时钟触发信号由最初的高电位缓慢降低至零电位。
10.一种采用权利要求1～9任一权利要求所述的GOA驱动电路制备的液晶显示面板。
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