CN108932930B - 栅极移位寄存器以及包括其的有机发光二极管显示器 - Google Patents

栅极移位寄存器以及包括其的有机发光二极管显示器 Download PDF

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Abstract

公开了栅极移位寄存器以及包括其的有机发光二极管显示器。该栅极移位寄存器包括第一级和第二级，第一级和第二级在图像数据写入时段期间输出图像显示栅极脉冲、并且在其中不写入图像显示数据的垂直消隐间隔中选择性地输出感测栅极脉冲。第一级包括第一进位信号施加节点Q1、第一交替驱动节点Qbo、激活电压保持节点M、激活节点Q1的第一感测控制块以及去激活节点Qbo的第二感测控制块。第二级包括第二进位信号施加节点Q2、第二交替驱动节点Qbe、激活节点Q2的第三感测控制块以及去激活节点Qbe的第四感测控制块。第一级和第二级彼此共享其驱动所需的部分电路。

Description

栅极移位寄存器以及包括其的有机发光二极管显示器
技术领域
本发明涉及有机发光二极管显示器，并且更具体地涉及用于外部补偿的栅极移位寄存器和包括该栅极移位寄存器的有机发光二极管显示器。
背景技术
有源矩阵有机发光二极管(OLED)显示器包括能够自身发光的多个OLED，并且具有许多优点，诸如快的响应时间、高的发光效率、高的亮度、宽的视角等。
用作自发光元件的OLED包括阳极电极、阴极电极以及阳极电极与阴极电极之间的有机化合物层。有机化合物层包括空穴注入层HIL、空穴传输层HTL、发射层EML、电子传输层ETL和电子注入层EIL。当驱动电压施加于阳极电极和阴极电极时，穿过空穴传输层HTL的空穴和穿过电子传输层ETL的电子移动到发射层EML并形成激子。结果，发射层EML产生可见光。
OLED显示器以矩阵形式布置每个包括OLED的像素布并且根据图像显示数据的灰度级来调整像素的亮度。每个像素包括驱动元件(例如，驱动晶体管)，其根据栅电极与源电极之间的电压来控制在OLED中流动的驱动电流。驱动元件的电特性因温度或劣化而变化。当像素之间的驱动元件的电特性存在差异时，对于相同的图像显示数据像素具有不同的亮度。因此，OLED显示器难以实现期望的图像。
已知外部补偿技术来补偿驱动元件的电特性的变化。外部补偿技术感测驱动元件的电特性，并且基于感测结果通过改变驱动元件的电特性来修改图像显示数据。
为了补偿驱动元件的特性随时间的变化，在驱动元件的驱动期间需要实时感测驱动元件的电特性。这种实时感测过程在除了来自一帧的图像数据写入时段之外的垂直消隐间隔中执行感测操作，并感测每帧中的特定像素线。像素线表示一组水平相邻的像素，并且由于水平分辨率在一个像素线上布置尽可能多的像素。面板驱动电路在图像数据写入时段期间向显示面板的栅极线顺序地提供图像显示栅极脉冲，并将图像显示数据写入显示面板的所有像素。在垂直消隐间隔中，面板驱动电路向连接至特定像素线的仅栅极线提供感测栅极脉冲，并将感测数据写入特定像素线的像素。
实时感测过程将感测电路连接至驱动元件的一个电极，从而感测在驱动元件中流动的电流。为了执行准确的感测，待感测的相应像素线的OLED被设计为不发光。因为在感测期间相应像素线的发射占空比减小了垂直消隐间隔的长度，所以感测的像素线与未感测的像素线之间可能发生亮度变化。结果，感测的像素线可以作为暗线可见。
优选的是，感测栅极脉冲被施加于将以随机顺序感测的像素线，以减少暗线感知现象。然而，当栅极移位寄存器以随机顺序产生感测栅极脉冲时，栅极移位寄存器的配置变得复杂。当复杂配置的栅极移位寄存器嵌入显示面板时，边框区域的大小增加。此外，由于时钟线和电源线的数量增加，功耗增加。
发明内容
因此，本公开内容旨在解决上述和其他问题，并提供一种能够在垂直消隐间隔中通过简单的电路配置以随机顺序输出感测栅极脉冲的栅极移位寄存器和一种包括该栅极移位寄存器的有机发光二极管显示器。
另外的特征和方面将在下面的描述中阐述，并且根据描述部分将变得明显，或者可以通过实践本文提供的发明构思而习得。本发明构思的其他特征和方面可以通过书面描述中特别指出的结构或从其中推导出的结构，以及其权利要求以及附图来实现和获得。
在一个方面中，提供了一种栅极移位寄存器，该栅极移位寄存器包括第一级和第二级，第一级和第二级被配置成在图像数据写入时段期间输出图像显示栅极脉冲、并且在其中不写入图像显示数据的垂直消隐间隔中选择性地输出感测栅极脉冲，其中，第一级包括：第一进位信号施加节点Q1、第一交替驱动节点Qbo和激活电压保持节点M；被配置成根据节点M的电压和全局重置信号来激活节点Q1的第一感测控制块；以及被配置成根据节点M的电压和全局重置信号来去激活节点Qbo的第二感测控制块，其中，第二级包括：第二进位信号施加节点Q2和第二交替驱动节点Qbe；被配置成根据节点M的电压和全局重置信号激活节点Q2的第三感测控制块；以及被配置成根据节点M的电压和全局重置信号来去激活节点Qbe的第四感测控制块，其中，第一级和第二级彼此共享其驱动所需的部分电路。
附图说明
可以包括附图以提供对本公开内容的进一步理解并且附图并入本说明书并构成本说明书的一部分，附图示出了本公开内容的实施方式，并且与说明书一起用于说明本公开内容的各种原理。
图1示出了根据本公开内容的实施方式的栅极移位寄存器的级的连接配置。
图2和图3示出了施加线采样信号、全局重置信号和全局起始信号的时序以及图像显示栅极脉冲和感测栅极脉冲的输出时序。
图4示意性地示出了彼此共享一部分电路配置的两个级。
图5详细示出了图4中所示的级。
图6示出了图5所示的级中包括的节点Q1、节点Q2、节点Qbo和节点Qbe的电压以及从这些级输出的图像显示栅极脉冲和进位信号。
图7A至图7I顺序地示出了图5和图6中所示的栅极移位寄存器的操作过程。
图8示出了根据本公开内容的实施方式的包括栅极移位寄存器的有机发光二极管显示器。
具体实施方式
现在将详细参考本公开内容的实施方式，其示例在附图中示出。只要有可能，在整个附图中将使用相同的附图标记来表示相同或相似的部分。如果可能误导本公开内容的实施方式，则将省略对已知技术的详细描述。
在本文公开的实施方式中，“在前级”是位于参考级之上并且生成具有比从参考级输出的栅极输出信号的相位早的相位的栅极输出信号的级。此外，“后续级”是位于参考级之下并且生成具有比从参考级输出的栅极输出信号的相位晚的相位的栅极输出信号的级。此外，构成根据本公开内容的实施方式的栅极移位寄存器的开关元件可以被实现为氧化物元件、非晶硅元件和多晶硅元件中至少之一。节点被激活的事实表明该节点被充有高电位电源电压或与高电位电源电压相对应的电压。节点被去激活的事实表明该节点被充有低电位电源电压或与低电位电源电压相对应的电压。
图1示出了根据本公开内容的实施方式的栅极移位寄存器的级的连接配置。
参照图1，根据本公开内容的实施方式的栅极移位寄存器包括彼此级联连接的多个级STGn至STGn+3。最上级还可以连接至至少一个在前伪级，并且最下级还可以连接至至少一个后续伪级。
级STGn至STGn+3各自产生栅极输出信号和进位信号。栅极输出信号可以包括图像显示栅极脉冲和感测栅极脉冲。级STGn至STGn+3产生图像显示栅极脉冲SCOUT(n)至SCOUT(n+3)，并将图像显示栅极脉冲SCOUT(n)至SCOUT(n+3)提供给设置在显示面板的各个像素线上的栅极线。级STGn至STGn+3产生进位信号Cn至Cn+3，并且可以将进位信号Cn至Cn+3提供给后续级中的一个。此外，级STGn到STGn+3可以被配置成使得任何一级在每个帧中生成感测栅极脉冲(例如，SCOUT(n)至SCOUT(n+3)中的一个)，并将感测栅极脉冲提供至设置在显示面板的特定像素线上的栅极线。在每个帧中产生感测栅极脉冲的级可以被随机设置。
级STGn至STGn+3可以从外部时序控制器(未示出)接收全局起始信号VSP、全局重置信号RESET、线采样信号LSP、时钟信号CLK等以生成栅极输出信号和进位信号。
全局起始信号VSP、全局重置信号RESET、线采样信号LSP和时钟信号CLKs被共同地提供给级STGn至STGn+3。全局起始信号VSP还可以被提供给在前伪级的起始端子，并且全局重置信号RESET还可以被提供给后续伪级的重置端子。
级STGn至STGn+3响应于被施加于每一帧中的每一级的起始端子的进位信号而各自激活节点Q的操作。在这种情况下，STGn至STGn+3的一些级可以接收来自在前伪级的进位信号。在前伪级可以响应于全局起始信号VSP而操作，并将该进位信号提供给一些后续级。
级STGn至STGn+3各自响应于被施加于每一帧中的每一级的重置端子的重置信号而使节点Q的操作去激活。在这种情况下，级STGn至STGn+3的一些级可以从后续伪级接收重置信号。后续伪级可以响应于全局重置信号RESET而操作，并将重置信号提供给一些在前级。
可以将至少一个时钟信号CLKs提供给级STGn至STGn+3中的每一个。时钟信号CLKs可以包括相位被顺序移位的扫描移位时钟，以及相位被顺序移位的进位移位时钟。扫描移位时钟是用于产生图像显示栅极脉冲和感测栅极脉冲的时钟信号，并且进位移位时钟是用于产生进位信号的时钟信号。扫描移位时钟在栅极高电压与栅极低电压之间摆动，使得它们在图像数据写入时段期间与图像显示栅极脉冲同步。扫描移位时钟在栅极高电压与栅极低电压之间摆动，使得它们在垂直消隐间隔中与感测栅极脉冲同步。在图像数据写入期间，所有扫描移位时钟摆动。在垂直消隐间隔中，一些扫描移位时钟摆动，并且其余的扫描移位时钟保持栅极低电压。
时钟信号CLKs可以以交叠方式被驱动，以便在高速驱动中确保足够的充电时间。根据交叠驱动的相邻相位的时钟可以以预定的高电平时段交叠。
级STGn至STGn+3可以与扫描移位时钟同步地顺序输出图像显示栅极脉冲。级STGn至STGn+3之一可以与某些扫描移位时钟同步地输出感测栅极脉冲。
级STGn至STGn+3中的每个可以从外部电源单元(未示出)接收电源电压PS。电源电压PS包括高电位电源电压和低电位电源电压。高电位电源电压可以设置为栅极高电压，例如28V。为了抑制包括在级STGn至STGn+3中的每个的晶体管的泄漏电流，可以将低电位电源电压设置为多个栅极低电压，例如-6V和-12V。
在这种情况下，扫描移位时钟可以在-6V与12V之间摆动，并且进位移位时钟可以在-12V与12V之间摆动。换言之，进位移位时钟的摆动宽度可以大于扫描移位时钟的摆动宽度。
为了实现级STGn至STGn+3的简单电路配置，两个相邻级(例如，级STGn和STGn+1以及级STGn+2和STGn+3)可以彼此共享感测控制块RT的一部分、节点Qh、节点Qbo和节点Qbe。
级STGn至STGn+3以预定时间间隔交替地驱动节点Qbo和节点Qbe，从而减少响应于节点Qbo和节点Qbe的电压而被开关的晶体管的劣化。在这种情况下，被施加于级STGn至STGn+3的反相器块的高电位电源电压可以被AC驱动。
图2和图3示出了施加线采样信号LSP、全局重置信号RESET和全局起始信号VSP的时序以及图像显示栅极脉冲和感测栅极脉冲的输出时序。
参照图2，图像显示栅极脉冲是用于选择图像显示数据将被写入的像素线的扫描控制信号，并且感测栅极脉冲是用于选择感测数据将被写入的像素线的扫描控制信号。感测数据是用于感测包括在显示面板中的像素的电特性的数据，并且是与图像显示器不相关的数据。
参照图2，在一帧的图像数据写入时段WP期间，各级可以输出相位被顺序移位的图像显示栅极脉冲。例如，在第一帧和第二帧的图像数据写入时段WP期间，可以从第n级输出图像显示栅极脉冲Pn_1并将其提供给第n像素线，并且可以从第m级输出图像显示栅极脉冲Pm并将其提供给第m像素线。
另一方面，可以在一帧的其中不写入图像显示数据的垂直消隐间隔BP中从多个级中的一个级输出感测栅极脉冲。可以非连续地或随机地选择将被写入感测数据的像素线(或称为“感测目标像素线”)以降低可视性。因此，任何一个级在每个垂直消隐间隔BP中输出一个感测栅极脉冲，并且输出感测栅极脉冲的级被非连续地或随机地选择。例如，感测栅极脉冲Pn_2可以从第n级输出并且在第一帧的垂直消隐间隔BP中提供给第n像素线。此外，感测栅极脉冲Pm_2可以从第m级输出并且在第二帧的垂直消隐间隔BP中被提供给第m像素线。当实现随机感测时，可以在第n像素线与第m像素线之间设置其他像素线。
参照图2和图3，线采样信号LSP是在每帧的图像数据写入时段WP中随机产生的。因为线采样信号LSP是随机产生的，所以帧具有在一帧中从一帧的起始时间到线采样信号LSP的输入起始时间的不同的间隔TP1和TP2。此外，间隔TP1和TP2在帧中是无规律的。换言之，线采样信号LSP在帧中以无规律的间隔被施加。
响应于线采样信号LSP、进位信号、全局重置信号RESET和全局起始信号VSP，选择感测数据将被写入到相应帧中的感测目标像素线。接收与线采样信号LSP同步的进位信号的级在图像数据写入时段WP中激活包括在级的采样块中的节点M的电压，并且保持节点M的激活电压直到垂直消隐间隔BP。此外，该级根据节点M的激活电压和垂直消隐间隔BP中的全局重置信号RESET激活包括在该级中的节点Q，从而输出感测栅极脉冲。
例如，当线采样信号LSP与在第一帧中输入到第n级的进位信号同步时，第n级在第一帧的垂直消隐间隔BP中输出感测栅极脉冲Pn_2，并且其余的级在第一帧的垂直消隐间隔BP中不输出感测栅极脉冲。为此，响应于在第一帧的图像数据写入时段WP中线采样信号LSP激活在第n级中包括的节点M的电压之后，节点M保持在激活电压直到在第一帧的垂直消隐间隔BP中输入全局起始信号VSP。响应于节点M的激活电压和第一帧的垂直消隐间隔BP中的全局重置信号RESET，第n级激活包括在第n级中的节点Q，并且向第n栅极线输出与时钟信号同步的感测栅极脉冲Pn_2。因此，连接至第n栅极线的第n像素线响应于感测栅极脉冲Pn_2而操作。此外，响应于第一帧的垂直消隐间隔BP中的全局起始信号VSP，第n级的节点Q和节点M被去激活。这样的初始化操作可以使得第n级能够在第二帧中正常地产生图像显示栅极脉冲。
此外，当线采样信号LSP与输入到第二帧中的第m级的进位信号同步时，第m级在第二帧的垂直消隐间隔BP中输出感测栅极脉冲Pm_2，并且其余的级在第二帧的垂直消隐间隔BP中不输出感测栅极脉冲。为此，响应于在第二帧的图像数据写入时段WP中线采样信号LSP激活在第m级中包括的节点M的电压之后，节点M保持在激活电压直到在第二帧的垂直消隐间隔BP中输入全局起始信号VSP。响应于节点M的激活电压和第二帧的垂直消隐间隔BP中的全局重置信号RESET，第m级激活包括在第m级中的节点Q，并且向第m栅极线输出与时钟信号同步的感测栅极脉冲Pm_2。因此，连接至第m栅极线的第m像素线响应于感测栅极脉冲Pm_2而操作。此外，响应于第二帧的垂直消隐间隔BP中的全局起始信号VSP，第m级的节点Q和节点M被去激活。这样的初始化操作可以使得第m级能够在后续帧中正常地产生图像显示栅极脉冲。
参照图2和图3，在第一帧和第二帧中的每一个的图像数据写入时段WP中，接收与线采样信号LSP不同步的进位信号的其余级不能激活其余级的节点M。因此，在第一帧和第二帧的每一个的垂直消隐间隔BP中，其余级不能激活其余级的节点Q，因此不能输出感测栅极脉冲。
图4示意性地示出了彼此共享一部分电路配置的两个级。
参照图4，两个相邻级STGn和STGn+1可以彼此共享感测控制块RT的一部分、节点Qh、节点Qbo和节点Qbe。
感测控制块RT对于执行随机感测是必需的。当两个级STGn和STGn+1彼此共享包括节点M的感测控制块RT的一部分时，级的电路配置被简化。即使当如上所述简化级的电路配置时，级也可以正常操作。
当使用两个Qb节点执行交替驱动时，当两个级STGn和STGn+1彼此共享节点Qh、节点Qbo和节点Qbe时，级的电路配置被简化。即使当如上所述简化级的电路配置时，级也可以正常操作。节点Qbo和节点Qbe以交替驱动的预定时间间隔交替地驱动。例如，当节点Qbo在第一间隔中被驱动时，节点Qbe可以在第一间隔中被暂停驱动。当在第一间隔之后的第二间隔中驱动节点Qbe时，节点Qbo可以在第二间隔中被暂停驱动。在这种情况下，在第一间隔中，节点Qbo的电压在放电电平与充电电平之间摆动，并且节点Qbe的电压保持在放电电平。在第二间隔中，节点Qbe的电压在放电电平与充电电平之间摆动，并且节点Qbo的电压保持在放电电平。
如图4所示，级STGn可以包括用于控制节点Q1和节点Qbo的电压的第一反相器块INV1以及包括在输出块中的晶体管T6、T7a和T7b。晶体管T6是上拉晶体管，其在节点Q1的电压保持在升压电压电平的相对短的时间段内接通。
另一方面，晶体管T7a和T7b是下拉晶体管，其接通很长时间并且相对快速地劣化。可以以预定时间间隔交替地驱动晶体管T7a和T7b以降低劣化速度。为此，晶体管T7a可以被设计成响应于节点Qbo的电压而接通，并且晶体管T7b可以被设计成响应于节点Qbe的电压而接通。因此，当晶体管T7a被驱动时，晶体管T7b被暂停驱动。相反，当晶体管T7b被驱动时，晶体管T7a被暂停驱动。
如图4所示，级STGn+1可以包括用于控制节点Q2和节点Qbe的电压的第二反相器块INV2以及包括在输出块中的晶体管T6’、T7a’和T7b’。晶体管T6’是上拉晶体管，其在节点Q2的电压保持在升压电压电平的相对短的时间段内接通。
另一方面，晶体管T7a’和T7b’是下拉晶体管，其接通很长时间并且相对快速地劣化。可以以预定时间间隔交替地驱动晶体管T7a’和T7b’以降低劣化速度。为此，晶体管T7a’可以被设计成响应于节点Qbo的电压而接通，并且晶体管T7b’可以被设计成响应于节点Qbe的电压而接通。因此，当晶体管T7a’被驱动时，晶体管T7b’被暂停驱动。相反，当晶体管T7b’被驱动时，晶体管T7a’被暂停驱动。
图5详细示出了图4中所示的级STGn和STGn+1。图6示出了图5所示的级STGn和STGn+1中包括的节点Q1、节点Q2、节点Qbo和节点Qbe的电压以及从级STGn和STGn+1输出的图像显示栅极脉冲和进位信号。
在图5和图6中，“GVDD”表示电压电平L2的高电位电源电压，并且电源电压GVDDo和GVDDe可以在用于AC驱动的电压电平L1和L2之间摆动。电压电平L1可以基本上等于低电位电源电压GVSS2。低电位电源电压GVSS0可以被设置为高于低电位电源电压GVSS2。当如上所述低电位电源电压GVSS0被设定为高于低电位电源电压GVSS2时，栅电极连接至节点Qbo和节点Qbe的晶体管T31a、T31b、T32a、T32b、T7cra、T7a、T7crb和T7b的截止电流可以被完全阻塞。低电位电源电压GVSS1可以被设定为基本上等于低电位电源电压GVSS0。
参照图5和图6，级STGn包括第一感测控制块BK1a、第二感测控制块BK1b、输入块BK2、反相器块BK3和输出块BK4。
第一感测控制块BK1a响应于线采样信号LSP而向节点M施加进位信号C(n-2)以将节点M的电压激活至高电位电源电压GVDD并且响应于节点M的激活电压和全局重置信号RESET而将节点Q1的电压激活至高电位电源电压GVDD。
为此，第一感测控制块BK1a包括多个晶体管Ta、Tb、Tc、T1b和T1c以及电容器Cst1。晶体管Ta包括被提供有线采样信号LSP的栅电极、被提供有进位信号C(n-2)的漏电极以及连接至节点N1的源电极。晶体管Tb包括被提供有线采样信号LSP的栅电极、连接至节点N1的漏电极以及连接至节点M的源电极。晶体管Tc包括连接至节点M的栅电极、提供有高电位电源电压GVDD的漏电极以及连接至节点N1的源电极。晶体管T1b包括连接至节点M的栅电极、被提供有高电位电源电压GVDD的漏电极以及连接至节点N3的源电极。电容器Cst1连接在高电位电源电压GVDD的输入端子与节点M之间，并且保持节点M的激活电压。晶体管T1c包括被提供有全局重置信号RESET的栅电极、连接至节点N3的漏电极以及连接至节点Q1的源电极。
第二感测控制块BK1b响应于全局重置信号RESET和节点M的电压，将节点Qbo的电压去激活为低电位电源电压GVSS2。
为此，第二感测控制块BK1b包括多个晶体管T5a和T5b。晶体管T5a包括被提供有全局重置信号RESET的栅电极、连接至节点Qbo的漏电极以及连接至节点N4的源电极。晶体管T5b包括连接至节点M的栅电极、连接至节点N4的漏电极以及被提供有低电位电源电压GVSS2的源电极。
输入块BK2向节点Q1施加进位信号C(n-3)以将节点Qh的电压激活至高电位电源电压GVDD。输入块BK2响应于进位信号C(n+3)将节点Q1的电压去激活至低电位电源电压GVSS2。输入块BK2根据节点Qbo的电压或节点Qbe的电压将节点Q1的电压去激活至低电位电源电压GVSS2。输入块BK2响应于全局起始信号VSP将节点Q1的电压去激活至低电位电源电压GVSS2。
为此，输入块BK2包括多个晶体管T1、T1a、T3q、T3n、T3na、T31a、T31b、T32a、T32b、T3nb和T3nc。晶体管T1包括各自被提供有进位信号C(n-3)的栅电极和漏电极，以及连接至节点Qh的源电极。晶体管T1a包括被提供有进位信号C(n-3)的栅电极、连接至节点Qh的漏电极以及连接至节点Q1的源电极。晶体管T3q包括连接至节点Q1的栅电极、被提供有高电位电源电压GVDD的漏电极以及连接至节点Qh的源电极。晶体管T3n包括被提供有进位信号C(n+3)的栅电极、连接至节点Q1的漏电极以及连接至节点Qh的源电极。晶体管T3na包括被提供有进位信号C(n+3)的栅电极、连接至节点Qh的漏电极以及被提供有低电位电源电压GVSS2的源电极。晶体管T31a包括连接至节点Qbo的栅电极、连接至节点Q1的漏电极以及连接至节点Qh的源电极。晶体管T31b包括连接至节点Qbo的栅电极、连接至节点Qh的漏电极以及被提供有低电位电源电压GVSS2的源电极。晶体管T32a包括连接至节点Qbe的栅电极、连接至节点Q1的漏电极以及连接至节点Qh的源电极。晶体管T32b包括连接至节点Qbe的栅电极、连接至节点Qh的漏电极以及被提供有低电位电源电压GVSS2的源电极。晶体管T3nb包括被提供有全局起始信号VSP的栅电极、连接至节点Q1的漏电极以及连接至节点Qh的源电极。晶体管T3nc包括被提供有全局起始信号VSP的栅电极、连接至节点Qh的漏电极以及连接至低电位电源电压GVSS2的输入端子的源电极。
反相器块BK3响应于进位信号C(n-3)将节点Qbo的电压去激活至低电位电源电压GVSS2。反相器块BK3根据节点Q1的激活电压将节点Qbo的电压去激活至低电位电源电压GVSS2。反相器块BK3向节点N5施加电源电压GVDDo并且将节点Qbo的电压激活至电源电压GVDDo。反相器块BK3根据节点Q2的激活电压将节点N5的电压去激活至低电位电源电压GVSS2。
为此，反相器块BK3包括多个晶体管T4、T41、T4q1、T4q2、T5和T5q。晶体管T4包括连接至节点N5的栅电极、被提供有电源电压GVDDo的漏电极以及连接至节点Qbo的源电极。晶体管T41包括各自被提供有电源电压GVDDo的栅电极和漏电极以及连接至节点N5的源电极。晶体管T4q1包括连接至节点Q1的栅电极、连接至节点N5的漏电极以及连接至低电位电源电压GVSS1的输入端子的源电极。晶体管T4q2包括连接至节点Q2的栅电极、连接至节点N5的漏电极以及被提供有低电位电源电压GVSS1的源电极。晶体管T5包括被提供有进位信号C(n-3)的栅电极、连接至节点Qbo的漏电极以及被提供有低电位电源电压GVSS2的源电极。晶体管T5q包括连接至节点Q1的栅电极、连接至节点Qbo的漏电极以及被提供有低电位电源电压GVSS2的源电极。
当节点Q1的电压从电压电平L2升高到电压电平L3时，输出块BK4输出进位移位时钟CRCLK(n)作为进位信号C(n)。当节点Qbo的电压被激活至电压电平L2或者节点Qbe的电压被激活至电压电平L2时，输出块BK4输出低电位电源电压GVSS2作为进位信号C(n)。当节点Q1的电压从电压电平L2升高到电压电平L3时，输出块BK4输出扫描移位时钟SCCLK(n)作为图像显示栅极脉冲(或感测栅极脉冲)SCOUT(n)。当节点Qbo的电压被激活至电压电平L2或者节点Qbe的电压被激活至电压电平L2时，输出块BK4输出低电位电源电压GVSS0作为图像显示栅极脉冲(或者感测栅极脉冲)SCOUT(n)。
为此，输出块BK4包括多个上拉晶体管T6cr和T6，多个下拉晶体管T7cra、T7crb、T7a和T7b以及电容器Cst2。上拉晶体管T6cr包括连接至节点Q1的栅电极、被提供有进位移位时钟CRCLK(n)的漏电极以及连接至节点N6的源电极。上拉晶体管T6包括连接至节点Q1的栅电极、被提供有扫描移位时钟SCCLK(n)的漏电极以及连接至节点N7的源电极。电容器Cst2连接在节点Q1与节点N7之间。下拉晶体管T7cra包括连接至节点Qbo的栅电极、连接至节点N6的漏电极以及连接至低电位电源电压GVSS2的输入端子的源电极。下拉晶体管T7crb包括连接至节点Qbe的栅电极、连接至节点N6的漏电极以及连接至低电位电源电压GVSS2的输入端子的源电极。下拉晶体管T7a包括连接至节点Qbo的栅电极、连接至节点N7的漏电极以及连接至低电位电源电压GVSS0的输入端子的源电极。下拉晶体管T7b包括连接至节点Qbe的栅电极、连接至节点N7的漏电极以及连接至低电位电源电压GVSS0的输入端子的源电极。
参照图5和图6，级STGn+1包括第一感测控制块BK1a’、第二感测控制块BK1b’、输入块BK2’、反相器块BK3’和输出块BK4’。
第一感测控制块BK1a’包括响应于全局重置信号RESET而将节点Q2的电压激活至高电位电源电压GVDD的晶体管T1c’。晶体管T1c’包括被提供有全局重置信号RESET的栅电极、连接至节点N3的漏电极以及连接至节点Q2的源电极。
第二感测控制块BK1b’响应于全局重置信号RESET和节点M的电压而将节点Qbe的电压去激活至低电位电源电压GVSS2。为此，第二感测控制块BK1b’包括晶体管T5a’。晶体管T5a’包括被提供有全局重置信号RESET的栅电极、连接至节点Qbe的漏极以及连接至节点N4的源电极。
输入块BK2’根据节点Qbe和节点Qbo的电压向节点Q2和节点Qh施加进位信号C(n-2)并且使节点Q2和节点Qh短路。输入块BK2'响应于全局起始信号VSP和进位信号C(n+4)使节点Q2和节点Qh短路。
为此，输入块BK2’包括多个晶体管T1’、T1a’、T3n’、T3nb’、T31a’和T32a’。晶体管T1’包括各自被提供有进位信号C(n-2)的栅电极和漏电极，以及连接至节点Qh的源电极。晶体管T1a’包括被提供有进位信号C(n-2)的栅电极、连接至节点Qh的漏电极以及连接至节点Q2的源电极。晶体管T3n’包括被提供有进位信号C(n+4)的栅电极、连接至节点Q2的漏电极以及连接至节点Qh的源电极。晶体管T31a’包括连接至节点Qbe的栅电极、连接至节点Q2的漏电极以及连接至节点Qh的源电极。晶体管T32a’包括连接至节点Qbo的栅电极、连接至节点Q2的漏电极以及连接至节点Qh的源电极。晶体管T3nb’包括被提供有全局起始信号VSP的栅电极、连接至节点Q2的漏电极以及连接至节点Qh的源电极。
反相器块BK3’响应于进位信号C(n-3)将节点Qbe的电压去激活至低电位电源电压GVSS2。反相器块BK3’根据节点Q2的激活电压将节点Qbe的电压去激活至低电位电源电压GVSS2。反相器块BK3’向节点N5’施加电源电压GVDDe并且将节点Qbe的电压激活至电源电压GVDDe。反相器块BK3’根据节点Q1的激活电压将节点N5’的电压去激活至低电位电源电压GVSS2。
为此，反相器块BK3’包括多个晶体管T4’、T41’、T4q1’、T4q2’、T5’和T5q’。晶体管T4’包括连接至节点N5’的栅电极、被提供有电源电压GVDDe的漏电极以及连接至节点Qbe的源电极。晶体管T41’包括各自被提供有电源电压GVDDe的栅电极和漏电极以及连接至节点N5’的源电极。晶体管T4q1’包括连接至节点Q2的栅电极、连接至节点N5’的漏电极以及连接至低电位电源电压GVSS1的源电极。晶体管T4q2’包括连接至节点Q1的栅电极、连接至节点N5’的漏电极和被提供有低电位电源电压GVSS1的源电极。晶体管T5’包括被提供有进位信号C(n-3)的栅电极、连接至节点Qbe的漏电极以及被提供有低电位电源电压GVSS2的源电极。晶体管T5q’包括连接至节点Q2的栅电极、连接至节点Qbe的漏电极以及被提供有低电位电源电压GVSS2的源电极。
当节点Q2的电压从电压电平L2升高到电压电平L3时，输出块BK4’输出进位移位时钟CRCLK(n+1)作为进位信号C(n+1)。当节点Qbo的电压被激活至电压电平L2或者节点Qbe的电压被激活至电压电平L2时，输出块BK4’输出低电位电源电压GVSS2作为进位信号C(n+1)。当节点Q2的电压从电压电平L2升高到电压电平L3时，输出块BK4’输出扫描移位时钟SCCLK(n+1)作为图像显示栅极脉冲(或感测栅极脉冲)SCOUT(n+1)。当节点Qbo的电压被激活至电压电平L2或者节点Qbe的电压被激活至电压电平L2时，输出块BK4’输出低电位电源电压GVSS0作为图像显示栅极脉冲(或感测栅极脉冲)SCOUT(n+1)。
为此，输出块BK4’包括多个上拉晶体管T6cr’和T6’，多个下拉晶体管T7cra’、T7crb’、T7a’和T7b’以及电容器Cst2’。上拉晶体管T6cr’包括连接至节点Q2的栅电极、被提供有进位移位时钟CRCLK(n+1)的漏电极以及连接至节点N6’的源电极。上拉晶体管T6’包括连接至节点Q2的栅电极、被提供有扫描移位时钟SCCLK(n+1)的漏电极以及连接至节点N7’的源电极。电容器Cst2’连接在节点Q2与节点N7’之间。下拉晶体管T7cra’包括连接至节点Qbe的栅电极、连接至节点N6’的漏电极以及连接至低电位电源电压GVSS2的输入端子的源电极。下拉晶体管T7crb’包括连接至节点Qbo的栅电极、连接至节点N6’的漏电极以及连接至低电位电源电压GVSS2的输入端子的源电极。下拉晶体管T7a’包括连接至节点Qbe的栅电极、连接至节点N7’的漏电极以及连接至低电位电源电压GVSS0的输入端子的源电极。下拉晶体管T7b’包括连接至节点Qbo的栅电极、连接至节点N7’的漏电极以及连接至低电位电源电压GVSS0的输入端子的源电极。
图6示出了电源电压GVDDo被施加有电压电平L2以及电源电压GVDDe被施加有电压电平L1来作为AC驱动的示例。本公开内容的实施方式同样适用于当电源电压GVDDo被施加有电压电平L1以及电源电压GVDDe被施加有电压电平L2的情况。
参照图6，节点Q1的电压与进位信号C(n-3)同步地从电压电平L1增加到电压电平L2。节点Q1的电压与进位信号C(n)同步地从电压电平L2升高到电压电平L3，然后从电压电平L3降低到电压电平L2。随后，节点Q1的电压与进位信号C(n+3)同步地从电压电平L2降低到电压电平L1。
节点Q2的电压与进位信号C(n-2)同步地从电压电平L1增加到电压电平L2。节点Q2的电压与进位信号C(n+1)同步地从电压电平L2升高到电压电平L3，然后从电压电平L3降低到电压电平L2。随后，节点Q2的电压与进位信号C(n+4)同步地从电压电平L2降低到电压电平L1。
节点Qbo的电压与进位信号C(n-3)同步地从电压电平L2下降到电压电平L1，并且与进位信号C(n+4)同步地从电压电平L1增加到电压电平L2。
节点Qbe的电压保持在电压电平L1。
在这种情况下，与进位信号C(n)同步地输出图像显示栅极脉冲SCOUT(n)，并且与进位信号C(n+1)同步地输出图像显示栅极脉冲SCOUT(n+1)。进位信号C(n)和C(n+1)的幅值(在GVDDo与GVSS2之间)大于图像显示栅极脉冲SCOUT(n)和SCOUT(n+1)的幅度(在GVDDo与GVSS0之间)。
图7A至图7I依次示出了图5和图6中所示的栅极移位寄存器的操作过程。更具体地，图7A至图7I示出了图像显示栅极脉冲和进位信号的输出序列。以上参照图2和图3描述了感测栅极脉冲的输出序列。在图7A至图7I中，用粗线表示具有激活电压的节点，并且用细线表示具有去激活电压的节点。
参照图7A，在时段A期间，节点Qbo的电压通过晶体管T4和T41的接通而增加至电压电平L2(GVDDo)。在这种情况下，其栅电极连接至节点Qbo的晶体管T31a和T31b接通，因此节点Q1和Qh的电压降低至电压电平L1(GVSS2)。此外，其栅电极连接至节点Qbo的晶体管T32a’接通，因此节点Q2和节点Qh彼此连接。因此，节点Q2的电压降低至电压电平L1(GVSS2)。
在时段A期间，由于其栅电极连接至节点Qbo的下拉晶体管T7cra和T7a接通，所以图像显示栅极脉冲SCOUT(n)的电压为低电位电源电压GVSS0，进位信号C(n)的电压为低电位电源电压GVSS2。另外，由于其栅电极连接至节点Qbo的下拉晶体管T7crb’和T7b’接通，所以图像显示栅极脉冲SCOUT(n+1)的电压为低电位电源电压GVSS0，并且进位信号C(n+1)的电压为低电位电源电压GVSS2。
参照图7B，在时段B期间，当输入具有电压GVDDo的进位信号C(n-3)时，节点Q1的电压通过晶体管T1和T1a的接通而增加至电压电平L2(GVDDo)，并且节点Qbo的电压通过晶体管T5的接通而降低至电压电平L1(GVSS2)。在这种情况下，其栅电极连接至节点Q1的晶体管T3q接通，并且因此节点Qh的电压增加至电压电平L2(GVDDo)。另外，其栅电极连接至节点Q1的晶体管T5q接通，并且因此节点Qbo的电压保持在电压电平L1(GVSS2)。
在时段B期间，扫描移位时钟SCCLK(n)的电压为低电位电源电压GVSS0，并且进位移位时钟CRCLK(n)的电压为低电位电源电压GVSS2。在这种情况下，因为其栅电极连接至节点Q1的上拉晶体管T6cr和T6具有高阈值电压，所以上拉晶体管T6cr和T6保持截止状态。由此，图像显示栅极脉冲SCOUT(n)的电压成为低电位电源电压GVSS0，并且进位信号C(n)的电压为低电位电源电压GVSS2。
参照图7C，在时段C期间，输入各自具有电压GVDDo的进位信号C(n-3)和C(n-2)。
在时段C期间，节点Q1的电压通过晶体管T1和T1a响应于进位信号C(n-3)的接通而增加至电压电平L2(GVDDo)，并且节点Qbo的电压通过晶体管T5的接通而降低至电压电平L1(GVSS2)。其栅电极连接至节点Q1的晶体管T3q接通，并且因此节点Qh的电压增加至电压电平L2(GVDDo)。另外，其栅电极连接至节点Q1的晶体管T5q接通，并且因此节点Qbo的电压保持在电压电平L1(GVSS2)。
在时段C期间，节点Q2的电压通过晶体管T1’和T1a’响应于进位信号C(n-2)的接通而增加至电压电平L2(GVDDo)，并且节点Qbe的电压通过晶体管T5’的接通而降低至电压电平L1(GVSS2)。其栅电极连接至节点Q2的晶体管T5q’使节点Qbe的电压保持在电压电平L1(GVSS2)。
在时段C期间，扫描移位时钟SCCLK(n)和SCCLK(n+1)的电压为低电位电源电压GVSS0，并且进位移位时钟CRCLK(n)和CRCLK(n+1)为低电位电源电压GVSS2。在这种情况下，其栅电极连接至节点Q1的上拉晶体管T6cr和T6保持截止状态，图像显示栅极脉冲SCOUT(n)的电压为低电位电源电压GVSS0，并且进位信号C(n)的电压为低电位电源电压GVSS2。另外，其栅电极连接至节点Q2的上拉晶体管T6cr’和T6’保持截止状态，图像显示栅极脉冲SCOUT(n+1)的电压为低电位电源电压GVSS0，并且进位信号C(n+1)的电压为低电位电源电压GVSS2。
参照图7D，在时段D期间，进位信号C(n-3)的电压从GVDDo降低至GVSS2，并且进位信号C(n-2)的电压保持在GVDDo。
在时段D期间，由于进位信号C(n-3)的电压变化，晶体管T5和T5’截止。然而，因为晶体管T5q和T5q’保持接通状态，所以节点Qbo和Qbe的电压保持在电压电平L1(GVSS2)。
在时段D期间，扫描移位时钟SCCLK(n)和SCCLK(n+1)的电压为低电位电源电压GVSS0，并且进位移位时钟CRCLK(n)和CRCLK(n+1)的电压为低电位电源电压GVSS2。在这种情况下，其栅电极连接至节点Q1的上拉晶体管T6cr和T6保持截止状态，图像显示栅极脉冲SCOUT(n)的电压为低电位电源电压GVSS0，并且进位信号C(n)的电压为低电位电源电压GVSS2。另外，其栅电极连接至节点Q2的上拉晶体管T6cr’和T6’具有高阈值电压并因此保持截止状态，图像显示栅极脉冲SCOUT(n+1)的电压为低电位电源电压GVSS0，并且进位信号C(n+1)的电压为低电位电源电压GVSS2。
参照图7E，在时段E期间，进位信号C(n-2)的电压从GVDDo降低至GVSS2。
在时段E期间，由于进位信号C(n-2)的电压的变化，晶体管T1’和T1a’截止。然而，因为晶体管T4q1、T4q2、T4q1’和T4q2’保持接通状态，所以节点Q1和Q2的电压保持在电压电平L2(GVDDo)。另外，节点Qbo和Qbe的电压保持在电压电平L1(GVSS2)。
在时段E期间，扫描移位时钟SCCLK(n)的电压增加至电源电压GVDDo，并且进位移位时钟CRCLK(n)的电压增加至电源电压GVDDo。当输入具有电压GVDDo的扫描移位时钟SCCLK(n)和具有电压GVDDo的进位移位时钟CRCLK(n)时，节点Q1的电压升高至能够使上拉晶体管T6cr和T6充分接通的电压电平L3。当其栅电极连接至节点Q1的上拉晶体管T6cr和T6接通时，图像显示栅极脉冲SCOUT(n)的电压为电源电压GVDDo，并且进位信号C(n)的电压为电源电压GVDDo。另一方面，其栅电极连接至节点Q2的上拉晶体管T6cr’和T6’保持截止状态，图像显示栅极脉冲SCOUT(n+1)的电压为低电位电源电压GVSS0，并且进位信号C(n+1)的电压为低电位电源电压GVSS2。
参照图7F，在时段F期间，扫描移位时钟SCCLK(n)和SCCLK(n+1)的电压为电源电压GVDDo，并且进位移位时钟CRCLK(n)和CRCLK(n+1)的电压为电源电压GVDDo。当输入各自具有电压GVDDo的扫描移位时钟SCCLK(n)和SCCLK(n+1)以及各自具有电源电压GVDDo的进位移位时钟CRCLK(n)和CRCLK(n+1)时，节点Q1的电压升高至能够使上拉晶体管T6cr和T6充分接通的电压电平L3。另外，节点Q2的电压升高至能够使上拉晶体管T6cr’和T6’充分接通的电压电平L3。
在时段F期间，当其栅电极连接至节点Q1的上拉晶体管T6cr和T6接通时，图像显示栅极脉冲SCOUT(n)的电压为电源电压GVDDo，并且进位信号C(n)的电压为电源电压GVDDo。另外，当其栅电极连接至节点Q2的上拉晶体管T6cr’和T6’接通时，图像显示栅极脉冲SCOUT(n+1)的电压为电源电压GVDDo，并且进位信号C(n+1)的电压为电源电压GVDDo。
参照图7G，在时段G期间，扫描移位时钟SCCLK(n)的电压降低至低电位电源电压GVSS0，并且进位移位时钟CRCLK(n)的电压降低至低电位电源电压GVSS0。当输入具有电压GVSS0的扫描移位时钟SCCLK(n)和具有电压GVSS0的进位移位时钟CRCLK(n)时，节点Q1的电压降低至电压电平L2。在这种情况下，其栅电极连接至节点Q1的上拉晶体管T6cr和T6截止，图像显示栅极脉冲SCOUT(n)的电压为低电位电源电压GVSS0，并且进位信号C(n)的电压为低电位电源电压GVSS0。另一方面，其栅电极连接至节点Q2的上拉晶体管T6cr’和T6’保持接通状态，图像显示栅极脉冲SCOUT(n+1)的电压为电源电压GVDDo，并且进位信号C(n+1)的电压为电源电压GVDDo。
参照图7H，在时段H期间，当输入具有电压GVDDo的进位信号C(n+3)时，晶体管T3n和T3na接通。因此，节点Q1和Qh的电压降低至低电位电源电压GVSS2。
在时段H期间，扫描移位时钟SCCLK(n+1)的电压降低至低电位电源电压GVSS0，并且进位移位时钟CRCLK(n+1)的电压降低至低电位电源电压GVSS2。当输入具有电压GVSS0的扫描移位时钟SCCLK(n+1)和具有电压GVSS2的进位移位时钟CRCLK(n+1)时，节点Q2的电压降低至电压电平L2(GVSS2)。在这种情况下，其栅电极连接至节点Q2的上拉晶体管T6cr’和T6’截止，图像显示栅极脉冲SCOUT(n+1)的电压为低电位电源电压GVSS0，并且进位信号C(n+1)的电压为低电位电源电压GVSS2。
参照图7I，在时段I期间，当输入具有电压GVDDo的进位信号C(n+4)时，晶体管T3n’接通。另外，节点Q2和节点Qh连接，并且节点Qh的电压降低至低电位电源电压GVSS2。
在时段I期间，晶体管T4q1和T4q2截止，并且晶体管T4截止。因此，节点Qbo的电压增加至电源电压GVDDo。在这种情况下，其栅电极连接至节点Qbo的晶体管T31a、T31b和T32a’接通。因此，节点Q1的电压保持在电压电平L1(GVSS2)，并且节点Q2的电压降低至电压电平L1(GVSS2)。
图8示出了根据本公开内容的实施方式的包括栅极移位寄存器的有机发光二极管显示器。
参照图8，根据本公开内容的实施方式的有机发光二极管(OLED)显示器包括显示面板100、数据驱动电路、扫描驱动电路、时序控制器110等。
多个数据线、多个感测线和多个栅极线被设置成在显示面板100上彼此交叉，并且用于外部补偿的像素以矩阵形式分别布置在线的交叉处以构成用于外部补偿的像素阵列。每个像素可以包括OLED、驱动薄膜晶体管(TFT)、存储电容器、第一晶体管和第二晶体管。构成像素的晶体管可以实现为p型晶体管、n型晶体管或其中p型晶体管和n型晶体管混合的混合型晶体管。另外，晶体管的半导体层可以包括非晶硅、多晶硅或氧化物。
包括用于外部补偿的像素阵列的根据本公开内容的实施方式的OLED显示器可以感测OLED和驱动TFT的电特性，并且可以根据感测结果校正图像显示数据。OLED的电特性可以包括OLED的操作点电压。驱动TFT的电特性可以包括驱动TFT的阈值电压和电子迁移率。
在韩国专利公开第10-2015-0052606(2015.05.14)号、第10-2016-0007971(2016.01.21)号、第10-2016-0001822(2016.01.07)号等中公开了根据本公开内容的实施方式的包括用于外部补偿的像素阵列的OLED显示器，其全部内容通过引用并入本文。
根据本公开内容的实施方式的OLED显示器执行用于感测像素的电特性的实时感测过程。根据本公开内容的实施方式的OLED显示器在一帧中除了图像数据写入时段WP之外的垂直空白间隔BP中执行感测操作。在这种情况下，每帧中感测一个像素线。在本文公开的实施方式中，像素线指示一组水平相邻的像素，并且在一个像素线上布置与水平分辨率一样多的像素。面板驱动电路在图像数据写入时段WP期间将图像显示栅极脉冲顺序地提供至显示面板100的栅极线，并且将图像显示数据写入显示面板100的所有像素。在垂直空白间隔BP中，面板驱动电路仅向连接至特定像素线的栅极线提供感测栅极脉冲，并且将感测数据写入到特定像素线的像素。
为此，数据驱动电路包括多个源极驱动器集成电路(IC)120。源极驱动器IC 120接收来自时序控制器110的图像显示数据RGB。源极驱动器IC 120响应于从时序控制器110接收的源极时序控制信号将图像显示数据RGB转换成伽马补偿电压并生成数据电压。源极驱动器IC 120将数据电压提供至显示面板100的数据线，使得数据电压与图像显示栅极脉冲同步。源极驱动器IC 120可以通过玻璃上芯片(COG)工艺或带式自动接合(TAB)工艺连接至显示面板100的数据线。
扫描驱动电路包括连接在时序控制器110与显示面板100的栅极线之间的电平移位器150和栅极移位寄存器130。
电平移位器150将从时序控制器110接收到的时钟信号CLKs的晶体管-晶体管逻辑(TTL)电平电压电平移位到能够使显示面板100的晶体管开关的栅极高电压和栅极低电压。如以上参照图1至图7I所述，栅极移位寄存器130通过具有比相关技术更简单的配置的级可以在垂直空白间隔BP中以随机顺序输出感测栅极脉冲，由此不规则地选择感测目标像素线。
扫描驱动电路可以使用板内栅极驱动器(GIP)方式直接形成在显示面板100的下基板上。在GIP方式中，电平移位器150可以安装在印刷电路板(PCB)140上，并且栅极移位寄存器130可以形成在显示面板100的下基板上。栅极移位寄存器130形成在显示面板100的其中没有显示图像的边框区域BZ中。
时序控制器110通过已知的各种接口方式接收来自外部主机系统的图像显示数据RGB。时序控制器110可以基于实时感测过程的感测结果来校正图像显示数据RGB，使得补偿像素之间的电特性的变化，并且然后可以将校正的图像显示数据RGB发送至源极驱动器IC120。
时序控制器110接收来自主机系统的诸如垂直同步信号Vsync、水平同步信号Hsync、数据使能信号DE和主时钟MCLK的时序信号。时序控制器110基于来自主机系统的时序信号生成用于控制数据驱动电路的操作时序的数据时序控制信号和用于控制扫描驱动电路的操作时序的扫描时序控制信号。
扫描时序控制信号包括线采样信号LSP、全局重置信号RESET、全局起始信号VSP、时钟信号CLKs等。
数据时序控制信号包括源极采样时钟SSC、源极输出使能信号SOE等。源极采样时钟SSC是基于上升沿或下降沿来控制源极驱动器IC 120内的数据的采样时序的时钟信号。源极输出使能信号SOE是控制数据电压的输出时序的信号。
本公开内容的实施方式具有以下效果。
首先，与相关技术相比，本公开内容的实施方式可以相当简化用于实现实时感测过程的栅极移位寄存器的配置。尽管栅极移位寄存器的配置简单，但是本公开内容的实施方式可以通过在垂直空白间隔中以随机顺序输出感测栅极脉冲来不规则地选择感测目标像素线。本公开内容的实施方式可以通过不规则地选择感测目标像素线来防止由顺序地感测引起的亮度变化被感知的相关技术的问题。
第二，由于本公开内容的实施方式包括具有比相关技术更简单的配置的栅极移位寄存器，因此本公开内容的实施方式可以具有发生处理故障的低概率和操作的高可靠性。
第三，当根据本公开内容的实施方式的栅极移位寄存器嵌入在显示面板中时，由于栅极移位寄存器的简单配置，本公开内容的实施方式可以减小边框尺寸。另外，因为根据本公开内容的实施方式的栅极移位寄存器不需要用于实时感测的时钟线和电源线，所以与相关技术相比，本公开内容的实施方式在功耗上更为有利。
尽管已参照多个说明性实施方式描述了实施方式，但是本领域技术人员可以设想落入本公开内容的原理的范围内的许多其他修改和实施方式。具体地，在本公开内容、附图和所附权利要求的范围内，在主题组合布置的组成部分和/或布置中可以进行各种变化和修改。除了组成部分和/或布置的变化和修改之外，替代性用途对于本领域技术人员也将是明显的。

Claims (11)

1.一种栅极移位寄存器，包括：
第一级和第二级，所述第一级和第二级被配置成在图像数据写入时段期间输出图像显示栅极脉冲、并且在其中不写入图像显示数据的垂直消隐间隔中选择性地输出感测栅极脉冲，
其中，所述第一级包括：
第一进位信号施加节点Q1、第一交替驱动节点Qbo和激活电压保持节点M；
第一感测控制块，所述第一感测控制块被配置成根据所述节点M的电压以及全局重置信号来激活所述节点Q1；以及
第二感测控制块，所述第二感测控制块被配置成根据所述节点M的电压以及所述全局重置信号来去激活所述节点Qbo，
其中，所述第二级包括：
第二进位信号施加节点Q2和第二交替驱动节点Qbe；
第三感测控制块，所述第三感测控制块被配置成根据所述节点M的电压以及所述全局重置信号来激活所述节点Q2；以及
第四感测控制块，所述第四感测控制块被配置成根据所述节点M的电压以及所述全局重置信号来去激活所述节点Qbe，
其中，所述第一级和所述第二级彼此共享其驱动所需的部分电路。
2.根据权利要求1所述的栅极移位寄存器，其中，所述第一级和所述第二级彼此共享所述节点Qbo和所述节点Qbe，
其中，所述第三感测控制块连接至所述第一感测控制块，并且所述第四感测控制块连接至所述第二感测控制块。
3.根据权利要求1所述的栅极移位寄存器，其中，在所述垂直消隐间隔中在所述全局重置信号之后输入全局起始信号，
其中，所述节点M的电压在所述图像数据写入时段中由与线采样信号同步的进位信号激活，并且保持激活状态直到所述全局起始信号被输入。
4.根据权利要求1所述的栅极移位寄存器，其中，所述第一级还包括第一输入块，并且所述第二级还包括第二输入块，所述第一输入块和所述第二输入块彼此共享节点Qh，
其中，所述第一输入块根据所述节点Q1的电压将所述节点Qh激活至高电位电源电压，
其中，所述第二输入块根据所述节点Qbe的电压将所述节点Q2连接至所述节点Qh、或者根据所述节点Qbo的电压将所述节点Q2连接至所述节点Qh。
5.根据权利要求3所述的栅极移位寄存器，其中，所述第一感测控制块包括：
晶体管Ta，所述晶体管Ta响应于所述线采样信号而接通并且被配置成将所述进位信号施加于节点N1；
晶体管Tb，所述晶体管Tb响应于所述线采样信号而接通并且被配置成将所述节点N1连接至所述节点M；
晶体管Tc，所述晶体管Tc响应于所述节点M的电压而接通并且被配置成向所述节点M施加高电位电源电压；
晶体管T1b，所述晶体管T1b响应于所述节点M的电压而接通并且被配置成向节点N3施加所述高电位电源电压；
晶体管T1c，所述晶体管T1c响应于所述全局重置信号而接通并且被配置成将所述节点N3连接至所述节点Q1；以及
电容器，所述电容器连接在所述高电位电源电压的输入端子与所述节点M之间。
6.根据权利要求5所述的栅极移位寄存器，其中，所述第三感测控制块包括晶体管T1c’，所述晶体管T1c’响应于所述全局重置信号而接通并且将所述节点N3连接至所述节点Q2。
7.根据权利要求3所述的栅极移位寄存器，其中，所述第二感测控制块包括：
晶体管T5a，所述晶体管T5a响应于所述全局重置信号而接通并且被配置成将所述节点Qbo连接至节点N4；以及
晶体管T5b，所述晶体管T5b响应于所述节点M的电压而接通并且被配置成向所述节点N4施加低电位电源电压。
8.根据权利要求7所述的栅极移位寄存器，其中，所述第四感测控制块包括晶体管T5a’，所述晶体管T5a’响应于所述全局重置信号而接通并且将所述节点Qbe连接至所述节点N4。
9.根据权利要求4所述的栅极移位寄存器，其中，所述第一输入块包括晶体管T3q，所述晶体管T3q响应于所述节点Q1的电压而接通并且向所述节点Qh施加所述高电位电源电压，
其中，所述第二输入块包括：
晶体管T31a’，所述晶体管T31a’响应于所述节点Qbe的电压而接通并且被配置成将所述节点Q2连接至所述节点Qh；以及
晶体管T32a’，所述晶体管T32a’响应于所述节点Qbo的电压而接通并且被配置成将所述节点Q2连接至所述节点Qh。
10.根据权利要求1所述的栅极移位寄存器，其中，所述第一级还包括第一输出块，所述第一输出块包括：
第一上拉晶体管，所述第一上拉晶体管响应于所述节点Q1的电压而接通并且被配置成向节点N6输出第一进位移位时钟；
第二上拉晶体管，所述第二上拉晶体管响应于所述节点Q1的电压而接通并且被配置成向节点N7输出第一扫描移位时钟；
第一下拉晶体管，所述第一下拉晶体管响应于所述节点Qbo的电压而接通并且被配置成向所述节点N6输出第一低电位电源电压；以及
第二下拉晶体管，所述第二下拉晶体管响应于所述节点Qbo的电压而接通并且被配置成向所述节点N7输出第二低电位电源电压，
其中，所述第二级还包括第二输出块，所述第二输出块包括：
第三上拉晶体管，所述第三上拉晶体管响应于所述节点Q2的电压而接通并且被配置成向节点N6’输出第二进位移位时钟；
第四上拉晶体管，所述第四上拉晶体管响应于所述节点Q2的电压而接通并且被配置成向节点N7’输出第二扫描移位时钟；
第三下拉晶体管，所述第三下拉晶体管响应于所述节点Qbo的电压而接通并且被配置成向所述节点N6’输出所述第一低电位电源电压；以及
第四下拉晶体管，所述第四下拉晶体管响应于所述节点Qbo的电压而接通并且被配置成向所述节点N7’输出所述第二低电位电源电压，
其中，所述第一进位移位时钟和所述第二进位移位时钟的摆动宽度大于所述第一扫描移位时钟和所述第二扫描移位时钟的摆动宽度，
其中，所述第一低电位电源电压小于所述第二低电位电源电压。
11.一种有机发光二极管显示器，包括：
包括栅极线的显示面板；以及
被配置成使用根据权利要求1至10中的任一项所述的栅极移位寄存器的输出来驱动所述栅极线的扫描驱动电路。
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