KR890017604A - 마이크로 컴퓨터 시스템 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 이용한 전형전인 마이크로 컴퓨터의 3차원 도면, 제2도는 본 발명을 이용한 전형적인 마이크로 컴퓨터의 단수 구성 요소에 대한 세부 블럭도, 제3도는 제2도보다 다소 더 세부적으로 장치가 동적버스 크기와 일치하지 않는 이유에 대해 이해하는데 유용하며 제조업자에 의해 추천된 80386과 82385사이의 접속 관계를 도시한 블럭도. 제4도는 제3도와 유사한 세부적 블럭도이지만 파이프라인 명령 순서와 동적버스 크기를 허용하는 본 발명의 응용을 예증하지 않는 도면.
Claims (1)
- 미정 동작의 완성에 앞서 다음 어드레스 신호에 응답하는 파이프 라인 명령 순서를 가진 마이크로 컴퓨터에 있어서, 소정 비트폭의 프로세서와, 국부 버스로 상기 프로세서에 결합된 상기 소정 비트폭의 캐쉬 메모리 서브 시스템과, 상기 소정 비트폭을 가진 최소한의 다른 성분은 상기 캐쉬 서브 시스템과 연관된 어드레스 영역에서 어드레스를 가지며 감소된 비트폭의 최소한의 한 성분이 상기 캐쉬 서브 시스템과 연관된 어드레스 영역외의 어드레스를 가지며, 상기 소정 비트폭을 가진 다른 성분 및 상기 감소된 비트폭의 최소한의 한 성분과 상기 국부 버스를 접속하는 다른 버스를 구비하며, 또한 상기 마이크로 컴퓨터 시스템은 a)상기 국부 버스에 확증된 어드레스에 응답하여 상기 확증된 어드레스가 상기 캐쉬 메모리 서브 시스템과 연관된 상기 어드레스 영역내에 존재하는지를 표시하는 신호를 발생하기 의한 어드레스 디코더 장치와, b) 상기 어드레스 디코더 장치에 응답하여, 상기 어드레스 디코더 장치가 상기 캐러 서브 시스템과 연관된 영역 외의 확증된 어드레스를 표시하면 파이프라인 동작을 위해 상기 마이크로 프로세서에 다음 어드레스 신호를 발생하기 위한 논리 장치를 구비하는 것을 특징으로 하는 마이크로 컴퓨터 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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