KR900006853A - 마이크로 프로세서 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 본 발명의 1실시예의 블럭도.
제 9 도는 명령디코더 논리의 상세한 블록도.
Claims (5)
1명령내에서 오퍼랜드의 어드레스 지정방법과 오퍼랜드에 대한 연산의 종류를 각각 독립해서 설정할 수 있는 명령을 갖는 마이크로 프로그램 제어방식의 마이크로 프로세서로서, 소정의 비트길이의 명령코드를 입력으로 하여 입력신호수보다 적은 수의 출력신호를 출력하는 조합논리회로를 가지며, 상기 조합 논리회로의 출력과 마이크로 프로그램의 적어도 일부의 비트 정보에 의해서 마이크로 프로그램의 어드레스를 생성하는 것을 특징으로 하는 마이크로 프로세서.
특허청구의 범위 제 1 항에 있어서, 상기 소정 비트길이가 8비트 길이인 것을 특징으로 하는 마이크로 프로세서.
1명령내에서 오퍼랜드의 어드레스 지정방법과 오퍼랜드에 대한 연산의 종류를 각각 독립해서 설정할 수 있는 명령을 갖는 마이크로 프로그램 제어방식의 마이크로 프로세서로서, 상기 명령의 코드길이가 소정 비트단위로 확장되고, 상기 명령의 최초의 소정 비트길이의 코드가 오퍼랜드의 지정방법을 지시하고, 상기 명령내의 상기 최초의 소정 비트길이의 코드와는 다른 소정 비트길이의 코드가 오퍼랜드에 대한 연산의 종류를 지시하며, 상기 양자의 지시에 대한 소정 비트길이의 코드체계가 동일한 것을 특징으로 하는 마이크로 프로세서.
특허청구의 범위 제 3 항에 있어서, 상기 최초의 소정 비트길이의 코드로 명령의 기능을 모두 지정할 수 있는 명령을 가지며, 상기 소정 비트길이의 코드도 상기 코드체계에 따르고 있는 것을 특징으로 하는 마이크로 프로세서.
특허청구의 범위 제 3 항 또는 제 4 항에 있어서, 상기 소정의 비트길이가 8비트 길이인 것을 특징으로하는 마이크로 프로세서.
※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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