KR940009821A - 레지스터 화일군을 공유하는 오퍼레이션 유닛을 갖춘 데이타 프로세서 - Google Patents

레지스터 화일군을 공유하는 오퍼레이션 유닛을 갖춘 데이타 프로세서 Download PDF

Info

Publication number
KR940009821A
KR940009821A KR1019930021651A KR930021651A KR940009821A KR 940009821 A KR940009821 A KR 940009821A KR 1019930021651 A KR1019930021651 A KR 1019930021651A KR 930021651 A KR930021651 A KR 930021651A KR 940009821 A KR940009821 A KR 940009821A
Authority
KR
South Korea
Prior art keywords
operation unit
data processor
data
register file
coupled
Prior art date
Application number
KR1019930021651A
Other languages
English (en)
Other versions
KR100288170B1 (ko
Inventor
루이스 반 메에르베르겐 요제프
안드리에스 힐데링크 헌드리쿠스
오제느 리챠드 립펜스 파울
델아우엘 안토이네
Original Assignee
프레데릭 얀 스미트
필립스 일렉트로닉스 엔.브이.
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 프레데릭 얀 스미트, 필립스 일렉트로닉스 엔.브이. filed Critical 프레데릭 얀 스미트
Publication of KR940009821A publication Critical patent/KR940009821A/ko
Application granted granted Critical
Publication of KR100288170B1 publication Critical patent/KR100288170B1/ko

Links

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/30098Register arrangements
    • G06F9/3012Organisation of register space, e.g. banked or distributed register file
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F15/00Digital computers in general; Data processing equipment in general
    • G06F15/76Architectures of general purpose stored program computers
    • G06F15/80Architectures of general purpose stored program computers comprising an array of processing units with common control, e.g. single instruction multiple data processors
    • G06F15/8053Vector processors
    • G06F15/8076Details on data register access
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3885Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3885Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units
    • G06F9/3889Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units controlled by multiple instructions, e.g. MIMD, decoupled access or execute
    • G06F9/3891Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units controlled by multiple instructions, e.g. MIMD, decoupled access or execute organised in groups of units sharing resources, e.g. clusters

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Software Systems (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Computing Systems (AREA)
  • Executing Machine-Instructions (AREA)
  • Advance Control (AREA)

Abstract

모듈 방식 구조인 데이타 프로세서는 다수의 오퍼레이션 유닛을 구비하는데, 각각 프로세서의 오퍼레이션을 결정하는 명령어 세트에 의해 요구되는 대로 특정 기능들을 구현하는데 이용된다. 오퍼레이션 유닛간에 몇몇에 대한 레지스터 화일이 병합된다. 어쨌든, 명령어 사이클 수의 단지 마진(margin)증가의 부담으로, IC실시예에서 더욱 레지스터 화일 영역이 작아지고, 레지스터 화일 제어회로가 줄어들고 마이크로코드 워드가 더욱 단순화된다.

Description

레지스터 화일군을 공유하는 오퍼레이션 유닛을 갖춘 데이타 프로세서
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 데이타 프로세서의 모듈 방식 구조에 대한 예시도,
제2도는 제1도의 구조를 구현하기 위한 종래 기술의 조립 블록도,
제3도는 제1도의 데이타 프로세서를 구현하는 본 발명의 조립 블록도에 대한 예시도.

Claims (5)

  1. 각각 개별적인 데이타를 수신하고 개별적인 데이타에 대해 데이타 처리 오퍼레이션중의 개별적인 오퍼레이션을 실행하는 제1다수의 오퍼레이션 유닛을 갖는 데이타 처리 수단 및 데이타 처리 수단에 결합되고 데이타 처리수단에 데이타를 제공하기에 앞서 데이타를 기억시키도록 동작하며, 제2다수의 레지스터 화일로 구성되는 레지스터 화일 수단을 구비하는 데이타 프로세서로서, 오퍼레이션 유닛의 각각의 특정 유닛은 레지스터 화일의 특정화일에 결합되는 데이타 프로세서에 있어서, 레지스터 화일의 적어도 하나는 적어도 두 개의 오퍼레이션 유닛에 결합되는 것을 특징으로 하는 데이타 프로세서.
  2. 제1항에 있어서, 제1다수의 오퍼레이션 유닛은 상호간의 비단일형(non-uniform)인 것을 특징으로 하는 데이타 프로세서.
  3. 제1항에 있어서, 상기 레지스터 화일중의 제1화일은 제1오퍼레이션 유닛 및 제2오퍼레이션 유닛에 결합되는데, 상기 제1오퍼레이션 유닛은 이항(dyadic) 오퍼레이션을 실행하고 상기 제2오퍼레이션 유닛은 단항(monadic) 오퍼레이션을 실행하도록 동작하는 것을 특징으로 하는 데이타 프로세서.
  4. 제3항에 있어서, 상기 제1오퍼레이션 유닛을 메모리를 구비하고 제2오퍼레이션 유닛은 어드레스 계산 유닛을 구비하는 것을 특징으로 하는 데이타 프로세서.
  5. 제1항에 있어서, 집적 회로 칩에 구현되는 것을 특징으로 하는 데이타 프로세서.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930021651A 1992-10-19 1993-10-19 레지스터 화일군을 공유하는 연산 유닛을 갖춘 데이타 처리기 KR100288170B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
EP92203192.7 1992-10-19
EP92203192 1992-10-19

Publications (2)

Publication Number Publication Date
KR940009821A true KR940009821A (ko) 1994-05-24
KR100288170B1 KR100288170B1 (ko) 2001-05-02

Family

ID=8210979

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019930021651A KR100288170B1 (ko) 1992-10-19 1993-10-19 레지스터 화일군을 공유하는 연산 유닛을 갖춘 데이타 처리기

Country Status (4)

Country Link
US (1) US5613152A (ko)
JP (1) JP3595562B2 (ko)
KR (1) KR100288170B1 (ko)
DE (1) DE69327504T2 (ko)

Families Citing this family (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5713039A (en) * 1995-12-05 1998-01-27 Advanced Micro Devices, Inc. Register file having multiple register storages for storing data from multiple data streams
JP2869379B2 (ja) * 1996-03-15 1999-03-10 三菱電機株式会社 プロセッサ合成システム及びプロセッサ合成方法
US6006296A (en) * 1997-05-16 1999-12-21 Unisys Corporation Scalable memory controller
JPH1131137A (ja) * 1997-07-11 1999-02-02 Nec Corp レジスタファイル
WO1999009472A1 (en) * 1997-08-18 1999-02-25 Koninklijke Philips Electronics N.V. Data processing device with relative jump instruction
US6820189B1 (en) 1999-05-12 2004-11-16 Analog Devices, Inc. Computation core executing multiple operation DSP instructions and micro-controller instructions of shorter length without performing switch operation
US7111155B1 (en) 1999-05-12 2006-09-19 Analog Devices, Inc. Digital signal processor computation core with input operand selection from operand bus for dual operations
EP2267597A3 (en) * 1999-05-12 2012-01-04 Analog Devices, Inc. Digital signal processor having a pipeline structure
US7107302B1 (en) 1999-05-12 2006-09-12 Analog Devices, Inc. Finite impulse response filter algorithm for implementation on digital signal processor having dual execution units
US6859872B1 (en) 1999-05-12 2005-02-22 Analog Devices, Inc. Digital signal processor computation core with pipeline having memory access stages and multiply accumulate stages positioned for efficient operation
JP3776644B2 (ja) 1999-10-05 2006-05-17 富士通株式会社 パイプライン演算装置、情報処理装置およびパイプライン演算装置の演算方法
JP2001167066A (ja) * 1999-12-08 2001-06-22 Nec Corp プロセッサ間通信方法及びマルチプロセッサシステム
ATE394755T1 (de) * 2000-06-20 2008-05-15 Nxp Bv Datenverarbeitungsgerät
US6895520B1 (en) 2001-03-02 2005-05-17 Advanced Micro Devices, Inc. Performance and power optimization via block oriented performance measurement and control
US7315934B2 (en) * 2002-03-06 2008-01-01 Matsushita Electric Industrial Co., Ltd. Data processor and program for processing a data matrix
US7246218B2 (en) * 2004-11-01 2007-07-17 Via Technologies, Inc. Systems for increasing register addressing space in instruction-width limited processors
US9367462B2 (en) 2009-12-29 2016-06-14 Empire Technology Development Llc Shared memories for energy efficient multi-core processors

Family Cites Families (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3978452A (en) * 1974-02-28 1976-08-31 Burroughs Corporation System and method for concurrent and pipeline processing employing a data driven network
US4388685A (en) * 1978-08-04 1983-06-14 Digital Equipment Corporation Central processor with apparatus for extended virtual addressing
US4293907A (en) * 1978-12-29 1981-10-06 Bell Telephone Laboratories, Incorporated Data processing apparatus having op-code extension register
US4348720A (en) * 1979-08-31 1982-09-07 Bell Telephone Laboratories, Incorporated Microcomputer arranged for direct memory access
EP0172522B1 (en) * 1981-10-22 1991-01-02 Nec Corporation Data processing machine suitable for high-speed processing
JPS58134357A (ja) * 1982-02-03 1983-08-10 Hitachi Ltd ベクトルプロセッサ
US4835733A (en) * 1985-09-30 1989-05-30 Sgs-Thomson Microelectronics, Inc. Programmable access memory
US4766566A (en) * 1986-08-18 1988-08-23 International Business Machines Corp. Performance enhancement scheme for a RISC type VLSI processor using dual execution units for parallel instruction processing
JPH077388B2 (ja) * 1988-09-13 1995-01-30 富士通株式会社 ベクトル演算処理装置
US5241635A (en) * 1988-11-18 1993-08-31 Massachusetts Institute Of Technology Tagged token data processing system with operand matching in activation frames
US4980819A (en) * 1988-12-19 1990-12-25 Bull Hn Information Systems Inc. Mechanism for automatically updating multiple unit register file memories in successive cycles for a pipelined processing system
JP2879070B2 (ja) * 1989-02-15 1999-04-05 コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ プログラム可能論理ユニット及び信号プロセッサ
US5301340A (en) * 1990-10-31 1994-04-05 International Business Machines Corporation IC chips including ALUs and identical register files whereby a number of ALUs directly and concurrently write results to every register file per cycle

Also Published As

Publication number Publication date
KR100288170B1 (ko) 2001-05-02
DE69327504D1 (de) 2000-02-10
JP3595562B2 (ja) 2004-12-02
DE69327504T2 (de) 2000-08-10
US5613152A (en) 1997-03-18
JPH06222920A (ja) 1994-08-12

Similar Documents

Publication Publication Date Title
KR940009821A (ko) 레지스터 화일군을 공유하는 오퍼레이션 유닛을 갖춘 데이타 프로세서
KR930018378A (ko) 캐쉬 메모리 시스템의 성능최적화 방법 및 장치
US3760369A (en) Distributed microprogram control in an information handling system
KR910010301A (ko) 명령 지정방법 및 실행장치
KR830009518A (ko) 병렬처리용(竝列處理用)데이터 처리 시스템
KR940015852A (ko) 긴 명령 워드를 갖는 처리기
KR830008252A (ko) 데이타 처리 시스템
KR900016866A (ko) 데이타 처리 시스템
KR950033803A (ko) 다중 비트 시프트 장치, 이것을 이용한 데이타 프로세서, 및 다중 비트 시프트 방법
DE69230057D1 (de) Risc mikroprozessorarchitektur mit mehrere registersätze von unterschiedlichen typen
KR870004366A (ko) 데이터 처리 시스템
KR920004964A (ko) 2개의 명령을 동시에 실행할 수 있는 데이타 프로세서
KR920020315A (ko) 병렬프로세서
KR920015910A (ko) 연산회로
KR850002906A (ko) 다중 데이타 통로 중앙 처리 유니트 구조
KR870004367A (ko) 데이터 처리 시스템
KR930022198A (ko) 데이타 처리 장치
KR900006853A (ko) 마이크로 프로세서
EP0035334B1 (en) Data processing system with two level microprogramming
DE3586564D1 (de) Programmierbares ein-chip-steuergeraet.
KR840005575A (ko) 비동기 버스 멀티프로세서(multiprocessor:다중처리장치) 시스템
GB1532609A (en) Data processing apparatus
KR940004440A (ko) 데이타처리장치
JPH0640303B2 (ja) デ−タ処理装置
SE7509282L (sv) Elektronisk dator.

Legal Events

Date Code Title Description
N231 Notification of change of applicant
A201 Request for examination
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20070126

Year of fee payment: 7

LAPS Lapse due to unpaid annual fee