KR940004446A - 버스 인터페이스 장치 - Google Patents

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KR940004446A
KR940004446A KR1019920014462A KR920014462A KR940004446A KR 940004446 A KR940004446 A KR 940004446A KR 1019920014462 A KR1019920014462 A KR 1019920014462A KR 920014462 A KR920014462 A KR 920014462A KR 940004446 A KR940004446 A KR 940004446A
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오두환
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강진구
삼성전자 주식회사
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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14—Handling requests for interconnection or transfer
    • G06F13/36—Handling requests for interconnection or transfer for access to common bus or bus system

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Abstract

본 발명은 디지탈처리 시스템에 있어서 버스 인터페이스 장치에 관한 것으로, 특히 입출력장치 및 네트워장치와의 직접 인터페이스를 위한 버스 인터페이스 장치에 관한 것이다.
이를 위하여 LAN 제어기 또는 SCSI제어기와 입출력버스 제어기사이에서 어드레스유효신호를 직접 인터페이스시키기 위한 인터페이스 논리부를 포함한다.
따라서 LAN제어기와 SCSI제어기를 입출력버스 제어기를 직접 인터페이스하여 버스 단위 트랜잭션을 짧게 함으로서 빠른 보조기억장치 액세스와 LAN 액세스를 할 수 있는 효과가 있다.

Description

버스 인터페이스 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 버스 인터폐이스장치의 블럭도.
제3도는 본 발명에 따른 버스 인터페이스장치의 회로도.

Claims (2)

  1. 입출력버스 제어기(10)와 입출력처리기(30)와 LAN제어기(20) 또는 SCSI제어기(40)를 구비한 디지탈처리 시스템에 있어서, 상기 LAN제어기(20) 또는 SCSI제어기(40)와 입출력버스제어기(l0) 사이에서 어드레스유효신호를 직접 인터페이스시키기 위한 인터페이스 논리부(50)를 포함함을 특징으로 하는 버스 인터페이스장치.
  2. 제1항에 있어서, 상기 인터페이스 논리부(50)는 병렬처리를 할 수 있는 파이프라인모드와 버스에러로인해 시스템이 정지하는 현상(Hang-up)을 방지하는 예외처리므드를 제어가능함을 특징으로 하는 버스인터페이스장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920014462A 1992-08-12 1992-08-12 버스 인터페이스 장치 KR950009576B1 (ko)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100383765B1 (ko) * 1999-12-27 2003-05-14 주식회사 하이닉스반도체 반도체 소자의 트랜지스터 제조방법
KR100984856B1 (ko) * 2003-10-07 2010-10-04 매그나칩 반도체 유한회사 반도체소자의 형성 방법

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KR100383765B1 (ko) * 1999-12-27 2003-05-14 주식회사 하이닉스반도체 반도체 소자의 트랜지스터 제조방법
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