KR890016471A - 반도체 장치에 있어서 데이타 출력 버퍼회로 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 따른 회로도, 제5도는 본 발명에 따른 제4도의 동작 타이밍.
Claims (2)
- 반도체 장치의 센스증폭 출력단(SAS,)를 통해 출력된 데이타의 출력버퍼회로에 있어서, 상기 센스증폭 출력단(SAS,)의 데이타를 반전하는 반전수단과, 상기 반전수단의 출력과 출력 인에이블의 반전신호를 받아 논리화하여 출력드라이빙 제어신호를 발생하는 논리수단과, 상기 논리수단의 드라이빙 제어신호에 의해 출력을 드라이빙하는 출력 드라이버 수단과, 상기 데이타의 어드레스 천이감지 신호에 의해 제어되며 상기 출력 드라이버 수단에서 출력 데이타 버스를 고속으로 프리차아징 되도록 드라이빙하는 프리차아징 드라이버 수단으로 구성됨을 특징으로 하는 회로.
- 제1항에 있어서, 프리차아징수단이 상기 어드레스 천이감지 신호에 따라 동시에 스위칭되는 제1,2 트랜지스터와, 상기 제1트랜지스터의 소오스단관 제2트랜지스터의 드레인단간에 게이트단이 출력단과 같이 결합되고 상기 출력 드라이버 수단의 출력신호가 게이팅신호로 입력 궤환되어 고속의 프리차아징을 실현하는 제3트랜지스터의 드레인단과 제1전원단과 결합되고 제2트랜지스터 소오스단과 제2전원단과 연결되어 상기출력 드라이버수단의 출력신호가 게이팅신호로 입력되어 고속의 프리차아징을 실현하는 제4트랜지스터로 구성됨을 특징으로 하는 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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