KR920001844A - 플립플롭 회로 및 그 로직 상태 제공 방법 - Google Patents

플립플롭 회로 및 그 로직 상태 제공 방법 Download PDF

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KR920001844A
KR920001844A KR1019910009492A KR910009492A KR920001844A KR 920001844 A KR920001844 A KR 920001844A KR 1019910009492 A KR1019910009492 A KR 1019910009492A KR 910009492 A KR910009492 A KR 910009492A KR 920001844 A KR920001844 A KR 920001844A
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KR
South Korea
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input
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signal
flip
input data
Prior art date
Application number
KR1019910009492A
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English (en)
Inventor
케이. 마하바디 죤
Original Assignee
빈센트 죠셉 로너
모토로라 인코포레이티드
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Filing date
Publication date
Application filed by 빈센트 죠셉 로너, 모토로라 인코포레이티드 filed Critical 빈센트 죠셉 로너
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    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
    • H03K3/027—Generators characterised by the type of circuit or by the means used for producing pulses by the use of logic circuits, with internal or external positive feedback
    • H03K3/037—Bistable circuits
    • H03K3/0375—Bistable circuits provided with means for increasing reliability; for protection; for ensuring a predetermined initial state when the supply voltage has been applied; for storing the actual state when the supply voltage fails
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
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    • H03K3/356104—Bistable circuits using complementary field-effect transistors
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    • H03K3/356147—Bistable circuits using complementary field-effect transistors using additional transistors in the input circuit using pass gates
    • H03K3/356156—Bistable circuits using complementary field-effect transistors using additional transistors in the input circuit using pass gates with synchronous operation

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Abstract

내용 없음

Description

플립플롭 회로 및 그 로직 상태 제공 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 양호한 실시예를 설명하는 개략도면.
제2도는 본 발명의 전송 게이트를 설명하는 개략도면.
제3도는 본 발명을 설명하는데 사용하는 파형 플롯.

Claims (3)

  1. 입력에 공급된 출력 및 입력 데이타 신호를 래칭하기 위해 클럭 신호에 응답하는 플립플롭 회로로서, 입력 데이타 신호가 클럭 신호의 제1부분 동에는 중간 노드를 통해 전달되고 상기 클럭 신호의 제2부분 동안에는 출력을 통해 전달되는 곳인 중간 노드를 갖고 있으며 입력에 공급된 입력 신호를 전달하기 위해 입력과 출력사이에 연결된 회로 수단과, 입력 데이타 신호의 반전 상태를 수신하기 위해 연결되는 게이트와, 동작 전위의 제1소스에 연결되는 소스와, 상기 중간 노드에 연결되는 드레인을 가지는 제1트랜지스터와, 상기 입력 데이타 신호의 반전 상태를 수신하기 위해 연결되는 게이트와, 동작 전위의 제2소스에 연결되는 소스와, 상기 중간 노드에 연결되는 드레인을 가지는 제2트랜지스터를 구비하는 플립플롭 회로.
  2. 입력 데이타 신호가 클럭 신호의 제1부분 동안에는 중간 노드를 통해 전달되고 클럭 신호의 제2부분 동안에는 출력을 통해 전달되는 곳인 중간 노드를 가지고 입력 신호를 전달하기 위해 입력과 출력 사이에 연결된 회로수단을 구비하여 클럭 신호에 응답하여 출력에서 입력 데이타 신호를 래칭하기 위한 플립플롭 회로에 있어서, 게이트와 동작 전위의 제1소스에 연결되는 소스와, 상기 중간 노드에 연결되는 드레인을 가지는 제1트랜지스터와, 입력과 제1트랜지스터의 게이트 사이에 연결된 제1인버터와, 게이트와, 동작 전위의 제2소스에 연결되는 소스와, 상기 중간 노드에 연결되는 드레인을 가지는 제2트랜지스터와, 입력과 상기 제2트랜지스터의 게이트 사이에 연결된 제2인버터를 구비하는 플립플롭 회로.
  3. 입력 데이타 신호가 공급된 클럭 신호의 엣지의 상태로 변화할 때 플립플롭 회로의 출력 신호에 대해 공지된 로직 상태 제공 방법으로서, 클럭 신호의 제1부분동안 입력에서 중간 노드까지 입력 데이타 신호를 전달하는 단계와, 상기 중간 노드에서 기억된 신호를 입력 데이타 신호의 중간 로직 상태에 구동하기 위한 부스트 신호를 공급하는 단계를 포함하는 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910009492A 1990-06-11 1991-06-10 플립플롭 회로 및 그 로직 상태 제공 방법 KR920001844A (ko)

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US07/535,618 US5001371A (en) 1990-06-11 1990-06-11 Meta-stable free flipflop

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