JPH07160218A - 面放電型プラズマディスプレイパネルの駆動方法及び駆動回路 - Google Patents

面放電型プラズマディスプレイパネルの駆動方法及び駆動回路

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JPH07160218A
JPH07160218A JP5310937A JP31093793A JPH07160218A JP H07160218 A JPH07160218 A JP H07160218A JP 5310937 A JP5310937 A JP 5310937A JP 31093793 A JP31093793 A JP 31093793A JP H07160218 A JPH07160218 A JP H07160218A
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Abstract

(57)【要約】 【目的】アドレス放電のための印加電圧の採り得る範囲
をより広くし又黒色表示の輝度を低減することにより表
示品質を向上させる。 【構成】リセット期間では、維持電極ＸとＹｓ間の放電
開始電圧より高い電圧且つ放電により維持電極Ｙｉ側に
生ずる壁電荷と維持電極Ｘ側に生ずる壁電荷との間の電
圧を該放電開始電圧より高くするための電圧のパルス
を、電極ＸとＹｓ間に印加し、この際、アドレス電極電
位を、電極ＸとＹｓの両電位の略平均値にする。アドレ
ス期間では、選択した電極Ｙｓに電位−Ｖｓのパルスを
印加し、同時に、点灯させるアドレス電極Ａａに電位Ｖ
ａのパルスを印加する。ここに、Ｖｓmin≦Ｖｓ＜Ｖｆx
ymin、Ｖａ＋Ｖｓ≧Ｖｆaymaxであり、Ｖｓminは維持放
電持続可能な最小電圧、Ｖｆxyminは電極ＸとＹ１〜Ｙ
ｎとの間の最小放電開始電圧、Ｖｆaymaxは、アドレス
電極Ａ１〜Ａｍと維持電極Ｙ１〜Ｙｎとの間の最大放電
開始電圧である。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、面放電型プラズマディ
スプレイパネルの駆動方法及び駆動回路に関する。
【０００２】
【従来の技術】
［第１従来例］図１４は、３電極を有する面放電型プラ
ズマディスプレイパネル（以下、ＰＤＰと言う）の第ｉ
行第ｊ列の画素を構成するセル１０の断面概略構成を示
す。紙面垂直方向に延びた一対の維持電極Ｘ及びＹｉ
は、ガラス基板１１上に形成され、その上に壁電荷保持
用の誘電帯層１２が被着され、さらにその上にＭｇＯ保
護膜１３が被着されている。一方、紙面左右方向に延び
たアドレス電極Ａｊは、ガラス基板１１と対向配置され
たガラス基板１４上に形成され、その上に蛍光体１５が
被着されている。蛍光体１５は、誘電体でもある。ま
た、ガラス基板１４上には、画素境界に隔壁１６が形成
されている。ＭｇＯ保護膜１３と蛍光体１５との間の放
電空間１７には、例えばＮｅ＋Ｘｅペニング混合ガスが
封入されている。
【０００３】ＰＤＰは、ｎ×ｍ画素、すなわち、ｉ＝１
〜ｎ、ｊ＝１〜ｍとする。任意の維持電極Ｙｉとアドレ
ス電極Ａｊとの交差部の点灯／消灯を可能にするため
に、維持電極Ｙ１〜Ｙｎ間及びアドレス電極Ａ１〜Ａｍ
間は互いに絶縁されている。これに対し、各維持電極Ｙ
１〜Ｙｎと互いに平行に対になっている維持電極Ｘは、
端部で共通に接続されている。
【０００４】図１５は、従来の第１のＰＤＰ駆動方法を
示す電極印加電圧波形図であり、１駆動サイクル分を示
す。この駆動方法は、線順次・自己消去アドレス方式で
あり、維持電極Ｙｉは、維持電極Ｙ１〜Ｙｎの順に１つ
ずつ選択される。以下、選択された維持電極ＹｉをＹｓ
で表し、非選択の維持電極ＹｉをＹｔで表す。例えばｓ
＝１のとき、ｔ＝２〜ｎである。また、維持電極Ｙｓを
含む１行分のセルを選択ラインと称し、維持電極Ｙｔを
含む１行分のセルを非選択ラインと称する。さらに、選
択ラインのうち、点灯させるセルに対応したアドレス電
極ＡｊをＡａで表し、消灯させるセルに対応したアドレ
ス電極ＡｊをＡｂで表す。
【０００５】（ａ）維持電極Ｙｔを０Ｖにした状態で、
維持電極Ｘに電位ＶＷの書き込みパルスが印加され、同
時に、維持電極Ｙｓに電位ＶＳのパルスが印加される。
維持電極ＸとＹｉとの間の放電開始電圧をＶｆxyとする
と、電位ＶＷは、 ＶＳ＋ＶＷ＞Ｖｆxy＞ＶＷ ・・・（１） を満たすように定められ（電位ＶＳは後述のように定め
られる）、選択ラインのみ、その全セルについて維持電
極ＸとＹｓとの間で書き込み放電Ｗが生ずる。この際、
放電が進むにつれて、選択ラインの維持電極Ｘの上方の
保護膜１３の表面（以下、維持電極Ｘ側と言う）には電
子である負の壁電荷が蓄積され、一方、維持電極Ｙｓの
上方の保護膜１３の表面（以下、維持電極Ｘ側と言う）
にはイオンである正の壁電荷が蓄積される。これら壁電
荷は放電空間内の電界強度を低減させるので、放電は直
ちに収束に向かい、１〜数μｓで終結する。終結したと
きの壁電荷による電圧をＶwall1で表す。
【０００６】（ｂ）維持電極Ｙｓ及びＹｔを０Ｖにした
状態で、維持電極Ｘに電位−ＶＳの維持パルスが印加さ
れる。電位ＶＳは、 ＶＳ＋Ｖwall1＞Ｖｆ＞ＶＳ ・・・（２） を満たすように定められる。これにより、選択ラインの
みについて維持電極ＸとＹｓとの間で維持放電Ｓが生
じ、前回とは逆に、維持電極Ｘ側に正の壁電荷が蓄積さ
れ、維持電極Ｙｓ側に負の壁電荷が蓄積される。
【０００７】（ｃ）維持電極Ｘ、Ｙｔ及びアドレス電極
Ａａを０Ｖにした状態で、維持電極Ｙｓに電位−ＶＳの
維持パルスが印加され、同時に、アドレス電極Ａｂに電
位−ＶＡのアドレスパルスが印加される。これにより、
選択ラインの維持電極ＸとＹｓとの間で維持放電が生じ
る。アドレス電極ＡｊとＹｉとの間の放電開始電圧をＶ
ｆayとし、維持電極Ｙｓの壁電荷の電位をＶwall2する
と、電位ＶＡは、 ＶＡ＋ＶＳ＋Ｖwall2＞Ｖｆay＞ＶＳ ・・・（３）を 満たすように定められる。これにより、選択ラインの消
灯させるセルについてはさらに、アドレス電極Ａｂと維
持電極Ｙｓとの間でも同時にアドレス放電が生じ、維持
電極Ｙｓ側には正の壁電荷が過剰に蓄積される。電位Ｖ
Ａはまた、このアドレス放電後、維持電極Ｘ、Ｙｓ及び
アドレス電極Ａｂを共に０Ｖとしたときに、壁電荷自身
で維持電極ＸとＹｉ間で放電が生ずるように定められ
る。しかし、この自己消去放電は、壁電荷量が充分でな
く且つアドレスパルス印加後に充分な時間を確保できな
いので、壁電荷が残る場合がある。この残留壁電荷は、
維持パルスの上乗せで維持放電が生じなければ問題な
い。
【０００８】この自己消去放電が生じたセルは、これ以
降に維持電極ＸとＹｉとに交互に維持パルスが印加され
ても、維持放電が生ぜず、消灯状態になる。これに対
し、点灯させるセルに対してはアドレス電極Ａｊにアド
レスパスルが印加されないため、維持パルスにより維持
放電を繰り返し、点灯状態となる。各表示ラインの駆動
サイクルの変化を図１６に示す。横軸は時間であり、縦
軸は表示ラインである。図中、Ｗは表示データ書換え駆
動サイクル、Ｓは現フィールドの維持放電のみの駆動サ
イクル、ｓは前フィールドの維持放電のみの駆動サイク
ルである。
【０００９】［第２従来例］図１７は、従来の第２のＰ
ＤＰ駆動方法を示す電極印加電圧波形図であり、１サブ
フィールド分を示している。この駆動方法は、アドレス
／維持放電分離型・自己消去アドレス方式であり、１サ
ブフィールドは、全セルの壁電荷を少し残した状態にす
るためのリセット期間と、点灯させる画素に対し後の維
持放電が可能な程度に壁電荷をアドレス放電により蓄積
させるためのアドレス期間と、壁電荷に維持パルスを上
乗せして、アドレス放電が生じたセルに対してのみ維持
放電を生じさせるための維持放電期間とに分けられる。
【００１０】（ａ）リセット期間では、最初に、維持電
極Ｙ１〜Ｙｎを０Ｖにした状態で、維持電極Ｘに電位Ｖ
Ｓ＋ＶＷの書き込みパルスが印加される。電位ＶＷは、
上式（１）を満たすように定められており、維持電極Ｘ
とＹ１〜Ｙｎとの間で全面書き込み放電Ｗが生ずる。 （ｂ）維持電極Ｘを０Ｖにした状態で、維持電極Ｙ１〜
Ｙｎに電位ＶＳの維持パルスが印加される。電位ＶＳ
は、上式（２）を満たすように定められており、維持電
極ＸとＹ１〜Ｙｎとの間で全面維持放電Ｓが生ずる。
【００１１】（ｃ）維持電極Ｙ１〜Ｙｎを０Ｖにした状
態で、電位ＶＳより低い電位の消去パルスが維持電極Ｘ
に印加され、同時に、アドレス電極Ａｂに電位−ＶＳの
アドレスパルスが印加される。これにより、一部の壁電
荷が中和されて、壁電荷の削減が行われる。このとき、
維持電極Ｙ１〜Ｙｎに残った負の壁電荷は、低い電位Ｖ
Ａで次のアドレス放電を生じさせるのに役立つ。この壁
電荷の量は、アドレス期間でアドレス放電を行わなかっ
たセルに対し維持放電期間で維持パルスにより維持放電
が生じない程度にする必要がある。
【００１２】次に、アドレス期間に移る。 （ｄ）維持電極Ｘ及びＹ１〜Ｙｎを電位ＶＳにする。 （ｅ）維持電極Ｙ１を選択し、すなわち維持電極Ｙ１〜
ＹｎのうちＹ１のみにスキャンパルスが印加され、同時
に、選択ラインの点灯させるセルについてのみアドレス
電極Ａａに電位ＶＡのアドレスパルスが印加されて、書
き込み放電を生じさせる。以下、維持電極Ｙ２〜Ｙｎを
順次選択して、書き込み放電を生じさせる。次に、維持
放電期間に移る。
【００１３】（ｆ）維持電極Ｙ１〜Ｙｎの電圧波形を互
いに同一にし、維持電極ＸとＹとに交互に維持パルスが
印加されて、アドレス期間で書き込みを行ったセルを点
灯させる。
【００１４】
【発明が解決しようとする課題】
［第１の問題］しかし、図１７の駆動方法では、アドレ
ス放電を低くするためにリセット期間で壁電荷を残留さ
せるので、残留壁電荷のばらつきや変化により、全ての
条件下で安定に動作する電位ＶＡの採り得る範囲が狭く
なったり、電位ＶＡの最適値が変化して、動作が不安定
になり、表示品質が低下するという問題があった。残留
壁電荷のばらつきや変化は、次のような原因により生ず
る。
【００１５】（１）全面書き込み放電によって作られる
壁電荷は、前のサブフィールドの点灯状態に依存する。 （２）ＰＤＰの電極も含めた駆動回路のインピーダンス
が温度によって変動し、このインピーダンスが放電特性
に影響する。 （３）セルの放電特性が温度に依存する。
【００１６】図１５の駆動方法においても、アドレス放
電前に維持電極Ｘ及びＹｓに壁電荷が蓄積されているの
で、前記と同様の問題が生ずる。 ［第２の問題］また、図１７の駆動方法では、維持放電
期間の長短、すなわち、維持パルスの回数によって、輝
度が決定される。
【００１７】そこで、図１８に示す如く、１フレームを
例えば８個のサブフィールドＳＦ１〜ＳＦ８に区分し、
サブフィールドＳＦ１〜ＳＦ８の維持放電期間の比を
１：２：４：８：１６：３２：６４：１２８とすること
により、２５６階調表示を行うことができる。画面の書
換えを６０Ｈｚとすると、１フレームは１６．６μｓと
なる。１フレーム内の維持放電を５１０サイクル（１サ
イクルで２回放電）とすると、サブフィールドＳＦ１〜
ＳＦ８の維持放電のサイクル数はそれぞれ２、４、８、
隔壁１６、３２、６４、１２８及び２５６となる。維持
放電周期を８μｓとすると、１フレーム内での維持放電
期間の合計は４．０８μｓとなる。各サブフィールドの
リセット期間に５０μｓ程度必要とすると、５００ライ
ンのＰＤＰを駆動するためには、１アドレスサイクルは
３μｓとなる。
【００１８】リセット期間での２〜３回の放電は、壁電
荷の分布をより均一にするので、後の安定動作のために
大きな役割を果たしているが、黒色表示でもこの放電で
発光するため、コントラストの低下を招く。例えば、図
１７及び図１８に示す駆動方式において、１フレーム内
の維持放電回数を５１０×２＝１０２０とする。１サブ
フィールド内のリセット期間では、全面書き込み放電と
維持放電と消去放電との３回の放電がある。この放電
は、維持放電期間での維持放電よりも規模が大きいの
で、この３回の放電による明るさは、通常の維持放電の
５回分程度に相当する。したがって、最大輝度と、最小
輝度である黒色表示の輝度との比は、１０２０：５×８
＝２６：１となる。
【００１９】これは、暗室中での値であるが、照明のあ
る室内では、ＰＤＰの表面反射も加わるため、コントラ
ストがより低い値となる。このため、高階調表示を行う
意味が無くなる。また、映像表示においては、黒レベル
が表示品質の重要なファクターであることからも、好ま
しくない。図１５の駆動方法においても、選択ラインの
全セルについて、書き込み放電Ｗと、次の維持放電Ｓ
と、アドレス放電と並行して消灯させるセルについても
行われる維持放電Ｓとの計３回の放電が、最大輝度と黒
色表示の最小輝度との比を低下させるという前記同様の
問題が生ずる。
【００２０】本発明の第１の目的は、上記問題点に鑑
み、アドレス放電のための印加電圧の採り得る範囲をよ
り広くすることにより、表示品質を向上させることがで
きる面放電型プラズマディスプレイパネルの駆動方法及
び駆動回路を提供することにある。本発明の第２の目的
は、黒色表示の輝度を低減することにより、表示品質を
向上させることができる面放電型プラズマディスプレイ
パネルの駆動方法及び駆動回路を提供することにある。
【００２１】
【課題を解決するための手段及びその作用】図１及び図
２は、本発明に係る面放電型プラズマディスプレイパネ
ル駆動方法の特徴部分の原理構成を示す。本第１発明で
は、第１基板に第１及び第２の電極が互いに平行に、表
示ライン毎に対をなして配置され、該第１基板又は該第
１基板と離間して対向配置された第２基板に、該第１及
び第２の電極と離間して交差するように第３電極Ａｊが
配置され、該第１及び第２の電極の表面が壁電荷蓄積用
の誘電体層で被われ、該第２基板側に蛍光体が形成さ
れ、該第１基板と該第２基板との間の空間に放電用のガ
スが封入され、該第１及び第２の電極と第３電極Ａｊと
の各交差部にセルが形成された面放電型プラズマディス
プレイパネルに対し、該誘電体の表面の電荷分布を均一
にさせるために互いに隣接した該第１と第２の電極間に
第１電圧のパルスを印加して放電させるリセット工程
と、点灯させる該セルの該誘電体表面の第１電極Ｘに対
応した部分及び第２電極Ｙｉに対応した部分にそれぞれ
一定量以上で極性が互いに逆の第１及び第２の壁電荷を
蓄積させるために、第２電極Ｙｉと、点灯させる該セル
に対応した第３電極Ａｊとの間に第２電圧のパルスを印
加して放電させる書き込み工程と、該第１と第２の壁電
荷間の第３電圧と、該第３電圧と同一極性で第１電極Ｘ
と第２電極Ｙｉとの間に印加する第４電圧との和が第１
の放電開始電圧以上になる該セルを点灯させ、放電毎に
該第１壁電荷及び該第２壁電荷の極性が逆になるように
するために、互いに隣接した該第１と第２の電極間に該
第４電圧のパルスとして交流電圧パルスを印加する維持
放電工程と、を繰り返し実行し、毎回の維持放電工程の
最後の該交流電圧パルスの極性が、該リセット工程での
第１電圧のパルスの極性と逆になっている面放電型プラ
ズマディスプレイパネル駆動方法において、例えば図２
に示す如く、該第１電圧のパルスは、該第１の放電開始
電圧より高く且つ放電により生ずる該第３電圧が該第１
の放電開始電圧より高くなる電圧パルスであり、該第１
電圧のパルス印加後の該第１、第２及び第３の電極の電
位を互いに等しくする。
【００２２】図１では第２電極Ｙｉが第２基板に形成さ
れているが、本発明は、公知の構成のように、第２電極
Ｙｉが第１基板側の、第１電極Ｘ及び第２電極Ｙｉに対
し該第２基板側又はこれと反対側に形成されていても適
用可能である。本第１発明のリセット工程での動作を、
図１及び図２を参照して説明する。 （ａ）リセット工程前では、壁電荷の量が前の表示状態
で異なるが、次の（ｂ）での第１電圧のパルスが該壁電
荷に上乗せされるように、維持工程を終了する。
【００２３】（ｂ）第１電極Ｘと第２電極Ｙｉとの間に
印加される第１電圧のパルスは、第１電極Ｘと第２電極
Ｙｉとの間の第１の放電開始電圧より高いので、壁電荷
が存在しなくてもこれら電極間に、維持放電工程での放
電に比し大規模の放電が生ずる。 （ｃ）放電により生じた電子及び正イオンは、これと逆
極性の第１電極Ｘ又は第２電極Ｙｉに引きつけられ、誘
電体層１の表面に蓄積され、第１電極Ｘ側の第１壁電荷
及び第２電極Ｙｉ側の第２壁電荷となる。これら壁電荷
は放電空間内の電界強度を低減させるので、放電は直ち
に収束に向かい、１〜数μｓで終結する。
【００２４】（ｄ）第１電圧のパルスは、この１壁電荷
と第２壁電荷との間の第３電圧が第１の放電開始電圧よ
り高くなる電圧パルスであるので、維持放電工程での放
電に比し大規模の放電が再度生ずる。 （ｅ）この大規模放電と、第１、第２及び第３の電極の
電位が互いに等しいこととから、壁電荷は殆ど蓄積され
ず且つ空間電荷は殆ど完全に中和される。維持放電程度
では、第１、第２及び第３の電極の電位を互いに等しく
しても、このような自己消去放電は生じない。
【００２５】（ｆ）空間には、再結合しきれない多少の
電荷が漂っているが、この空間電荷は、次のアドレス放
電において、放電を起こし易くする種火の役割を果た
す。自己消去放電がほぼ完全に行われるのに必要な待ち
時間は、セルの材質、寸法、封入ガスの種類及び密度等
により異なるが、５μｓ程度以上である。待ち時間が長
すぎると、他の工程の時間が短縮され、また、プライミ
ング効果が小さくなるので、５０μｓ程度以下にする必
要がある。
【００２６】この第１発明では、このような自己消去放
電を行って、壁電荷が殆ど完全に中和するようにしてい
るので、点灯させるセルに書き込みを行う際には、第１
及び第２の電極付近の状態が均一化されている。これに
より、書き込み工程でのパルスの第２電圧の採り得る範
囲が広くなり、書き込み放電前の電荷分布の状態や温度
の変化等によらず常時安定したアドレス放電を行うこと
が可能となり、書き込みミスを防止して表示品質を向上
させることができる。
【００２７】また、消灯させるセルについては、第１と
第２の電極間で放電が生じないようにできるので、最大
輝度と黒色表示の最小輝度との比が従来より高くなり、
階調表示の品質が向上する。第１発明の第１態様では、
例えば図２（Ａ）〜（Ｃ）に示す如く、第１電圧のパル
スを印加している間、第３電極Ａｊの電位を、第１電極
Ｘの電位と第２電極Ｙｉの電位の略平均値にする。略平
均値は、平均値に近い方が好ましいが、（平均値）±
（第１電圧）／４以内程度であればその効果が得られ
る。
【００２８】この第１態様では、第１電極Ｘに対する第
３電極Ａｊの電圧と第２電極Ｙｊに対する第３電極Ａｊ
の電圧とが、絶対値が略等しく符号が逆になるので、第
３電極Ａｊの正電荷に対する引力と負電荷に対する引力
が略等しくなり、第３電極Ａｊ側で正電荷と負電荷が中
和して第３電極Ａｊ側への壁電荷蓄積量が殆ど０にな
る。このため、第１発明の効果が高められる。
【００２９】第１発明の第２態様では、例えば図２
（Ａ）に示す如く、第１電圧のパルスを、第２電極Ｙｉ
をグランドレベルにし第１電極Ｘに正の電圧パルスを印
加することにより生成する。この第２態様によれば、負
の高圧パルスが不要であるので、駆動回路用電源を、簡
単、小型かつ安価に構成できる。
【００３０】第１発明の第３態様では、例えば図２
（Ｂ）に示す如く、第１電圧のパルスを印加している
間、第３電極Ａｊの電位をグランドレベルにする。この
第３態様によれば、電源電圧を低くすることができる。
第１発明の第４態様では、例えば図２（Ａ）〜（Ｃ）に
示す如く、第１電圧のパルスの印加前及び後の第１、第
２及び第３の電極Ｘ、Ｙｉ及びＡｊの電位はグランドレ
ベルである。
【００３１】第１発明の第５態様では、例えば図６に示
す如く、リセット期間において、第１電圧のパルスを印
加した後、さらに、第１と第２の電極間に、第１の放電
開始電圧より低く、且つ、立ち上がりの傾斜が緩やかな
消去パルスを印加する。この第５態様によれば、異常セ
ルであるために第１電圧パルスで消去できなかった第１
及び第２の壁電荷に消去パルスの電圧を上乗せして放電
させ壁電荷を消去させることができ、余剰点灯を防止し
て表示品質を向上させることができる。消去パルスの立
ち上がりの傾斜を緩やかにするのは、量にばらつきのあ
る壁電荷を効率よく放電させるためである。
【００３２】第１発明の第６態様では、例えば図６に示
す如く、第１電圧のパルスと消去パルスとの間の時間に
おいて、第１と第２の電極間に、第１の放電開始電圧よ
り低く極性が第１電圧と逆のパルスを印加し、次に、第
１の放電開始電圧より低く極性が第１電圧と同一のパル
スを印加し、次に印加する消去パルス極性を第１電圧と
逆にする。
【００３３】この第６態様によれば、異常セルであるた
めに第１電圧パルスで消去できなかった第１及び第２の
壁電荷の極性が統一され且つ増幅されるので、消去パル
スで第５実施例よりも多く消去することができる。異常
セルの割合は一般に少ないので、この消去により、書き
込みしなかった場合に維持放電工程で放電できない程度
壁電荷が残っていても問題はない。また、この残留壁電
荷の極性が、書き込み工程において第２電極と第３電極
との間の電圧を低下させる極性となるので、点灯させな
いセルの放電が妨げられ、余剰点灯防止上好ましい。
【００３４】第１発明の第７態様では、書き込み工程に
おいて、第２電圧は、第２と第３の電極間の第２の放電
開始電圧以上であり、第４電圧が機能する最小値をＶｓ
minとし、第１の放電開始電圧をｆxymiとしたとき、第
１と第２の電極間にＶｓmin≦Ｖｓ＜Ｖｆxymiなる第５
電圧Ｖｓのパルスを印加する。この第７態様によれば、
消灯させるセルについては、書き込み工程において確実
に第１と第２の電極間で放電が生じないようにすること
ができる。
【００３５】第１発明の第８態様では、第５電圧を第１
の放電開始電圧に近い値にする。この第８態様によれ
ば、第２電極Ｙｉと第３電極Ａｊとの間の小規模放電
で、充分に第１電極Ｘと第２電極Ｙｉとの間の放電の引
き金となるので、駆動回路の消費電力を低減することが
できる。第１発明の第９態様では、例えば図５に示す如
く、第２電圧のパルスは、グランドレベルに対し第２電
極Ｙｉの電位を負にし且つ第３電極Ａｊをグランドレベ
ルにした状態で第３電極Ａｊに印加した正パルスであ
り、第５電圧のパルスは、第１電極Ｘの電位を第３電極
Ａｊの電位に等しくした状態で第２電極Ｙｉに印加した
負パルスである。
【００３６】この第９態様によれば、上記第８態様の効
果に加え、電源電圧の種類が１つ減るので、電源回路が
より簡単となる。また、維持放電工程において維持放電
が可能な量の壁電荷を効率よく生成することができる。
第１発明の第１０態様では、第２電極Ｙｉの電位は、第
５電圧の１／４〜３／４程度である。
【００３７】この第１０態様によれば、セルに隔壁を設
けなくても、書き込み工程での放電による空間電荷が、
隣接セルへ飛来して、壁電荷を蓄積させることによる誤
書き込みを防止することができる。第１発明の第１１態
様では、例えば図８に示す如く、第２電圧のパルスの幅
を、第５電圧のパルスの幅よりも狭くしている。
【００３８】この第１１態様によれば、書き込み工程に
おいて第３電極Ａｊに蓄積される負の壁電荷量が低減す
るので、維持工程での始めの維持パルスで第３電極Ａｊ
と第２電極Ｙｉとの間の放電には到らず、正常な維持放
電が確保される。また、このように短くしても、第２電
圧のパルスは、第１と第２の電極間の放電に対し引き金
の役割を果たせばよいので、第２電圧はこの役割を果た
すのに充分なパルス幅であれば第５電圧のパルスの幅よ
りも狭くしても問題ない。このパルス幅の好ましい値
は、封入ガスの種類やセルの寸法及び材質によって異な
るが、第２電圧のパルスの周期を３μｓとした場合、１
〜２μｓ程度である。
【００３９】第１発明の第１２態様では、例えば図８に
示す如く、維持放電工程において、第３電極Ａｊの電位
をグランドレベルに対し正の電位とする。この第１２態
様によれば、書き込み工程で生じた第３電極Ａｊ側の過
剰な負の壁電荷を正の電位で打ち消すことができるの
で、維持工程で第３電極Ａｊと第２電極Ｙｉとの間の放
電を防止でき、正常な維持放電が確保される。これによ
り、表示ミスが防止されて、表示品質が向上する。ま
た、維持放電の際にイオンが第３電極側へ飛来するのを
少なくして、第２基板側に形成された蛍光体の劣化を防
ぐことができる。
【００４０】第１発明の第１３態様では、例えば図７に
示す如く、維持放電工程の最初の第４電圧のパルスを印
加する前に、第１及び第２の電極に同時に、第３電極Ａ
ｊとの電位差が第４電圧の１／４〜３／４程度の正のパ
ルスを印加する。この第１３態様によれば、第２電極側
の過剰な正の壁電荷による電圧が該正パルスに上乗せさ
れ、第２電極Ｙｉ側が第３電極Ａｊ側より高い電位とな
り、微弱な放電を起こすことができる。この放電によっ
て、第３電極Ａｊ側の過剰な負の壁電荷の一部が除去さ
れるため、以降は正常な維持放電の継続が可能となる。
これにより、表示ミスが防止されて、表示品質が向上す
る。
【００４１】第１発明の第１４態様では、維持放電工程
において、第３電極Ａｊに接続された駆動回路出力端を
ハイインピーダンスにする。この第１４態様によれば、
第３電極駆動回路の出力を一定に保持するための電力が
削減でき、低消費電力化を図ることができる。第１発明
の第１５態様では、例えば図４に示す如く、リセット工
程を全てのセルに対し同時に実行し、次に、第２電極Ｙ
ｉについて一方から他方へ１つずつ順に書き込み工程を
実行し、次に、全ての第１及び第２の電極について維持
放電工程を同時に実行する。
【００４２】第２発明では、第１基板に第１及び第２の
電極が互いに平行に、表示ライン毎に対をなして配置さ
れ、複数の第１電極Ｘが共通に接続され、該第１基板又
は該第１基板と離間して対向配置された第２基板に、該
第１及び第２の電極と離間して交差するように第３電極
Ａｊが配置され、該第１及び第２の電極の表面が壁電荷
蓄積用の誘電体層で被われ、該第２基板側に蛍光体が形
成され、該第１基板と該第２基板との間の空間に放電用
のガスが封入され、該第１及び第２の電極と第３電極Ａ
ｊとの各交差部にセルが形成された面放電型プラズマデ
ィスプレイパネルに対し、該誘電体の表面の電荷分布を
均一にさせるために互いに隣接した該第１と第２の電極
間に第１電圧のパルスを印加して放電させ、点灯させる
該セルの該誘電体表面の第１電極Ｘに対応した部分及び
第２電極Ｙｉに対応した部分にそれぞれ一定量以上で極
性が互いに逆の第１及び第２の壁電荷を蓄積させるため
に、第２電極Ｙｉと、点灯させる該セルに対応した第３
電極Ａｊとの間に第２電圧のパルスを印加して放電さ
せ、該第１と第２の壁電荷間の第３電圧と、該第３電圧
と同一極性で第１電極Ｘと第２電極Ｙｉとの間に印加す
る第４電圧との和が第１の放電開始電圧以上になる該セ
ルを点灯させ、放電毎に該第１壁電荷及び該第２壁電荷
の極性が逆になるようにするために、互いに隣接した該
第１と第２の電極間に該第４電圧のパルスとして交流電
圧パルスを印加する面放電型プラズマディスプレイパネ
ル駆動装置において、該面放電型プラズマディスプレイ
パネル駆動装置は、該第１電圧のパルスを、該放電開始
電圧より高く且つ放電により生ずる該第３電圧が該第１
の放電開始電圧より高くなる電圧のパルスとし、該第１
電圧のパルス印加後の該第１、第２及び第３の電極の電
位を互いに等しくする。
【００４３】この第２発明によれば、上記第１発明と同
じ効果が得られる。
【００４４】
【実施例】以下、図面に基づいて本発明の好適な実施例
を説明する。以下の各実施例においては、ＰＤＰは、例
えば上述の図１４に示すセル構造を有するものとする。
また、選択された維持電極ＹｉをＹｓで表し、非選択の
維持電極ＹｉをＹｔで表す。また、維持電極Ｙｓを含む
１行分のセルを選択ラインと称し、維持電極Ｙｔを含む
１行分のセルを非選択ラインと称する。さらに、選択ラ
インのうち、点灯させるセルのアドレス電極ＡｊをＡａ
で表し、消灯させるセルのアドレス電極Ａｊをアドレス
電極Ａｂで表す。
【００４５】［第１実施例］図３は、本発明の第１実施
例のＰＤＰ駆動方法を示す電極印加電圧波形図であり、
１駆動サイクル分を示す。この駆動方法は、線順次・書
き込みアドレス方式であり、維持電極Ｙｉは、Ｙ１〜Ｙ
ｎの順に１つずつ選択される。
【００４６】（ａ）アドレス電極Ａｊ及び維持電極Ｙｔ
が０Ｖの状態で、維持電極Ｘに電位Ｖｗの書き込みパル
スが印加され、同時に、維持電極Ｙｓに電位−Ｖｓのパ
ルスが印加される。なお、この（ａ）の前、すなわち、
図３での１駆動サイクルの最後では、Ｘ電極に０又は正
の壁電荷が蓄積され、維持電極Ｙｓに０又は負の壁電荷
が蓄積されている。この条件は、書き込みパルスの極性
と１駆動サイクルの最後の維持パルスの極性とを逆にす
ることで満たされる。
【００４７】電位Ｖｗ及びＶｓは、 Ｖｗ＋Ｖｓ≧Ｖｆ ・・・（４） を満たすように定められる。この様に定めることによ
り、選択ラインのみ、その全セルについて維持電極Ｘと
Ｙｓとの間で書き込み放電Ｗが生ずる。例えば、Ｖｗ＝
１３０Ｖ、Ｖｓ＝１８０Ｖ、Ｖｆ＝２９０Ｖであり、書
き込みパルスの電圧Ｖｗ＋Ｖｓは維持パルスの電圧Ｖｓ
よりも充分高いので、維持放電に比し大規模の放電が生
ずる。この際、放電が進むにつれて、選択ラインの維持
電極Ｘ側には負の壁電荷が蓄積され、一方、維持電極Ｙ
ｓ側には正の壁電荷が蓄積される。これら壁電荷は放電
空間内の電界強度を低減させるので、放電は直ちに収束
に向かい、１〜数μｓで終結する。終結したときの壁電
荷による電圧をＶwall3で表す。前記電位Ｖｗはさら
に、このＶwall3が、 Ｖwall3＞Ｖｆ ・・・（５） を満たすように定められる。
【００４８】（ｂ）維持電極ＸとＹｓが同時に０Ｖに戻
され、上式（５）により、維持電極Ｘ側の壁電荷と維持
電極Ｙｉ側の壁電荷との間の電圧で自己消去放電Ｃが生
ずる。この放電においては、維持電極Ｘと維持電極Ｙｓ
とアドレス電極Ａｊとの間の電位差がいずれも０Ｖであ
り、かつ、放電が大規模であるため、放電によって生じ
た空間電荷が維持電極Ｘ側、Ｙｓ側及びアドレス電極Ａ
ｊ側に壁電荷として殆ど蓄積されない（理論的には
０）。したがって、空間電荷は、放電空間内で再結合
し、殆ど完全に中和される。空間には、再結合しきれな
い多少の電荷が漂っているが、この空間電荷は、次のア
ドレス放電において、放電を起こし易くする種火の役割
を果たす。この効果は、プライミング（種火）効果とし
て知られている。
【００４９】自己消去放電がほぼ完全に行われるのに必
要な待ち時間は、セルの材質、寸法、封入ガスの種類及
び密度等により異なるが、書き込みパルスが立ち下がっ
てから５〜５０μｓ程度、例えば２０μｓである。 （ｃ）維持電極Ｘ、Ｙｔ及びアドレス電極Ａｂが０Ｖの
状態で、維持電極Ｙｓに電位−Ｖｓのパルスが印加さ
れ、同時に、アドレス電極Ａａに電位Ｖａのアドレスパ
ルスが印加される。電位Ｖａ及びＶｓは、 Ｖｓmin≦Ｖｓ＜Ｖｆxymin ・・・（６） Ｖａ＋Ｖｓ≧Ｖｆaymax ・・・（７） を満たすように定められる。ここに、Ｖｓminは、ＰＤ
Ｐ内の全セルが後述の維持放電を持続できる最小電圧で
あり、ＶｆxyminはＰＤＰ内での維持電極ＸとＹ１〜Ｙ
ｎとの間の最小の放電開始電圧であり、Ｖｆaymaxは、
ＰＤＰ内でのアドレス電極Ａ１〜Ａｍと維持電極Ｙ１〜
Ｙｎとの間の最大の放電開始電圧である。
【００５０】この様に定めることにより、点灯させるセ
ルについては、アドレス電極Ａａと維持電極Ｙｓとの間
でアドレス放電が生じ、この放電がトリガとなって直ち
に、維持電極ＸとＹｓとの間にも放電が生じ、図１５の
従来の場合と異なり、維持電極Ｘ側とＹｓ側にそれぞ
れ、後の維持放電パルスで維持放電を行うことが可能な
量の負及び正の壁電荷が生成される。また、消灯させる
セルについては、図１５の従来の場合と異なり、維持電
極ＸとＹｓとの間で放電が生じない。
【００５１】（ｄ）全電極を０Ｖにした状態で、維持電
極Ｘに電位−Ｖｓの維持パルスが印加され、アドレス放
電が生じたセルについてのみ、維持放電が生ずる。この
放電により、維持電極Ｘ側及びＹｉ側にそれぞれ正及び
負の壁電荷が蓄積される。 （ｅ）全電極を０Ｖにした状態で、維持電極Ｙ１〜Ｙｎ
に電位−Ｖｓの維持パルスが印加され、（ｄ）で維持放
電が生じたセルについてのみ、維持放電が生ずる。この
放電により、維持電極Ｘ側及びＹｉ側にそれぞれ負及び
正の壁電荷が蓄積される。
【００５２】以降、上記（ｄ）及び（ｅ）の動作が繰り
返される。本第１実施例では、選択ラインの全セルに書
き込み放電を行った後、自己消去放電を行って、壁電荷
が殆ど完全に中和するようにしているので、選択ライン
に表示データの書き込みを行う際には、選択ラインの全
セルの状態が均一化されている。これにより、電位Ｖａ
の採り得る範囲が広くなり、書き込み放電前の電荷分布
の状態や温度の変化等によらず常時安定したアドレス放
電を行うことが可能となり、書き込みミスを防止して表
示品質を向上させることができる。
【００５３】また、上記（ｃ）において、消灯させるセ
ルについては図１５の従来の場合と異なり、維持電極Ｘ
とＹｓとの間で放電が生じないので、選択ラインの全セ
ル放電発光の回数はＷサイクルで２回となり、従来の２
／３となる。このため、最大輝度と黒色表示の最小輝度
との比が従来の３／２倍高くなり、階調表示の品質が向
上する。
【００５４】［第２実施例］図４は、本発明の第２実施
例のＰＤＰ駆動方法を示す電極印加電圧波形図であり、
１サブフィールド分を示す。この駆動方法は、アドレス
／維持放電分離型・書き込みアドレス方式であり、１サ
ブフィールドは、全セルの壁電荷を殆ど完全に消去する
ためのリセット期間と、点灯させる画素に対し後の維持
放電が可能な程度に壁電荷をアドレス放電により蓄積さ
せるためのアドレス期間と、壁電荷に維持パルスを上乗
せして、アドレス放電が生じたセルに対してのみ維持放
電を生じさせるための維持放電期間とに分けられる。
【００５５】電位Ｖｗ、Ｖｓ及びＶａは上記第１実施例
と同一の条件式（４）〜（７）を満たす。 （ａ）リセット期間では、最初に、全電極を０Ｖにした
状態で、維持電極Ｘに電位Ｖｗの書き込みパルスが印加
され、同時に、維持電極Ｙ１〜Ｙｎに電位−Ｖｓのパル
スが印加される。なお、この（ａ）の前、すなわち、図
４での１サブフィールドの最後では、維持電極に印加さ
れる維持パルスの極性が書き込みパルスの極性と逆にな
っているので、維持電極Ｘには０又は正の壁電荷が蓄積
され、維持電極Ｙ１〜Ｙｎには０又は負の壁電荷が蓄積
されている。このため、壁電荷が存在する場合には必ず
書き込みパルスの電圧に上乗せされることになる。この
点に関しては、以下の各実施例においても同様である。
これにより、維持電極ＸとＹ１〜Ｙｎとの間で全面書き
込み放電Ｗが生ずる。
【００５６】（ｂ）維持電極ＸとＹｓが同時に０Ｖに戻
されて等電位になることと、上式（５）とから、維持電
極Ｘ側の壁電荷と維持電極Ｙ１〜Ｙｎ側の壁電荷との間
の電圧で自己消去放電Ｃが生じ、壁電荷は殆ど蓄積され
ず且つ空間電荷は殆ど完全に中和される。次に、アドレ
ス期間に移る。
【００５７】（ｃ）維持電極Ｘ、Ｙ２〜Ｙｎ及びアドレ
ス電極Ａｂが０Ｖの状態で、維持電極Ｙ１に電位−Ｖｓ
のパルスが印加され、同時に、アドレス電極Ａａに電位
Ｖａのアドレスパルスが印加される。これにより、第１
選択ラインの点灯させるセルについては、アドレス電極
Ａａと維持電極Ｙ１との間でアドレス放電が生じ、この
放電がトリガとなって直ちに、維持電極ＸとＹ１との間
にも放電が生じ、維持電極Ｘ側とＹ１側にそれぞれ、後
の維持放電パルスで維持放電を行うことが可能な量の負
及び正の壁電荷が生成される。また、消灯させるセルに
ついては、アドレス放電が生じないので、維持電極Ｘと
Ｙ１との間の放電も生じない。
【００５８】以降、維持電極Ｙ２〜Ｙｎの順に（ｃ）と
同様の動作が行われる。次に、維持放電期間に移る。 （ｄ）全電極を０Ｖにした状態で、維持電極Ｘに電位−
Ｖｓの維持パルスが印加され、アドレス放電が生じたセ
ルについてのみ、維持放電が生ずる。この放電により、
維持電極Ｘ側及びＹ１〜Ｙｎ側にそれぞれ正及び負の壁
電荷が蓄積される。電位Ｖｓは、上式（２）に相当す
る、 Ｖｓ＋Ｖwall4＞Ｖｆ＞Ｖｓ ・・・（２Ａ） を満たすように定められている。
【００５９】（ｅ）全電極を０Ｖにした状態で、維持電
極Ｙ１〜Ｙｎに電位−Ｖｓの維持パルスが印加され、
（ｆ）で維持放電が生じたセルについてのみ、維持放電
が生ずる。この放電により、維持電極Ｘ側及びＹｉ側に
それぞれ負及び正の壁電荷が蓄積される。以降、上記
（ｆ）及び（ｇ）の動作が繰り返される。
【００６０】本第２実施例では、全面書き込み放電を行
った後、自己消去放電を行って、壁電荷が殆ど完全に中
和するようにしているので、アドレス期間で選択ライン
に表示データの書き込みを行う際には、選択ラインの全
セルの状態が均一化されている。これにより、電位Ｖａ
の採り得る範囲が広くなり、書き込み放電前の電荷分布
の状態や温度の変化等によらず常時安定したアドレス放
電を行うことが可能となり、書き込みミスを防止して表
示品質を向上させることができる。
【００６１】また、１サブフィールド内のリセット期間
における放電発光は２回であり、従来の２／３となる。
このため、最大輝度と黒色表示の最小輝度との比が従来
の３／２倍高くなり、階調表示の品質が向上する。 ［第３実施例］図５は、本発明の第３実施例のＰＤＰ駆
動方法を示す電極印加電圧波形図であり、１サブフィー
ルド分を示す。
【００６２】維持放電及び全面書き込み放電を行う後述
の走査ドライバ及びＸ共通ドライバは、他のドライバに
比し電力消費が大きいため、大型となる。一方、負パル
ス生成回路よりも正パルス生成回路の方が、簡単で安価
に構成できる。そこで、第３実施例では、リセット期間
及び維持放電期間において、正パルスのみを使用する。
【００６３】（ａ）リセット期間では、最初に、全電極
を０Ｖにした状態で、維持電極Ｘに電位Ｖｓ＋Ｖｗの書
き込みパルスが印加され、同時に、アドレス電極Ａ１〜
Ａｍに電位Ｖａｗのパルスが印加される。書き込みパル
スを電位Ｖｓと電位Ｖｗとの和にしているのは、維持パ
ルスにも使用される電位Ｖｓの電源を主にし、ステップ
アップ回路で電位Ｖｓに電位Ｖｗを上乗せして電位Ｖｓ
＋Ｖｗを生成するためである。
【００６４】電位Ｖｓ＋Ｖｗは、上式（４）を満たすよ
うに定められる。これにより、維持電極ＸとＹ１〜Ｙｎ
との間で全面書き込み放電Ｗが生ずる。この放電により
アドレス電極Ａ１〜Ａｍ側に蓄積する壁電荷量は、アド
レス電極Ａ１〜Ａｍ側の状態を均一にしてアドレス期間
で安定動作させるために、できるだけ少ない方が好まし
い。ここで、Ｖａｗ＝（Ｖｓ＋Ｖｗ）／２とすれば、維
持電極Ｘに対するアドレス電極Ａ１〜Ａｍの電圧と維持
電極Ｙ１〜Ｙｎに対するアドレス電極Ａ１〜Ａｍの電圧
とが、絶対値が等しく符号が逆になるので、アドレス電
極Ａ１〜Ａｍの正電荷に対する引力と負電荷に対する引
力が等しくなり、アドレス電極Ａ１〜Ａｍ側で正電荷と
負電荷が中和してアドレス電極Ａ１〜Ａｍ側への壁電荷
蓄積量が殆ど０になる。他方、電源回路を小型化するた
めには、電位Ｖａｗは低い方が好ましい。これらのこと
から、電位Ｖａｗの好ましい範囲は、 （Ｖｓ＋Ｖｗ）／４≦Ｖａｗ≦（Ｖｓ＋Ｖｗ）／２ ・・・（８） 程度である。
【００６５】（ｂ）アドレス電極Ａ１〜Ａｍと維持電極
Ｘとが同時に０Ｖに戻されて等電位になることと、上式
（５）とから、維持電極Ｘ側の壁電荷と維持電極Ｙ１〜
Ｙｎ側の壁電荷との間の電圧で自己消去放電Ｃが生じ、
壁電荷は殆ど蓄積されず且つ空間電荷は殆ど完全に中和
される。次に、アドレス期間に移る。
【００６６】（ｃ）維持電極Ｘを電位Ｖａｘにし、非選
択の維持電極Ｙ２〜Ｙｎを電位−Ｖｓｃにした状態で、
選択する維持電極Ｙ１に電位−Ｖｙのスキャンパルスが
印加され、同時に、アドレス電極Ａａに電位Ｖａのアド
レスパルスが印加される。非選択の維持電極Ｙ２〜Ｙｎ
を電位−Ｖｓｃにする理由は、後述のように電位Ｖａを
低くして消費電力を低減するためである。電位−Ｖｓｃ
の好ましい値は、（−Ｖｙ＋Ｖａ）／２付近である。
【００６７】電位Ｖａｘ、Ｖｙ及び電位Ｖａは、上式
（６）及び（７）に相当する、 Ｖｓmin≦Ｖａｘ＋Ｖｙ＜Ｖｆxymin ・・・（６Ａ） Ｖａ＋Ｖｙ≧Ｖｆaymax ・・・（７Ａ） を満たすように定められる。これにより、第１選択ライ
ンの点灯させるセルについては、アドレス電極Ａａと維
持電極Ｙ１との間でアドレス放電が生じ、この放電がト
リガとなって直ちに、維持電極ＸとＹ１との間にも放電
が生じ、維持電極Ｘ側とＹ１側にそれぞれ、後の維持放
電パルスで維持放電を行うことが可能な量の負及び正の
壁電荷が生成される。また、消灯させるセルについて
は、アドレス放電が生ぜず、維持電極ＸとＹ１との間の
放電も生じない。
【００６８】電位Ｖａｘの好ましい値は、次の通りであ
る。スイッチング回数が比較的多いアドレスドライバの
負担を少しでも軽減して、全消費電力を低減することが
好ましい。すなわち、アドレス電極に印加される電位Ｖ
ａを、上式（７Ａ）の制限下で低い電圧に設定すること
が好ましい。アドレス電極Ａａと維持電極Ｙｓとの間の
放電を引き金として、維持電極ＸとＹｓの放電に移行
し、維持放電に必要な壁電荷を形成するというメカニズ
ムからすると、電位Ｖａを低くするには、維持電極Ｘと
Ｙｓとの間の電圧Ｖａｘ＋Ｖｙを、上式（６Ａ）の制限
下で大きくすることにより、アドレス電極Ａａと維持電
極Ｙｓとの間の小規模放電で、充分に維持電極ＸとＹｓ
との間の放電の引き金となるようにすればよい。
【００６９】また、Ｖａｘ＝Ｖａとすれば、電源電圧の
種類が１つ減るので、電源回路が簡単となる。次に、維
持放電期間に移る。 （ｄ）アドレス電極Ａ１〜ＡｍをＶｓ／２にし、維持電
極Ｘを０Ｖにした状態で、維持電極Ｙ１〜Ｙｎに電位Ｖ
ｓの維持パルスが印加される。
【００７０】アドレス電極Ａ１〜Ａｍが０Ｖのままであ
ると、アドレス放電によって生成されたアドレス電極Ａ
１〜Ａｍ側の負の壁電荷と維持電極Ｙ１〜Ｙｎ側の正の
壁電荷とが、始めの維持パルスに上乗せされて作用する
ため、維持電極ＸとＹ１〜Ｙｎとの間に維持放電が生ず
る前に、アドレス電極Ａ１〜Ａｍと維持電極Ｙ１〜Ｙｎ
との間で放電を開始して、維持電極ＸとＹ１〜Ｙｎとの
間の維持放電が生じなくなることがあり得る。これを防
ぐため、アドレス電極Ａ１〜Ａｍに正の電圧（電位Ｖｓ
／２）を印加して、アドレス電極Ａ１〜Ａｍ側の負の壁
電荷による電界を打ち消すようにしている。また、アド
レス電極Ａ１〜Ａｍを電位Ｖｓ／２にしておくことで、
電位Ｖａｗの場合と同じ理由により、維持放電の際にイ
オンがアドレス電極Ａ１〜Ａｍ側へ飛来するのを少なく
して、スパッタ等による蛍光体１５の劣化を防ぐことが
できる。
【００７１】電位Ｖｓは、上式（２Ａ）を満たすように
定められており、維持電極ＸとＹ１〜Ｙｎとの間で全面
維持放電Ｓが生ずる。 （ｅ）Ａ１〜Ａｍを電位Ｖｓ／２にし、維持電極Ｙ１〜
Ｙｎを０Ｖにした状態で、維持電極Ｘに電位Ｖｓの維持
パルスが印加される。以降、維持電極Ｙ２〜Ｙｎの順に
以上の（ｄ）及び（ｅ）と同様の動作が行われる。
【００７２】なお、維持放電期間において、最初の維持
パルスが維持電極Ｙ１〜Ｙｎに印加されたときに、アド
レス電極Ａ１〜Ａｎの電位を電位Ｖｓ／２にし、その後
は、アドレス電極駆動回路の出力をハインピーダンス状
態にしてもよい。この場合、アドレス電極駆動回路の出
力を電位Ｖｓ／２に保持するための電力が削減でき、低
消費電力化を図ることができる。また、場合によって
は、最初の維持パルスが印加される前にアドレス電極駆
動回路の出力端をハイインピーダンス状態にして、維持
放電の際にイオンがアドレス電極Ａ１〜Ａｍ側に蓄積さ
れる量を低減させてもよい。
【００７３】［第４実施例］図６は、本発明の第４実施
例のＰＤＰ駆動方法を示す電極印加電圧波形図であり、
１サブフィールドのリセット期間とアドレス期間とを示
す。 （ａ）及び（ｂ）での動作は、上記第３実施例の場合と
同一である。正常なセルは、（ａ）及び（ｂ）での動作
により、壁電荷を完全に中和し、又は、壁電荷が残留し
ていてもミス表示の原因にならない程度に中和すること
ができる。
【００７４】しかし、ＰＤＰ作成の際のなんらかの原因
によって、セルの特性が通常と異なるために、自己消去
放電が不充分で多くの壁電荷が残ってしまったり、自己
消去放電が全く起こらずに全面書き込み放電の際に形成
された壁電荷がそのまま残ってしまう場合がある。これ
らの異常セルは、アドレス放電をさせなくても維持放電
期間で発光し、余剰点灯となる。
【００７５】そこで、本第４実施例では、これら壁電荷
をアドレス放電前に強制的に放電させて消去することに
より、維持放電期間での余剰点灯を防止し、表示品質を
向上させる。 （ｂ）から（ｃ）までに必要な待ち時間は、上記第１実
施例と同一である。 （ｃ）全電極を０Ｖにした状態で、維持電極Ｙ１〜Ｙｎ
に電位Ｖｓのパルスが印加される。これに応答して放電
するセルは、Ｙ側に対し維持電極Ｘ側に相対的に負の壁
電荷が、維持放電可能な量残ってしまったセルである。
場合によっては、この放電により、壁電荷の極性が反転
して、維持電極Ｘ側に正の壁電荷が蓄積され、Ｙ側に負
の壁電荷が蓄積される。電位Ｖｓは、維持放電期間での
維持パルスの電位に必ずしも等しくする必要はなく、上
式（６）を満たせばよい。
【００７６】（ｄ）全電極を０Ｖにした状態で、維持電
極Ｘに電位Ｖａのパルスが印加され、維持電極Ｙ１〜Ｙ
ｍに電位−Ｖｙのパルスが印加される。すなわち、アド
レス期間で維持電極ＸとＹｉとの間に印加される電圧の
パルスが印加される。この電圧は、上式（６Ａ）でＶａ
ｘ＝Ｖａとしたのを満たせばよい。これに応答して放電
するセルは、前記（ｃ）により又はその前に、Ｙ側に対
し維持電極Ｘ側に相対的に正の壁電荷が、維持放電可能
な量残ってしまったセルである。この放電により、壁電
荷の極性が反転して、維持電極Ｘ側に負の壁電荷が蓄積
され、Ｙ側に正の壁電荷が蓄積される。
【００７７】残留壁電荷の極性が、（ｃ）及び（ｄ）の
放電により統一される。また、（ｃ）及び（ｄ）の放電
により、壁電荷の電荷分布がより均一化され、かつ、次
の消去パルスの電圧が上乗せられて放電するに充分な壁
電荷の量に調整される。 （ｅ）全電極を０Ｖにした状態で、維持電極Ｙ１〜Ｙｎ
に、立ち上がりが緩やかな電位Ｖｓの消去パルスが印加
され、同時に、アドレス電極Ａ１〜Ａｍに電位Ｖａｗの
パルスが印加される。これにより、セルによって放電開
始電圧にばらつきがあっても、大部分の壁電荷を消去可
能であり、少量の壁電荷が残留する。残留した壁電荷は
正電荷であり、次のアドレスパルスと逆極性となるの
で、アドレス放電が生じ難く、余剰点灯が防止され、表
示品質が向上する。アドレス電極Ａ１〜Ａｍに電位Ｖａ
ｗのパルスを印加するのは、維持電極Ｙ１〜Ｙｎとアド
レス電極Ａ１〜Ａｍとの間で不都合な放電が生ずるのを
避けるためである。
【００７８】その後の動作は、上記第３実施例と同一で
ある。 ［第５実施例］図７は、本発明の第５実施例のＰＤＰ駆
動方法を示す電極印加電圧波形図であり、１サブフィー
ルド分を示す。リセット期間及びアドレス期間での動作
は、上記第３実施例の場合と同一である。
【００７９】リセット期間で全面自己消去放電が行わ
れ、アドレス期間でアドレス放電が行われたセルは、維
持電極Ｘ側に負の壁電荷が蓄積し、維持電極Ｙｉ側に正
の壁電荷が蓄積し、アドレス電極Ａｊ側に負の壁電荷が
蓄積されている。何らかの原因で、アドレス電極Ａｊ側
に維持電極Ｘ側よりも大規模の負の壁電荷が蓄積された
場合、維持パルスが印加されたときに、アドレス電極Ａ
ｊに電位Ｖｓ／２の電位が印加されていても、アドレス
電極Ａｊ側の電位が維持電極Ｘ側の電位より低くなる場
合には、維持電極Ｙｉとアドレス電極Ａｊとの間で放電
が生ずる。この放電が生ずると、維持電極ＸとＹｉとの
間に放電が生ぜず、以降の維持放電が行えなくなる。
【００８０】そこで、この第５実施例では、アドレス電
極Ａｊ側の過剰な負の壁電荷の一部を除去するために、
アドレス電極Ａｊを電位Ｖｓ／２にした後に、維持電極
Ｘ及びＹ１〜Ｙｎに電位Ｖｓのパルスが印加される。こ
の場合、維持電極Ｙ１〜Ｙｎ側の過剰な正の壁電荷によ
る電圧が電位Ｖｓに上乗せされ、維持電極Ｙｉ側がアド
レス電極Ａｊ側より高い電位となり、微弱な放電を起こ
すことができる。この放電によって、アドレス電極Ａｊ
側の過剰な負の壁電荷の一部が除去されるため、以降は
正常な維持放電の継続が可能となる。これにより、表示
ミスが防止されて、表示品質が向上する。
【００８１】［第６実施例］図８は、本発明の第６施例
のＰＤＰ駆動方法を示す電極印加電圧波形図であり、１
サブフィールド分を示す。この第６実施例では、上記第
５実施例で述べた問題点を別の方法で解決している。リ
セット期間及び維持放電期間での動作は、上記第３実施
例の場合と同一である。
【００８２】アドレス期間において、アドレス電極Ａａ
と維持電極Ｙｓとの間で開始されたアドレス放電は、直
ちに維持電極ＸとＹｓとの放電に移行して、維持電極Ｘ
及びＹｓとの間で維持放電を行うことが可能な量の壁電
荷が生じ、放電を終了する。アドレス電極Ａａに印加さ
れる電位Ｖａのパルスは、維持電極ＸとＹｓとの間の放
電に対し引き金の役割を果たせばよいので、アドレス電
極Ａａと維持電極Ｙｓとの間で放電が開始された直後に
アドレス電極Ａａの電位を０にする。この場合、アドレ
ス電極Ａａの電位は維持電極Ｘより低いので、維持電極
Ｘほど負の壁電荷を蓄積することはない。これにより、
始めの維持パルスでアドレス電極Ａａと維持電極Ｙｓと
の間の放電には到らず、正常な維持放電が確保される。
アドレスパルスの好ましい幅は、封入ガスの種類やセル
の寸法及び材質によって異なるが、アドレスサイクルを
３μｓとした場合、１〜２μｓ程度である。
【００８３】［第７実施例］図９は、本発明の第７実施
例のプラズマディスプレイ装置２０のブロック図であ
る。プラズマディスプレイ装置２０は、図６に示す駆動
方法を実施するためのものである。表示パネル２１は、
一方のガラス基板上に互いに平行にアドレス電極Ａ１〜
Ａｍが形成され、このガラス基板に対向する他方のガラ
ス基板上に、アドレス電極Ａ１〜Ａｍと直角な方向に維
持電極Ｘ及びＹ１〜Ｙｎが形成されている。維持電極Ｘ
は、維持電極Ｙ１〜Ｙｎの各々と対になっており、か
つ、一端部が共通に接続されている。これら電極に印加
される電圧は、電源回路２２で生成され、アドレスドラ
イバ２３、Ｙ共通ドライバ２４、走査ドライバ２５及び
Ｘ共通ドライバ２６を介して該電極に供給される。アド
レスドライバ２３、Ｙ共通ドライバ２４、走査ドライバ
２５及びＸ共通ドライバ２６は、制御回路２７からの信
号により制御される。制御回路２７はこの信号を、外部
から供給される表示データＤＡＴＡ、表示データＤＡＴ
Ａに同期したドットクロックＣＬＫ、垂直同期信号ＶＳ
ＹＮＣ及び水平同期信号ＨＳＹＮＣに基づいて生成す
る。
【００８４】アドレスドライバ２３は、制御回路２７か
ら直列の表示データ及びシフトパルスがそれぞれ直列デ
ータ入力端及びクロック入力端に供給されるシフトレジ
スタ２３１と、１行分の表示データがシフトレジスタ２
３１に確保された時点でシフトレジスタ２３１の並列表
示データが保持されるラッチ回路２３２と、ラッチ回路
２３２の出力に基づいてオン／オフが定められ、駆動電
圧出力のタイミングが制御回路２７からの制御信号で制
御されるアドレス電極駆動回路２３３とを有する。アド
レス電極駆動回路２３３のｍ個の出力端はそれぞれ、ア
ドレス電極Ａ１〜Ａｍに接続されている。
【００８５】走査ドライバ２５は、サブフィールド内の
アドレス期間の始端に同期して直列データ入力端に
‘１’が供給され、アドレスサイクルに同期したシフト
パルスがクロック入力端に供給されるＹ駆動回路２５２
と、Ｙ駆動回路２５２の各ビットの出力によりオン／オ
フが定められ、駆動電圧出力のタイミングが制御回路２
７からの制御信号で制御されるＹ駆動回路２５２とを有
する。Ｙ駆動回路２５２の出力端は、維持電極Ｙ１〜Ｙ
ｎに接続されている。Ｙ共通ドライバ２４は、Ｙ駆動回
路２５２を介して維持電極Ｙ１〜Ｙｎに共通の駆動電圧
を供給するためのものである。
【００８６】図９中、電位Ｖｃｃは論理回路用であり、
電位Ｖｄは駆動回路用である。表示パネル２１の１個の
セル１０に対するアドレスドライバ２３、Ｙ共通ドライ
バ２４、走査ドライバ２５及びＸ共通ドライバ２６の駆
動回路部の概略構成を図１０に示す。アドレス電極駆動
回路２３３は、各ｊに共通の電圧ステップアップ回路２
３３ａと、出力端がアドレス電極Ａｊに接続されたＡｊ
駆動回路２３３ｂｊとを有する。ｊ＝１〜ｍの各々につ
いて、Ａｊ駆動回路２３３ｂｊの出力端がアドレス電極
Ａｊに接続されるのに対し、１つの電圧ステップアップ
回路２３３ａの出力端がＡ１〜Ａｍ駆動回路２３３ｂ１
〜２３３ｂｍの各入力端に接続される。
【００８７】電圧ステップアップ回路２３３ａは、電位
Ｖａの電源配線がダイオードＤ１のアノード及び抵抗Ｒ
１の一端に接続され、抵抗Ｒ１の他端がツェナーダイオ
ードＤ２のカソード、コンデンサＣ１の一端及びスイッ
チ素子ＳＷ１の一端に接続されている。スイッチ素子Ｓ
Ｗ１の他端はスイッチ素子ＳＷ２の一端及びコンデンサ
Ｃ２の一端に接続され、コンデンサＣ２の他端はダイオ
ードＤ１のカソードに接続されている。ツェナーダイオ
ードＤ２のアノード、コンデンサＣ１の他端及びスイッ
チ素子ＳＷ２の他端は、グランド線に接続されている。
【００８８】電圧ステップアップ回路２３３ａは、アド
レス期間においては、電位Ｖａを出力し、それ以外の期
間においては電位Ｖａｗを出力する。コンデンサＣ１の
端子間電圧は、ツェナーダイオードＤ２の降伏電圧Ｖａ
ｓに等しくなる。電圧ステップアップ回路２３３ａの出
力電圧は、アドレス期間では、スイッチ素子ＳＷ１がオ
フにされスイッチ素子ＳＷ２がオンにされて電位Ｖａと
なり、アドレス期間以外では、スイッチ素子ＳＷ２がオ
フにされた後スイッチ素子ＳＷ１がオンにされて、コン
デンサＣ１の電圧ＶａにコンデンサＣ２の電圧Ｖｓが上
乗せられ、Ｖａｗ＝Ｖａ＋Ｖａｓとなる。
【００８９】Ａｊ駆動回路２３３ｂｊは、ダイオードＤ
３のアノード、ダイオードＤ４のカソード、スイッチ素
子ＳＷ３の一端及びスイッチ素子ＳＷ４の一端が共にア
ドレス電極Ａｊに接続され、ダイオードＤ３のカソード
及びスイッチ素子ＳＷ３の他端が電圧ステップアップ回
路２３３ａの出力端に接続され、ダイオードＤ４のアノ
ード及びスイッチ素子ＳＷ４の他端がグランド線に接続
されている。
【００９０】Ａｊ駆動回路２３３ｂｊは、スイッチ素子
ＳＷ３をオンにし、スイッチ素子ＳＷ４をオフにする
と、アドレス電極Ａｊに電圧ステップアップ回路２３３
ａの出力電位Ｖａ又はＶａｗが印加され、また、スイッ
チ素子ＳＷ３をオフにし、スイッチ素子ＳＷ４をオンに
すると、アドレス電極Ａｊが０Ｖになる。Ｙ駆動回路
は、各ｉに共通のＹ共通ドライバ２４と、出力端が維持
電極Ｙｉに接続されたＹｉ駆動回路２５２ｉとを有す
る。ｉ＝１〜ｎの各々について、Ｙｉ駆動回路２５２ｉ
の出力端が維持電極Ｙｉに接続されるのに対し、１つの
Ｙ共通ドライバ２４の出力端がＹ１〜Ｙｎ駆動回路２５
２１〜２５２ｎの各入力端に接続される。
【００９１】Ｙ共通ドライバ２４は、スイッチ素子ＳＷ
５の一端がグランド線に接続され、スイッチ素子ＳＷ６
の一端が電位Ｖｓの電源配線に接続されている。スイッ
チ素子ＳＷ５の他端は、一方ではダイオードＤ５のアノ
ードからカソードを通って電位Ｖｓの電源配線に接続さ
れ、他方ではダイオードＤ６のカソードからアノードを
通って配線ＳＤに接続されている。配線ＳＤは、一方で
はダイオードＤ７のカソードからアノードを通りスイッ
チ素子ＳＷ７を介して電位−Ｖｓｃの電源配線に接続さ
れ、他方ではスイッチ素子ＳＷ８を介して電位−Ｖｙの
電源配線に接続されている。スイッチ素子ＳＷ６の他端
は、一方ではダイオードＤ８のカソードからアノードを
通ってグランド線に接続され、他方ではスイッチ素子Ｓ
Ｗ１０を介して配線ＳＵに接続されている。配線ＳＵ
は、一方では抵抗Ｒ２及びスイッチ素子ＳＷ９を介して
電位Ｖｓに接続され、他方ではスイッチ素子ＳＷ１１を
介して電位−Ｖｙの電源配線に接続されている。
【００９２】Ｙｉ駆動回路２５２ｉは、ダイオードＤ９
のアノード、ダイオードＤ１０のカソード、スイッチ素
子ＳＷ１２の一端及びスイッチ素子ＳＷ１３の一端が共
に維持電極Ｙｉに接続され、ダイオードＤ９のカソード
及びスイッチ素子ＳＷ１２の他端が配線ＳＤに接続さ
れ、ダイオードＤ１０のアノード及びスイッチ素子ＳＷ
１３の他端が配線ＳＵに接続されている。
【００９３】リセット期間においては、スイッチ素子Ｓ
Ｗ８をオンにし、その他のスイッチ素子をオフにするこ
とにより、維持電極ＹｉからダイオードＤ９、配線ＳＤ
及びスイッチ素子ＳＷ８を通って電流が流れ、維持電極
Ｙｉが電位−Ｖｙとなり、また、スイッチ素子ＳＷ９を
オンにし、その他のスイッチ素子をオフにすることによ
り、抵抗Ｒ２及びダイオードＤ１０を通って、立ち上が
りが緩やかな消去パルス用の電位ＶＳが維持電極Ｙｉに
印加される。この立ち上がりの傾斜は、抵抗Ｒ２と電極
間静電容量とによって決定される。
【００９４】リセット期間及び維持放電期間での維持パ
ルス用の電位Ｖｓは、スイッチ素子ＳＷ６及びＳＷ１０
をオンにし、その他のスイッチ素子をオフにすることに
より、スイッチ素子ＳＷ６、ＳＷ１０及びダイオードＤ
１０を通って維持電極Ｙｉに印加される。アドレス期間
においては、スイッチ素子ＳＷ７とＳＷ１１をオンに
し、その他のスイッチ素子をオフにすることにより、非
選択電位である−Ｖｓｃと選択電位である−ＶｙとがＹ
ｉ駆動回路２５２ｉに与えられる。この際、スイッチ素
子ＳＷ１０をオフにすることにより、ダイオードＤ８を
通って電位−Ｖｙの電源配線へ電流が流れるのが阻止さ
れ、また、スイッチ素子ＳＷ５に接続されている保護用
の逆ダイオード（図１１）を経由して配線ＳＤへ電流が
流れ込むのをダイオードＤ６により阻止している。この
状態で、スイッチ素子ＳＷ１３をオンにすることにより
スキャンパルス用の電位−Ｖｙが維持電極Ｙｉに印加さ
れ、スイッチ素子ＳＷ１２をオンにすることにより非選
択電位である−Ｖｓｃが維持電極Ｙｉに印加される。こ
の動作は、ｉ＝１〜ｎについて順次行われる。
【００９５】正電位の維持電極Ｙｉを０Ｖに低下させる
場合には、スイッチ素子ＳＷ５をオンにし、その他のス
イッチ素子をオフにする。これにより、維持電極Ｙｉか
らダイオードＤ９、Ｄ６及びスイッチ素子ＳＷ５を通っ
て、維持電極Ｙｉを０Ｖにするための電流が流れる。負
電位の維持電極Ｙｉを０Ｖに上昇させる場合には、スイ
ッチ素子ＳＷ１０をオンにし、その他のスイッチ素子を
オフにする。これにより、ダイオードＤ８からスイッチ
素子ＳＷ１０及びダイオードＤ１０を通って、維持電極
Ｙｉを０Ｖにするための電流が流れる。
【００９６】Ｘ共通ドライバ２６は、コンデンサＣ３の
一端が、一方ではスイッチ素子ＳＷ１４を介して電位Ｖ
ｗの電源配線に接続され、他方ではスイッチ素子ＳＷ１
５を介してグランド線に接続されている。コンデンサＣ
３の他端は、一方ではダイオードＤ１１のカソードから
アノードを通って電位Ｖｓの電源配線に接続され、他方
ではスイッチ素子ＳＷ１６を介して維持電極Ｘに接続さ
れている。維持電極Ｘはまた、一方ではスイッチ素子Ｓ
Ｗ１７を介してグランド線に接続され、他方ではダイオ
ードＤ１２のカソードからアノードを通りスイッチ素子
ＳＷ１８を介して電位Ｖａの電源配線に接続されてい
る。スイッチ素子ＳＷ１６及びＳＷ１７にはそれぞれ逆
方向のダイオードＤ１３及びＤ１４が並列接続されてい
る。
【００９７】ダイオードＤ１１と、コンデンサＣ３と、
スイッチ素子ＳＷ１３と、スイッチ素子ＳＷ１４とは、
ステップアップ回路を構成しており、スイッチ素子ＳＷ
１４をオフにし、スイッチ素子ＳＷ１５をオンにするこ
とによりダイオードＤ１１のカソード電位がＶｓとな
り、この状態からスイッチ素子ＳＷ１５をオフにした後
スイッチ素子ＳＷ１４をオンにすることにより、ダイオ
ードＤ１１のカソード電位がＶｓからＶｓ＋Ｖｗにステ
ップアップされる。したがって、スイッチ素子ＳＷ１６
をオンにすると、維持パルス用の電位Ｖｓ又は書き込み
パルス用の電位Ｖｓ＋Ｖｗが維持電極Ｘに印加される。
【００９８】アドレス期間では、スイッチ素子ＳＷ１８
をオンにし、その他のスイッチ素子をオフにすることに
より、維持電極Ｘが電位Ｖａに保持される。維持電極Ｘ
を０Ｖに低下させる場合には、スイッチ素子ＳＷ１６及
びＳＷ１８をオフにして、スイッチ素子ＳＷ１７をオン
にする。電源電圧は、例えば、放電開始電圧がＶｆxymi
n＝２９０Ｖ、Ｖｆaymax＝１８０Ｖのとき次の通りであ
る。
【００９９】 Ｖｓ＝１８０Ｖ、Ｖａ＝５０Ｖ、Ｖｗ＝１３０Ｖ −Ｖｙ＝−１５０Ｖ、−Ｖｓｃ＝−５０Ｖ Ｖｃｃ＝５Ｖ、Ｖｄ＝１５Ｖ 図１１は、図１０の中で特徴を有するＹ駆動回路の詳細
を示す。スイッチ素子ＳＷ５、ＳＷ６、ＳＷ８、ＳＷ１
０、ＳＷ１１及びＳＷ１３はｎＭＯＳトランジスタを有
し、スイッチ素子ＳＷ７、ＳＷ９及びＳＷ１２はｐＭＯ
Ｓトランジスタを有する。これらＭＯＳトランジスタの
ソース・ドレイン間に逆方向接続されたダイオードは、
そのＭＯＳトランジスタの保護用である。スイッチ素子
ＳＷ７〜９及びＳＷ１１のＭＯＳトランジスタのゲート
・ソース間に接続された抵抗は、デート電位のリーク抵
抗であり、該抵抗に並列接続されたツェナーダイオード
は、ＭＯＳトランジスタをオンにする際にゲート・ソー
ス間の電圧を規定するものである。
【０１００】Ｍ１〜Ｍ５は、ＰＤＰ駆動回路に一般的に
使用されている、ＭＯＳ−ＦＥＴドライバＩＣ（例え
ば、ＴＩ社製、型式ＳＮ７５３７２Ｐ）であり、駆動対
象のＭＯＳトランジスタをオンにする際に必要なゲート
電圧Ｖｇｓを発生するものである。このオン電圧Ｖｇｓ
のパルス化はコンデンサで行われる。Ｍ６は、この出力
端に図示のスイッチ素子ＳＷ５及びＳＷ６を接続するこ
とにより、プッシュプル回路を構成することが可能なＭ
ＯＳ−ＦＥＴドライバＩＣ（例えば、ＩＲ社製、型式Ｉ
Ｒ２１１０）である。
【０１０１】Ｍ７は、３端子レギレータであり、入力Ｉ
側のコンデンサに蓄えられた電位Ｖｄから、Ｙｉ駆動回
路２５２ｉ用のフローテング５Ｖ（Ｆ．Ｖｃｃ）を生成
する。入力Ｉ側のコンデンサが充電される期間は、スイ
ッチ素子ＳＷ５がオンして配線ＳＵが０Ｖに保たれた時
のみである。スイッチ素子ＳＷ１９は、Ｍ７の入力端に
印加される電位Ｖｄのオン／オフと、スイッチ素子ＳＷ
１０のオン動作とを行うためのものである。
【０１０２】スイッチ素子ＳＷ１１は、スイッチ素子Ｓ
Ｗ１０のオフと、アドレス期間においてスキャン電位を
配線ＳＵに印加する機能とを兼用しているので、回路が
簡単になっている。スイッチ素子ＳＷ１１をオンにする
と、配線ＳＵから、スイッチ素子ＳＷ１０のゲート・ソ
ース間に接続されたダイオード及びツェナーダイオード
を経由してスイッチ素子ＳＷ１１を通り、電源配線電位
−Ｖｙに電流が流れ、配線ＳＵが電位−Ｖｙまで低下
し、他方では、スイッチ素子ＳＷ１０のゲート・ソース
間の電圧が０Ｖになってスイッチ素子ＳＷ１０が自動的
にオフになる。これにより、効率のよい動作が行われ、
回路も簡単になる。再びスイッチ素子ＳＷ１０をオンに
する場合には、スイッチ素子ＳＷ５をオンにして配線Ｓ
Ｄ及びＳＵを０Ｖにし、スイッチ素子ＳＷ１９をオンに
してスイッチ素子ＳＷ１０にオン電圧Ｖｇｓを与える。
【０１０３】通常の設計では、スイッチ素子ＳＷ１０用
のドライバをフローテング構成で新たに設ける必要があ
るが、本実施例によれば、これを設けることなく、上記
のように効率のよい動作を安価な回路構成で実現でき
る。図１２及び図１３は、図１０中の、電極の印加電圧
波形及びスイッチ素子のオン／オフを示す。図中の数値
は、一例である。図１２及び誘電帯層１２の説明は、以
上の説明から容易に理解できることと、重複説明を避け
るため、省略する。
【０１０４】なお、本発明には外にも種々の変形例が含
まれる。例えば、本発明が適用されるＰＤＰのセル構造
は図１４の型に限定されず、互いに並行な一対のＸ維持
電極とＹｉ維持電極と、これらと離間して交差するアド
レス電極とを有するものであればよく、これら３電極が
同一基板側に配置されていてもよい。
【０１０５】
【発明の効果】以上説明した如く、本発明に係る面放電
型プラズマディスプレイパネルの駆動方法及び駆動回路
によれば、自己消去放電を行って、壁電荷が殆ど完全に
中和するようにしているので、点灯させるセルに書き込
みを行う際には、第１及び第２の電極付近の状態が均一
化されており、これにより、書き込み工程でのパルスの
第２電圧の採り得る範囲が広くなり、書き込み放電前の
電荷分布の状態や温度の変化等によらず常時安定したア
ドレス放電を行うことが可能となり、書き込みミスを防
止して表示品質を向上させることができるという優れた
効果を奏する。また、消灯させるセルについては、第１
と第２の電極間で放電が生じないようにできるので、最
大輝度と黒色表示の最小輝度との比が従来より高くな
り、階調表示の品質が向上するという優れた効果を奏す
る。
【０１０６】本方法発明の第１態様では、第１電極に対
する第３電極の電圧と第２電極に対する第３電極の電圧
とが、絶対値が略等しく符号が逆になるので、第３電極
の正電荷に対する引力と負電荷に対する引力が略等しく
なり、第３電極側で正電荷と負電荷が中和して第３電極
側への壁電荷蓄積量が殆ど０になり、このため、第１発
明の効果が高められる。
【０１０７】本方法発明の第２態様によれば、負の高圧
パルスが不要であるので、駆動回路用電源を、簡単、小
型かつ安価に構成できるという効果を奏する。本方法発
明の第３態様によれば、電源電圧を低くすることができ
るという効果を奏する。本方法発明の第５態様によれ
ば、異常セルであるために第１電圧パルスで消去できな
かった第１及び第２の壁電荷に消去パルスの電圧を上乗
せして放電させ壁電荷を消去させることができ、また、
消去パルスの立ち上がりの傾斜を緩やかにしているの
で、量にばらつきのある壁電荷を効率よく放電させるこ
とができ、余剰点灯を防止して表示品質を向上させるこ
とができるという効果を奏する。
【０１０８】本方法発明の第６態様によれば、異常セル
であるために第１電圧パルスで消去できなかった第１及
び第２の壁電荷の極性が統一され且つ増幅されるので、
消去パルスで第５実施例よりも多く消去することがで
き、また、この残留壁電荷の極性が、書き込み工程にお
いて第２電極と第３電極との間の電圧を低下させる極性
となるので、点灯させないセルの放電が妨げられ、余剰
点灯をより確実に防止することができるという効果を奏
する。
【０１０９】本方法発明の第７態様によれば、消灯させ
るセルについては、書き込み工程において確実に第１と
第２の電極間で放電が生じないようにすることができ、
コントラストが向上するという上記本発明の効果が高め
られる。本方法発明の第８態様によれば、第２電極と第
３電極との間の小規模放電で、充分に第１電極と第２電
極との間の放電の引き金となるので、駆動回路の消費電
力を低減することができるという効果を奏する。
【０１１０】本方法発明の第９態様によれば、上記第８
態様の効果に加え、電源電圧の種類が１つ減るので、電
源回路がより簡単となり、また、維持放電工程において
維持放電が可能な量の壁電荷を効率よく生成することが
できるという効果を奏する。本方法発明の第１０態様に
よれば、セルに隔壁を設けなくても、書き込み工程での
放電による空間電荷が、隣接セルへ飛来して、壁電荷を
蓄積させることによる誤書き込みを防止することができ
るという効果を奏する。
【０１１１】本方法発明の第１１態様によれば、書き込
み工程において第３電極に蓄積される負の壁電荷量が低
減するので、維持工程での始めの維持パルスで第３電極
と第２電極との間の放電には到らず、正常な維持放電が
確保されるという効果を奏する。本方法発明の第１２態
様によれば、書き込み工程で生じた第３電極側の過剰な
負の壁電荷を正の電位で打ち消すことができるので、維
持工程で第３電極と第２電極との間の放電を防止でき、
正常な維持放電が確保され、これにより、表示ミスが防
止されて、表示品質が向上し、また、維持放電の際にイ
オンが第３電極側へ飛来するのを少なくして、セルの劣
化を防ぐことができるという効果を奏する。
【０１１２】本方法発明の第１３態様によれば、第２電
極側の過剰な正の壁電荷による電圧が該正パルスに上乗
せされ、第２電極側が第３電極側より高い電位となり、
微弱な放電を起こすことができ、この放電によって、第
３電極側の過剰な負の壁電荷の一部が除去されるため、
以降は正常な維持放電の継続が可能となり、表示ミスが
防止されて、表示品質が向上するという効果を奏する。
【０１１３】本方法発明の第１４態様によれば、第３電
極駆動回路の出力を一定に保持するための電力が削減で
き、低消費電力化を図ることができるという効果を奏す
る。
【図面の簡単な説明】
【図１】本発明の原理を示す壁電荷自己消去工程図であ
る。
【図２】図１の工程を行わせるための電極印加電圧波形
例示図である。
【図３】本発明の第１実施例のプラズマディスプレイパ
ネル駆動方法を示す電極印加電圧波形図である。
【図４】本発明の第２実施例のプラズマディスプレイパ
ネル駆動方法を示す電極印加電圧波形図である。
【図５】本発明の第３実施例のプラズマディスプレイパ
ネル駆動方法を示す電極印加電圧波形図である。
【図６】本発明の第４実施例のプラズマディスプレイパ
ネル駆動方法を示す電極印加電圧波形図である。
【図７】本発明の第５実施例のプラズマディスプレイパ
ネル駆動方法を示す電極印加電圧波形図である。
【図８】本発明の第６実施例のプラズマディスプレイパ
ネル駆動方法を示す電極印加電圧波形図である。
【図９】本発明の第７実施例のプラズマディスプレイ装
置のブロック図である。
【図１０】図９の装置の１つの表示セルに対する駆動回
路概略図である。
【図１１】図１０中のＹ駆動回路の詳細図である。
【図１２】図１０の回路の、印加電圧波形及びスイッチ
素子のオン／オフを示す図である。
【図１３】図１２の続きを示す図である。
【図１４】プラズマディスプレイパネルのセル断面構成
図である。
【図１５】従来の第１のプラズマディスプレイパネル駆
動方法を示す電極印加電圧波形図である。
【図１６】図１５の駆動方法において、各表示ラインの
駆動サイクルの変化を示す図である。
【図１７】従来の第２のプラズマディスプレイパネル駆
動方法を示す電極印加電圧波形図である。
【図１８】図１７の方法を用いて２５６階調表示するた
めの１フレームの構成を示す図である。
【符号の説明】 １０ セル １１、１４ ガラス基板 １２ 誘電帯層 １３ 保護膜 １５ 蛍光体 １６ 隔壁 １７ 放電空間 ２０ プラズマディスプレイ装置 ２１ 表示パネル ２２ 電源回路 ２３ アドレスドライバ ２４ Ｙ共通ドライバ ２５ 走査ドライバ ２６ Ｘ共通ドライバ ２７ 制御回路 ２３１、２５１ シフトレジスタ ２３２ ラッチ回路 ２３３ アドレス電極駆動回路 ２５２ Ｙ駆動回路 ２３３ａ 電圧ステップアップ回路 ２３３ｂｊ Ａｊ駆動回路 ２３３ｂ１ アドレス電極駆動回路 ２５２ｉ Ｙｉ駆動回路

Claims (17)

    【特許請求の範囲】
  1. 【請求項１】 第１基板に第１及び第２の電極が互いに
    平行に、表示ライン毎に対をなして配置され、該第１基
    板又は該第１基板と離間して対向配置された第２基板
    に、該第１及び第２の電極と離間して交差するように第
    ３電極（Ａｊ）が配置され、該第１及び第２の電極の表
    面が壁電荷蓄積用の誘電体層で被われ、該第２基板側に
    蛍光体が形成され、該第１基板と該第２基板との間の空
    間に放電用のガスが封入され、該第１及び第２の電極と
    該第３電極との各交差部にセルが形成された面放電型プ
    ラズマディスプレイパネルに対し、 該誘電体の表面の電荷分布を均一にさせるために互いに
    隣接した該第１と第２の電極間に第１電圧のパルスを印
    加して放電させるリセット工程と、 点灯させる該セルの該誘電体表面の該第１電極（Ｘ）に
    対応した部分及び該第２電極（Ｙｉ）に対応した部分に
    それぞれ一定量以上で極性が互いに逆の第１及び第２の
    壁電荷を蓄積させるために、該第２電極と、点灯させる
    該セルに対応した該第３電極との間に第２電圧のパルス
    を印加して放電させる書き込み工程と、 該第１と第２の壁電荷間の第３電圧と、該第３電圧と同
    一極性で該第１電極と該第２電極との間に印加する第４
    電圧との和が第１の放電開始電圧以上になる該セルを点
    灯させ、放電毎に該第１壁電荷及び該第２壁電荷の極性
    が逆になるようにするために、互いに隣接した該第１と
    第２の電極間に該第４電圧のパルスとして交流電圧パル
    スを印加する維持放電工程と、 を繰り返し実行し、毎回の維持放電工程の最後の該交流
    電圧パルスの極性が、該リセット工程での第１電圧のパ
    ルスの極性と逆になっている面放電型プラズマディスプ
    レイパネル駆動方法において、 該第１電圧のパルスは、該第１の放電開始電圧より高く
    且つ放電により生ずる該第３電圧が該第１の放電開始電
    圧より高くなる電圧パルスであり、該第１電圧のパルス
    印加後の該第１、第２及び第３の電極の電位を互いに等
    しくする、 ことを特徴とする面放電型プラズマディスプレイパネル
    駆動方法。
  2. 【請求項２】 前記第１電圧のパルスを印加している
    間、前記第３電極（Ａｊ）の電位を、該第１電極（Ｘ）
    の電位と該第２電極（Ｙｉ）の電位の略平均値にする、 ことを特徴とする請求項１記載の面放電型プラズマディ
    スプレイパネル駆動方法。
  3. 【請求項３】 前記第１電圧のパルスを、前記第２電極
    （Ｙｉ）をグランドレベルにし前記第１電極（Ｘ）に正
    の電圧パルスを印加することにより生成する、 ことを特徴とする請求項２記載の面放電型プラズマディ
    スプレイパネル駆動方法。
  4. 【請求項４】 前記第１電圧のパルスを印加している
    間、前記第３電極（Ａｊ）の電位をグランドレベルにす
    る、 ことを特徴とする請求項２記載の面放電型プラズマディ
    スプレイパネル駆動方法。
  5. 【請求項５】 前記第１電圧のパルスの印加前及び後の
    前記第１、第２及び第３の電極の電位はグランドレベル
    である、 ことを特徴とする請求項１乃至３のいずれか１つに記載
    の面放電型プラズマディスプレイパネル駆動方法。
  6. 【請求項６】 前記リセット期間において、前記第１電
    圧のパルスを印加した後、さらに、前記第１と第２の電
    極間に、前記第１の放電開始電圧より低く、且つ、立ち
    上がりの傾斜が緩やかな消去パルスを印加することによ
    り、異常セルであるために該第１電圧パルスで消去でき
    なかった前記第１及び第２の壁電荷に該消去パルスの電
    圧を上乗せして放電させ該壁電荷を消去させることを特
    徴とする請求項１乃至５のいずれか１つに記載の面放電
    型プラズマディスプレイパネル駆動方法。
  7. 【請求項７】 異常セルであるために該第１電圧パルス
    で消去できなかった前記第１及び第２の壁電荷の極性を
    統一し且つ増幅して前記消去パルスでより多く消去する
    ために、前記第１電圧のパルスと前記消去パルスとの間
    の時間において、前記第１と第２の電極間に、前記第１
    の放電開始電圧より低く極性が該第１電圧と逆のパルス
    を印加し、次に、該第１の放電開始電圧より低く極性が
    該第１電圧と同一のパルスを印加し、次に印加する前記
    消去パルスの極性を該第１電圧と逆にする、 ことを特徴とする請求項６記載の面放電型プラズマディ
    スプレイパネル駆動方法。
  8. 【請求項８】 前記書き込み工程において、 前記第２電圧は、前記第２と第３の電極間の第２の放電
    開始電圧以上であり、 前記第４電圧が機能する最小値をＶｓminとし、前記第
    １の放電開始電圧をｆxyminとしたとき、前記第１と第
    ２の電極間にＶｓmin≦Ｖｓ＜Ｖｆxyminなる第５電圧Ｖ
    ｓのパルスを印加する、 ことを特徴とする請求項１乃至７のいずれか１つに記載
    の面放電型プラズマディスプレイパネル駆動方法。
  9. 【請求項９】 前記第５電圧を前記第１の放電開始電圧
    に近い値にする、 ことを特徴とする請求項８記載の面放電型プラズマディ
    スプレイパネル駆動方法。
  10. 【請求項１０】 前記第２電圧のパルスは、グランドレ
    ベルに対し前記第２電極（Ｙｉ）の電位を負にし且つ前
    記第３電極（Ａｊ）をグランドレベルにした状態で該第
    ３電極に印加した正パルスであり、 前記第５電圧のパルスは、前記第１電極（Ｘ）の電位を
    該第３電極の電位に等しくした状態で該第２電極に印加
    した負パルスである、 ことを特徴とする請求項８記載の面放電型プラズマディ
    スプレイパネル駆動方法。
  11. 【請求項１１】 前記第２電極（Ｙｉ）の電位は、前記
    第５電圧の１／４〜３／４程度であることを特徴とする
    請求項１０記載の面放電型プラズマディスプレイパネル
    駆動方法。
  12. 【請求項１２】 前記第２電圧のパルスの幅を、前記第
    ５電圧のパルスの幅よりも狭くする、 ことを特徴とする請求項１乃至１１のいずれか１つに記
    載の面放電型プラズマディスプレイパネル駆動方法。
  13. 【請求項１３】 前記維持放電工程において、前記第３
    電極（Ａｊ）の電位をグランドレベルに対し正の電位と
    する、 ことを特徴とする請求項１乃至１２のいずれか１つに記
    載の面放電型プラズマディスプレイパネル駆動方法。
  14. 【請求項１４】 前記維持放電工程の最初の該第４電圧
    のパルスを印加する前に、前記第１及び第２の電極に同
    時に、前記第３電極（Ａｊ）との電位差が前記第４電圧
    の１／４〜３／４程度の正のパルスを印加する、 ことを特徴とする請求項１３記載の面放電型プラズマデ
    ィスプレイパネル駆動方法。
  15. 【請求項１５】 前記維持放電工程において、前記第３
    電極（Ａｊ）に接続された駆動回路出力端をハイインピ
    ーダンスにする、 ことを特徴とする請求項１乃至１４のいずれか１つに記
    載の面放電型プラズマディスプレイパネル駆動方法。
  16. 【請求項１６】 前記リセット工程を全ての前記セルに
    対し同時に実行し、 次に、前記第２電極（Ｙｉ）について一方から他方へ１
    つずつ順に前記書き込み工程を実行し、 次に、全ての前記第１及び第２の電極について前記維持
    放電工程を同時に実行する、 ことを特徴とする請求項１乃至１５のいずれか１つに記
    載の面放電型プラズマディスプレイパネル駆動方法。
  17. 【請求項１７】 第１基板に第１及び第２の電極が互い
    に平行に、表示ライン毎に対をなして配置され、複数の
    該第１電極（Ｘ）が共通に接続され、該第１基板又は該
    第１基板と離間して対向配置された第２基板に、該第１
    及び第２の電極と離間して交差するように第３電極（Ａ
    ｊ）が配置され、該第１及び第２の電極の表面が壁電荷
    蓄積用の誘電体層で被われ、該第２基板側に蛍光体が形
    成され、該第１基板と該第２基板との間の空間に放電用
    のガスが封入され、該第１及び第２の電極と該第３電極
    との各交差部にセルが形成された面放電型プラズマディ
    スプレイパネルに対し、 該誘電体の表面の電荷分布を均一にさせるために互いに
    隣接した該第１と第２の電極間に第１電圧のパルスを印
    加して放電させ、点灯させる該セルの該誘電体表面の該
    第１電極に対応した部分及び該第２電極（Ｙｉ）に対応
    した部分にそれぞれ一定量以上で極性が互いに逆の第１
    及び第２の壁電荷を蓄積させるために、該第２電極と、
    点灯させる該セルに対応した該第３電極との間に第２電
    圧のパルスを印加して放電させ、該第１と第２の壁電荷
    間の第３電圧と、該第３電圧と同一極性で該第１電極と
    該第２電極との間に印加する第４電圧との和が第１の放
    電開始電圧以上になる該セルを点灯させ、放電毎に該第
    １壁電荷及び該第２壁電荷の極性が逆になるようにする
    ために、互いに隣接した該第１と第２の電極間に該第４
    電圧のパルスとして交流電圧パルスを印加する面放電型
    プラズマディスプレイパネルの駆動回路において、 該面放電型プラズマディスプレイパネルの駆動回路は、
    該第１電圧のパルスを、該放電開始電圧より高く且つ放
    電により生ずる該第３電圧が該第１の放電開始電圧より
    高くなる電圧のパルスとし、該第１電圧のパルス印加後
    の該第１、第２及び第３の電極の電位を互いに等しくす
    る、 ことを特徴とする面放電型プラズマディスプレイ
    パネルの駆動回路。
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