KR100285620B1 - 플라즈마 디스플레이 패널 및 그의 어드레스 방법 - Google Patents

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Abstract

본 발명은 어드레싱 시간을 단축시킬 수 있는 PDP 및 그의 어드레스 방법에 관한 것이다.
본 발명의 PDP는 매트릭스 형태로 배열된 셀 각각이 제1기판 상에 로오방향으로 길게 형성되어 나란하게 배치된 제1 및 제2서스테인 전극라인과, 상기 제1기 판과 대향하는 제2 기판 상에 칼럼방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 어드레스 전극라인과, 상기 제1 및 제2 어드레스 전극라인 중 어느 하나의 상부에 형성된 절연물질패턴과, 상기 제1 및 제2 기판과 함께 방전용 가스가 충진되어진 방전공간을 마련하는 격벽을 구비하는 것을 특징으로 한다.
본 발명에 의하면, 어드레스 방전시 2개의 로오라인씩 또는 어드레스 전극라인을 화면의 상하로 분리하여 4개의 로오라인씩 구동하여 어드레스 기간을 현저하게 단축시킴으로써 전화면에 균일한 방전을 일으킬 수 있게 된다.

Description

플라즈마 디스플레이 패널 및 그의 어드레스 방법
본 발명은 평판 디스플레이 장치 중의 하나인 플라즈마 디스플레이 장치에 관한 것으로, 특히 어드레싱 시간을 단축시킬 수 있는 PDP 및 그의 어드레스 방법에 관한 것이다.
최근들어 대형 평판표시장치가 요구됨에 따라 플라즈마 디스플레이 패널 (Plasma Display Panel ; 이하, PDP라 한다)에 대한 연구가 활발히 진행되고 있다. PDP는 통상 가스 방전 현상을 이용하여 화상을 표시하는 디스플레이 장치로서 방전방식에 따라 직류(DC) 방식과 교류(AC) 방식으로 크게 대별되고 있다.
제1도를 참조하면, 통상적으로 많이 사용되고 있는 3전극 교류(AC) 방식의 PDP의 셀 구조가 도시되어 있다. 여기서, 제1(a)도는 PDP의 셀을 가로축을 따라 자른 단면도를 나타내고, 제1(b)도는 세로축을 따라 자른 단면도를 나타낸다.
제1도에 도시된 PDP의 셀은 화상의 표시면인 상부기판(10)과, 격벽(14)에 의해 상부기판(10)과 평행하게 배치괸 하부기판(12)을 구비한다. 이 격벽(14)은 셀사이를 격리시켜 셀 내부에 방전공간을 마련하게 된다. 상부기판(10) 상에는 서스테인전극 쌍, 즉 주사 및 서스테인 전극(이하, Y 서스테인전극이라 한다)(16a)과 서스테인 전극(이하, Z 서스테인전극이라 한다)(16b)이 나란하게 배치된다. 하부기판(12) 상에는 Y 및 Z 서스테인전극들(16a,16b)과 방전을 일으키기 위한 어드레스 전극(22)이 배치되게 된다. 이 Y 및 Z 서스테인전극(16a,16b)과 어드레스 전극(22)에는 방전을 유지시켜 주기 위해 극성이 계속적으로 반전되는 교류(AC) 전압이 인가된다. 그리고, Y 및 Z 서스테인전극(16a,16b)이 배치된 상부기판(10) 상에는 전하축적을 위한 상부 유전체층(18)이 평탄하게 형성되어 있고, 이 상부 유전체층(18) 표면에는 보호막(20)이 형성되어 있다. 이 보호막(20)은 플라즈마 입자들의 스퍼터링 현상으로부터 상부 유전체층(18)을 보호하여 수명을 연장시켜 줄 뿐만 아니라 이차전자의 방출 효율을 높여주고 내화 금속의 산화물 오염으로 인한 방전 특성의 변화를 줄여주는 역할을 하는 것으로써, 주로 산화마그네슘(MgO) 막이 사용되어진다. 어드레스 전극(22)이 배치된 하부기판(12) 상에는 역시 전하축척을 위한 하부 유전체층(24)이 평탄하게 형성되어 있고, 하부 유전체층(24) 상에는 고유색의 가시광성(R,G,B)을 발생하기 위한 형광체층(26)이 격벽(14)을 포획하도록 도포되어 있다. 이 형광체층(14)은 가스방전시 발생되는 짧은 파장의 자외선(Vacuum Ultraviolet ; VUV)에 의해 여기되어 적, 녹, 청(R,G,B)의 가시광을 발생하게 된다. 셀 내부에 마련되는 방전공간은 자외선 방출 효율을 높여주기 위해 주로 네온(Ne)과 제논(Xe)의 혼합가스로 충전되어진다. 이러한 구성을 갖는 PDP의 셀에 있어서, 어드레스전극(22)과 하나의 서스테인전극(16a 또는 16b) 사이에 방전이 일어나 셀 내부의 유전체(18, 24) 상에 벽전하를 형성하게 된다. 그 다음, Y 및 Z 서스테인 전극(16a, 16b)에 전압을 인가하면 벽전하가 형성된 셀에서만 방전이 계속해서 일어나서 진공 자외선을 방충하게 진다. 이 진공 자외선이 형광체(26)를 여기시켜 가시광이 발생되게 된다.
제2도는 PDP의 계조구현 방법을 나타내는 것으로서, 제2도는 서브필드 방식으로 구동되는 경우 한 프레임의 구동순서를 나타내고 있다.
PDP가 서브필드 방식으로 구동되는 경우 한 화면에 해당하는 한 프레임은 시간적으로 구분된 다수개, 예컨대 8개의 서브필드를 포함하고 있다. 이 경우, 한 프레임의 계조는 각 서브필드에서 발광기간의 길이에 의해 결정된 밝기, 즉 휘도치의 조합으로 구현되게 된다. 제2도에 있어서, 각 서브필드에서 결정된 휘도치(1, 2, 4, 8,…, 128)의 조합으로 0에서 255까지의 계조를 구현하게 된다. 이를 위하여, 각 셀에 선택적으로 벽전하를 형성하여 벽전하가 형성된 셀에서는 방전이 일어나고 벽전하가 형성되지 않은 셀에서는 방전이 일어나지 않도록 하고 있다. 선택적으로 각각의 셀에 벽전하를 형성하는 구간을 어드레스구간이라 하고, 방전이 일어나서 발광하는 구간을 서스테인 구간이라고 한다. 여기서, 어드레스구간은 각 서브필드마다 동일한 시간이 할당되느니 반면에 휘도치가 결정되는 서스테인 구간은 각 서브필드마다 다르게 할당되게 된다.
제3도는 PDP 상에 매트릭스 구조로 배치된 전극라인들을 도시한 것으로서, 제3도의 PDP(30)는 수평방향으로 나란하게 배열된 Y 및 Z 서스테인 전극라인 쌍(Y,Z)과, 수직방향으로 배열된 어드레스 전극라인(X)을 구비한다.
제3도는 PDP에서 서스테인 전극라인 쌍(Y,Z)과 어드레스 전극라인(X)의 교차지점에 제1도에 도시된 바와 같은 셀(28)이 각각 형성되게 된다. 통상 VGA급 PDP는 640×480의 화소수로 이루어지는데, 한 화소는 적(Red), 녹(Green), 청(Blue)를 나타내는 3개의 색화소로 구성되므로 480개의 Y 및 Z 서스테인 전극라인 쌍들(Y1∼Y480, Z1∼Z480)과 1920개의 어드레스 전극라인들(X1∼X1920)이 필요하게 된다. 로오라인(Row Line)을 이루는 서스테인 전극라인 쌍(Y,Z)은 화면을 주사하고 방전을 유지시켜 주기 위해 주로 사용되고, 칼럼(Column)을 이루는 어드레스 전극라인(X)은 데이터 입력에 주로 사용된다.
서스테인 기간에 방전이 일어나야 하는 셀은 이전의 어드레스 기간에서 Y 서스테인 전극 쪽에 벽전하가 형성되어야 한다. 상세히 하면, 우선 첫 번째 Y 서스테인 전극라인(Y1)에 낮은 전압, 즉 주사펄스가 인가됨과 동시에 어드레스 전극라인들(X1∼X1920)에 데이터펄스가 인가되면, 첫 번째 Y 서스테인 전극라인(Y1)과 어드레스 전극라인들(X1∼X1920) 사이에 선택적으로 방전이 일어나게 된다. 이때, 어드레스 전극라인들(X1∼X1920)중 하이상태의 전압펄스가 인가된 셀들에서만 방전이 일어나서 첫 번째 Y 서스테인 전극 (Y1) 쪽에 벽전하가 형성되게 된다. 그 다음, 같은 방법으로 두 번째 Y 서스테인 전극라인(Y2)과 어드레스 전극라인들(X1∼X1920) 사이에 방전을 일으키게 된다. 이러한 동작을 마지막 Y 서스테인 전극라인(Y480)까지 순차적으로 계속하여 어드레스를 마치면, 즉 한 서브필드에 대한 어드레스 기간이 끝나면 Y 및 Z 서스테인 전극라인들(Y1∼Y480, Z1∼Z480) 각각에 서스테인 전압을 동시에 인가하여 벽전하가 형성된 셀에서만 서스테인 방전이 일어나도록 한다.
이와 같이, 종래의 PDP 구동방법은 각 서브필드마다 순차로 어드레스 방전을 일으킨 후에 동시에 서스테인 방전이 발생하도록 하고 있다. 다시 말하여, 종래의 PDP 구동 방법에 의하면, 어드레스기간에 상대적으로 긴 시간이 소요되고 있다. 예컨대, 한 서브필드동안 어드레스하는 시간은 하나의 로오라인을 어드레스하는 시간에 로오라인 수 480을 곱한 값이 된다. 이에 따라, 어드레스 기간 중에 첫 번째 로오라인에 마련된 셀들에 형성된 벽전하량이 마지막 로오라인에 마련된 셀들에 형성된 벽전하량보다 작아지게 되어 서스테인 방전시 전 화면에 불균일한 방전이 발생되는 문제점이 초래되고 있다. 특히, PDP가 고화질화되어 갈수록 셀의 수가 증가하여 어드레스 기간은 상대적으로 길어지게되므로 이 어드레스 기간을 줄일 수 있는 방안이 요구되고 있다.
따라서, 본 발명의 목적은 어드레스 기간을 단축시켜 전화면에 균일한 방전을 일어나도록 하는 PDP 및 그 어드레스 방법을 제공하는 것이다.
본 발명의 다른 목적은 한 셀에 두 개의 어드레스 전극을 구비하여 어드레스 기간을 단축시킬 수 있는 PDP를 제공하는 것이다.
본 발명의 또 다른 목적은 상기 셀에서 하나의 어드레스 전극만 구동되도록 하여 한 번에 두 로오라인씩 어드레스함으로써 어드레스 기간을 단축시킬 수 있는 PDP의 어드레스 방법을 제공하는 것이다.
본 발명의 또 다른 목적은 한 번에 두 로오라인씩 어드레스함과 아울러 한 화면을 상하로 구분하여 구동함으로써 어드레스 기간을 현저하게 단축시킬 수 있는 PDP 및 그 어드레스 방법을 제공하는 것이다.
제1도는 통상적인 교류방식의 PDP 셀의 구조를 나타내는 단면도.
제2도는 PDP의 계조구현 방법을 설명하기 위하여 서브필드로 구성되는 한 프레임의 구동순서를 나타내는 도면.
제3도는 통상적인 PDP의 전극배치도.
제4도는 본 발명의 실시예에 따른 PDP의 전극배치도.
제5도는 본 발명의 실시예에 따른 PDP 셀의 구조를 나타내는 단면도.
제6도는 제4도에 도시된 PDP에서 어드레스 방전을 설명하기 위한 도면.
제7도는 본 발명의 다른 실시예에 따른 PDP의 전극배치도.
* 도면의 주요부분에 대한 부호의 설명
10, 36 : 상부기판 12, 38 : 하부기판
14, 40 : 격벽 16, 42 : 서스테인 전극
16a : Y 서극테인 전극 16b : Z 서스테인 전극
18, 44 : 상부 유전체 20, 46 : 보호막
22 : 어드레스전극 24, 50 : 하부 유전체
26, 54 : 형광체 28, 34 : 셀
30, 32 : PDP 48a : 제1 어드레스 전극
48b : 제2 어드레스 전극 52 : 절연물질패턴
상기 목적을 달성하기 위하여, 본 발명에 따른 PDP는 매트릭스 형태로 배열된 셀 각각이 제1기판 상에 로오방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 서스테인 전극라인과, 상기 제1기판과 대향하는 제2기판 상에 칼럼방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 어드레스 전극라인과, 상기 제1 및 제2 어드레스 전극라인 중 어느 하나의 상부에 형성된 절연물질패턴과, 상기 제1 및 제2기판과 함께 방전용 가스가 충진되는 방전공간을 마련하는 격벽을 구비하는 것을 특징으로 한다.
본 발명에 따른 PDP의 어드레스 방법은 매트릭스 형태로 배열된 셀 각각이 제1기판 상에 로오방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 서스테인 전극라인과, 상기 제1기판과 대향하는 제2기판 상에 칼럼방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 어드레스 전극라인과, 상기 제1 및 제2 어드레스 전극라인 중 어느 하나의 상부에 형성된 절연물질패턴과, 상기 제1 및 제2기판과 함께 방전용 가스가 충진되는 방전공간을 마련하는 격벽을 구비하고, 복수개의 셀들로 이루어진 적어도 2개 이상의 로오라인들에 포함되는 상기 제1기판 서스테인전극라인들에 주사펄스가 동시에 공급되게 함과 아울러 상기 로오라인들에 포함되는 상기 제1 및 제2 어드레스전극라인들에 동시에 해당 데이터펄스가 공급되게 하여 상기 적어도 2개 이상의 로오라인들에서 동시에 상기 데이터펄스에 따른 어드레스방전이 발생되게 하는 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 이점들은 첨부 도면을 참조한 본 발명의 바람직한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
제4도는 본 발명의 실시예에 따른 PDP의 전극구조를 도시한 것으로써, 제4도에 도시된 PDP(32)는 수평방향으로 나란하게 배열된 Y 및 Z 서스테인 전극라인 쌍(Y,Z)과, 수직방향으로 배열된 어드레스 전극라인 쌍(Xa, Xb)을 구비한다.
제4도의 PDP에서 매트릭스 구조를 이루는 서스테인 전극라인 쌍(Y,Z)과 어드레스 전극라인(Xa, Xb)의 교차지점에 하나의 셀(34)이 각각 형성되게 된다. 통상 640×480의 화소수로 이루어지는 PDP의 경우 한 화소는 적(Red), 녹(Green), 청(Blue)를 나타내는 3개의 색화소로 구성되므로 480개의 Y 및 Z 서스테인 전극라인 쌍들(Y1∼Y480, Z1∼Z480)과 1920개의 어드레스 전극라인 쌍들(Xa1∼Xa1920, Xb1∼Xb1920)이 필요하게 된다. 로오라인(Row Line)을 이루는 서스테인 전극라인 쌍(Y,Z)은 화면을 주사하고 방전을 유지시켜 주기 위해 주로 사용되고, 칼럼(Column)을 이루는 어드레스 전극라인쌍(Xa, Xb)은 데이터 입력에 주로 사용된다.
제5도는 본 발명에 따른 PDP에 구성되는 한 셀의 단면을 도시한 것으로써, 제5도에 도시된 PDP의 셀은 화상의 표시면인 상부기판(36)과, 격벽(40)에 의해 상부기판(36)과 평행하게 배치된 하부기판(38)과, 상부기판(36) 상에 나란하게 형성된 시스테인 전극(42)과, 하부기판(38) 상에 나란하게 형성된 제1 및 제2 어드레스 전극(48a, 48b)을 구비한다.
제5도에 도시된 PDP의 셀에서 하부기판(38) 상에 수직으로 신장된 격벽(40)은 셀 사이를 격리시켜 셀 내부에 방전공간을 마련하게 된다. 상부기판(36) 상에는 서스테인전극(42), 즉 Y 서스테인전극과 Z 서스테인전극이 수평방향으로 나란하게 배치된다. 그리고, 서스테인전극(42)이 배치된 상부기판(36) 상에는 전하축척을 위한 상부 유전체층(44)이 평탄하게 형성되어 있고, 이 상부 유전체층(44) 표면에는 보호막(46)이 형성되어 있다. 이 보호막(46)은 방전시 플라즈마 입자들의 스퍼터링 현상으로부터 상부 유전체층(44)을 보호하여 수명을 연장시켜 줄 뿐만 아니라 이차전자의 방출 효율을 높여주고 내화 금속의 산화물 오염으로 인한 방전 특성의 변화를 줄여주는 역할을 하는 것으로써, 주로 산화마그네슘(MgO) 막이 사용되어 진다. 하부기판(52) 상에는 제1 및 제2 어드레스 전극(48a, 48b)이 수직방향으로 나란하게 배치되게 된다. 제1 및 제2 어드레스 전극(48a, 48b)이 배치된 하부기판(38) 상에는 역시 전하축적을 위한 하부 유전체층(50)이 평탄하게 형성되어 있다. 이 하부 유전체층(50)의 표면에서 두 개의 어드레스 전극(48a, 48b) 중 한 어드레스 전극에 대향하는 일측부에는 방전을 일으키지 않도록 절연물질패턴(52)이 형성되게 된다. 이 절연물질패턴(52)이 형성된 하부 유전체층(50) 상에는 고유색의 가시광선(R,G,B)을 발생하기 위한 형광체층(54)이 격벽(40)을 포획하도록 도포되게 된다. 이 형광체층(54)은 셀 내부에서 가스방전시 발생되는 짧은 파장의 자외선(Vacuum Ultraviolet ; VUV)에 의해 여기되어 적, 녹, 청(R,G,B) 중 하나의 가시광을 발생하게 된다. 셀 내부에 마련되는 방전공간은 자외선 방출 효율을 높여주기 위해 주로 네온(Ne)과 제논(Xe)의 혼합가스로 충진되어진다. 이러한 PDP의 셀에 있어서, 하나의 어드레스전극(48a)과 하나의 서스테인전극(42) 사이에 어드레스 방전이 일어나 셀 내부의 유전체(50, 44) 상에 벽전하가 형성되게 된다. 그 다음, Y 및 Z 서스테인전극(42)에 서스테인 전압을 인가하면 벽전하가 형성된 셀에서만 서스테인 방전이 계속해서 일어나서 진공 자외선을 방출하게 된다. 이 진공 자외선이 형광체(54)를 여기시켜 가시광이 발생되게 된다.
이와 같이, 본 발명에 따른 PDP에 구성에 되는 한 셀에서 어드레스 방전은 Y서스테인 전극(42)과 두 개의 어드레스전극(48a, 48b) 중 하나의 어드레스 전극(48a 또는 48b)에 의해 일어나게 된다. 이때, 다른 하나의 어드레스 전극(48b 또는 48b)은 절연물질패턴(52)으로 도포되어 있으므로 어드레스 전극으로서의 역할을 하지 않게 된다. 여기서, 절연물질패턴(52)은 제6도에 도시된 바와 같이 로오라인 별로 교번되도록 배치되게 된다. 이에 따라, 두 개의 로오라인에서 동시에 어드레스방전이 일어나게 된다. 제6도에 있어서, 어드레스 방전시 첫 번째 Y 서스테인 전극라인(Y1)과 두 번째 서스테인 전극라인(Y2)에 낮은 전압의 주사펄스가 인가되고, 이 주사펄스에 동기화 되어 각 칼럼의 제1 및 제2 어드레스 전극라인(Xa1, Xb1 및 Xa2, Xb2)에 데이터펄스가 인가되게 된다. 이때, 어드레스 전극(Xa1, Xb1, Xa2, Xb2) 중에 하이 전압펄스가 인가되는 셀에서만 어드레스 방전이 일어나 셀의 내부에 벽전하가 형성되게 된다. 예컨대, 제6도에서 C와 D 셀만을 점등하고자 하는 경우 각 칼럼의 제2 어드레스 전극라인(Xb1, Xb2)에는 하이 전압펄스가 인가되고, 제1 어드레스 전극라인(Xa1, xa2)에는 로우 전압펄스가 인가되게 된다. 이와 같이, 한 번의 주사기간에 두 개의 로오라인을 동시에 어드레스함으로써 어드레스 시간을 절반으로 단축시킬 수 있게 된다.
제7도는 본 발명의 다른 실시예에 따른 PDP의 전극 배치도를 도시한 것으로서, 제1 실시예와 같이 두 개의 로오라인을 동시에 어드레싱함과 아울러 한 화면을 상하로 구분하여 어드레싱 시간을 종래의 4/1로 줄일 수 있게 된다.
제7도에 있어서, 어드레스 전극라인이 상하로 분리되어 상반부는 제1 및 제2 어드레스 전극라인들(Xa, Xb)에 의해 구동되고 하반부는 제3 및 제4 어드레스 전극라인들(Xc, Xd)에 의해 구동되게 된다. 예를 들어, 제7도에 도시된 바와 같이 8×6의 화소수가 마련된 PDP의 경우 상반부 제1 내지 제4 Y 서스테인 전극라인(Y1∼Y4)은 제1 및 제2 어드레스 전극라인(Xa, Xb)과 함께 어드레스 방전이 일어나게 하고, 하반부 제5 내지 제8 Y 서스테인 전극라인(Y5∼Y8)은 제3 및 제4 어드레스 전극라인(Xc, Xd)과 함께 어드레스 방전이 일어나게 한다. 이 경우, 절연물질패턴(52)은 두 개의 로오라인에 걸쳐 형성되고 두 로오라인씩 교번하여 배치되게 된다. 이에 따라, 상반부의 제1 어드레스 전극라인(Xa)은 제3 및 제4 Y 서스테인 전극라인(Y3, Y4)과 함께 어드레스 방전을 일으키는 반면에 제2 어드레스 전극라인(Xb)은 제1 및 제2 Y 서스테인 전극라인(Y1, Y2)과 함께 어드레스 방전을 일으키게 된다. 이와 비슷하게, 하반부의 제3 어드레스 전극라인(Xc)은 제5 및 제6 Y 서스테인 전극라인(Y5, Y6)과 함께 어드레스 방전을 일으키는 반면에 제4 어드레스 전극라인(Xd)은 제7 및 제8 Y 서스테인 전극라인(Y7, Y8)과 함께 어드레스 방전을 일으키게 된다. 이에 따라, 4개의 로오라인을 동시에 주사할 수 있게 된다. 예를 들면, 제1 및 제3 서스테인 전극라인(Y1, Y3)과 하반부의 제5 및 제7 서스테인 전극라인(Y5, Y7)에 동시에 스캔펄스를 인가함과 아울러 제1 내지 제4 어드레스전극라인(Xa, Xb, Xc, Xd)에 해당 데이터펄스를 동시에 인가하여 어드레스방전이 발생되게함으로써 한 번의 주사기간에 첫 번째, 세 번째, 다섯 번째, 일곱 번째 로오라인들을 동시에 어드레스할 수 있게 된다. 이렇게, 4개의 로오라인씩 어드레스함으로써 어드레스 기간을 기간을 종래에 비하여 1/4로 줄일 수 있게 된다.
상술한 바와 같이, 본 발명에 따른 PDP 및 그 어드레스 방법에 의하면 각 칼럼마다 두 개의 어드레스 전극라인을 나란하게 배치하여 두 개의 로오라인을 동시에 어드레스함으로써 어드레스 기간을 종래에 비하여 절반으로 단축시킬 수 있게 된다. 또한, 본 발명에 따른 PDP 및 그 어드레스 방법에 의하면 상기 어드레스 전극라인을 화면의 상하로 분리하여 구동함으로써 어드레스 기간을 종래에 비하여 1/4로 단축시킬 수 있게 된다. 결과적으로, 어드레스 기간을 단축시켜 전화면에 균일한 방전이 일어나도록 할 수 있게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (9)

  1. 매트릭스 형태로 배열된 셀들을 구비하는 플라즈마 디스플레이 패널에 있어서, 상기 셀 각각은 제1기판 상에 로오방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 서스테인 전극라인과, 상기 제1기판과 대향하는 제2기판 상에 칼럼방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 어드레스 전극라인과, 상기 제1 및 제2 어드레스 전극라인 중 어느 하나의 상부에 형성된 절연물질패턴과, 상기 제1 및 제2기판과 함께 방전용 가스가 충진되는 방전공간을 마련하는 격벽을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제1항에 있어서, 상기 절연물질패턴은 복수개의 셀들로 이루어진 적어도 2개 이하의 로오라인마다 그의 위치가 교번적으로 바뀌게끔 형성된 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제2항에 있어서, 적어도 2개 이상의 로오라인들에서 어드레스방전이 동시에 발생하게끔 상기 적어도 2개 이상의 로오라인들에 포함된 상기 제1 서스테인전극라인들이 동시에 주사펄스를 공급하고 그 로오라인에 포함된 상기 제1 및 제2 어드레스 전극라인들이 동시에 해당 데이터펄스를 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제2항에 있어서, 상기 제1 및 제2 어드레스 전극라인들은 상기 패널에서 상하부로 분리되어 형성된 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제4항에 있어서, 적어도 4개씩의 로오라인들에서 동시에 어드레스방전이 발생하게끔 상기 상하부 각각에 포함되는 2개씩의 로오라인들에 포함된 상기 제1 서스테인전극라인들이 동시에 주사펄스를 공급하고 그 로오라인들에 포함된 상기 제1 및 제2 어드레스 전극라인들이 동시에 해당 데이터펄스를 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 제1항에 있어서, 상기 제1 및 제2기판 중 적어도 하나 이상의 상부에 형성되어진 유전체층과, 상기 유전체층을 보호하기 위한 보호막과, 상기 제2기판의 상부에 형성된 형광체층을 더 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  7. 매트릭스 형태로 배열된 셀들을 구비하는 플라즈마 디스플레이 패널의 구동방법에 있어서. 상기 셀 각각은 제1기판 상에 로오방향으로 길게 형성되어 나란하게 배치된 제1 및 제2 서스테인 전극라인과, 상기 제1기판과 대향하는 제2기판 상에 칼럼방향으로 긱게 형성되어 나란하게 배치된 제1 및 제2 어드레스 전극라인과, 상기 제1 및 제2 어드레스 전극라인 중 어느 하나의 상부에 형성된 절연물질패턴과, 상기 제1 및 제2기판과 함께 방전용 가스가 충진되는 방전공간을 마련하는 격벽을 구비하고, 복수개의 셀들로 이루어진 적어도 2개 이상의 로오라인들에 포함되는 상기 제1 서스테인전극라인들에 주사펄스가 동시에 공급되게 함과 아울러 상기 로오라인들에 포함되는 상기 제1 및 제2 어드레스전극라인들에 동시에 해당 데이터펄스가 공급되게 하여 상기 적어도 2개 이상의 로오라인들에서 동시에 상기 데이터펄스에 따른 어드레스방전이 발생되게 하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 어드레스 방법.
  8. 제7항에 있어서, 상기 제1 및 제2 어드레스 전극라인들이 상기 패널에서 상하부로 분리되어 구동되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 어드레스 방법.
  9. 제8항에 있어서, 상기 상하부 각각에 포함되는 적어도 2개씩의 로오라인들에 포함된 상기 제1 서스테인전극라인들에 동시에 주사펄스가 공급되게 하고 그 로오라인들에 포함된 상기 제1 및 제2 어드레스 전극라인들에 동시에 해당 데이터펄스가 공급되게 하여 적어도 4개씩의 로오라인들에서 동시에 어드레스방전이 발생되게 하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 어드레스 방법.
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