JPH04195188A - フラット型表示装置の階調駆動方法及び階調駆動装置 - Google Patents

フラット型表示装置の階調駆動方法及び階調駆動装置

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JPH04195188A
JPH04195188A JP2331589A JP33158990A JPH04195188A JP H04195188 A JPH04195188 A JP H04195188A JP 2331589 A JP2331589 A JP 2331589A JP 33158990 A JP33158990 A JP 33158990A JP H04195188 A JPH04195188 A JP H04195188A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔概　要〕 プラズマデイスプレィ装置やＥＬデイスプレィ装置など
のフラット型表示装置の階調駆動方法及び階調駆動装置
に関し、 階調表示を行うために必要な駆動時間を短くすることが
でき、階調性の高い表示を行うことのできる階調駆動方
法及び装置を提供することを目的とし、 画面がメモリー機能を有した画素の集合によって構成さ
れたフラット型表示装置の階調駆動方法であって、前記
画面に表示される１つのフレームを複数のサブフレーム
に時間的に分割し、分割したそれぞれのサブフレームを
、全画面の画素に対して、メモリー媒体を選択的に形成
して表示データの書き込みを行う第１ステップと、全画
面の画素に対して、前記メモリー媒体が形成された画素
を表示させる第２ステップとによって表示するとともに
、前記各サブフレームの第２ステップの時間的長さを、
それぞれのサブフレームに対して与えられた重みに応じ
て相違させ、前記サブフレームを合成することによって
１つのフレームの階調表示を行うように構成する。
〔産業上の利用分野〕
本発明は、プラズマデイスプレィ装置やＥＬデイスプレ
ィ装置などのフラット型表示装置の階調駆動方法及び階
調駆動装置に関する。
フラット型表示装置は、奥行き寸法が小さく且つ大型の
表示画面を実現できるため、その利用範囲を急速に拡大
しつつある。
これにともなって、表示画像の品質の一層の向上が望ま
れており、例えばハイビジョンの表示装置として利用す
るために、２５６階調程度の高い階調性を実現すること
が要望されている。
［従来の技術］ 従来より、フラット型表示装置の画面に表示される１つ
のフレームを複数のサブフレームに時間的に分割し、分
割したそれぞれのサブフレームの表示時間に重みを付け
ることによって階調表示を行うことが提案されている（
特公昭５１−３２０５１号公報）。
第８図は第４図に示す対向放電型のＦＤＰ　（プラズマ
デイスプレィパネル）３を階調表示するための従来の階
調駆動方法を示す図である。第８図に示す電圧波形は、
各放電セルにおいてＸ′Ｎ極及びｙｔ極に印加される波
形の合成波形を示している。
従来の階調駆動方法では、書き込みパルスＰｗ、消去パ
ルスＰｆ、及び維持パルスＰｓを、水平方向のラインで
あるＹｉｉＹｊ、Ｙｊ＋１．Ｙｊ＋２・・・に対して順
に印加する書込みサイクルＣＹｗと、維持パルスＰｓの
みを印加する維持サイクルＣＹｍとが設けられている。
書込みサイクルＣＹｗは、上方のラインから順に１サイ
クルずつ遅れて実行され、それぞれのラインにおいて、
書込みサイクルＣＹｗの後に維持サイクルＣＹｍが実行
される。
各ラインにおいては、書込みサイクルＣＹｗの書き込み
パルスＰｗによって壁電荷が形成され、消去パルスＰｆ
によってその壁電荷が消去される。
そのとき、消去しない画素（放電セルＣ）について、つ
まり実際に書き込みの必要な画素について、Ｘ電極Ｘｉ
、Ｘｉ＋１．Ｘｉ＋２・・・に対して消去パルスＰｆと
同時にそれを打ち消すキャンセルパルスＰｃが選択的に
印加され、その結果、キャンセルパルスＰｃ、が印加さ
れた画素についてのみ、選択的に壁電荷が形成されて書
き込みが行われる。
維持パルスＰｓは、全部の画素に対して同時に印加され
、壁電荷が形成されている画素のみが発光して表示が行
われる。
各ライン毎に実行される書込みサイクルＣＹｗと維持サ
イクルＣＹｍとによって１つのサブフレームが表示され
、各サブフレームにおける維持サイクルＣＹｍの時間的
長さに重みをつけることによって１つのフレームの階調
表示が行われる。
〔発明が解決しようとする課題〕
しかし、上述した従来の階調駆動方法では、各ライン毎
に書込みサイクルＣＹｗが別個に設けられ、その度毎に
書き込みパルスＰｗ及び維持パルスＰｓが印加されるの
でそれだけ時間を要し、画面４の全体に対する表示デー
タの書き込みのために多くの時間を要する。
すなわち、書き込みパルスＰＷ、消去パルスＰｆ、及び
維持パルスＰｓの各パルス幅をＴｗ、Ｔｆ、Ｔｓとし、
ライン数をｍとすると、階調性が２″である場合に１フ
レームの表示に必要な時間Ｔｈは、 Ｔｈ＝（Ｔｗ＋Ｔｆ＋Ｔｓ）ＸｍＸｎ　　−・・・・・
（１）となる。
したがって、ｍ＝４００とし、且つ１分間に６０フレー
ムを表示するとし、例えば１６階調（ｎ＝４）の階調性
を持たせた場合には、１つのサブフレームに与えられる
時間は１０μｓ程度となってしまう、この時間内に書込
みサイクルＣＹｗ及び維持サイクルＣＹｍを実行するた
めには、駆動周波数を相当高くする必要がある。
しかし、駆動周波数を高くすると、消費電力が大きくな
り、また、壁電荷の蓄積時間の関係で動作マージンが小
さくなるため、高くできる周波数に限界があり、上述の
階調性の実現は極めて困難である。
また、画面４の全体で見ると、書込みサイクルＣＹｗと
維持サイクルＣＹｍとが同時に実行されるため、維持サ
イクルＣＹｍを書込みサイクルＣＹｗと同じ周期にする
必要があり、輝度の制御、例えば人間の眼のガンマ特性
に合った階調性を実現するような輝度の制御が難しいと
いう問題もある。
本発明は、上述の問題に鑑み、階調表示を行うために必
要な駆動時間を短くすることができ、階調性の高い表示
を行うことのできる階調駆動方法及び装置を提供するこ
とを目的としている。
（ＩＩ！を解決するための手段〕 請求項１の発明に係る階調駆動方法は、上述の課題を解
決するため、第１図〜第７図に示すように、画面４，４
ａがメモリー機能を有した画素Ｃの集合によって構成さ
れたフラット型表示装置３゜３ａの階調駆動方法であっ
て、前記函面４．４８に表示される１つのフレームＦＭ
を複数のサブフレームＳＦに時間的に分割し、分割した
それぞれのサブフレームＳＦを、全画面４，４ａの画素
Ｃに対して、メモリー媒体を選択的に形成して表示デー
タの書き込みを行う第１ステップＣＹａと、全画面４，
４ａの画素Ｃに対して、前記メモリー媒体が形成された
画素Ｃを表示させる第２ステップＣＹｉとによって表示
するとともに、前記各サブフレームＳＦの第２ステップ
ＣＹｉの時間的長さを、それぞれのサブフレームＳＦに
対して与えられた重みに応じて相違させ、前記サブフレ
ームＳＦを合成することによって１つのフレームＦＭの
階調表示を行う。
請求項２の発明に係る階調駆動方法は、前記第１ステッ
プＣＹａにおいて、全画面４．４ａの画素Ｃに対してメ
モリー媒体を形成した後に、形成されたメモリー媒体を
選択的に消去することにより、表示データの書き込みを
行う。
請求項３の発明に係る階調駆動方法は、前記第１ステッ
プＣＹａにおいて、全画面４．４ａの画素Ｃに対して同
時に書き込みパルスＰｗを印加しメモリー媒体を形成し
た後に、ライン毎に順次走査することにより、形成され
たメモリー媒体を選択的に消去し、表示データの書き込
みを行う。
請求項４の発明に係る階調駆動方法は、前記メモリー媒
体が壁電荷であるフラット型表示装置についてである。
請求項５の発明に係る階調駆動方法は、前記メモリー媒
体が空間電荷であるフラット型表示装置についてである
。
請求項６の発明に係る階調駆動装置は、画面４゜４ａが
メモリー機能を有した画素Ｃの集合によって構成された
フラット型表示装置３．３ａ（Ｄ階調駆動装置であって
、前記画面４，４ａに表示される１つのフレームＦＭを
複数のサブフレームＳＦに時間的に分割するサブフレー
ム分割処理手段１３と、分割したそれぞれのサブフレー
ムＳＦを、全画面４．４ａの画素Ｃに対して、メモリー
媒体を選択的に形成して表示データの書き込みを行う第
１ステップＣＹａと、全画面４，４ａの画素Ｃに対して
、前記メモリー媒体の形成された画素Ｃを表示させる第
２ステップＣＹｉとによって表示するとともに、前記各
サブフレームＳＦの第２ステップＣＹｉの時間的長さを
、それぞれのサブフレームＳＦに対して与えられた重み
に応して相違させるように、前記画面４，４ａをスキャ
ンするスキャン処理手段１４とを有してなる。
〔作　用〕
１つのフレームＦＭは、複数のサブフレームＳＦが時間
軸上で合成されることによって表示される。
それぞれのサブフレームＳＦは、第１ステップＣＹａに
よってメモリー媒体が選択的に形成され、第２ステップ
ＣＹｉによって所定の時間表示される。
第１ステップＣＹａは、画面４，４ａの全体、すなわち
全画素Ｃに対して同時に行われる。但し、画面４．４ａ
を複数の画面に分割し、分割したそれぞれの画面毎に行
ってもよい。
第２ステップＣＹｉの時間的長さは、それぞれのサブフ
レームＳＦに対して与えられた重みに応して相違し、そ
れぞれの画素Ｃについて、サブフレームＳＦの組み合わ
せによって階調表示が行われる。
〔実施例〕
以下、本発明の実施例を図面を参照しつつ説明する。
第１図は本発明に係る階調駆動方法を説明するための図
、第４図は対向放電型のＰＤＰ　（プラズマデイスプレ
ィパネル）３の概略の構成図である。
第１回においては、１フレ一ムＦＭを４つのサブフレー
ムＳＦ１〜４に分割した場合の例が示されている。
第４図において、ＰＤＰ３の画面４は、縦方向に延びる
Ｘ電極Ｘｉと横方向に延びるＹ電極Ｙｊとのそれぞれの
交点において放電セルＣが画定され、各放電セルＣが放
電により選択的に発光することによって表示が行われる
。
第１図おいて、その横方向は時間軸であり、画面４に表
示される１フレ一ムＦＭを４つのサブフレームＳＦ１〜
４に時間的に分割し、分割したそれぞれのサブフレーム
ＳＦ１〜４を、それぞれ、アドレスサイクルＣＹａ　（
第１ステップ）と表示すイクルＣＹｉ（第２ステップ）
とによって表示する。
アドレスサイクルＣＹａでは、画面４全体の画素（放電
セルＣ）に対して壁電荷を同時に形成した後に、形成さ
れた壁電荷を選択的に消去することにより、表示データ
の書き込みを行う。
そして、各サブフレームＳＦ１〜４の表示すイクルＣＹ
ｉの時間的長さを、それぞれのサブフレームＳＦ１〜４
に対して与えられた重みに応して順次長くなるように設
定し、これらのサブフレームＳＦ１〜４を合成すること
によって、ｌフレームＦＭの階調表示を行うのである。
次に、第２図及び第３図に基づいてさらに具体的に説明
する。
第２図はＰＤＰ３に印加される駆動電圧の波形を示す図
、第３図はＰＤＰ３のＸ電極Ｘｉ及びＹ電極Ｙｊにそれ
ぞれ印加される駆動電圧の波形を示す図である。なお第
２図は第３図の波形の合成波形である。
アドレスサイクルＣＹａは、各ラインであるＹ電極Ｙｊ
、Ｙｊ＋１．Ｙｊ＋２・・・に対して、同時に実行され
る。
アドレスサイクルＣＹａにおいては、全部のライン（し
たがって全部の画素）に対して同時に書き込みパルスＰ
ｗが印加され、これによって壁電荷が形成される。
次に、各ライン毎に、順次、消去パルスＰｆが印加され
る−とともに、それぞれの消去パルスＰｆの印加と同時
に、当該サブフレームＳＦ１〜４において発光表示すべ
き画素について、キャンセルパルスＰｃがＸ電極Ｘｉ、
Ｘｉ＋１．Ｘｉ＋：ｌ”・−から印加される。キャンセ
ルパルスＰｃが印加されなかった画素は、消去パルスＰ
ｆによって壁電荷が消滅するが、キャンセルパル−スＰ
ｃが印加された画素は、消去パルスＰｆがキャンセルパ
ルスＰｃによって打ち消され、その結果壁電荷が維持さ
れる。
つマリ、消去パルスＰｆとキャンセルパルスＰＣによっ
て壁電荷が選択的に消去され、表示データの書き込みが
行われる。
表示すイクルＣＹｉにおいては、全部のラインに対して
同時に維持パルスＰｓが印加され、これによって、壁電
荷が形成されている（維持されている）画素が発光する
。
表示すイクルＣＹｉにおいて、各画素の輝度は維持パル
スＰ＄の個数に応じて決まる。
各サブフレームＳＦ１〜４の長さは、例えば１対２対４
対８となるように、それぞれの表示すイクルＣＹｉにお
ける維持パルスＰｓの個数が設定されており、これによ
って、それぞれの比に応じた輝度が得られるようになっ
ている。
これらのサブフレームＳＦ１〜４を合成することによっ
て、１フレ一ムＦＭの階調表示が行われる。
なお、第３図に示されるように、Ｙ電極Ｙｊには、正方
向の維持パルスＰｓｙ、書き込みパルスＰｗ、及び消去
パルスＰｆが印加され、Ｘ電極Ｘｉには、正方向の維持
パルスＰｓｘ、及び画素毎に選択されたキャンセルパル
スＰｃが印加される。
第５図はＰＤＰ３ａのｘｔ極Ｘ、Ｙ電極Ｙｊ、及びアド
レス電極Ａｎにそれぞれ印加される駆動電圧の波形を示
す図、第６図は特開昭５７−７８７５１号又は特開昭６
１−３９３４１号公報などにより周知の三電極構造を持
った面放電型のＰＤＰ３ａの概略の構成図である。
第６図において、ＰＤＰ３ａの画面４ａは、横方向に延
びる互いに平行なＸ電極Ｘ及びｙｉｉ極Ｙｊと、縦方向
に延びるアドレス電極Ａｎとのそれぞれの交点において
、放電セルＣが画定されている。
第５図において、各ラインであるＹ電極Ｙｊ。
Ｙｊ＋１．Ｙｊ＋２・・・及びＸ電極Ｘに対して、同時
にアドレスサイクルＣＹａが実行される。
アドレスサイクルＣＹａにおいては、全部のラインに対
して同時に書き込みパルスＰｗがＸ電極Ｘから印加され
、これによって壁電荷が形成される。
次に、各ライン毎に、順次、消去パルスＰｆがＹ’！極
から印加されるとともに、それぞれの消去パルスＰｆの
印加と同時に、当該サブフレームＳＦ１〜４において発
光表示すべき画素（放電セルＣ）について、消去アドレ
スパルスＰａがアドレス電極Ａｎから印加される。
消去アドレスパルスＰａが印加された画素のみについて
、消去用放電が発生し壁電荷が消去される。一方、消去
アドレスパルスＰａが印加されない画素は壁電荷が維持
される。
表示すイクルＣＹｉにおいては、全部のラインに対して
同時に維持パルスＰｓｙ、Ｐｓｘが印加され、これによ
って、壁電荷が形成されている画素が発光する。
サブフレームＳＦ１〜４に応じて表示すイクルＣＹｉの
長さ（維持パルスＰｓｙ、Ｐｓｘの個数）が相違し、そ
れぞれの長さに応じた輝度が得られるようになっている
。
これらのサブフレームＳＦ１〜４を合成することによっ
て、１フレ一ムＦＭの階調表示が行われる。
第７図は本発明に係る階調駆動装置５を示すブロック図
である。
階調駆動装置５は、ＡＤ変換部１１、フレームメモリ１
２、サブフレーム分割処理部１３、スキャン処理部１４
、タイミング制御部１５などから構成されている。
ＡＤ変換部１１は、アナログ信号である人力信号Ｓ１を
量子化してデジタル信号である画像データＤ２に変換す
る。
フレームメモリ１２は、ＡＤ変換部１１から出力される
１フレ一ム分の画像データＤ２を格納する。
サブフレーム分割処理部１３は、フレームメモリ１２に
格納された１フレ一ムＦＭの画像データＤ２を、階調に
応じた個数のサブフレームＳＦに分割し、それぞれのサ
ブフレームＳＦの画像データＤ３を出力する。
スキャン処理部１４は、サブフレーム分割処理部１３か
ら出力される各サブフレームＳＦの画像データＤ３、及
びタイミング制御部１５からのタイミング信号に基づい
て、ＰＤＰ３のＹ１ｉ極駆動駆動３１及びｘｔ極駆動回
路３２をスキャンする。
スキャン処理部１４には、キャンセルパルスＰＣを発生
するキャンセルパルス発生回路（ＰＤＰ３ａに対しては
消去アドレスパルス発生回路）２１、書き込みパルスＰ
ｗを発生する書き込みパルス発生回路２２、維持パルス
Ｐｓを発生する維持パルス発生回路２３、これらの信号
を合成する合成回路２４などが設けられている。
タイミング制御部１５は、サブフレーム分割処理部１３
の処理のタイミング、キャンセルパルスＰｃを出力する
タイミング、各サブフレームＳＦにおける表示すイクル
ＣＹｉの終了のタイミングなど、種々のタイミング信号
を出力する。
次に、階調駆動装置５の動作について説明するが、ＰＤ
Ｐ３に印加される電圧波形などについては先に説明した
のと同様であるので、詳しい説明を省略する。
フレームメモリ１２に１画素当たりｎビットの画像デー
タＤ２が格納され、これを２″階調で表示する場合には
、サブフレーム分割処理部１３は、画像データＤ２の最
下位ビットから順に最上位ビットまで、それぞれのビッ
トのみからなるｎ１ｌｌ！の２値の画像データＤ３を順
次出力する。
これらの画像データＤ３に基づいて、キャンセルパルス
発生回路２１は、それぞれのラインのスキャン時におい
てそれぞれの水平方向位置に対応したキャンセルパルス
Ｐｃを発生する。
タイミング制御部１５は、サブフレーム分割処理部１３
が出力するビット位置の画像データＤ３に応じて、それ
ぞれのサブフレームＳＦの表示すイクルＣＹｉの長さが
所定の値になるように、タイミング制御信号を出力する
。
合成回路２４は、各パルス発生回路２１〜２３からのパ
ルス信号を合成することによって、各サブフレームＳＦ
においてアドレスサイクルＣＹａ及び表示すイクルＣＹ
ｉが実行されるように、第３図に示す電圧波形のスキャ
ン信号を作成して出力する。
上述の実施例によると、書き込みパルスＰｗが全部の画
面４に対して同時に印加され、これによって同時に壁電
荷が形成されるので、従来のようにライン毎に順次維持
パルスＰｓ及び書き込みパルスＰｗを印加する階調駆動
方法に比較して、壁電荷を形成するのに必要な時間が大
幅に減少する。
そのため、従来と同じ階調性を従来よりも低い駆動周波
数で得ることができ、それだけ消費電力を低くすること
ができるとともに、動作マージンを確保するために維持
パルスＰｓのパルス幅を充分大きくすることが可能であ
る。
また、従来と同じ周波数の場合には、従来に比較して階
調性の高い表示を行うことが可能であり、高品位の画像
を表示することができる。したがって、ＦＤＰ３をハイ
ビジョンに利用することが可能となってくる。
また、各サブフレームＳＦ１〜４において、アドレスサ
イクルＣＹａと表示すイクルＣＹｉとが互いに独立して
おり、表示すイクルＣＹｉにおける維持パルスＰｓの周
期をアドレスサイクルＣＹａの周期に同期させる必要が
ないため、表示すイクルＣＹｉ内の維持パルスＰｓの個
数を任意に設定することができる。
したがって、耀度の制御が容易であり、各サブフレーム
ＳＦ１〜４の長さの比を、例えば人間の眼のガンマ特性
に合った階調性に近くなるように設定することが容易で
あるとともに、信較性、回路設計の自由度、コストなど
において有利である。
上述の実施例においては、１フレ一ムＦＭを４つのサブ
フレームＳＦ１〜４に分割したが、３つ以下又は５つ以
上のサブフレームＳＦに分割してもよい、各サブフレー
ムＳＦにおける表示すイクルＣＹｉの長さは、種々の比
率に設定することが可能である。表示すイクルＣＹｉの
長さとして、アドレスサイクルＣＹａにおける維持パル
スＰｓの長さを加算してもよい、ｘｔ極、Ｙ［極、アド
レス電極に印加する電圧波形は、上述以外に種々の波形
とすることができる。ＦＤＰ３．３ａ、階調駆動装置５
の構造及び構成は、上述した以外に種々異なったものと
することができる。
上述の実施例においては、メモリー媒体が壁電荷である
ＡＣ型のＦＤＰ３，３ａについて説明したが、メモリー
媒体が空間電荷であるＤＣ型のＰＤＰ、ＥＬ表示装置又
は液晶表示装置などの他のメモリー媒体を持つものに対
しても適用することができる。
〔発明の効果〕
本発明によると、階調表示を行うために必要な駆動時間
を短くすることができ、階調性の高い表示を行うことの
できる階調駆動方法及び装置を提供することができる。
【図面の簡単な説明】
第１図は本発明に係る階調駆動方法を説明するための図
、 第２図は対向放電型のＰＤＰに印加される駆動電圧の波
形を示す図、 第３図は対向放電型のＰＤＰのＸｔ極及びＹ電極にそれ
ぞれ印加される駆動電圧の波形を示す図、第４図は対向
放電型のＰＤＰの概略の構成図、第５図は面放電型のＰ
ＤＰのＸｔ極、Ｙ電極、及びアドレス電極にそれぞれ印
加される駆動電圧の波形を示す図、 第６図は面放電型のＰＤＰの概略の構成図、第７図は本
発明に係る階調駆動装置を示すブロック図、 第８回は対向放電型のＰＤＰを階調表示するための従来
の階調駆動方法を示す図である。 図において、 ３．３ａはＦＤＰ　（フラット型表示装置）、４．４ａ
は画面、 ５は階調駆動装置、 １３はサブフレーム分割処理部（サブフレーム分割処理
手段）、 １４はスキャン処理部（スキャン処理手段）、ＦＭはフ
レーム、 ＳＦはサブフレーム、 Ｃは放電セル（画素）、 ＣＹａはアドレスサイクル（第１ステップ）、ＣＹｉは
表示すイクル（第２ステップ）である。 ハ二 第ス ーテ ツ　　− プ 本発明に係る階調駆動方法を説明するための図第１図 ３　　ＰＤＰ 対向型のＦＤＰの概略の構成図 第４図 第５図

Claims (6)

    【特許請求の範囲】
  1. （１）画面（４）（４ａ）がメモリー機能を有した画素
    （Ｃ）の集合によって構成されたフラット型表示装置（
    ３）（３ａ）の階調駆動方法であって、 前記画面（４）（４ａ）に表示される１つのフレーム（
    ＦＭ）を複数のサブフレーム（ＳＦ）に時間的に分割し
    、分割したそれぞれのサブフレーム（ＳＦ）を、全画面
    （４）（４ａ）の画素（Ｃ）に対して、メモリー媒体を
    選択的に形成して表示データの書き込みを行う第１ステ
    ップ（ＣＹａ）と、 全画面（４）（４ａ）の画素（Ｃ）に対して、前記メモ
    リー媒体が形成された画素（Ｃ）を表示させる第２ステ
    ップ（ＣＹｉ）とによって表示するとともに、前記各サ
    ブフレーム（ＳＦ）の第２ステップ（ＣＹｉ）の時間的
    長さを、それぞれのサブフレーム（ＳＦ）に対して与え
    られた重みに応じて相違させ、前記サブフレーム（ＳＦ
    ）を合成することによって１つのフレーム（ＦＭ）の階
    調表示を行うことを特徴とするフラット型表示装置の階
    調駆動方法。
  2. （２）前記第１ステップ（ＣＹａ）において、全画面（
    ４）（４ａ）の画素（Ｃ）に対してメモリー媒体を形成
    した後に、形成されたメモリー媒体を選択的に消去する
    ことにより、表示データの書き込みを行うことを特徴と
    する請求項１記載のフラット型表示装置の階調駆動方法
    。
  3. （３）前記第１ステップ（ＣＹａ）において、全画面（
    ４）（４ａ）の画素（Ｃ）に対して同時に書き込みパル
    ス（Ｐｗ）を印加しメモリー媒体を形成した後に、ライ
    ン毎に順次走査することにより、形成されたメモリー媒
    体を選択的に消去し、表示データの書き込みを行うこと
    を特徴とする請求項１記載のフラット型表示装置の階調
    駆動方法。
  4. （４）前記メモリー媒体が壁電荷である請求項１から請
    求項３のいずれかに記載のフラット型表示装置の階調駆
    動方法。
  5. （５）前記メモリー媒体が空間電荷である請求項１から
    請求項３のいずれかに記載のフラット型表示装置の階調
    駆動方法。
  6. （６）画面（４）（４ａ）がメモリー機能を有した画素
    （Ｃ）の集合によって構成されたフラット型表示装置（
    ３）（３ａ）の階調駆動装置であって、 前記画面（４）（４ａ）に表示される１つのフレーム（
    ＦＭ）を複数のサブフレームプラズマディスプレイ装置
    やＥＬディスプレイ装置などのフラット型表示装置の階
    調駆動方法及び階調駆動装置に関し、階調表示を行うた
    めに必要な駆動時間を短くすることができ、階調性の高
    い表示を行うことのできる階調駆動方法及び装置を提供
    することを目的とし、画面がメモリー機能を有した画素
    の集合によって構成されたフラット型表示装置の階調駆
    動方法であって、前記画面に表示される１つのフレーム
    を複数のサブフレームに時間的に分割し、分割したそれ
    ぞれのサブフレームを、全画面の画素に対して、メモリ
    ー媒体を選択的に形成して表示データの書き込みを行う
    第１ステップと、全画面の画素に対して、前記メモリー
    媒体が形成された画素を表示させる第２ステップとによ
    って表示するとともに、前記各サブフレームの第２ステ
    ップの時間的長さを、それぞれのサブフレームに対して
    与えられた重みに応じて相違させ、前記サブフレームを
    合成することによって１つのフレームの階調（ＳＦ）に
    時間的に分割するサブフレーム分割処理手段（１３）と
    、分割したそれぞれのサブフレーム（ＳＦ）を、全画面
    （４）（４ａ）の画素（Ｃ）に対して、メモリー媒体を
    選択的に形成して表示データの書き込みを行う第１ステ
    ップ（ＣＹａ）と、全画面（４）の画素（Ｃ）に対して
    、前記メモリー媒体の形成された画素（Ｃ）を表示させ
    る第２ステップ（ＣＹｉ）とによって表示するとともに
    、前記各サブフレーム（ＳＦ）の第２ステップ（ＣＹｉ
    ）の時間的長さを、それぞれのサブフレーム（ＳＦ）に
    対して与えられた重みに応じて相違させるように、前記
    画面（４）（４ａ）をスキャンするスキャン処理手段（
    １４）とを有してなることを特徴とするフラット型 表示装置の階調駆動装置。
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