JP2914317B2 - マイクロコンピュータ - Google Patents
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- G05B23/0227—Qualitative history assessment, whereby the type of data acted upon, e.g. waveforms, images or patterns, is not relevant, e.g. rule based assessment; if-then decisions
- G05B23/0235—Qualitative history assessment, whereby the type of data acted upon, e.g. waveforms, images or patterns, is not relevant, e.g. rule based assessment; if-then decisions based on a comparison with predetermined threshold or range, e.g. "classical methods", carried out during normal operation; threshold adaptation or choice; when or how to compare with the threshold
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- H02H7/00—Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions
- H02H7/08—Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions for dynamo-electric motors
- H02H7/093—Emergency protective circuit arrangements specially adapted for specific types of electric machines or apparatus or for sectionalised protection of cable or line systems, and effecting automatic switching in the event of an undesired change from normal working conditions for dynamo-electric motors against increase beyond, or decrease below, a predetermined level of rotational speed
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- Programmable Controllers (AREA)
- Control Of Ac Motors In General (AREA)
- Microcomputers (AREA)
Description
【０００１】
【発明の属する技術分野】本発明は、マイクロコンピュ
ータに関し、特に、モータ制御等を目的とするパルス出
力機能を有するマイクロコンピュータに関する。
ータに関し、特に、モータ制御等を目的とするパルス出
力機能を有するマイクロコンピュータに関する。
【０００２】
【従来の技術】図４は、従来の、モータ制御等を目的と
するパルス出力機能を備えたマイクロコンピュータの一
構成例を示すブロック図である。
するパルス出力機能を備えたマイクロコンピュータの一
構成例を示すブロック図である。
【０００３】本従来例は図４に示すように、出力パルス
のアクティブ幅を制御するとともにマイクロコンピュー
タ全体の制御を行うＣＰＵ１と、出力パルスの基本クロ
ックとなるクロック信号が入力され、該クロック信号を
カウントするタイマ２と、ＣＰＵ１において設定された
アクティブ幅の設定値を保持し、該設定値とタイマ２に
おいてカウントされたカウント値とを比較して両者が一
致したタイミングにおいて一致信号を出力するコンペア
・レジスタ３と、コンペア・レジスタ３から出力された
一致信号が入力され、該一致信号に基づいて割り込み信
号及び出力タイミング信号を生成し、出力するマスク回
路４と、マスク回路４から出力される出力タイミング信
号とタイマ２においてオーバーフロー時に出力されるオ
ーバーフロー信号とに基づいて制御パルスを生成し、出
力する出力制御回路５とから構成されている。
のアクティブ幅を制御するとともにマイクロコンピュー
タ全体の制御を行うＣＰＵ１と、出力パルスの基本クロ
ックとなるクロック信号が入力され、該クロック信号を
カウントするタイマ２と、ＣＰＵ１において設定された
アクティブ幅の設定値を保持し、該設定値とタイマ２に
おいてカウントされたカウント値とを比較して両者が一
致したタイミングにおいて一致信号を出力するコンペア
・レジスタ３と、コンペア・レジスタ３から出力された
一致信号が入力され、該一致信号に基づいて割り込み信
号及び出力タイミング信号を生成し、出力するマスク回
路４と、マスク回路４から出力される出力タイミング信
号とタイマ２においてオーバーフロー時に出力されるオ
ーバーフロー信号とに基づいて制御パルスを生成し、出
力する出力制御回路５とから構成されている。
【０００４】上記のように構成されたマイクロコンピュ
ータにおいては、ＣＰＵ１において制御パルスのアクテ
ィブ幅が制御され、それにより、外部に接続されるモー
タの回転速度が決定されている（特開平２−１９９５０
３号公報参照）。
ータにおいては、ＣＰＵ１において制御パルスのアクテ
ィブ幅が制御され、それにより、外部に接続されるモー
タの回転速度が決定されている（特開平２−１９９５０
３号公報参照）。
【０００５】以下に、上述した動作について詳細に説明
する。
する。
【０００６】図５は、図４に示したマイクロコンピュー
タから出力される制御パルスの一例を示す図である。
タから出力される制御パルスの一例を示す図である。
【０００７】タイマ２に、出力パルスの基本クロックと
なるクロック信号が入力されると、タイマ２において、
入力されたクロック信号がカウントされる。そして、タ
イマ２におけるオーバーフロー周期によって制御パルス
の周期ｂが決定する。なお、タイマ２におけるカウント
クロックやビット長が一定の場合は、周期ｂも一定とな
る。
なるクロック信号が入力されると、タイマ２において、
入力されたクロック信号がカウントされる。そして、タ
イマ２におけるオーバーフロー周期によって制御パルス
の周期ｂが決定する。なお、タイマ２におけるカウント
クロックやビット長が一定の場合は、周期ｂも一定とな
る。
【０００８】周期ｂが決定した状態において、ＣＰＵ１
にて、制御パルスのアクティブ幅ａの設定値が設定さ
れ、コンペア・レジスタ３に保持される。
にて、制御パルスのアクティブ幅ａの設定値が設定さ
れ、コンペア・レジスタ３に保持される。
【０００９】その後、コンペア・レジスタ３において、
保持されている設定値とタイマ２におけるカウント値と
が比較され、両者が一致したタイミングにおいて一致信
号が出力される。
保持されている設定値とタイマ２におけるカウント値と
が比較され、両者が一致したタイミングにおいて一致信
号が出力される。
【００１０】コンペア・レジスタ３から一致信号が出力
されると、マスク回路４において、一致信号に基づいて
割り込み信号及び出力タイミング信号が生成され、出力
される。
されると、マスク回路４において、一致信号に基づいて
割り込み信号及び出力タイミング信号が生成され、出力
される。
【００１１】その後、出力制御回路５において、マスク
回路４から出力された出力タイミング信号とタイマ２か
ら出力されたオーバーフロー信号とに基づいて、周期ｂ
及びアクティブ幅ａを有する制御パルスが生成され、出
力される。
回路４から出力された出力タイミング信号とタイマ２か
ら出力されたオーバーフロー信号とに基づいて、周期ｂ
及びアクティブ幅ａを有する制御パルスが生成され、出
力される。
【００１２】ここで、アクティブ幅ａにおいては、狭い
ほど制御パルスにより動作するモータの回転速度が速く
なり、広いほどモータの回転速度が遅くなる。
ほど制御パルスにより動作するモータの回転速度が速く
なり、広いほどモータの回転速度が遅くなる。
【００１３】また、制御パルスの出力の許可及び禁止の
制御においては、ＣＰＵ１からマスク回路４に対して出
力されるマスク信号にしたがって行われている。
制御においては、ＣＰＵ１からマスク回路４に対して出
力されるマスク信号にしたがって行われている。
【００１４】
【発明が解決しようとする課題】しかしながら、上述し
たような従来のマイクロコンピュータにおいては、コン
ペア・レジスタに設定される制御パルスのアクティブ幅
が、主にＣＰＵの演算等のソフトウェア処理において決
定されており、ソフトウェアのバグ等によりコンペア・
レジスタに許容範囲外の値が設定された場合にそれを検
出する手段がないため、ソフトウェアのバグ等によりコ
ンペア・レジスタに許容範囲外の値が設定された場合、
モータの回転速度がシステムにおける許容範囲外となっ
てしまい、その結果、モータや駆動回路が破壊してしま
う虞れがある。
たような従来のマイクロコンピュータにおいては、コン
ペア・レジスタに設定される制御パルスのアクティブ幅
が、主にＣＰＵの演算等のソフトウェア処理において決
定されており、ソフトウェアのバグ等によりコンペア・
レジスタに許容範囲外の値が設定された場合にそれを検
出する手段がないため、ソフトウェアのバグ等によりコ
ンペア・レジスタに許容範囲外の値が設定された場合、
モータの回転速度がシステムにおける許容範囲外となっ
てしまい、その結果、モータや駆動回路が破壊してしま
う虞れがある。
【００１５】また、制御パルスの出力許可及び禁止にお
いては、マスク回路において制御されており、外部回路
等において異常状態が検出された場合、その異常状態を
ＣＰＵに入力し、さらにＣＰＵからマスク回路にマスク
信号が送られることにより制御パルスの出力が禁止され
るため、何らかの理由により上述した問題点が発生した
場合に、自ら制御パルスの出力を停止することができ
ず、異常発生時において迅速に出力を停止させることが
できないという問題点がある。
いては、マスク回路において制御されており、外部回路
等において異常状態が検出された場合、その異常状態を
ＣＰＵに入力し、さらにＣＰＵからマスク回路にマスク
信号が送られることにより制御パルスの出力が禁止され
るため、何らかの理由により上述した問題点が発生した
場合に、自ら制御パルスの出力を停止することができ
ず、異常発生時において迅速に出力を停止させることが
できないという問題点がある。
【００１６】本発明は、上述したような従来の技術が有
する問題点に鑑みてなされたものであって、出力異常を
自ら検出することができるとともに、モータの回転速度
がシステムにおける許容範囲外となった場合にモータの
回転を停止させることができるマイクロコンピュータを
提供することを目的とする。
する問題点に鑑みてなされたものであって、出力異常を
自ら検出することができるとともに、モータの回転速度
がシステムにおける許容範囲外となった場合にモータの
回転を停止させることができるマイクロコンピュータを
提供することを目的とする。
【００１７】
【課題を解決するための手段】上記目的を達成するため
に本発明は、出力パルスのアクティブ幅を制御するため
の該アクティブ幅の設定値を設定するとともにマイクロ
コンピュータ全体の制御を行うＣＰＵと、前記出力パル
スの基本クロックとなるクロック信号が入力され、該ク
ロック信号をカウントするタイマと、前記設定値を保持
し、該設定値と前記タイマにおいてカウントされたカウ
ント値とを比較して両者が一致したタイミングにおいて
一致信号を出力するコンペア・レジスタと、該コンペア
・レジスタから出力された一致信号が入力され、該一致
信号に基づいて割り込み信号及び出力タイミング信号を
生成し、出力するマスク回路と、該マスク回路から出力
される出力タイミング信号と前記タイマにおいてオーバ
ーフロー時に出力されるオーバーフロー信号とに基づい
て制御パルスを生成し、出力する出力制御回路とを有し
てなるマイクロコンピュータにおいて、前記ＣＰＵは、
前記アクティブ幅の境界値を設定し、前記境界値を保持
し、該境界値と前記コンペア・レジスタに保持されてい
る設定値とを比較し、予め決められた条件が満たされた
場合に異常発生を示す信号を前記ＣＰＵに対して出力す
る境界値レジスタを有することを特徴とする。
に本発明は、出力パルスのアクティブ幅を制御するため
の該アクティブ幅の設定値を設定するとともにマイクロ
コンピュータ全体の制御を行うＣＰＵと、前記出力パル
スの基本クロックとなるクロック信号が入力され、該ク
ロック信号をカウントするタイマと、前記設定値を保持
し、該設定値と前記タイマにおいてカウントされたカウ
ント値とを比較して両者が一致したタイミングにおいて
一致信号を出力するコンペア・レジスタと、該コンペア
・レジスタから出力された一致信号が入力され、該一致
信号に基づいて割り込み信号及び出力タイミング信号を
生成し、出力するマスク回路と、該マスク回路から出力
される出力タイミング信号と前記タイマにおいてオーバ
ーフロー時に出力されるオーバーフロー信号とに基づい
て制御パルスを生成し、出力する出力制御回路とを有し
てなるマイクロコンピュータにおいて、前記ＣＰＵは、
前記アクティブ幅の境界値を設定し、前記境界値を保持
し、該境界値と前記コンペア・レジスタに保持されてい
る設定値とを比較し、予め決められた条件が満たされた
場合に異常発生を示す信号を前記ＣＰＵに対して出力す
る境界値レジスタを有することを特徴とする。
【００１８】また、前記ＣＰＵは、前記境界値レジスタ
から異常発生を示す信号が出力された場合に、前記マス
ク回路に対して前記出力タイミング信号の出力を禁止す
る旨の信号を出力することを特徴とする。
から異常発生を示す信号が出力された場合に、前記マス
ク回路に対して前記出力タイミング信号の出力を禁止す
る旨の信号を出力することを特徴とする。
【００１９】また、前記境界値レジスタは、前記条件が
満たされた場合に、前記マスク回路に対して前記出力タ
イミング信号の出力を禁止する旨の信号を出力すること
を特徴とする。
満たされた場合に、前記マスク回路に対して前記出力タ
イミング信号の出力を禁止する旨の信号を出力すること
を特徴とする。
【００２０】また、前記境界値は、前記アクティブ幅に
よって制御されるモータの回転速度がシステムにおいて
許容される許容最小値であることを特徴とする。
よって制御されるモータの回転速度がシステムにおいて
許容される許容最小値であることを特徴とする。
【００２１】また、前記条件は、前記設定値が前記境界
値よりも小さいことであることを特徴とする。
値よりも小さいことであることを特徴とする。
【００２２】また、前記条件は、前記設定値が前記境界
値よりも大きいことであることを特徴とする。
値よりも大きいことであることを特徴とする。
【００２３】（作用）上記のように構成された本発明に
おいては、境界値レジスタに、アクティブ幅によって制
御されるモータの回転速度がシステムにおいて許容され
る境界値が設定され、コンペア・レジスタに設定される
アクティブ幅の設定値が境界値と比較されて、予め決め
られた条件が満たされた場合に、異常と判断され、制御
パルスの出力が禁止される。
おいては、境界値レジスタに、アクティブ幅によって制
御されるモータの回転速度がシステムにおいて許容され
る境界値が設定され、コンペア・レジスタに設定される
アクティブ幅の設定値が境界値と比較されて、予め決め
られた条件が満たされた場合に、異常と判断され、制御
パルスの出力が禁止される。
【００２４】このように、コンペア・レジスタに設定さ
れるアクティブ幅の設定値がシステムにおいて異常とな
るような値となる場合に、制御パルスの出力が禁止され
るので、外部に接続されたモータや駆動回路が破壊され
ることはない。
れるアクティブ幅の設定値がシステムにおいて異常とな
るような値となる場合に、制御パルスの出力が禁止され
るので、外部に接続されたモータや駆動回路が破壊され
ることはない。
【００２５】
【発明の実施の形態】以下に、本発明の実施の形態につ
いて図面を参照して説明する。
いて図面を参照して説明する。
【００２６】図１は、本発明のマイクロコンピュータの
実施の一形態を示すブロック図である。
実施の一形態を示すブロック図である。
【００２７】本形態は図１に示すように、出力パルスの
アクティブ幅を制御するとともにマイクロコンピュータ
全体の制御を行うＣＰＵ１と、出力パルスの基本クロッ
クとなるクロック信号が入力され、該クロック信号をカ
ウントするタイマ２と、ＣＰＵ１において設定されたア
クティブ幅の設定値を保持し、該設定値とタイマ２にお
いてカウントされたカウント値とを比較して両者が一致
したタイミングにおいて一致信号を出力するコンペア・
レジスタ３と、コンペア・レジスタ３から出力された一
致信号が入力され、該一致信号に基づいて割り込み信号
及び出力タイミング信号を生成し、出力するマスク回路
４と、マスク回路４から出力される出力タイミング信号
とタイマ２においてオーバーフロー時に出力されるオー
バーフロー信号とに基づいて制御パルスを生成し、出力
する出力制御回路５と、ＣＰＵ１によって設定されたア
クティブ幅の境界値を保持し、その境界値とコンペア・
レジスタ３におけるアクティブ幅の設定値とを比較し、
アクティブ幅の設定値が境界値よりも小さな場合に異常
発生を示す異常割り込み信号をＣＰＵ１に対して出力す
る境界値レジスタ６とから構成されている。
アクティブ幅を制御するとともにマイクロコンピュータ
全体の制御を行うＣＰＵ１と、出力パルスの基本クロッ
クとなるクロック信号が入力され、該クロック信号をカ
ウントするタイマ２と、ＣＰＵ１において設定されたア
クティブ幅の設定値を保持し、該設定値とタイマ２にお
いてカウントされたカウント値とを比較して両者が一致
したタイミングにおいて一致信号を出力するコンペア・
レジスタ３と、コンペア・レジスタ３から出力された一
致信号が入力され、該一致信号に基づいて割り込み信号
及び出力タイミング信号を生成し、出力するマスク回路
４と、マスク回路４から出力される出力タイミング信号
とタイマ２においてオーバーフロー時に出力されるオー
バーフロー信号とに基づいて制御パルスを生成し、出力
する出力制御回路５と、ＣＰＵ１によって設定されたア
クティブ幅の境界値を保持し、その境界値とコンペア・
レジスタ３におけるアクティブ幅の設定値とを比較し、
アクティブ幅の設定値が境界値よりも小さな場合に異常
発生を示す異常割り込み信号をＣＰＵ１に対して出力す
る境界値レジスタ６とから構成されている。
【００２８】以下に、上記のように構成されたマイクロ
コンピュータの動作について説明する。
コンピュータの動作について説明する。
【００２９】図２は、図１に示したマイクロコンピュー
タから出力される制御パルスの一例を示す図である。
タから出力される制御パルスの一例を示す図である。
【００３０】タイマ２に、出力パルスの基本クロックと
なるクロック信号が入力されると、タイマ２において、
入力されたクロック信号がカウントされる。そして、タ
イマ２におけるオーバーフロー周期によって制御パルス
の周期ｂが決定する。なお、タイマ２におけるカウント
クロックやビット長が一定の場合は、周期ｂも一定とな
る。
なるクロック信号が入力されると、タイマ２において、
入力されたクロック信号がカウントされる。そして、タ
イマ２におけるオーバーフロー周期によって制御パルス
の周期ｂが決定する。なお、タイマ２におけるカウント
クロックやビット長が一定の場合は、周期ｂも一定とな
る。
【００３１】周期ｂが決定した状態において、ＣＰＵ１
にて、制御パルスのアクティブ幅ａの設定値が設定さ
れ、コンペア・レジスタ３に保持される。
にて、制御パルスのアクティブ幅ａの設定値が設定さ
れ、コンペア・レジスタ３に保持される。
【００３２】また、ＣＰＵ１において、制御パルスのア
クティブ幅の許容最小値となる境界値が設定され、境界
値レジスタ６に保持される。ここで、境界値レジスタ６
に保持される境界値においては、アクティブ幅によって
制御されるモータ（不図示）の回転速度がシステムにお
いて許容される許容値であり、これ以上、アクティブ幅
が狭くなるとモータの回転速度がシステムにおける許容
値を超えてしまい、システムが破壊する虞れがあるとい
うものである。
クティブ幅の許容最小値となる境界値が設定され、境界
値レジスタ６に保持される。ここで、境界値レジスタ６
に保持される境界値においては、アクティブ幅によって
制御されるモータ（不図示）の回転速度がシステムにお
いて許容される許容値であり、これ以上、アクティブ幅
が狭くなるとモータの回転速度がシステムにおける許容
値を超えてしまい、システムが破壊する虞れがあるとい
うものである。
【００３３】その後、境界値レジスタ６において、保持
されている境界値とコンペア・レジスタ３に設定された
設定値とが比較され、コンペア・レジスタ３に設定され
ている設定値が境界値よりも大きな場合は、コンペア・
レジスタ３において、保持されている設定値とタイマ２
におけるカウント値とが比較され、両者が一致したタイ
ミングにおいて一致信号が出力される。
されている境界値とコンペア・レジスタ３に設定された
設定値とが比較され、コンペア・レジスタ３に設定され
ている設定値が境界値よりも大きな場合は、コンペア・
レジスタ３において、保持されている設定値とタイマ２
におけるカウント値とが比較され、両者が一致したタイ
ミングにおいて一致信号が出力される。
【００３４】コンペア・レジスタ３から一致信号が出力
されると、マスク回路４において、一致信号に基づいて
割り込み信号及び出力タイミング信号が生成され、出力
される。
されると、マスク回路４において、一致信号に基づいて
割り込み信号及び出力タイミング信号が生成され、出力
される。
【００３５】その後、出力制御回路５において、マスク
回路４から出力された出力タイミング信号とタイマ２か
ら出力されたオーバーフロー信号とに基づいて、周期ｂ
及びアクティブ幅ａを有する制御パルスが生成され、出
力される。
回路４から出力された出力タイミング信号とタイマ２か
ら出力されたオーバーフロー信号とに基づいて、周期ｂ
及びアクティブ幅ａを有する制御パルスが生成され、出
力される。
【００３６】一方、ソフトウェアのバグ等によって、コ
ンペア・レジスタ３に設定されている設定値が境界値よ
りも小さくなってしまった場合は、境界値レジスタ６か
らＣＰＵ１に対して異常割り込み信号が出力され、その
後、ＣＰＵ１からマスク回路４に出力されるマスク信号
によって、制御パルスを生成するための出力タイミング
信号の出力が禁止される。
ンペア・レジスタ３に設定されている設定値が境界値よ
りも小さくなってしまった場合は、境界値レジスタ６か
らＣＰＵ１に対して異常割り込み信号が出力され、その
後、ＣＰＵ１からマスク回路４に出力されるマスク信号
によって、制御パルスを生成するための出力タイミング
信号の出力が禁止される。
【００３７】（他の実施の形態）図３は、本発明のマイ
クロコンピュータの実施の他の形態を示すブロック図で
ある。
クロコンピュータの実施の他の形態を示すブロック図で
ある。
【００３８】本形態は図３に示すように、図１に示した
ものに対して、境界値レジスタ６において、コンペア・
レジスタ３に設定されている設定値が境界値よりも小さ
いと判断された場合に、境界値レジスタ６からＣＰＵ１
に対して異常割り込み信号が出力されると同時に、マス
ク回路４に対して制御パルスを生成するための出力タイ
ミング信号の出力を禁止するためのマスク信号が出力さ
れるものである。
ものに対して、境界値レジスタ６において、コンペア・
レジスタ３に設定されている設定値が境界値よりも小さ
いと判断された場合に、境界値レジスタ６からＣＰＵ１
に対して異常割り込み信号が出力されると同時に、マス
ク回路４に対して制御パルスを生成するための出力タイ
ミング信号の出力を禁止するためのマスク信号が出力さ
れるものである。
【００３９】本形態においては、コンペア・レジスタ３
における異常検出や、制御パルスの出力禁止動作が全て
ハードウェアで処理されるため、確実に異常な制御パル
スの出力を防ぐことができる。
における異常検出や、制御パルスの出力禁止動作が全て
ハードウェアで処理されるため、確実に異常な制御パル
スの出力を防ぐことができる。
【００４０】なお、上述した実施の形態においては、制
御パルスのアクティブレベルがハイレベルに設定されて
いる場合ついて説明したが、アクティブレベルがロウレ
ベルに設定されている場合においても同様の制御が可能
である。
御パルスのアクティブレベルがハイレベルに設定されて
いる場合ついて説明したが、アクティブレベルがロウレ
ベルに設定されている場合においても同様の制御が可能
である。
【００４１】また、上述した実施の形態においては、コ
ンペア・レジスタ３に設定されている設定値が境界値よ
りも小さくなった場合に境界値レジスタ６からＣＰＵ１
に対して異常割り込み信号が出力されるが、コンペア・
レジスタ３に設定されている設定値が境界値よりも大き
くなった場合に異常割り込み信号が出力されるようにし
てもよい。
ンペア・レジスタ３に設定されている設定値が境界値よ
りも小さくなった場合に境界値レジスタ６からＣＰＵ１
に対して異常割り込み信号が出力されるが、コンペア・
レジスタ３に設定されている設定値が境界値よりも大き
くなった場合に異常割り込み信号が出力されるようにし
てもよい。
【００４２】
【発明の効果】以上説明したように本発明においては、
アクティブ幅によって制御されるモータの回転速度がシ
ステムにおいて許容される境界値が設定され、コンペア
・レジスタに設定されるアクティブ幅の設定値を境界値
と比較し、予め決められた条件が満たされた場合に、異
常と判断し、異常発生の信号を出力する境界値レジスタ
を設けたため、コンペア・レジスタに設定されるアクテ
ィブ幅の設定値がシステムにおいて異常となるような値
となる場合に、制御パルスの出力を禁止することがで
き、それにより、外部に接続されたモータや駆動回路の
破壊を防ぐことができる。
アクティブ幅によって制御されるモータの回転速度がシ
ステムにおいて許容される境界値が設定され、コンペア
・レジスタに設定されるアクティブ幅の設定値を境界値
と比較し、予め決められた条件が満たされた場合に、異
常と判断し、異常発生の信号を出力する境界値レジスタ
を設けたため、コンペア・レジスタに設定されるアクテ
ィブ幅の設定値がシステムにおいて異常となるような値
となる場合に、制御パルスの出力を禁止することがで
き、それにより、外部に接続されたモータや駆動回路の
破壊を防ぐことができる。
【００４３】また、異常発生時に、境界値レジスタから
ＣＰＵに対して異常発生を示す信号が、また、マスク回
路に対して出力タイミング信号の出力禁止の信号がそれ
ぞれ出力されるため、異常発生時に、自ら制御パルスの
出力を停止させることができ、異常発生時における出力
停止を迅速に行うことができる。
ＣＰＵに対して異常発生を示す信号が、また、マスク回
路に対して出力タイミング信号の出力禁止の信号がそれ
ぞれ出力されるため、異常発生時に、自ら制御パルスの
出力を停止させることができ、異常発生時における出力
停止を迅速に行うことができる。
【図１】本発明のマイクロコンピュータの実施の一形態
を示すブロック図である。
を示すブロック図である。
【図２】図１に示したマイクロコンピュータから出力さ
れる制御パルスの一例を示す図である。
れる制御パルスの一例を示す図である。
【図３】本発明のマイクロコンピュータの実施の他の形
態を示すブロック図である。
態を示すブロック図である。
【図４】従来の、モータ制御等を目的とするパルス出力
機能を備えたマイクロコンピュータの一構成例を示すブ
ロック図である。
機能を備えたマイクロコンピュータの一構成例を示すブ
ロック図である。
【図５】図４に示したマイクロコンピュータから出力さ
れる制御パルスの一例を示す図である。
れる制御パルスの一例を示す図である。
１ ＣＰＵ ２ タイマ ３ コンペア・レジスタ ４ マスク回路 ５ 出力制御回路 ６ 境界値レジスタ
Claims (6)
- 【請求項１】 出力パルスのアクティブ幅を制御するた
めの該アクティブ幅の設定値を設定するとともにマイク
ロコンピュータ全体の制御を行うＣＰＵと、 前記出力パルスの基本クロックとなるクロック信号が入
力され、該クロック信号をカウントするタイマと、 前記設定値を保持し、該設定値と前記タイマにおいてカ
ウントされたカウント値とを比較して両者が一致したタ
イミングにおいて一致信号を出力するコンペア・レジス
タと、 該コンペア・レジスタから出力された一致信号が入力さ
れ、該一致信号に基づいて割り込み信号及び出力タイミ
ング信号を生成し、出力するマスク回路と、 該マスク回路から出力される出力タイミング信号と前記
タイマにおいてオーバーフロー時に出力されるオーバー
フロー信号とに基づいて制御パルスを生成し、出力する
出力制御回路とを有してなるマイクロコンピュータにお
いて、 前記ＣＰＵは、前記アクティブ幅の境界値を設定し、 前記境界値を保持し、該境界値と前記コンペア・レジス
タに保持されている設定値とを比較し、予め決められた
条件が満たされた場合に異常発生を示す信号を前記ＣＰ
Ｕに対して出力する境界値レジスタを有することを特徴
とするマイクロコンピュータ。 - 【請求項２】 請求項１に記載のマイクロコンピュータ
において、 前記ＣＰＵは、前記境界値レジスタから異常発生を示す
信号が出力された場合に、前記マスク回路に対して前記
出力タイミング信号の出力を禁止する旨の信号を出力す
ることを特徴とするマイクロコンピュータ。 - 【請求項３】 請求項１または請求項２に記載のマイク
ロコンピュータにおいて、 前記境界値レジスタは、前記条件が満たされた場合に、
前記マスク回路に対して前記出力タイミング信号の出力
を禁止する旨の信号を出力することを特徴とするマイク
ロコンピュータ。 - 【請求項４】 請求項１乃至３のいずれか１項に記載の
マイクロコンピュータにおいて、 前記境界値は、前記アクティブ幅によって制御されるモ
ータの回転速度がシステムにおいて許容される許容最小
値であることを特徴とするマイクロコンピュータ。 - 【請求項５】 請求項１乃至４のいずれか１項に記載の
マイクロコンピュータにおいて、 前記条件は、前記設定値が前記境界値よりも小さいこと
であることを特徴とするマイクロコンピュータ。 - 【請求項６】 請求項１乃至４のいずれか１項に記載の
マイクロコンピュータにおいて、 前記条件は、前記設定値が前記境界値よりも大きいこと
であることを特徴とするマイクロコンピュータ。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8253135A JP2914317B2 (ja) | 1996-09-25 | 1996-09-25 | マイクロコンピュータ |
| US08/936,809 US5928366A (en) | 1996-09-25 | 1997-09-24 | Microcomputer based system for the fail-safe control of an electric motor or the like |
| KR1019970048887A KR100294523B1 (ko) | 1996-09-25 | 1997-09-25 | 마이크로컴퓨터 |
| DE19742423A DE19742423A1 (de) | 1996-09-25 | 1997-09-25 | Microcomputer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8253135A JP2914317B2 (ja) | 1996-09-25 | 1996-09-25 | マイクロコンピュータ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10105207A JPH10105207A (ja) | 1998-04-24 |
| JP2914317B2 true JP2914317B2 (ja) | 1999-06-28 |
Family
ID=17247004
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8253135A Expired - Fee Related JP2914317B2 (ja) | 1996-09-25 | 1996-09-25 | マイクロコンピュータ |
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|---|---|
| US (1) | US5928366A (ja) |
| JP (1) | JP2914317B2 (ja) |
| KR (1) | KR100294523B1 (ja) |
| DE (1) | DE19742423A1 (ja) |
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| JPH0221302A (ja) * | 1988-07-11 | 1990-01-24 | Oki Electric Ind Co Ltd | パルス幅変調信号出力方法 |
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1996
- 1996-09-25 JP JP8253135A patent/JP2914317B2/ja not_active Expired - Fee Related
-
1997
- 1997-09-24 US US08/936,809 patent/US5928366A/en not_active Expired - Fee Related
- 1997-09-25 KR KR1019970048887A patent/KR100294523B1/ko not_active IP Right Cessation
- 1997-09-25 DE DE19742423A patent/DE19742423A1/de not_active Ceased
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| Publication number | Publication date |
|---|---|
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| US5928366A (en) | 1999-07-27 |
| KR100294523B1 (ko) | 2001-07-12 |
| DE19742423A1 (de) | 1998-05-14 |
| JPH10105207A (ja) | 1998-04-24 |
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