JP2013038401A5 - - Google Patents
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- 絶縁表面上に形成されたソース電極層又はドレイン電極層と、
前記ソース電極層又は前記ドレイン電極層上に設けられ、第1の酸化物半導体層及び前記第1の酸化物半導体層と異なるエネルギーギャップを有する第2の酸化物半導体層を含む酸化物半導体積層と、
前記酸化物半導体積層上に設けられたゲート絶縁膜と、
前記ゲート絶縁膜を介して前記酸化物半導体積層と重畳するゲート電極層と、を有する半導体装置。 - 絶縁表面上に形成されたソース電極層又はドレイン電極層と、
前記ソース電極層又は前記ドレイン電極層上に設けられ、第1の酸化物半導体層と、前記第1の酸化物半導体層に接し、前記第1の酸化物半導体層よりも小さいエネルギーギャップを有する第2の酸化物半導体層と、前記第2の酸化物半導体層に接し、前記第2の酸化物半導体層より大きいエネルギーギャップを有する第3の酸化物半導体層と、を含む酸化物半導体積層と、
前記酸化物半導体積層上に設けられたゲート絶縁膜と、
前記ゲート絶縁膜を介して前記酸化物半導体積層と重畳するゲート電極層と、を有する半導体装置。 - 絶縁表面上に設けられ、第1の酸化物半導体層及び前記第1の酸化物半導体層と異なるエネルギーギャップを有する第2の酸化物半導体層を含む酸化物半導体積層と、
前記酸化物半導体積層上に設けられたゲート絶縁膜と、
前記ゲート絶縁膜を介して前記酸化物半導体積層と重畳するゲート電極層と、を有する半導体装置。 - 絶縁表面上に設けられ、第1の酸化物半導体層と、前記第1の酸化物半導体層に接し、前記第1の酸化物半導体層よりも小さいエネルギーギャップを有する第2の酸化物半導体層と、前記第2の酸化物半導体層に接し、前記第2の酸化物半導体層より大きいエネルギーギャップを有する第3の酸化物半導体層と、を含む酸化物半導体積層と、
前記酸化物半導体積層上に設けられたゲート絶縁膜と、
前記ゲート絶縁膜を介して前記酸化物半導体積層と重畳するゲート電極層と、を有する半導体装置。 - 請求項2又は4において、前記第3の酸化物半導体層は、前記第1の酸化物半導体層の側面及び前記第2の酸化物半導体層の側面を覆って、前記第2の酸化物半導体層上に設けられている半導体装置。
- 請求項1乃至5のいずれか一において、
前記酸化物半導体積層において、前記ゲート電極層と重畳しない領域は、ドーパントを含む半導体装置。 - 酸化物絶縁膜上に、ソース電極層及びドレイン電極層を形成し、
前記ソース電極層及び前記ドレイン電極層上に、第1の酸化物半導体層と、前記第1の酸化物半導体層と異なるエネルギーギャップを有する第2の酸化物半導体層と、を含む酸化物半導体積層を形成し、
前記ソース電極層、前記ドレイン電極層及び前記酸化物半導体積層上にゲート絶縁膜を形成し、
前記ゲート絶縁膜を介して、前記酸化物半導体積層と重畳するゲート電極層を形成する半導体装置の作製方法。 - 酸化物絶縁膜上に、ソース電極層及びドレイン電極層を形成し、
前記ソース電極層及び前記ドレイン電極層上に、第1の酸化物半導体層と、前記第1の酸化物半導体層より小さいエネルギーギャップを有する第2の酸化物半導体層と、前記第2の酸化物半導体層より大きいエネルギーギャップを有する第3の酸化物半導体層と、を含む酸化物半導体積層を形成し、
前記ソース電極層、前記ドレイン電極層及び前記酸化物半導体積層上にゲート絶縁膜を形成し、
前記ゲート絶縁膜を介して、前記酸化物半導体積層と重畳するゲート電極層を形成する半導体装置の作製方法。 - 請求項8において、前記第1の酸化物半導体層の側面及び前記第2の酸化物半導体層の側面を覆うように前記第3の酸化物半導体層を積層させる半導体装置の作製方法。
- 請求項7乃至請求項9のいずれか一において、
前記ゲート絶縁膜を成膜した後に、前記ゲート絶縁膜上から前記酸化物半導体積層に酸素を導入する半導体装置の作製方法。 - 請求項7乃至請求項10のいずれか一において、
前記ゲート電極層を形成した後、前記ゲート電極層をマスクとして、前記酸化物半導体積層にドーパントを導入する半導体装置の作製方法。
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