JP2003208135A - 液晶表示装置のデータ駆動装置及び方法 - Google Patents

液晶表示装置のデータ駆動装置及び方法

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JP2003208135A JP2002178008A JP2002178008A JP2003208135A JP 2003208135 A JP2003208135 A JP 2003208135A JP 2002178008 A JP2002178008 A JP 2002178008A JP 2002178008 A JP2002178008 A JP 2002178008A JP 2003208135 A JP2003208135 A JP 2003208135A
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Seok Woo Lee
ソク ウー リー，
Jin Kyong Song
ジン キョン ソン，
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LG Philips LCD Co Ltd
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Abstract

(57)【要約】 【目的】本発明はＤＡＣ部を時分割駆動して既存のチッ
プ面積と比較して大きくチップ面積を増加させないか、
むしろチップ面積を減少させながらデータ駆動ＩＣの出
力チャネル数を増加させることでデータ駆動ＩＣ及びＴ
ＣＰの数を減らすことができる液晶表示装置のデータ駆
動装置及び方法を提供する。 【解決手段】本発明は、入力された画素データを時分割
して供給するためのマルチプレクサ部と；マルチプレク
サ部からの画素データを画素電圧信号に変換するための
デジタル・アナログ変換部と；デジタルーアナログ変換
部からの画素電圧信号を複数の出力ラインに選択的に供
給するためのディマルチプレクサ部と；ディマルチプレ
クサ部からの画素電圧信号をサンプリング及びホールデ
ィングして複数のデータラインに出力するためのサンプ
リング及びホールディング部とを具備することを特徴と
する。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は液晶表示装置に関す
るもので、特にデジタル・アナログ変換部を時分割駆動
してデータ駆動集積回路とテープ・キャリア・パッケー
ジの数を減らすことができる液晶表示装置のデータ駆動
装置及び方法に関するものである。
【０００２】
【従来の技術】通常の液晶表示装置は電界を利用して液
晶の光透過率を調節することで画像を表示する。このた
めに、液晶表示装置は液晶セルがマトリックス状に配列
された液晶パネルと、この液晶パネルを駆動するための
駆動回路とを具備する。液晶パネルにはそれぞれ複数の
ゲートラインとデータラインが交差して配列されて、そ
の交差部に設けられる領域に液晶セルが配設される。こ
の液晶パネルには液晶セルのそれぞれに電界を印加する
ための複数の画素電極と共通電極が設けられる。画素電
極のそれぞれはスイッチング素子である薄膜トランジス
タのソース及びドレーン端子を経由してデータラインの
いずれか１つに接続される。薄膜トランジスタのゲート
端子は、画素電圧信号を１ライン分ずつの画素電極に印
加するゲートラインの中のいずれか１つに接続される。
駆動回路はゲートラインを駆動するためのゲートドライ
バと、データラインを駆動するためのデータドライバ
と、共通電極を駆動するための共通電圧発生部とを具備
する。ゲートドライバはスキャニング信号をゲートライ
ンに順次供給し、液晶パネルの上の液晶セルを１ライン
分ずつ順次駆動する。データドライバはゲートラインの
いずれか１つにゲート信号が供給される毎にデータライ
ンのそれぞれに画素電圧信号を供給する。共通電圧発生
部は共通電極に共通電圧信号を供給する。これにより、
液晶表示装置は、液晶セル別に画素電圧信号が画素電極
と共通電極の間に印加した電界により、光透過率を調節
することで画像を表示する。データドライバとゲートド
ライバは多数個の集積回路（以下、ＩＣという）に集積
化される。集積化されたデータドライバＩＣとゲートド
ライバＩＣのそれぞれはテープ・キャリア・パッケージ
（以下、ＴＣＰという）に実装されて、タブ（ＴＡＢ：
Tape Automated Bonding）方式で液晶パネルに接続され
るか、ＣＧＯ（Chip On Glass）方式で液晶パネル上に
実装される。
【０００３】図１は従来の液晶表示パネル装置を概念的
に図示しており、データＴＣＰ（６）を通して液晶パネ
ル（２）に接続された複数のデータ駆動ＩＣ（４）と、
ＴＣＰ（６）を通してデータ駆動ＩＣ（４）に接続され
たデータ印刷回路基板（以下、ＰＣＢという）（８）と
を具備する。
【０００４】データＰＣＢ（８）は、タイミング制御部
（図示しない）から供給される各種の制御信号及びデー
タ信号とパワー部（図示しない）からの駆動電圧信号を
入力してデータ駆動ＩＣ（４）に中継する役割を有す
る。ＴＣＰ（６）は液晶パネル（２）の上段部に設けら
れたデータパッドに電気的に接続されると共に、データ
ＰＣＢ（８）に設けられた出力パッドに電気的に接続さ
れる。データ駆動ＩＣ（４）はデジタル信号である画素
データ信号を、アナログ信号である画素電圧信号に変換
して液晶パネル（２）上のデータラインに供給する。
【０００５】このために、データ駆動ＩＣ（４）のそれ
ぞれは、図２に図示されるように、サンプリング信号が
順次供給されるシフトレジスタ部（１４）と、サンプリ
ング信号に応じて画素データ（ＶＤ）を順次ラッチし、
同時に出力するラッチ部（１６）と、ラッチ部（１６）
からの画素データ（ＶＤ）を画素電圧信号に変換するデ
ジタル・アナログ変換部（以下、ＤＡＣ部という）（１
８）と、ＤＡＣ（１８）からの画素電圧信号を緩衝して
出力する出力バッファ部（２６）とを具備する。また、
データ駆動ＩＣ（４）は、タイミング制御部（図示しな
い）から供給される各種の制御信号と画素データ（Ｖ
Ｄ）を中継する信号制御部（１０）と、ＤＡＣ部（１
８）で必要とする正極性及び負極性ガンマ電圧を供給す
るガンマ電圧部（１２）とを更に具備する。このような
構成を有するデータ駆動ＩＣ（４）のそれぞれは、ｎ個
ずつのデータライン（ＤＬ１乃至ＤＬｎ）を駆動する。
【０００６】信号制御部（１０）は、タイミング制御部
（図示しない）からの各種の制御信号（ＳＳＣ、ＳＳ
Ｐ、ＳＯＥ、ＰＯＬなど）と画素データ（ＶＤ）が各構
成要素に出力されるように制御する。
【０００７】ガンマ電圧部（１２）は、ガンマ基準電圧
発生部（図示しない）から入力される複数のガンマ基準
電圧をグレイ別に細分化して出力する。
【０００８】シフトレジスタ部（１４）に含まれるｎ／
６個のシフトレジスタは、信号制御部（１０）からのソ
ース・スタート・パルス（ＳＳＰ）をソース・サンプリ
ング・クロック信号（ＳＳＣ）により順次シフトさせ、
サンプリング信号として出力する。
【０００９】ラッチ部（１６）は、シフトレジスタ部
（１４）からのサンプリング信号に応じて信号制御部
（１０）からの画素データ（ＶＤ）を一定の単位ずつ順
次サンプリングしてラッチする。このために、ラッチ部
はｎ個の画素データ（ＶＤ）をラッチするためのｎ個の
ラッチで構成されており、該ラッチのそれぞれは画素デ
ータ（ＶＤ）のビット数（３ビットまたは６ビット）に
対応する大きさを有する。特にタイミング制御部（図示
しない）は、伝送周波数を減らすため、画素データ（Ｖ
Ｄ）を偶数画素データと奇数画素データに分けて伝送ラ
インを通して同時に出力する。ここで、偶数画素データ
と奇数画素データのそれぞれは、赤（Ｒ）、緑（Ｇ）、
青（Ｂ）の画素データを含む。これによりラッチ部（１
６）は、サンプリング信号毎に信号制御部（１０）を経
由して供給される偶数画素データと奇数画素データ、即
ち６個の画素データを同時にラッチする。続いて、ラッ
チ部（１６）は信号制御部（１０）からのソース出力イ
ネーブル信号（ＳＯＥ）に応じてラッチされたｎ個の画
素データ（ＶＤ）を同時に出力する。この場合、ラッチ
部（１６）はデータ反転選択信号（ＲＥＶ）に応じてト
ランジション・ビット数を減らすように修正された画素
データ（ＶＤ）を復元させ出力する。これは、タイミン
グ制御部におけるデータ伝送の際の電気的な干渉（ＥＭ
Ｉ）を最小化するために、トランジションされるビット
数が基準値を超えないようトランジション・ビット数を
減らすように画素データ（ＶＤ）を修正して供給するた
めである。
【００１０】ＤＡＣ部（１８）はラッチ部（１６）から
の画素データ（ＶＤ）を同時に正極性及び負極性の画素
電圧信号に変換して出力する。このために、ＤＡＣ部
（１８）はラッチ部（１６）に共通接続されたＰ（Posi
tive）デコーディング部（２０）及びＮ（Negative）デ
コーディング部（２２）と、Ｐデコーディング部（２
０）及びＮデコーディング部（２２）の出力信号を選択
するためのマルチプレクサ（ＭＵＸ；２４）とを具備す
る。
【００１１】Ｐデコーディング部（２０）に含まれるｎ
個のＰデコーダは、ラッチ部（１６）から同時に入力さ
れるｎ個の画素データを、ガンマ電圧部（１２）からの
正極性のガンマ電圧を利用して、正極性の画素電圧信号
に変換する。Ｎデコーディング部（２２）に含まれるｎ
個のＮデコーダは、ラッチ部（１６）から同時に入力さ
れるｎ個の画素データを、ガンマ電圧部（１２）からの
負極性のガンマ電圧を利用して、負極性の画素電圧信号
に変換する。マルチプレクサ（２４）は信号制御部（１
０）からの極性の制御信号（ＰＯＬ）に応じてＰデコー
ダ（２０）からの正極性の画素電圧信号またはＮデコー
ダ（２２）からの負極性の画素電圧信号を選択して出力
する。
【００１２】出力バッファ部（２６）に含まれるｎ個の
出力バッファは、ｎ個のデータライン（ＤＬ１乃至ＤＬ
ｎ）にそれぞれ直列に接続されて電圧追従機を構成す
る。このような出力バッファはＤＡＣ部（１８）からの
画素電圧信号を信号緩衝し、データライン（ＤＬ１乃至
ＤＬｎ）に供給する。
【００１３】図３は、図２に図示されたデータ駆動ＩＣ
（４）内の一部の画素データの伝送経路を具体的に図示
している。
【００１４】図３でラッチ部（１６）のラッチ（１７）
は９個の画素データをＤＡＣ部（１８）を構成する９個
のＤＡＣ（デジタル・アナログ変換器）（１９）のそれ
ぞれに出力して画素電圧信号に変換する。画素電圧信号
は出力バッファ部（２６）のバッファ（２７）を通して
第１乃至第９データライン（ＤＬ１乃至ＤＬ９）のそれ
ぞれに供給される。
【００１５】このように、従来のデータ駆動ＩＣのそれ
ぞれは、ｎ個のデータライン（ＤＬ１乃至ＤＬｎ）を駆
動するためにＰデコーダ及びＮデコーダとマルチプレク
サのそれぞれを含むｎ個のＤＡＣとを具備しなければな
らない。このために、データ駆動ＩＣの構成が複雑にな
り、製造単価が相対的に高くなる。したがって、液晶表
示装置の製造費用を節減するためにデータ駆動ＩＣの数
を減らすことが要求される。
【００１６】データ駆動ＩＣの数を減らす方法にデータ
駆動ＩＣが駆動することができるデータラインの数、即
ち出力チャネル数を増加させる方法が検討されている。
しかし、データ駆動ＩＣの駆動チャネル数を増加させる
場合、複雑な構成のＤＡＣ数が増加するので、チップ面
積が増大することにより面積に比例してＴＣＰの費用が
上昇するだけでなく、集積化が難しく、製造費用及び不
良率の上昇などの問題点を生じる。
【００１７】
【発明が解決しようとする課題】従って、本発明の目的
は、ＤＡＣ部を時分割駆動し、既存のチップ面積と比較
して大きくチップ面積を増加させないか、むしろチップ
面積を減少させながらデータ駆動ＩＣの出力チャネル数
を増加させることで、データ駆動ＩＣ及びＴＣＰの数を
減らすことができる液晶表示装置のデータ駆動装置及び
方法を提供することである。
【００１８】
【課題を解決するための手段】前記目的を達成するため
に、本発明による液晶表示装置のデータ駆動装置は、入
力された画素データを時分割して供給するためのマルチ
プレクサ部と、マルチプレクサ部からの画素データを画
素電圧信号に変換するためのデジタル・アナログ変換部
と、デジタル・アナログ変換部からの画素電圧信号を多
数の出力ラインに選択的に供給するためのディマルチプ
レクサ部と、ディマルチプレクサ部からの画素電圧信号
をサンプリング及びホールディングして複数のデータラ
インに出力するためのサンプリング及びホールディング
とを具備することを特徴とする。
【００１９】ここで、第１マルチプレクサ・アレイは、
少なくとも２ｎ／３個のマルチプレクサを具備し、少な
くとも２ｎ個の画素データを少なくとも２ｎ／３個ずつ
時分割して供給し、デジタル・アナログ変換のアレイ
は、少なくとも２ｎ／３個のデジタル・アナログ変換器
と、少なくとも２ｎ／３個の画素データを画素電圧信号
に変換するための前記少なくとも２ｎ／３個のデジタル
・アナログ変換器を具備し、ディマルチプレクサ・アレ
イは少なくとも２ｎ／３個のディマルチプレクサを具備
して少なくとも２ｎ／３個ずつの画素電圧信号を少なく
とも２ｎ個以上の出力ラインに選択的に供給することを
特徴とする。
【００２０】また、本発明の液晶表示装置のデータ駆動
装置は、サンプリング信号を順次発生するためのシフト
・レジスタ部と、サンプリング信号に応じて少なくとも
２ｎ個以上の画素データを所定の単位ずつ順次ラッチし
てマルチプレクサ部に同時に出力するためのラッチ部
と、サンプリング及びホールディング部からの画素電圧
信号をバッファして複数のデータラインに出力するため
のバッファ部とを更に具備することを特徴とする。
【００２１】また、デジタル・アナログ変換器のそれぞ
れは、画素データを正極性の画素電圧信号に変換するた
めの正極性部と、負極性の画素電圧信号に変換するため
の負極性部と、正極性部及び負極性部の出力を選択する
マルチプレクサとを具備することを特徴とする。
【００２２】特に、マルチプレクサのそれぞれは、第１
乃至第３スイッチング制御素子のそれぞれに応じて少な
くとも３個の画素データを１つのデジタル・アナログ変
換器に時分割して供給するための第１乃至第３スイッチ
ング素子を具備し、ディマルチプレクサのそれぞれは、
前記第１乃至第３スイッチング制御信号のそれぞれに応
じてデジタル・アナログ変換器からの画素電圧信号を、
少なくとも３個の出力ラインに選択的に供給するための
第４乃至第６スイッチング素子を具備することを特徴と
する。
【００２３】サンプリング及びホールディング部はディ
マルチプレクサ部の少なくとも２ｎ個の出力ラインのそ
れぞれに接続される少なくとも２ｎ個のサンプリング及
びホルダとを具備し、サンプリング及びホルダのそれぞ
れは前記ディマルチプレクサ部の出力ラインのそれぞれ
に並列に接続される第１及び第２サンプリング・スイッ
チング素子と、サンプリング・スイッチング素子を経由
した画素電圧信号を充電するための第１及び第２キャパ
シタと、第１及び第２キャパシタに充電された画素電圧
信号がホールディングされるようにした後、データライ
ンに放電されるようにする第１及び第２ホールディング
・スイッチング素子とを具備することを特徴とする。
【００２４】ここで、第１キャパシタに充電される画素
電圧信号をサンプリングする第１サンプリング・スイッ
チング素子と、第２キャパシタに充電された画素電圧信
号をホールディング及び放電させる第２ホールディング
・スイッチング素子は、同一の第１スイッチング制御信
号に応じて駆動され、第２キャパシタに充電される画素
電圧信号をサンプリングする第２サンプリング・スイッ
チング素子と、第１キャパシタに充電された画素電圧信
号をホールディング及び放電させる第１ホールディング
・スイッチング素子は、第１スイッチング制御信号と論
理状態を反転する同一の第２スイッチング制御信号に応
じて駆動されることを特徴とする。
【００２５】本発明による液晶表示装置のデータ駆動方
法は、マルチプレクサ部で入力された画素データを時分
割して供給する段階と、デジタル・アナログ変換部でマ
ルチプレクサ部からの画素データを画素電圧信号に変換
する段階と、ディマルチプレクサ部でデジタル・アナロ
グ変換部からの画素電圧信号を多数の出力ラインに選択
的に供給する段階と、サンプリング及びホールディング
部でディマルチプレクサ部からの画素電圧信号をサンプ
リング及びホールディングして複数のデータラインに出
力する段階を含むことを特徴とする。
【００２６】また、本発明の液晶表示装置のデータ駆動
方法は、シフトレジスタ部でサンプリング信号を順次発
生する段階と、ラッチ部でサンプリング信号に応じて少
なくとも２ｎ個の画素データを所定の単位ずつ順次ラッ
チし、マルチプレクサ部に同時に供給する段階と、サン
プリング及びホールディング部で出力される画素電圧信
号をバッファして少なくとも２ｎ個のデータラインに供
給する段階を更に含むことを特徴とする。
【００２７】そして、マルチプレクサ部で画素データを
時分割する段階は、第１乃至第３スイッチング制御信号
に応じて少なくとも２ｎ個の画素データを少なくとも３
区間に時分割して供給する段階であり、ディマルチプレ
クサ部で画素電圧信号を複数の出力ラインに選択的に供
給する段階は、第１乃至第３スイッチング制御信号に応
じて画素電圧信号のそれぞれを少なくとも３個の出力ラ
インに選択的に供給する段階であることを特徴とする。
【００２８】また、サンプリング及びホールディング部
に含まれるサンプリング及びホルダのそれぞれが、第１
及び第２サンプリング・スイッチング素子と、第１及び
第２キャパシタと、第１及び第２ホールディング・スイ
ッチング素子とを具備し、サンプリング及びホールディ
ング部で画素電圧信号をサンプリング及びホールディン
グされるようにする段階は、任意の水平期間で第１サン
プリング・スイッチング素子がマルチプレクサ部からの
画素電圧信号をサンプリングし、第１キャパシタに充電
されるようにすると共に、同時に第２ホールディング・
スイッチング素子が前記第２キャパシタに充電される前
の水平期間の画素電圧信号を対応するデータラインに放
電されるようにする段階と、次の水平期間で第２サンプ
リング・スイッチング素子が前記ディマルチプレクサ部
からの画素電圧信号をサンプリングし、第２キャパシタ
に充電されるようにすると共に、同時に第１ホールディ
ング・スイッチング素子が前記第１キャパシタに充電さ
れる前の水平期間の画素電圧信号を対応するデータライ
ンに放電されるようにする段階を含むことを特徴とす
る。
【００２９】
【作用】本発明による液晶表示装置のデータ駆動装置及
び方法は、ＤＡＣ部を時分割駆動することで、既存のチ
ップ面積に比較して大きくチップ面積を増加させない
か、むしろチップ面積を減少させながらデータ駆動ＩＣ
の出力のチャネル数を従来対比２倍に増加させることが
できる。これにより、本発明による液晶表示装置のデー
タ駆動装置及び方法によると、データ駆動ＩＣのチャネ
ル数を増加させ、データ駆動ＩＣ及びＴＣＰの数を従来
比１／２に減らすことができるので、液晶表示装置の製
造費用を低くすることができる。
【００３０】
【発明の実施態様】以下、図４乃至図８を参照して本発
明の好ましい実施例に対して説明する。
【００３１】図４は本発明の実施例によるＬＣＤのデー
タ駆動装置を図示したブロック図である。
【００３２】図４に図示されたＬＣＤのデータ駆動装置
は、順次サンプリング信号を供給するシフト・レジスタ
部（３４）と、サンプリング信号に応答して画素データ
（ＶＤ）を順次ラッチして同時に出力するラッチ部（３
６）と、ラッチ部（３６）からの画素データ（ＶＤ）を
時分割して供給するマルチプレクサ部（３８）と、マル
チプレクサ部（３８）からの画素データ信号（ＶＤ）を
画素電圧信号に変換するＤＡＣ部（４０）と、出力ライ
ンを時分割駆動してＤＡＣ（４０）からの画素電圧信号
を供給するディマルチプレクサ部（４２）と、ディマル
チプレクサ部（４２）から入力される画素電圧信号をサ
ンプリング及びホールディングしてデータライン（ＤＬ
１乃至ＤＬ２ｎ）に同時に供給するサンプリング及びホ
ールディング部（４４）とを具備する。また、データ駆
動装置はタイミング制御部（図示しない）から供給され
る制御信号と画素データ（ＶＤ）を中継する信号制御部
（３０）と、ＤＡＣ部（４０）で必要とする正極性及び
負極性のガンマ電圧を供給するガンマ電圧部（３２）と
を更に具備する。このような構成を有するデータ駆動装
置は、１つのデータ駆動ＩＣに集積化されて従来のデー
タ駆動ＩＣと比較して２倍に増加された２ｎ個のデータ
ライン（ＤＬ１乃至ＤＬ２ｎ）を駆動する。
【００３３】信号制御部（３０）は、タイミング制御部
（図示しない）からの各種の制御信号（ＳＳＣ、ＳＳ
Ｐ、ＳＯＥ、ＰＯＬなど）と、画素データ（ＶＤ）が対
応する構成要素などに出力されるように制御する。
【００３４】ガンマ電圧部（３２）は、ガンマ基準電圧
発生部（図示しない）から入力される複数個のガンマ基
準電圧をグレイ別に細分化して出力する。
【００３５】シフトレジスタ部（３４）に含まれるシフ
トレジスタは、信号制御部（３０）からのソース・スタ
ート・パルス（ＳＳＰ）をソース・サンプリング・クロ
ック信号（ＳＳＣ）により順次シフトさせ、サンプリン
グ信号に出力する。
【００３６】ラッチ部（３６）は、シフトレジスタ部
（３４）からのサンプリング信号に応じて信号制御部
（３０）からの画素データ（ＶＤ）を一定の単位ずつ順
次サンプリングしてラッチする。このためにラッチ部
（３６）は、図５に図示したように、２ｎ個の画素デー
タ（ＶＤ）をラッチするために２ｎ個のラッチ（４６）
に構成され、該ラッチ（４６）のそれぞれは画素データ
（ＶＤ）のビット数（３ビットまたは６ビット）に対応
する大きさを有する。このようなラッチ部（３６）はサ
ンプリング信号毎に信号制御部（３０）を経由して供給
される偶数画素データと奇数画素データ、即ち６個の画
素データを同時にラッチする。続いてラッチ部（３６）
は、信号制御部（３０）からのソース出力イネーブル信
号（ＳＯＥ）に応じてラッチされた２ｎ個の画素データ
（ＶＤ）を同時に出力する。この場合、ラッチ部（３
６）はデータ反転選択信号（ＲＥＶ）に応じてトランジ
ション・ビット数が減少するように修正された画素デー
タ（ＶＤ）を復元させ出力する。
【００３７】マルチプレクサ部（３６）はラッチ部（３
６）から入力される２ｎ個の画素データを時分割して出
力する。この２ｎ個の画素データを３区間に時分割する
場合、マルチプレクサ部（３６）は図５に図示したよう
に３個ずつのラッチ（４６）に接続された２ｎ／３個の
マルチプレクサ（４６）を具備する。マルチプレクサ
（４６）のそれぞれは、３個ずつのラッチ（４６）から
入力された画素データを時分割し、１つの出力ラインに
順次供給する。さらに詳細には、マルチプレクサ部（３
６）はラッチ部（３６）から入力される２ｎ個の画素デ
ータを２ｎ／３個ずつ時分割してＤＡＣ部（４０）に出
力する。
【００３８】ＤＡＣ部（４０）はマルチプレクサ部（３
８）から入力される画素データを正極性及び負極性の画
素電圧信号に変換し、極性制御信号（ＰＯＬ）に応じて
正極性及び負極性の画素電圧信号を選択的に出力する。
このために、ＤＡＣ部（４０）は、図５に図示したよう
に、マルチプレクサ（４８）のような２ｎ／３個のＤＡ
Ｃ（５０）を具備する。ＤＡＣ（５０）のそれぞれは、
マルチプレクサ（４８）に共通接続されたＰデコーダ及
びＮデコーダと、Ｐデコーダ及びＮデコーダの出力信号
を選択するためのマルチプレクサとを具備する。Ｐデコ
ーダは画素データをガンマ電圧部（３４）からの正極性
のガンマ電圧を利用して正極性の画素電圧信号に変換す
る。Ｎデコーダは画素データをガンマ電圧部（３４）か
らの負極性のガンマ電圧を利用して負極性の画素電圧信
号に変換する。マルチプレクサは信号制御部（３２）か
らの極性制御信号（ＰＯＬ）に応じて正極性の画素電圧
信号又は負極性の画素電圧信号を選択して出力する。
【００３９】ディマルチプレクサ部（４２）は出力ライ
ンを時分割駆動してＤＡＣ部（４０）からの画素電圧信
号を選択的に供給する。このために、ディマルチプレク
サ部（４２）は、図５に図示したように、ＤＡＣ（５
０）と同様にの２ｎ／３個のディマルチプレクサ（５
２）を具備する。ディマルチプレクサ（５２）のそれぞ
れは、３個の出力ラインを時分割駆動してＤＡＣ（５
０）から供給される画素電圧信号を選択的に供給する。
さらに詳細には、ディマルチプレクサ部（４２）はＤＡ
Ｃ（４０）から入力される２ｎ／３個づつの画素電圧信
号を異なる出力ラインに順次サンプリング及びホールデ
ィング部（４４）に出力する。
【００４０】サンプリング及びホールディング部（４
４）は、ディマルチプレクサ部（４２）から入力される
画素電圧信号をサンプリングしてホールディングした
後、データライン（ＤＬ１乃至ＤＬ２ｎ）に同時に出力
する。このために、サンプリング及びホールディング部
（４４）は、図５に図示されたように、データライン
（ＤＬ１乃至ＤＬ２ｎ）と同一の２ｎ個のサンプリング
及びホルダ（５４）を具備する。サンプリング及びホル
ダ（５４）のそれぞれは、ディマルチプレクサ（５２）
から時間差を置いて入力される画素電圧信号をサンプリ
ングしてホールディングした後、データライン（ＤＬ１
乃至ＤＬ２ｎ）のそれぞれに同時に出力する。さらに詳
細には、サンプリング及びホールディング部（４４）は
ディマルチプレクサ部（４２）から２ｎ／３個ずつ入力
される画素電圧信号をサンプリングしてホールディング
した後、２ｎ個の画素電圧信号がすべてサンプリングさ
れると画素電圧信号などを第１乃至第２ｎデータライン
（ＤＬ１乃至ＤＬ２ｎ）に同時に出力する。
【００４１】図６は、図５に図示されたデータ駆動ＩＣ
内における３個のＲ、Ｇ、Ｂ画素データに対する伝送経
路を具体的に図示しており、図７は図６に図示された構
成要素の駆動を制御する制御信号を図示している。
【００４２】図６で３個のラッチ（４６）のそれぞれ
は、タイミング制御部（図示しない）から図４に図示さ
れた信号制御部（３０）を経由して、出力イネーブル信
号（ＳＯＥ）に応じたＲ、Ｇ、Ｂ画素データをマルチプ
レクサ（４８）に出力する。出力イネーブル信号（ＳＯ
Ｅ）には、通常、図７に図示されたように、１水平期間
（１Ｈ）毎にラッチ（４６）に共通的に供給される。
【００４３】マルチプレクサ（４８）は３個のラッチ
（４６）から入力されるＲ、Ｇ、Ｂ画素データを時分割
し、１つのＤＡＣ（５０）に順次供給する。このため
に、マルチプレクサ（４８）は入力ラインが３個のラッ
チ（４６）のそれぞれに接続されて、出力ラインが１つ
のＤＡＣ（５０）に共通接続された第１乃至第３スイッ
チ（５６、５８、６０）とを具備する。第１乃至第３ス
イッチ（５６、５８、６０）は、タイミング制御部から
信号制御部（３００を経由して入力される第１乃至第３
スイッチ制御信号（ＳＷ１、ＳＷ２、ＳＷ３）のそれぞ
れに応じてラッチ（４６）からの画素データを出力す
る。例えば、第１乃至第３スイッチ（５６、５８、６
０）は、図７に図示されたように、順次イネーブルされ
る第１乃至第３スイッチ制御信号（ＳＷ１、ＳＷ２、Ｓ
Ｗ３）に応じてラッチ（４６）から入力されたＲ、Ｇ、
Ｂ画素データを、順次１つのＤＡＣ（５０）に出力す
る。
【００４４】ＤＡＣ（５０）はマルチプレクサ（４８）
から入力されるＲ、Ｇ、Ｂ画素データをＲ、Ｇ、Ｂ画素
電圧信号に変換し、ディマルチプレクサ（５２）に出力
する。
【００４５】ディマルチプレクサ（５２）は、ＤＡＣ
（５０）から順次入力されるＲ、Ｇ、Ｂ画素電圧信号
を、相互に異なる出力ラインを通して３個のサンプリン
グ及びホルダ（５４）のそれぞれに出力する。このため
に、ディマルチプレクサ（５２）は入力ラインが１つの
ＤＡＣ（５０）の出力ラインに共通に接続され、出力ラ
インが３個のサンプリング及びホルダ（５４）のそれぞ
れに接続された、第４乃至第６スイッチ（６２、６４、
６６）とを具備する。第４乃至第６スイッチ（６２、６
４、６６）は、タイミング制御部から信号制御部（３
０）を経由して入力される第１乃至第３スイッチ制御信
号（ＳＷ１、ＳＷ２、ＳＷ３）のそれぞれに応じてＤＡ
Ｃ（５０）からの画素データを相互に異なる出力ライン
を通して出力する。この場合、ディマルチプレクサ（５
２）は、マルチプレクサ（４８）と同一の第１乃至第３
スイッチ制御信号（ＳＷ１、ＳＷ２、ＳＷ３）を利用す
る。例えば、第４乃至第６スイッチ（６２、６４、６
６）は、図７に示したように、順次イネーブルされる第
１乃至第３スイッチ制御信号（ＳＷ１、ＳＷ２、ＳＷ
３）に応じてＤＡＣ（５０）から順次入力されるＲ、
Ｇ、Ｂ画素電圧信号を、３個のサンプリング及びホルダ
（５４）に分離して供給する。
【００４６】３個のサンプリング及びホルダ（５４）
は、ディマルチプレクサ（５２）から順次入力される
Ｒ、Ｇ、Ｂ画素電圧信号をサンプリングしてホールディ
ングした後、同時に第１乃至第３データライン（ＤＬ１
乃至ＤＬ３）のそれぞれに出力する。このためにサンプ
リング及びホルダ（５４）は、入力ラインがディマルチ
プレクサ（５２）の１つの出力ラインに共通接続された
第７及び第８スイッチ（６８、７０）と、第７及び第８
スイッチ（６８、７０）のそれぞれの出力ラインに接続
された第１及び第２キャパシタ（Ｃａ、Ｃｂ）と、入力
ラインが１つのデータライン（ＤＬ）に共通接続された
第９及び第１０スイッチ（７２、７４）とを具備する。
また、サンプリング及びホルダ（５４）は、第９及び第
１０スイッチ（７２、７４）の出力ラインとデータライ
ンの間に接続されたバッファ（７６）とを更に具備す
る。
【００４７】対角線方向に位置する第７及び第１０スイ
ッチ（６８、７４）は、同一の第４スイッチ制御信号
（ＳＷ４）に応答し、第８及び第９スイッチ（７０、７
２）は第４スイッチ制御信号（ＳＷ４）と相反した論理
状態を有する第５スイッチ制御信号（ＳＷ５）に応答す
る。第４及び第５スイッチ制御信号（ＳＷ４、ＳＷ５）
は、異なる制御信号とタイミング制御部から信号制御部
（３０）を通して供給される。第１及び第２キャパシタ
（Ｃａ、Ｃｂ）は互いに異なる、即ち時間的に隣接した
水平ラインのデータを充電する。
【００４８】例えば、１水平期間を示す図７に図示され
るように、ハイ状態に供給される第４スイッチ制御信号
（ＳＷ４）に応じて第７及び第１０スイッチ（６８、７
４）がターン・オンされる。これにより、ターン・オン
された第７スイッチ（６８）により、ディマルチプレク
サ（５２）から供給される画素電圧信号がサンプリング
され、第１キャパシタ（Ｃａ）に充電されてホールディ
ングされる。これと同時に、直前の水平期間に第２キャ
パシタ（Ｃｂ）に充電されていた画素電圧信号がターン
・オンされた第１０スイッチ（７４）とバッファ（７
６）を経由してデータライン（ＤＬ）に供給される。
【００４９】次に、１水平期間を示す図７に図示される
ように、ハイ状態に供給される第５スイッチ制御信号
（ＳＷ５）に応答して第８及び第９スイッチ（７０、７
２）がターン・オンされる。これにより、ターン・オン
された第８スイッチ（７０）によりディマルチプレクサ
（５２）から供給される画素電圧信号がサンプリングさ
れ、第２キャパシタ（Ｃｂ）に充電されてホールディン
グされる。これと同時に、直前の水平期間で第１キャパ
シタ（Ｃａ）に充電されていた画素電圧信号が、ターン
・オンされた第９スイッチ（７２）とバッファ（７６）
を経由して対応するデータライン（ＤＬ）に供給され
る。
【００５０】このように、サンプリング及びホルダ（５
４）が、画素電圧信号のサンプリングのための一対の第
７及び第８スイッチ（６８、７０）と、画素電圧信号の
充電のための一対の第１及び第２キャパシタ（Ｃａ、Ｃ
ｂ）と、画素電圧信号のホールディングのための一対の
第９及び第１０スイッチ（７２、７４）とを具備し、そ
れぞれ相互交替的に駆動されるようにすることで、サン
プリング及びホールディングの動作による信号遅延を防
止することができる。
【００５１】以上説明したように、本発明の実施例によ
るデータ駆動ＩＣは、ＤＡＣ部の時分割駆動でＤＡＣ数
を少なくとも１／３に減らすことにより、ＩＣ内でＤＡ
Ｃ部が占める空間を減らす。これにより、既存のチップ
面積と比較して大きくチップ面積を増加させないか、む
しろチップ面積を減少させながら、データ駆動ＩＣが駆
動するデータラインの数、即ち出力チャネル数を従来対
比２倍に増加させることが可能になり、よってデータ駆
動ＩＣとそれに実装されるＴＣＰの数を１／２に減らす
ことができる。
【００５２】さらに詳細には、図８に図示されたよう
に、２倍の出力チャネルを有するデータ駆動ＩＣ（８
２）がＴＣＰ（８４）上に実装されて液晶パネル（８
０）に接続される。
【００５３】例えば、ＳＸＧＡモード（１２８０＊１０
２４）の液晶パネル（８０）を駆動するために、従来で
は３８４チャネルデータ駆動ＩＣ１０個を必要とした反
面、前述した本発明のデータ駆動ＩＣ（８２）を使用す
る場合、チップ面積の増大させることなく７６８チャネ
ルを確保することができるので、１／２である５個のデ
ータ駆動ＩＣ（８２）だけが必要となる。これにより、
データ駆動ＩＣ（８２）及びＴＣＰ（８４）の数を従来
より少なくとも１／２に減らすことができるので、液晶
表示装置の製造費用を低くすることができる。
【００５４】
【発明の効果】上述したように、本発明による液晶表示
装置のデータ駆動装置及び方法では、ＤＡＣ部を時分割
駆動して、既存のチップ面積と比較して大きくチップ面
積を増加させないか、むしろチップ面積を減少させなが
ら、データ駆動ＩＣの出力チャネル数を増加させること
ができる。これにより、本発明による液晶表示装置のデ
ータ駆動装置及び方法によると、データ駆動ＩＣのチャ
ネル数を増加させることにより、データ駆動ＩＣ及びＴ
ＣＰの数を従来対比１／２に減らすことができるので、
液晶表示装置の製造費用を低くすることができるように
なる。
【００５５】以上説明した内容を通し、当業者であれば
本発明の技術思想を逸脱しない範囲で多様な変更及び修
正が可能であることが分かる。従って、本発明の技術的
な範囲は、明細書の詳細な説明に記載された内容に限定
されず、特許請求の範囲によって定められなければなら
ない。
【図面の簡単な説明】
【図１】 図１は従来の液晶表示装置のデータ駆動装置
を概略的に図示した図面である。
【図２】 図２は図１に図示されたデータ駆動集積回路
の詳細な構成を図示したブロック図である。
【図３】 図３は図２に図示されたデータ駆動集積回路
内での一部のデータ伝送経路を具体的に図示した図面で
ある。
【図４】 図４は本発明の実施例による液晶表示装置の
データ駆動集積回路の構成を図示したブロック図であ
る。
【図５】 図５は図４に図示されたデータ駆動集積回路
内での一部のデータ伝送経路を図示した図面である。
【図６】 図６は図５に図示されたサンプリング及びホ
ルダの構成を具体化し、データ伝送経路を図示した図面
である。
【図７】 図７は図６に図示されたスイッチを制御する
スイッチ制御信号の波形図である。
【図８】 図８は本発明によるデータ駆動集積回路を含
む液晶表示装置のデータ駆動装置を概略的に図示した図
面である。
【符号の説明】
２、８０：液晶パネル ４、８２：データ駆動集積回路（ＩＣ） ６、８４：テープ・キャリア・パッケージ（ＴＣＰ） ８：データ印刷回路基板（ＰＣＢ） １０、３０：信号制御部 １２、３２：ガンマ電圧部 １４、３４：シフト・レジスタ部 １６、３６：ラッチ部 １７、４６：ラッチ １８、４０：デジタル・アナログ変換（ＤＡＣ）部 １９、５０：デジタル・アナログ変換器（ＤＡＣ） ２０：Ｐデコーディング部 ２２：Ｎデコーディング部 ２４、３８：マルチプレクサ（ＭＵＸ）部 ２６：出力バッファ部 ２７、７６：バッファ ４２：ディマルチプレクサ（ＤＥＭＵＸ）部 ４４：サンプリング及びホールディング部 ４８：マルチプレクサ（ＭＵＸ） ５２：ディマルチプレクサ（ＤＥＭＵＸ） ５４：サンプリング及びホルダ ５６、５８、６０、６２、６４、６６、６８、７０、７
２、７４：スイッチ
フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０９Ｇ 3/20 Ｇ０９Ｇ 3/20 ６２３Ｈ ６２３Ｌ ６４１ ６４１Ｃ ６８０ ６８０Ｇ (72)発明者 ソン， ジン キョン 大韓民国 キョンサンブク−ドー， クミ −シ， ジンピュン−ドン， イニュイジ グ 82ビー２エル， シンスン ヴィラ 303号 Ｆターム(参考） 2H093 NA16 NC13 NC22 NC23 NC24 NC25 NC26 NC27 NC28 NC34 ND03 ND39 ND42 ND50 NE07 5C006 AA16 AA22 AF25 AF43 AF46 AF71 AF82 BB16 BC02 BC12 BC13 BF03 BF04 BF11 BF24 BF25 BF37 EB05 FA16 FA42 FA43 FA51 5C080 AA10 BB05 CC03 DD12 DD23 DD25 DD26 DD28 EE29 FF11 GG11 JJ02 JJ03 JJ04 JJ06

Claims (11)

    【特許請求の範囲】
  1. 【請求項１】 入力された画素データを時分割して供給
    するためのマルチプレクサ部と、 前記マルチプレクサ部からの画素データを画素電圧信号
    に変換するためのデジタル・アナログ変換部と、 前記デジタル・アナログ変換部からの画素電圧信号を複
    数の出力ラインに選択的に供給するためのディマルチプ
    レクサ部と、 前記ディマルチプレクサ部からの画素電圧信号をサンプ
    リング及びホールディングして複数のデータラインに出
    力するためのサンプリング及びホールディング部とを具
    備することを特徴とする液晶表示装置のデータ駆動装
    置。
  2. 【請求項２】 前記マルチプレクサ部は、少なくとも２
    ｎ／３個のマルチプレクサを具備して少なくとも２ｎ個
    の画素データを少なくとも２ｎ／３個ずつ時分割して供
    給するマルチプレクサ・アレイであり、 前記デジタル・アナログ変換部は、前記少なくとも２ｎ
    ／３個のデジタル・アナログ変換器を具備して前記少な
    くとも２ｎ／３個の画素データを画素電圧信号に変換す
    るデジタル・アナログ変換アレイであり、 前記ディマルチプレクサは、少なくとも２ｎ／３個のデ
    ィマルチプレクサを具備して前記少なくとも２ｎ／３個
    ずつの画素電圧信号を少なくとも２ｎ個の出力ラインに
    選択的に供給するディマルチプレクサ・アレイであるこ
    とを特徴とする請求項１に記載の液晶表示装置のデータ
    駆動装置。
  3. 【請求項３】 サンプリング信号を順次発生するための
    シフトレジスタ部と、 前記サンプリング信号に応じて前記少なくとも２ｎ個の
    画素データを所定の単位ずつ順次ラッチして前記マルチ
    プレクサ部に同時に出力するためのラッチ部と、 前記サンプリング及びホールディング部からの画素電圧
    信号をバッファして前記複数のデータラインに出力する
    ためのバッファ部とを更に具備することを特徴とする請
    求項２に記載の液晶表示装置のデータ駆動装置。
  4. 【請求項４】 前記デジタル・アナログ変換器はそれぞ
    れ、 前記画素データを正極性の画素電圧信号に変換するため
    の正極性部と、 負極性の画素電圧信号に変換するための負極性部と、 正極性部及び負極性部の出力を選択するマルチプレクサ
    とを具備することを特徴とする請求項２に記載の液晶表
    示装置のデータ駆動装置。
  5. 【請求項５】 前記マルチプレクサはそれぞれ、 第１乃至第３スイッチング制御素子のそれぞれに応じて
    少なくとも３個の画素データを１つのデジタル・アナロ
    グ変換器に時分割して供給するための第１乃至第３スイ
    ッチング素子を具備し、 前記ディマルチプレクサはそれぞれ、前記第１乃至第３
    スイッチング制御信号のそれぞれに応じて前記デジタル
    ・アナログ変換器からの画素電圧信号を少なくとも３個
    の出力ラインに選択的に供給するための第４乃至第６ス
    イッチング素子を具備することを特徴とする請求項２に
    記載の液晶表示装置のデータ駆動装置。
  6. 【請求項６】 前記サンプリング及びホールディング部
    は、前記ディマルチプレクサ部の少なくとも２ｎ個の出
    力ラインのそれぞれに接続された少なくとも２ｎ個のサ
    ンプリング及びホルダを具備し、前記サンプリング及び
    ホルダのそれぞれは、 前記ディマルチプレクサ部の出力ラインのそれぞれに並
    列に接続される第１及び第２サンプリング・スイッチン
    グ素子と、 前記サンプリング・スイッチング素子を経由した画素電
    圧信号を充電するための第１及び第２キャパシタと、 前記第１及び第２キャパシタに充電された画素電圧信号
    をホールディングした後、前記データラインに放電する
    第１及び第２ホールディング・スイッチング素子とを具
    備することを特徴とする請求項２に記載の液晶表示装置
    のデータ駆動装置。
  7. 【請求項７】 前記第１キャパシタに充電される画素電
    圧信号をサンプリングする第１サンプリング・スイッチ
    ング素子と、前記第２キャパシタに充電された画素電圧
    信号をホールディング及び放電する第２ホールディング
    ・スイッチング素子は、同一の第１スイッチング制御信
    号によって駆動され、 前記第２キャパシタに充電される画素電圧信号をサンプ
    リングする第２サンプリング・スイッチング素子と、前
    記第１キャパシタに充電された画素電圧信号をホールデ
    ィング及び放電する第１ホールディング・スイッチング
    素子は、前記第１スイッチング制御信号と論理状態が反
    転した同一の第２スイッチング制御信号によって駆動さ
    れることを特徴とする、請求項６に記載の液晶表示装置
    のデータ駆動装置。
  8. 【請求項８】 マルチプレクサ部で入力された画素デー
    タを時分割して供給する段階と、 デジタル・アナログ変換部で前記マルチプレクサ部から
    の画素データを画素電圧信号に変換する段階と、 ディマルチプレクサ部で前記デジタル・アナログ変換部
    からの画素電圧信号を複数の出力ラインに選択的に供給
    する段階と、 サンプリング及びホールディング部で前記ディマルチプ
    レクサ部からの画素電圧信号をサンプリング及びホール
    ディングして複数のデータラインに出力する段階を含む
    ことを特徴とする液晶表示装置のデータ駆動方法。
  9. 【請求項９】 シフトレジスタ部でサンプリング信号を
    順次発生する段階と、 ラッチ部で前記サンプリング信号に応じて前記少なくと
    も２ｎ個の画素データを所定の単位ずつ順次ラッチし、
    前記マルチプレクサ部に同時に供給する段階と、 前記サンプリング及びホールディング部で出力される前
    記画素電圧信号をバッファし、前記少なくとも２ｎ個の
    データラインに供給する段階を更に含むことを特徴とす
    る請求項８に記載の液晶表示装置のデータ駆動方法。
  10. 【請求項１０】 前記マルチプレクサ部で前記画素デー
    タを時分割する段階は、第１乃至第３スイッチング制御
    信号に応じて少なくとも２ｎ個の画素データを少なくと
    も３区間に時分割して供給する段階であり、前記ディマ
    ルチプレクサ部で前記画素電圧信号を複数の出力ライン
    に選択的に供給する段階は、前記第１乃至第３スイッチ
    ング制御信号に応じて前記画素電圧信号のそれぞれを少
    なくとも３個の出力ラインに選択的に供給する段階であ
    ることを特徴とする、請求項８に記載の液晶表示装置の
    データ駆動方法。
  11. 【請求項１１】 前記サンプリング及びホールディング
    部に含まれるサンプリング及びホルダのそれぞれが、第
    １及び第２サンプリング・スイッチング素子と、第１及
    び第２キャパシタと、第１及び第２ホールディング・ス
    イッチング素子とを具備し、 前記サンプリング及びホールディング部で画素電圧信号
    をサンプリング及びホールディングする段階は、 任意の水平期間で前記第１サンプリング・スイッチング
    素子が前記マルチプレクサ部からの画素電圧信号をサン
    プリングして前記第１キャパシタに充電にすると共に、
    同時に前記第２ホールディング・スイッチング素子が前
    記第２キャパシタに充電される前の水平期間の画素電圧
    信号を対応するデータラインに放電する段階と、 次の水平期間で前記第２サンプリング・スイッチング素
    子が前記ディマルチプレクサ部からの画素電圧信号をサ
    ンプリングして前記第２キャパシタに充電すると共に、
    同時に前記第１ホールディング・スイッチング素子が前
    記第１キャパシタに充電される前の水平期間の画素電圧
    信号を対応するデータラインに放電する段階とを含むこ
    とを特徴とする、請求項８に記載の液晶表示装置のデー
    タ駆動方法。
JP2002178008A 2002-01-14 2002-06-19 液晶表示装置のデータ駆動装置及び方法 Pending JP2003208135A (ja)

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