CN1432989A - 用于驱动液晶显示器的装置和方法 - Google Patents

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Abstract

用于一个液晶显示器的一种数据驱动装置和方法，其中一个数模转换器部分在时分基础上被驱动以增加一个数据驱动IC的输出通道数目，同时与现有的芯片面积相比没有过分增加芯片面积或是减少芯片面积，由此减少了数据驱动IC和TCP的数目。在该装置中，一个多路复用器部分执行输入像素数据的时分以输出被时分了的像素数据。一个数模转换器部分把来自于多路复用器部分的像素数据转换成为像素电压信号。一个多路分解器部分有选择地把来自于数模转换器部分的像素电压信号提供给该多路分解器部分的多条输出线。一个采样器和保持器部分采样并保持来自于多路分解器部分的像素电压信号，以输出被采样和保持的像素电压信号到液晶显示器的多条数据线上。

Description

用于驱动液晶显示器的装置和方法
发明领域
本发明涉及一种液晶显示器，而且尤其涉及一种用于驱动一个液晶显示器的装置和方法。尽管本发明适于一个宽的应用范围，但是它尤其适于减少数模转换器集成电路和数据载体封装的数目。
相关技术讨论
通常，一个液晶显示器(LCD)在显示一幅图像过程中通过使用一个电场来控制液晶体的透光率。为此，LCD包括：一个液晶显示板，具有以一个矩阵形式布置的液晶元件；以及一个驱动电路，用于驱动液晶显示板。
在液晶显示板中，多条选通线和数据线用彼此交叉的方式布置。液晶元件位于选通线与数据线交叉的每个区域处。液晶显示板具有一像素电极和一公共电极，以施加一个电场到每一个液晶元件上。每一个像素电极通过作为开关器件的一个薄膜晶体管的源和漏极连接到一条数据线上。薄膜晶体管的栅极与一条选通线相连以允许一个像素电压信号被施加到用于每条线的像素电极上。
驱动电路包括一个用于驱动选通线的选通驱动器、一个用于驱动数据线的数据驱动器、和一个用于驱动公共电极的公共电压发生器。选通驱动器顺序地施加一个扫描信号到选通线上以顺序地逐行驱动液晶显示板上的液晶元件。每当选通信号被施加到一条选通线上时，数据驱动器施加一个数据电压信号到每一条数据线上。公共电压发生器施加一个公共电压信号到公共电极上。因此，LCD根据数据电压信号通过在像素电极和公共电极之间施加的一个电场为每个液晶元件控制透光率，由此显示一幅画面。数据驱动器和选通驱动器被集成到多个集成电路(IC)中。集成的数据驱动器IC和选通驱动器IC被安装在通过一个带式自动键合(TAB)系统连接到液晶显示板的一个载带封装(TCP)上，或是通过玻板基芯片(COG)系统被安装在液晶显示板上。
图1示意地显示在一个传统的LCD中的一个数据驱动装置。
参见图1，数据驱动装置包括通过TCP6连接到一个液晶显示板2的数据驱动IC4，和一个通过TCP6连接到数据驱动IC4的数据印刷电路板(PCB)8。
数据PCB8的作用是从一个定时控制器(未显示)接收各个控制信号、从一个发电机(power generator)(未显示)接收数据信号和驱动电压信号并连接数据驱动IC4。每一个TCP6被电连接到在液晶显示板2的上部提供的一个数据焊盘和在每个数据PCB8处提供的一个输出焊盘。数据驱动IC4把数字像素数据转换成为模拟像素信号以提供给在液晶显示板2上的数据线。
为此，如图2所示，每一个数据驱动IC4包括：一个移位寄存器部分14，用于施加一个顺序采样信号；一个锁存器部分16，用于响应于该顺序采样信号顺序地锁存一个像素数据VD，并且同时输出被锁存了的像素数据VD；一个数模转换器(DAC)18，用于把来自于锁存器部分16的锁存像素数据VD转换成为一个像素信号；以及一个输出缓冲部分26，用于缓冲和输出来自于DAC18的像素信号。此外，数据驱动IC4包括：一个信号控制器10，用于连接来自于一个定时控制器(未显示)的各个控制信号和像素数据VD；以及一个γ电压部分12，用于提供在DAC18中所需的正的和负的γ电压。具有如上所述的一个配置的每个数据驱动IC4驱动n条数据线D1到Dn。
信号控制器10控制到相应部分的各个控制信号(即，SSP、SSC、SOE、REV、和POL、等)和像素数据VD输出。另外，γ电压部分12为每个灰度级划分并且输出从一个γ参考电压发生器(未显示)生成的多个γ参考电压。
包括在移位寄存器部分14内的n/6移位寄存器响应于一个源采样时钟信号SSC，顺序地移位一个来自于信号控制器10的源起动脉冲SSP以作为一个采样信号输出。锁存器部分16响应于来自于移位寄存器部分14的采样信号，以某一单位顺序地采样并且锁存来自于信号控制器10的像素数据VD。为此，锁存器部分16包括n个锁存器用于锁存n个像素数据VD，其中每个锁存器具有一个对应于像素数据VD的位数(即，3位或6位)的大小。特别地，定时控制器(未显示)同时通过每条传输线输出被分为偶数像素数据VDeven和奇数像素数据VDodd的像素数据VD，以便降低传输频率。每一个偶数数据VDeven和奇数数据VDodd包括红(R)、绿(G)、和蓝(B)像素数据。因此，锁存器部分16同时锁存通过信号控制器10施加的偶数像素数据VDeven和奇数像素数据VDodd，即用于每个采样信号的6个像素数据。
随后，锁存器部分16响应于一个来自于信号控制器10的源输出使能信号SOE同时输出n个像素数据VD。在这种情况下，锁存器部分16响应于一个数据反转选择信号REV恢复被调制为具有一个减少了的转变位数的像素数据VD，然后输出被恢复的、具有一个减少了的转变位数的像素数据VD。这是由于提供了具有一个大于参考值的转变位数的像素数据VD，从而使它被调制为具有一个减少了的转变位数，以便最小化在来自定时控制器的数据传输上的电磁干扰(EMI)。
DAC18把来自于锁存器部分16的像素数据VD同时转换成为正的和负的像素信号，并且输出被转换了的像素数据VD。为此，DAC18包括共同连接到锁存器部分16的一个正的(P)解码部分20和一个负的(N)解码部分22，和一个用于选择P和N解码部分20和22的输出信号的多路复用器(MUX)24。
在P解码部分20中有n个P解码器，该P解码部分20通过使用来自于γ电压部分12的正γ电压，把从锁存器部分16输入的n个像素数据同时转换成为正的像素信号。类似地，具有n个N解码器的N解码部分22通过使用来自于γ电压部分12的负γ电压，把从锁存器部分16输入的n个像素数据同时转换成为负的像素信号。多路复用器24对来自于信号控制器10的一个极性控制信号POL做出响应，以有选择地输出来自于P解码部分20的正像素信号或是来自于N解码部分22的负像素信号。
具有n个输出缓冲器的输出缓冲部分26包括串联连接到n条数据线D1到Dn的电压输出跟随器。这种输出缓冲器执行对来自于DAC18的像素电压信号的缓冲，并且提供给数据线D1到Dn。
图3说明了在如图2所示的数据驱动IC4内的一部分像素数据的一条传输路径。
在图3中，锁存器部分17中的锁存器17输出9个像素数据到构成DAC部分18的9个DAC19，以把像素数据转换成为像素电压信号。像素电压信号通过输出缓冲器部分26的缓冲器27被施加到第一到第九条数据线DL1到DL9上。
如上所述，每一个传统的数据驱动IC4应该具有n个DAC，其中每个DAC包括一个P解码器、一个N解码器和一个多路复用器，以便驱动n条数据线DL1到DLn。因此，数据驱动IC具有一个导致相对高制造成本的复杂配置。因此，必须减少数据驱动IC的数目以便降低制造成本。
为了减少数据驱动IC的数目，已经考虑了一个增加能够由数据驱动IC驱动的数据线数目、即输出通道数目的方案。然而，由于具有一个复杂配置的DAC的数目依据在数据驱动IC的驱动通道数目的增加而被增加，扩大了芯片面积，使得该芯片面积成比例的TCP的成本增加了，而且它们的集成变得困难了。因此，制造成本增加了，而且产量很可能降低了。
发明概述
因此，本发明旨在提供一种用于驱动一个液晶显示器的装置和方法，它实质上排除了由于相关技术的局限性和缺点而导致的一个或多个问题。
本发明的另一个目的是提供一种用于驱动一个液晶显示器的装置和方法，其中一个数模转换器部分在时分(time-division)的基础上被驱动以增加数据驱动IC的输出通道数目，同时与现有的芯片面积相比该芯片面积没有被大大增加或降低，由此减少了数据驱动IC和TCP的数目。
本发明另外的特征和优点将在随后的描述中进行阐述，而且在某种程度上来说，这些从该描述中是很显然的，或是可以通过本发明的实践得知。本发明的目的及其它优点将通过在所撰写的说明书和权利要求以及附图中特别指出的结构得到实现和完成。
为了实现这些及其它优点，并依据本发明的目的，如所实施的和概括描述的那样，用于一个液晶显示器的一种数据驱动装置包括：一个多路复用器部分，具有至少一个多路复用器，用于执行输入像素数据的时分以输出被时分了的像素数据；一个数模转换器部分，具有至少一个数模转换器，用于把来自于多路复用器部分的时分像素数据转换成为像素电压信号；一个多路分解器部分，具有至少一个多路分解器，用于有选择地把来自于数模转换器部分的像素电压信号提供给该多路分解器部分的多条输出线；以及一个采样器和保持器部分，具有至少一个采样器和保持器，用于采样及保持来自于多路分解器部分的像素电压信号以输出被采样及保持的电压信号到液晶显示器的多条数据线。
在该数据驱动装置中，多路复用器部分包括至少2n/3个多路复用器(其中n是一个整数)以执行至少2n个像素数据的一个至少2n/3的时分，数模转换器部分包括至少2n/3个数模转换器以把至少2n/3个像素数据转换成为像素电压信号，而且多路分解器部分包括至少2n/3个多路复用器以有选择地把2n/3个像素电压信号中的每一个提供给至少2n条输出线。
该数据驱动装置进一步包括：一个移位寄存器部分，用于顺序地生成采样信号；一个锁存器部分，用于响应于该采样信号以一个单位顺序地锁存至少2n个像素数据以同时输出被锁存的数据到多路复用器部分；以及一个缓冲器部分，用于缓冲来自于采样器和保持器阵列的像素电压信号以把它们输出到多条数据线上。
每个数模转换器包括一个用于把像素数据转换成为正电压信号的正部分，一个用于把像素数据转换成为负电压信号的负部分，和一个用于选择正和负部分输出的多路复用器。
每个多路复用器包括第一到第三开关器件，用于分别响应于第一到第三开关控制信号执行至少三个像素数据的时分以输出被时分的像素数据到数模转换器中的一个，而且每个多路分解器包括第四到第六开关器件，用于分别响应于第一到第三开关控制信号把来自于数模转换器部分的像素电压信号有选择地提供到至少三条输出线。
采样器和保持器部分包括连接到多路分解器部分的至少2n条输出线的至少2n个采样器和保持器，其中每个都包括：并联连接到多路分解器部分的每条输出线上的第一和第二采样开关；第一和第二电容器，用于装载经过该采样开关的像素电压信号；以及第一和第二保持开关，用于保持在第一和第二电容器中装载的像素电压信号，并且把被保持的像素电压信号排出到数据线中。
响应于第一开关控制信号，驱动用于采样将在第一电容器中装载的像素电压信号的第一采样开关，和用于保持并排出在第二电容器中装载的像素电压信号的第二保持开关，并且，响应于相对于第一开关控制信号具有一个反相逻辑状态的第二开关控制信号，驱动用于采样将在第二电容器中装载的像素电压信号的第二采样开关，和用于保持并排出在第一电容器中装载的像素电压信号的第一保持开关。
在本发明的另一个方面，用于一个液晶显示器的一种数据驱动方法包括：执行对从一个多路复用器部分输入的像素数据的时分以施加被时分了的像素数据；把来自于多路复用器部分、被时分了的像素数据转换成为多个像素电压信号；有选择地把来自于一个数模转换器部分的像素电压信号提供给多路分解器部分的多条输出线；以及，在一个采样器和保持器部分采样及保持来自于多路分解器部分的像素电压信号，以输出被采样及保持的像素电压信号到液晶显示器的多条数据线。
该数据驱动方法进一步包括：顺序地生成采样信号；响应于该采样信号以一个单位顺序地锁存至少2n个像素数据以同时输出被锁存的数据到多路复用器部分；以及，缓冲来自于采样器和保持器部分的像素电压信号以把被缓冲的像素电压信号输出到至少2n条数据线上。
在该数据驱动方法中，执行像素数据的时分包括：响应于第一到第三开关控制信号执行至少2n个像素数据的到至少三个区域的时分，而且，有选择地提供像素电压信号到多条输出线包括：响应于第一到第三开关控制信号把像素电压信号有选择地提供到至少三条输出线。
在此，采样器和保持器部分具有至少一个包括第一和第二采样开关、第一和第二电容器、以及第一和第二保持开关的采样器和保持器。采样及保持像素电压信号包括：允许第一采样开关采样来自于多路分解器部分的、将在一个水平时段在第一电容器中装载的像素电压信号，同时，允许第二保持开关把在前一水平时段在第二电容器中装载的像素电压信号排放到相应的数据线中，并且允许第二采样开关采样来自于多路分解器部分的、将在第二电容器中装载的像素电压信号，同时，允许第一保持开关把在前一水平时段在第一电容器中装载的像素电压信号排放到相应的数据线中。
应当理解，上述一般说明及下列的详细说明都是示范性的和说明性的，而且被用来提供对如权利要求所述的本发明的进一步说明。
附图简要说明
被包括在内以提供对本发明的进一步理解、并且被结合进来构成这个申请一部分的附图，和用来说明本发明原理的说明书一起说明了本发明中的实施例。
在附图中：
图1是一个示意图，显示了一个传统的液晶显示器中的一个数据驱动装置；
图2是一个详细的方框图，显示了在图1中的数据驱动集成电路的配置；
图3说明了在如图2所示的数据驱动集成电路内的一部分数据的一条传输路径；
图4是一个方框图，显示了依据本发明的一个液晶显示器的一个数据驱动集成电路的配置；
图5说明了在如图4所示的数据驱动集成电路内的一部分数据的一条传输路径；
图6说明了具有如图5所示的采样器和保持器详细配置的数据的一条传输路径；
图7是一个用于控制如图6中所示的开关的开关控制信号的波形图；以及
图8是一个示意图，显示了包括依据本发明的数据驱动集成电路的一个液晶显示器中的一个数据驱动装置的配置。
实施例的详细描述
下面将结合本发明中举例说明的实施例进行详细说明，其中的例子在附图中进行了图解说明。只要可能，在所有附图中将使用同样的附图标记以指向同样的或相似的部分。
图4是一个方框图，显示了依据本发明的一个液晶显示器中的一个数据驱动装置的配置。
参见图4，数据驱动装置包括：一个移位寄存器部分34，用于施加顺序的采样信号；一个锁存器部分36，用于响应于该采样信号顺序地锁存像素数据VD，并且同时输出被锁存的像素数据；一个多路复用器部分38，用于执行对来自于锁存器部分36的像素数据VD的时分；一个数模转换器(DAC)部分40，用于把来自于多路复用器部分38的像素数据VD转换成为像素电压信号；一个多路分解器部分42，用于执行对输出线的时分驱动以施加来自于DAC部分40的像素电压信号；以及，一个采样及保持部分44，用于采样及保持从多路分解器部分38输入的像素电压信号以同时提供给数据线DL1到DL2n。此外，数据驱动装置包括：一个信号控制器30，用于连接从一个定时控制器(未显示)中生成的各个控制信号和像素数据VD；以及一个γ电压部分32，用于提供正的和负的γ电压到DAC部分40。具有如上所述的一个配置的数据驱动装置可以被集成到单个数据驱动IC中以驱动2n条数据线DL1到DL2n，它们是能够由传统数据驱动IC驱动的数据线的两倍。
信号控制器30控制各个控制信号(即，SSP、SSC、SOE、REV、和POL等)和像素数据VD以提供给相应部分。此外，γ电压部分32为每个灰度级划分从一个γ参考电压发生器(未显示)生成的多个γ参考电压，然后输出被划分的γ参考电压。
包括在移位寄存器部分34内的多个移位寄存器响应于一个源采样时钟信号SSC，顺序地移位一个从信号控制器30生成的源起动脉冲SSP以作为一个采样信号输出。
锁存器部分36响应于来自于移位寄存器部分34的采样信号，以某一单位顺序地采样从信号控制器30中输出的像素数据VD以锁存被采样的像素数据。为此，如图5所示，锁存器部分36包括2n个锁存器46，用于锁存2n个像素数据VD，其中每个锁存器46都具有对应于像素数据VD的位数(即，3位或6位)的大小。锁存器部分36同时锁存通过信号控制器30施加的偶数像素数据VDeven和奇数像素数据VDodd，即用于每个采样信号的6个像素数据。随后，锁存器部分36响应于一个来自于信号控制器30的源输出使能信号SOE同时输出被锁存的2n个像素数据VD。在这种情况下，锁存器部分36响应于一个数据反转选择信号REV恢复被调制为具有一个减少了的转变位数的像素数据VD，然后输出被恢复的、具有一个减少了的转变位数的像素数据VD。
多路复用器部分38执行从锁存器部分36输入的2n个像素数据的时分以输出被时分了的像素数据。当2n个像素数据被时分为三个区域时，多路复用器部分38包括连接到每三个锁存器46的2n/3个多路复用器48，如图5所示。每个多路复用器48执行对从每三个锁存器46输入的像素数据的时分，以顺序地提供给一条输出线。换句话说，多路复用器部分36执行对从锁存器部分36输入的2n个像素数据的一个2n/3时分以输出被时分了的像素数据到DAC部分40。
DAC部分40把来自于多路复用器部分38的像素数据VD转换成为正的和负的像素电压信号，并且响应于一个极性控制信号POL有选择地输出正的和负的像素电压信号。为此，DAC部分40包括2n/3个DAC 50，它们与多路复用器48具有相同的数目，如图5所示。每一个DAC 50包括共同连接到多路复用器48的一个正(P)解码器和一个负(N)解码器，和一个用于选择P和N解码器的输出信号的多路复用器。P解码器通过使用从γ电压部分34中生成的正γ电压把像素数据转换成为正的像素电压信号。N解码器通过使用从γ电压部分34中生成的负γ电压把像素数据转换成为负的像素电压信号。多路复用器对来自于信号控制器32的极性控制信号POL做出响应以有选择地输出正像素电压信号或负像素电压信号。
多路分解器部分42执行输出线的时分驱动以有选择地施加来自于DAC部分40的像素电压信号。为此，多路分解器部分42包括2n/3个多路分解器，它们与DAC 50具有相同的数目，如图5所示。每一个多路分解器52执行对三条输出线的时分驱动以有选择地施加来自于DAC 50的像素电压信号。换句话说，多路分解器部分42通过不同的输出线顺序地把从DAC部分40中输入的每2n/3个像素电压信号输出到采样器和保持器部分44。
采样器和保持器部分44采样并保持来自于多路分解器部分42的像素电压信号，然后同时输出到数据线DL1到DL2n。为此，采样器和保持器部分44包括2n个采样器和保持器54，它们与数据线DL1到DL2n具有相同的数目，如图5所示。每一个采样器和保持器54都采样并保持从多路分解器52输入的具有一个时间差的像素电压信号，然后同时输出到数据线DL1到DL2n。换句话说，采样器和保持器部分44采样并保持从多路分解器部分42输入的每2n/3个像素电压信号，而且如果所有2n个像素电压信号都已经被采样了，则同时输出这些像素电压信号到第一到第2n条数据线DL1到DL2n。
图6说明了在如图5所示的数据驱动IC内的三个红(R)、绿(G)、和蓝(B)像素数据的一条传输路径。图7是一个用于控制如图6中所示的每个部分的驱动的控制信号的波形图。
在图6中，三个锁存器46中的每一个对通过如图4所示的信号控制器30从定时控制器(未显示)中输入的一个输出使能信号SOE做出响应，以输出R、G、和B像素数据到多路复用器48。输出使能信号SOE在每个水平时段1H被施加到各个锁存器46，如图7所示。
多路复用器48执行从三个锁存器46中输入的R、G、和B像素数据的时分以顺序地提供被时分的像素数据到单个DAC 50。为此，多路复用器48包括第一到第三开关56、58、和60，其中每个开关都具有一条连接到三个锁存器46中每一个的输入线，和一条共同连接到DAC 50的输出线。第一到第三开关56、58、和60对从定时控制器中通过信号控制器30输入的第一到第三开关控制信号SW1、SW2、和SW3做出响应，以输出来自于锁存器46的像素数据。例如，第一到第三开关56、58、和60对如图7所示顺序使能的第一到第三开关控制信号SW1、SW2、和SW3做出响应，以顺序地输出从锁存器46中输入的R、G、和B像素数据到DAC 50。
DAC 50把从多路复用器48中顺序输入的R、G、和B像素数据转换为R、G、和B像素电压信号以输出被转换的像素数据到多路分解器52。
多路分解器52通过不同的输出线把从DAC 50中顺序输入的R、G、和B像素电压信号输出到三个采样器和保持器54中的每一个。为此，多路分解器52包括第四到第六开关62、64、和66，其中每个开关都具有一条共同连接到DAC50的一条输出线的输入线，和一条连接到三个采样器和保持器54中每一个的输出线。第四到第六开关62、64、和66对从定时控制器中通过信号控制器30输入的第一到第三开关控制信号SW1、SW2、和SW3做出响应，以通过不同的输出线输出来自于DAC 50的像素数据。在这种情况下，多路分解器52与多路复用器48类似，使用第一到第三开关控制信号SW1、SW2、和SW3。例如，第四到第六开关62、64、和66对如图7所示顺序使能的第一到第三开关控制信号SW1、SW2、和SW3做出响应，以分别施加从DAC 50中顺序输入的R、G、和B像素电压信号到三个采样器和保持器54。
三个采样器和保持器54采样并保持从多路分解器52中顺序输入的R、G、和B像素电压信号，然后同时输出到第一到第三条数据线DL1到DL3中的每一条。为此，采样器和保持器54包括：第七和第八开关68和70，其中每个开关都有一条输入线共同连接到多路分解器52的一条输出线上；第一和第二电容器Ca和Cb，分别连接到第七和第八开关68和70的输出线上；以及，第九和第十开关72和74，其中每个开关都有一条输入线连接到第七和第八开关68和70的每条输出线上，而且有一条输出线共同连接到数据线DL中的一条上。此外，采样器和保持器54包括一个缓冲器76，连接在第九和第十开关72和74的输出线与数据线DL之间。
位于一个对角线方向上的第七和第十开关68和74对同一个第四开关控制信号SW4做出响应，而第八和第九开关70和72对第五开关控制信号SW5做出响应，其中该第五开关控制信号SW5具有一个与第四开关控制信号SW4相反的逻辑状态。第四和第五开关控制信号SW4和SW5从定时控制器中通过信号控制器30被施加，这与其它控制信号类似。第一和第二电容器Ca和Cb在彼此不同(即在时间基础上彼此相邻)的水平线上装载数据。
例如，在一个水平时段，响应于如图7所示具有高状态的第四开关控制信号SW4，接通第七和第十开关68和74。因此，从多路分解器52中施加的像素电压信号借助于被接通的第七开关68被采样，并且在第一电容器Ca中被装载和保持。同时，在前一水平时段在第二电容器Cb中被装载的像素电压信号通过接通的第十开关74和缓冲器76，被施加到相应的数据线DL上。
在下一个水平时段，响应于如图7所示具有高状态的第五开关控制信号SW5，接通第八和第九开关70和72。因此，从多路分解器52中施加的像素电压信号借助于接通的第八开关70被采样，并且在第二电容器Cb中被装载和保持。同时，在前一个水平时段，在第一电容器Ca中已经被装载的像素电压信号通过接通的第九开关72和缓冲器76被施加到相应的数据线DL上。
如上所述，采样器和保持器54包括：一对第七和第八开关68和70，用于采样像素电压信号；一对第一和第二电容器Ca和Cb，用于装载像素电压信号；以及一对第九和第十开关72和74，用于交替地保持将被驱动的像素电压信号，由此防止由这种采样和保持操作所引起的信号延迟。
如上所述，在依据本发明的数据驱动IC中，DAC的数目通过DAC部分的时分驱动被减少为至少1/3，由此减少了在IC内由DAC部分占用的空间。因此，由数据驱动IC驱动的数据线的数目被增加了。换句话说，输出通道的数目变成了先前已知设备的两倍，同时与现有的芯片面积相比，芯片面积没有被大大增加或减少。因此，数据驱动IC和安装有IC的TCP的数目可以被减少为1/2。
更具体地说，具有两倍的传统设备输出通道的数据驱动IC 82被安装在TCP84上，并且被连接到一个液晶显示板80上，如图8所示。
例如，为了用一个SXGA(1280×1024)模式驱动液晶显示板80，传统的设备需要10个数据驱动IC，其中每个数据驱动IC都具有384个通道，而本发明仅仅需要5个数据驱动IC 82，它是传统设备的1/2，这是由于可以得到768个通道而不必扩大芯片面积。因此，与传统的设备相比，数据驱动IC 82和TCP84的数目被减少为至少1/2，由此降低了制造成本。
如上所述，依据本发明，DAC部分在时分基础上被驱动以把数据驱动IC的通道数增加到传统设备的两倍，而不必大大地扩大芯片面积或减少芯片面积。因此，与传统的设备相比，数据驱动IC的通道数被增加了，而且数据驱动IC和TCP的数目被减少为1/2，由此降低了制造成本。
对本领域技术人员来说，显然在本发明的用于驱动一个液晶显示器的装置和方法中能够进行各种修改和变化，而没有背离本发明的精神或范围。因此，假如对这个发明的修改和变化属于附加权利要求和它们等效含义的范围之内，则本发明涵盖这些修改和变化。

Claims (12)

1.一种用于液晶显示器的数据驱动装置，包括：
多路复用器部分，具有至少一个多路复用器，用于执行输入像素数据的时分以输出被时分了的像素数据；
数模转换器部分，具有至少一个数模转换器，用于把来自于多路复用器部分的、被时分了的像素数据转换成为像素电压信号；
多路分解器部分，具有至少一个多路分解器，用于有选择地把来自于数模转换器部分的像素电压信号提供给该多路分解器部分的多条输出线；以及
采样器和保持器部分，具有至少一个采样器和保持器，用于采样并保持来自于多路分解器部分的像素电压信号以输出被采样和保持的像素电压信号到液晶显示器的多条数据线上。
2.如权利要求1所述的数据驱动装置，其特征在于：多路复用器部分包括至少2n/3个多路复用器以执行至少2n个像素数据的至少2n/3的时分，其中n是一个整数，
数模转换器部分包括至少2n/3个数模转换器，以把至少2n/3个像素数据转换成为像素电压信号，以及
多路分解器部分包括至少2n/3个多路分解器以有选择地把2n/3个像素电压信号中的每一个提供给多路分解器部分的至少2n条输出线。
3.如权利要求1所述的数据驱动装置，进一步包括：
移位寄存器部分，用于顺序地生成多个采样信号；
锁存器部分，用于响应于该采样信号以一个单位顺序地锁存至少2n个像素数据，以同时输出被锁存的数据到多路复用器部分；以及
缓冲器部分，用于缓冲来自于采样器和保持器部分的像素电压信号，以把被缓冲的像素电压信号输出到液晶显示器的多条数据线上。
4.如权利要求1所述的数据驱动装置，其特征在于：每个数模转换器包括一个用于把像素数据转换成为正电压信号的正部分，一个用于把像素数据转换成为负电压信号的负部分，和一个用于选择正和负部分的输出的多路复用器。
5.如权利要求1所述的数据驱动装置，其特征在于：每个多路复用器包括第一到第三开关器件，用于分别响应于第一到第三开关控制信号执行至少三个像素数据的时分，以输出被时分的像素数据到数模转换器中的一个，以及
每个多路分解器包括第四到第六开关器件，用于分别响应于第一到第三开关控制信号，把来自于数模转换器部分的像素电压信号有选择地提供到至少三条输出线。
6.如权利要求1所述的数据驱动装置，其特征在于：采样器和保持器部分包括连接到多路分解器部分的至少2n条输出线的至少2n个采样器和保持器，其中每个采样器和保持器都包括：
第一和第二采样开关，并联连接到多路分解器部分的每条输出线上；
第一和第二电容器，用于装载经过该采样开关的像素电压信号；以及
第一和第二保持开关，用于保持在第一和第二电容器中装载的像素电压信号，并且把被保持的像素电压信号排放到液晶显示器的数据线中。
7.如权利要求6所述的数据驱动装置，其特征在于：响应于第一开关控制信号，驱动用于采样将在第一电容器中装载的像素电压信号的第一采样开关，和用于保持并排出在第二电容器中装载的像素电压信号的第二保持开关，以及
响应于相对于第一开关控制信号具有一个反相逻辑状态的第二开关控制信号，驱动用于采样将在第二电容器中装载的像素电压信号的第二采样开关，和用于保持并排出在第一电容器中装载的像素电压信号的第一保持开关。
8.一种用于液晶显示器的数据驱动方法，包括：
执行对从一个多路复用器部分输入的像素数据的时分以施加被时分了的像素数据；
把来自于多路复用器部分的、被时分了的像素数据转换成为多个像素电压信号；
有选择地把来自于一个数模转换器部分的像素电压信号提供到多路复用器部分的多条输出线上；以及
在一个采样器和保持器部分采样并保持来自于多路分解器部分的像素电压信号，以输出被采样和保持的像素电压信号到液晶显示器的多条数据线上。
9.如权利要求8所述的数据驱动方法，进一步包括：
顺序地生成多个采样信号；
响应于该采样信号以一个单位顺序地锁存至少2n个像素数据，以同时输出被锁存的数据到多路复用器部分；以及
缓冲被采样和保持的像素电压信号，以把被缓冲的像素电压信号输出到液晶显示器的至少2n条数据线上。
10.如权利要求8所述的数据驱动方法，其特征在于：执行像素数据的时分包括：响应于第一到第三开关控制信号执行至少2n个像素数据到至少三个区域的时分，以及
有选择地提供像素电压信号包括：响应于第一到第三开关控制信号把像素电压信号有选择地提供到至少三条输出线上。
11.如权利要求8所述的数据驱动方法，其特征在于：采样器和保持器部分具有至少一个包括第一和第二采样开关、第一和第二电容器、以及第一和第二保持开关的采样器和保持器。
12.如权利要求11所述的数据驱动方法，其特征在于：采样并保持像素电压信号包括：允许第一采样开关采样来自于多路分解器部分的将在一个水平时段在第一电容器中装载的像素电压信号，同时，允许第二保持开关把在前一水平时段在第二电容器中装载的像素电压信号排放到一条相应的数据线中，以及
允许第二采样开关采样来自于多路分解器部分的将在第二电容器中被装载的像素电压信号，同时，允许第一保持开关把在前一水平时段在第一电容器中装载的像素电压信号排放到一条相应的数据线中。
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