JP2000196093A5 - - Google Patents
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Description
【特許請求の範囲】
【請求項1】
Nチャネル型TFTとPチャネル型TFTとで形成されたCMOS回路を含む半導体装置であって、
前記CMOS回路の前記Nチャネル型TFTおよび前記Pチャネル型TFTは、絶縁層を介して第1配線および第2配線によって活性層が挟まれた構造を有し、
前記Nチャネル型TFTの活性層はチャネル形成領域に接して低濃度不純物領域を含んでおり、
前記チャネル形成領域は前記第1配線および前記第2配線に重なり、
前記低濃度不純物領域は前記第1配線に重なり、且つ、前記第2配線に重ならないように形成されていることを特徴とする半導体装置。
【請求項2】
請求項1において、前記Nチャネル型TFTの前記第1配線と前記第2配線とは電気的に接続されていることを特徴とする半導体装置。
【請求項3】
請求項1または請求項2において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜であることを特徴とする半導体装置。
【請求項4】
Nチャネル型TFTで形成された画素TFTと保持容量とを有する画素マトリクス回路を含む半導体装置であって、
前記画素TFTは絶縁層を介して第1配線および第2配線によって活性層が挟まれた構造を有し、
前記活性層はチャネル形成領域に接して低濃度不純物領域を含んでおり、
前記チャネル形成領域は前記第1配線および前記第2配線に重なり、
前記低濃度不純物領域は前記第1配線に重なり、且つ、前記第2配線に重ならないように形成されており、
前記保持容量は、前記第1配線および前記活性層によって前記絶縁層が挟まれた構造であることを特徴とする半導体装置。
【請求項5】
請求項4において、前記第1配線はフローティング状態にあることを特徴とする半導体装置。
【請求項6】
請求項4において、前記第1配線は最低電源電位に保持されることを特徴とする半導体装置。
【請求項7】
請求項4乃至請求項6のいずれか一項において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜であることを特徴とする半導体装置。
【請求項8】
同一基板上に形成された画素マトリクス回路とドライバー回路とを有する半導体装置であって、
前記画素マトリクス回路に含まれる画素TFTと前記ドライバー回路に含まれるNチャネル型TFTは、絶縁層を介して第1配線および第2配線によって活性層が挟まれた構造を有し、
前記活性層はチャネル形成領域に接して低濃度不純物領域を含んでおり、
前記チャネル形成領域は前記第1配線および前記第2配線に重なり、
前記低濃度不純物領域は前記第1配線に重なり、且つ、前記第2配線に重ならないように形成され、
前記画素TFTが有する第1配線は最低電源電位に保持され、前記ドライバー回路に含まれるNチャネル型TFTが有する第1配線は、該ドライバー回路に含まれるNチャネル型TFTが有する第2配線と同電位に保持されることを特徴とする半導体装置。
【請求項9】
請求項8において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜であることを特徴とする半導体装置。
【請求項10】
請求項1乃至請求項9に記載された半導体装置とは、アクティブマトリクス型液晶ディスプレイまたはアクティブマトリクス型ELディスプレイであることを特徴とする半導体装置。
【請求項11】
請求項1乃至請求項10に記載された半導体装置とは、ビデオカメラ、デジタルカメラ、プロジェクター、プロジェクションTV、ゴーグル型ディスプレイ、カーナビゲーション、パーソナルコンピュータ、携帯情報端末であることを特徴とする半導体装置。
【請求項12】
Nチャネル型TFTとPチャネル型TFTとで形成されたCMOS回路を含む半導体装置の作製方法であって、
基板上に第1配線を形成し、
前記第1配線の上に第1絶縁層を形成し、
前記第1絶縁層の上に前記Nチャネル型TFTの活性層および前記Pチャネル型TFTの活性層を形成し、
前記Nチャネル型TFTの活性層および前記Pチャネル型TFTの活性層を覆って第2絶縁層を形成し、
前記第2絶縁層の上に第2配線を形成し、
前記Nチャネル型TFTの活性層において、前記第1配線が重なり、且つ、前記第2配線が重ならない部分に、第1の低濃度不純物領域と第2の低濃度不純物領域を形成することを特徴とする半導体装置の作製方法。
【請求項13】
請求項12において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜で形成されることを特徴とする半導体装置の作製方法。
【請求項1】
Nチャネル型TFTとPチャネル型TFTとで形成されたCMOS回路を含む半導体装置であって、
前記CMOS回路の前記Nチャネル型TFTおよび前記Pチャネル型TFTは、絶縁層を介して第1配線および第2配線によって活性層が挟まれた構造を有し、
前記Nチャネル型TFTの活性層はチャネル形成領域に接して低濃度不純物領域を含んでおり、
前記チャネル形成領域は前記第1配線および前記第2配線に重なり、
前記低濃度不純物領域は前記第1配線に重なり、且つ、前記第2配線に重ならないように形成されていることを特徴とする半導体装置。
【請求項2】
請求項1において、前記Nチャネル型TFTの前記第1配線と前記第2配線とは電気的に接続されていることを特徴とする半導体装置。
【請求項3】
請求項1または請求項2において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜であることを特徴とする半導体装置。
【請求項4】
Nチャネル型TFTで形成された画素TFTと保持容量とを有する画素マトリクス回路を含む半導体装置であって、
前記画素TFTは絶縁層を介して第1配線および第2配線によって活性層が挟まれた構造を有し、
前記活性層はチャネル形成領域に接して低濃度不純物領域を含んでおり、
前記チャネル形成領域は前記第1配線および前記第2配線に重なり、
前記低濃度不純物領域は前記第1配線に重なり、且つ、前記第2配線に重ならないように形成されており、
前記保持容量は、前記第1配線および前記活性層によって前記絶縁層が挟まれた構造であることを特徴とする半導体装置。
【請求項5】
請求項4において、前記第1配線はフローティング状態にあることを特徴とする半導体装置。
【請求項6】
請求項4において、前記第1配線は最低電源電位に保持されることを特徴とする半導体装置。
【請求項7】
請求項4乃至請求項6のいずれか一項において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜であることを特徴とする半導体装置。
【請求項8】
同一基板上に形成された画素マトリクス回路とドライバー回路とを有する半導体装置であって、
前記画素マトリクス回路に含まれる画素TFTと前記ドライバー回路に含まれるNチャネル型TFTは、絶縁層を介して第1配線および第2配線によって活性層が挟まれた構造を有し、
前記活性層はチャネル形成領域に接して低濃度不純物領域を含んでおり、
前記チャネル形成領域は前記第1配線および前記第2配線に重なり、
前記低濃度不純物領域は前記第1配線に重なり、且つ、前記第2配線に重ならないように形成され、
前記画素TFTが有する第1配線は最低電源電位に保持され、前記ドライバー回路に含まれるNチャネル型TFTが有する第1配線は、該ドライバー回路に含まれるNチャネル型TFTが有する第2配線と同電位に保持されることを特徴とする半導体装置。
【請求項9】
請求項8において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜であることを特徴とする半導体装置。
【請求項10】
請求項1乃至請求項9に記載された半導体装置とは、アクティブマトリクス型液晶ディスプレイまたはアクティブマトリクス型ELディスプレイであることを特徴とする半導体装置。
【請求項11】
請求項1乃至請求項10に記載された半導体装置とは、ビデオカメラ、デジタルカメラ、プロジェクター、プロジェクションTV、ゴーグル型ディスプレイ、カーナビゲーション、パーソナルコンピュータ、携帯情報端末であることを特徴とする半導体装置。
【請求項12】
Nチャネル型TFTとPチャネル型TFTとで形成されたCMOS回路を含む半導体装置の作製方法であって、
基板上に第1配線を形成し、
前記第1配線の上に第1絶縁層を形成し、
前記第1絶縁層の上に前記Nチャネル型TFTの活性層および前記Pチャネル型TFTの活性層を形成し、
前記Nチャネル型TFTの活性層および前記Pチャネル型TFTの活性層を覆って第2絶縁層を形成し、
前記第2絶縁層の上に第2配線を形成し、
前記Nチャネル型TFTの活性層において、前記第1配線が重なり、且つ、前記第2配線が重ならない部分に、第1の低濃度不純物領域と第2の低濃度不純物領域を形成することを特徴とする半導体装置の作製方法。
【請求項13】
請求項12において、前記第1配線および/または前記第2配線は、タンタル(Ta)、クロム(Cr)、チタン(Ti)、タングステン(W)、モリブデン(Mo)、またはシリコン(Si)から選ばれた元素を主成分とする導電膜、或いは前記元素を組み合わせた合金膜またはシリサイド膜で形成されることを特徴とする半導体装置の作製方法。
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