DE3602124A1 - Amorpher silicium-duennschichttransistor - Google Patents
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Description
TER MEER · MÖLLER · STEINMEISTKR Sharp.-K.K. 28IT-GER
Amorpher Silicium-Dünnschichttransistor
Beschreibung
Die Erfindung betrifft einen Dünnschichttransistor gemäß
dem Oberbegriff des Patentanspruchs 1.
Der Aufbau konventioneller Dünnschicht- bzw. Dünnfilm-Feldeffekttransistoren
(field effect thin film transistors TFT) wird nachfolgend genauer beschrieben. Die Fig. 1 bis
3 zeigen Querschnitte durch derartige konventionelle TFT-Strukturen,
bei denen jeweils eine Gate-Elektrode 20, 21, 22 auf einem isolierenden Substrat 10, 11, 12 liegt und
von einem Gate-Isolationsfilm 30, 31, 32 bedeckt ist. Bei
der TFT-Struktur nach Fig. 1 wird der Gate-Isolationsfilm 30 von einem nichtdotierten amorphen Siliciumfilm 40 vollständig
bedeckt. Bei der TFT-Struktur nach Fig. 2 liegt dagegen ein nichtdotierter amorpher Siliciumfilm 41 nur
im Zentralbereich auf dem Gate-Isolationsfilm 31. Metallfilme werden auf die jeweiligen Endbereiche der Siliciumfilme
40, 41 und der Gate-Elektroden 20, 21 aufgebracht, um Source-Elektroden 50, 51 und Drain-Elektroden 60, 61
zu bilden. Bei der TFT-Struktur nach Fig. 3 liegen amorphe Siliciumfilme 72, 82 vom η -Typ auf beiden Endbereichen
des Gate-Isolationsfilms 32. Auf den amorphen SiIiciumfilmen
72, 82 vom η -Typ werden Source- und Drain-Elektroden 52, 62 aufgebracht. Zuletzt wird ein nichtdotierter
amorpher Siliciumfilm 42 im Zentralbereich des Gate-Isolationsfilms 32 sowie auf die Elektroden 52 und
62 niedergeschlagen.
Wird der entsprechend der Fig. 1 ausgebildete Dünnschicht-
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transistor eingeschaltet, so verlaufen nicht nur auf der Oberfläche des nichtdotierten amorphen Siliciumfilms 40
Stromwege zur Gate-Elektrode 20, sondern auch in anderen Teilen des amorphen Siliciumfilms 40, wie in Fig. 4 dargestellt
ist. Das bedeutet, daß der Drain-Strom nicht allein durch den Flächenwiderstand (Kanalwiderstand) Reh
festgelegt ist, der durch die Laminatschicht auf der Oberfläche 40a des amorphen Siliciumfilms 40 an der Seite der
Gate-Elektrode aufgrund der Gate-Spannung gebildet wird, die zwischen der Gate-Elektrode 20 und der Source-Elektrode
50 angelegt wird. Durch den einen hohen Widerstand besitzenden, nichtdotierten amorphen Siliciumfilm 40 zwischen
der Source-Elektrode 50 und der Laminatschicht auf der Oberfläche 40a wird darüber hinaus ein Widerstand
(Kontaktwiderstand) Rco gebildet, der zu einem hohen Widerstand im Einschaltzustand führt. Bestehen die Source-
und die Drain-Elektroden 50, 60 aus metallischem Material, beispielsweise aus Aluminium, so treten diese praktisch
sowohl mit negativen als auch mit positiven Ladungsträgern (Elektronen bzw. Löcher) in ohmschen Kontakt. In Abhängigkeit
davon werden Minoritätsträger injiziert, die zu einem Leckstrom im Ausschaltzustand führen (niedriger
Widerstand im Ausschaltzustand). Ein derartiger Leckstrom wird in einem Dünnschichttransistor vom n-Kanal-Typ dadurch
verhindert, daß eine Schicht vom η -Typ zwischen dem nichtdotierten amorphen Siliciumfilm 40 und der Source-
bzw. Drain-Elektrode 50, 60 angeordnet ist. In diesem Fall ist es allerdings notwendig, den nichtdotierten amorphen
Siliciumfilm und den amorphen Siliciumfilm vom η -Typ bereichsweise zu ätzen. Da diese beiden Filme dieselben
chemischen Eigenschaften aufweisen, müssen sie selektiv bzw. getrennt unter Einhaltung vorbestimmter Ätzzeiten
behandelt werden, um Filmteile bis auf eine erforderliche Filmdicke genau abtragen zu können. Andererseits muß die
nichtdotierte Schicht 40 von vornherein sehr dünn sein, um einen Dünnschichttransistor mit hohem Widerstand im
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Ausschaltzustand zu erhalten, so daß sie praktisch keinem Ätzvorgang mehr unterworfen werden kann. Werden daher viele
Dünnschichttransistoren in einem größeren Bereich auf einem Substrat hergestellt, beispielsweise zur Bildung einer
aktiven, matrixförmig ausgebildeten Flüssigkristall-Anzeigeeinrichtung, so müssen die Schichtdicken der jeweils
nichtdotierten Schichten 40 genau eingehalten werden. Schwankungen hinsichtlich ihrer Schicht- bzw. Filmdicke sowie Veränderungen hinsichtlich der Ätzrate sind
nicht erlaubt. Das bedeutet, daß das selektive Ätzen praktisch nicht durchgeführt werden kann.
Bei der TFT-Struktur nach Fig. 2 hat der Kontaktwiderstand Rco praktisch keinen Einfluß auf die Eigenschaften des
Dünnschichttransistors, wenn der nichtdotierte amorphe Siliciumfilm
41 dick ist. Ist er dagegen dünn, so treten Stromwege auf, wie sie in Fig. 5 durch © markiert sind,
welche die TFT-Eigenschaften beträchtlich beeinflussen. Insbesondere sind starke Fluktuationen zu verzeichnen.
Auch in diesem Fall sollte die nichtdotierte amorphe Siliciumschicht
41 dünn sein, um einen niedrigen Widerstand im Ausschaltzustand zu erhalten. Liegt eine Schicht vom
η -Typ zwischen der Metallelektrode 51 bzw. 61 und der nichtdotierten amorphen Siliciumschicht 41, um eine Injektion
von Minoritätsträgern zu verhindern, so muß auch hier ein selektiver Ätzvorgang durchgeführt werden, was
die bereits unter Fig. 1 erwähnten Schwierigkeiten nach sich zieht.
Entsprechend der in Fig. 3 dargestellten TFT-Struktur steht die nichtdotierte amorphe Siliciumschicht 42 in direktem
Kontakt mit den auf dem Gate-Isolationsfilm 32 liegenden
amorphen Siliciumfilmen 72 und 82 vom η -Typ, so
daß der Kontaktwiderstand Rco praktisch keinen Einfluß auf die TFT-Eigenschaften ausübt. Aufgrund des direkten
Kontakts zwischen dem nichtdotierten amorphen Silicium-
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film 42 und den aus Metall bestehenden Source- und Drain-Elektroden
52, 62 läßt sich jedoch eine Minoritätsträgerinjektion (in Abhängigkeit der positiven Ladungsträger
bzw. Löcher) nicht durch die amorphen Siliciumschichten 72, 82 vom η -Typ einschränken. Diese Minoritätsträgerinjektion
könnte aber durch Beseitigung der metallischen Elektrode 62 oder dadurch verhindert werden, daß die metallische
Elektrode 62 so weit abgetragen bzw. zurückgesetzt wird, daß sie nicht mehr die nichtdotierte amorphe
Siliciumschicht 42 überlappt. Im zuletzt genannten Fall wäre somit ebenfalls eine selektive bzw. getrennte Ätzung
der nichtdotierten amorphen Siliciumschicht 42 und der amorphen Siliciumschicht 82 vom η -Typ erforderlich. Allerdings
ist es auch bei der in Fig. 3 dargestellten Struktur praktisch nicht möglich, auf diese Weise einen
Dünnschicht- bzw. Dünnfilmtransistor mit den erforderlichen Eigenschaften herzustellen.
Der Erfindung liegt die Aufgabe zugrunde, einen Dünnschichttransistor
mit guten Transistoreigenschaften zu schaffen, der einen geringen Widerstand im eingeschalteten
Zustand aufgrund eines geringen Elektrodenwiderstands und einen hohen Widerstand im ausgeschalteten Zustand aufgrund
einer eingeschränkten Minoritätsträgerinjektion aufweist, und der einfach herstellbar ist.
Die Lösung der gestellten Aufgabe ist im kennzeichnenden Teil des Patentanspruchs 1 angegeben. Eine vorteilhafte
Ausgestaltung der Erfindung ist dem Unteranspruch zu entnehmen.
Der Dünnschichttransistor nach der Erfindung zeichnet sich aus durch
- eine auf einem isolierenden Substrat angeordnete Gate-Elektrode,
- einen die Gate-Elektrode bedeckenden ersten Isolations-
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film,
- einen ersten leitfähigen Halbleiterfilm auf dem ersten
Isolationsfilm,
- einen auf der gesamten oberen Fläche des ersten Halbleiterfilms angeordneten zweiten Isolationsfilm,
- zwei zweite leitfähige Halbleiterfilme, die voneinander
beabstandet sind und in Kontakt mit den jeweiligen Seitenflächen des ersten Halbleiterfilms stehen, und durch
- erste und zweite Elektroden, von denen jeweils eine auf einem der zweiten Halbleiterfilme aufgebracht ist.
Nach einer vorteilhaften Ausgestaltung der Erfindung enthält der erste leitfähige Halbleiterfilm einen nichtdotierten
amorphen Siliciumfilm oder besteht aus einem derartigen Siliciumfilm.
Bei dem Transistor nach der Erfindung fließt der Strom nur durch die Seitenflächen des ersten Halbleiterfilms
sowie durch die zweiten Halbleiterfilme. Da die Halbleiterschichten
über diese Seitenflächen mit niedrigem Widerstand in Kontakt mit dem Kanal gehalten werden, beeinflußt der
Widerstand bzw. Kontaktwiderstand der Halbleiterschichten selbst nicht den Transistorwiderstand im eingeschalteten
Zustand, so daß der Transistor in diesem Fall einen niedrigen Widerstand aufweist. Genauer gesagt fließt kein
Strom senkrecht zur größten Oberfläche des Halbleiterfilms, so daß sich die Transistoreigenschaften nicht in
Abhängigkeit der Dicke des Halbleiterfilms ändern können. Da der erste Halbleiterfilm direkt in Kontakt mit den
zweiten Halbleiterfilmen steht, durch die die Injektion von Minoritätsträgern eingeschränkt bzw. zurückgehalten wird,
tritt auch kein Leckstrom im ausgeschalteten Zustand des Transistors auf. Der Feldeffekt-Dünnschichttransistor besitzt
somit im ausgeschalteten Zustand einen hohen Widerstand.
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_8 _
Die Zeichnung stellt neben dem Stand der Technik ein Ausführungsbeispiel
der Erfindung dar. Es zeigen:
Fig. 1 bis 3 konventionelle Dünnschichttransistoren,
5
Fig. 4 einen Schnitt durch einen Dünnschichttransistor nach Fig. 1 zur Erläuterung seiner
Wirkungsweise,
Fig. 5 einen Schnitt durch einen Dünnschichttransistor nach Fig. 2 zur Erläuterung seiner
Wirkungsweise,
Fig. 6 einen Dünnschichttransistor nach der vorliegenden Erfindung und
Fig. 7(A) bis 7(C) den Dünnschichttranistor nach Fig. 6 in verschiedenen Herstellungsstufen.
Ein Feldeffekt-Dünnschicht- bzw. -Dünnfilmtransistor nach
der Erfindung ist in der Fig. 6 im Schnitt dargestellt, während die Fig. 7(A) bis 7(C) einzelne Herstellungsstufen
dieses Feldeffekt-Dünnschichttransistors zeigen. Entsprechend der Fig. 7(A) liegen auf einem isolierenden Substrat
13 eine Gate-Elektrode 23 sowie ein Gate-Isolationsfilm
33 in der angegebenen Reihenfolge aufeinander. Die Gate-Elektrode 23 besteht aus einem metallischen Film
oder aus einem Halbleiter, beispielsweise aus einem mit Ta, Ti, Mo, W, Ni oder Cr stark dotierten Polysilicium.
Der Gate-Isolationsfilm 33 besteht z. B. aus
Ta2O , Si3N4 oder aus Si0_ und ist durch anodische Oxidation,
thermische Oxidation oder durch ein CVD- bzw. Plasma-CVD-Verfahren
(chemical vapor deposition bzw. CVD-Verfahren) hergestellt. Entsprechend der Fig. 7(B) werden ein
nichtdotierter amorpher Siliciumfilm 43' als erster leitender
Halbleiterfilm und anschließend ein Si^N.-Film 93'
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mit Hilfe des Plasma-CVD-Verfahrens niedergeschlagen. Sodann
wird auf den Film 93' eine Fotoresistschicht 103 aufgebracht, und zwar nur im zentralen Bereich des Films 93',
wobei die Randbereiche der Gate-Elektrode 23 frei bleiben. Statt aus Si3N4 kann der Film 93' auch aus SiO„ bestehen
und durch ein Sputterverfahren, durch einen CVD-Prozeß
oder durch thermische Oxidation gebildet werden. Wie in Fig. 7(C) dargestellt ist, werden ein amorpher Siliciumfilm
43 und ein Si3N4-FiIm 93 unter Zuhilfenahme der Foto-
resistschicht 103 durch einen Ätzvorgang gebildet. Der Isolationsfilm 93 bedeckt somit die gesamte Oberfläche
des halbleitenden Films 43, mit Ausnahme seiner Seitenflächen. Nach Entfernung der Fotoresistschicht 103 wird
eine amorphe Siliciumschicht 73' vom η -Typ als zweiter leitender Halbleiterfilm niedergeschlagen, z. B. durch
Glühentladung. Anschließend wird auf der Schicht 73' ein Mo-Film 53' durch ein Sputterverfahren gebildet. Auf dem
Mo-Film 53' wird dann eine Fotoresistschicht 113 erzeugt. Die Fotoresistschicht 113 ist so ausgebildet, daß in einem
nachfolgenden Ätzvorgang der Mo-Film 53' und die amorphe Siliciumschicht 73' vom η -Typ im zentralen Bereich
der Gate-Elektrode nacheinander weggeätzt werden können, um auf diese Weise die amorphen Siliciumschichten 73, 83
vom η -Typ eine Source-Elektrode 53 und eine Drain-Elektrode
6 3 zu erhalten. Nach Abtrennung der restlichen Fotoresistschicht 113 liegt der in Fig. 6 dargestellte Dünnschichttransistor
vor. Die Schichten 53, 73 und 63, 83 überlappen dabei jeweils die Schicht 93.
Entsprechend der vorliegenden Erfindung wird die nichtdotierte
amorphe Siliciumschicht 43 durch den Isolationsfilm 93 während des letzten Ätzvorgangs geschützt, so daß eine
selektive Ätzung bezüglich der nichtdotierten amorphen Siliciumschicht 43 (vgl. Fig. 7(B)) und der amorphen Siliciumschicht
73' vom η -Typ vorgenommen werden kann. Da der Strom entsprechend der Fig. 5 nur in Richtung des
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Pfeils (a) fließen kann, treten Schwankungen der Transistoreigenschaften
(im Einschaltzustand) praktisch nicht mehr auf. Sie sind vernachlässigbar klein. Die aufgrund der
Gate-Spannung angeregte bzw. gebildete Laminatschicht sowie die amorphen Schichten 73, 83 vom η -Typ werden darüber
hinaus in direktem Kontakt mit der Oberfläche der nichtdotierten amorphen Siliciumschicht 43 an der Gate-Seite
gehalten. Der Kontaktwiderstand Rco im Bereich der Source- und Drain-Elektroden ist daher extrem klein, so
daß der Dünnschichttransistor einen niedrigen Widerstand im Einschaltzustand aufweist. Da andererseits die amorphen
Siliciumschichten 73, 83 vom η -Typ jeweils zwischen dem nichtdotierten amorphen Siliciumfilm 43 und einer metallischen
Elektrode 53, 63 liegen, wird die Injektion positiver Löcher eingeschränkt bzw. verhindert, so daß der
Dünnschichttransistor einen hohen Widerstand im Ausschaltzustand aufweist. Der Dünnschichttransistor zeigt daher
gegenüber den konventionellen Dünnschichttransistoren
verbesserte Schalteigenschaften, insbesondere einen höheren Widerstand im ausgeschalteten bzw. Ausschaltzustand
und einen niedrigeren Widerstand im eingeschalteten bzw. Einschaltzustand. Speziell eignet sich der Feldeffekt-Dünnschichttransistor
nach der vorliegenden Erfindung zur Adressierung von aktiven, matrixförmig ausgebildeten
Flüssigkristallanzeigeeinrichtungen mit großer Bildkapazität.
Im oben genannten Ausführungsbeispiel muß der halbleitende
Film nicht unbedingt aus amorphem Silicium bestehen.
Er kann beispielsweise auch aus polykristallinem Silicium,
einer II-VI-Halbleiterverbindung, einer III-V-Halbleiterverbindung,
einer IV-VI-Verbindung oder aus amorphem Germanium oder polykristallinem Germanium bestehen. Die
nichtdotierte amorphe Siliciumschicht kann auch durch einen leichtdotierten amorphen Siliciumfilm ersetzt sein.
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Wie bereits oben erwähnt, wird durch die vorliegende Erfindung ein Dünnschichttransistor mit geringen Schwankungen
seiner Eigenschaften im eingeschalteten Zustand erhalten, der darüber hinaus im eingeschalteten Zustand einen
geringen Widerstand und im ausgeschalteten Zustand einen hohen Widerstand aufweist. Insbesondere werden Stromschwankungen
im Einschaltzustand vermieden. Es sei darauf hingewiesen, daß ein selektiver Ätzvorgang bei der Herstellung
des Dünnschichttransistors nach der vorliegenden Erfindung nicht unbedingt erforderlich ist.
Claims (2)
- TER MEER-MÜLLE R-StEINMEISTER PATENTANWÄLTE-EUROPEAN PATENT ATTORNEYS O R Π 9 1 9 /Dipl.-Chem. Dr. N. ter Meer Dipl. Ing. H. SteinmeisterDipl. Ing. F. E. Müller Artur-Ladebeck-Strasse 51Mauerkircherstrasse 45D-8000 MÜNCHEN 8O D-4800 BIELEFELD 1ür/cb ;t2817-GER/PT-T 24. Januar 1986SHARP KABUSHIKI KAISHA22-22 Nagaike-cho Abeno-ku, Osaka 545, JapanAmorpher Silicium-DünnschichttransistorPriorität: 24. Januar 1985, Japan, Nr. 6.0-11905 (P)PatentansprücheDünnschichttransistor, gekennzeichnet durch- eine auf einem isolierenden Substrat (13) angeordnete Gate-Elektrode (23),- einen die Gate-Elektrode (23) bedeckenden ersten Isolationsfilm (33),- einen ersten leitfähigen Halbleiterfilm (43) auf dem ersten Isolationsfilm (33),- einen auf der gesamten oberen Fläche des ersten Halbleiterfilms (43) angeordneten zweiten Isolationsfilm (93),- zwei zweite leitfähige Halb! ο ι ^-3r filme (73, 83), dieTER MEER · MÜLLER ■ STEINMEISTm ' Sharp' K.K. - 2817-GERvoneinander beabstandet sind und in Kontakt mit den jeweiligen Seitenflächen des ersten Halbleiterfilms (43) stehen, und durch- erste und zweite Elektroden (53, 63), von denen jeweils eine auf einem der zweiten Halbleiterfilme (73, 83) aufgebracht ist.
- 2. Dünnschichttransistor nach Anspruch 1, dadurch gekennzeichnet, daß der erste
leitfähige Halbleiterfilm (43) einen nichtdotierten amorphen Siliciumfilm enthält.
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