DE102012211221B4 - Siliciumcarbid-Halbleitervorrichtung - Google Patents
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- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 title claims abstract description 104
- 229910010271 silicon carbide Inorganic materials 0.000 title claims abstract description 103
- 239000004065 semiconductor Substances 0.000 title claims abstract description 83
- 239000000758 substrate Substances 0.000 claims abstract description 74
- 239000012535 impurity Substances 0.000 claims abstract description 24
- 230000001154 acute effect Effects 0.000 claims abstract description 22
- 239000010410 layer Substances 0.000 description 77
- 238000005530 etching Methods 0.000 description 12
- 238000004519 manufacturing process Methods 0.000 description 7
- 230000015556 catabolic process Effects 0.000 description 4
- 238000000034 method Methods 0.000 description 4
- 238000009413 insulation Methods 0.000 description 3
- 239000011229 interlayer Substances 0.000 description 3
- 229910052751 metal Inorganic materials 0.000 description 3
- 239000002184 metal Substances 0.000 description 3
- 238000001020 plasma etching Methods 0.000 description 3
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 2
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- 238000009616 inductively coupled plasma Methods 0.000 description 2
- 229910052698 phosphorus Inorganic materials 0.000 description 2
- 239000011574 phosphorus Substances 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- 101100116570 Caenorhabditis elegans cup-2 gene Proteins 0.000 description 1
- 101100116572 Drosophila melanogaster Der-1 gene Proteins 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 230000004888 barrier function Effects 0.000 description 1
- 229910052796 boron Inorganic materials 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000018109 developmental process Effects 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 239000007943 implant Substances 0.000 description 1
- 238000011835 investigation Methods 0.000 description 1
- 238000005468 ion implantation Methods 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 150000004767 nitrides Chemical class 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/7801—DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
- H01L29/7802—Vertical DMOS transistors, i.e. VDMOS transistors
- H01L29/7813—Vertical DMOS transistors, i.e. VDMOS transistors with trench gate electrode, e.g. UMOS transistors
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/04—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their crystalline structure, e.g. polycrystalline, cubic or particular orientation of crystalline planes
- H01L29/045—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their crystalline structure, e.g. polycrystalline, cubic or particular orientation of crystalline planes by their particular orientation of crystalline planes
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/08—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/0843—Source or drain regions of field-effect devices
- H01L29/0847—Source or drain regions of field-effect devices of field-effect transistors with insulated gate
- H01L29/0852—Source or drain regions of field-effect devices of field-effect transistors with insulated gate of DMOS transistors
- H01L29/0856—Source regions
- H01L29/0865—Disposition
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/42356—Disposition, e.g. buried gate electrode
- H01L29/4236—Disposition, e.g. buried gate electrode within a trench, e.g. trench gate electrode, groove gate electrode
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- H01—ELECTRIC ELEMENTS
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66053—Multistep manufacturing processes of devices having a semiconductor body comprising crystalline silicon carbide
- H01L29/66068—Multistep manufacturing processes of devices having a semiconductor body comprising crystalline silicon carbide the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
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- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
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- H01L29/10—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/1095—Body region, i.e. base region, of DMOS transistors or IGBTs
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- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
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- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
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- H01L29/7816—Lateral DMOS transistors, i.e. LDMOS transistors
- H01L29/7825—Lateral DMOS transistors, i.e. LDMOS transistors with trench gate electrode
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- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
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Abstract
Description
- Die vorliegende Erfindung betrifft eine Siliciumcarbid-(SiC)-Halbleitervorrichtung mit einem Trench-Gate.
- Bekannt ist eine SiC-Halbleitervorrichtung mit einem Metall-Oxid-Halbleiter-Feldeffekttransistor (MOSFET) mit einer Trench-Gate-Struktur, die eine Kanaldichte erhöhen kann, so dass ein hoher Strom in der SiC-Halbleitervorrichtung fließen kann. Bei dem MOSFET aus SiC ändern sich die elektrischen Eigenschaften drastisch mit einer Ebenenrichtung einer Ebene, auf der ein Strompfad gebildet wird. Insbesondere beeinflusst ein Winkel eines Grabens, der durch Ätzen gebildet wird, eine Ebenenrichtung und die elektronischen Eigenschaften. Folglich ist ein Winkel eines Grabens in einem MOSFET mit einer Trench-Gate-Struktur von Bedeutung. In gleicher Weise ist eine Graben-Seitenwand, auf der ein Strompfad gebildet wird, vorzugsweise nahe einer (11-20)-Ebene oder einer (1-100)-Ebene, d.h. einer Ebene senkrecht zu einer (0001)-Ebene oder einer (000-1)-Ebene, wodurch eine Kanalbeweglichkeit erhöht werden kann (siehe Druckschrift
JP H09 - 199 724 A US 5 744 826 A entspricht). - Ein vertikales Ätzen mit hoher Genauigkeit ist erforderlich, damit die Graben-Seitenwand die (11-20)-Ebene oder die (1-100)-Ebene ist, wodurch eine Kanalbeweglichkeit erhöht werden kann. Bekannt ist, dass SiC für gewöhnlich durch reaktives Ionenätzen (RIE-Ätzen) oder induktiv gekoppeltes Plasmaätzen (ICP-Ätzen) unter Verwendung von SF6, Cl2, CF4 als ein Ätzgas trockengeätzt wird. In gleicher Weise wird ein Graben-Ätzen vorzugsweise vertikal von einer Wafer-Oberfläche ausgeführt.
- Da SiC jedoch eine chemisch beständige Substanz ist, ist es schwierig, SiC vertikal mit hoher Genauigkeit zu ätzen. Obgleich ein Winkel einer Graben-Seitenwand idealerweise vertikal zu der (0001)-Ebene einer Wafer-Oberfläche ist, so wie es in der
6A gezeigt ist, neigt sich eine Graben-Seitenwand tatsächlich bezüglich einer Ebene senkrecht zu der (0001)-Ebene, so wie es in der6B gezeigt ist. - Folglich ist die Graben-Seitenwand bezüglich der (11-20)-Ebene oder der (1-100)-Ebene, bei welcher die Kanalbeweglichkeit erhöht werden kann, geneigt und kann keine hohe Kanalbeweglichkeit erhalten werden. Wenn ein Neigungswinkel der Graben-Seitenwand bezüglich der (11-20)-Ebene oder der (1-100)-Ebene niedrig ist, ist eine Abnahme in der Kanalbeweglichkeit gering. Wenn der Neigungswinkel über einem vorbestimmten Wert liegt, nimmt die Kanalbeweglichkeit ab und kann eine gewünschte Kanalbeweglichkeit nicht erhalten werden.
- Weiterer relevanter Stand der Technik ist bekannt aus den Druckschriften
DE 10 2009 016 681 A1 ,DE 10 2004 058 021 A1 undUS 2011 / 0 017 998 A1 - Es ist folglich Aufgabe der vorliegenden Erfindung, eine SiC-Halbleitervorrichtung bereitzustellen, bei der eine Graben-Seitenwand nahe einer (11-20)-Ebene oder einer (1-100)-Ebene ist und eine Kanalbeweglichkeit erhöht werden kann.
- Die Lösung der Aufgabe erfolgt durch eine Siliciumcarbid-Halbleitervorrichtung mit den Merkmalen des Anspruchs 1. Vorteilhafte Weiterbildungen ergeben sich aus den Unteransprüchen.
- Eine SiC-Halbleitervorrichtung gemäß einer Ausgestaltung weist ein Halbleitersubstrat, einen Basis-Bereich, mehrere Gräben, einen Bereich ersten Leitfähigkeitstyps, eine Kontaktschicht, eine Gate-Isolierschicht, eine Gate-Elektrode, eine erste Elektrode und eine zweite Elektrode auf.
- Das Halbleitersubstrat weist ein SiC-Substrat und eine auf dem SiC-Substrat angeordnete Drift-Schicht auf. Das SiC-Substrat weist einen eines ersten Leitfähigkeitstyps und eines zweiten Leitfähigkeitstyps auf. Die Drift-Schicht ist aus Siliciumcarbid aufgebaut und weist den ersten Leitfähigkeitstyp auf. Das Halbleitersubstrat ist ein Off-Substrat, dessen Oberfläche einen Off-Winkel aufweist.
- Der Basis-Bereich ist auf der Drift-Schicht angeordnet. Der Basis-Bereich ist aus Siliciumcarbid aufgebaut und weist den zweiten Leitfähigkeitstyp auf. Die Gräben durchdringen den Basis-Bereich von einer Oberfläche des Basis-Bereichs in die Drift-Schicht. Die Gräben weisen eine Längsrichtung in einer Richtung auf und sind in einem Streifenmuster angeordnet. Jeder der Gräben weist eine erste und eine zweite Seitenwand auf, die sich in der Längsrichtung erstrecken. Der Bereich ersten Leitfähigkeitstyps ist in Kontakt mit nur der ersten Seitenwand der ersten und der zweiten Seitenwand von jedem der Gräben. Der Bereich ersten Leitfähigkeitstyps weist eine höhere Störstellenkonzentration als die Drift-Schicht auf. Die Kontaktschicht ist auf einer gegenüberliegenden Seite des Bereichs ersten Leitfähigkeitstyps von jedem der Gräben angeordnet. Die Kontaktschicht weist den zweiten Leitfähigkeitstyp und eine höhere Störstellenkonzentration als der Basis-Bereich auf. Die Gate-Isolierschicht ist in jedem der Gräben angeordnet. Die Gate-Elektrode ist in jedem der Gräben über die Gate-Isolierschicht angeordnet. Die erste Elektrode ist elektrisch mit dem Bereich ersten Leitfähigkeitstyps und der Kontaktschicht verbunden. Die zweite Elektrode ist elektrisch mit dem Siliciumcarbid-Substrat verbunden.
- Wenn eine Gate-Spannung an die Gate-Elektrode gelegt wird, wird ein Strompfad nur auf der ersten Seitenwand der ersten und der zweiten Seitenwand von jedem der Gräben gebildet und fließt ein elektrischer Strom entlang des Strompfads.
- Die Oberfläche des Halbleitersubstrats weist den Off-Winkel bezüglich einer von einer (0001)-Ebene und einer (000-1)-Ebene auf.
- Das Halbleitersubstrat weist eine Off-Richtung in einer <11-20>-Richtung auf, und die Längsrichtung der Gräben ist eine <1-100>-Richtung, die senkrecht zur Off-Richtung verläuft, oder das Halbleitersubstrat weist eine Off-Richtung in einer <1-100>-Richtung auf, und die Längsrichtung der Gräben ist eine <11-20>-Richtung, die senkrecht zur Off-Richtung verläuft.
- Die erste Seitenwand liegt in einem ersten spitzen Winkel zu einer von einer (11-20)-Ebene und einer (1-100)-Ebene, die zweite Seitenwand liegt in einem zweiten spitzen Winkel zu der einen der (11-20)-Ebene und der (1-100)-Ebene, und der erste spitze Winkel ist kleiner als der zweite spitze Winkel.
- Bei der vorstehend beschriebenen SiC-Halbleitervorrichtung wird der Strompfad nur auf der ersten Seitenwand mit einem kleineren spitzen Winkel zu einer von einer (11-20)-Ebene und einer (1-100)-Ebene als die zweite Seitenwand gebildet. Folglich kann die SiC-Halbleitervorrichtung eine hohe Kanalbeweglichkeit aufweisen.
- Weitere Vorteile der vorliegenden Erfindung werden aus der nachfolgenden detaillierten Beschreibung, die unter Bezugnahme auf die beigefügten Zeichnungen gemacht wurde, näher ersichtlich sein. In den Zeichnungen zeigt:
- Lediglich die zweite Ausführungsform nach
4 und die dritte Ausführungsform nach5 und dazu in Bezug genommene Teile betreffen den Gegenstand der vorliegenden Erfindung. Die erste Ausführungsform hingegen betrifft nicht den Gegenstand der vorliegenden Erfindung sondern dient als Beispiel allein deren Erläuterung. -
1 einer Querschnittsansicht einer SiC-Halbleitervorrichtung mit einem vertikalen MOSFET mit einer Trench-Gate-Struktur gemäß einer ersten Ausführungsform; -
2 eine Draufsicht auf einen Wafer mit der in der1 gezeigten SiC-Halbleitervorrichtung; -
3 eine Abbildung, in der Linien parallel zu einer (0001)-Ebene in einer Querschnittsansicht der SiC-Halbleitervorrichtung gezeigt sind; -
4 eine Querschnittsansicht einer SiC-Halbleitervorrichtung mit einem vertikalen MOSFET mit einer Trench-Gate-Struktur gemäß einer zweiten Ausführungsform der vorliegenden Erfindung; -
5 eine Querschnittsansicht einer SiC-Halbleitervorrichtung mit einem vertikalen MOSFET mit einer Trench-Gate-Struktur gemäß einer dritten Ausführungsform der vorliegenden Erfindung; und -
6A eine Abbildung zur Veranschaulichung eines idealen Graben-Ätzens und6B eine Abbildung zur Veranschaulichung eines tatsächlichen Graben-Ätzens. - Nachstehend werden Ausführungsformen der vorliegenden Erfindung unter Bezugnahme auf die beigefügten Zeichnungen beschrieben. In jeder der folgenden Ausführungsformen sind gleiche oder äquivalente Teile in den Zeichnungen mit den gleichen Bezugszeichen versehen.
- (Erste Ausführungsform)
- Nachstehend wird eine SiC-Halbleitervorrichtung gemäß einer ersten Ausführungsform unter Bezugnahme auf die
1 und2 beschrieben. Die SiC-Halbleitervorrichtung weist vertikale MOSFETs mit einer Trench-Gate-Struktur auf. In der1 sind nur zwei Zellen der vertikalen MOSFETs gezeigt. Es sind jedoch mehrere MOSFETs mit einer Struktur gleich den in der1 gezeigten vertikalen MOSFETs angeordnet, um benachbart zueinander angeordnet zu sein.2 zeigt eine Draufsicht eines Wafers, in dem eine Vorrichtungsstruktur der in der1 gezeigten SiC-Halbleitervorrichtung gebildet ist, und einen Zustand vor der Vereinzelung in Chips. - Die in der
1 gezeigte SiC-Halbleitervorrichtung weist ein SiC-Halbleitersubstrat1 auf. Das SiC-Halbleitersubstrat 1 ist ein Off-Substrat mit einem Off-Winkel von 4 Grad bezüglich einer (0001)-Ebene. Eine Off-Richtung des Off-Substrats verläuft, wie in2 gezeigt, parallel zu einer <11-20>-Richtung. - Das SiC-Halbleitersubstrat
1 weist, wie in1 gezeigt, auf: ein n+-leitendes SiC-Substrat2 , das ein Off-Substrat ist, und eine n--leitende Driftschicht3 , die epitaxial auf einer Oberfläche des n+-leitenden SiC-Substrats 2 gebildet ist. Das n+-leitende SiC-Substrat2 und die n--leitende Driftschicht3 weisen n-leitende Störstellen, wie beispielsweise Phosphor, auf, und eine n-leitende Störstellenkonzentration der n--leitenden Driftschicht3 ist geringer als eine n-leitende Störstellenkonzentration des n+-leitenden SiC-Substrats2 . - Das n+-leitende SiC-Substrat 2 kann eine n-leitende Störstellenkonzentration von beispielsweise 1,0 × 1019 /cm3 und eine Dicke von ungefähr 300 µm aufweisen. Die n--leitende Driftschicht
3 kann eine n-leitende Störstellenkonzentration von 3,0 × 1015 /cm3 bis 7,0 × 1015 /cm3 und eine Dicke von ungefähr 10 bis 15 µm aufweisen. Obgleich die Störstellenkonzentration der n--leitenden Driftschicht3 in einer Tiefenrichtung konstant sein kann, ändert sich die Konzentration vorzugsweise derart, dass ein Abschnitt der n--leitenden Driftschicht3 benachbart zum n+-leitenden SiC-Substrat2 eine höhere Konzentration als ein Abschnitt der n--leitenden Driftschicht3 entfernt von dem n+-leitenden SiC-Substrat2 aufweist. Die Störstellenkonzentration eines Abschnitts der n--leitenden Driftschicht3 in einem Abstand zwischen ungefähr 3 µm und ungefähr 5 µm von der Oberfläche des n+-leitenden SiC-Substrats2 kann beispielsweise um ungefähr 2,0 × 1015 /cm-3 höher als die Störstellenkonzentration des anderen Abschnitts der n--leitenden Driftschicht3 sein. Folglich können ein interner Widerstand der n--leitenden Driftschicht3 und ein Durchlasswiderstand verringert werden. - In einem Oberflächenabschnitt der n--leitenden Driftschicht
3 ist ein p-leitender Basis-Bereich4 gebildet. In einem oberen Abschnitt des p-leitenden Basis-Bereichs4 sind ein n+-leitender Source-Bereich5 und eine p+-leitende Körperschicht6 angeordnet. Der n+-leitende Source-Bereich5 kann als ein Bereich ersten Leitfähigkeitstyps dienen. Die p+-leitende Körperschicht6 kann als eine Kontaktschicht dienen. - Der p-leitende Basis-Bereich
4 und die p+-leitende Körperschicht6 weisen p-leitende Störstellen, wie beispielsweise Bor und Aluminium, auf. Der n+-leitende Source-Bereich5 weist n-leitende Störstellen, wie beispielsweise Phosphor, auf. Der p-leitende Basis-Bereich4 kann eine p-leitende Störstellenkonzentration von beispielsweise 5,0 × 1016 /cm3 bis 2,0 × 1019 /cm3 und eine Dicke von ungefähr 2,0 µm aufweisen. Der n+-leitende Source-Bereich5 kann eine n-leitende Störstellenkonzentration (Oberflächenkonzentration) von beispielsweise 1,0 × 1021 /cm3 und eine Dicke von ungefähr 0,3 µm aufweisen. Die p+-leitende Körperschicht6 kann eine p-leitende Störstellenkonzentration von beispielsweise 1,0 × 1021 /cm3 und eine Dicke von ungefähr 0,3 µm aufweisen. Der n+-leitende Source-Bereich5 ist nur auf einer Seite einer Trench-Gate-Struktur angeordnet. Die p+-leitende Körperschicht6 ist auf einer gegenüberliegenden Seite des n+-leitenden Source-Bereichs5 von der Trench-Gate-Struktur angeordnet. Auf einer Seite der Trench-Gate-Struktur, die sich von der Seite unterscheidet, auf welcher der n+-leitende Source-Bereich5 angeordnet ist, ist die p+-leitende Körperschicht6 getrennt von der Trench-Gate-Struktur angeordnet. - Mehrere Gräben
7 dringen durch den p-leitenden Basis-Bereich4 und den n+-leitenden Source-Bereich5 in die n--leitende Driftschicht3 . Jeder Graben7 kann eine Breite von beispielsweise 1,4 µm bis 2,0 µm und eine Tiefe von größer oder gleich 2,0 µm (wie beispielsweise 2,5 µm) aufweisen. Die Gräben7 erstrecken sich in einer <1-100>-Richtung, die senkrecht zur Off-Richtung verläuft, und sind zu regelmäßigen Intervallen in einem Streifenmuster angeordnet. Nachstehend wird die Richtung, in der sich die Gräben7 erstrecken, als Längsrichtung der Trench-Gate-Struktur bezeichnet. Jeder Graben7 weist eine erste Seitenwand und eine zweite Seitenwand auf, die sich in der Längsrichtung erstrecken. Bei dem in der1 gezeigten Beispiel entspricht die erste Seitenwand einer linken Seitenwand und die zweite Seitenwand einer rechten Seitenwand. - Der p-leitende Basis-Bereich
4 ist in Kontakt mit der ersten Seitenwand und der zweiten Seitenwand jedes Grabens7 . Der n+-leitende Source-Bereich5 ist in Kontakt nur mit der ersten Seitenwand von der ersten und der zweiten Seitenwand jedes Grabens7 , und der n+-leitende Source-Bereich5 ist nicht auf der zweiten Seitenwand jedes Grabens7 vorgesehen. Idealerweise sind die Seitenwände jedes Grabens7 vertikal zur Oberfläche des SiC-Halbleitersubstrats 1. Es ist jedoch schwierig, jeden Graben7 vertikal zu bilden, und tatsächlich sind die Seitenwände der Gräben7 geneigt. In der vorliegenden Ausführungsform liegt ein Winkel zwischen der ersten Seitenwand jedes Grabens7 und einer Ebene parallel zur Oberfläche des SiC-Halbleitersubstrats 1 innerhalb eines Bereichs von 82 bis 90 Grad. - Eine Oberfläche jedes Grabens
7 ist von einer Gate-Oxidschicht8 bedeckt, und jeder Graben7 ist mit einer Gate-Elektrode9 gefüllt, die auf einer Oberfläche der Gate-Oxidschicht8 gebildet und aus einem dotierten polykristallinen Silizium aufgebaut ist. Genauer gesagt, die Gate-Oxidschicht8 ist in jedem Graben7 angeordnet, und die Gate-Elektrode9 ist über die Gate-Oxidschicht8 in jedem Graben7 angeordnet. Die Gate-Oxidschicht8 wird gebildet, indem die Oberflächen der Gräben7 thermisch oxidiert werden. Eine Dicke der Gate-Oxidschicht8 beträgt ungefähr 10 nm sowohl auf den Seitenwänden als auch den Böden jedes Grabens7 . Die Trench-Gate-Struktur weist den vorstehend beschriebenen Aufbau auf. Der n+-leitende Source-Bereich5 und die p+-leitende Körperschicht6 erstrecken sich entlang der Längsrichtung der Trench-Gate-Struktur, die in einem Streifenmuster angeordnet ist. Ein Strompfad wird auf der ersten Seitenwand jedes Grabens7 gebildet, mit welcher der n+-leitende Source-Bereich5 in Kontakt ist, und ein Strompfad wird nicht auf der zweiten Seitenwand jedes Grabens7 gebildet. - Auf Oberflächen des n+-leitende n Source-Bereichs
5 und der p+-leitenden Körperschicht6 und einer Oberfläche der Gate-Elektrode9 sind eine Source-Elektrode (erste Elektrode) 11 und eine Gate-Verdrahtung (nicht gezeigt) über eine Zwischenschicht-Isolierschicht10 angeordnet. Die Source-Elektrode11 und die Gate-Verdrahtung sind aus mehreren Metallen aufgebaut, wie beispielsweise einer Doppelschicht aus Nickel und Aluminium. Wenigstens Abschnitte der Source-Elektrode11 und der Gate-Verdrahtung, die in Kontakt mit einem n-leitenden SiC sind, sind aus einem Metall aufgebaut, das einen ohmschen Kontakt zwischen sowohl der Source-Elektrode11 als auch der Gate-Verdrahtung als auch dem n-leitenden SiC herstellen kann. Das n-leitende SiC weist den n+-leitenden Source-Bereich5 und die Gate-Elektrode9 auf, wenn die Gate-Elektrode9 n-leitende Störstellen aufweist. Wenigstens Abschnitte der Source-Elektrode11 und der Gate-Verdrahtung, die in Kontakt mit einem p-leitenden SiC sind, sind aus einem Metall aufgebaut, das einen ohmschen Kontakt zwischen sowohl der Source-Elektrode11 als auch der Gate-Verdrahtung als auch dem p-leitenden SiC herstellen kann. Das p-leitende SiC weist die p+-leitende Körperschicht6 und die Gate-Elektrode9 auf, wenn die Gate-Elektrode9 p-leitende Störstellen aufweist. Die Source-Elektrode11 und die Gate-Verdrahtung sind elektrisch isoliert, indem sie auf einer Zwischenschicht-Isolierschicht10 gebildet sind. Durch Kontaktlöcher, die in der Zwischenschicht-Isolierschicht10 vorgesehen sind, ist die Source-Elektrode11 elektrisch mit dem n+-leitenden Source-Bereich5 und der p+-leitenden Körperschicht6 verbunden und ist die Gate-Verdrahtung elektrisch mit der Gate-Elektrode9 verbunden. - Auf einer Rückoberflächenseite des n+-leitenden SiC-Substrats 2 ist eine Drain-Elektrode
12 angeordnet, die elektrisch mit dem n+-leitenden SiC-Substrat 2 verbunden ist. Die Drain-Elektrode12 kann als eine zweite Elektrode dienen. Auf diese Weise ist die SiC-Halbleitervorrichtung mit dem MOSFET mit der n-Kanal-Trench-Gate-Struktur des Inversionstyps gebildet. - Bei der SiC-Halbleitervorrichtung mit dem vorstehend beschriebenen Aufbau wird dann, wenn eine Gate-Spannung an die Gate-Elektrode
9 gelegt wird, der Strompfad auf den beiden Seitenwänden jedes Grabens7 gebildet, kontaktiert jedoch ein Strompfad, der auf einer Seitenwand gebildet ist, nicht den Source-Bereich5 , so dass ein elektrischer Strom in einem anderen Strompfad fließt. Auf diese Weise wird nur die erste Seitenwand der ersten und der zweiten Seitenwand jedes Grabens7 zu einem Strompfad. Dies liegt daran, dass das SiC-Halbleitersubstrat 1 das Off-Substrat ist und Ebenenrichtungen der ersten Seitenwand und der zweiten Seitenwand jedes Grabens7 voneinander verschieden sind. Hierauf wird nachstehend unter Bezugnahme auf die3 näher eingegangen. - In der
3 sind Linien parallel zur (0001)-Ebene in einem Querschnitt der SiC-Halbleitervorrichtung gezeigt. Das SiC-Halbleitersubstrat 1 ist, wie in2 gezeigt, das Off-Substrat mit dem Off-Winkel. Da die erste Seitenwand und die zweite Seitenwand jedes Grabens7 bezüglich der Oberfläche des SiC-Halbleitersubstrats 1 geneigt sind, unterscheidet sich ein Winkel zwischen der ersten Seitenwand und der (0001)-Ebene von einem Winkel zwischen der zweiten Seitenwand und der (0001)-Ebene. - Insbesondere ist der Winkel zwischen der ersten Seitenwand jedes Grabens
7 und der (0001)-Ebene 90 Grad oder ein Winkel nahe 90 Grad, da der Off-Winkel vorhanden ist, und ist der Winkel zwischen der zweiten Seitenwand jedes Grabens7 und der (0001)-Ebene, aufgrund des Off-Winkels, ein Winkel weit entfernt von 90 Grad. Die Ebene, die senkrecht zur (0001)-Ebene verläuft, ist eine (11-20)-Ebene, auf welcher die Kanalbeweglichkeit am höchsten ist, wobei die Kanalbeweglichkeit zunimmt, wenn sich die Ebene der (11-20)-Ebene nähert. Folglich kann, auf der ersten Seitenwand jedes Grabens7 mit dem Winkel von 90 Grad oder dem Winkel nahe 90 Grad bezüglich der (0001)-Ebene, eine hohe Kanalbeweglichkeit erhalten werden. Demgegenüber kann, auf der zweiten Seitenwand jedes Grabens7 mit dem Winkel weit entfernt von 90 Grad bezüglich der (0001)-Ebene, gegebenenfalls keine hohe Kanalbeweglichkeit erhalten werden. - Folglich ist, in der vorliegenden Ausführungsform, der n+-leitende Source-Bereich
5 derart auf der ersten Seitenwand jedes Grabens7 gebildet, dass der Strompfad nur auf der ersten Seitenwand jedes Grabens7 gebildet wird. Die erste Seitenwand liegt in einem spitzen Winkel zu der (11-20)-Ebene, und die zweite Seitenwand liegt in einem zweiten spitzen Winkel zu der (11-20)-Ebene, wobei der erste spitze Winkel kleiner als der zweite spitzen Winkel ist. Genauer gesagt, die erste Seitenwand jedes Grabens7 , deren spitzer Winkel bezüglich der (11-20)-Ebene kleiner als derjenige der zweiten Seitenwand ist, wird als Strompfad festgelegt. Folglich wird der Strompfad nur auf der Seitenwand mit einer hohen Kanalbeweglichkeit gebildet und kann die hohe Kanalbeweglichkeit erhalten werden. - In Fällen, in denen der Strompfad sowohl auf der ersten Seitenwand als auch der zweiten Seitenwand jedes Grabens
7 gebildet wird, ist die Kanalbeweglichkeit zwischen der ersten Seitenwand und der zweiten Seitenwand verschieden und wird ein elektrischer Strom, der auf der ersten Seitenwand und der zweiten Seitenwand fließt, ungleichmäßig bzw. unausgewogen. In Fällen, in denen der Strompfad jedoch nur auf der ersten Seitenwand jedes Grabens7 gebildet ist, fließen kein ungleichmäßiger elektrischer Strom auf den beiden Seitenwänden jedes Grabens7 und kann die SiC-Halbleitervorrichtung stabil arbeiten. - Bei einem Fertigungsverfahren der SiC-Halbleitervorrichtung der vorliegenden Ausführungsform wird das Off-Substrat mit der Off-Richtung in der <11-20>-Richtung als das Halbleitersubstrat
1 verwendet, wird die Längsrichtung der Gräben7 als die <1-100>-Richtung festgelegt, die senkrecht zur Off-Richtung verläuft, und werden Masken zur Ionenimplantation, um den n+-leitenden Source-Bereich5 und die p+-leitende Körperschicht6 zu bilden, von den herkömmlichen Masken geändert. Der andere Teil des Fertigungsverfahrens der SiC-Halbleitervorrichtung kann einem Fertigungsverfahren einer herkömmlichen SiC-Halbleitervorrichtung gleichen. - Bei dem Fertigungsverfahren der SiC-Halbleitervorrichtung der vorliegenden Ausführungsform können die folgenden Effekte erzielt werden, da der Strompfad nur auf der ersten Seitenwand jedes Grabens
7 gebildet wird. Jeder Graben7 wird durch Trockenätzen, wie beispielsweise RIE und CIP, unter Verwendung von SF5, Cl2 und CF4 als Ätzgas gebildet, wobei es schwierig ist, jeden Graben7 durch Ätzen derart zu bilden, dass die Seitenwände jedes Grabens7 vertikal zur Oberfläche des SiC-Halbleitersubstrats 1 verlaufen. In Fällen, in denen der Strompfad jedoch nur auf einer Seitenwand jedes Grabens7 gebildet wird, so wie es in der vorliegenden Ausführungsform erfolgt, muss nur die Seitenwand, auf welcher der Strompfad gebildet wird, nahezu vertikal bezüglich der (0001)-Ebene sein. Selbst wenn die Seitenwand bezüglich einer Ebene geneigt ist, die vertikal zur Oberfläche des SiC-Halbleitersubstrats 1 verläuft, kann die Seitenwand nahezu vertikal bezüglich der (0001)-Ebene sein. - Folglich kann, ohne dass die Ätzbedingungen streng festgelegt werden, die eine Seitenwand jedes Grabens
7 , auf welcher der Strompfad gebildet wird, nahezu vertikal bezüglich der (0001)-Ebene sein, auch wenn die eine Seitenwand jedes Grabens7 nicht vertikal bezüglich der Oberfläche des SiC-Halbleitersubstrats 1 ist. Gemäß einer Untersuchung nimmt die Kanalbeweglichkeit auf der (1-100)-Ebene und der (11-20)-Ebene vertikal zur (1-100)-Ebene den höchsten Wert an, wobei die Kanalbeweglichkeit ebenso hoch ist, wenn die Seitenwand leicht geneigt ist, und eine hohe Kanalbeweglichkeit erhalten werden kann, wenn der Winkel bezüglich der (0001)-Ebene größer oder gleich 86 Grad ist. Ferner kann auch dann, wenn der Winkel der Seitenwand jedes Grabens7 bezüglich der (0001)-Ebene größer als 90 Grad ist, eine hohe Kanalbeweglichkeit erhalten werden. Da die hohe Kanalbeweglichkeit über einen breiten Winkelbereich erhalten werden kann, kann eine Prozesstoleranz beim Ätzen zum Bilden der Gräben7 erweitert werden. - Wenn der Winkel bezüglich der (0001)-Ebene, wie vorstehend beschrieben, größer oder gleich 86 Grad ist, kann eine hohe Kanalbeweglichkeit erzielt werden. In Fällen, in denen das SiC-Halbleitersubstrat 1 als das Off-Substrat verwendet wird, können die Seitenwände jedes Grabens
7 ferner um den Off-Winkel bezüglich der Oberfläche des SiC-Halbleitersubstrats 1 geneigt sein. Das SiC-Halbleitersubstrat 1 weist den Off-Winkel von 4 Grad bezüglich der (0001)-Ebene auf. Folglich kann, in der vorliegenden Ausführungsform, der Winkel zwischen der ersten Seitenwand jedes Grabens7 und einer Ebene parallel zur Oberfläche des SiC-Halbleitersubstrats 1 innerhalb eines Bereichs von 82 bis 90 Grad liegen. - (Zweite Ausführungsform)
- Nachstehend wird eine SiC-Halbleitervorrichtung gemäß einer zweiten Ausführungsform der vorliegenden Erfindung unter Bezugnahme auf die
4 beschrieben. Bei der SiC-Halbleitervorrichtung der vorliegenden Ausführungsform wird eine Verkleinerung in einer Off-Richtung bezüglich der SiC-Halbleitervorrichtung der ersten Ausführungsform ausgeführt und ist der andere Teil gleich der ersten Ausführungsform. Dementsprechend wird nur der Teil beschrieben, der sich von der ersten Ausführungsform unterscheidet. - Die SiC-Halbleitervorrichtung der vorliegenden Ausführungsform weist, wie in
4 gezeigt, einen vertikalen MOSFET mit einer Trench-Gate-Struktur auf. Bei der SiC-Halbleitervorrichtung ist die p+-leitende Körperschicht6 in Kontakt mit der zweiten Seitenwand jedes Grabens7 , auf der kein Strompfad gebildet wird. In Fällen, in denen ein Strompfad nur auf einer Seitenwand jedes Grabens7 gebildet wird, nimmt ein Durchlasswiderstand zu, da die Anzahl von Strompfaden pro Einheitsbereich gering ist, verglichen mit Fällen, in denen Strompfade auf beiden Seitenwänden gebildet werden. Die Zunahme des Durchlasswiderstands kann beschränkt werden, indem ein Abstand zwischen benachbarten Graben7 verringert wird. In Fällen, in denen die p+-leitende Körperschicht6 in Kontakt mit der zweiten Seitenwand jedes Grabens7 ist, auf welcher der Strompfad nicht gebildet wird, kann der Durchlasswiderstand weiter beschränkt werden. - In Fällen, in denen die p+-leitende Körperschicht
6 gebildet ist, um die zweite Seitenwand jedes Grabens7 zu kontaktieren, fließt ein elektrischer Strom durch die p+-leitende Körperschicht6 , wenn ein Avalanche-Durchbruch stattfindet, und kann die Gate-Oxidschicht8 an einem Kontaktabschnitt beschädigt werden. Folglich wird, um die Avalanche-Durchbruchspannung zu verbessern, die p+-leitende Körperschicht6 vorzugsweise getrennt von dem Graben7 angeordnet. - (Dritte Ausführungsform)
- Nachstehend wird eine SiC-Halbleitervorrichtung gemäß einer dritten Ausführungsform der vorliegenden Erfindung unter Bezugnahme auf die
5 beschrieben. In der vorliegenden Ausführungsform wird eine Durchbruchspannung bezüglich der SiC-Halbleitervorrichtung der zweiten Ausführungsform verbessert und ist der andere Teil gleich der zweiten Ausführungsform. Folglich wird nur der Teil beschrieben, der sich von der zweiten Ausführungsform unterscheidet. - Die SiC-Halbleitervorrichtung der vorliegenden Ausführungsform weist, wie in
5 gezeigt, einen vertikalen MOSFET mit einer Trench-Gate-Struktur auf. Auch in der vorliegenden Ausführungsform ist die p+-leitende Körperschicht6 in Kontakt mit der zweiten Seitenwand jedes Grabens7 , auf der kein Strompfad gebildet wird. Die p+-leitende Körperschicht6 erstreckt sich zu einer Position tiefer als der Boden jedes Grabens7 . Die p+-leitende Körperschicht6 weist eine Störstellenkonzentration größer der Störstellenkonzentration des p-leitenden Basis-Bereichs4 auf. In Fällen, in denen sich die p+-leitende Körperschicht6 zu der Position tiefer als der Boden jedes Grabens7 erstreckt, wird eine hohe Spannung weniger wahrscheinlich in die Gate-Oxidschicht8 eintreten, da eine Sperrschicht vorhanden ist, die sich von der p+-leitenden Körperschicht6 zu der n--leitenden Driftschicht3 erstreckt, bei einer Sperrvorspannung. Folglich kann die Konzentration des elektrischen Feldes in der Gate-Oxidschicht8 abgeschwächt und eine Beschädigung der Gate-Oxidschicht8 beschränkt werden. Dementsprechend kann die Durchbruchspannung verbessert werden. - Die SiC-Halbleitervorrichtung mit dem vertikalen MOSFET mit der vorstehend beschriebenen Struktur kann im Wesentlichen mit einem Fertigungsverfahren gleich dem Fertigungsverfahren der SiC-Halbleitervorrichtung der ersten Ausführungsform gefertigt werden. Die p+-leitende Körperschicht
6 muss jedoch bis zu einer tiefen Position gebildet werden. Da SiC sehr fest ist, ist es schwierig, die p+-leitende Körperschicht6 bis zu der tiefen Position zu bilden. Die p+-leitende Körperschicht6 kann beispielsweise wie folgt gebildet werden. Nachdem der p-leitende Basis-Bereich4 gebildet wurde und bevor die Gräben7 gebildet werden, werden Vertiefungen in Bereichen gebildet, in denen die p+-leitende Körperschicht6 zu bilden ist, und wird eine p+-leitende Schicht epitaxial gebildet, um die Vertiefungen zu füllen. Anschließend wird die p+-leitende Schicht entfernt, indem beispielsweise ein chemisch mechanisches Polieren (CMP) angewandt wird, bis der p-leitende Basis-Bereich4 freiliegt. Folglich kann die p+-leitende Körperschicht6 bis zu der tiefen Position gebildet werden. In Fällen, in denen der p-leitende Basis-Bereich4 durch Epitaxialwachstum gebildet wird, kann ein Prozess zum Implantieren von p-leitenden Störstellen in Bereichen, in denen die p+-leitende Körperschicht6 zu bilden ist, während eines Prozesses zum Bilden des p-leitenden Basis-Bereichs4 wiederholt werden, um so die p+-leitende Körperschicht6 Schritt für Schritt zu bilden. - (Weitere Ausführungsformen)
- In jeder der vorstehend beschriebenen Ausführungsformen ist das SiC-Halbleitersubstrat 1 das Off-Substrat mit dem Off-Winkel bezüglich der (0001)-Ebene. Das SiC-Halbleitersubstrat 1 kann ebenso ein Off-Substrat mit einem Off-Winkel bezüglich einer (000-1)-Ebene sein.
- In jeder der vorstehend beschriebenen Ausführungsformen ist die Off-Richtung des SiC-Halbleitersubstrats 1 die <11-20>-Richtung. Die Off-Richtung des SiC-Halbleitersubstrats 1 kann ebenso eine <1-100>-Richtung sein. In diesem Fall ist die Längsrichtung der Gräben
7 die <11-20>-Richtung, die senkrecht zur Off-Richtung verläuft, und wird eine Ebenenrichtung einer Seitenwand jedes Grabens7 , auf welcher der Strompfad gebildet wird, so festgelegt, dass sie nahe der (1-100)-Ebene ist. - In jeder der vorstehend beschriebenen Ausführungsformen weist der Off-Winkel des SiC-Halbleitersubstrats 1 einen Wert von 4 Grad auf. Der Off-Winkel des SiC-Halbleitersubstrats 1 kann innerhalb eines Bereichs von 2 bis 8 Grad geändert werden. In diesem Fall ändert sich ein Winkelbereich des Neigungswinkels der Seitenwände der Gräben
7 , innerhalb dem eine hohe Kanalbeweglichkeit erzielt werden kann, mit dem Off-Winkel. Die Prozesstoleranz des Ätzens zum Bilden der Gräben7 kann jedoch auf jeden Fall erweitert werden. - In jeder der vorstehend beschriebenen Ausführungsformen wird der n-Kanal-MOSFET, in dem ein erster Leitfähigkeitstyp der n-Leitfähigkeitstyp und ein zweiter Leitfähigkeitstyp der p-Leitfähigkeitstyp ist, als Beispiel beschrieben. Die vorliegende Erfindung kann jedoch ebenso auf einen p-Kanal-MOSFET angewandt werden, bei dem ein Leitfähigkeitstyp jeder Komponente invertiert ist. Ferner wird, in der obigen Beschreibung, der MOSFET mit der Trench-Gate-Struktur als ein Beispiel beschrieben. Die vorliegende Erfindung kann ebenso auf einen IGBT mit einer Trench-Gate-Struktur angewandt werden. In Fällen, in denen die SiC-Halbleitervorrichtung den IGBT aufweist, wird der Leitfähigkeitstyp des n+-leitenden SiC-Substrats 2 von dem n-Leitfähigkeitstyp zu dem p-Leitfähigkeitstyp geändert. Der weitere Aufbau und ein Fertigungsverfahren gleichen denjenigen der vorstehend beschriebenen Ausführungsform.
- Obgleich die Gate-Oxidschicht
8 , die durch thermische Oxidation gebildet wird, als ein Beispiel für eine Gate-Isolierschicht aufgezeigt wird, kann die Gate-Isolierschicht ebenso eine Isolierschicht sein, die sich von einer Oxidschicht unterscheidet, wie beispielsweise eine Nitridschicht. - Wenn eine Ausrichtung einer Kristallfläche beschrieben wird, muss ursprünglich ein Balken oberhalb einer gewünschten Ziffer beigefügt sein. Der Balken wird in der vorliegenden Anmeldung jedoch vor der gewünschten Ziffer beigefügt, da die elektronische Einreichung der Beschreibung Beschränkungen auferlegt.
- Vorstehend wurde eine Siliciumcarbid-Halbleitervorrichtung offenbart.
- In einer Siliciumcarbid-Halbleitervorrichtung weisen mehrere Gräben
7 eine Längsrichtung in einer Richtung auf und sind die mehreren Gräben7 in einem Streifenmuster angeordnet. Jeder der Gräben7 weist eine erste und eine zweite Seitenwand auf, die sich in der Längsrichtung erstrecken. Die erste Seitenwand liegt in einem ersten spitzen Winkel zu einer von einer (11-20)-Ebene und einer (1-100)-Ebene, und die zweite Seitenwand liegt in einem zweiten spitzen Winkel zu der einen von der (11-20)-Ebene und der (1-100)-Ebene, wobei der erste spitze Winkel kleiner als der zweite spitze Winkel ist. Ein Bereich5 ersten Leitfähigkeitstyps ist in Kontakt mit nur der ersten Seitenwand der ersten und der zweiten Seitenwand von jedem der Gräben7 , und ein Strompfad wird nur auf der ersten Seitenwand der ersten und der zweiten Seitenwand gebildet.
Claims (3)
- Siliciumcarbid-Halbleitervorrichtung mit: - einem Halbleitersubstrat (1) mit einem Siliciumcarbid-Substrat (2) und einer auf dem Siliciumcarbid-Substrat (2) angeordneten Drift-Schicht (3), wobei das Siliciumcarbid-Substrat (2) einen eines ersten Leitfähigkeitstyps oder eines zweiten Leitfähigkeitstyps aufweist, die Drift-Schicht (3) aus Siliciumcarbid aufgebaut ist und den ersten Leitfähigkeitstyp aufweist, und das Halbleitersubstrat (1) ein Off-Substrat ist, dessen Oberfläche einen Off-Winkel aufweist; - einem Basis-Bereich (4), der auf der Drift-Schicht (3) angeordnet ist, wobei der Basis-Bereich (4) aus Siliciumcarbid aufgebaut ist und den zweiten Leitfähigkeitstyp aufweist; - mehreren Gräben (7), welche den Basis-Bereich (4) von einer Oberfläche des Basis-Bereichs (4) in die Drift-Schicht (3) durchdringen, wobei die Gräben (7) eine Längsrichtung in einer Richtung aufweisen und in einem Streifenmuster angeordnet sind, wobei jeder der Gräben (7) eine erste und eine zweite Seitenwand aufweist, die sich in der Längsrichtung erstrecken; - einem Bereich (5) ersten Leitfähigkeitstyps in Kontakt mit nur der ersten Seitenwand der ersten und der zweiten Seitenwand von jedem der Gräben (7), wobei der Bereich (5) ersten Leitfähigkeitstyps eine höhere Störstellenkonzentration als die Drift-Schicht (3) aufweist; - einer Kontaktschicht (6), die auf einer gegenüberliegenden Seite des Bereichs (5) ersten Leitfähigkeitstyps von jedem der Gräben (7) angeordnet ist, wobei die Kontaktschicht (6) den zweiten Leitfähigkeitstyp und eine höhere Störstellenkonzentration als der Basis-Bereich (4) aufweist; - einer Gate-Isolierschicht (8), die in jedem der Gräben (7) angeordnet ist; - einer Gate-Elektrode (9), die in jedem der Gräben (7) über die Gate-Isolierschicht (8) angeordnet ist; - einer ersten Elektrode (11), die elektrisch mit dem Bereich (5) ersten Leitfähigkeitstyps und der Kontaktschicht (6) verbunden ist; und - einer zweiten Elektrode (12), die elektrisch mit dem Siliciumcarbid-Substrat (2) verbunden ist, wobei - dann, wenn eine Gate-Spannung an die Gate-Elektrode (9) gelegt wird, ein Strompfad nur auf der ersten Seitenwand der ersten und der zweiten Seitenwand von jedem der Gräben (7) gebildet wird und ein elektrischer Strom entlang des Strompfads fließt, - die Oberfläche des Halbleitersubstrats (1) den Off-Winkel bezüglich einer von einer (0001)-Ebene und einer (000-1)-Ebene aufweist, - das Halbleitersubstrat (1) eine Off-Richtung in einer <11-20>-Richtung aufweist und die Längsrichtung der Gräben (7) eine <1-100>-Richtung ist, die senkrecht zur Off-Richtung verläuft, oder das Halbleitersubstrat (1) eine Off-Richtung in einer <1-100>-Richtung aufweist und die Längsrichtung der Gräben (7) eine <11-20>-Richtung ist, die senkrecht zur Off-Richtung verläuft, und - die erste Seitenwand in einem ersten spitzen Winkel zu einer von einer (11-20)-Ebene und einer (1-100)-Ebene liegt, die zweite Seitenwand in einem zweiten spitzen Winkel zu der einen der (11-20)-Ebene und der (1-100)-Ebene liegt, und der erste spitze Winkel kleiner als der zweite spitze Winkel ist, und wobei die Kontaktschicht (6) in Kontakt mit der zweiten Seitenwand von jedem der Gräben (7) ist.
- Siliciumcarbid-Halbleitervorrichtung nach
Anspruch 1 , wobei die erste Seitenwand von jedem der Gräben (7) in einem Winkel innerhalb eines Bereichs von 82 Grad bis 90 Grad bezüglich der Oberfläche des Halbleitersubstrats (1) liegt. - Siliciumcarbid-Halbleitervorrichtung nach
Anspruch 1 oder2 , wobei die Kontaktschicht (6) eine Körperschicht ist, die sich zu einer Position tiefer als ein Boden von jedem der Gräben (7) erstreckt.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011144320A JP5673393B2 (ja) | 2011-06-29 | 2011-06-29 | 炭化珪素半導体装置 |
JP2011-144320 | 2011-06-29 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102012211221A1 DE102012211221A1 (de) | 2013-01-03 |
DE102012211221B4 true DE102012211221B4 (de) | 2020-07-02 |
Family
ID=47355378
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102012211221.9A Expired - Fee Related DE102012211221B4 (de) | 2011-06-29 | 2012-06-28 | Siliciumcarbid-Halbleitervorrichtung |
Country Status (4)
Country | Link |
---|---|
US (1) | US9136372B2 (de) |
JP (1) | JP5673393B2 (de) |
CN (1) | CN102856382B (de) |
DE (1) | DE102012211221B4 (de) |
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R082 | Change of representative |
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|
R082 | Change of representative |
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|
R016 | Response to examination communication | ||
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R020 | Patent grant now final | ||
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