CN104795030A - 栅极驱动电路及包括栅极驱动电路的显示装置 - Google Patents

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申暻周
蔡钟哲
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Abstract

公开了一种栅极驱动电路及包括栅极驱动电路的显示装置。栅极驱动电路包括：上拉控制部分，响应于之前级之一的进位信号，向第一节点施加之前级之一的进位信号；上拉部分，输出时钟信号作为第N栅极输出信号；进位部分，输出时钟信号作为第N进位信号；第一下拉部分，将第一节点处的信号下拉至第二断开电压；第二下拉部分，将第N栅极输出信号下拉至第一断开电压；反相部分，基于时钟信号和第二断开电压产生反相信号以将反相信号输出给反相节点；以及复位部分，向反相节点输出复位信号。

Description

栅极驱动电路及包括栅极驱动电路的显示装置
技术领域
本发明构思的示例实施例涉及一种栅极驱动电路及包括栅极驱动电路的显示装置。
背景技术
通常，液晶显示(LCD)装置包括：包括像素电极的第一基板、包括公共电极的第二基板和位于第一基板与第二基板之间的液晶层。由施加至像素电极和公共电极的电压产生电场。通过调节电场的强度，可以调节穿过液晶层的光的透射率，从而可以显示期望的图像。
通常，显示装置包括显示面板和面板驱动器。显示面板包括多条栅极线和多条数据线。面板驱动器包括向栅极线提供栅极信号的栅极驱动器和向数据线提供数据电压的数据驱动器。
当静态图像被输入时，显示面板会以低频率被驱动，以降低功耗。
栅极驱动器可以包括栅极驱动电路，栅极驱动电路包括多个开关元件。开关元件可以包括薄膜晶体管(TFT)。栅极驱动电路可以被设计为使显示面板以高频率被驱动。因此，当显示面板以低频率被驱动时，栅极驱动电路的节点中的某些节点可能具有浮置状态，这会降低栅极驱动电路的可靠性。
发明内容
本发明构思的示例实施例的方面针对一种可以降低显示装置的功耗和/或改善栅极驱动电路的可靠性的栅极驱动电路。
本发明构思的示例实施例的方面针对一种包括栅极驱动电路的显示装置。
根据本发明的示例实施例，一种栅极驱动电路包括：上拉控制部分，所述上拉控制部分被配置为向第一节点施加之前级之一的进位信号；上拉部分，所述上拉部分被配置为响应于施加到所述第一节点的信号，输出时钟信号作为第N栅极输出信号；进位部分，所述进位部分被配置为响应于施加到所述第一节点的信号，输出所述时钟信号作为第N进位信号；第一下拉部分，所述第一下拉部分被配置为响应于之后级之一的进位信号，将所述第一节点处的信号下拉至第二断开电压；第二下拉部分，所述第二下拉部分被配置为响应于所述之后级之一的进位信号，将所述第N栅极输出信号下拉至第一断开电压；反相部分，所述反相部分被配置为基于所述时钟信号和所述第二断开电压产生反相信号以将所述反相信号输出给反相节点；以及复位部分，所述复位部分被配置为向所述反相节点输出复位信号，其中N是正整数。
当输入图像数据表示视频图像时，所述复位信号可以具有低电平；并且当所述输入图像数据表示静态图像时，所述复位信号可以周期性地从所述低电平升高至高电平。
所述复位信号可以被共同施加到所述栅极驱动电路的所有级。
当所述输入图像数据表示所述视频图像时，显示面板可以具有第一驱动频率；当所述输入图像数据表示所述静态图像时，所述显示面板具有小于所述第一驱动频率的第二驱动频率，并且所述复位信号的频率等于或者大于所述第二驱动频率且等于或者小于所述第一驱动频率。
所述复位部分可以包括复位晶体管，并且所述复位晶体管可以包括共同联接至被施加以所述复位信号的复位端子的控制电极和输入电极以及联接至所述反相节点的输出电极。
所述栅极驱动电路可以进一步包括第一保持部分，所述第一保持部分被配置为响应于被施加到所述反相节点的所述反相信号以及所述复位信号，将所述第一节点处的信号下拉至所述第二断开电压，所述第一保持部分可以包括相互串联的第一保持晶体管和第二保持晶体管，所述第一保持晶体管可以包括联接至所述反相节点的控制电极、联接至所述第一节点的输入电极以及联接至所述第二保持晶体管的输入电极的输出电极，并且所述第二保持晶体管可以包括联接至所述反相节点的控制电极、联接至所述第一保持晶体管的输出电极的输入电极以及被施加以所述第二断开电压的输出电极。
所述栅极驱动电路可以进一步包括第二保持部分，所述第二保持部分被配置为响应于所述反相信号和所述复位信号，将所述第N栅极输出信号下拉至所述第一断开电压，所述第二保持部分可以包括第三保持晶体管，并且所述第三保持晶体管可以包括联接至所述反相节点的控制电极、联接至输出所述第N栅极输出信号的端子的输入电极以及被施加以所述第一断开电压的输出电极。
所述栅极驱动电路可以进一步包括第三保持部分，所述第三保持部分被配置为响应于所述反相信号和所述复位信号，将所述第N进位信号下拉至所述第二断开电压；所述第三保持部分可以包括第四保持晶体管，并且所述第四保持晶体管可以包括联接至所述反相节点的控制电极、联接至输出所述第N进位信号的端子的输入电极以及被施加以所述第二断开电压的输出电极。
所述反相部分可以包括：相互串联的第一反相晶体管和第三反相晶体管，以及相互串联的第二反相晶体管和第四反相晶体管。
所述第一反相晶体管可以包括共同被施加以所述时钟信号的控制电极和输入电极以及联接至第四节点的输出电极；所述第二反相晶体管可以包括联接至所述第四节点的控制电极，被施加以所述时钟信号的输入电极以及联接至所述反相节点的输出电极；所述第三反相晶体管可以包括联接至输出所述第N进位信号的端子的控制电极、联接至所述第四节点的输入电极以及被施加以所述第二断开电压的输出电极；并且所述第四反相晶体管可以包括联接至输出所述第N进位信号的端子的控制电极、联接至所述反相节点的输入电极以及被施加以所述第二断开电压的输出电极。
所述反相信号在所述时钟信号具有高电平时可以具有高电平，所述反相信号在所述时钟信号具有低电平时可以具有低电平，并且所述反相信号在所述第N进位信号具有高电平时可以具有所述低电平。
所述栅极驱动电路可以进一步包括进位下拉部分，所述进位下拉部分被配置为响应于之后级之一的进位信号，将所述第N进位信号下拉至所述第二断开电压。
根据本发明的示例实施例，一种栅极驱动电路可以包括上拉控制部分，所述上拉控制部分被配置为向第一节点施加之前级之一的进位信号；上拉部分，所述上拉部分被配置为响应于施加到所述第一节点的信号，输出时钟信号作为第N栅极输出信号；进位部分，所述进位部分被配置为响应于施加到所述第一节点的信号，输出所述时钟信号作为第N进位信号；第一下拉部分，所述第一下拉部分被配置为响应于之后级之一的进位信号，将所述第一节点处的信号下拉至第二断开电压；第二下拉部分，所述第二下拉部分被配置为响应于所述之后级之一的进位信号，将所述第N栅极输出信号下拉至第一断开电压；反相部分，所述反相部分被配置为基于所述时钟信号和所述第二断开电压产生反相信号以将所述反相信号输出给反相节点；其中当所述输入图像数据表示视频图像时，所述时钟信号在高电平和低电平之间摆动，其中当所述输入图像数据表示静态图像时，所述时钟信号针对扫描时段在所述高电平和所述低电平之间摆动，并且所述时钟信号针对非扫描时段维持第一低电平且周期性地从所述第一低电平降低至第二低电平，并且其中N为正整数。
所述第一低电平可以为所述第一断开电压，且所述第二低电平可以为所述第二断开电压。
所述第一低电平可以为所述第二断开电压，且所述第二低电平可以为小于所述第二断开电压的第三断开电压。
当所述输入图像数据表示所述视频图像时，显示面板可以具有第一频率的驱动频率；当所述输入图像数据表示所述静态图像时，所述显示面板可以具有小于所述第一频率的第二频率的驱动频率，并且在所述非扫描时段所述时钟信号降低至所述第二低电平的频率可以等于或者大于所述第二频率并且等于或者小于所述第一频率。
根据本发明的示例实施例，一种显示装置包括：显示面板，所述显示面板被配置为显示图像；数据驱动电路，所述数据驱动电路被配置为向所述显示面板施加数据电压；以及栅极驱动电路，所述栅极驱动电路被配置为向所述显示面板施加栅极输出信号，所述栅极驱动电路包括：上拉控制部分，所述上拉控制部分被配置为向第一节点施加之前级之一的进位信号；上拉部分，所述上拉部分被配置为响应于施加到所述第一节点的信号，输出时钟信号作为第N栅极输出信号；进位部分，所述进位部分被配置为响应于施加到所述第一节点的信号，输出所述时钟信号作为第N进位信号；第一下拉部分，所述第一下拉部分被配置为响应于之后级之一的进位信号，将所述第一节点处的信号下拉至第二断开电压；第二下拉部分，所述第二下拉部分被配置为响应于所述之后级之一的进位信号，将所述第N栅极输出信号下拉至第一断开电压；反相部分，所述反相部分被配置为基于所述时钟信号和所述第二断开电压产生反相信号以将所述反相信号输出给反相节点；以及复位部分，所述复位部分被配置为向所述反相节点输出复位信号，其中N是正整数。
当输入图像数据表示视频图像时，所述复位信号可以具有低电平，并且当所述输入图像数据表示静态图像时，所述复位信号可以周期性地从所述低电平升高至高电平。
所述复位信号可以被共同施加到所述栅极驱动电路的所有级。
所述复位部分可以包括复位晶体管，并且所述复位晶体管可以包括共同联接至被施加以所述复位信号的复位端子的控制电极和输入电极以及联接至所述反相节点的输出电极。
根据具有所述栅极驱动电路和包括所述栅极驱动电路的显示装置的示例实施例，当输入图像数据表示静态图像时，显示面板可以以低频率被驱动以降低显示装置的功耗。另外，当所述显示面板以低频率被驱动时，可以防止或基本上防止所述栅极驱动电路的节点具有浮置状态，这可以改善栅极驱动电路的可靠性。
附图说明
通过参考附图更详细地描述本发明构思的示例实施例，本发明构思的上述和其他特征和方面将变得更显而易见，附图中：
图1是示出根据本发明构思的示例实施例的显示装置的框图；
图2是示出图1的栅极驱动器的第N级的等效电路图；
图3是示出图2的栅极驱动器的第N级的输入信号、节点信号以及输出信号的波形图；
图4是示出当输入图像数据表示静态图像时驱动图1的显示面板的方法的概念图；
图5是示出当输入图像数据表示静态图像时图2的栅极驱动器的第N级的输入信号、节点信号以及输出信号的波形图；
图6是示出根据本发明构思的示例实施例的栅极驱动器的第N级的等效电路图；
图7是示出当输入图像数据表示静态图像时图6的栅极驱动器的第N级的输入信号、节点信号以及输出信号的波形图；并且
图8是示出当输入图像数据表示静态图像时根据本发明构思的示例实施例的栅极驱动器的第N级的输入信号、节点信号和输出信号的波形图。
具体实施方式
下文将参考附图对本发明构思进行更加详细的解释。
图1是示出根据本发明构思的示例实施例的显示装置的框图。
参照图1，显示装置包括显示面板100和面板驱动器。面板驱动器包括时序控制器200、栅极驱动器300、伽马参考电压发生器400以及数据驱动器500。
显示面板100具有显示图像的显示区域以及与显示区域相邻的周围区域。
显示面板100包括多条栅极线GL、多条数据线DL以及联接至栅极线GL和数据线DL的多个单元像素。栅极线GL沿第一方向D1延伸，并且数据线DL沿与第一方向D1交叉的第二方向D2延伸(例如，第二方向D2垂直于或者基本上垂直于第一方向D1)。
每个单元像素包括开关元件、液晶电容器和存储电容器。液晶电容器和存储电容器电联接至开关元件。单元像素被布置成矩阵形式。
时序控制器200从外部装置接收输入图像数据RGB以及输入控制信号CONT。输入图像数据可以包括红色图像数据R、绿色图像数据G和蓝色图像数据B。输入控制信号CONT可以包括主时钟信号和数据使能信号。输入控制信号CONT可以包括垂直同步信号和水平同步信号。
时序控制器200基于输入图像数据RGB和输入控制信号CONT产生第一控制信号CONT1、第二控制信号CONT2、第三控制信号CONT3和数据信号DATA。
时序控制器200基于输入控制信号CONT产生用于控制栅极驱动器300的操作的第一控制信号CONT1，并向栅极驱动器300输出第一控制信号CONT1。第一控制信号CONT1可以进一步包括垂直起始信号和栅极时钟信号。
时序控制器200基于输入控制信号CONT产生用于控制数据驱动器500的操作的第二控制信号CONT2，并向数据驱动器500输出第二控制信号CONT2。第二控制信号CONT2可以包括水平起始信号和负载信号。
时序控制器200基于输入图像数据RGB产生数据信号DATA。时序控制器200向数据驱动器500输出数据信号DATA。
时序控制器200基于输入控制信号CONT产生用于控制伽马参考电压发生器400的操作的第三控制信号CONT3，并向伽马参考电压发生器400输出第三控制信号CONT3。
时序控制器200可以确定输入图像数据RGB是表示静态图像还是视频图像。
当输入图像数据RGB表示视频(或者非静态)图像时，时序控制器200将驱动频率设置为第一频率。当输入图像数据RGB表示静态图像时，时序控制器200将驱动频率设置为第二频率。第二频率可以小于第一频率。例如，第一频率可以为约60赫兹(Hz)。例如，第二频率可以为约1Hz。
栅极驱动器300响应于从时序控制器200接收的第一控制信号CONT1，产生用于驱动栅极线GL的栅极信号。栅极驱动器300向栅极线GL依次输出栅极信号。
栅极驱动器300可以直接安装在显示面板100上，或者可以作为带载封装(TCP)配置联接至显示面板100。可替代地，栅极驱动器300可以被集成到显示面板100上。
参照图2更详细地解释栅极驱动器300的结构。
伽马参考电压发生器400响应于从时序控制器200接收的第三控制信号CONT3，产生伽马参考电压VGREF。伽马参考电压发生器400将伽马参考电压VGREF提供给数据驱动器500。伽马参考电压VGREF具有与数据信号DATA的电平对应的值。
在示例实施例中，伽马参考电压发生器400可以位于时序控制器200中，或者位于数据驱动器500中。
数据驱动器500从时序控制器200接收第二控制信号CONT2和数据信号DATA，并从伽马参考电压发生器400接收伽马参考电压VGREF。数据驱动器500使用(或者利用)伽马参考电压VGREF，将数据信号DATA转换为具有模拟形式的数据电压。数据驱动器500将数据电压输出到数据线DL。
数据驱动器500可以安装(例如直接安装)在显示面板100上，或者可以以带载封装(TCP)配置联接至显示面板100。可替代地，数据驱动器500可以被集成到显示面板100上。
图2是示出图1的栅极驱动器300的第N级的等效电路图。图3是示出图2的栅极驱动器300的第N级的输入信号、节点信号以及输出信号的波形图。
参照图1至图3，栅极驱动器300接收第一时钟信号CK、第二时钟信号CKB、第一断开电压VSS1、第二断开电压VSS2和复位信号RST。栅极驱动器300输出栅极输出信号GOUT。
第一时钟信号CK和第二时钟信号CKB被施加于时钟端子。第一断开电压VSS1被施加于第一断开端子。第二断开电压VSS2被施加于第二断开端子。复位信号RST被施加于复位端子。栅极输出信号GOUT从栅极输出端子输出。
第一时钟信号CK是具有彼此交替的高电平和低电平的方波。第一时钟信号CK的高电平可以对应于栅极导通电压。第一时钟信号CK的低电平可以对应于第二断开电压VSS2。第一时钟信号CK的占空比可以为50％。可替代地，第一时钟信号CK的占空比可以小于50％。第一时钟信号CK可以被施加于栅极驱动器300的奇数级或者栅极驱动器300的偶数级。例如，栅极导通电压可以介于约15V至约20V之间。
第二时钟信号CKB是具有彼此交替的高电平和低电平的方波。第二时钟信号CKB的高电平可以对应于栅极导通电压。第二时钟信号CKB的低电平可以对应于第二断开电压VSS2。第二时钟信号CKB的占空比可以为50％。可替代地，第二时钟信号CKB的占空比可以小于50％。第二时钟信号CKB可以被施加于栅极驱动器300的奇数级或者栅极驱动器300的偶数级。例如，当第一时钟信号CK被施加于栅极驱动器300的奇数级时，第二时钟信号CKB被施加于栅极驱动器300的偶数级。例如，当第一时钟信号CK被施加于栅极驱动器300的偶数级时，第二时钟信号CKB被施加于栅极驱动器300的奇数级。例如，第二时钟信号CKB可以是第一时钟信号CK的反相信号。
第一断开电压VSS1可以是直流(DC)信号。第二断开电压VSS2可以是DC信号。第二断开电压VSS2可以具有比第一断开电压VSS1的电平低的电平。例如，第一断开电压VSS1可以是大约-5V。例如，第二断开电压VSS2可以是大约-10V。
第N级响应于第N-1级的第N-1进位信号，输出第N栅极输出信号GOUT(N)和第N进位信号CR(N)，第N-1级是第N级的之前级。第N级响应于第N+1级的第N+1进位信号CR(N+1)，将第N栅极输出信号GOUT(N)下拉至第一断开电压VSS1，第N+1级是第N级的后一级。此处，N是自然数。
以相似的方式，第一级至最后一级依次输出栅极输出信号GOUT。
第N-1进位信号CR(N-1)被施加于第N-1进位端子。第N+1进位信号CR(N+1)被施加于第N+1进位端子。第N进位信号CR(N)从第N进位端子输出。
第N级包括上拉控制部分(例如，上拉控制器或者上拉控制器件)310、充电部分(或者充电器件)320、上拉部分(或者上拉器件)330、进位部分(或者进位器件)340、反相部分(例如反相器或者反相器件)350、第一下拉部分(或者第一下拉器件)361、第二下拉部分(或者第二下拉器件)362、进位下拉部分(或者进位下拉器件)370、第一保持部分(或者第一保持器件)381、第二保持部分(或者第二保持器件)382、第三保持部分(或者第三保持器件)383以及复位部分(或者复位器件)390。
上拉控制部分310包括第四晶体管T4。第四晶体管T4包括共同联接至第N-1进位端子的控制电极和输入电极以及联接至第一节点Q1的输出电极。第一节点Q1被联接至上拉部分330的控制电极。
充电部分320包括充电电容器C1。充电电容器C1包括联接至第一节点Q1的第一电极和联接至栅极输出端子的第二电极。
上拉部分330响应于施加到第一节点Q1的信号，输出第一时钟信号CK作为第N栅极输出信号GOUT(N)。
上拉部分330包括第一晶体管T1。第一晶体管T1包括联接至第一节点Q1的控制电极、联接至时钟端子的输入电极以及联接至栅极输出端子的输出电极。
例如，第一晶体管T1的控制电极可以是栅电极。第一晶体管T1的输入电极可以是源电极。第一晶体管T1的输出电极可以是漏电极。
进位部分340响应于施加到第一节点Q1的信号，输出第一时钟信号CK作为第N进位信号CR(N)。
进位部分340包括第十五晶体管T15。第十五晶体管T15包括联接至第一节点Q1的控制电极、联接至时钟端子的输入电极以及联接至第N进位端子的输出电极。
例如，第十五晶体管T15的控制电极可以是栅电极。第十五晶体管T15的输入电极可以是源电极。第十五晶体管T15的输出电极可以是漏电极。
反相部分350基于第一时钟信号CK和第二断开电压VSS2产生反相信号，并将反相信号输出到第三节点Q3。第三节点Q3被称作反相节点。
反相部分350包括第十二晶体管T12、第七晶体管T7、第十三晶体管T13以及第八晶体管T8。第十二晶体管T12和第十三晶体管T13相互串联。第七晶体管T7和第八晶体管T8相互串联。
第十二晶体管T12包括共同联接至时钟端子的控制电极和输入电极以及联接至第四节点Q4的输出电极。第七晶体管T7包括联接至第四节点Q4的控制电极、联接至时钟端子的输入电极以及联接至第三节点Q3的输出电极。第十三晶体管T13包括联接至第N进位端子的控制电极、联接至第四节点Q4的输入电极以及联接至第二断开端子的输出电极。第八晶体管T8包括联接至第N进位端子的控制电极、联接至第三节点Q3的输入电极以及联接至第二断开端子的输出电极。
例如，第十二晶体管T12、第七晶体管T7、第十三晶体管T13以及第八晶体管T8的控制电极可以是栅电极。第十二晶体管T12、第七晶体管T7、第十三晶体管T13以及第八晶体管T8的输入电极可以是源电极。第十二晶体管T12、第七晶体管T7、第十三晶体管T13以及第八晶体管T8的输出电极可以是漏电极。
例如，第十二晶体管T12可以是包括位于漏电极和源电极之间的浮置金属的场弛豫晶体管(FRT)。
此处，第十二晶体管T12是第一反相晶体管。第七晶体管T7是第二反相晶体管。第十三晶体管T13是第三反相晶体管。第八晶体管T8是第四反相晶体管。
第一下拉部分361响应于第N+1进位信号CR(N+1)，将第一节点Q1处的电压下拉至第二断开电压VSS2。
第一下拉部分361可以包括相互串联的多个开关元件。例如，第一下拉部分361可以包括相互串联的两个晶体管。
例如，第一下拉部分361包括第九晶体管T9和“9-1”晶体管T9-1。第九晶体管T9包括联接至第N+1进位端子的控制电极、联接至第一节点Q1的输入电极以及联接至第二节点Q2的输出电极。9-1晶体管T9-1包括联接至第N+1进位端子的控制电极、联接至第二节点Q2的输入电极以及联接至第二断开端子的输出电极。
例如，第九晶体管T9和9-1晶体管T9-1的控制电极可以是栅电极。第九晶体管T9和9-1晶体管T9-1的输入电极可以是源电极。第九晶体管T9和9-1晶体管T9-1的输出电极可以是漏电极。
第一下拉部分361包括相互串联的晶体管，使得第一节点Q1处的电压和第二断开电压VSS2可以被分配到第九晶体管T9和9-1晶体管T9-1。因此，可以改善栅极驱动器300的可靠性，并且可以增加栅极驱动器300的寿命。
此处，第九晶体管T9是第一下拉晶体管。9-1晶体管T9-1是第二下拉晶体管。
第二下拉部分362响应于第N+1进位信号CR(N+1)，将第N栅极输出信号GOUT(N)下拉至第一断开电压VSS1。
第二下拉部分362包括第二晶体管T2。第二晶体管T2包括联接至第N+1进位端子的控制电极、联接至栅极输出端子的输入电极以及联接至第一断开端子的输出电极。
例如，第二晶体管T2的控制电极可以是栅电极。第二晶体管T2的输入电极可以是源电极。第二晶体管T2的输出电极可以是漏电极。
进位下拉部分370响应于第N+1进位信号CR(N+1)，将第N进位信号CR(N)下拉至第二断开电压VSS2。
进位下拉部分370包括第十七晶体管T17。第十七晶体管T17包括联接至第N+1进位端子的控制电极、联接至第N进位端子的输入电极以及联接至第二断开端子的输出电极。
例如，第十七晶体管T17的控制电极可以是栅电极。第十七晶体管T17的输入电极可以是源电极。第十七晶体管T17的输出电极可以是漏电极。
另外，进位下拉部分370减小了由于通过第N+1级的第四晶体管T4传输的漏电流而导致的噪声。
第一保持部分381响应于施加到第三节点Q3的反相信号和复位信号，将第一节点Q1处的电压下拉至第二断开电压VSS2。
第一保持部分381可以包括相互串联的多个开关元件。例如，第一保持部分381可以包括相互串联的两个晶体管。
例如，第一保持部分381包括第十晶体管T10和“10-1”晶体管T10-1。第十晶体管T10包括联接至第三节点Q3的控制电极、联接至第一节点Q1的输入电极以及联接至10-1晶体管T10-1的输入电极的输出电极。10-1晶体管T10-1包括联接至第三节点Q3的控制电极、联接至第十晶体管T10的输出电极的输入电极以及联接至第二断开端子的输出电极。
例如，第十晶体管T10和10-1晶体管T10-1的控制电极可以是栅电极。第十晶体管T10和10-1晶体管T10-1的输入电极可以是源电极。第十晶体管T10和10-1晶体管T10-1的输出电极可以是漏电极。
第一保持部分381包括多个晶体管，使得第一节点Q1处的电压和第二断开电压VSS2可以被分配到第十晶体管T10和10-1晶体管T10-1(或者被第十晶体管T10和10-1晶体管T10-1分开)。因此，改善了栅极驱动器300的可靠性，并且可以增加栅极驱动器300的寿命。
此处，第十晶体管T10是第一保持晶体管。10-1晶体管T10-1是第二保持晶体管。
第二保持部分382响应于施加到第三节点Q3的反相信号以及复位信号RST，将第N栅极输出信号GOUT(N)下拉至第一断开电压VSS1。
第二保持部分382包括第三晶体管T3。第三晶体管T3包括联接至第三节点Q3的控制电极、联接至栅极输出端子的输入电极以及联接至第一断开端子的输出电极。
例如，第三晶体管T3的控制电极可以是栅电极。第三晶体管T3的输入电极可以是源电极。第三晶体管T3的输出电极可以是漏电极。
此处，第三晶体管T3是第三保持晶体管。
第三保持部分383响应于施加到第三节点Q3的反相信号以及复位信号RST，将第N进位信号CR(N)下拉至第二断开电压VSS2。
第三保持部分383包括第十一晶体管T11。第十一晶体管T11包括联接至第三节点Q3的控制电极、联接至第N进位端子的输入电极以及联接至第二断开端子的输出电极。
例如，第十一晶体管T11的控制电极可以是栅电极。第十一晶体管T11的输入电极可以是源电极。第十一晶体管T11的输出电极可以是漏电极。
此处，第十一晶体管T11是第四保持晶体管。
复位部分390响应于复位信号RST，将复位信号RST输出给反相节点。
复位部分390包括第十八晶体管T18。第十八晶体管T18包括共同联接至复位端子的控制电极和输入电极以及联接至第三节点Q3的输出电极。
例如，第十八晶体管T18的控制电极可以是栅电极。第十八晶体管T18的输入电极可以是源电极。第十八晶体管T18的输出电极可以是漏电极。
此处，第十八晶体管T18是复位晶体管。
在本示例实施例中，虽然第N-1进位信号被用作之前的进位信号，但是之前的进位信号并不限于第N-1进位信号。之前的进位信号可以是之前级之一的进位信号。另外，虽然第N+1进位信号被用作之后的进位信号，但是之后的进位信号并不限于第N+1进位信号。之后的进位信号可以是之后级之一的进位信号。
在本示例实施例中，第一晶体管、第二晶体管、第三晶体管、第四晶体管、第七晶体管、第八晶体管、第九晶体管、9-1晶体管、第十晶体管、10-1晶体管、第十一晶体管、第十二晶体管、第十三晶体管、第十五晶体管、第十七晶体管以及第十八晶体管可以是氧化物半导体晶体管。氧化物半导体晶体管的半导体层可以包括氧化物半导体。例如，半导体层可以包括氧化锌、氧化锡、镓铟锌(Ga-In-Zn)氧化物、铟锌(In-Zn)氧化物、铟锡(In-Sn)氧化物、铟锡锌(In-Sn-Zn)氧物化等中的至少一种。半导体层可以包括掺杂了金属(和/或导电材料)(诸如铝(Al)、镍(Ni)、铜(Cu)、钽(Ta)、钼(Mo)、铪(Hf)、钛(Ti)、铌(Nb)、铬(Cr)或者钨(W))的氧化物半导体。本发明并不限于氧化物半导体的材料。
可替代地，第一晶体管、第二晶体管、第三晶体管、第四晶体管、第七晶体管、第八晶体管、第九晶体管、9-1晶体管、第十晶体管、10-1晶体管、第十一晶体管、第十二晶体管、第十三晶体管、第十五晶体管、第十七晶体管以及第十八晶体管可以是非晶硅晶体管。
参照图3，第一时钟信号CK具有对应于第N-2级、第N级、第N+2级和第N+4级的高电平。第二时钟信号CKB具有对应于第N-1级、第N+1级和第N+3级的高电平。
第N-1进位信号CR(N-1)具有对应于第N-1级的高电平。第N+1进位信号CR(N+1)具有对应于第N+1级的高电平。
第N级的栅极输出信号GOUT(N)与第一时钟信号CK同步，并且具有对应于第N级的高电平。第N进位信号CR(N)与第一时钟信号CK同步，并且具有对应于第N级的高电平。
第N级第一节点Q1处的电压被上拉控制部分310拉高至对应于第N-1级的第一电平。第N级第一节点Q1处的电压被上拉部分330和充电部分320拉高至对应于第N级的第二电平，第二电平高于第一电平。第N级第一节点Q1处的电压对应于第N+1级被第一下拉部分361拉低。
第N级第二节点Q2处的电压通过上拉部分330具有对应于第N级的高电平，并且对应于第N+1级被第一下拉部分361拉低。
第N级第三节点Q3处的电压与第一时钟信号CK同步。第N级第三节点Q3的电压通过反相部分350具有对应于第N-2级、第N+2级和第N+4级的高电平。除了栅极输出信号GOUT具有高电平的第N级之外，第N级第三节点Q3的电压具有高电平。第三节点Q3的电压可以是反相信号。
图4是示出当输入图像数据表示静态图像时驱动图1的显示面板100的方法的概念图。图5是示出当输入图像数据表示静态图像时图2的栅极驱动器300的第N级的输入信号、节点信号以及输出信号的波形图。
参照图1至图5，时序控制器200确定输入图像数据RGB是表示静态图像还是视频图像。
当输入图像数据RGB表示视频图像时，时序控制器200将显示面板100的驱动频率设置为第一频率。当输入图像数据RGB表示静态图像时，时序控制器200将显示面板100的驱动频率设置为第二频率。第二频率低于第一频率。
当显示面板100以高频率被驱动时，时钟信号CK和CKB在高电平和低电平之间摆动，并且栅极驱动器300重复扫描操作。
时钟信号CK和CKB的高电平可以是栅极导通电压VON。时钟信号CK和CKB的低电平可以是第二断开电压VSS2。
例如，当显示面板100的驱动频率为大约60Hz时，栅极驱动器300基于时钟信号CK和CKB重复地产生对应于栅极线GL的栅极输出信号GOUT，并且栅极驱动器300在每秒期间运行大约六十次扫描操作。
比较而言，当显示面板100以低频率被驱动时，栅极驱动器300针对短的扫描时段ST运行扫描操作，并针对长的非扫描时段NST停止扫描。
例如，当显示面板100的驱动频率为约1Hz时，栅极驱动器300使用(或者利用)在高电平和低电平之间摆动的时钟信号CK和CKB针对约1/60秒的扫描时段ST运行一次扫描操作。
时钟信号CK和CKB针对约59/60秒的非扫描时段NST维持设置或者预定的低电平。因此，针对非扫描时段NST，显示装置的功耗可以被降低。
然而，在非扫描时段NST，栅极驱动器300不产生栅极输出信号GOUT和进位信号CR。从栅极驱动器300的第N级的角度看，第N+1进位信号不产生，从而使响应于第N+1进位信号被下拉的节点不被下拉。例如，第N级第一节点处的电压Q1(N)不会被第一下拉部分361下拉。例如，第N级的栅极输出信号GOUT(N)不会被第二下拉部分362下拉。例如，第N级的进位信号CR(N)不会被进位下拉部分370下拉。
由于浮置节点，栅极输出信号GOUT(N)的电平逐渐增高。因此，显示面板100的像素中的开关元件会被稍稍接通，从而使电流从像素电极泄露到数据线DL。因此，栅极驱动器300的可靠性会被降低，并且显示面板100的显示质量会劣化。
当输入图像数据RGB表示视频图像时，复位信号RST稳定地具有低电平。因此，当输入图像数据RGB表示视频图像时，复位部分390不操作。
当输入图像数据RGB表示静态图像时，复位信号RST周期性地从低电平升高到高电平。当复位信号RST升高到高电平时，复位部分390的复位晶体管被接通，从而使具有高电平的复位信号RST被施加到反相节点Q3。
当具有高电平的复位信号RST被施加到反相节点Q3时，第一保持部分381、第二保持部分382以及第三保持部分383的保持晶体管T10、T10-1、T3和T11被接通。
当第一保持部分381的第一保持晶体管T10和第二保持晶体管T10-1被接通时，第一节点处的电压Q1(N)被下拉至第二断开电压VSS2。
当第二保持部分382的第三保持晶体管T3被接通时，栅极输出信号GOUT(N)被下拉至第一断开电压VSS1。
当第三保持部分383的第四保持晶体管T11被接通时，进位信号CR(N)被下拉至第二断开电压VSS2。
复位信号RST可以被共同地施加到栅极驱动器的所有级。
当显示面板100具有与表示视频图像的输入图像数据RGB相对应的第一频率的驱动频率以及与表示静态图像的输入图像数据RGB相对应的第二频率的驱动频率时，复位信号RST的频率可以等于或者大于第二频率且等于或者小于第一频率。例如，当第一频率为大约60Hz且第二频率为大约1Hz时，复位信号RST的频率可以被确定为位于约1Hz至约60Hz之间。当复位信号RST具有大约2Hz的频率时，复位信号RST在一秒钟内对应于非扫描时段NST可以具有两个高电平的脉冲。当复位信号RST具有大约10Hz的频率时，复位信号RST在一秒钟内对应于非扫描时段NST可以具有十个高电平的脉冲。
根据本示例实施例，当输入图像数据RGB表示静态图像时，显示面板100以低频率被驱动，从而可以降低显示装置的功耗。当显示面板100以低频率被驱动时，栅极驱动器300使用(或者利用)复位信号RST周期性地下拉栅极输出信号GOUT(N)，从而可以防止或者基本上防止栅极驱动器300的错误操作。因此，可以改善栅极驱动器300的可靠性和显示面板100的显示质量。
图6是示出根据本发明构思的示例实施例的栅极驱动器的第N级的等效电路图。图7是示出当输入图像数据表示静态图像时图6的栅极驱动器的第N级的输入信号、节点信号以及输出信号的波形图。
除了时钟信号CK和CKB的波形以及栅极驱动器300的结构外，根据本示例实施例的显示装置与参照图1至图5解释的之前示例实施例的显示装置基本相同。因此，相同的附图标记将被用于指示与图1至图5的之前示例实施例中描述的那些相同或者相似的部分，并且将省略关于上述元件的某些重复解释。
参照图1、图3、图4、图6和图7，显示装置包括显示面板100和面板驱动器。面板驱动器包括时序控制器200、栅极驱动器300、伽马参考电压发生器400以及数据驱动器500。
栅极驱动器300接收第一时钟信号CK、第二时钟信号CKB、第一断开电压VSS1、第二断开电压VSS2以及复位信号RST。栅极驱动器300输出栅极输出信号GOUT。
第N级响应于第N-1级的第N-1进位信号CR(N-1)，输出第N栅极输出信号GOUT(N)和第N进位信号CR(N)，第N-1级是第N级的之前级。第N级响应于第N+1级的第N+1进位信号CR(N+1)，将第N栅极输出信号GOUT(N)下拉至第一断开电压VSS1，第N+1级是第N级的之后级。
以相似的方式，第一至最后一级依次输出栅极输出信号GOUT。
第N级包括上拉控制部分310、充电部分320、上拉部分330、进位部分340、反相部分350、第一下拉部分361、第二下拉部分362、进位下拉部分370、第一保持部分381、第二保持部分382以及第三保持部分383。
时序控制器200确定输入图像数据RGB是表示静态图像还是视频图像。
当输入图像数据RGB表示视频图像时，时序控制器200将显示面板100的驱动频率设置为第一频率。当输入图像数据RGB表示静态图像时，时序控制器200将显示面板100的驱动频率设置为第二频率。第二频率低于第一频率。
当显示面板100以高频率被驱动时，时钟信号CK和CKB中的每一个在高电平和低电平之间摆动，并且栅极驱动器300重复扫描操作。
比较而言，当显示面板100以低频率被驱动时，栅极驱动器300针对短的扫描时段ST运行扫描操作，并针对长的非扫描时段NST停止扫描。
在本示例实施例中，当输入图像数据RGB表示静态图像时，时钟信号CK针对扫描时段ST在高电平和低电平之间摆动，并且时钟信号CK针对非扫描时段NST维持第一低电平并周期性地从第一低电平降低至第二低电平。
在本示例实施例中，第一低电平可以基本上与第一断开电压VSS1相同。第二低电平可以基本上与第二断开电压VSS2相同。
在非扫描时段NST中，栅极驱动器300不产生栅极驱动信号GOUT和进位信号CR。从栅极驱动器300的第N级的角度看，第N+1进位信号不产生，从而使响应于第N+1进位信号被下拉的节点不被下拉。
由于浮置节点，栅极输出信号GOUT(N)的电平逐渐增高。因此，显示面板100的像素中的开关元件会被稍稍接通，从而使电流从像素电极泄露到数据线DL。因此，栅极驱动器300的可靠性会降低，并且显示面板100的显示质量会劣化。
当输入图像数据RGB表示静态图像时，时钟信号CK维持第一低电平，且周期性地从第一低电平降低至第二低电平。
当时钟信号CK降低至第二低电平时，由于第一晶体管T1的漏源电压Vds，电流从栅极输出端子流到时钟端子，从而使栅极输出信号GOUT(N)的电平降低。
另外，当时钟信号CK降低至第二低电平时，由于第十五晶体管T15的漏源电压Vds，电流从进位端子流到时钟端子，从而使进位信号CR(N)的电平可以降低。
当显示面板100具有与表示视频图像的输入图像数据RGB相对应的第一频率的驱动频率以及与表示静态图像的输入图像数据RGB相对应的第二频率的驱动频率时，时钟信号CK和CKB中的每一个降低至第二低电平的频率可以等于或者大于第二频率并且等于或者小于第一频率。例如，当第一频率为大约60Hz且第二频率为大约1Hz时，时钟信号CK和CKB降低至第二低电平的频率可以被确定为位于约1Hz至约60Hz之间。当时钟信号CK和CKB降低至第二低电平的频率为大约2Hz时，时钟信号CK和CKB的频率在一秒钟内对应于非扫描时段NST可以具有两个第二低电平的脉冲。当时钟信号CK和CKB降低至第二低电平的频率为大约10Hz时，时钟信号CK和CKB的频率在一秒钟内对应于非扫描时段NST可以具有十个第二低电平的脉冲。
根据本示例实施例，当输入图像数据RGB表示静态图像时，显示面板100以低频率被驱动，从而可以降低显示装置的功耗。当显示面板100以低频率被驱动时，栅极驱动器300使用(或者利用)时钟信号CK和CKB周期性地下拉栅极输出信号GOUT(N)，从而可以防止或者基本上防止栅极驱动器300的错误操作。因此，可以改善栅极驱动器300的可靠性，并且可以改善显示面板100的显示质量。
图8是示出当输入图像数据表示静态图像时根据本发明构思的示例实施例的栅极驱动器300的第N级的输入信号、节点信号和输出信号的波形图。
除了时钟信号CK和CKB的波形外，根据本示例实施例的显示装置基本上与参照图6和图7解释的之前示例实施例的显示装置相同。因此，相同的附图标记将被用于指示与图6和图7的之前示例实施例中描述的那些相同或者相似的部分，并且省略关于上述元件的某些重复解释。
参照图1、图3、图4、图6和图8，显示装置包括显示面板100和面板驱动器。面板驱动器包括时序控制器200、栅极驱动器300、伽马参考电压发生器400以及数据驱动器500。
栅极驱动器300接收第一时钟信号CK、第二时钟信号CKB、第一断开电压VSS1、第二断开电压VSS2以及复位信号RST。栅极驱动器300输出栅极输出信号GOUT。
第N级响应于第N-1级的第N-1进位信号CR(N-1)，输出第N栅极输出信号GOUT(N)和第N进位信号CR(N)，第N-1级是第N级的之前级。第N级响应于第N+1级的第N+1进位信号CR(N+1)，将第N栅极输出信号GOUT(N)下拉至第一断开电压VSS1，第N+1级是第N级的之后级。
以相似的方式，第一至最后一级依次输出栅极输出信号GOUT。
第N级包括上拉控制部分310、充电部分320、上拉部分330、进位部分340、反相部分350、第一下拉部分361、第二下拉部分362、进位下拉部分370、第一保持部分381、第二保持部分382以及第三保持部分383。
时序控制器200确定输入图像数据RGB是表示静态图像还是视频图像。
当输入图像数据RGB表示视频图像时，时序控制器200将显示面板100的驱动频率设置为第一频率。当输入图像数据RGB表示静态图像时，时序控制器200将显示面板100的驱动频率设置为第二频率。第二频率小于第一频率。
当显示面板100以高频率被驱动时，时钟信号CK和CKB在高电平和低电平之间摆动，并且栅极驱动器300重复扫描操作。
比较而言，当显示面板100以低频率被驱动时，栅极驱动器300针对短的扫描时段ST运行扫描操作，并针对长的非扫描时段NST停止扫描。
在本示例实施例中，当输入图像数据RGB表示静态图像时，时钟信号CK针对扫描时段ST在高电平和低电平之间摆动，并且时钟信号CK针对非扫描时段NST维持第一低电平并周期性地从第一低电平降低至第二低电平。
在本示例实施例中，第一低电平基本上与第二断开电压VSS2相同。第二低电平基本上与小于第二断开电压VSS2的第三断开电压VSS3相同。
在非扫描时段NST，栅极驱动器300不产生栅极驱动信号GOUT和进位信号CR。从栅极驱动器300的第N级角度看，第N+1进位信号不产生，从而使响应于第N+1进位信号被下拉的节点不被下拉。
由于浮置节点，栅极输出信号GOUT(N)的电平逐渐增高。因此，显示面板100的像素中的开关元件会被稍稍接通，从而使电流从像素电极泄露到数据线DL。因此，栅极驱动器300的可靠性会降低，并且显示面板100的显示质量会劣化。
当输入图像数据RGB表示静态图像时，时钟信号CK维持第一低电平，并且周期性地从第一低电平降低至第二低电平。
当时钟信号CK降低至第二低电平时，由于第一晶体管T1的漏源电压Vds，电流从栅极输出端子流向时钟端子，从而使栅极输出信号GOUT(N)的电平可以降低。
另外，当时钟信号CK降低至第二低电平时，由于第十五晶体管T15的漏源电压Vds，电流从进位端子流向时钟端子，从而使进位信号CR(N)的电平可以降低。
根据本示例实施例，当输入图像数据RGB表示静态图像时，显示面板100以低频率被驱动，从而可以降低显示装置的功耗。当显示面板100以低频率被驱动时，栅极驱动器300使用(或者利用)时钟信号CK和CKB，周期性地下拉栅极输出信号GOUT(N)，从而可以防止或者基本上防止栅极驱动器300的错误操作。因此，可以改善栅极驱动器300的可靠性和显示面板100的显示质量。
根据以上解释的本发明构思，可以降低显示装置的功耗，改善栅极驱动器的可靠性，并且改善显示面板的显示质量。
前述内容是对本发明构思的解释，而不应当被理解为是对本发明构思的限制。虽然已描述了本发明构思的一些示例实施例，但是本领域技术人员很容易理解，可以对这些示例实施例进行许多修改，而实质上没有脱离本发明构思的新颖的教导和方面。因此，所有这种修改旨在被包括在如权利要求所限定的本发明构思的范围内。在权利要求中，装置加功能的从句旨在覆盖此处被描述为执行所记载的功能的结构，不仅是结构的等同物，还包括等同的结构。因此，可以理解，前述内容是对本发明构思的解释，而不应当被理解为对具体的公开的示例实施例的限制，并且对公开的示例实施例以及其他示例实施例的修改，旨在被包括在所附权利要求的范围之内。本发明构思由所附权利要求及包括在其中的权利要求的等同物所限定。

Claims (20)

1.一种栅极驱动电路包括：
上拉控制部分，所述上拉控制部分被配置为向第一节点施加之前级之一的进位信号；
上拉部分，所述上拉部分被配置为响应于施加到所述第一节点的信号，输出时钟信号作为第N栅极输出信号；
进位部分，所述进位部分被配置为响应于施加到所述第一节点的信号，输出所述时钟信号作为第N进位信号；
第一下拉部分，所述第一下拉部分被配置为响应于之后级之一的进位信号，将所述第一节点处的信号下拉至第二断开电压；
第二下拉部分，所述第二下拉部分被配置为响应于所述之后级之一的进位信号，将所述第N栅极输出信号下拉至第一断开电压；
反相部分，所述反相部分被配置为基于所述时钟信号和所述第二断开电压产生反相信号以将所述反相信号输出给反相节点；以及
复位部分，所述复位部分被配置为向所述反相节点输出复位信号，
其中N是正整数。
2.根据权利要求1所述的栅极驱动电路，其中当输入图像数据表示视频图像时，所述复位信号具有低电平，并且
当所述输入图像数据表示静态图像时，所述复位信号周期性地从所述低电平升高至高电平。
3.根据权利要求2所述的栅极驱动电路，其中所述复位信号被共同施加到所述栅极驱动电路的所有级。
4.根据权利要求3所述的栅极驱动电路，其中当所述输入图像数据表示所述视频图像时，显示面板具有第一驱动频率；
当所述输入图像数据表示所述静态图像时，所述显示面板具有小于所述第一驱动频率的第二驱动频率，并且
所述复位信号的频率等于或者大于所述第二驱动频率且等于或者小于所述第一驱动频率。
5.根据权利要求1所述的栅极驱动电路，其中所述复位部分包括复位晶体管，并且
所述复位晶体管包括共同联接至被施加以所述复位信号的复位端子的控制电极和输入电极以及联接至所述反相节点的输出电极。
6.根据权利要求5所述的栅极驱动电路，进一步包括第一保持部分，所述第一保持部分被配置为响应于施加到所述反相节点的反相信号以及所述复位信号，将所述第一节点处的信号下拉至所述第二断开电压，
其中所述第一保持部分包括相互串联的第一保持晶体管和第二保持晶体管，
其中所述第一保持晶体管包括联接至所述反相节点的控制电极、联接至所述第一节点的输入电极以及联接至所述第二保持晶体管的输入电极的输出电极，并且
其中所述第二保持晶体管包括联接至所述反相节点的控制电极、联接至所述第一保持晶体管的输出电极的输入电极以及被施加以所述第二断开电压的输出电极。
7.根据权利要求6所述的栅极驱动电路，进一步包括第二保持部分，所述第二保持部分被配置为响应于所述反相信号和所述复位信号，将所述第N栅极输出信号下拉至所述第一断开电压，
其中所述第二保持部分包括第三保持晶体管，并且
其中所述第三保持晶体管包括联接至所述反相节点的控制电极、联接至输出所述第N栅极输出信号的端子的输入电极以及被施加以所述第一断开电压的输出电极。
8.根据权利要求7所述的栅极驱动电路，进一步包括第三保持部分，所述第三保持部分被配置为响应于所述反相信号和所述复位信号，将所述第N进位信号下拉至所述第二断开电压，
其中所述第三保持部分包括第四保持晶体管，并且
其中所述第四保持晶体管包括联接至所述反相节点的控制电极、联接至输出所述第N进位信号的端子的输入电极以及被施加以所述第二断开电压的输出电极。
9.根据权利要求1所述的栅极驱动电路，其中所述反相部分包括：
相互串联的第一反相晶体管和第三反相晶体管，以及
相互串联的第二反相晶体管和第四反相晶体管。
10.根据权利要求9所述的栅极驱动电路，其中所述第一反相晶体管包括共同被施加以所述时钟信号的控制电极和输入电极以及联接至第四节点的输出电极，
其中所述第二反相晶体管包括联接至所述第四节点的控制电极、被施加以所述时钟信号的输入电极以及联接至所述反相节点的输出电极，
其中所述第三反相晶体管包括联接至输出所述第N进位信号的端子的控制电极、联接至所述第四节点的输入电极以及被施加以所述第二断开电压的输出电极，并且
其中所述第四反相晶体管包括联接至输出所述第N进位信号的端子的控制电极、联接至所述反相节点的输入电极以及被施加以所述第二断开电压的输出电极。
11.根据权利要求10所述的栅极驱动电路，其中所述反相信号在所述时钟信号具有高电平时具有高电平，所述反相信号在所述时钟信号具有低电平时具有低电平，并且
所述反相信号在所述第N进位信号具有高电平时具有所述低电平。
12.根据权利要求1所述的栅极驱动电路，进一步包括进位下拉部分，所述进位下拉部分被配置为响应于之后级之一的进位信号，将所述第N进位信号下拉至所述第二断开电压。
13.一种栅极驱动电路包括：
上拉控制部分，所述上拉控制部分被配置为向第一节点施加之前级之一的进位信号；
上拉部分，所述上拉部分被配置为响应于施加到所述第一节点的信号，输出时钟信号作为第N栅极输出信号；
进位部分，所述进位部分被配置为响应于施加到所述第一节点的信号，输出所述时钟信号作为第N进位信号；
第一下拉部分，所述第一下拉部分被配置为响应于之后级之一的进位信号，将所述第一节点处的信号下拉至第二断开电压；
第二下拉部分，所述第二下拉部分被配置为响应于所述之后级之一的进位信号，将所述第N栅极输出信号下拉至第一断开电压；
反相部分，所述反相部分被配置为基于所述时钟信号和所述第二断开电压产生反相信号以将所述反相信号输出给反相节点；
其中当输入图像数据表示视频图像时，所述时钟信号在高电平和低电平之间摆动，
其中当所述输入图像数据表示静态图像时，所述时钟信号针对扫描时段在所述高电平和所述低电平之间摆动，并且所述时钟信号针对非扫描时段维持第一低电平且周期性地从所述第一低电平降低至第二低电平，并且
其中N为正整数。
14.根据权利要求13所述的栅极驱动电路，其中所述第一低电平为所述第一断开电压，并且
所述第二低电平为所述第二断开电压。
15.根据权利要求13所述的栅极驱动电路，其中所述第一低电平为所述第二断开电压，并且
所述第二低电平为小于所述第二断开电压的第三断开电压。
16.根据权利要求13所述的栅极驱动电路，其中当所述输入图像数据表示所述视频图像时，显示面板具有第一频率的驱动频率，
其中当所述输入图像数据表示所述静态图像时，所述显示面板具有小于所述第一频率的第二频率的驱动频率，并且
其中所述时钟信号在所述非扫描时段降低至所述第二低电平的频率，等于或者大于所述第二频率，并且等于或者小于所述第一频率。
17.一种显示装置包括：
显示面板，所述显示面板被配置为显示图像；
数据驱动电路，所述数据驱动电路被配置为向所述显示面板施加数据电压；以及
栅极驱动电路，所述栅极驱动电路被配置为向所述显示面板施加栅极输出信号，所述栅极驱动电路包括：
上拉控制部分，所述上拉控制部分被配置为向第一节点施加之前级之一的进位信号；
上拉部分，所述上拉部分被配置为响应于施加到所述第一节点的信号，输出时钟信号作为第N栅极输出信号；
进位部分，所述进位部分被配置为响应于施加到所述第一节点的信号，输出所述时钟信号作为第N进位信号；
第一下拉部分，所述第一下拉部分被配置为响应于之后级之一的进位信号，将所述第一节点处的信号下拉至第二断开电压；
第二下拉部分，所述第二下拉部分被配置为响应于所述之后级之一的进位信号，将所述第N栅极输出信号下拉至第一断开电压；
反相部分，所述反相部分被配置为基于所述时钟信号和所述第二断开电压产生反相信号以将所述反相信号输出给反相节点；以及
复位部分，所述复位部分被配置为向所述反相节点输出复位信号，
其中N是正整数。
18.根据权利要求17所述的显示装置，其中当输入图像数据表示视频图像时，所述复位信号具有低电平，并且
当所述输入图像数据表示静态图像时，所述复位信号周期性地从所述低电平升高至高电平。
19.根据权利要求18所述的显示装置，其中所述复位信号被共同施加到所述栅极驱动电路的所有级。
20.根据权利要求17所述的显示装置，其中所述复位部分包括复位晶体管，并且
所述复位晶体管包括共同联接至被施加以所述复位信号的复位端子的控制电极和输入电极以及联接至所述反相节点的输出电极。
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