CN109509459B - Goa电路及显示装置 - Google Patents
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Abstract
本发明提供了一种GOA电路及显示装置。所述GOA电路包括多级GOA单元，每一级GOA单元均包括：上拉控制模块、上拉模块、级传模块、下拉模块、自举模块及下拉维持模块，其中，所述上拉模块在第一节点的控制下，利用时钟信号输出扫描信号；所述下拉模块在下一级GOA单元的扫描信号的控制下将第一节点和扫描信号的电位分别下拉至第一低电平和第二低电平；所述下拉维持单元在扫描信号的非输出期间，将第一节点及上一级级GOA单元的级传信号维持在第一低电平，将扫描信号维持在第二低电平；所述时钟信号的低电平与第二低电平相等，所述第一低电平小于第二低电平，能够减少GOA电路中的电位拉扯，提升GOA电路的稳定性。
Description
技术领域
本发明涉及显示技术领域，尤其涉及一种GOA电路及显示装置。
背景技术
液晶显示器(Liquid Crystal Display，LCD)具有机身薄、省电、无辐射等众多优点，得到了广泛的应用。如：液晶电视、移动电话、个人数字助理(PDA)、数字相机、计算机屏幕或笔记本电脑屏幕等，在平板显示领域中占主导地位。
主动矩阵式液晶显示器(Active Matrix Liquid Crystal Display，AMLCD)是目前最常用的显示装置，所述主动矩阵式液晶显示器包含多个像素，每个像素电性连接一个薄膜晶体管(TFT)，薄膜晶体管的栅极(Gate)连接至水平扫描线，漏极(Drain)连接至垂直方向的数据线，源极(Source)则连接至像素电极。在水平扫描线上施加足够的电压，会使得电性连接至该条水平扫描线上的所有TFT打开，从而数据线上的信号电压能够写入像素，控制不同液晶的透光度进而达到控制色彩与亮度的效果。
阵列基板行驱动(Gate Driver on Array，GOA)技术是利用现有的薄膜晶体管液晶显示器的阵列(Array)制程将栅极行扫描驱动电路制作在TFT阵列基板上，实现对栅极逐行扫描的驱动方式。GOA技术能减少外接集成电路板(Integrated Circuit，IC)的焊接(bonding)工序，有机会提升产能并降低产品成本，而且可以使液晶显示面板更适合制作窄边框或无边框的显示产品。
现有的GOA电路一般包括：每一级GOA单元均包括：上拉控制模块、上拉模块、级传模块、下拉模块、自举模块及下拉维持模块，其中上拉控制模块用于在扫描阶段控制上拉模块打开，所述上拉模块用于输出级传信号及扫描信号，下拉膜用于在非扫描阶段控制所述上拉模块关闭，所述自举模块用于在扫描阶段维持所述上拉模块保持打开，所述下拉维持模块用于在非扫描阶段维持所述上拉模块保持关闭，其中所述上拉模块利用时钟信号产生并输出级传信号及扫描信号，所述下拉模块通过预设低电平下拉所述扫描信号的输出端的电位使得上拉模块保持关闭，现有技术中时钟信号的低电平一般均低于下拉模块采用的预设低电平，在下拉过程中，由于时钟信号的低电平与预设低电平之间的拉扯，会导致预设低电平的无法保持稳定，导致GOA电路无法保持稳定工作。
发明内容
本发明的目的在于提供一种GOA电路，能够减少GOA电路中的电位拉扯，提升GOA电路的稳定性。
本发明的目的还在于提供一种显示装置，能够减少GOA电路中的电位拉扯，提升GOA电路的稳定性。
为实现上述目的，本发明提供了一种GOA电路，包括多级GOA单元，每一级GOA单元均包括：上拉控制模块、上拉模块、级传模块、下拉模块、自举模块及下拉维持模块；
设n为正整数，在第n级GOA单元中：
所述上拉控制模块电性连接第一节点并接入第n-1级GOA单元的级传信号和第n-1级GOA单元的扫描信号，用于在第n-1级GOA单元的级传信号控制下，将第n-1级GOA单元的扫描信号输出至第一节点；
所述上拉模块与第一节点电性连接并接入时钟信号，用于在第一节点的控制下，利用时钟信号输出扫描信号；
所述级传模块与第一节点电性连接并接入时钟信号，用于在第一节点的控制下，利用时钟信号输出级传信号；
所述下拉模块与第一节点电性连接并接入第n+1级GOA单元的扫描信号、第一低电平、第二低电平及扫描信号，用于在第n+1级GOA单元的扫描信号的控制下下拉第一节点的电位至第一低电平以及在第n+1级GOA单元的扫描信号的控制下下拉扫描信号的电位至第二低电平；
所述自举模块与第一节点电性连接，用于在扫描信号输出期间使得所述第一节点的电位抬升并维持抬升后的电位；
所述下拉维持单元电性连接第一节点并接入扫描信号、第n-1级GOA单元的级传信号、第一低电平及第二低电平，用于在扫描信号的非输出期间，将第一节点及第n-1级GOA单元的级传信号维持在第一低电平，将扫描信号维持在第二低电平；
所述时钟信号的低电平与第二低电平相等，所述第一低电平小于第二低电平。
所述上拉控制模块包括第一薄膜晶体管，所述第一薄膜晶体管的栅极接入第n-1级GOA单元的级传信号，源极接入第n-1级GOA单元的扫描信号，漏极电性连接第一节点。
所述上拉模块包括：第二薄膜晶体管，所述第二薄膜晶体管的栅极电性连接第一节点，源极接入时钟信号，漏极输出扫描信号。
所述级传模块包括：第三薄膜晶体管，所述第三薄膜晶体管的栅极电性连接第一节点，源极接入时钟信号，漏极输出级传信。
所述下拉模块包括第四薄膜晶体管及第五薄膜晶体管；
所述第四薄膜晶体管的栅极接入第n+1级GOA单元的扫描信号，源极电性连接第一节点，漏极接入第一低电平；
所述第五薄膜晶体管的栅极接入第n+1级GOA单元的扫描信号，源极接入扫描信号，漏极接入第二低电平。
所述自举模块包括自举电容，所述自举电容的第一端电性连接第一节点，第二端接入扫描信号。
所述下拉维持模块包括第六薄膜晶体管、第七薄膜晶体管、第八薄膜晶体管及反相器；
所述第六薄膜晶体管的栅极电性连接所述反相器的输出端，源极接入扫描信号，漏极接入第二低电平；
所述第七薄膜晶体管的栅极电性连接所述反相器的输出端，源极电性连接第一节点，漏极接入第一低电平；
所述第八薄膜晶体管的栅极电性连接所述反相器的输出端，源极接入第n-1级GOA单元的级传信号，漏极接入第一低电平；
所述反相器的输入端电性连接第一节点；
所述反相器包括：第九薄膜晶体管、第十薄膜晶体管、第十一薄膜晶体管及第十二薄膜晶体管；
所述第九薄膜晶体管的栅极和源极均接入反相信号，漏极电性连接第十二薄膜晶体管的栅极；
所述第十薄膜晶体管的栅极电性连接第一节点，源极电性连接第十二薄膜晶体管的栅极，漏极接入第一低电平；
所述第十一薄膜晶体管的栅极电性连接第一节点，源极电性连接第十二薄膜晶体管的漏极，漏极接入第一低电平；
所述第十二薄膜晶体管的源极接入反相信号；
所述第十二薄膜晶体管的漏极为所述反相器的输出端，所述第十薄膜晶体管的栅极为所述反相器的输入端。
在第一级GOA单元中，采用启动信号替代所述第n-1级GOA单元的扫描信号及第n-1级GOA单元的级传信号输入到上拉控制单元，在最后一级GOA单元中，采用启动信号替代所述第n+1级GOA单元的扫描信号输入到下拉单元中。
在相邻的两级GOA单元中，其上拉模块接入的时钟信号的相位相反。
本发明还提供一种显示装置包括上述的GOA电路。
本发明的有益效果：本发明提供了一种GOA电路，包括多级GOA单元，每一级GOA单元均包括：上拉控制模块、上拉模块、级传模块、下拉模块、自举模块及下拉维持模块，其中，所述上拉模块在第一节点的控制下，利用时钟信号输出扫描信号；所述下拉模块在下一级GOA单元的扫描信号的控制下将第一节点和扫描信号的电位分别下拉至第一低电平和第二低电平；所述下拉维持单元在扫描信号的非输出期间，将第一节点及上一级级GOA单元的级传信号维持在第一低电平，将扫描信号维持在第二低电平；所述时钟信号的低电平与第二低电平相等，所述第一低电平小于第二低电平，通过设置时钟信号的低电平与第二低电平相等并在扫描信号的非输出期间使得上一级级GOA单元的级传信号维持在第一低电平，能够减少GOA电路中的电位拉扯，提升GOA电路的稳定性。本发明还提供一种显示装置，能够减少GOA电路中的电位拉扯，提升GOA电路的稳定性。
附图说明
为了能更进一步了解本发明的特征以及技术内容，请参阅以下有关本发明的详细说明与附图，然而附图仅提供参考与说明用，并非用来对本发明加以限制。
附图中，
图1为本发明的GOA电路的一级GOA单元的电路图；
图2为本发明的GOA电路的工作时序图；
图3为本发明的GOA电路的第一级GOA单元的电路图；
图4为本发明的GOA电路的最后一级GOA单元的电路图。
具体实施方式
为更进一步阐述本发明所采取的技术手段及其效果，以下结合本发明的优选实施例及其附图进行详细描述。
请参阅图1，本发明提供一种GOA电路，包括多级GOA单元，每一级GOA单元均包括：上拉控制模块100、上拉模块200、级传模块300、下拉模块400、自举模块500及下拉维持模块600；
设n为正整数，在第n级GOA单元中：
所述上拉控制模块100电性连接第一节点Q(n)并接入第n-1级GOA单元的级传信号ST(n-1)和第n-1级GOA单元的扫描信号G(n-1)，用于在第n-1级GOA单元的级传信号ST(n-1)控制下，将第n-1级GOA单元的扫描信号G(n-1)输出至第一节点Q(n)；
所述上拉模块200与第一节点Q(n)电性连接并接入时钟信号CK，用于在第一节点Q(n)的控制下，利用时钟信号CK输出扫描信号G(n)；
所述级传模块300与第一节点Q(n)电性连接并接入时钟信号CK，用于在第一节点Q(n)的控制下，利用时钟信号CK输出级传信号ST(n)；
所述下拉模块400与第一节点Q(n)电性连接并接入第n+1级GOA单元的扫描信号G(n+1)、第一低电平VSSQ、第二低电平VSSG及扫描信号G(n)，用于在第n+1级GOA单元的扫描信号G(n+1)的控制下下拉第一节点Q(n)的电位至第一低电平VSSQ以及在第n+1级GOA单元的扫描信号G(n+1)的控制下下拉扫描信号G(n)的电位至第二低电平VSSG；
所述自举模块500与第一节点Q(n)电性连接，用于在扫描信号G(n)输出期间使得所述第一节点Q(n)的电位抬升并维持抬升后的电位；
所述下拉维持单元600电性连接第一节点Q(n)并接入扫描信号G(n)、第n-1级GOA单元的级传信号ST(n-1)、第一低电平VSSQ及第二低电平VSSG，用于在扫描信号G(n)的非输出期间，将第一节点Q(n)及第n-1级GOA单元的级传信号ST(n-1)维持在第一低电平VSSQ，将扫描信号G(n)维持在第二低电平VSSG；
所述时钟信号CK的低电平与第二低电平VSSG相等，所述第一低电平VSSQ小于第二低电平VSSG。
具体地，请参阅图1，在本发明的第一实施例中，所述上拉控制模块100包括第一薄膜晶体管T1，所述第一薄膜晶体管T1的栅极接入第n-1级GOA单元的级传信号ST(n-1)，源极接入第n-1级GOA单元的扫描信号G(n-1)，漏极电性连接第一节点Q(n)。
具体地，请参阅图1，在本发明的第一实施例中，所述上拉模块200包括：第二薄膜晶体管T2，所述第二薄膜晶体管T2的栅极电性连接第一节点Q(n)，源极接入时钟信号CK，漏极输出扫描信号G(n)。
具体地，请参阅图1，在本发明的第一实施例中，所述级传模块300包括：第三薄膜晶体管T3，所述第三薄膜晶体管T3的栅极电性连接第一节点Q(n)，源极接入时钟信号CK，漏极输出级传信号ST(n)。
具体地，请参阅图1，在本发明的优选实施例中，所述下拉模块400包括第四薄膜晶体管T4及第五薄膜晶体管T5；
所述第四薄膜晶体管T4的栅极接入第n+1级GOA单元的扫描信号G(n+1)，源极电性连接第一节点Q(n)，漏极接入第一低电平VSSQ；
所述第五薄膜晶体管T5的栅极接入第n+1级GOA单元的扫描信号G(n+1)，源极接入扫描信号G(n)，漏极接入第二低电平VSSG。
具体地，请参阅图1，在本发明的优选实施例中，所述自举模块500包括自举电容C1，所述自举电容C1的第一端电性连接第一节点Q(n)，第二端接入扫描信号G(n)。
具体地，请参阅图1，在本发明的优选实施例中，所述下拉维持模块600包括第六薄膜晶体管T6、第七薄膜晶体管T7、第八薄膜晶体管T8及反相器601；
所述第六薄膜晶体管T6的栅极电性连接所述反相器601的输出端，源极接入扫描信号G(n)，漏极接入第二低电平VSSG；
所述第七薄膜晶体管T7的栅极电性连接所述反相器601的输出端，源极电性连接第一节点Q(n)，漏极接入第一低电平VSSQ；
所述第八薄膜晶体管T8的栅极电性连接所述反相器601的输出端，源极接入第n-1级GOA单元的级传信号ST(n-1)，漏极接入第一低电平VSSQ；
所述反相器601的输入端电性连接第一节点Q(n)。
进一步地，如图1所述，所述反相器601为达灵顿结构反相器，具体包括：第九薄膜晶体管T9、第十薄膜晶体管T10、第十一薄膜晶体管T11及第十二薄膜晶体管T12；
所述第九薄膜晶体管T9的栅极和源极均接入反相信号LC，漏极电性连接第十二薄膜晶体管T12的栅极；
所述第十薄膜晶体管T10的栅极电性连接第一节点Q(n)，源极电性连接第十二薄膜晶体管T12的栅极，漏极接入第一低电平VSSQ；
所述第十一薄膜晶体管T11的栅极电性连接第一节点Q(n)，源极电性连接第十二薄膜晶体管T12的漏极，漏极接入第一低电平VSSQ；
所述第十二薄膜晶体管T12的源极接入反相信号LC；
所述第十二薄膜晶体管T12的漏极为所述反相器601的输出端，所述第十薄膜晶体管T10的栅极为所述反相器601的输入端。
优选地，本发明的GOA电路中所述的所有薄膜晶体管均为金属氧化物半导体薄膜晶体管、多晶硅薄膜晶体管或非晶硅薄膜晶体管，且均为N型薄膜晶体管。
具体地，在相邻的两级GOA单元中，其上拉模块200接入的时钟信号CK的相位相反。如图2所示，在本发明的优选实施例，所述第n级GOA单元中接入的高频时钟信号CK为第一高频时钟信号CK1及第二高频时钟信号CK2中的一个，所述第n+1级GOA单元中接入的高频时钟信号CK为第一高频时钟信号CK1及第二高频时钟信号CK2中的另一个，其中，所述第一高频时钟信号CK1及第二高频时钟信号CK2中的相位相反。
进一步地，在本发明的优选实施例中，奇数级的GOA单元接入第一高频时钟信号CK1，偶数级的GOA单元接入第二高频时钟信号CK2。
优选地，在本发明的优选实施例中，所述时钟信号CK的低电平与第二低电平VSSG均为-5V，所述第一低电平VSSQ为-10V。
值得一提的是，如图3所示，为了实现电路的正常启动，本发明的GOA电路的第一级GOA单元中，采用启动信号STV替代所述第n-1级GOA单元的级传信号ST(n-1)及第n-1级GOA单元的扫描信号G(n-1)输入所述上拉控制单元100，实现电路的正常工作，对应到本发明的优选实施例中，即为第一级GOA单元中，所述第一薄膜晶体管T1的栅极和源极均接入启动信号STV，所述第八薄膜晶体管T8的源极接入启动信号STV，如图4所示，在最后一级GOA单元中采用启动信号STV替代所述第n+1级GOA单元的扫描信号G(n+1)输入到下拉单元400中，对应到本发明的优选实施例中，即为最后一级GOA单元中，第四薄膜晶体管T4及第五薄膜晶体管T5的栅极接入启动信号STV。优选地，所述启动信号的脉冲周期等于一帧时长。
需要说明的是，请参阅图1及图3，以本发明的优选实施例为例，本发明的GOA电路的工作过程如下：
阶段1、预充电阶段：第n-1级GOA单元的级传信号ST(n-1)为高电位，第n-1级GOA单元的扫描信号G(n-1)为高电位，所述第一薄膜晶体管T1打开，第n-1级GOA单元的扫描信号G(n-1)输入第一节点Q(n)，使得第一节点Q(n)抬升至高电位，第一高频时钟信号CK1输出低电平；
阶段2、输出阶段：第n-1级GOA单元的级传信号ST(n-1)为低电位，第n-1级GOA单元的扫描信号G(n-1)为低电位，所述第一薄膜晶体管T1关闭，自举电容C1使得第一节点Q(n)抬升的更高，第一高频时钟信号CK1输出高电平，所述第二薄膜晶体管T2及第三薄膜晶体管T3均打开，分别输出高电平的扫描信号G(n)和级传信号ST(n)；
阶段3、下拉阶段：第n+1级GOA单元的扫描信号G(n+1)为高电位，第四薄膜晶体管T4及第五薄膜晶体管T5打开，将第一节点Q(n)下拉至第一低电平VSSQ，将扫描信号G(n)下拉至第二低电平VSSG；此时，第一高频时钟信号CK1输出低电平，且第一高频时钟信号CK1的低电平和第二低电平VSSG均为-5V，能够避免第一高频时钟信号CK1的低电平和第二低电平VSSG之间的电位拉扯，保证GOA电路的工作稳定性。
阶段4、下拉维持阶段：第一节点Q(n)为低电位，第十薄膜晶体管T10、第十一薄膜晶体管T11关闭，反相信号LC为高电平，第九薄膜晶体管T9及第十二薄膜晶体管T12导通，第六薄膜晶体管T6、第七薄膜晶体管T7及第八薄膜晶体管T8导通，将第一节点Q(n)和第n-1级GOA单元的级传信号ST(n-1)维持在第一低电位VSSQ，将扫描信号G(n)维持在第二低电平VSSG，此时第一薄膜晶体管T1及第三薄膜晶体管T3的栅源极电压均为0V，第二薄膜晶体管T2的栅源极电压小于0V，第一薄膜晶体管T1、第二薄膜晶体管T2及第三薄膜晶体管T3均可以处于较佳的关闭状态，尤其是第二薄膜晶体管T2栅源极电压小于0V，比现有技术关闭的更好。
此外，本发明还提供一种显示装置，、包括上述的GOA电路。。
综上所述，本发明提供了一种GOA电路，包括多级GOA单元，每一级GOA单元均包括：上拉控制模块、上拉模块、级传模块、下拉模块、自举模块及下拉维持模块，其中，所述上拉模块在第一节点的控制下，利用时钟信号输出扫描信号；所述下拉模块在下一级GOA单元的扫描信号的控制下将第一节点和扫描信号的电位分别下拉至第一低电平和第二低电平；所述下拉维持单元在扫描信号的非输出期间，将第一节点及上一级级GOA单元的级传信号维持在第一低电平，将扫描信号维持在第二低电平；所述时钟信号的低电平与第二低电平相等，所述第一低电平小于第二低电平，通过设置时钟信号的低电平与第二低电平相等并在扫描信号的非输出期间使得上一级级GOA单元的级传信号维持在第一低电平，能够减少GOA电路中的电位拉扯，提升GOA电路的稳定性。本发明还提供一种显示装置，能够减少GOA电路中的电位拉扯，提升GOA电路的稳定性。
以上所述，对于本领域的普通技术人员来说，可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形，而所有这些改变和变形都应属于本发明权利要求的保护范围。
Claims (9)
1.一种GOA电路，其特征在于，包括多级GOA单元，每一级GOA单元均包括：上拉控制模块(100)、上拉模块(200)、级传模块(300)、下拉模块(400)、自举模块(500)及下拉维持模块(600)；
设n为正整数，在第n级GOA单元中：
所述上拉控制模块(100)电性连接第一节点(Q(n))并接入第n-1级GOA单元的级传信号(ST(n-1))和第n-1级GOA单元的扫描信号(G(n-1))，用于在第n-1级GOA单元的级传信号(ST(n-1))控制下，将第n-1级GOA单元的扫描信号(G(n-1))输出至第一节点(Q(n))；
所述上拉模块(200)与第一节点(Q(n))电性连接并接入时钟信号(CK)，用于在第一节点(Q(n))的控制下，利用时钟信号(CK)输出扫描信号(G(n))；
所述级传模块(300)与第一节点(Q(n))电性连接并接入时钟信号(CK)，用于在第一节点(Q(n))的控制下，利用时钟信号(CK)输出级传信号(ST(n))；
所述下拉模块(400)与第一节点(Q(n))电性连接并接入第n+1级GOA单元的扫描信号(G(n+1))、第一低电平(VSSQ)、第二低电平(VSSG)及扫描信号(G(n))，用于在第n+1级GOA单元的扫描信号(G(n+1))的控制下下拉第一节点(Q(n))的电位至第一低电平(VSSQ)以及在第n+1级GOA单元的扫描信号(G(n+1))的控制下下拉扫描信号(G(n))的电位至第二低电平(VSSG)；
所述自举模块(500)与第一节点(Q(n))电性连接，用于在扫描信号(G(n))输出期间使得所述第一节点(Q(n))的电位抬升并维持抬升后的电位；
所述下拉维持模块(600)电性连接第一节点(Q(n))并接入扫描信号(G(n))、第n-1级GOA单元的级传信号(ST(n-1))、第一低电平(VSSQ)及第二低电平(VSSG)，用于在扫描信号(G(n))的非输出期间，将第一节点(Q(n))及第n-1级GOA单元的级传信号(ST(n-1))维持在第一低电平(VSSQ)，将扫描信号(G(n))维持在第二低电平(VSSG)；
所述时钟信号(CK)的低电平与第二低电平(VSSG)相等，所述第一低电平(VSSQ)小于第二低电平(VSSG)；
所述上拉控制模块(100)包括第一薄膜晶体管(T1)，所述第一薄膜晶体管(T1)的栅极接入第n-1级GOA单元的级传信号(ST(n-1))，源极接入第n-1级GOA单元的扫描信号(G(n-1))，漏极电性连接第一节点(Q(n))；
所述下拉维持模块(600)包括第六薄膜晶体管(T6)、第七薄膜晶体管(T7)、第八薄膜晶体管(T8)及反相器(601)；
所述第六薄膜晶体管(T6)的栅极电性连接所述反相器(601)的输出端，源极接入扫描信号(G(n))，漏极接入第二低电平(VSSG)；
所述第七薄膜晶体管(T7)的栅极电性连接所述反相器(601)的输出端，源极电性连接第一节点(Q(n))，漏极接入第一低电平(VSSQ)；
所述第八薄膜晶体管(T8)的栅极电性连接所述反相器(601)的输出端，源极接入第n-1级GOA单元的级传信号(ST(n-1))，漏极接入第一低电平(VSSQ)；
所述反相器(601)的输入端电性连接第一节点(Q(n))。
2.如权利要求1所述的GOA电路，其特征在于，所述上拉模块(200)包括：第二薄膜晶体管(T2)，所述第二薄膜晶体管(T2)的栅极电性连接第一节点(Q(n))，源极接入时钟信号(CK)，漏极输出扫描信号(G(n))。
3.如权利要求1所述的GOA电路，其特征在于，所述级传模块(300)包括：第三薄膜晶体管(T3)，所述第三薄膜晶体管(T3)的栅极电性连接第一节点(Q(n))，源极接入时钟信号(CK)，漏极输出级传信号(ST(n))。
4.如权利要求1所述的GOA电路，其特征在于，所述下拉模块(400)包括第四薄膜晶体管(T4)及第五薄膜晶体管(T5)；
所述第四薄膜晶体管(T4)的栅极接入第n+1级GOA单元的扫描信号(G(n+1))，源极电性连接第一节点(Q(n))，漏极接入第一低电平(VSSQ)；
所述第五薄膜晶体管(T5)的栅极接入第n+1级GOA单元的扫描信号(G(n+1))，源极接入扫描信号(G(n))，漏极接入第二低电平(VSSG)。
5.如权利要求1所述的GOA电路，其特征在于，所述自举模块(500)包括自举电容(C1)，所述自举电容(C1)的第一端电性连接第一节点(Q(n))，第二端接入扫描信号(G(n))。
6.如权利要求1所述的GOA电路，其特征在于，所述反相器(601)包括：第九薄膜晶体管(T9)、第十薄膜晶体管(T10)、第十一薄膜晶体管(T11)及第十二薄膜晶体管(T12)；
所述第九薄膜晶体管(T9)的栅极和源极均接入反相信号(LC)，漏极电性连接第十二薄膜晶体管(T12)的栅极；
所述第十薄膜晶体管(T10)的栅极电性连接第一节点(Q(n))，源极电性连接第十二薄膜晶体管(T12)的栅极，漏极接入第一低电平(VSSQ)；
所述第十一薄膜晶体管(T11)的栅极电性连接第一节点(Q(n))，源极电性连接第十二薄膜晶体管(T12)的漏极，漏极接入第一低电平(VSSQ)；
所述第十二薄膜晶体管(T12)的源极接入反相信号(LC)；
所述第十二薄膜晶体管(T12)的漏极为所述反相器(601)的输出端，所述第十薄膜晶体管(T10)的栅极为所述反相器(601)的输入端。
7.如权利要求1所述的GOA电路，其特征在于，在第一级GOA单元中，采用启动信号(STV)替代所述第n-1级GOA单元的扫描信号(G(n-1))及第n-1级GOA单元的级传信号(ST(n-1))输入到上拉控制单元(100)，在最后一级GOA单元中，采用启动信号(STV)替代所述第n+1级GOA单元的扫描信号(G(n+1))输入到下拉单元(400)中。
8.如权利要求1所述的GOA电路，其特征在于，在相邻的两级GOA单元中，其上拉模块(200)接入的时钟信号(CK)的相位相反。
9.一种显示装置，其特征在于，包括如权利要求1至8任一项所述的GOA电路。
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