KR970051152A - 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치 - Google Patents

고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치 Download PDF

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Abstract

본 발명은 다수의 데이타 버스를 셀 어레이 및 센스 앰프 어레이 위로 지나도록 배치하여 동시에 많은 수의 센스 앰프의 데이타를 지역 데이타 버스 센스 앰프에 프리페치함으로써 고속 버스트 리드/리이트 동작이 가능하도록 한 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 장치에 관한 것이다.

Description

고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 제1실시예에 의한 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 DRAM의 회로도
제4도는 본 발명의 제2실시예에 의한 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 DRAM의 회로도.

Claims (17)

  1. 반도체 메모리 장치에 있어서, 컬럼 방향으로 2n개씩 나누어진 K개의 비트라인 센스앰프로 구성된 비트라인센스앰프 어레이와, 상기 동일한 컬럼 방향의 비트라인센스앰프 어레이에 공유되며 셀 어레이 및 상기 비트라인센스앰프 어레이 위를 지나도록 배치된 모두 K/2n개의 지역데이타버스라인과, 상기 각 비트라인센스앰프어레이에서 2n개마다 한 개의 비트라인센스앰프가 상기 지역데이타버스라인과 연결되도록 상기 비트라인센스 앰프 어레이에 연결된 서브 컬럼 디코더 수단과, 상기 비트라인센스앰프 어레이마다 2n개씩의 서브 컬럼 디코더 출력에 의하여 선택된 비트라인센스앰프가 상기 지역데이타버스라인과 연결되도록 하는 스위치 수단과, 상기 칼럼 디코더 출력에 의해 선택된 K/2n개의 비트라인센스앰프 데이타를 동시에 미리 읽어내기 위해 상기 K/2n지역데이타라인에 연결된 K/2n개의 데이타버스센스앰프를 구비하는 것을 특징으로 하는 고속 버스 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  2. 제1항에 있어서, 상기 K개의 비트라인센스앰프로 구성된 비트라인센스앰프 어레이를 컬럼 방향으로 2n개씩 나눌 때, n이 0이상의 정수인 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스라인 구조를 갖는 반도체 메모리 장치.
  3. 제1항에 있어서, 상기 서브 컬럼 디코더 수단은, 상기 K개의 비트라인센스앰프로 구성된 비트라인센스앰프 어레이를 컬럼 방향으로 2n개씩 나눌 때, 블럭 선택 신호에 의하여 선택되고, 입력으로 n개의 컬럼 어드레스를 받아 디코딩하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  4. 제1항에 있어서, 상기 스위치 수단은, 상기 K개의 비트라인센스앰프로 구성된 비트라인센스앰프 어레이를 컬럼 방향으로 2n개씩 나눌 때, 블럭 선택 신호에 의하여 선택되고, 입력으로 n개의 컬럼 어드레스가 디코딩 된 2n개의 신호를 받고, 서브컬럼 디코더마다 디코딩된 2n개의 신호를 공유하는 것을 특징으로 하는 고속버스 트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  5. 제1항에 있어서, 상기 서브 컬럼 디코더 수단은, 상기 비트라인센스앰프 어레이에 연결된 서브 칼럼 디코더중에서 한개의 서브 컬럼 디코더만이 활성화되는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  6. 반도체 메모리 장치에 있어서, 칼럼 방향으로 2n개씩 나누어진 K개의 비트라인 센스앰프로 구성된 비트라인센스앰프 어레이와, 동일한 칼럼 방향의 비트라인 센스앰프의 그룹을 상기 비트라인센스앰프 어레이마다 하나씩 건너 공유되며 셀 어레이 및 상기 비트라이니센스앰프 어레이 위를 지나도록 배치된 모두 2K/2n개의 지역데이타버스라인과, 상기 각 비트라인센스앰프 어레이에서 2n개마다 한개의 비트라인센스앰프가 상기 지역데이타버스라인과 연결되도록 상기 셀 어레이의 양쪽에 연결된 서브 칼럼 디코더 수단과, 상기 각 비트라인센스앰프 어레이마다 2n개씩의 서브 컬럼 디코더 출력에 의하여 선택된 비트라인센스앰프가 상기 지역데이타버스라인과 연결되도록하는 스위치 수단과,상기 컬럼 디코더 출력에 의해 선택된 2K/2n개의 비트라인센스앰프 데이타를 동시에 미리 읽어내기 위해 상기 2K/2n지역데이타링에 연결된 2K/2n개의 데이타버스센스앰프 데이타를 구비하는 것 을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  7. 제6항에 있어서, 상기 K개의 비트라인센스앰프로 구성된 비트라인센스앰프 어레이를 컬럼 방향으로 2n개씩 나눌 때, n이 0이상의 정수인 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  8. 제6항에 있어서, 상기 서브 컬럼 디코더 수단은, 상기 K개의 비트라인센스앰프로 구성된 비트라인센스앰프 어레이를 컬럼 방향으로 2n개씩 나눌때, 블럭 선택 신호에 의하여 선택되고, 입력으로 n개의 컬럼 어드레스를 받아 디코딩하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  9. 제6항에 있어서, 상기 스위치 수단은, 상기 K개의 비트라인센스앰프로 구성된 비트라인센스앰프 어레이를 컬럼 방향으로 2n개씩 나눌 때, 블럭 선택 신호에 의하여 선택되고, 입력으로 n개의 컬럼 어드레스가 디코딩 된 2n개의 신호를 받고, 서브 컬럼 디코더마다 디코딩된 2n개의 신호를 공유하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  10. 제6항에 있어서, 상기 서브 컬럼 디코더 수단은, 상기 엑세스하는 워드 라인 이 속한 셀 어레이의 양쪽의 비트라인센스앰프 어레이에 연결된 서브 컬럼 디코더가 모두 활성화되는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  11. 2개의 연속적인 로우 어드레스에 대한 버스트 리드 동작을 위한 반도체 메모리 장치에 있어서, 앞선 로우 어드레스와 다음 로우 어드레스에 의한 버스트 데이타 사이에 중단없이 연속적으로 버스트 리드 동작이 가능하도록 하기 위하여, 앞선 로오 어드레스의 데이타를 데이타버스세스앰프에 미리 읽어내고 버스트 리드 동작을 하는 동안 바로 프리차지 상태를 거쳐, 다음 로우 어드레스의 데이타를 액세스함으로써 처음 버스트 리드 후에 중단없이 다음 버스트 리드 동작을 수행하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  12. m×n개의 데이타버스센스앰프로 구성된 데이타버스센스앰프 어레이를 포함하는 반도체 메모리 장치에 있어서, 컬럼 디코더의 출력을 공유하는 2n개의 데이타버스라센스앰프를 한 개의 블럭으로 하여 m개의 데이타버스센스앰프를 블럭으로 나누고, 이 데이타버스센스앰프 블럭에 속한 n개의 비트라인센스엠프는 상기 컬럼 디 코더의 출력에 의하여 동시에 n개의 글로벌 데이타 버스에 연결되어 저장된 데이타를 전달하고, 이 전달된 데이타는 리드 데이타 버퍼에 입력된 후, 데이타 출력 드라이어를 거쳐 데이타 핀으로 출력되는 데이타 리드 경로를 구비하는 것을 특징으로 하느 고속 버스트 리드/라이드 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  13. m×2n개의 데이타버스센스앰프로 구성된 데이타버스센스앰프 어레이를 포함하는 반도체 메모리 장치에 있어서, 컬럼 디코더의 출력을 공유하는 2n개의 데이타버스라센스앰프를 한 개의 블럭으로 하여 m개의 데이타버스센스앰프를 블럭으로 나누고, 이 데이타버스센스앰프 블럭에 속한 2n개의 비트라인센스앰프중에서 n개의 데이타버스센스앰프는 상기 컬럼 디코더의 출력과 출력 선택기의 출력에 의하여 동시에 n개의 글로벌 데이타 버스에 연결되어 저장된 데이타를 전달하고, 이 전달된 데이타는 리드 데이타 버퍼에 입력된 후, 데이타 출력 드라이어를 거쳐 데이타 핀으로 출력되는 데이타 리드 경로를 구비하는 것을 특징으로 하느 고속 버스트 리드/라이드 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  14. 제13항에 있어서, 상기 데이타버스센스앰프 블럭 중 2개의 데이타버스센스앰프 그룹은, 한쪽 데이타센스 앰프 그룹이 컬럼 디코더의 출려과 출력 선택기의 출력으로 n개의 글로벌 데이타 버스와 연결되어 버스트 리드 동작이 수행되는 것과, 다른 데이타버스센스앰프 그룹은 입력 선택기의 출력에 의하여 m×n개의 지역데이타버스에 연결되어 선택된 m×n개의 비트라인센스앰프의 데이타를 받는 것을 동시에 수행하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  15. 제13항에 있어서, 상기 데이타버스센스앰프 블럭은, 상기 데이타버스센스앰프 블럭의 각각의 데이타버스센스앰프마다 래치가 2개씩 있고, 입력 선택기에 의하여 각 데이타버스센스앰프와 2개중의 한 래치가 연결되어 데이타버스센스앰프에 의해 센싱된 데이타를 래칭하는 것과, 출력 선택기의 출력과 컬럼 디코더의 출력에 의하여 나머지 래치가 글로벌 데이타 버스와 연결되어 버스트 리드 동작을 동시에 수행하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  16. 제13항에 있어서, 상기 데이타버스센스앰프 블럭은, 상기 데이타버스센스앰프 블럭의 각각의 데이타버스센스앰프마다 래치가 4개씩 있고, 입력 선택기에 의하여 각 데이타버스센스앰프와 4개중의 한 래치가 연결되어 데이타버스센스앰프에 의해 센싱된 데이타를 래칭하는 것과, 출력 선택기의 출력과 컬럼 디코더의 출력에 의하여 나머지 3개중의 한 래치가 클로벌 데이타 버스와 연결되어 버스트 리드 동작을 동시에 수행하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
  17. m×n개의 지역 데이타버스에 대하여 m×n개의 라이트 데이타 드라이버를 포함하는 반도체 메모리 장치에 있어서, 컬럼 디코더의 출력을 공유하는 n개의 라이트 데이타 드라이버가 한 개의 블럭이 되어 m개의 라이트데이타드라이버 블럭으로 나누어지고, 이 라이트데이타드라이버 블럭에 속한 n개의 라이트데이타드라이버는 상기 컬럼 디코더의 출력에 의하여 동시에 글로벌 데이타 버스에 연결되어 데이타 핀에서 글로벌 데이타 버스를 거쳐 전달된 데이타를 지역 데이타버스로 드라이빙하여 라이트 동작을 연속적으로 수행하는 것을 특징으로 하는 고속 버스트 리드/라이트 동작에 적합한 데이타 버스 라인 구조를 갖는 반도체 메모리 장치.
    참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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