KR102015680B1 - 최대 가능도 비트-스트림 엔코딩을 이용한 직접 디지털 합성 - Google Patents
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Abstract
최대 가능도 시퀀스 추정(maximum likelihood Sequence Estimation)을 이용한 RF 신호의 직접적인 합성(direct synthesis)을 위한 방법 및 장치가 제공된다. 디지털 스트림을 발생하기 위해 디지털 RF 입력 신호에 대해 최대 가능도 시퀀스 추정을 수행함으로써 디지털 RF 입력 신호는 합성되고, 프로토타입 필터(prototype filter)에 의한 필터링 이후에, 상기 발생된 디지털 스트림은 실질적으로 최소의 오류를 발생한다. 실질적으로 최소의 오류는 프로토타입 필터의 디지털 출력과 디지털 RF 입력 신호 사이의 차이(difference)를 포함한다. 디지털 스트림은 입력 디지털 RF 신호와 실질적으로 동일하다. 디지털 스트림은 아날로그 복원 필터(analog restitution filter)에 인가되고, 아날로그 복원 필터의 출력은 디지털 RF 입력 신호에 근사한 아날로그 RF 신호를 포함한다.
Description
관련 출원에 대한 상호 참조
본 출원은 "Software Digital Front End(SoftDFE) Signal Processing and Digital Radio"라는 명칭으로 2011년 10월 27일에 출원된 미국 특허 가출원번호 제61/552,242호를 우선권 주장하며, 그 내용을 본원에서 참조하고 있다.
본 출원은 "Methods and Apparatus for Direct Synthesis of RF Signals Using Delta-Sigma Modulator"라는 명칭으로 2009년 3월 31일에 국제출원된 국제 특허 출원 번호 제PCT/US09/38929호와 관련이 있으며, 그 내용은 본원에서 참조하고 있다.
발명의 분야
본 발명은 비트 스트림 엔코딩 기술에 관한 것으로, 더 구체적으로는 최대 가능도 비트 스트림 엔코딩(maximum likelihood bit stream encoding)을 이용한 RF 신호의 직접 합성(digital synthesis)을 위한 기술에 관한 것이다.
통신 신호는 기저대역 신호를 담고 있는 원래 신호를 반송파 주파수와 곱하여 얻어지는 원하는 주파수에서 송신된다. 무선 주파수(RF) 송신기에서는 예컨대 전형적으로 디지털 신호를 아날로그 신호로 변환한 다음, 이 아날로그 신호를 하나 이상의 혼합기를 이용해 RF 반송파 주파수와 혼합(mixing)함으로써, 원하는 RF 주파수가 디지털 기저대역 신호를 담고 있는 정보로부터 입수된다.
디지털 기저대역 신호를 담고 있는 정보로부터 RF 신호를 직접적으로 합성하는 다수의 직접 합성 기술이 제안되거나 제시되었다. 예를 들면, 2009년 3월31일에 국제 출원된 발명의 명칭이 "Methods Ans Apparatus for Direct Synthesis of FR Signals Using Delta-Sigma Modulator"인 국제 특허 출원 번호 제PCT/US09/38929호는 델타-시그마 변조기를 이용한 RF 신호의 직접 합성 기술을 개시한다.
정밀도가 높은 디지털-아날로그 변환인 경우, 방대한 오버샘플링(oversampling)이 가능할 때(예컨대, 신호 대역폭이 비교적 작고 10-1000배의 오버샘플링 가능한 오디오 또는 무선 기저대역 애플리케이션), 이러한 델타-시그마 변조기는 1비트 양자화기(one bit quantizer)와, 변조기(잡음 성형기(noise shaper)), 그리고 그 뒤를 따르는 아날로그 필터를 이용해, 높은 정확도로 디지털-아날로그 변환을 달성하는데 성공적으로 이용되었다. 그러나, 이러한 델타-시그마 변조기의 피드백 경로는 높은 샘플링 주파수(예컨대 1GHz를 넘는 주파수)에서 구현하기가 어렵다. 비선형 양자화기의 존재로 인해, 알고리즘은 낮은 클록 주파수에서 병렬처리 및 구현하기가 어렵다. 또한, 변조기의 안정을 보장하기 위해 입력 신호는 전형적으로 기준 전압의 비율에 대해 제한된다(예컨대 이 기술은 아주 전력 효율적이지는 않다). 더 나아가, 높은 오버샘플링율(oversampling rate)(100이상)이 높은 분해능(resolutions)을 위해 요구된다.
그러므로, 높은 샘플링 주파수에서 RF 신호를 직접 합성하기 위한 개선된 방법 및 장치가 요구된다. 또한, RF 신호를 직접 합성할 수 있는 변조기로서, 델타-시그마 변조기에 비해 오버샘플링율이 감소되고 개선된 잡음 성능을 제공할 수 있으며, 높은 주파수(수백 MHz에서 수 GHz까지)에서 구현될 수 있는 안정한 변조기도 요구된다. 예를 들어, 많은 나라에서 GSM 신호는 약 800MHz 주변에서 집중되어 있고, WCDMA 신호는 약 2.1GHz(기지국 송신기) 주변에 집중되어 있다.
전반적으로 최대 가능도 시퀀스 추정(MLSE;maximum likelihood Sequence Estimation)을 이용하여 RF 신호를 직접 합성하는 방법 및 장치가 제공된다. 본 발명의 한 양상에 따르면, RF 디지철 RF 입력 신호는 디지털 RF 입력 신호에 대해 최대 가능도 시퀀스 추정을 수행함으로써 합성되어 디지털 스트림을 발생하고, 결과적으로 프로토타입 필터(prototype filter)에 의한 필터링 이후에 이 발생된 디지털 스트림은 실질적으로 최소 오류(minimum error)를 만들어 낸다. 실질적으로 최소 오류는 프로토타입 필터의 디지털 출력과 디지털 RF 입력 신호 사이의 차이를 포함한다. 디지털 스트림은 실질적으로 입력 디지털 RF 신호와 동일하다. 최대 가능도 시퀀스 추정은 예컨대 비터비 디코딩(Viterbi decoding), 감축 상태 시퀀스 추정(RSSE;Reduced State Sequence Estimation) 및/또는 M 알고리즘을 포함한다.
본 발명의 다른 양상에 따르면, 디지털 스트림은 아날로그 복원 필터(analog restitution filter)에 인가된다. 아날로그 복원 필터는 디지털 RF 입력 신호에 근사한 아날로그 RF 신호를 포함한다. 다양한 실시예에서, 아날로그 복원 필터는 예컨대 수동 필터, R-L-C(resistive-inductive-capacitive) 회로 및/또는 송신선을 포함한다.
프로토타입 필터는 복원 필터와 유사한 주파수 응답을 가질 수 있다. 다양한 실시예에서, 프로토타입 필터는 유한 임펄스 응답 필터 또는 무한 임펄스 응답 필터를 포함한다. 예를 들어, 프로토타입 필터는 대역 통과 필터일 수 있고, 디지털 RF 입력 신호는 디지털 영역에서 RF 주파수로 변조된 기저대역 신호이다. 선택적으로 프로토타입 필터는 기저대역 필터일 수 있고, 디지털 RF 입력 신호는 기저대역 신호이다.
본 발명의 추가적인 특징 및 이점과 더불어 본 발명의 보다 완벽한 이해는 이후의 상세한 설명과 도면을 참조하여 얻어질 것이다.
도 1은 종래의 RF 송신기를 예시한다.
도 2는 예시적인 델타-시그마 변조기를 예시한다.
도 3은 예시적인 1비트 델타-시그마 변조기의 주파수 응답을 예시한다.
도 4는 본 발명의 양상들을 포함하는 예시적인 최대 가능도 비트-스트림 엔코딩 시스템의 개략적인 블록도이다.
도 5는 도 4의 최대 가능도 비트-스트림 엔코더의 예시적인 구현의 개락적인 블록도를 예시한다.
도 6a 및 도 6b는 기저대역 및 통과 대역 구현을 위한 h(t) 프로토타입 필터에 대한 예시적인 필터 응답을 각각 예시한다.
도 2는 예시적인 델타-시그마 변조기를 예시한다.
도 3은 예시적인 1비트 델타-시그마 변조기의 주파수 응답을 예시한다.
도 4는 본 발명의 양상들을 포함하는 예시적인 최대 가능도 비트-스트림 엔코딩 시스템의 개략적인 블록도이다.
도 5는 도 4의 최대 가능도 비트-스트림 엔코더의 예시적인 구현의 개락적인 블록도를 예시한다.
도 6a 및 도 6b는 기저대역 및 통과 대역 구현을 위한 h(t) 프로토타입 필터에 대한 예시적인 필터 응답을 각각 예시한다.
본 발명이 양상들은 최대 가능도 비트-스트림 엔코딩을 이용하여 신호의 직접적인 디지털 합성을 제공한다. 본 발명의 한 양상에 따르면, 엔코더는 최대 가능도 엔코딩에 기반하여 제공된다(예컨대 비터비 또는 M 알고리즘). 예시적인 최대 가능도 비트-스트림 엔코더는 실질적으로 디지털 스트림 데이터의 최적 시퀀스를 발생하고, 따라서 이 결과물을 아날로그 필터링한 이후의 아날로그 파형은 원하는 신호와 (거의) 동일하다. 이런 방식으로, 디지털 신호는 실질적으로 최적 비트(혹은 다중 레벨) 시퀀스를 찾음으로써 디지털 신호가 근사화되고, 따라서 이 결과물의 필터링 이후의 아날로그 RF 신호는 입력 신호의 디지털 버전(version)과 거의 동일하다.
델타-시그마 변조
도 1은 종래의 RF 송신기(100)를 예시한다. 도 1에 도시된 것처럼, 종래의 RF 송신기(100)는 처음에 기저대역 신호를 담고 있는 정보를 디지털-아날로구 변환기(110)를 이용해 디지털 신호로 변환한다. 이후, 디지털 신호는 저역 통과 필터(120)에 의해 필터링되고, 혼합기(130)를 이용해 RF 반송파 주파수 신호와 혼합된다. 다음, 혼합기(130)의 출력은 대역 통과 필터(140)에 의해 필터링되어, 공지의 방식으로 대역외 잡음(out-of-band noise)을 줄인다.
도 2는 2009년 3월 31일에 "Methods and Apparatus for Direct Synthesis of RF Signals Using Delta-Sigma Modulator"라는 발명의 명칭으로 국제 출원된 국제 특허 출원 번호 제PCT/US09/38929호에 따른 예시적인 델타-시그마 변조기(200)를 예시한다. 도 2에 도시된 바와 같이, 예시적인 델타-시그마 변조기(200)는 1비트 양자화기(210)와, 정합된 주파수 폴/제로 쌍(matched frequency pole/zero pair)을 갖는 오류 예측 필터(220)를 채용한다. 정합된 주파수 폴/제로 쌍은 수학식(2)와 함께 이후에 더 자세히 논의된다. 예시적인 오류 예측 필터(220)는 18 차수를 갖는다.
1비트 양자화기(210)에 대한 입력값 u는 덧셈시(230)에 의해 양자화된 출력값 q와 비교되는데, 이 덧셈기는 양자화 오류 e를 발생한다. 양자화 오류 e는 오류 예측 필터(220)에 의해 처리되어, 오류예측값 e1을 발생하는데, 이 값은 1클록 사이클동안 레지스터(240)에 저장된 뒤, 오류 보상된 입력값 u를 발생하는 덧셈기(250)에 의해 입력 신호 r로부터 감산된다. 일반적으로, 오류 예측 필터(220)는 공지의 방식에서 신호를 필터링하기 위해 입력값을 약간 인지한다. 예를 들면, 만약 오류가 천천히 변하고 있는 것으로 인지된다면, 오류 예측 필터(2200는 후속 샘플에 대해 동일한 값을 이용할 수 있다.
일반적으로, 1비트 양자화기(210)의 출력은 입력 신호의 대략적 근사치(coarse approximation)를 제공한다. 입력 신호 r은 예컨대 16비트 디지털 값일 수 있고, 대략적 아날로그 변환을 위해 1비트 양자화(이 양자화는 입력 신호의 극성에 기반할 수 있다)가 양자화기(210)에 의해 수행될 수 있다. 1비트 양자화기(210)와 연관된 양자화 잡음 e는 주로 대역외의 것이다. 이전에 지적하였듯이, 양자화기(210)에 의해 수행되는 1비트 양자화는 본질적으로 선형이다.
본원에 설명된 예시적인 실시예에서, 양자화 오류 e(n)은 입력 r(n)에 비상관(uncorrelated)되는 것으로 가정된다. 그러므로, 양자화 출력 q(t)의 전력 스펙트럼 밀도 Sq ,q는 다음과 같이 주파수 f의 함수로 표현될 수 있다.
오류 예측 필터(220)는 원하는 주파수 f1, f2,...fN에서 제로(zeros)를 제공하고, 제로와 실질적으로 동일한 주파수에서 폴(poles)을 제공하는데, 이때 폴은 1보다 작은 크기값 αi를 갖는다. 폴과 제로의 배치는 고정될 수도 있고 가변할 수도 있으며, 본 기술분야에 숙련된 사람에게는 자명하듯이, 소정의 구현을 위해 최적화될 수 있음을 유의하라.
도 3은 18차수를 갖는 예시적인 대역 통과 델타-시그마 ㅕㄴ조기(200)에 대한 주파수 응답(300)을 예시한다. 도 3에 도시된 것처럼, 예시적인 오류 예측 필터(220)는 2GHz 주변의 통과 대역을 나타내고, 100MHz의 대역폭을 갖는다. 유의미하게도, 예시적인 오류 예측 필터(220)는 110dB의 SFDR을 입증한다.
최대 가능도 비트-
스트림
엔코딩을
이용한 직접 합성
도 4는 본 발명의 양상들응 포함하는 예시적인 최대 가능도 비트-스트림 엔코딩 시스템(400)의 개략적인 블록도이다. 도 4에 도시된 것처럼, 최대 가능도 비트-스트림 엔코딩 시스템(400)은 도 5와 함께 이후에 더 자세히 설명되는 최대 가능도 비트-스트림 엔코더(500)와 아날로그 복원 필터(410)를 포함한다. 입력 신호 x는 최대 가능도 비트-스트림 엔코더(500)에 인가된다. 입력 신호 x는 디지털 RF 신호를 포함한다.
도 5와 함께 이후에 더 자세히 논의되듯이, 최대 가능도 비트-스트림 엔코더(500)는 디지털 RF 입력 신호 x와 실질적으로 동일한 디지털 스트림 b를 발생하고, 따라서 프로토타입 필터에 의한 필터링 이후에는 이 발생된 디지털 스트림 b는 실질적으로 최소 오류를 만든다. 이후에 논의되듯이, 오류는 프로토타입 필터의 디지털 출력과 디지털 RF 입력 신호 x 사이의 차이로 정의된다.
디지털 스트림 b는 예컨대 2레벨 2진 신호, 다중 레벨 신호일 수 있고, 하나 이상의 NRZ, PAM, QAM(예컨대 QPSK) 신호일 수도 있다.
도 4에 도시된 것처럼, 디지털 스트림 b는 아날로그 복원 필터(410)에 인가되어, 디지털 RF 입력 신호에 근사한 아날로그 RF 신호를 발생한다. 아날로그 복원 필터(410)는 전형적으로 수동형이고, 예컨대 RLC 회로 및/또는 송신선을 이용하여 구현될 수 있다.
본 발명의 양상들은 최대 가능도 시퀀스 추정(MLSE) 기술이 보다 전형적인 데이터 디코딩뿐만 아니라 데이터 변환 및 엔코딩에도 적용될 수 있음을 인지한다.
도 5는 본 발명의 양상들을 포함하는 예시적인 최대 가능도 비트-스트림 엔코더(500)의 개락적인 블록도를 예시한다. 도 5에 도시된 것처럼, 최대 가능도 비트-스트림 엔코더(500)는 디지털 RF 입력 신호 x를 수신하고, 디지털 RF 입력 신호 x와 실질적으로 동일한 디지털 스트림 b를 발생하므로, h(t) 프로토타입 필터(520)에 의한 필터링 이후에는, 도 6과 함께 아래에서 더 논의되는 것처럼, 상기 발생된 디지털 스트림 b는 실질적으로 최소 오류 e를 만들어 낸다. 도 5에 도시된 것처럼, 예시적인 오류 신호 e는 덧셈기(530)에 의해 프로토타입 필터(520)의 디지털 출력 신호(필터링된 디지털 비트-스트림 b)와 RF 입력 신호 x 사이의 차이로서 획득된다.
일반적으로, h(t) 프로토타입 필터(520)는 디지털 입력 신호 x의 주파수 주변에 실질적으로 집중된 통과 대역을 갖는다. h(t) 프로토타입 필터(520)는 예컨대 유한 임펄스 응답(FIR) 또는 무한 임펄스 응답(IIR) 필터로 구현될 수 있다.
스테이지(510)에서, 최대 가능도 비트-스트림 엔코더(500)는 MLSE 기술을 이용하여 오류를 최소회시키는 최대 가능도 비트 스트림(비트 스트림 b)를 찾는다. MSLE 기술은 (방대할 수 있는 디코더의 상태 개수를 줄이기 위해) 예컨대 비터비 알고리즘, 감축 상태 시퀀스 추정(RSSE) 및 M 알고리즘 중 하나 이상을 포함한다. 만약 탭의 개수가 Ntaps라면, 디코더의 상태 개수는 2Ntaps로서 탭의 개수는 지수적으로 증가하므로, 실용적이지 않을 수도 있다. M 알고리즘의 논의를 위해, 예를 들면, 이. 에프. 하라치(E. F. Haratsch)가 Int'l Symposium on VLSI Technology, Systems, and Applications, Taipei(1999년 6월)에 기고한 "High-Speed VLSI Implementation of Reduced Complexity Sequence Estimation Algorithms With Application to Gigabit Ehternet 1000 BaseT"를 참조하며, 이것은 본원에서 참조로 이용하고 있다.
아날로그 복원 필터(410)는 입력 신호 x의 특성에 기반하여 설계되고, 프로토타입 필터(520)는 복원 필터(410)와 유사한 주파수 응답을 갖는다.
MLSE는 선택적으로 자신의 디코딩에 디지털 드라이버 아날로그 회로(예컨대 직렬 변환기-역직렬 변환기(serializer-deserializer)(SerDes)의 송신 회로) 또는 RF 전력 증폭기(클래스 S 스위칭 유형 증폭기)의 비선형 메모리를 포함하는데, 이러한 증폭기나 드라이버 회로는 그 비선형성을 보상하기 위해 디지털 혹은 혼합된 신호 SOC(System on Chip)에서 흔히 이용된다. SOC는 예를 들면 기저대역 신호 프로세서, 디지털 프론트 엔드(DFE) 또는 단일 칩 기지국을 포함할 수도 있다.
도 6a 및 도 6b는 기저대역 및 통과 대역 구현을 위한 h(t) 프로토타입 필터(620)에 대한 예시적인 필터 응답을 각각 예시한다. 도 6a에 도시된 것처럼, h(t) 프로토타입 필터(620)는 예컨대 40MHz LTE 기저대역 신호처럼 기저대역 응답(610)(20MHz LTE의 2개 반송파)을 갖는다. 대응하는 예시적인 샘플링율은 5.89824 GSPS(=30.62MSPS(LTE 기저대역))이다. 응답 부분(620)은 디지털 전치 왜곡(DPD;digital pre-distortion)으로 인한 스펙트럼상의 재성장에 기여한다. 최대 3차 정정의 DPD 이후에 관심있는 신호 대역폭(630)은 예컨대 120MHz이다(혹은 5차 정정인 경우에는 200MHz임).
도 6b에 도시된 것처럼, h(t) 프로토타입 필터(620)는 관심있는 신호 대역폭(660) 및 통과 대역 응답(650)을 갖는다. 통과 대역의 경우, 너무 작은 신호 대역폭은 실현이 어려운데, 그 이유는 매우 높은 Q 필터를 초래하기 때문이다(예컨대, 2.14GHz/20MHz Q~100(너무 높음), 그러나 2.14GHz/200MHz는 10의 Q를 유발하고, 이것은 실용적이다).
다른 변형안에서, 최대 가능도 엔코더는 아날로그-디지털 변환기로서 이용될 수 있는데, 여기에서 입력 신호는 디지털 신호를 대신하여 아날로그 신호이고, 프로토타입 필터는 아날로그이고, 복원 필터는 디지털이며, 최대 가능도 디코더는 아날로그 영역에서 구현된다.
결론
본 발명의 예시적인 실시예들이 디지털 논리 블록과 관련하여 설명되었지만, 본 기술분야에 숙련된 사람에게는, 다양한 함수들이 디지털 영역에서 소프트웨어 프로그램의 처리 단계들로서 구현될 수도 있고, 회로 소자 또는 상태 머신에 의해 하드웨어로 구현될 수도 있으며, 또는 소프트웨어와 하드웨어의 조합으로 구현될 수도 있음이 자명하다. 이러한 소프트웨어는 예를 들어 디지털 신호 프로세서, 주문형 반도체 또는 마이크로 콘트롤러에 채용될 수 있을 것이다. 이러한 하드웨어와 소프트웨어는 집적회로 내부에 구현된 회로내에 구현될 수도 있다.
그러므로, 본 발명의 함수들은 방법과 그 방법을 실시하는 장치의 형태로 구현될 수 있다. 본 발명의 하나 이상의 양상들은 예를 들어 저장 매체에 저장되거나, 머신에 로드되거나 또는 머신에 의해 실행되는 것에 무관하게 프로그램 코드의 형태로 구현될 수 있고, 이 프로그램 코드가 예컨대 프로세서같은 머신에 로드되어 실행될 때, 머신은 본 발명을 실시하는 장치가 된다. 범용 프로세서에 구현될 때, 프로그램 코드 세그먼트는 프로세서와 조합하여 특정 논리 회로와 유사하게 동작하는 장치를 제공한다. 본 발명은 또한 하나 이상의 집적 회로, 디지털 프로세서, 마이크로 프로세서 및 마이크로 콘트롤러에 구현될 수 있다.
본원에 도시 및 설명된 실시예 및 그 변형안들은 단지 본 발명의 원리를 예시하기 위한 것이고, 본 발명의 사상과 범주를 벗어나지 않으면서 당업자에 의해 다양한 수정안들이 구현될 수도 있음이 이해되어야 한다.
Claims (36)
- 디지털 RF 입력 신호의 직접적인 디지털 합성(direct digital synthesis)을 위한 방법으로서,
디지털 스트림(digital stream)을 발생하기 위해 상기 디지털 RF 입력 신호에 대해 M 알고리즘을 적용함으로써 최대 가능도 시퀀스 추정(maximum likelihood sequence estimation)을 수행하여, 프로토타입 필터(prototype filter)에 의한 필터링 이후에, 상기 발생된 디지털 스트림이 최소의 오류를 발생시키도록 하는 단계와,
아날로그 복원 필터(analog restitution filter) 앞에 있는 스위칭 유형 전력 증폭기(switching type power amplifier)에 상기 디지털 스트림을 인가하는 단계
를 포함하되,
상기 최대 가능도 시퀀스 추정은 상기 M 알고리즘을 포함하며, 상기 프로토타입 필터는 무한 임펄스 응답(infinite impulse response: IIR) 필터를 포함하는
방법. - 제1항에 있어서,
상기 최소의 오류는 상기 프로토타입 필터의 디지털 출력과 상기 디지털 RF 입력 신호 사이의 차이(difference)를 포함하는
방법. - 제1항에 있어서,
상기 디지털 스트림을 상기 아날로그 복원 필터에 인가하는 단계를 더 포함하는
방법. - 디지털 스트림을 발생하기 위해 디지털 RF 입력 신호에 M 알고리즘을 적용함으로써 최대 가능도 시퀀스 추정을 수행하여, 프로토타입 필터에 의한 필터링 이후에 상기 발생된 디지털 스트림이 최소의 오류를 발생시키도록 하는 최대 가능도 시퀀스 추정기와,
아날로그 복원 필터와,
상기 디지털 스트림을 수신하는 스위칭 유형 전력 증폭기
를 포함하되,
최대 가능도 시퀀스 추정은 상기 M 알고리즘을 포함하며, 상기 프로토타입 필터는 무한 임펄스 응답(IIR) 필터를 포함하고, 상기 스위칭 유형 전력 증폭기는 상기 아날로그 복원 필터 앞에 있는
디지털 RF 입력 신호 합성기. - 제4항에 있어서,
상기 최소의 오류는 상기 프로토타입 필터의 디지털 출력과 상기 디지털 RF 입력 신호 사이의 차이를 포함하는
디지털 RF 입력 신호 합성기. - 제4항에 있어서,
상기 아날로그 복원 필터의 출력은 상기 디지털 RF 입력 신호에 근사한 아날로그 RF 신호를 포함하는
디지털 RF 입력 신호 합성기. - 제4항에 있어서,
상기 디지털 스트림은 상기 디지털 RF 입력 신호와 동일한
디지털 RF 입력 신호 합성기. - 디지털 RF 입력 신호 합성을 위한 시스템으로서,
메모리와,
상기 메모리에 결합된 적어도 하나의 하드웨어 장치를 포함하되,
상기 적어도 하나의 하드웨어 장치는,
디지털 스트림을 발생하기 위해 상기 디지털 RF 입력 신호에 대해 M 알고리즘을 적용함으로써 최대 가능도 시퀀스 추정을 수행하여, 프로토타입 필터에 의한 필터링 이후에 상기 발생된 디지털 스트림이 최소의 오류를 발생시키도록 하고,
아날로그 복원 필터 앞에 있는 스위칭 유형 전력 증폭기에 상기 디지털 스트림을 인가하도록 하되,
상기 최대 가능도 시퀀스 추정은 상기 M 알고리즘을 포함하며, 상기 프로토타입 필터는 무한 임펄스 응답(IIR) 필터를 포함하도록 동작하는
시스템. - 제8항에 있어서,
상기 최소의 오류는 상기 프로토타입 필터의 디지털 출력과 상기 디지털 RF 입력 신호 사이의 차이를 포함하는
시스템. - 제8항에 있어서,
상기 아날로그 복원 필터의 출력은 상기 디지털 RF 입력 신호에 근사한 아날로그 RF 신호를 포함하는
시스템. - 삭제
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- 삭제
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