JPWO2009019947A1 - 磁壁ランダムアクセスメモリ - Google Patents

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Abstract

磁気ランダムアクセスメモリは、垂直磁気異方性を有する強磁性層である磁化記録層(10)と、磁気記録層(10)上に設けられ情報を読み出すための磁気読出し層(50)とを具備する。磁化記録層(10)は、反転可能な磁化を有する磁化反転領域(13)と、磁化反転領域(13)の第1境界に接続され磁化の向きが第1方向に固定された第1磁化固定領域(11a)と、磁化反転領域(13)の第2境界に接続され磁化の向きが第2方向に固定された第2磁化固定領域(11b)とを備える。磁気読出し層(50)は、磁化反転領域(13)の磁化の方向に対応して磁化の方向が変化する磁気センス層(33)と、磁気センス層(33)上に設けられた非磁性バリア層(32)と、非磁性バリア層(32)上に設けられたピン層(30)とを備える。

Description

本発明は、磁気ランダムアクセスメモリ(MRAM:Magnetic Random Access Memory)に関し、特に、磁壁移動方式のMRAMに関する。
MRAMは、高集積・高速動作の観点から有望な不揮発性メモリである。MRAMにおいては、TMR(Tunnel MagnetoResistance)効果などの「磁気抵抗効果」を示す磁気抵抗素子が利用される。その磁気抵抗素子には、例えばトンネルバリヤ層が二層の強磁性層で挟まれた磁気トンネル接合(MTJ;Magnetic Tunnel Junction)が形成される。その二層の強磁性層は、磁化の向きが固定された磁化固定層(ピン層)と、磁化の向きが反転可能な磁化自由層(フリー層)とを有している。
ピン層とフリー層の磁化の向きが“反平行”である場合のMTJの抵抗値(R+ΔR)は、磁気抵抗効果により、それらが“平行”である場合の抵抗値(R)よりも大きくなることが知られている。MRAMは、このMTJを有する磁気抵抗素子をメモリセルとして用い、その抵抗値の変化を利用することによってデータを不揮発的に記憶する。例えば、反平行状態はデータ“1”に対応付けられ、平行状態はデータ“0”に対応付けられる。メモリセルに対するデータの書き込みは、フリー層の磁化の向きを反転させることによって行われる。
MRAMに対するデータの書き込み方法として、「アステロイド方式」や「トグル方式」が知られている。これらの書き込み方式によれば、メモリセルサイズにほぼ反比例して、フリー層の磁化を反転させるために必要な反転磁界が大きくなる。つまり、メモリセルが微細化されるにつれて、書き込み電流が増加する傾向にある。
微細化に伴う書き込み電流の増加を抑制することができる書き込み方式として、「スピン注入(spin transfer)方式」が提案されている(例えば、特開2005−93488号公報(対応米国特許US7193284(B2))、“Current−driven excitation of magnetic multilayers”,J.C.Slonczewski,Journal of Magnetism & Magnetic Materials,159,L1−L7(1996)、を参照)。スピン注入方式によれば、強磁性導体にスピン偏極電流(spin−polarized current)が注入され、その電流を担う伝導電子のスピンと導体の磁気モーメントとの間の直接相互作用によって磁化が反転する(以下、「スピン注入磁化反転:Spin Transfer Magnetization Switching」と参照される)。
米国特許第6834005号公報には、スピン注入を利用した磁気シフトレジスタが開示されている。この磁気シフトレジスタは、磁性体中の磁壁(domain wall)を利用して情報を記憶する。多数の領域(磁区)に分けられた磁性体において、磁壁を通過するように電流が注入され、その電流により磁壁が移動する。各領域の磁化の向きが、記録データとして扱われる。このような磁気シフトレジスタは、例えば、大量のシリアルデータの記録に利用される。尚、磁性体中の磁壁の移動は、“Real−Space Observation of Current−Driven Domain Wall Motion in Submicron Magnetic Wires”,A.Yamaguchi et al.,Physical Review Letters,Vol.92,pp.077205−1−4(2004)にも報告されている。
このようなスピン注入による磁壁移動(Domain Wall Motion)を利用した「磁壁移動方式のMRAM」が、特開2005−191032号公報、及び“Reduction of Threshold Current Density for Current−Driven Domain Wall Motion using Shape Control”,A.Yamaguchi et al.,Japanese Journal of Applied Physics,vol.45,No.5A,pp.3850−3853(2006)に記載されている。
特開2005−191032号公報に記載されたMRAMは、磁化が固定された磁化固定層と、磁化固定層上に積層されたトンネル絶縁層と、トンネル絶縁層に積層された磁化記録層とを備える。磁化記録層には、磁化の向きが反転可能な部分と実質的に変化しない部分も含まれているため、磁化自由層ではなく、磁化記録層と呼ぶことにする。図1は、特開2005−191032号公報の磁化記録層の構造を示す概略平面図である。図1において、磁化記録層100は、直線形状を有している。具体的には、磁化記録層100は、トンネル絶縁層及び磁化固定層と重なる接合部103、接合部103の両端に隣接するくびれ部104、及びくびれ部104に隣接形成された一対の磁化固定領域101、102を有する。一対の磁化固定領域101、102には、互いに反対向きの固定磁化が付与されている。更に、MRAMは、一対の磁化固定領域101、102に電気的に接続された一対の書き込み用端子105、106を備える。この書き込み用端子105、106により、磁化記録層100の接合部103、一対のくびれ部104及び一対の磁化固定領域101、102を貫通する電流が流れる。
図2は、“Magnetic Configuration of A New Memory Cell Utilizing Domain Wall Motion”,H.Numata et al.,Intermag 2006 Digest,HQ−03(2006)に記載された磁気メモリセルの磁気記録層120の構造を示している。磁気記録層110は、U字型の形状を有している。具体的には、磁気記録層120は、第1磁化固定領域121、第2磁化固定領域122、及び磁化反転領域123を有している。磁化反転領域123は、ピン層130とオーバーラップしている。磁化固定領域121、122は、Y方向に延びるように形成されており、その磁化の向きは同じ方向に固定されている。一方、磁化反転領域123は、X方向に延びるように形成されており、反転可能な磁化を有している。従って、磁壁が、第1磁化固定領域121と磁化反転領域123との境界B1、あるいは、第2磁化固定領域122と磁化反転領域123との境界B2に形成される。磁化状態の初期化は、例えば、XY面内で斜め45度方向に十分大きな初期磁界を印加することによりおこなわれ、初期磁界を除いた後に、磁化固定領域の磁化が+Y方向、磁化反転領域の磁化が+X方向を向き、磁壁が境界B1に形成された状態が実現される。
磁化固定領域121、122は、電流供給端子125、126のそれぞれに接続されている。これら電流供給端子125、126を用いることにより、磁気記録層120に書き込み電流を流すことが可能である。その書き込み電流の方向に応じて、磁壁は磁化反転領域123中を移動する。この磁壁移動により、磁化反転領域123の磁化方向を制御することができる。
しかし、電流駆動磁壁移動を利用したMRAMでは、書き込み電流の絶対値が比較的大きくなってしまうことが懸念される。前掲のPhysical Review Letters,Vol.92,pp.077205−1−4(2004)のほかにも、電流駆動磁壁移動の観測は数多く報告されている。しかし、磁壁移動には概ね1×10A/cm程度の閾値電流密度を要している。この場合、例えば磁壁移動の起こる層の幅を100nm、膜厚を10nmとした場合でも書き込み電流は1mAとなる。これ以下に書き込み電流を低減するためには膜厚を薄くすればよいが、この場合には書き込みに要する電流密度は更に上昇してしまうことが知られている(例えば、前掲のJapanese Journal of Applied Physics,vol.45,No.5A,pp.3850−3853(2006)参照)。 電流駆動磁壁移動を利用したMRAMにおいて、書込み電流を低減できる技術が期待される。
一方、磁化記録層の磁気異方性が基板面に垂直である垂直磁気異方性材料を用いた素子においては、10A/cm台の閾値電流密度が観測されている(例えば、“Threshold currents to move domain walls in films with perpendicular anisotropy”,D.Ravelosona et al.,Applied Physics Letters,Vol.90,072508(2007)参照)。
垂直磁気異方性材料を用いた素子に関連して、特開2003−110094号公報(対応米国特許US6844605(B2))に垂直磁化膜を用いた磁気メモリ及びその製造方法が開示されている。この磁気メモリは、垂直磁化膜からなる第1磁性層と非磁性層と垂直磁化膜からなる第2磁性層が積層されてなり、該第2磁性層の反転磁界が、該第1磁性層の反転磁界より小さく、該第1磁性層の磁化方向と該第2磁性層の磁化方向の相対角度によって、該第1磁性層と該第2磁性層間に電流を流した時の抵抗値が異なる磁気抵抗素子と、該磁気抵抗素子の該第1磁性層の磁化方向を反転させるために設けられた磁界発生機構と、を有している。この磁気メモリは、以下の式(1)であらわされる該第1磁性層の反転磁界Hcが、該磁界発生機構から発生する磁界よりも小さくなるように設定されることを特徴とする。
Hc=2(Ku−2πMsf)/Ms・・・(1)
ここで、Ku,Msは、各々、第1磁性層11の垂直磁気異方性定数、飽和磁化であり、fは、第1磁性層11の膜厚をT、幅と長さをWとすると、f=7×10−13(T/W)−2×10−9(T/W)+3×10−6(T/W)−0.0019(T/W)+0.9681である。
また、特開2006−73930号公報に磁壁移動を利用した磁気抵抗効果素子の磁化状態の変化方法及び該方法を用いた磁気メモリ素子、固体磁気メモリが開示されている。この磁気メモリ素子は、第一の磁性層と中間層と第二の磁性層とを有し、情報を第一の磁性層と、第二の磁性層との磁化の方向で記録する。この磁気メモリ素子は、少なくとも一方の磁性層内に互いに反平行磁化となる磁区とそれらの磁区を隔てる磁壁を定常的に形成し、前記磁壁を磁性層内で移動させることで、隣り合う磁区の位置を制御して情報記録を行うことを特徴とする。前記第二の磁性層は膜面垂直方向に磁気異方性を有していても良い。
既述のように、電流駆動磁壁移動を利用したMRAMでは、書き込み電流の絶対値が比較的大きくなってしまうことが懸念される。従って、発明者は、以下に示すように、電流駆動磁壁移動を利用したMRAMにおいて、磁化記録層として垂直磁気異方性材料を用いることにより、書込み電流を低減できることを検討した。
図3A及び図3Bは、それぞれ想定しうる垂直磁気異方性材料を用いた磁気抵抗素子の平面図及び断面図である。磁化記録層10は、磁化反転領域13と、一対の磁化固定領域11a、11bとを備える。ただし、図3A及び図3Bにおいて、白丸と点の記号、白丸とバツの記号、白矢印は、それらが記載された磁化反転領域13や磁化固定領域11a、11bの磁化方向を示している。
磁化反転領域13は、トンネル絶縁層32及びピン層30と重なり、フリー層としての機能を有する。磁化固定領域11aは磁化反転領域13の一端に、磁化固定領域11bは磁化反転領域13の他端にそれぞれ隣接されている。磁化反転領域13と磁化固定領域11a、11bとの接合部にはくびれ部15が設けられる。一対の磁化固定領域11a、11bには、互いに反対向きの固定磁化が付与される。また、くびれ部15は磁壁に対するピンポテンシャルとして機能し、磁壁はくびれ部付近の領域12a、又は、領域12bに位置するように初期化される。データの読出しは磁化反転領域13とピン層30との磁化の相対的な向きに依存して、トンネル抵抗が異なることを利用しておこなわれる。磁化反転領域13の磁化が膜面に垂直方向であるので、ピン層30の磁化も膜面に垂直でなければならない(例えば、特開2003−110094号公報 、特開2006−73930号公報)。
一方、情報の格納及び読み出しに関しては、一般にMR比ができるだけ大きいことが望ましい。これまで、磁気トンネル接合としては、フリー層、ピン層共に面内の磁化成分を有する構成について、多く報告されている。例えば、フリー層、ピン層としてCoFeBを用い、トンネルバリヤとしてMgOを用いた場合、200%以上のMR比が観測されている(“230% room−temperature magnetoresistance in CoFeB/MgO/CoFeB magnetic tunnel junctions”,D.D.Djayaprawira et al.,Applied Physics Letters,Vol.86,092502(2005)参照)。しかし、図3A及び図3Bのように想定される垂直異方性を有する磁性層を用いた磁気トンネル接合において、このような大きなMR比は観測されていない。そのため、情報の格納及び読み出しを適切に行うことができるか否かについて問題がある。
本発明の目的は、磁化記録層の磁気異方性が垂直方向である電流駆動磁壁移動型MRAMにおいて、情報の格納及び読み出しを適切に行うことが可能な構造を有する磁気ランダムアクセスメモリを提供することにある。
本発明の磁気ランダムアクセスメモリは、垂直磁気異方性を有する強磁性層である磁化記録層と、磁気記録層上に設けられた情報を読み出すための磁気読出し層とを具備する。磁化記録層は、反転可能な磁化を有する磁化反転領域と、磁化反転領域の第1境界に接続され磁化の向きが第1方向に固定された第1磁化固定領域と、磁化反転領域の第2境界に接続され磁化の向きが第2方向に固定された第2磁化固定領域とを備える。磁気読出し層は、磁化反転領域の磁化の方向に対応して磁化の方向が変化する磁気センス層と、磁気センス層上に設けられた非磁性バリア層と、非磁性バリア層上に設けられたピン層とを備える。
この発明の前記及びそれ以外の他の目的と特徴は、添付図面と併せて説明される以降の実施の形態の記載からより明確になるであろう。ただし、当該添付図面において、
図1は、特開2005−191032号公報の磁化記録層の構造を示す概略平面図である。 図2は、Intermag 2006 Digest,HQ−03(2006)に記載された磁気メモリセルの磁気記録層の構造を示している。 図3Aは、それぞれ想定しうる垂直磁気異方性材料を用いた磁気抵抗素子の平面図及び断面図である。 図3Bは、それぞれ想定しうる垂直磁気異方性材料を用いた磁気抵抗素子の平面図及び断面図である。 図4Aは、本実施の形態に係る磁気抵抗素子の構成の一例を示す平面図である。 図4Bは、本実施の形態に係る磁気抵抗素子の構成の一例を示す断面図である。 図4Cは、本実施の形態に係る磁気抵抗素子の構成の一例を示す断面図である。 図5は、本実施の形態に係る磁気抵抗素子の構成の変形例を示す断面図である。 図6は、本実施の形態に係る磁気抵抗素子の構成の他の変形例を示す断面図である。 図7は、本実施の形態に係る磁気抵抗素子の構成の更に他の変形例を示す断面図である。 図8は、本実施の形態に係る磁気抵抗素子の構成の更に他の変形例を示す断面図である。 図9は、本実施の形態に係る磁気抵抗素子の構成の更に他の変形例を示す断面図である。 図10は、本実施の形態に係る磁気メモリセル(磁気抵抗素子)に対するデータの書込み原理を示す断面図である。 図11Aは、本実施の形態に係る磁気メモリセル(磁気抵抗素子)に対するデータの読出し原理を示す断面図である。 図11Bは、本実施の形態に係る磁気メモリセル(磁気抵抗素子)に対するデータの読出し原理を示す断面図である。 図12Aは、本実施の形態に係る磁気抵抗素子(磁気メモリセル)の別の構成を示す断面図である。 図12Bは、本実施の形態に係る磁気抵抗素子(磁気メモリセル)の別の構成を示す断面図である。 図13は、本実施の形態に係るMRAMの構成の一例を示すブロック図である。
以下、添付図面を参照して、本発明の実施の形態に係るMRAMを説明する。本実施の形態に係るMRAMは垂直磁気異方性を持つ磁性層を用いた磁壁移動方式のMRAMである。
1.磁気メモリセルの構成
図4Aは本実施の形態に係る磁気抵抗素子の構成の一例を示す平面図である。図4B及び図4Cは、それぞれ本実施の形態に係る磁気抵抗素子の構成の一例を示す断面図である。その磁気抵抗素子2を磁気メモリセルに用いた例について説明する。図4Bは例えば“1”を記憶した場合を示し、図4Cは、例えば、“0”を記憶した場合を示す。ただし、図4B及び図4Cにおいて、白丸とバツの記号や白矢印は、各層における磁化方向を示している(以下同じ)。磁気抵抗素子2は、強磁性体層である磁気記録層10と磁気読出し層50から構成されている。磁気記録層10と磁気読出し層50との間には分離層34が配置されている。磁気記録層10の両端部には電流端子14a、14bが設けられている。磁気読出し層50には電流引き出し用の配線31が接続されている。
磁気記録層10は基板面(XY平面)に垂直な方向の異方性を持つ。材料として、Fe、Co、Niのうちから選択される少なくとも一つ以上の材料を含むことが望ましい。さらに、PtやPdを含むことで垂直磁気異方性を安定化させることができる。これに加えて、B、C、N、O、Al、Si、P、Ti、V、Cr、Mn、Cu、Zn、Zr、Nb、Mo、Tc、Ru、Rh、Ag、Hf、Ta、W、Re、Os、Ir、Au、Smなどを添加することによって所望の磁気特性が発現されるように調整することができる。具体的にはCo、Co−Pt、Co−Pd、Co−Cr、Co−Pt−Cr、Co−Cr−Ta、Co−Cr−B、Co−Cr−Pt−B、Co−Cr−Ta−B、Co−V、Co−Mo、Co−W、Co−Ti、Co−Ru、Co−Rh、Fe−Pt、Fe−Pd、Fe−Co−Pt、Fe−Co−Pd、Sm−Coなどが例示される。この他、Fe、Co、Niのうちから選択される少なくとも一つの材料を含む層が、異なる層と積層されることにより垂直方向の磁気異方性を発現させることもできる。具体的にはCo/Pd、Co/Pt、Fe/Auの積層膜などが例示される。
図4A、図4B及び図4Cに示されるように、本実施の形態に係る磁気記録層10は、第1磁化固定領域11a、第2磁化固定領域11b、及び磁化反転領域13を有している。本実施の形態において、磁化反転領域13と第1磁化固定領域11aとの境界、及び、磁化反転領域13と第2磁化固定領域との境界には、それぞれくびれ部15が形成されている。このくびれ部15は磁壁(domain wall)DWに対して、ピンポテンシャルの役割を果たす。磁化反転領域13と磁化固定領域11a、11bとの境界付近の形状・磁気特性は、この境界がピンポテンシャルの極小になる条件であれば、くびれに限定されない。
第1磁化固定領域11aと第2磁化固定領域11bの磁化は、互いに反平行な方向に固定される。尚、「磁化が固定されている」とは、書き込み動作の前後で磁化の方向が変わらないことを意味する。すなわち、書き込み動作中に、これら磁化固定領域の一部の磁化の方向が変化しても、書き込み動作終了後には元に戻り、結果として書き込み動作の前後で磁化の方向が変わらない。
一方、磁化反転領域13の磁化の向きは反転可能であり、+Z方向及び−Z方向のいずれかの向きである。図4Bに示されるように、磁化反転領域13の磁化の向きが−Z方向の場合、第1磁化固定領域11aが1つの磁区(magnetic domain)を形成し、磁化反転領域13と第2磁化固定領域11bが別の磁区を形成する。つまり、第1磁化固定領域11aと磁化反転領域13の間に磁壁DWが形成される。一方、図4Cに示されるように、磁化反転領域13の磁化の向きが+Z方向の場合、第1磁化固定領域11aと磁化反転領域13が1つの磁区を形成し、第2磁化固定領域11bが別の磁区を形成する。つまり、第1磁化固定領域11bと磁化反転領域13の間に磁壁DWが形成される。
図4B及び図4Cに示されるように、本実施の形態に係る磁気読出し層50は、磁気センス層33、トンネルバリヤ層32、ピン層30から構成され、磁気トンネル接合を形成している。磁気センス層33及びピン層30は、共に各層の面内に磁気異方性を持つ磁性膜である。すなわち、これらの層の磁気異方性の向きと、磁気記録層10の磁気異方性の向きとは略直角である。磁気センス層33及びピン層30の材料としては、Fe、Co、Niのうちから選択される少なくとも一つ以上の材料を含むことが望ましい。具体的にはNiFe、CoFe、CoFeBなどがあげられる。ピン層30の磁化の向きは、書込み動作、及び、読出し動作のいずれによっても変化しない。そのため、ピン層30の磁気異方性は磁気センス層33よりも大きいことが望ましい。これは、磁化記録層10とピン層30の材料、組成を変えることにより実現される。また、ピン層30のトンネルバリヤ層33とは反対側の面にPtMn、IrMn、FeMnなどの反強磁性体層(図示されず)を積層し、磁化をピン止めすることによっても実現される。さらにピン層30を強磁性層、非磁性層、強磁性層からなる積層膜にすることもできる。ここで、非磁性層としてはRu、Cuなどが用いられる、2つの強磁性層の磁化は互いに反平行になる。2つの強磁性層の磁化を等しくすれば、ピン層からの漏洩磁界を抑制することができる。トンネルバリヤ層32としては、Al膜やMgO膜等の薄い絶縁膜を用いることができる。
磁気読出し層50と磁気記録層10との相対位置は、磁気センス層33の磁化が磁気記録層10の磁壁DW及び磁区からの磁束に応じて、その方向が変化するように配置される。また、磁気センス層33の磁気異方性の方向、及び、ピン層30の磁気異方性の方向は、“0”状態のトンネル抵抗と“1”状態のトンネル抵抗とが異なるように定める必要がある。図4A及び図4Bにおいては、磁気読出し層50は、磁気記録層10の第1磁化固定領域11aと磁化反転領域13との境界付近に配置されている。そして、磁気センス層33の磁化容易軸、及び、ピン層30の磁化容易軸は、磁気記録層10の磁壁DWが移動する方向と垂直な方向に付与されている。磁気センス層33の磁気異方性の起源としては、図4Aに示したような形状異方性(楕円形状)の他に、結晶磁気異方性、歪み誘導異方性などを用いることができる。このとき、磁気記録層10と磁気読出し層50との間の分離層34は、その少なくとも一部としてPtMn、IrMn、FeMnなどの反強磁性体層を用いることができる。それにより、磁気センス層33の磁区の安定化をはかることもできる。
このように、本発明の磁気抵抗素子(磁気メモリセル)は、磁気記録層10における磁壁DWの位置が変更されることにより、データが書き込まれる。そのとき、磁気読出し層50の状態も磁気記録層10の状態の変化に伴い変更される。そして、その磁気記録層10の状態を反映した磁気読出し層50の状態が検知されることで、データが読み出される。
図5は、本実施の形態に係る磁気抵抗素子の構成の変形例を示す断面図である。この磁気抵抗素子2aは、分離層34を省略し、磁気記録層10の上に磁気読出し層50を直接形成している。それにより、この磁気抵抗素子2aは、書込み電流が分離34へ分流することがない。従って、書込み電流を低減することが可能になる。
図6は、本実施の形態に係る磁気抵抗素子の構成の他の変形例を示す断面図である。この磁気抵抗素子2bは、磁気センス層33aを磁気記録層10と同時に加工している。ことにより、磁気センス層33aの形状と磁気記録層10の形状とをほぼ等しくすることもできる。この場合、バリア層32より上の磁気読出し層50の加工(成形)において、バリア層32で止める(エッチングのストッパとする)ことができる。それにより、エッチングによる磁気読み出し層50の成形を高歩留りで行うことができる。
図7は、本実施の形態に係る磁気抵抗素子の構成の更に他の変形例を示す断面図である。この磁気抵抗素子2cは、磁気記録層10と磁気読出し層50との位置関係を、図4B及び図4Cとは上下反対にしている。本変形例においては、磁気読み出し層50を加工(成形)し、層間絶縁層を成膜して、CMPによる平坦化プロセスを行った後、磁気記録層10の成膜、及び、加工(成形)を行う。
図8は、本実施の形態に係る磁気抵抗素子の構成の更に他の変形例を示す断面図である。この磁気抵抗素子2dは、磁気記録層10において、第1磁化固定領域11aに重ねて第1磁化固定用磁性層19aを設け、第2磁化固定領域11bに重ねて第2磁化固定用磁性層19bを設けた例である。磁化固定用磁性層19a、19bは、それぞれ磁化固定領域11a、11bの磁化を固定する役割、及び、スピン偏極電流源としての役割を果たす。第1磁化固定用磁性層19aと第2磁化固定用磁性層19bの保磁力を変えることにより、ヒステリシスを利用して磁化固定領域11aと磁化固定領域11bの磁化を互いに反平行にすることができる。
図9は、本実施の形態に係る磁気抵抗素子の構成の更に他の変形例を示す断面図である。この磁気抵抗素子2eは、2つの磁気読出し層50a、50b設けている。磁気読出し層50a、50bは、それぞれ第1磁化固定領域11aと磁化反転領域13との境界、及び、第2磁化固定領域11bと磁化反転領域13との境界に設けられている。読み出し動作時に、2つの磁気読出し層50a、50bの各々からの信号は磁壁DWの有無により異なるので、両信号の差動出力をとることにより、読み出し信号の信号品質を高めることができる。
2.書込み動作
次に、磁気抵抗素子(磁気メモリセル)に対するデータの書込み原理を説明する。なお、他の磁気抵抗素子2a〜2eの書込み原理も同様である。
図10は、本実施の形態に係る磁気抵抗素子(磁気メモリセル)に対するデータの書込み原理を示す断面図である。データ書き込みは、スピン注入を利用した磁壁移動方式で行われる。書き込み電流Iwは、MTJを貫通する方向ではなく、磁気記録層10内を平面的に流れる。その書き込み電流Iwは、上記電流供給端子14a、14bから磁気記録層10に供給される。図10における左側の図(“0”state)に示されるように、データ“0”状態において、磁化反転領域13の磁化の向きは−Z方向である。磁壁DWは、磁化反転領域13と第2磁化固定領域11bとの境界に存在する。一方、図10における右側の図(“1”state)に示されるように、データ“1”状態において、磁化反転領域13の磁化の向きは+Z方向である。磁壁DWは、磁化反転領域13と第1磁化固定領域11aとの境界に存在する。
データ“1”の書き込み動作時、第1書き込み電流Iw1が、電流供給端子14aから供給され、第1磁化固定領域11aから磁化反転領域13を通って第2磁化固定領域11bに流れ、電流供給端子14bから送出される(図10における中央上側の図)。この場合、磁化反転領域13には、第2磁化固定領域11bからスピン電子が注入される。注入された電子のスピンは、磁化反転領域13と第2磁化固定領域11bとの境界にある磁壁DWを第1磁化固定領域11aの方向に駆動する。その結果、磁化反転領域13の磁化の向きは、+Z方向へスイッチする。つまり、スピントランスファー効果により、磁化反転領域13の磁化が反転し、その磁化の向きが+Z方向に変わる。そして、磁壁DWは、磁化反転領域13と第1磁化固定領域11aとの境界に移動する(図10における右側の図)。第1磁化固定領域11aの磁化は+Z方向、磁化反転領域13の磁化は−Z方向になる。このとき、磁気センス層33には磁化反転領域13から磁化固定領域11aに向かって+X方向の磁界がかかり、磁気センス層33の磁化は+X方向を向く。
一方、データ“0”の書き込み動作時、第2書き込み電流Iw2が、電流供給端子14bから供給され、第2磁化固定領域11bから磁化反転領域13を通って第1磁化固定領域11aに流れ、電流供給端子14aから送出される(図10における中央下側の図)。この場合、磁化反転領域13には、第1磁化固定領域11aからスピン電子が注入される。注入された電子のスピンは、磁化反転領域13と第1磁化固定領域11aとの境界にある磁壁DWを第2磁化固定領域11bの方向に駆動する。その結果、磁化反転領域13の磁化の向きは、−Z方向へスイッチする。つまり、スピントランスファー効果により、磁化反転領域13の磁化が反転し、その磁化の向きが−Z方向に変わる。そして、磁壁DWは、磁化反転領域13と第2磁化固定領域11bとの境界に移動する(図10における左側の図)。磁気センス層33付近では、磁気記録層10には磁壁DWはなく、その磁化は+Z方向を向いている。ピン層30の磁化は+Y方向に固定され、磁気センス層33の磁気異方性も同様に+Y方向である。この場合、磁気センス層33は、磁気記録層10の磁化の影響よりも形状磁気異方性により、+Y方向に向く。
このように、磁気記録層10内を平面的に流れる書き込み電流Iw1,Iw2によって、磁化反転領域13の磁化の方向がスイッチする。第1磁化固定領域11a及び第2磁化固定領域11bは、異なるスピンを有する電子の供給源の役割を果たしている。
この場合、磁気記録層10は、垂直磁気異方性材料により形成されている。そのため、書き込み電流Iw1,Iw2に対して磁気記録層10の各領域の磁化方向は垂直である。従って、書き込み電流Iw1、Iw2の大きさを著しく低減することができる。
また、ピン層30の磁界と磁気センス層33の磁気異方性と磁気記録層10の磁壁の位置との関係で書き込み動作が行われるので、誤書き込みが起こり難く、熱擾乱にも強いようにデータを書き込むことが可能となる。
3.読出し動作
次に、磁気抵抗素子(磁気メモリセル)に対するデータの読出し原理を説明する。なお、他の磁気抵抗素子2a〜2eの読出し原理も同様である。
図11A及び図11Bは、本実施の形態に係る磁気抵抗素子(磁気メモリセル)に対するデータの読出し原理を示す断面図である。データの読出しにおいては、読出し電流Iが磁気読出し層50に供給される。すなわち、読出し電流Iは配線層31からピン層30、バリア層20、磁気センス層33、分離層34、第1磁化固定領域11aを経由して、電流供給端子14aに流れる。
図11Aを参照して、データ“0”が記憶されている(図10における左側の図を参照)場合、ピン層30の磁化は+Y方向に固定されている。磁気センス層33の磁気異方性も同様に+Y方向である。このデータ“0”状態において、磁気センス層33付近では、磁気記録層10には磁壁DWはなく、その磁化は−Z方向を向いている。このとき、磁気センス層33にかかる磁界も−Z方向である。磁気センス層33は±Z方向には反磁界のため向きにくいため、磁気記録層10からの磁界によりほとんど磁化の方向を変えず、磁化容易軸方向を向く。このとき、磁気センス層33とピン層30の磁化の相対角は平行となり、磁気読出し層50のトンネル抵抗は低抵抗状態になる。この低抵抗を検出することで、データ“0”を読み出すことができる。
図11Bを参照して、データ“1”が記憶されている(図10における右側の図を参照)状態において、磁気センス層33付近では、磁気記録層10には磁壁DWが形成される。すなわち、第1磁化固定領域11aの磁化は−Z方向、磁化反転領域13の磁化は+Z方向になる。このとき、磁気センス層33には磁化反転領域13から磁化固定領域11aに向かって−X方向の磁界がかかり、磁気センス層33の磁化は−X方向を向く。このとき、磁気センス層33とピン層30の磁化の相対角は約90度となり、磁気読出し層50の抵抗は中抵抗状態になる。ここで、中抵抗状態とは抵抗変化が磁気読出し層50の最大抵抗変化の約半分であることを示している。この中抵抗を検出することで、データ“1”を読み出すことができる。
このように、本実施の形態における磁気抵抗素子では、通常のMRAMと同じ低抵抗状態と、通常のMRAMの最大抵抗状態の約半分程度の中抵抗状態との二つの状態を用いて、データを格納することができる。これにより、図3A及び図3Bの場合と比較して、MR比の大きさを十分大きく、通常のMRAM程度にすることができる。したがって、そのMR比により読み出し電流の大きさを十分に大きくとることが可能となる。
磁気センス層33、及び、ピン層30の磁気異方性の方向は図10、図11A、図11Bに示した方向以外であっても良い。図12A及び図12Bは、本実施の形態に係る磁気抵抗素子(磁気メモリセル)の別の構成を示す断面図である。図12Aでは、ピン層30の磁化固定方向を−X方向、磁気センス層33の磁気異方性を+X方向とした場合の“0”状態を示している。図12Bでは、ピン層30の磁化固定方向を−X方向、磁気センス層33の磁気異方性を−X方向とした場合の“1”状態を示している。ここで、磁気センス層33には+X方向にバイアス磁界を印加されており、磁気記録層10の磁壁DW近傍からの磁界がない場合、その磁化は+X方向を向いているとする。このバイアス磁界はピン層30端面からの漏洩磁界を利用してもよいし、別にバイアス磁界印加用の磁性層を磁気読出し層50の内部に設けても良い。図12A及び図12Bでは“0”状態は高抵抗状態、“1”状態は低抵抗状態に対応し、読出し信号として最大抵抗変化を利用できるという特徴がある。
この場合の磁気抵抗素子では、通常のMRAMと同じ低抵抗状態と、通常のMRAMの最大抵抗状態との二つの状態を用いて、データを格納することができる。これにより、図3A及び図3Bの場合と比較して、MR比の大きさを更に十分大きくし、通常のMRAM程度にすることができる。したがって、そのMR比により読み出し電流の大きさを更に十分に大きくとることが可能となる。
4.MRAMの構成
図13は、本実施の形態に係るMRAMの構成の一例を示すブロック図である。図13において、MRAM60は、複数の磁気メモリセル1がマトリックス状に配置されたメモリセルアレイ61を有している。このメモリセルアレイ61は、データの記録に用いられる磁気メモリセル1と共に、データ読み出しの際に参照されるリファレンスセル1rを含んでいる。リファレンスセル1rの構造は、磁気メモリセル1と同じである。
各磁気メモリセル1は、図4A〜図12Bに示された磁気抵抗素子2(2a〜2eを含む)に加え、選択トランジスタTR1、TR2を有している。選択トランジスタTR1のソース/ドレインの一方は、第1磁化固定領域11aの電流供給端子14aに接続され、他方は第1ビット線BL1に接続されている。選択トランジスタTR2のソース/ドレインの一方は、第2磁化固定領域11bの電流供給端子14bに接続され、他方は第2ビット線BL2に接続されている。選択トランジスタTR1、TR2のゲートはワード線WLに接続されている。磁気メモリセル1のピン層30は、電流引き出し用の配線31を介して図のようにグランド線Gに接続されている。
ワード線WLは、Xセレクタ62に接続されている。Xセレクタ62は、データの書込み動作時、及び読出し動作時において、対象メモリセル1sにつながるワード線WLを選択ワード線WLsとして選択する。第1ビット線BL1はY側電流終端回路64に接続されており、第2ビット線BL2はYセレクタ63に接続されている。Yセレクタ63は、対象メモリセル1sにつながる第2ビット線BL2を選択第2ビット線BL2sとして選択する。Y側電流終端回路64は、対象メモリセル1sにつながる第1ビット線BL1を選択第1ビット線BL1sとして選択する。
Y側電流源回路65は、データ書込み動作時、選択第2ビット線BL2sに対し、所定の書き込み電流(Iw1,Iw2)の供給又は引き込みを行う。Y側電源回路66は、データ書き込み動作時、Y側電流終端回路64に所定の電圧を供給する。その結果、書き込み電流(Iw1,Iw2)は、Yセレクタ63へ流れ込む、あるいは、Yセレクタ63から流れ出す。これらXセレクタ62、Yセレクタ63、Y側電流終端回路64、Y側電流源回路65、及びY側電源回路66は、磁気メモリセル1に書き込み電流Iw1,Iw2を供給するための「書き込み電流供給回路」を構成している。
データ読み出し動作時、第1ビット線BL1は“Open”に設定される。読み出し電流負荷回路67は、選択第2ビット線BL2sに所定の読み出し電流を流す。また、読み出し電流負荷回路67は、リファレンスセル1rにつながるリファレンス第2ビット線BL2rに所定の電流を流す。センスアンプ68は、リファレンス第2ビット線BL2rの電位と選択第2ビット線BL2sの電位の差に基づいて、対象メモリセル1sからデータを読み出し、そのデータを出力する。
本発明では、磁気読出し層が、磁化記録層とは独立に磁気トンネル結合を有している。そして、書込み動作により磁気記録層の状態を変化させると、磁気読み出し層は、磁気記録層に近接して設けられているので、その変化の影響を受ける。その結果、磁気読み出し層の磁気トンネル結合の状態も変化する。従って、その磁気トンネル結合の状態を検知することで、データを読み出すことができる。この場合、書込み電流の大きさを左右するのは、磁気記録層が垂直磁気異方性を有しているか否かである。本発明では、磁気記録層は垂直磁気異方性を有しているので、書き込み電流の大きさを著しく低減することができる。一方、出力信号の大きさを左右するのは、磁気トンネル結合のMR比の大きさである。本発明では、磁気トンネル結合が垂直磁気異方性を有するように構成する必要がない。そのため、磁気トンネル結合をMR比の大きい磁気トンネル結合にすることができるので、出力信号を大きくすることが可能となる。それにより、本発明では、磁化記録層の磁気異方性が垂直方向である電流駆動磁壁移動型MRAMにおいて、信号出力を大きくして情報の格納及び読み出しを適切に行うことが可能となる。
以上、実施形態を本発明を説明したが、本発明は上記実施形態に限定されるものではない。本発明の構成や詳細には、本発明のスコープ内で当業者が理解しうる様々な変更をすることができる。
この出願は、2007年8月3日に出願された特許出願番号2007−202943号の日本特許出願に基づいており、その出願による優先権の利益を主張し、その出願の開示は、引用することにより、そっくりそのままここに組み込まれている。

Claims (10)

  1. 垂直磁気異方性を有する強磁性層である磁化記録層と、
    前記磁気記録層上に設けられた情報を読み出すための磁気読出し層と
    を具備し、
    前記磁化記録層は、
    反転可能な磁化を有する磁化反転領域と、
    前記磁化反転領域の第1境界に接続され、磁化の向きが第1方向に固定された第1磁化固定領域と、
    前記磁化反転領域の第2境界に接続され、磁化の向きが第2方向に固定された第2磁化固定領域と
    を備え、
    前記磁気読出し層は、
    前記磁化反転領域の磁化の方向に対応して磁化の方向が変化する磁気センス層と、
    前記磁気センス層上に設けられた非磁性バリア層と、
    前記非磁性バリア層上に設けられたピン層と
    を備える
    磁気ランダムアクセスメモリ。
  2. 請求の範囲1に記載の磁気ランダムアクセスメモリであって、
    前記磁気センス層の磁気異方性は、面内である
    磁気ランダムアクセスメモリ。
  3. 請求の範囲1に記載の磁気ランダムアクセスメモリであって、
    前記磁気読み出し層が、前記第1境界付近、前記第2境界付近、及び、前記第1境界付近及び前記第2境界付近の両方、のいずれかの位置に設けられている
    磁気ランダムアクセスメモリ。
  4. 請求の範囲1に記載の磁気ランダムアクセスメモリであって、
    前記ピン層の磁化固定方向は、面内、かつ、前記磁気記録層に印加する書込み電流方向と直交している
    磁気ランダムアクセスメモリ。
  5. 請求の範囲1に記載の磁気ランダムアクセスメモリであって、
    前記ピン層の磁化固定方向は、面内、かつ、前記磁気記録層に印加する書込み電流方向と平行であることを特徴とする磁気ランダムアクセスメモリ。
  6. 請求の範囲5に記載の磁気ランダムアクセスメモリであって、
    前記磁気センス層の磁気異方性は、面内、かつ、前記磁気記録層に印加する書込み電流方向と平行又は直交である
    磁気ランダムアクセスメモリ。
  7. 請求の範囲6に記載の磁気ランダムアクセスメモリであって、
    前記磁気センス層にはバイアス磁界が印加されている
    磁気ランダムアクセスメモリ。
  8. 請求の範囲1に記載の磁気ランダムアクセスメモリであって、
    前記磁化記録層と前記磁気読出し層との間に設けられた非強磁性金属を更に具備する
    磁気ランダムアクセスメモリ。
  9. 請求の範囲1に記載の磁気ランダムアクセスメモリであって、
    前記磁化記録層と前記磁気センス層とが直接接する
    磁気ランダムアクセスメモリ。
  10. 請求の範囲1に記載の磁気ランダムアクセスメモリであって、
    前記磁化記録層は、
    前記第1磁化固定領域に接して設けられ、磁化の向きが第1方向に固定された第1磁化固定用磁性層と、
    前記第2磁化固定領域に接して設けられ、磁化の向きが第2方向に固定された第2磁化固定用磁性層と
    を更に備える
    磁気ランダムアクセスメモリ。
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Families Citing this family (23)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2009093387A1 (ja) * 2008-01-25 2009-07-30 Nec Corporation 磁気ランダムアクセスメモリ及びその初期化方法
WO2009104428A1 (ja) * 2008-02-19 2009-08-27 日本電気株式会社 磁気ランダムアクセスメモリ
US8787076B2 (en) * 2008-09-02 2014-07-22 Nec Corporation Magnetic memory and method of manufacturing the same
WO2010087271A1 (ja) * 2009-01-28 2010-08-05 日本電気株式会社 不揮発ロジック回路
JP5483025B2 (ja) * 2009-01-30 2014-05-07 日本電気株式会社 磁気メモリ素子、磁気メモリ
JP5150531B2 (ja) * 2009-03-03 2013-02-20 ルネサスエレクトロニクス株式会社 磁気抵抗素子、磁気ランダムアクセスメモリ、及びそれらの製造方法
JP2010219104A (ja) * 2009-03-13 2010-09-30 Nec Corp 磁気メモリ素子、磁気メモリ、及びその製造方法
KR101598831B1 (ko) * 2009-10-14 2016-03-03 삼성전자주식회사 자기저항소자, 이를 포함하는 정보저장장치 및 상기 정보저장장치의 동작방법
KR101598833B1 (ko) * 2009-12-21 2016-03-03 삼성전자주식회사 자기 메모리 소자 및 그 동작방법
WO2011093363A1 (ja) * 2010-01-29 2011-08-04 株式会社アルバック 記憶素子及び記憶方法
JP5786341B2 (ja) 2010-09-06 2015-09-30 ソニー株式会社 記憶素子、メモリ装置
JP5803079B2 (ja) * 2010-09-13 2015-11-04 ソニー株式会社 記憶素子、メモリ装置
US8704320B2 (en) 2011-09-12 2014-04-22 Qualcomm Incorporated Strain induced reduction of switching current in spin-transfer torque switching devices
US9208845B2 (en) * 2011-11-15 2015-12-08 Massachusetts Instiute Of Technology Low energy magnetic domain wall logic device
JP5836163B2 (ja) * 2012-03-08 2015-12-24 ルネサスエレクトロニクス株式会社 磁気メモリセル、磁気メモリセルの製造方法
US9117523B1 (en) * 2012-05-01 2015-08-25 Iron City Integrated Circuits Chainlink memory
US20140003118A1 (en) * 2012-07-02 2014-01-02 International Business Machines Corporation Magnetic tunnel junction self-alignment in magnetic domain wall shift register memory devices
EP2712079B1 (en) 2012-09-25 2015-06-03 Crocus Technology S.A. Magnetic logic unit (MLU) cell and amplifier having a linear magnetic signal
EP2712078B1 (en) 2012-09-25 2015-06-03 Crocus Technology S.A. Magnetic logic unit (MLU) cell and amplifier having a linear magnetic signal
JP6093146B2 (ja) * 2012-10-25 2017-03-08 株式会社東芝 磁性細線を有する磁気メモリおよびその書き込み方法
JP6219200B2 (ja) * 2014-02-27 2017-10-25 株式会社東芝 磁気装置
US9779865B2 (en) * 2014-10-17 2017-10-03 The Arizona Board Of Regents On Behalf Of The University Of Arizona Voltage-controlled magnetic devices
CN108666339B (zh) * 2017-03-28 2020-11-13 中芯国际集成电路制造(上海)有限公司 磁性随机存储器及其存储单元的制造方法

Family Cites Families (24)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5640343A (en) 1996-03-18 1997-06-17 International Business Machines Corporation Magnetic memory array using magnetic tunnel junction devices in the memory cells
US6055179A (en) * 1998-05-19 2000-04-25 Canon Kk Memory device utilizing giant magnetoresistance effect
JP3550524B2 (ja) 2000-03-10 2004-08-04 シャープ株式会社 磁気抵抗効果素子及びそれを用いた磁気メモリ
JP2003045010A (ja) 2000-08-04 2003-02-14 Tdk Corp 磁気抵抗効果装置およびその製造方法ならびに薄膜磁気ヘッドおよびその製造方法
JP3854836B2 (ja) * 2001-09-28 2006-12-06 キヤノン株式会社 垂直磁化膜を用いた磁気メモリの設計方法
US6545906B1 (en) 2001-10-16 2003-04-08 Motorola, Inc. Method of writing to scalable magnetoresistance random access memory element
JP3863484B2 (ja) 2002-11-22 2006-12-27 株式会社東芝 磁気抵抗効果素子および磁気メモリ
US6834005B1 (en) 2003-06-10 2004-12-21 International Business Machines Corporation Shiftable magnetic shift register and method of using the same
JP2005093488A (ja) 2003-09-12 2005-04-07 Sony Corp 磁気抵抗効果素子とその製造方法、および磁気メモリ装置とその製造方法
US6970379B2 (en) 2003-10-14 2005-11-29 International Business Machines Corporation System and method for storing data in an unpatterned, continuous magnetic layer
JP4143020B2 (ja) 2003-11-13 2008-09-03 株式会社東芝 磁気抵抗効果素子および磁気メモリ
JP4413603B2 (ja) * 2003-12-24 2010-02-10 株式会社東芝 磁気記憶装置及び磁気情報の書込み方法
EP1708257B1 (en) 2004-01-15 2010-11-24 Japan Science and Technology Agency Current injection magnetic domain wall moving element
US7099729B2 (en) 2004-02-20 2006-08-29 Powerchip Semiconductor Corp. Semiconductor process and yield analysis integrated real-time management method
JP2006073930A (ja) * 2004-09-06 2006-03-16 Canon Inc 磁壁移動を利用した磁気抵抗効果素子の磁化状態の変化方法及び該方法を用いた磁気メモリ素子、固体磁気メモリ
JP4920881B2 (ja) 2004-09-27 2012-04-18 株式会社日立製作所 低消費電力磁気メモリ及び磁化情報書き込み装置
JP4945721B2 (ja) 2004-10-27 2012-06-06 国立大学法人東北大学 磁気抵抗効果素子及び磁気メモリ装置
JP4932275B2 (ja) 2005-02-23 2012-05-16 株式会社日立製作所 磁気抵抗効果素子
JP2006287081A (ja) 2005-04-04 2006-10-19 Fuji Electric Holdings Co Ltd スピン注入磁区移動素子およびこれを用いた装置
WO2007020823A1 (ja) 2005-08-15 2007-02-22 Nec Corporation 磁気メモリセル、磁気ランダムアクセスメモリ、及び磁気ランダムアクセスメモリへのデータ読み書き方法
JP2007103663A (ja) 2005-10-04 2007-04-19 Toshiba Corp 磁気素子、記録再生素子、論理演算素子および論理演算器
JP5077732B2 (ja) * 2006-03-23 2012-11-21 日本電気株式会社 磁気メモリセル、磁気ランダムアクセスメモリ、半導体装置及び半導体装置の製造方法
JP2007317895A (ja) * 2006-05-26 2007-12-06 Fujitsu Ltd 磁気抵抗メモリ装置
JP5299735B2 (ja) * 2007-08-24 2013-09-25 日本電気株式会社 磁壁ランダムアクセスメモリ

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