JP2007317895A - 磁気抵抗メモリ装置 - Google Patents
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Abstract
【課題】
磁壁を安定に移動することができる多値磁気メモリ装置を提供する。
【解決手段】
磁気抵抗メモリ装置は、
磁化方向が第1の方向に固定された固定磁化層と、
前記固定磁化層上に形成されたトンネルバリア絶縁層と、
前記トンネルバリア絶縁層を介して前記固定磁化層に対向する自由磁化層であって、前記トンネルバリア絶縁層に接する活性部と、前記活性部両側に配置された2つの待機部とを有し、内部に渦型構造の磁壁と該磁壁の一方側で前記第1の方向に磁化した第1の磁区と該磁壁の他方側で前記第1の方向と逆の第2の方向に磁化した第2の磁区とを含み、前記活性部、前記2つの待機部のそれぞれに対応して前記磁壁をピン止めする機能を有する3つのピン止め構造を備えた自由磁化層と、
を有する。
【選択図】 図1
磁壁を安定に移動することができる多値磁気メモリ装置を提供する。
【解決手段】
磁気抵抗メモリ装置は、
磁化方向が第1の方向に固定された固定磁化層と、
前記固定磁化層上に形成されたトンネルバリア絶縁層と、
前記トンネルバリア絶縁層を介して前記固定磁化層に対向する自由磁化層であって、前記トンネルバリア絶縁層に接する活性部と、前記活性部両側に配置された2つの待機部とを有し、内部に渦型構造の磁壁と該磁壁の一方側で前記第1の方向に磁化した第1の磁区と該磁壁の他方側で前記第1の方向と逆の第2の方向に磁化した第2の磁区とを含み、前記活性部、前記2つの待機部のそれぞれに対応して前記磁壁をピン止めする機能を有する3つのピン止め構造を備えた自由磁化層と、
を有する。
【選択図】 図1
Description
本発明は、磁気メモリ装置に関し、特に磁壁を移動させることにより情報を書き込むことのできる磁気抵抗メモリ装置に関する。
不揮発性磁気ランダムアクセスメモリ(MRAM)は、ダイナミックランダムアクセスメモリ(DRAM)、フラッシュ(FLASH)メモリに代わる次世代の超大容量不揮発性メモリの有力候補として注目されている。MRAMの1例である磁性トンネル接合(MTJ)素子は、トンネルバリア絶縁層を介して2層の強磁性体層を対向させ、トンネル電流を流す時の磁気抵抗を利用する。
一方の強磁性層は、反強磁性層あるいはフェリピンド構造を用いて磁化を固定して固定磁化層とする。他方の強磁性層は、磁化を変更できる自由磁化層とする。例えば、対向する2層の強磁性体層の磁化を平行か反平行に制限する構成とすると、自由磁化層の磁化が固定磁化層の磁化と平行の時、トンネル電流に対する抵抗は低く、反平行のときトンネル電流に対する抵抗は高い。
MTJ素子の近傍に互いに交差する配線(例えばビット線とワード線)を配置し、パルス電流を流すことにより自由磁化層に外部磁界を印加して、磁化方向を書き換えることができる。目的とするMTJ素子の周囲に磁界が漏洩すると、誤書き込みが生じうる。
特開2000−195250号は、強磁性層の少なくとも一方と配線層を積層構造とすることを提案する。例えば、2層の強磁性層を交差するように対向配置し、その外側に配線層を積層した構造を用いる。交差部が行列状に形成される構造の場合、固定磁化層を構成する強磁性層は交差部のみに配置してもよい。自由磁化層を構成する強磁性層に括れを形成して、磁壁を積極的にピン止めする構成も提案している。
特開2002−299584号は、配線と強磁性層とを兼用する構成を提案している。例えば、ビット線を強磁性体で形成し、固定磁化層を兼ねさせる。ビット線の全体を強磁性体で作成する必要はなく、自由磁化層と対向する部分のみを強磁性体で作成してもよい。自由磁化層を配線として利用してもよい。
自由磁化層に、例えば固定磁化層からスピン偏極した電流を流すこと、いわゆるスピン注入、によって磁化を反転することもできる。書き込み時の消費電力を低くしようとすると、トンネルバリア層を薄くすることが望まれる。トンネルバリア層をある程度以上薄くすると、反平行/平行の磁気抵抗(MR)比が低下して、読み出し時のマージンを低下させる。また、使用時間の経過と共にトンネルバリア層に劣化が生じることもある。
特表2005−535111号は、磁化がN個の安定位置を有する強磁性層を自由磁化層として用いた多値MRAMを提案する。
Phys. Rev. L. 92,p.077205-1 (2004)は、中間で円弧状に約90度曲げられ、両端に電極を接続したた強磁性細線を形成し、磁界を印加して、一旦一方向に一様な磁化を生じさせ、次に逆方向に弱い磁界を印加して磁壁を形成したサンプルを作成している。強磁性細線に電流を流すと、磁壁が電流と逆方向、すなわち電子の流れる方向に移動することが報告されている。実験に用いた強磁性細線は、厚さ0.1μm未満、幅240nm、端部が磁壁の発生を防止するように先鋭化したx方向延在部の長さ10μm、y方向延在部の長さ10μm、x方向延在部とy方向延在部との接続部の円弧の半径約3μmである。
特開2006−005308号は、磁気ヒステリシス特性を有する材料で棒状磁性層を形成し、両端と中央部に電極を形成したメモリを提案する。印加した外部磁界を減少させて磁壁を生じさせた後、棒状磁性層に電流を流して磁壁を電流と逆方向に移動させ、情報を記憶する。中央部の電極の左側に磁壁があるか、右側に磁壁があるかによって変化する、右部分、左部分の少なくとも一方の抵抗、または右部分と左部分の抵抗の差を検出して情報を読み出す。磁壁の位置を安定化するため、棒状磁性膜の左部分及び右部分に狭窄部を形成することも提案する。
特開2006−073930号は、固定磁化層と自由磁化層を面垂直方向に異方性を有する磁性層とし、自由磁化層を固定磁化層との対向部より両側に張り出し、2つの磁区とその間の磁壁を有する構成とし、固定磁化層をビット線に、自由磁化層を書き込み配線に接続し、ビット線、書き込み配線に電流を流して磁壁を移動させることで情報を書き込み、ビット線、書き込み配線間にトンネル電流を流して抵抗を検出することで読み出しを行うMTJメモリ装置を提案する。
本発明の目的は、磁壁を安定に移動することができる多値磁気抵抗メモリ装置を提供することである。
本発明の他の目的は、消費電力が低く、磁壁を電流によって安定に移動することにより情報を書き換える多値磁気抵抗メモリ装置を提供することである。
本発明の1観点によれば、
磁化方向が第1の方向に固定された固定磁化層と、
前記固定磁化層上に形成されたトンネルバリア絶縁層と、
前記トンネルバリア絶縁層を介して前記固定磁化層に対向する自由磁化層であって、前記トンネルバリア絶縁層に接する活性部と、前記活性部両側に配置された2つの待機部とを有し、内部に渦型構造の磁壁と該磁壁の一方側で前記第1の方向に磁化した第1の磁区と該磁壁の他方側で前記第1の方向と逆の第2の方向に磁化した第2の磁区とを含み、前記活性部、前記2つの待機部のそれぞれに対応して前記磁壁をピン止めする機能を有する3つのピン止め構造を備えた自由磁化層と、
を有する磁気抵抗メモリ装置
が提供される。
磁化方向が第1の方向に固定された固定磁化層と、
前記固定磁化層上に形成されたトンネルバリア絶縁層と、
前記トンネルバリア絶縁層を介して前記固定磁化層に対向する自由磁化層であって、前記トンネルバリア絶縁層に接する活性部と、前記活性部両側に配置された2つの待機部とを有し、内部に渦型構造の磁壁と該磁壁の一方側で前記第1の方向に磁化した第1の磁区と該磁壁の他方側で前記第1の方向と逆の第2の方向に磁化した第2の磁区とを含み、前記活性部、前記2つの待機部のそれぞれに対応して前記磁壁をピン止めする機能を有する3つのピン止め構造を備えた自由磁化層と、
を有する磁気抵抗メモリ装置
が提供される。
トンネルバリア絶縁層を介して固定磁化層と対向する、自由磁化層の活性部に、磁壁をはさんで形成された2つの磁区、及び磁壁のいずれを配置するかにより3値のメモリを実現する。ピン止め構造を備えることにより、磁壁を3箇所の内選択した位置に安定に配置することができる。
山口他は、Phys. Rev.L. 92, p.077205-1 (2004)において、幅240nmの磁気細線に逆向きの2つの磁区を形成すると、逆方向の磁区の間に渦型磁壁(vortexdomain wall)が形成されることを磁力顕微鏡による観察とシミュレーションにより結論付けた。観察された磁壁はサブミクロンの寸法を有する。磁気細線に電流を流すと、磁壁は電流方向と逆方向に、電流値に比例した距離移動する。磁壁を移動させる電流値には閾値が存在する。観察された閾値は、1.0×1012A/m2であった。
本発明者らは、先に、磁気トンネル接合(MTJ)構造において、自由磁化層を磁気細線で構成し、磁化方向が逆の2つの磁区を形成し、自由磁化層に閾値以上の電流を流して固定磁化層と対向する部分にどちらか一方の磁区を配置する(情報を書き込む)ことにより、“0”、“1”の情報を記憶するメモリを提案した。読み出しは閾値未満の電流で行えば、非破壊読み出しが行える。
本発明者らは、今回、1つのMTJメモリ素子で3値の記憶を行い、記憶容量を増加できる磁気メモリを検討した。
図1A−1Dは、本発明の実施例によるMTJメモリ素子の構成を概略的に示す断面図、自由磁化層の平面図、自由磁化層内の磁壁を示す平面図、自由磁化層の磁化状態と出力電圧の関係を示すグラフである。
図1Aにおいて、固定磁化層1はトンネルバリア絶縁層2を介して自由磁化層3と対向する。固定磁化層1の磁化方向は反強磁性層4の磁化方向によって固定されている。固定磁化層1は、例えば、磁性層1a、非磁性導電層1b、磁性層1cを積層したフェリピンド構造で構成される。複数の磁性層がある場合、固定磁化層の磁化方向とは、自由磁化層と対向する最上磁性層の磁化方向を指す。自由磁化層3は固定磁化層1の両側にも延びている。
図1Bは、自由磁化層3の平面構成を示す。自由磁化層3は細長い平面形状を有し、中央部に固定磁化層1と対向して磁性トンネル接合MTJを構成する活性部6が配置され、その両側に磁壁移動を許容するための待機部7a、7bが配置されている。自由磁化層3の両側面には、自由磁化層3の幅を減少させる対向ノッチ5が3箇所に形成されている。なお、ノッチを三角形で図示したが、ノッチは部分的に幅ないし断面積が減少し、磁壁をピニングできるものであればよい。三角形の変形したもの(角を丸めたものなど)、四角形、円形などである場合を含む。
図1Cは、自由磁化層にヘッド・ツ・ヘッドの磁区MD1,MD2を形成した状態を示す。磁区MD1,MD2の間には渦型の磁壁DWが形成される。磁壁DW内の磁化方向は渦状に分布している。磁壁DWは種々の磁化方向を含み、全体としては磁化のない領域とみなせる。自由磁化層3内で磁壁DWを移動させると、磁壁DWの移動に伴い、左右の磁区MD1,MD2の長さが増減する。
図1Aに示すように、書き込み回路8が待機部7a、7b、例えば自由磁化層3の両端、に接続され、図中右向き、または左向きの電流を供給できる。自由磁化層3に右向きの電流を流すと、磁壁DWは電流方向と逆向き、左向き、に移動する。自由磁化層3に左向きの電流を流すと、磁壁DWは右向きに移動する。磁壁DWの移動量は、ほぼ電流値に比例するが、自由磁化層3内の欠陥分布により変化する。従って、磁壁の位置を電流値のみによって制御しようとすると位置精度が低くなる。
図1Bに示すように、自由磁化層3にノッチ5を形成すると、ノッチ5は磁壁DWを積極的にピン止めする機能を発揮する。両側面に対向するノッチを形成することにより、確実に磁壁の位置を安定化することができる。自由磁化層3の3箇所に対向ノッチを形成すると、磁壁DWのピン止め位置が3箇所設定される。
図1Aに示すように、読み出し回路9が固定磁化層1(反強磁性層4)と自由磁化層3の間に接続され、トンネル電流を流すことにより磁気トンネル抵抗を検出する。磁壁の駆動用に自由磁化層の両端には電極が形成されるので、これらの電極を利用してもよい。固定磁化層1の磁化方向が右向きであるとすると、同じ向きの磁化を有する磁区MD1に接続される左側の電極を利用すればよい。より直接的に自由磁化層3の活性部6上に読み出し用電極を形成して、固定磁化層1との間の抵抗を検出しもよい。
磁壁を左側の待機部7aに位置付けると、活性部6は左向きの磁区MD2で占有される。磁化方向が反平行となり磁気トンネル抵抗は高い。磁壁DWを右側の待機部7bに位置付けると、活性部6は右向きの磁区MD1で占有される。固定磁化層1の磁化方向と自由磁化層3の磁化方向が平行となり、磁気トンネル抵抗は低い。磁壁DWを中央の活性部6に位置付けると、活性部6には磁壁DWが配置される。活性部6の左右に磁区MD1,MD2が等量入り込んでも、全体として磁化のない状態は変わらない。この状態のMTJ接合の磁気トンネル抵抗は、平行、反平行の中間の値となる。
活性部6に読み出し電極を接続した場合は、磁気トンネル抵抗を直接的に測定できる。待機部に接続された電極を用いる場合は、固定磁化層の磁化方向と同じ磁化方向を有する磁区が接続される電極を用いるのがよい。逆の磁化方向を有する磁区に接続された電極を用いると、トンネル抵抗が低い時は磁壁が中間に入り、トンネル抵抗が高いときは磁壁は入らないので、抵抗変化が小さくなってしまう。図示の場合は、左側の磁区MD1が固定磁化層と同じ磁化方向を有する場合である。
自由磁化層の左側待機部7aの電極と固定磁化層との間の抵抗を検出すると、検出する抵抗は待機部7a活性部6の自由磁化層の抵抗と磁気トンネル抵抗と固定磁化層の抵抗となる。固定磁化層の抵抗は変化しないので無視すると、磁壁DWが右側待機部7bにある時は、磁区MD1が待機部7aから活性部6まで延在し自由磁化層の抵抗は低く、活性部6の磁化方向は固定磁化層1の磁化方向と同じなのでトンネル抵抗も低く、検出される抵抗は低い。磁壁DWが左側待機部7aにある時は、待機部7aから活性部までの間に磁区MD1,磁壁DW,磁区MD2が存在し、磁壁DWの存在によって抵抗が高くなり、さらに活性部6の磁化方向は固定磁化層1の磁化方向と反対なのでトンネル抵抗も高く、検出される抵抗は高い。磁壁DWが活性部6にあるときは、これらの中間となる。
図1Dは、上述した自由磁化層の活性部6の磁化状態とトンネル磁気抵抗を介して検出される出力の関係を示す。活性部6の磁化方向が固定磁化層1の磁化方向と反平行の場合、出力は高く“2”である。活性部6に磁壁DWがある場合、出力は中間で“1”である。活性部6の磁化方向が固定磁化層1の磁化方向と平行の場合、出力は低く“0”である。このように3値のメモリが提供される。
以上、単一のMTJメモリ素子の構成を説明したが、メモリ回路を構成するときの等価回路を以下説明する。
図2Aに示すように、固定磁化層1と自由磁化層3とを含むMTJメモリ素子と自由磁化層3の1端に接続されたトランジスタTrによってメモリ素子が形成される。多数のメモリ素子が行列状に配置され、第1ビット線B1,第2ビット線B2が行方向に沿って各行に配置され、ソース線SL,ワード線WLが列方向に沿って各列に配置されている。トランジスタTrの自由磁化層3に接続された端子をドレインとすると、ソースはソース線SLに接続される。自由磁化層3の他端を第1ビット線BL1に接続して書き込み経路が形成される。さらに、固定磁化層1をビット線BL2に接続することにより読み出し経路が形成される。
図3Aは、図1の書き込み回路8に含まれるパルス回路の例を示す。パルス源81は、パルス電流を供給する。極性反転回路82は、パルスの極性を反転することができる。自由磁化層に流す電流の向きを反転することができる。
図3Bは、読み出し回路9に含まれる比較器91を示す。比較器91には低圧側参照電圧REF1、高圧側参照電圧REF2と共に読み出し信号電圧SIGが供給される。比較器91は、読み出し信号電圧SIGが低圧側参照電圧REF1より低いか、高圧側参照電圧REF2より高いか、両参照電圧の中間かを判定し、3値の出力信号を供給する。
図2Aにおいて、ワード線WLを選び、対応するソース線SLに電圧を供給すると、ある列が選択される。第1ビット線BL1を選択すると交差部のメモリ素子が選択される。ソース線SL、第1ビット線BL1間に電流を流すことにより磁壁を次のピン止め位置まで移動できる。電流方向を反転すると、磁壁の移動方向も反転する。このようにして、書き込みを行える。
第1ビット線に代え、第2ビット線BL2の1つを選択すると、読み出し用に1つのメモリ素子が選択される。ソース線SL,第2ビット線BL2の間に電流を流し、信号電圧SIGを発生させる。図3Bに示した比較器91が、読み出し電圧が“0”か、“1”か、“2”かを判定し、出力信号を供給する。このようにしてメモリの読み出しが行える。
図2Bは、変形例を示す。ワード線WLが列方向の代わりに、行方向に沿って配置されている。ソース線SL,ワード線WLを選択することにより、1つのメモリ素子が選択される。第1ビット線BL1,第2ビット線BL2はワード線WLと同一行のものを選択する。
図4は、図2Aの回路を実施した半導体磁気メモリ装置の構成例を示す。シリコン基板10に素子分離領域12が形成され、活性領域ARを画定する。p型不純物例えばBをイオン注入して、活性領域をp型ウェルにする。活性領域AR表面に酸化シリコン膜等のゲート絶縁膜13を形成し、その上に多結晶シリコン膜等のゲート電極14(ワード線WLを兼ねる)を形成する。ゲート電極14両側の活性領域内にn型不純物PまたはAsをイオン注入し、ソース領域16、ドレイン領域18のエクステンション領域を形成する。サイドウォール形成後n型不純物のイオン注入を行い、ソース領域16、ドレイン領域18の高濃度領域を形成する。このようにして、MOS型の選択トランジスタが形成される。
選択トランジスタを覆って、酸化シリコン膜等の第1層間絶縁膜20を堆積する。なお、層間絶縁膜は、必要に応じて化学機械研磨(CMP)などにより表面を平坦化するものとする。第1層間絶縁膜20を貫通してソース領域16、ドレイン領域18に達するコンタクト孔をエッチングする。TiNバリア層、W層を埋め込み、コンタクトプラグ24,25を形成する。コンタクトプラグ上にAl合金などの配線層を形成し、パターニングしてソース線SL,パッド26を形成する。ソース線SL,ワード線WLは紙面垂直方向に延在する。
ソース線SL,パッド26を覆って、酸化シリコン膜等の第2層間絶縁膜28を堆積する。第2層間絶縁膜28上にアルミ合金等で第2ビット線BL2を形成する。第2ビット線BL2を覆って、酸化シリコン膜等で第3層間絶縁膜32を堆積する。
第3層間絶縁膜32表面から第2ビット線BL2に達する接続孔を形成し、導電性プラグ36を埋め込む。第3層間絶縁膜32の上に、導電性プラグ36に接続されるように例えばTa膜の下部電極層38、例えばPtMn膜の反強磁性膜4、下からCoFe膜/Ru膜/CoFeB膜の積層からなるフェリピンド構造の固定磁化層1、MgOのトンネルバリア絶縁層2を形成する。積層構造をパターニングした後、酸化シリコン膜等の第4層間絶縁膜44を堆積する。第4層間絶縁膜44表面からパッド26に達する接続孔を形成し、TiN層、W層を埋め込み、導電性プラグ48を形成する。
第4層間絶縁膜44の上に例えばNiFe膜の自由磁化層3を堆積し、導電性プラグ48、トンネルバリア絶縁層2を覆う磁気細線形状にパターニングする。なお、磁気細線は図1Bに示すように3箇所に対向ノッチを持つようにパターニングする。MTJ構造のメモリ素子が形成される。自由磁化層3を覆って、第4層間絶縁膜44上に酸化シリコン膜等の第5層間絶縁膜56を堆積する。
第5層間絶縁膜56表面から自由磁化層3の他端に接続されるTiN/Wなどの導電性プラグ60を埋め込む。第5層間絶縁膜56上に導電性プラグ60に接続されるAl合金等の第1ビット線BL1を形成する。
このようにして半導体磁気メモリ装置が形成される。なお、以上説明した構成は例示であり、種々の変更が可能である。例えば、反強磁性層は、Re,Ru,Rh,Pd,IrPt,Cr,Fe,Ni,Cu,Ag,AuのいずれかとMnとを含む反強磁性材料で構成することができる。強磁性層は、Co,Fe,Niのいずれかを含む強磁性材料で形成することができる。フェリピンド構造の比磁性膜はRu,Rh,Cr等の導電性非磁性材料で形成できる。トンネルバリア絶縁層は、Mg,Al,Hf,Ti,V,Ta,Siのいずれかを含む酸化物材料、酸化窒化物材料、窒化物材料で形成できる。自由磁化層に接続される配線を自由磁化層の下方及び上方の2層の配線で形成したが、同一配線層で形成することもできる。自由磁化層に電流を流して磁壁を移動する場合を説明したが、特開2006−073930号公報、実施例の欄、段落0023−0043、図1−5に開示するように、自由磁化層に磁界を印加して磁壁を移動することもできる。
その他種々の変更、置換、改良、組合わせ等が可能なことは当業者に自明であろう。
その他種々の変更、置換、改良、組合わせ等が可能なことは当業者に自明であろう。
1 固定磁化層
2 トンネルバリア絶縁層
3 自由磁化層
4 反強磁性層
5 ノッチ
6 活性部
7 待機部
8 書き込み回路
9 読み出し回路
DW 磁壁
MD 磁区
SL ソース線
BL ビット線
WL ワード線
Tr (選択)トランジスタ
2 トンネルバリア絶縁層
3 自由磁化層
4 反強磁性層
5 ノッチ
6 活性部
7 待機部
8 書き込み回路
9 読み出し回路
DW 磁壁
MD 磁区
SL ソース線
BL ビット線
WL ワード線
Tr (選択)トランジスタ
Claims (4)
- 磁化方向が固定された固定磁化層と、電流により磁化方向を反転させることができる自由磁化層と、該固定磁化層と該自由磁化層に挟持されたトンネルバリア絶縁層とを有する磁気メモリ装置において、
少なくとも自由磁化層にノッチが形成された磁気抵抗メモリ装置。 - 前記固定磁化層の磁化方向が第1の方向であり、
前記自由磁化層が、前記トンネルバリア絶縁層に接する活性部と、前記活性部両側に配置された2つの待機部とを有し、内部に渦型構造の磁壁と該磁壁の一方側で前記第1の方向に磁化した第1の磁区と該磁壁の他方側で前記第1の方向と逆の第2の方向に磁化した第2の磁区とを含み、前記活性部、前記2つの待機部のそれぞれに対応して前記磁壁をピン止めするノッチを備えた請求項1記載の磁気抵抗メモリ装置。 - 前記自由磁化層の待機部に接続され、前記自由磁化層に前記磁壁を横断する電流を供給し、前記磁壁を電流方向と逆の方向に移動できる書き込み部と、
前記固定磁化層と前記自由磁化層に接続され、前記トンネルバリア絶縁層を横断する電流を供給し、磁気トンネル抵抗が、高、中、低の3値のいずれであるかを検出する読み出し部と、
をさらに有する請求項2記載の磁気抵抗メモリ装置。 - 前記自由磁化層が磁気細線で形成され、前記ノッチが磁気細線の両側部に形成された請求項2または3記載の磁気抵抗メモリ装置。
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20090108 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20110609 |
|
A131 | Notification of reasons for refusal |
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|
A761 | Written withdrawal of application |
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