JPWO2008123156A1 - 試験装置及び電子デバイス - Google Patents
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Abstract
Description
1.特願2007−089691 出願日 2007年03月29日
110 インターフェイス試験部
112 インターフェイス制御部
114 パターン発生部
116 タイミング発生部
118 インターフェイス判定部
120 入出力回路
122 ドライバ
124 コンパレータ
126 スイッチ
128 シフトレジスタ
130 スキャン試験部
132 加算部
134 シフトレジスタ
136 加算部
138 一致検出部
140 BIST試験部
150 電源試験部
152 電源判定部
154 電力測定部
160 電源供給部
170 結果処理部
200 被試験デバイス
202 入出力ピン
204 スキャンピン
206 BISTピン
208 電源ピン
209 制御ピン
210 インターフェイス回路
212 バッファメモリ
214 切替部
216 スイッチ
220 内部インターフェイス回路
230 内部回路
240 内蔵セルフテスト回路
250 電源部
Claims (13)
- デバイス内部の内部回路とデバイス外部との間で信号を受け渡す外部インターフェイス回路を備える被試験デバイスを試験する試験装置であって、
前記外部インターフェイス回路を試験するための試験パターンを、前記外部インターフェイス回路に入力するパターン発生部と、
前記外部インターフェイス回路に前記試験パターンを折り返して出力させるインターフェイス制御部と、
前記外部インターフェイス回路が折り返して出力する前記試験パターンに基づいて、前記外部インターフェイス回路の良否を判定するインターフェイス判定部と
を備える試験装置。 - 前記外部インターフェイス回路は、複数の入出力ピンを有し、
前記インターフェイス制御部は、前記外部インターフェイス回路を試験する場合に、前記パターン発生部から前記試験パターンが入力される前記入出力ピンと、前記試験パターンを折り返して出力すべき前記入出力ピンとを前記被試験デバイスの内部で接続させる
請求項1に記載の試験装置。 - 前記被試験デバイスは、前記内部回路を試験する内蔵セルフテスト回路を更に備え、
前記試験装置は、
前記内蔵セルフテスト回路を制御して、前記内部回路を試験するBIST試験部と、
前記内部回路、および前記外部インターフェイス回路のいずれにも不良が検出されなかった場合に、前記被試験デバイスを良品と判定する結果処理部と
を更に備える請求項1に記載の試験装置。 - 前記BIST試験部は、前記外部インターフェイス回路の試験と並行して前記内部回路を試験する
請求項3に記載の試験装置。 - 前記インターフェイス制御部は、前記外部インターフェイス回路を試験する場合に、前記外部インターフェイス回路と前記内部回路との間で信号を伝送する接続経路を切り離す
請求項4に記載の試験装置。 - 前記内部回路の試験と並行して、前記内部回路に電源電力を供給する電源供給部と、
前記電源供給部から前記被試験デバイスに供給される前記電源電力を測定する電力測定部と、
前記電力測定部が測定した前記電源電力に基づいて、前記被試験デバイスの良否を判定する電源判定部と
を更に備える
請求項1に記載の試験装置。 - 前記パターン発生部は、擬似ランダムパターンを前記試験パターンとして生成し、
前記インターフェイス判定部は、前記パターン発生部が出力した前記擬似ランダムパターンと、前記外部インターフェイス回路が折り返して出力する論理値パターンとが一致するか否かを判定する
請求項1に記載の試験装置。 - 前記外部インターフェイス回路は、前記複数の入出力ピンに一対一に対応して設けられ、対応する前記入出力ピンに外部から入力されたデータを格納する複数のバッファメモリを有し、
前記インターフェイス制御部は、前記外部インターフェイス回路を試験する場合に、前記試験パターンが入力される前記入出力ピンに対応する前記バッファメモリが格納したデータを、前記試験パターンを折り返して出力すべき前記入出力ピンを介して出力させる
請求項2に記載の試験装置。 - 前記外部インターフェイス回路は、それぞれの前記入出力ピンを、前記内部回路又は他の前記入出力ピンのいずれに接続するかを切り替える切替部を更に備え、
前記インターフェイス制御部は、前記外部インターフェイス回路を試験する場合に、前記パターン発生部から前記試験パターンが入力される前記入出力ピンと、前記試験パターンを折り返して出力すべき前記入出力ピンとを接続させる切替制御信号を前記切替部に入力する
請求項2に記載の試験装置。 - 内部回路と、
複数の入出力ピンを有し、デバイス外部及び前記内部回路の間で信号を受け渡す外部インターフェイス回路と、
それぞれの前記入出力ピンを、前記内部回路又は他の前記入出力ピンのいずれに接続するかを切り替える切替部と
を備える電子デバイス。 - 前記切替部は、前記外部インターフェイス回路を試験する旨の通知を、外部の試験装置から受けた場合に、前記試験装置から試験パターンを受け取るべき前記入出力ピンと、前記試験装置に前記試験パターンを折り返して出力すべき前記入出力ピンとを電子デバイスの内部で接続する
請求項10に記載の電子デバイス。 - 前記内部回路を試験する内蔵セルフテスト回路を更に備え、
前記切替部は、前記内部回路及び前記外部インターフェイス回路を並行して試験する場合に、前記外部インターフェイス回路と前記内部回路とを切り離す
請求項11に記載の電子デバイス。 - 前記内部回路は、入力されるデータを記憶するメモリセルを有する
請求項10に記載の電子デバイス。
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