JPS6284534A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPS6284534A JP60224284A JP22428485A JPS6284534A JP S6284534 A JPS6284534 A JP S6284534A JP 60224284 A JP60224284 A JP 60224284A JP 22428485 A JP22428485 A JP 22428485A JP S6284534 A JPS6284534 A JP S6284534A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] この発明は、半導体装置およびその製造方法に関し、特
に、内部配線のためのIf電極配線有する半導体装置お
よびその製造方法に関する。
[従来の技術] 従来から、シリコン半導体の内部配線の材料として、ア
ルミニウムおよびアルミニウム合金が用いられている。
しかし、近年、LSIの高密度化・高集積度化に伴い、
フンタクトホール部での段差被覆はますます雌しい方向
に進んでいる。
第2図は、従来の半導体装置の一例の断面構造を示す図
である。第2図において、シリコン基板1の上には、下
敷酸化膜2が形成される。下敷酸化1!2の上には、P
SG (燐ガラス膜)からなるスムースコートlll3
が形成される。半導体IIIには、素子の内部配線のた
めのコンタクトホール9が設けられる。コンタクトホー
ル9の基板1上およびスムースコート膜3上にはアルミ
ニウムまたはアルミニウム合金からなる配線層4が形成
される。
次に、第2図に示す従来の半導体装置の製造方法につい
て説明する。コンタクトホール9の形成されたシリコン
基板1.その上のスムースコートL12上に、スパッタ
リング法によりたとえばアルミニウムシリコン膜を全面
に形成する。このとき、段差部5の被覆性〈ステップカ
バレッジ性)を十分にするために、ウェハを加熱するの
が一般的である。
次に、写真製版技術を用い、レジストによるバターニン
グを行ない、不要な部分のアルミニウム膜をエツチング
により除去することにより、たとえば外部電極取出領域
(図示せず)が形成された配線114を得ることができ
る。次に、配線層4とシリコン基板1との電気的コンタ
クトをとるため。
およびトランジスタのしきい値電圧の安定性を増すため
に、約450℃程度の熱処理を加える。
[発明が解決しようとする問題点] 第3図は配線層の種類およびその硬度を示す図である。
従来の半導体装置は、上述の製造工程により製造される
が、このように、ウェハを加熱して、厚みがたとえば約
1μlのAJLSi配線層4を形成した場合には、配線
層4の形成直後において、第3図(a )に示すように
、ヌープ硬度が30HK前後に低下する。
一方、最近では、LSIのチップサイズの増大に伴い、
モールド材の収縮応力に起因する配線の変形が生じやす
くなっている。
それゆえに、この発明は、上述のような問題点を解消す
るためになされたもので、コンタクトホールでのステッ
プカバレッジ性を低下させないで、かつ配線層の硬度を
保持して、変形に耐え得る配線層を有する半導体装置を
得ることを目的とする。
[問題点を解決するための手段] この発明に係る半導体装置は、内部配線のための電極配
線層の表面にアルミニウム水和物を形成するようにした
ものである。
また、この発明に係る半導体装置の製造方法は、開口部
領域を含む半導体基板上に、基板を加熱しながら、第1
の金属層を形成し、次に、基板を加熱しないで、第1の
金属層上に第2の金属層を形成し、次に、第2の金am
表面にアルミニウム水和物層を形成するようにしたもの
である。
[作用] 第1および第2の金m層上に形成されるアルミニウム水
和物層は、非常に硬いので、加熱処理時に↓じる配置1
層の変形を妨げる即用をする。
[実施例] 以下、この発明の一実施例を図について説明する。
第1図(IV)は、この発明の一実施例の半導体装置の
積層構造を示す図である。第1図(IV)において、シ
リコン基板1の上には、下敷酸化膜2が形成され、下敷
酸化!lI2上にはスムースコートm3が形成される。
また、半導体装置には、内部配線用のコンタクトホール
9が設けられる。コンタクトホール9部分のシリコン基
板1上およびスムースコート腰3上には、第1の金属層
6.第2の金属層7およびアルミニウム水和物層8が形
成される。第1の金属層6は、たとえばアルミニウムシ
リコンであり、第2の金属層はたとえばアルミニウムシ
リコンチタンである。ざらに、外部電極取出領域10に
は、外部配線用の取出口が設【ブられる。
第1図はこの発明の一実施例の製造工程を示す図である
。次に、第1図を参照して、この発明の一実施例の製造
方法について説明する。
第1図(I) 半導体装置に、内部配線のためのコンタクトホール9を
設ける。コンタクトホール913よびスム−スコートl
l1s上にたとえばスパッタリング法により第1の金属
N6を形成する。このとき、ステップカバレッジ性を向
上させるために、基板全体を加熱する。第1の金属層6
として、たとえばアルミニウムシリコンが用いられ、た
とえば約0゜5μmの厚みに形成される。
第1図(n) 次に、同じくスパッタリング法により、第1の金属層6
上に、第2の金属117を形成する。このとき、ウェハ
の加熱は行なわない。第2の金属層7として、たとえば
アルミニウムシリコンチタンが用いられ、たとえば約0
.5μ−の厚みに形成される。第2の金属層の形成直後
には、第3図(b )に示づように、約90HKのヌー
プ硬度が得られる。
この状態で、金属86.7とシリコン基板1との電気的
コンタクトをとる等のために、約450℃の熱処理を行
なうと、金属層6.7の硬度は急激に低下し、約40H
Kとなる。このような硬度の低下を防ぐために、第1図
(IV)に示すステップを行なう。
第1図(II[) 次に、写真製版技術を用い、第1および第2の金属層を
バターニングして、配線層を形成する。
このとき、外部電極取出口10が形成される。
第1図HV) バターニング終了後、第2の金属層7の全面を温水によ
り煮沸処理するか、または、陽ti酸化法を用いて、ア
ルミニウム水和物lI8を形成する。
アルミニウム水和物@8が形成された後に、上述のよう
な450℃の熱処理を行なっても、第3図(C)に示す
ように、硬度の低下はアルミニウム水和物層を形成しな
いものに比べて、少なく、508に程度の硬度が保持さ
れる。
硬度の低下が少ない理由は、硬度の高いアルミニウム水
和物層により覆われているために、アルミニウムあるい
はアルミニウム合金の結晶のグレイン成長が妨げられる
ためである。
ここで、温水処理を行なう場合には、金属層表面が自然
酸化されるが、これをスパッタエツチング法等にて除去
すれば、アルミニウム水和物層8の成長速度は速くなる
。このとき、外部N極取出口10のスムースコート11
3上には、アルミニウム水和物層等が付着するが、次に
、これをvA酸やフン酸等により除去する。次に、たと
えばALIll等と金属層6,7とが接続可能になるよ
うに外部電極取出口10の内面のアルミニウム水和物層
を除去する。
[発明の効果] 以上のように、この発明によれば、第1の金属層および
第2の金属層からなる配ll11を形成後、配線層の表
面にアルミニウム水和物層を形成するようにしたので、
配線層は所定の硬度を保持するため、その後の熱処理に
おいても変形が生じない。
また、第1の金属層は、基板全体を加熱して形成される
ので、コンタクトホール部におけるステップカバレッジ
性、は良好である。
【図面の簡単な説明】
第1図はこの発明の一実施例の半導体装置およびその製
造方法を示づ図である。第2図は従来の半導体装置の一
例の断面構造を示す図である。第3図は配線層の種類お
よびその硬度を示す図である。 図において、1はシリコン基板、2は下敷酸イヒ膜、3
はスムースコート膜、4はアルミニウム配置111.5
はコンタクトホール段差部、6は第1金属層、7は第2
金劃L8はアルミニウム水和物層、9はコンタクトホー
ル、10は外部1m取出fIit11!を示す。 なお、図中、同一符号は同一または相当部分を示す。 代  理  人     大  岩  増  雄第1図 s: フznFttilNp

Claims (4)

    【特許請求の範囲】
  1. (1)内部配線のための開口部領域を覆うような電極配
    線を有する半導体装置であつて、前記電極配線は、第1
    の金属層と、前記第1の金属層上に形成される第2の金
    属層とを含み、前記第2の金属層表面には、アルミニウ
    ム水和物層が形成されたことを特徴とする半導体装置。
  2. (2)前記第1の金属層および前記第2の金属層はアル
    ニウムあるいはアルミニウム合金よりなることを特徴す
    る特許請求の範囲第1項記載の半導体装置。
  3. (3)内部配線のための開口部領域を覆うような電極配
    線を有する半導体装置の製造方法であって、 少なくとも前記開口部領域を含む半導体基板上に、前記
    基板を加熱しながら、第1の金属層を形成する第1のス
    テップと、 前記基板を加熱しないで、前記第1の金属層上に第2の
    金属層を形成する第2のステップと、前記第2の金属層
    表面にアルミニウム水和物層を形成する第3のステップ
    とを備える半導体装置の製造方法。
  4. (4)前記第1および第2の金属層は、アルミニウムあ
    るいはアルミニウム合金からなることを特徴とする特許
    請求の範囲第3項記載の半導体装置の製造方法。
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GB8623528A GB2181893B (en) 1985-10-08 1986-10-01 Semiconductor device and method of manufacturing thereof
DE19863634168 DE3634168A1 (de) 1985-10-08 1986-10-07 Halbleitereinrichtung und herstellungsverfahren dafuer
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Families Citing this family (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2624304B1 (fr) * 1987-12-04 1990-05-04 Philips Nv Procede pour etablir une structure d'interconnexion electrique sur un dispositif semiconducteur au silicium
DE3815512C2 (de) * 1988-05-06 1994-07-28 Deutsche Aerospace Solarzelle und Verfahren zu ihrer Herstellung
KR940008936B1 (ko) * 1990-02-15 1994-09-28 가부시끼가이샤 도시바 고순도 금속재와 그 성질을 이용한 반도체 장치 및 그 제조방법
US5126283A (en) * 1990-05-21 1992-06-30 Motorola, Inc. Process for the selective encapsulation of an electrically conductive structure in a semiconductor device
JPH07123101B2 (ja) * 1990-09-14 1995-12-25 株式会社東芝 半導体装置
US5175125A (en) * 1991-04-03 1992-12-29 Chartered Semiconductor Manufacturing Ltd. Pte Method for making electrical contacts
US5679982A (en) * 1993-02-24 1997-10-21 Intel Corporation Barrier against metal diffusion
US5382447A (en) * 1993-12-02 1995-01-17 International Business Machines Corporation Process for fabricating improved multilayer interconnect systems
US5913146A (en) * 1997-03-18 1999-06-15 Lucent Technologies Inc. Semiconductor device having aluminum contacts or vias and method of manufacture therefor
US6906421B1 (en) * 1998-01-14 2005-06-14 Cypress Semiconductor Corporation Method of forming a low resistivity Ti-containing interconnect and semiconductor device comprising the same
DE69937953D1 (de) * 1999-11-22 2008-02-21 St Microelectronics Srl Korrosion durch Feuchtigkeit inhibierende Schicht für Metallisierungsschichten aus Al für elektronische Vorrichtungen und Verfahren zur Herstellung
JP6191587B2 (ja) * 2014-12-08 2017-09-06 トヨタ自動車株式会社 半導体装置

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS52147988A (en) * 1976-06-03 1977-12-08 Toshiba Corp Manufacture of semiconductor device
JPS56105660A (en) * 1980-01-28 1981-08-22 Nec Corp Semiconductor device
JPS58201367A (ja) * 1982-05-20 1983-11-24 Nec Corp Mos型半導体装置の製造方法

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3866311A (en) * 1971-06-14 1975-02-18 Nat Semiconductor Corp Method of providing electrically isolated overlapping metallic conductors
US4433004A (en) * 1979-07-11 1984-02-21 Tokyo Shibaura Denki Kabushiki Kaisha Semiconductor device and a method for manufacturing the same
US4471376A (en) * 1981-01-14 1984-09-11 Harris Corporation Amorphous devices and interconnect system and method of fabrication
DE3140669A1 (de) * 1981-10-13 1983-04-28 Siemens AG, 1000 Berlin und 8000 München Verfahren zum herstellen von halbleitervorrichtungen
JPS58103168A (ja) * 1981-12-16 1983-06-20 Fujitsu Ltd 半導体装置
JPS58137231A (ja) * 1982-02-09 1983-08-15 Nec Corp 集積回路装置
WO1984001471A1 (en) * 1982-09-30 1984-04-12 Advanced Micro Devices Inc An aluminum-metal silicide interconnect structure for integrated circuits and method of manufacture thereof
DE3244461A1 (de) * 1982-12-01 1984-06-07 Siemens AG, 1000 Berlin und 8000 München Integrierte halbleiterschaltung mit einer aus einer aluminium/silizium-legierung bestehenden kontaktleiterbahnebene
JPS60136337A (ja) * 1983-12-22 1985-07-19 モノリシツク・メモリ−ズ・インコ−ポレイテツド 2重層処理においてヒロツク抑制層を形成する方法及びその構造物

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS52147988A (en) * 1976-06-03 1977-12-08 Toshiba Corp Manufacture of semiconductor device
JPS56105660A (en) * 1980-01-28 1981-08-22 Nec Corp Semiconductor device
JPS58201367A (ja) * 1982-05-20 1983-11-24 Nec Corp Mos型半導体装置の製造方法

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Publication number Publication date
JPH0611076B2 (ja) 1994-02-09
KR900001652B1 (ko) 1990-03-17
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GB8623528D0 (en) 1986-11-05
DE3634168A1 (de) 1987-04-16
KR870004504A (ko) 1987-05-09
GB2181893B (en) 1989-03-30
DE3634168C2 (ja) 1991-12-05
US4896204A (en) 1990-01-23

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