JPS6149437A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPS6149437A
JPS6149437A JP17186084A JP17186084A JPS6149437A JP S6149437 A JPS6149437 A JP S6149437A JP 17186084 A JP17186084 A JP 17186084A JP 17186084 A JP17186084 A JP 17186084A JP S6149437 A JPS6149437 A JP S6149437A
Authority
JP
Japan
Prior art keywords
film
wirings
wiring
sio2
poly
Prior art date
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Pending
Application number
JP17186084A
Other languages
English (en)
Inventor
Kenji Tominaga
健司 富永
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Filing date
Publication date
Application filed by Matsushita Electronics Corp filed Critical Matsushita Electronics Corp
Priority to JP17186084A priority Critical patent/JPS6149437A/ja
Publication of JPS6149437A publication Critical patent/JPS6149437A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は金属配線を有する半導体装置に関するものであ
る。
従来例の構成とその問題点 従来、半導体装置において金属配線を行なう場合、第1
図の断面図のように、半導体基板1上に、絶縁膜2を介
して、全面に金属膜を形成した後、フォトレジストを用
いて同金属膜配線パターン3を形成して、配線間の分離
したい領域を食刻するか、あるいは全面にフォトレジス
トを塗布し、配線パターンを形成した後、金属膜を形成
しフォトレジスト除去と共に、リフトオフ法によって配
線間の分離したい領域をはく離することで金属膜配線パ
ターン3を形成する方法が用いられてきたが、いず扛も
2次元空間内で金属配線間の分離をおこなっているため
、配線間に一定のスペースを設けなければならず、半導
体装置の集積度向上に大きな障害となっている。
発明の目的 本発明は上記の不都合を排除した半導体装置を提供する
ものである。
発明の構成 本発明は上記の目的を達成するために、半導体基板上に
絶縁膜を被着し、同絶縁膜にオーバーハング状の開口部
を設けた後、配線金属膜を蒸着し、前記開口部の底面に
配線域が設けられたことを特徴とする半導体装置であっ
て、金属配線間を3次元的に分離するため金属配線間に
水平方向に一定のスペースを設ける必要がなく、半導体
装置の高集積化において同一の設計ルールで最高2倍ま
で金属配線密度を高めることができる。
実施例の説明 第2図a −dは本発明実施例の工程順断面図を示す。
第2図aに示すように所定の回路素子が構成された半導
体基板1上に、CVD法で厚さ8000人の酸化シリコ
ン膜2を成長温度430°Cで形成する。さらにCVD
法で厚さ5000へのポリシリコン層4を成長温度61
0″Cで形成し、同じくCVD法で厚さ3000人の酸
化シリコン膜5を1、        成長温度430
’Cで形成した後、7オトレジスト6を塗布する。次に
、第2図すに示すようにフォトレジスト6で配線パター
ンを形成した後、酸化シリコン膜4をフォトレジスト6
をマスクにして反応性イオンエツチング法を用いて異方
性エッチする。フォトレジスト6を除去後、第2図Cに
示すように、ポリシリコン膜4を酸化シリコン膜4をマ
スクにしてドライエッチ法を用いて等方性エッチし、ポ
リシリコン膜4の上にオーパーツ・ング状の酸化シリコ
ン膜5のひさしができるようにする。下層の配線間の電
気的絶縁のためポリシリコン膜3のエッチされた側面を
ウェット酸化して酸化膜7を形成した後、第2図dに示
すように厚さ5oooへのアルミニウム膜3をスパッタ
蒸着すると、アルミニウム膜3はオーバーハング状の酸
化シリコン膜5により自動的に上下に分離され、アルミ
ニウム配線3が形成される。
なお、本実施例ではひさしの材料として上層に酸化シリ
コン膜、下層に側面を酸化したポリシリコン膜を用いた
が、その他に窒化シリコン膜、酸 ′化アルミニウム膜
、あるいは有機質膜等性質の異なる少なくとも2種類の
膜であ扛ばよい。
また金属配線材料としてアルミニウム膜を用いたが、そ
の他に高融点金属等の配線材料でもよい。
発明の効果 以上の説明から明らかなように本発明を用いれば金属配
線の集積度が大幅に向上し、半導体装置の高集積化にむ
けての工業的価値は太きい。
【図面の簡単な説明】
第1図は従来の半導体装置の金属配線の一例を示す断面
図、第2図a−dは本発明にかかる半導体装置の金属配
線の一実施例を示す工程断面図である。 1・ ・・所定の回路素子が形成さ扛た半導体基板、2
・・・・層間絶縁膜、3・・・・・金属配線膜、4・・
・・・・ポリシリコン膜、5・・・・酸化シリコン膜、
6・・・・・・フォトレジスト、7・・・・・・ポリシ
リコン膜の側面に形成された酸化膜。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1

Claims (3)

    【特許請求の範囲】
  1. (1)半導体基板上に絶縁膜を被着し、同絶縁膜にオー
    バーハング状の開口部を設けた後、配線金属膜を蒸着し
    、前記開口部の底面に配線域が設けられたことを特徴と
    する半導体装置。
  2. (2)絶縁膜が少なくとも下層の酸化シリコン膜と上層
    の窒化シリコン膜の2層からなる特許請求の範囲第1項
    に記載された半導体装置。
  3. (3)絶縁膜が少なくとも下層のポリシリコンと上層の
    酸化シリコン膜もしくは窒化シリコン膜の2層からなり
    、該ポリシリコンの開口部に露出した面が酸化されてい
    ることを特徴とする特許請求の範囲第1項に記載された
    半導体装置。
JP17186084A 1984-08-17 1984-08-17 半導体装置 Pending JPS6149437A (ja)

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JPS6149437A true JPS6149437A (ja) 1986-03-11

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03119197A (ja) * 1989-09-25 1991-05-21 Mas Fab Andritz Ag ダブル スクリーン ベルト プレス
KR100490575B1 (ko) * 2001-08-03 2005-05-17 야마하 가부시키가이샤 귀금속 박막 패턴 형성방법

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03119197A (ja) * 1989-09-25 1991-05-21 Mas Fab Andritz Ag ダブル スクリーン ベルト プレス
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