JPH0477009A - 増幅回路 - Google Patents
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- H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
- H03F3/60—Amplifiers in which coupling networks have distributed constants, e.g. with waveguide resonators
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Abstract
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Description
及び低廉化し、更に安定動作を行なう増幅回路を提供す
ることを目的とし、高周波の入力信号をソース接地の電
界効果トランジスタで増幅する増幅回路において、該ト
ランジスタのドレイン出力線に一端を接続され他端より
増幅した信号を出力する第1のインダクタと、該第1の
インダクタの他端を接地するコンデンサと、該第1のイ
ンダクタの他端にバイアス電圧を供給するストリップラ
インで形成した第2のインダクタをとを有し、該第2の
インダクタのバイアス電圧供給側の端部に一端か高周波
的に接地された抵抗の他端を接続し、該入力信号の基本
波に対して該コンデンサと第2のインダクタとの並列共
振で高インピーダンスとし、かつ該基本波の第2高周波
に対して該ドレイン出力線のインダクタンス及び該第1
のインダクタと該コンデンサとの直列共振により該トラ
ンジスタのドレインを低インピーダンスとするよう構成
する。
回路に関する。
る。移動無線装置はその電源として電池を使用するため
、その電力の略75%を消費する送信増幅回路の効率を
向上させることか強く要求されている。
増幅回路)としてUnited 5ates Pate
nt4717884号に記載の如きガリウム、ヒ素、電
界効果トランジスタ(GaAsFET)を用いたものか
ある。
T10のゲートに高周波の入力信号を供給する。入力信
号基本波の第3高周波に対してはFET]、0の接続イ
ンダクタンス及び外部インダクタ11と、FETl0の
寄生容量C3との並列共振により、FETl0のドレイ
ンをオーブン(高インピーダンス)とする。このときス
タブ12は第3高周波の周波数λ、に対してλ、/4長
となる。また、第2高周波に対しては第2高周波の周波
数λ2に対してλ2/6長のスタブ12の容量と接続イ
ンダクタンスL1及び外部インダクタ11との直列共振
により、F’ETIOのドレインを略ショート(低イン
ピーダンス)とする。
3は少なくとも基本波から第3高周波までの帯域で高イ
ンピーダンスを維持しなければならない。このため、チ
ョークコイル13は集中定数素子を用いており、分布定
数素子であるストリップラインを用い回路を小型化及び
低廉化することが困難であるという問題かあった。
及び低廉化し、更に安定動作を行なう増幅回路を提供す
ることを目的とする。
で増幅する増幅回路において、トランジスタのドレイン
出力線に一端を接続され他端より増幅した信号を圧力す
る第1のインダクタと、 第1のインダクタの他端を接地するコンデンサと、 第1のインダクタの他端にバイアス電圧を供給するスト
リップラインで形成した第2のインダクタとを有し、 入力信号の基本波に対してコンデンサと第2のインダク
タとの並列共振で高インピーダンスとし、かつ基本波の
第2高周波に対してドレイン出力線のインダクタンス及
び該第1のインダクタとコンデンサとの直列共振により
該トランジスタのドレインを低インピーダンスとするよ
う構成する。
一端が高周波的に接地された抵抗の他端を接続する。
ス間の寄生容量とドレイン出力線のインダクタンス及び
第1のインダクタ及びコンデンサ及び該第2のインダク
タとの並列共振によりトランジスタのドレインを高イン
ピーダンスとするよう構成する。
た第3高周波に対して並列共振してトランジスタのドレ
インのインピーダンスを決定するコンデンサをバイアス
供給回路としても利用し、基本波でこのコンデンサと第
2のインダクタとを並列共振こさせて高インピーダンス
を得ているため、第2のインダクタを低インダクタンス
としストリップラインて形成でき増幅回路の小型化及び
低廉化か可能となる。
周波帯での回路動作の安定性を確保てきる。
によっても同じ効果を有する高効率増幅回路の構成か可
能である。
ンデンサ21を通してストリップラインで形成された入
力整合回路22に供給され、ここからGaAsFET2
3のゲートに供給される。
27及びストリップラインで形成された高周波チョーク
コイル28を通してバイアス電圧Voか印加されている
。チョークコイル28を形成するストリップラインは基
本波の周波数λ、に対しλ、/4長とされており、チョ
ークコイル28の端子26側の端部は高周波短絡用のコ
ンデンサ29によって接地されている。
間の寄生容量24とドレインのホンディングワイヤによ
る接地容量25を存しており、ドレインは接続容量25
を介しストリップラインのインダクタ30の一端に接続
されている。
低域通過形出力整合回路31に接続されると共に集中定
数素子のコンデンサ32によって接地されており、更に
バイアス回路を構成するインダクタ33の一端か接続さ
れている。
ンダクタ33の他端には端子34よりバイアス供給線路
35を通してバイアス電圧V、か印加されており、イン
ダクタ33の端子34側の端部は高周波短絡用のコンデ
ンサ36によって接地されている。
ス30より出力整合回路31を通り、結合コンデンサ3
7を通して端子38より出力される。
ンダクタ33との並列共振により高インピーダンスとな
り、また第2高周波に対して接続インダクタンス25及
びインダクタ30とコンデンサ32との直列共振により
FET23のドレインが略ショート(低インピーダンス
)となり、更に第3高周波に対して寄生容量24と接続
インダクタンス25及びインダクタ30及びコンデンサ
32及びインダクタ33との並列共振によりFET23
のドレインが略オーブン(高インピーダンス)となるよ
うに上記インダクタ30.33コンデンサ32夫々の定
数か選択されている。
ン、第2高周波でショートとなってF級動作を行なうと
共に、基本波に対してコンデンサ32と並列共振回路を
構成するインダクタ33がらバイアスを供給するため、
インダクタ33をλ、/4以下の長さのストリップライ
ンて構成でき、従来の如く集中定数素子のチョークコイ
ルを必要としないのでバイアス供給回路の小型化及び低
廉化が可能となる。
ンサ32の代りに第2図に示す如く分布定数素子のスト
リップライン4oで形成した容量を用いても良い。
中、第1図と同一部分には同一符号を付し、その説明を
省略する。
ンダクタ33の端子34側の端部はコンデンサ41で接
地されると共に、例えば5oΩ程度の安定化用の抵抗4
2の一端が接続され、抵抗42の他端はコンデンサ36
によって接地されている。同様にゲートバイアスを供給
する回路のインンダクタ28の端子26側の端部はコン
デンサ43で接地されると共に、安定化用の抵抗44の
一端か接続され、抵抗44の他端はコンデンサ29によ
って接地されている。
ことによって、基本波より低い低周波成分に対してイン
ダクタ33.28のインピーダンスが小さい場合にも抵
抗42.44だけのインピーダンスが確保されるので、
増幅回路の安定性か向上し、発振等を生ずるおそれか防
止される。
ンサ32の代りに第4図に示す如く分布定数素子のスト
リップライン4oて形成した容量を用いても良い。
のドレインか第2高調波でショートとなっていれば、第
3高調波でオーブンとはならなくとも充分に増幅動作を
実現てきる。従って、この場合には入力信号の基本波に
対してコンデンサ32とインダクタ33との並列共振に
より高インピーダンスとなり、また第2高周波に対して
接続インダクタンス25及びインダクタ30とコンデン
サ32との直列共振によりFET23のドレインか略シ
ョート(低インピーダンス)となるようにインダクタ3
0.33及びコンデンサ32又はストリップライン4o
夫々き定数を選定すれば良い。
、 第5図は従来回路の一例の回路図である。 図において、 23はFET。 24は寄生容量、 25は接続インダクタンス、 2B、30.33はインダクタ、 29.32.36,41.43はコンデンサ、42.4
4は抵抗 を示す。 〔発明の効果〕 上述の如く、本発明の増幅回路によれば、回路を小型化
及び低廉化でき、更に安定動作を行なうことかでき、実
用上きわめて有用である。 VG 庫ψ−月回路ψ発1*防し使lの冒涜ば4第 図 茹 C 電1ハ田り9距し渭U琢−jのazm
Claims (1)
- 【特許請求の範囲】 (1)高周波の入力信号をソース接地の電界効果トラン
ジスタ(23)で増幅する増幅回路において、 該トランジスタ(23)のドレイン出力線に一端を接続
され他端より増幅した信号を出力する第1のインダクタ
(30)と、 該第1のインダクタ(30)の他端を接地するコンデン
サ(32)と、 該第1のインダクタ(30)の他端にバイアス電圧を供
給するストリップラインで形成した第2のインダクタ(
33)をとを有し、 該入力信号の基本波に対して該コンデンサ (32)と第2のインダクタ(33)との並列共振で高
インピーダンスとし、かつ該基本波の第2高周波に対し
て該ドレイン出力線のインダクタンス(25)及び該第
1のインダクタ(30)と該コンデンサ(32)との直
列共振により該トランジスタ(23)のドレインを低イ
ンピーダンスとするよう構成したことを特徴とする増幅
回路。 (2)該第2のインダクタ(33)のバイアス電圧供給
側の端部に一端が高周波的に接地された抵抗(42)の
他端を接続したことを特徴とする請求項(1)記載の増
幅回路。 (3)該コンデンサ(32)をストリップライン(40
)で形成したことを特徴とする請求項(1)又は請求項
(2)記載の増幅回路。 (4)請求項(1)記載の増幅回路において、更に第3
高周波に対して該トランジスタ(23)のドレイン・ソ
ース間の寄生容量(24)と該ドレイン出力線のインダ
クタンス(25)及び該第1のインダクタ(30)及び
該コンデンサ(32)及び該第2のインダクタ(33)
との並列共振により該トランジスタ(23)のドレイン
を高インピーダンスとするよう構成したことを特徴とす
る増幅回路。 (5)該第2のインダクタ(33)のバイアス電圧供給
側の端部に一端が高周波的に接地された抵抗(42)の
他端を接続したことを特徴とする請求項(4)記載の増
幅回路。 (6)該コンデンサ(32)をストリップライン(40
)で形成したことを特徴とする請求項(4)又は請求項
(5)記載の増幅回路。
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