JP5382040B2 - 配線基板 - Google Patents
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Description
線材料の一部は基材の一方の面から突出しているので、例えば電子部品などを実装する場合にバンプを形成する工程を省略し得る。
置する複数の接続端子12が密集して配置されている。そして、図2に示すように、これら複数の接続端子12には上方へ突出する導電性のバンプ13がそれぞれ設けられている。さらに、複数の接続端子12と重なるようにドライバIC4が設置されており、このドライバIC4の下面に設けられた複数の端子4aと複数の接続端子12とがバンプ13を介してそれぞれ電気的に接続されている。一方、複数の配線部10の左端にそれぞれ設けられた複数の接続端子11は、ドライバIC4の駆動対象であるアクチュエータ等の種々の装置(図示省略)にそれぞれ接続される。
うに、溝20に流れ込んだ液体32は、他方(図3の右端)の凹部22まで流れていくため、各溝20及びこの溝20に連通する2つの凹部21,22に液体32が充填される。尚、図3(c),(d)では、各溝20の両端に設けられた2つの凹部21,22のうち、左端の凹部21に液滴31を着弾させているが、右端の凹部22に液滴31を着弾させてもよい。
ることができるため、導電性の液滴31を面積の大きい凹部21,22に着弾させることによって、幅が狭い溝20にも液体32を充填することができる。一般に、濡れやすい内壁を有する溝の幅が2〜3mm以下である場合には、液体は毛管力によって溝に沿って濡れ広がるが、溝20の幅は、本実施形態のように20μm程度以下であることが望ましい。この場合には十分な大きさの毛管力が働くため、液体32は迅速に溝20全体に行き渡ることができる。このように微細な幅の溝であっても、液体は毛管力によって溝を伝って濡れ広がっていくため、基材2に微細な幅の導電パターン3(配線部10)を容易に形成することができ、製造コストも低減できる。
図5に示すように、凹部22に充填された導電性材料30(接続端子12)の表面に銀や金などのバンプ13を形成した後に、さらに、このバンプ13の表面に溶融したハンダなどの、バンプ13とは別の金属材料を含む導電性の液滴を着弾させて、バンプ13に表面層41を形成してもよい。
基材2の上面に必ずしも撥液膜5を形成する必要はなく、撥液膜形成工程を省略してもよい。この場合でも、基材2の上面の表面粗さよりも、溝20及び凹部21,22の内面の表面粗さが大きくなるようにすれば、これら溝20及び凹部21,22の内面の撥液性が基材2の上面よりも低くなる。例えば、レーザー加工によって溝20及び凹部21,22を形成することにより、溝20及び凹部21,22を画成する内面の表面を粗くして濡れ性を高めることができる。この場合には、基材2の上面の撥液性が溝20及び凹部21,22の内面の撥液性よりも相対的に高くなるため、凹部21,22に液滴を着弾させて溝20内に液体32を充填させる際に、液体32が基材2の上面に流れ出しにくくなる。
前記第1実施形態では、基材2側にバンプ13を形成しているが、図6に示すように、ドライバIC4の端子4aの表面(下面)に、下方へ突出するバンプ43が予め形成されていてもよい。この場合には、基材2にバンプ13を形成する工程を省略できる。
図7(a)に示すように、各溝20の両端に設けられた2つの凹部21,22のそれぞれに対して導電性の液滴31を着弾させてもよい。この場合には、図7(b)に示すように、溝20に、その両端の2つの凹部21,22からそれぞれ液体32が流れ込むため、溝20に、より迅速に液体32を充填することができる。
図8(a)に示すように、各溝20の右端に設けられた(ドライバIC4の設置側の)凹部22に液滴31を着弾させて溝20内に液体32を充填していき、さらに、図8(b)に示すように、凹部22に充填された液体32の液面が、表面張力により基材2の上面よりも盛り上がるまで液体32を充填してもよい。この場合には、図8(c)に示すように、液体32を固化させると、固化した導電性材料30により凹部22に突出状のバンプ13が形成される。従って、導電パターン3を形成した後に、バンプ13を形成するための特別な工程を行う必要がないため、接続端子12とドライバIC4とをバンプ13を介して確実に接続しつつ、製造工程を簡略化することができる。
基材2の上面に溝20及び凹部21,22を形成した後、この基材2の上面にドライバIC4を設置してから、溝20内に液体32を充填してもよい。即ち、まず、図9(a)に示すように、基材2の上面に溝20及び凹部21,22を形成する(凹部形成工程)。次に、図9(b)に示すように、基材2の上面に、各端子4aが各溝20の右端に位置する凹部22と平面視で重なるようにドライバIC4を載置する(電子部品設置工程)。そして、図9(c)に示すように、各溝20の左端に位置する凹部21に液滴31を着弾させて、この凹部21から溝20に液体32を流し込む。図9(d)に示すように、右端の凹部22まで液体32が充填されて、ドライバIC4の下面の各端子4aに液体32が接触する。つまり、液体32を溝20に充填してこの液体32を固化させるだけで、一方の凹部22においてドライバIC4の端子4aと接続端子12を接続することができる。ドライバIC4を基材2に設置する際に、ドライバIC4の端子4aと導電パターン3の接続端子12とを接続するためにドライバIC4を基材2へ押しつける必要がないため、ドライバIC4や基材2が損傷するおそれがない。尚、本変更形態において、ドライバIC4の各端子4aが平面視で重なる部分は、各溝20の端部に位置する凹部22に限られるものではなく、各溝20の一部分であってもよい。また、各溝20の途中の一部分にその幅が部分的に大きくなる拡大部分を形成し、その拡大部分が各端子4aと重なるようにしてもよい。
本変更形態では、第6変更形態の凹部形成工程において、さらに、基材2Aの上面に、接着剤用の溝50及び溝50に連通する2つの凹部51,52を形成し(図10参照)、これを用いてドライバIC4と基板1Aとを接着剤で固定する。凹部形成工程の後、基材2Aの右端に位置する一方の凹部51に接着剤の液滴を着弾させることにより、溝50と、基材2Aの左端に位置する他方の凹部52に接着剤53を充填して(図11参照)、凹部52に充填された接着剤53により、ドライバIC4の下面を基材2Aに接合する。この基板1Aにおいては、図11に示すように、ドライバIC4の下面と基材2Aの上面が接着剤53により接合された状態で、その後に、凹部22に充填された導電性材料30に
よりドライバIC4の端子4aと導電パターン3が接続されるため、その電気的接続の信頼性が高くなる。尚、基材2の上面とドライバIC4の下面との間に接着剤53を供給するための凹部52は、必然的に、平面視でドライバIC4と重なる領域に形成することになるが、ドライバIC4と基材2Aとの接合をさらに確実なものにするために、図10に示すように、凹部52がドライバIC4の中央部と重なる領域に形成することが好ましい。
図12、図13に示すような微細な幅及びピッチの導電パターンを、基材2Bの上面と下面の両方に形成することもできる。基板1Bの上面には、複数の配線部60と複数の配線部60の一端に設けられた複数の接続端子61とを備える導電パターン65が形成されている。また、基材2Bの下面にも、複数の配線部62と複数の配線部62の一端に設けられた複数の接続端子63とを備える導電パターン66が形成されている。そして、配線部60の接続端子61と反対側の端部と、配線部62の接続端子63と反対側の端部とは、基材2Bを貫通する複数の連通孔74に充填された導電性材料30により接続されている。また、基材2Bの下面にはドライバIC4が設置され、このドライバIC4の複数の端子4aと基材2Bの下面に形成された複数の接続端子63とが接続されている。
い。この場合には、基材2Bに複数の電子部品をより高密度に配置することができる。
本変更形態において、導電性の液体が着弾する部分(受液部)は平坦、すなわち、溝を除く他の基材表面部分と同じ高さであり、受液部の表面の撥液性は、基材表面の他の部分の撥液性よりも低い。図15,16に示す基板101は、受液部121及び溝が1つずつであることと受液部121が凹部でないことを除いて、第1実施形態の基板1と同一の構造である。
図17(a),(b)に示すように、溝20に充填された導電性の液体32の液面32aを、溝20の上方の開口よりも下にすることもでき、あるいは、溝20の上方の開口よりも上に盛り上げることもできる。溝20に充填された液体32の量が溝20の容積に比べて少ない場合には、液面32aは溝20の開口よりも下になる。この場合、液面32aは、表面張力によって、溝20を画成する壁面側と比べて溝の中央が窪んだ形状となる。
このようにして形成された導電パターンは、基材2の表面に対して突出しておらず、溝の内側で保護されているため、断線などの恐れが低い。また、溝20に充填された液体32の量が溝20の容積に比べて多い場合には、液面32aは溝20の開口よりも上に盛り上がった形状となる。溝20の外側の基材2の表面には撥液膜5が形成されているため、液体32が溝20からあふれて広がることが抑制されるからである。このようにして形成された導電パターンは、基材2の表面に対して突出しているため、ICなどの電気素子と接続する際にバンプとして利用することができる。
2から突出した形状を有する導電パターン83を容易に形成することができる。尚、この第2実施形態に対しても、溝及び凹部の形状、バンプの形成方法等について、前記第1実施形態と同様の変更を加えることができる。
3 導電パターン
4a 端子
5 撥液膜
13 バンプ
20 溝(第1の溝)
21,22 凹部(第1の凹部)
30 導電性材料
31 凹部
31 液滴
32 液体
40 液滴噴射装置
41 表面層
43 バンプ
65,66 導電パターン
70 溝(第1の溝)
71 凹部(第1の凹部)
72 溝(第2の溝)
73 凹部(第2の凹部)
74 連通孔
82 基材
83 導電パターン
93 バンプ
100 レジスト層
101,102 型
103 貫通孔
110 溝
111,112 凹部
120 導電性材料
Claims (8)
- 配線パターンが設けられた配線基板であって、
前記配線基板は
基材と、
前記基材の一方の面側に形成された複数の溝と、
前記基材の前記一方の面側に形成され、前記複数の溝とそれぞれ連通している複数の凹部と、
前記複数の溝と前記複数の凹部に充填された配線材料とを備え、
前記複数の溝は、前記複数の凹部の間隔より小さい間隔で形成されており、
前記凹部に充填された前記配線材料の表面が、前記基材の前記一方の面よりも隆起しており、前記溝部に充填された前記配線材料の表面が、前記基材の前記一方の面よりも窪んでいることを特徴とする配線基板。 - 前記配線材料が導電性材料によって構成されていることを特徴とする請求項1に記載の配線基板。
- 前記導電性材料が銀又は金のナノ粒子を含むことを特徴とする請求項2に記載の配線基板。
- 前記凹部は前記溝の少なくとも一方の端部に形成されていることを特徴とする請求項1に記載の配線基板。
- 前記凹部は、前記基材の一端にまとめて配置されていることを特徴とする請求項1に記載の配線基板。
- 前記複数の溝は、前記一端から前記一端とは反対側の他端へ向かって延びていることを特徴とする請求項5に記載の配線基板。
- 前記凹部は、前記溝の両端に形成されていることを特徴とする請求項4に記載の配線基板。
- 前記溝の前記両端に形成された前記凹部に充填された前記配線材料の表面は、前記基材の一方の面よりも隆起していることを特徴とする請求項7に記載の配線基板。
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JP2002361868A (ja) * | 2000-08-08 | 2002-12-18 | Seiko Epson Corp | インクジェット式記録ヘッド、及び、その製造方法 |
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US6973710B2 (en) * | 2001-08-03 | 2005-12-13 | Seiko Epson Corporation | Method and apparatus for making devices |
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JP2003188497A (ja) * | 2001-12-18 | 2003-07-04 | Yasunaga Corp | 導体回路の形成方法 |
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KR101115291B1 (ko) * | 2003-04-25 | 2012-03-05 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 액적 토출 장치, 패턴의 형성 방법, 및 반도체 장치의 제조 방법 |
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