JP5335759B2 - 変調ダイバーシティのためのシステム及び方法 - Google Patents

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Description

米国特許法１１９条に基づく優先権の主張
本特許出願は、２００４年７月２９日に出願され、これの譲受人へ譲渡され、参照して本明細書に明示的に組み込まれる、特許仮出願第６０／５９２，９９９号、表題「ＯＦＤＭ無線通信システムにおけるチャネルインターリービング方法（ＭＥＴＨＯＤ ＯＦ ＣＨＡＮＮＥＬ ＩＮＴＥＲＬＥＡＶＩＮＧ ＩＮ Ａ ＯＦＤＭ ＷＩＲＥＬＥＳＳ ＣＯＭＭＵＮＩＣＡＴＩＯＮＳ ＳＹＳＴＥＭ）」の優先権を主張する。
開示される実施形態は、一般的には無線通信に関し、より具体的には無線通信システムにおけるチャネルインターリービングに関する。
直交周波数分割多重（ＯＦＤＭ）は高速デジタル信号をブロードキャストするための技術である。ＯＦＤＭシステムでは、単一の高速データストリームが数個の並列低速サブストリームへ分割され、各サブストリームはそれぞれの副搬送周波数を変調するために使用される。本発明は直交振幅変調の観点から説明するが、これを位相偏移キー変調システムへ等しく適用できることに留意されたい。
ＯＦＤＭシステムに用いる変調技術は直交振幅変調（ＱＡＭ）と呼ばれ、ここでは搬送周波数の位相と振幅の両方が変調される。ＱＡＭ変調では、複数のデータビットから複合ＱＡＭシンボルが生成され、各シンボルは実数項と虚数項とを含み、各シンボルは生成元にあたる複数のデータビットを表す。複数のＱＡＭビットは、複素平面によって図式化できるパターンでまとめて送信される。一般的に、そのパターンは「コンステレーション」と呼ばれる。ＯＦＤＭシステムは、ＱＡＭ変調を用いることによってその効率性を改善させることができる。
ある信号がブロードキャストされる場合には、これが２つ以上の経路によって受信器まで伝搬することがある。例えば、ただ一つの送信器からの信号は、直線に沿って受信器まで伝搬でき、且つこれはまた物体から反射し別の経路に沿って受信器まで伝搬できる。さらに、スペクトル効率を増すためいわゆる「セルラー」ブロードキャスト技術をシステムに使用する場合には、受信器を対象とした信号が２つ以上の送信器によってブロードキャストされることがある。したがって、同じ信号が２つ以上の経路に沿って受信器まで送信される。そのような並列信号伝搬は、人為的であれ（すなわち同じ信号を２つ以上の送信器からブロードキャストすることによって生じる）、自然であれ（すなわちエコーによって生じる）、「マルチパス」と呼ばれる。セルラーデジタル放送はスペクトル的には効率的であるが、マルチパス問題に効果的に取り組むための措置を講じなければならないことは容易に理解できる。
幸い、ＱＡＭ変調を使用するＯＦＤＭシステムは、（上で述べたとおり、セルラーブロードキャスト技術を使用する場合に必然である）マルチパス条件の存在下で、単一の搬送周波数だけを使用するＱＡＭ変調技術よりも効果的である。より具体的に、単一搬送波ＱＡＭシステムでは、主経路ほどに強いエコーを有するチャネルを等化するため複雑なイコライザを使用しなければならず、かかる等化の実行は困難である。対照的に、ＯＦＤＭシステムでは、適切な長さのガードインターバルを各シンボルの最初に挿入するだけで、複雑なイコライザの必要性を全面的に解消できる。よって、マルチパス条件が見込まれる場合には、ＱＡＭ変調を使用するＯＦＤＭシステムが好まれる。
典型的なトレリス符号化スキームでは、データストリームが畳み込み符号器により符号化され、次に続くビットはビットグループにまとめられ、同ビットグループがＱＡＭシンボルとなる。１グループ内には数個のビットがあり、１グループ当たりのビット数は整数「ｍ」によって規定される（よって、各グループは「ｍ−ａｒｙ」次元を有すると言われる）。典型的に、「ｍ」の値は４、５、６、又は７であるが、これはそれより多くなることも少なくなることもある。
ビットをマルチビットシンボルにグループ分けした後には、シンボルがインターリーブされる。「インターリーブ」することによって、シンボルストリームは順次に再配置され、これによりチャネル劣化によって生じるおそれのあるエラーをランダム化する。例証するため、５つのワードを送信すると仮定する。非インターリーブ信号の送信中に一時的なチャネル妨害が発生するとする。このような状況下では、チャネル妨害が減少する前に１ワード全体が失われることがあり、失われたワードによってどのような情報が伝達されていたのかを知ることは、不可能ではないにしろ、困難である。
対照的に、もしも５ワードの文字が送信の前に順次に再配置され（すなわち「インターリーブされ」）、チャネル妨害が発生するなら、数文字は、場合によっては１ワード当たり１文字が失われる可能性がある。しかし、再配置された文字を復号化すると、ワードのうち数ワードは文字を欠いてはいるが、全５ワードが出現するであろう。このような状況下で、データを概ね元どおりに復元することがデジタル復号器にとって比較的容易なことは、容易に理解されよう。ｍ−ａｒｙシンボルをインターリーブした後、シンボルは上で指摘したＱＡＭ原理を用いて複合シンボルへマップされ、それぞれの副搬送波チャネルへ多重化され、送信される。
一実施形態によるチャネルインターリーバを示す図である。 別の実施形態によるチャネルインターリーバを示す図である。 一実施形態に従いインターリービングバッファの中に入れられるターボパケットのコードビットを示す図である。 一実施形態に従いＮ／ｍ行×ｍ列のマトリックスに配列されたインターリーババッファを示す図である。 一実施形態によるインターリーブ化インターレース表を示す図である。 一実施形態によるチャネライゼーション図を示す図である。 一実施形態に従い、ある特定のスロットで全１のシフトシーケンスが長くつらなる良好／不良チャネル推定をもたらすチャネライゼーション図を示す図である。 全２のシフトシーケンスが均等に散在する良好／不良チャネル推定インターレースをもたらすチャネライゼーション図を示す図である。 一実施形態に従いインターリービングを実施するべく構成された無線装置を示す図である。
一実施形態において、チャネルインターリーバはビットインターリーバとシンボルインターリーバとを備える。図１は２種類のチャネルインターリービングスキームを示す。両スキームとも、最大のチャネルダイバーシティを達成するため、ビットインターリービング及びインターレースを使用する。
図１ａは一実施形態によるチャネルインターリーバを示す。図１ｂは別の実施形態によるチャネルインターリーバを示す。図１ｂのインターリーバは、専らｍ−ａｒｙ変調ダイバーシティを達成するためにビットインターリーバを使用し、さらに明示的シンボルインターリービングを必要とせずにより優れたインターリービング性能を提供する周波数ダイバーシティを達成するため、２次元インターリーブ化インターレース表とランタイムスロット対インターレースマッピングとを使用する。
図１ａは、ビットインターリービングブロック１０４へ入力されるターボ符号化ビット１０２を示す。ビットインターリービングブロック１０４はインターリーブ化ビットを出力し、同インターリーブ化ビットはコンステレーションシンボルマッピングブロック１０６へ入力される。コンステレーションシンボルマッピングブロック１０６はコンステレーションシンボルマップ化ビットを出力し、同コンステレーションシンボルマップ化ビットは、コンステレーションシンボルインターリービングブロック１０８へ入力される。コンステレーションシンボルインターリービングブロック１０８は、コンステレーションシンボルインターリーブ化ビットをチャネライゼーションブロック１１０へ出力する。チャネライゼーションブロック１１０はインターレース表１１２を用いてコンステレーションシンボルインターリーブ化ビットをインターレースし、ＯＦＤＭシンボル１１４を出力する。
図１ｂは、ビットインターリービングブロック１５４へ入力されるターボ符号化ビット１５２を示す。ビットインターリービングブロック１５４はインターリーブ化ビットを出力し、同インターリーブ化ビットはコンステレーションシンボルマッピングブロック１５６へ入力される。コンステレーションシンボルマッピングブロック１５６はコンステレーションシンボルマップ化ビットを出力し、同コンステレーションシンボルマップ化ビットはチャネライゼーションブロック１５８へ入力される。チャネライゼーションブロック１５８は、インターリーブ化インターレース表と動的スロット対インターレースマッピング１６０とを用いてコンステレーションシンボルインターリーブ化ビットをチャネル化し、ＯＦＤＭシンボル１６２を出力する。
変調ダイバーシティのためのビットインターリービング
図１ｂのインターリーバは、変調ダイバーシティを達成するためビットインターリービング１５４を使用する。ターボパケットのコードビット１５２は、隣接するコードビットが異なるコンステレーションシンボルへマップされるパターンにてインターリーブされる。例えば２ｍ−Ａｒｙ変調の場合、ＮビットインターリーババッファはＮ／ｍブロックへ分割される。隣接するコードビットは隣接するブロックへ順次に書き込まれ、図２ａ（上）に示すとおり、その後バッファの先頭から末尾にかけて順次に１つずつ読み取られる。これは、隣接するコードビットが異なるコンステレーションシンボルへマップされることを保証する。同等に、図２ｂ（下）に示すとおり、インターリーババッファはＮ／ｍ行×ｍ列のマトリックスに配列される。コードビットは列ごとにバッファへ書き込まれ、行ごとに読み取られる。マッピングに依存する１６ＱＡＭの場合、コンステレーションシンボルのあるビットは他のビットより信頼性が高いため、例えば、第１及び第３のビットは第２及び第４のビットより信頼性が高いため、隣接するコードビットがコンステレーションシンボルの同じビット位置へマップされるのを防ぐには、行は左から右へ、そして右から左へ、交互に読み取られるべきである。
図２ａは、一実施形態に従いインターリービングバッファ２０４の中に入れられたターボパケット２０２のコードビットを示す。図２ｂは、一実施形態によるビットインターリービング操作の図解である。図２ｂに示すとおり、ターボパケット２５０のコードビットはインターリービングバッファ２５２の中へ入れられる。インターリービングバッファ２５２は、第２及び第３の列を入れ替えることによって変換され、これにより、一実施形態による、ｍ＝４の、インターリービングバッファ２５４を作る。ターボパケット２５６のインターリーブ化コードビットは、インターリービングバッファ２５４から読み取られる。
簡素化のため、もしも最高変調レベルが１６で、さらにもしもコードビット長が常に４で割れるなら、固定ｍ＝４を使用してよい。この場合に、ＱＰＳＫのため分離を改善するには、中間の２列が読み取りの前に入れ替えられる。この手順は図２ｂ（下）に描かれている。どの２列でも入れ替えてよいことは当業者にとって明白であろう。列がいかなる順序で配置されてもよいこともまた、当業者にとって明白であろう。行がいかなる順序で配置されてもよいこともまた、当業者にとって明白であろう。
別の実施形態においては、第１のステップとして、ターボパケット２０２のコードビットがグループへ分配される。図２ａ及び図２ｂの両方の実施形態もまたコードビットをグループへ分配する点に留意されたい。ただし、ただ単に行又は列を入れ替えるのではなく、各グループの中のコードビットは、各々の与えられたグループのグループビット順序に従ってシャッフルされる。よって、グループへ分配された後の１６個のコードビットからなる４つのグループの順序は、グループの単純な線形順序を用いて｛１、５、９、１３｝｛２、６、１０、１４｝｛３、７、１１、１５｝｛４、８、１２、１６｝となる可能性があるが、シャッフル後の１６個のコードビットからなる４つのグループの順序は｛１３、９、５、１｝｛２、１０、６、１４｝｛１１、７、１５、３｝｛１２、８、４、１６｝となる可能性がある。行又は列を入れ替えることは、このグループ内シャッフルの回帰的ケースにあたることに留意されたい。
インターリーブ化インターレース
一実施形態によると、チャネルインターリーバは、コンステレーションシンボルインターリービングのためインターリーブ化インターレースを用いることにより、周波数ダイバーシティを達成する。これは、明示的なコンステレーションシンボルインターリービングの必要性を解消する。インターリービングは２つのレベルで実行される。
・インターレース内またはイントラインターレースインターリービング：一実施形態においては、１個のインターレースの５００副搬送波がビット逆転方式でインターリーブされる。
・インターレース間またはインターレース内インターリービング：一実施形態においては、８個のインターレースがビット逆転方式でインターリーブされる。
副搬送波数が５００以外になりうることは当業者にとって明白であろう。インターレース数が８以外になりうることもまた、当業者にとって明白であろう。
５００は２の累乗ではないから、一実施形態に従い減少セットビット逆転操作を使用するべきである。以下のコードはその操作を示す。
Figure 0005335759
ｎ＝５００の場合、ｍは２ｍ＞ｎ、すなわち８である最小の整数であり、ｂｉｔＲｅｖは正規ビット逆転操作である。
データチャネルのコンステレーションシンボルシーケンスのシンボルは、一実施形態による、図３に描かれたインターレース表を用いてチャネライザによって決定される割り当てスロットインデックスに従い順次線形方式で対応する副搬送波へマップされる。
図３は、一実施形態によるインターリーブ化インターレース表を図解する。ターボパケット３０２と、コンステレーションシンボル３０４と、インターリーブ化インターレース表３０６とが示されている。また、インターレース０（３０８）と、インターレース４（３１０）と、インターレース２（３１２）と、インターレース６（３１４）と、インターレース１（３１６）と、インターレース５（３１８）と、インターレース３（３２０）と、インターレース７（３３２）とが示されている。
一実施形態においては、８つのインターレースのうち１つがパイロットとして使われる、すなわちインターレース２とインターレース６とがパイロットとして交互に使われる。その結果、チャネライザはスケジューリングのため７つのインターレースを使用できる。便宜上、チャネライザはスケジューリングユニットとしてスロットを使用する。スロットは、ＯＦＤＭシンボルの１インターレースとして規定される。インターレース表は、スロットをある特定のインターレースへマップするために使用される。８つのインターレースを使用するため、８つのスロットがある。７つのスロットはチャネライゼーションのため取っておき、１つのスロットはパイロットのため取っておく。一般性を損なうことなく、図４に示すとおり、スロット０はパイロットのために使用され、スロット１から７はチャネライゼーションのために使用され、垂直軸はスロットインデックス４０２であり、水平軸はＯＦＤＭシンボルインデックス４０４であり、太字の項目はＯＦＤＭシンボル時にて対応するスロットへ割り当てられるインターレースインデックスである。
図４は一実施形態によるチャネライゼーション図を示す。図４は、スケジューラ４０６のために予約されるスロットインデックス４０６と、パイロット４０８のために予約されるスロットインデックス４０８とを示す。太字の項目はインターレースインデックス番号である。四角をともなう数字はパイロットに隣接するインターレースであって、結果的にチャネル推定が良好なインターレースである。
四角で囲まれた数字はパイロットに隣接するインターレースであって、結果的にチャネル推定が良好なインターレースである。スケジューラはひとまとまりの連続するスロットとＯＦＤＭシンボルとをデータチャネルへ割り当てるから、インターレース間インターリービングにより、データチャネルへ割り当てられる連続するスロットが不連続のインターレースへマップされることは明白である。よって、より一層の周波数ダイバーシティ利得を達成できる。
ただし、この静的な割り当て（つまり、スロットから物理的インターレースへのマッピング表（スケジューラスロット表はパイロットスロットを含まない）は時間の経過にともない変化しない）は１つの問題を被る。つまり、もしもデータチャネル割り当てブロック（長方形を仮定する）が複数のＯＦＤＭシンボルを占めるなら、データチャネルへ割り当てられるインターレースは時間の経過にともない変化せず、周波数ダイバーシティの損失を招く。解決するには、ＯＦＤＭシンボルからＯＦＤＭシンボルにかけてスケジューラインターレース表を周期的にシフトするだけでよい（つまり、パイロットインターレースを除外する）。
図５は、１ＯＦＤＭシンボルにつき１回スケジューラインターレース表をシフトする操作を描く。この方式は、静的インターレース割り当ての問題を首尾よく打開する、すなわち、ある特定のスロットは異なるＯＦＤＭシンボル時に異なるインターレースへマップされる。
図５は、一実施形態に従い、ある特定のスロット５０２で全て１のシフトシーケンスが長くつらなる良好／不良チャネル推定をもたらすチャネライゼーション図を示す。図５は、スケジューラ５０６のために予約されるスロットインデックス５０６と、パイロット５０８のために予約されるスロットインデックスとを示す。スロットシンボルインデックス５０４は水平軸上に示されている。
ただし、短くつらなる良好チャネル推定インターレースと短くつらなる不良チャネル推定のインターレースとからなる好適なパターンとは対照的に、スロットには、良好チャネル推定の４つの連続するインターレースが割り当てられ、その後ろに長くつらなる不良チャネル推定のインターレースが続く。図の中で、パイロットインターレースに隣接するインターレースは四角で印されている。長くつらなる良好／不良チャネル推定の問題を解決するには、全て１のシーケンスとは別のシフトシーケンスを使用する。この課題を果たすため、使用できるシーケンスは数多くある。最も簡素なシーケンスは全て２のシーケンスである、すなわちスケジューラインターレース表は、１ＯＦＤＭシンボルにつき１回の代わりに２回シフトされる。図６に示す結果は、チャネライザのインターレースパターンを大幅に改善する。このパターンが２×７＝１４ＯＦＤＭシンボルごとに繰り返されることに留意されたい（ここで、２はパイロットインターレーススタガー周期であり、７はチャネライザインターレースシフト周期である）。
送信器と受信器の両方で操作を簡素化するには、与えられたＯＦＤＭシンボル時にてスロットからインターレースへのマッピングを決定するため簡素な式を使用できる。
Figure 0005335759
ここで
・Ｎ＝Ｉ−１はトラフィックデータスケジューリングのために使用されるインターレースの数であり、ここでＩは総インターレース数である、
・ｉ∈｛０，１，．．．，Ｉ−１｝は、パイロットインターレースを除き、スロットｓがＯＦＤＭシンボルｔにてマップする先のインターレースインデックスである、
・ｔ＝０，１，．．．，Ｔ−１は、スーパーフレームにおけるＯＦＤＭシンボルインデックスであり、ここでＴはフレーム２における総ＯＦＤＭシンボル数である。現在の設計でフレーム内のＯＦＤＭ記号数は１４で割れないから、フレームに代わるスーパーフレームにおけるＯＦＤＭ記号インデックスはさらなるダイバーシティをフレームへ与える。
・ｓ＝１，２，．．．，Ｓ−１ｓはスロットインデックスであり、ここでＳは総スロット数である、
・Ｒは１ＯＦＤＭシンボル当たりのシフト回数である、
Figure 0005335759
は減少セットビット逆転操作である。つまり、パイロットによって使用されるインターレースはビット逆転操作から除外されることになる。
例：一実施形態において、Ｉ＝８、Ｒ＝２。対応するスロット−インターレースマッピング式は、
Figure 0005335759
となり、
ここで、
Figure 0005335759
は以下の表に対応する。
Figure 0005335759
この表は以下のコードによって生成できる。
Figure 0005335759
ここでｍ＝３であり、ｂｉｔＲｅｖは正規ビット逆転操作である。
ＯＦＤＭシンボルｔ＝１１の場合、パイロットはインターレース６を使用する。スロットとインターレースとの間のマッピングは、
・スロット１は
Figure 0005335759
のインターレースへマップし、
・スロット２は
Figure 0005335759
のインターレースへマップし、
・スロット３は
Figure 0005335759
のインターレースへマップし、
・スロット４は
Figure 0005335759
のインターレースへマップし、
・スロット５は
Figure 0005335759
のインターレースへマップし、
・スロット６は
Figure 0005335759
のインターレースへマップし、
・スロット７は
Figure 0005335759
のインターレースへマップすることになる。
結果として得られるマッピングは図６のマッピングに合致する。図６は、全て２のシフトシーケンスが均等に散在する良好／不良チャネル推定インターレースをもたらす、チャネライゼーション図を示す。
一実施形態によると、インターリーバは以下の特徴を有する、
ビットインターリーバは、コードビットを異なる変調シンボルへインターリーブすることによりｍ−Ａｒｙ変調ダイバーシティの利点を活かすべく設計される、
インターレース内インターリービングとインターレース間インターリービングとにより周波数ダイバーシティを達成するべく設計される「シンボルインターリービング」。
ＯＦＤＭシンボルからＯＦＤＭシンボルにかけてスロット−インターレースマッピング表を変更することにより、さらなる周波数ダイバーシティ利得とチャネル推定利得とが達成される。この目標を達成するため、簡素なローテーションシーケンスが提案される。
図７は、一実施形態に従いインターリービングを実施するべく構成された無線装置を示す。無線装置７０２は、アンテナ７０４と、デュプレクサ７０６と、受信器７０８と、送信器７１０と、プロセッサ７１２と、メモリ７１４とを備える。プロセッサ７１２は、一実施形態に従いインターリービングを実行できる。プロセッサ７１２は、これの操作を実行するためバッファ又はデータ構造としてメモリ７１４を使用する。
当業者なら、様々な技術及び技法のいずれかを用いて情報と信号とを表現できることを理解するであろう。例えば、上の説明を通じて言及されるデータ、命令、コマンド、情報、信号、ビット、シンボル、及びチップは、電圧、電流、電磁波、磁場又は磁性粒子、光場又は光粒子、又はこれらの任意の組み合わせによって表現してよい。
当業者ならさらに、本明細書にて開示される実施形態との関係で述べた種々の例示的な論理ブロック、モジュール、回路、及びアルゴリズムステップを、電子ハードウェア、コンピュータソフトウェア、又は双方の組み合わせとして実施できることを認めるであろう。このハードウェアとソフトウェアとの互換性を明確に例証するため、種々の例示的コンポーネント、ブロック、モジュール、回路、及びステップは、概してそれらの機能性の観点から上に説明してきた。かかる機能性がハードウェアとして、又はソフトウェアとして実施されるか否かは、特定の応用と、システム全体に課せられる設計上の制約とによって決まる。当業者なら、説明した機能性を特定の応用ごとに異なる方法で実施できるであろうが、かかる実施の決定は、本発明の範囲から逸脱を生じさせるものとして解釈すべきではない。
本明細書にて開示される実施形態との関係で述べた種々の例示的な論理ブロック、モジュール、及び回路は、ここで説明した機能を実行するべく設計された汎用プロセッサ、デジタル信号プロセッサ（ＤＳＰ）、特定用途向け集積回路（ＡＳＩＣ）、フィールドプログラマブルゲートアレイ（ＦＰＧＡ）、又はその他のプログラム可能論理素子、ディスクリートゲート又はトランジスタロジック、個別ハードウェアコンポーネント、又はこれらの任意の組み合わせにより実施又は実行してよい。汎用プロセッサはマイクロプロセッサであってよく、ただし代案において、プロセッサは任意の従来のプロセッサ、コントローラ、マイクロコントローラ、又は状態機械であってよい。プロセッサはまた、計算装置の組み合わせとして、例えばＤＳＰとマイクロプロセッサとの組み合わせ、複数のマイクロプロセッサ、ＤＳＰコアと連携する1つ以上のマイクロプロセッサ、又は任意の他のそのような構成として実施してよい。
本明細書にて開示される実施形態との関係で述べた方法又はアルゴリズムのステップは、ハードウェアにて直に、プロセッサによって実行されるソフトウェアモジュールにて、又は２つの組み合わせにて、具現化してよい。ソフトウェアモジュールは、ＲＡＭメモリ、フラッシュメモリ、ＲＯＭメモリ、ＥＰＲＯＭメモリ、ＥＥＰＲＯＭメモリ、レジスタ、ハードディスク、リムーバブルディスク、ＣＤ−ＲＯＭ、又は当技術分野で公知の任意の他の記憶媒体形態に常駐してよい。例示的記憶媒体はプロセッサへ結合され、かくしてプロセッサは記憶媒体から情報を読み取ることができ、且つ同記憶媒体へ情報を書き込むことができる。代案において、記憶媒体はプロセッサへ一体化してよい。プロセッサと記憶媒体とはＡＳＩＣに常駐してよい。ＡＳＩＣは利用者端末に常駐してよい。代案において、プロセッサと記憶媒体とは利用者端末にてディスクリートコンポーネントとして常駐してよい。
開示された実施形態のこれまでの説明は、当業者による本発明の製作を、又は使用を、可能にするために提供されている。これらの実施形態に対する様々な変更は当業者にとって直ちに明白となるであろうし、本明細書で定めた一般原理は、本発明の精神又は範囲から逸脱することなく他の実施形態へ適用できる。よって、本発明は本明細書で示された実施形態に限定されることを意図せず、本明細書で開示される原理と新規な特徴とに合致する最も広い範囲が与えられるべきものである。

Claims (41)

  1. インターリービングのための方法であって、
    ターボ符号化されたコードビットを、隣接するコードビットが異なるグループへと順次に分配され、その結果前記コードビットが第１の順序へとインターリーブされるビット順序に従って、複数のグループへ分配することと、
    前記ターボ符号化されたコードビットが、第２の順序に基づいてコンステレーションシンボルへと変調されるように該第２の順序へとさらにインターリーブされるよう、前記複数のグループの各々の中で前記分配されたターボ符号化されたコードビットをシャッフルすることと、
    を含む、方法。
  2. 前記ターボ符号化されたコードビットをシャッフルすることは、前記グループの各々についてグループビット順序に従ってグループ内シャッフルすることを備えている、請求項１に記載の方法。
  3. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項１に記載の方法。
  4. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項２に記載の方法。
  5. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、列を入れ替えることと等しい、請求項２に記載の方法。
  6. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、行を入れ替えることと等しい、請求項２に記載の方法。
  7. 前記グループビット順序に従い前記グループからターボ符号化されたコードビットを送信することをさらに含む、請求項５に記載の方法。
  8. 前記グループビット順序に従い前記グループからターボ符号化されたコードビットを送信することをさらに含む、請求項６に記載の方法。
  9. 前記ターボ符号化されたコードビットを備えているターボパケットを受信すること、
    をさらに備え、前記分配することは、前記グループの異なるものに、前記ターボパケットにおける、隣接するターボ符号化されたコードビットを入れることを備える、請求項１に記載の方法。
  10. 無線通信のための装置であって、
    プロセッサと、
    前記プロセッサに結合されたメモリと、
    を備え、前記プロセッサは、
    ターボ符号化されたコードビットを、隣接するコードビットが異なるグループへと順次に分配され、その結果前記コードビットが第１の順序へとインターリーブされるビット順序に従って、複数のグループへ分配するように、
    前記ターボ符号化されたコードビットが、第２の順序に基づいてコンステレーションシンボルへと変調されるように該第２の順序へとさらにインターリーブされるよう、前記複数のグループの各々の中で前記分配されたターボ符号化されたコードビットをシャッフルするように、
    構成される、装置。
  11. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項１０に記載の装置。
  12. 前記プロセッサは、前記グループの各々についてグループビット順序に従ってグループ内シャッフルすることを引き起こすようにさらに構成される、請求項１０に記載の装置。
  13. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項１２に記載の装置。
  14. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、列を入れ替えることと等しい、請求項１２に記載の装置。
  15. 前記プロセッサは、前記グループビット順序に従い前記グループから前記ターボ符号化されたコードビットの送信を引き起こすようにさらに構成される、請求項１４に記載の装置。
  16. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、行を入れ替えることと等しい、請求項１２に記載の装置。
  17. 前記プロセッサは、前記グループビット順序に従い前記グループから前記ターボ符号化されたコードビットの送信を引き起こすようにさらに構成される、請求項１６に記載の装置。
  18. 無線通信のための装置であって、
    ターボ符号化されたコードビットを、隣接するコードビットが異なるグループへと順次に分配され、その結果前記コードビットが第１の順序へとインターリーブされるビット順序に従って、複数のグループへ分配するための手段と、
    前記ターボ符号化されたコードビットが、第２の順序に基づいてコンステレーションシンボルへと変調されるように該第２の順序へとさらにインターリーブされるよう、前記複数のグループの各々の中で前記分配されたターボ符号化されたコードビットをシャッフルするための手段と、
    を含む、
    装置。
  19. 前記ビット順序は、線形順序である、請求項１８に記載の装置。
  20. 前記ターボ符号化されたコードビットをシャッフルするための手段は、前記グループの各々についてグループビット順序に従ってグループ内シャッフルするための手段を備えている、請求項１８に記載の装置。
  21. 前記ビット順序は、線形順序である、請求項２０に記載の装置。
  22. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、列を入れ替えることと等しい、請求項２０に記載の装置。
  23. 前記グループビット順序に従い前記グループから前記ターボ符号化されたコードビットの送信を引き起こすための手段、をさらに含む、請求項２２に記載の装置。
  24. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、行を入れ替えることと等しい、請求項２０に記載の装置。
  25. 前記グループビット順序に従い前記グループから前記ターボ符号化されたコードビットの送信を引き起こすための手段、をさらに含む、請求項２４に記載の装置。
  26. コンピュータプログラム製品であって、
    ターボ符号化されたコードビットを、隣接するコードビットが異なるグループへと順次に分配され、その結果前記コードビットが第１の順序へとインターリーブされるビット順序に従って、複数のグループへ分配することと、
    前記ターボ符号化されたコードビットが、第２の順序に基づいてコンステレーションシンボルへと変調されるように該第２の順序へとさらにインターリーブされるよう、前記複数のグループの各々の中で前記分配されたターボ符号化されたコードビットをシャッフルすることと、
    の機能を実行するコード、
    を実施するコンピュータによって実行可能なコードを保存するタンジブルコンピュータ読み取り可能記憶媒体、
    を備える、コンピュータプログラム製品。
  27. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項２６に記載のコンピュータプログラム製品。
  28. 前記ターボ符号化されたコードビットをシャッフルすることは、前記グループの各々についてグループビット順序に従ってグループ内シャッフルすることを備えている、請求項２６に記載のコンピュータプログラム製品。
  29. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項２８に記載のコンピュータプログラム製品。
  30. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、列を入れ替えることと等しい、請求項２８に記載のコンピュータプログラム製品。
  31. 前記コンピュータ読み取り可能記憶媒体は、前記グループビット順序に従い前記グループからターボ符号化されたコードビットを送信するためのコードをさらに含む、請求項３０に記載のコンピュータプログラム製品。
  32. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、行を入れ替えることと等しい、請求項２８に記載のコンピュータプログラム製品。
  33. 前記コンピュータ読み取り可能記憶媒体は、前記グループビット順序に従い前記グループからターボ符号化されたコードビットを送信するためのコードをさらに含む、請求項３２に記載のコンピュータプログラム製品。
  34. 前記コンピュータ読み取り可能記憶媒体は、前記ターボ符号化されたコードビットを備えているターボパケットを受信するためのコード、をさらに備え、前記分配することは、前記グループの異なるものに、前記ターボパケットにおける、隣接するターボ符号化されたコードビットを入れることを備える、請求項２６に記載のコンピュータプログラム製品。
  35. インターリービングのための装置であって、
    隣接するコードビットが異なるグループへと順次に分配され、その結果前記コードビットが第１の順序へとインターリーブされるビット順序に従って複数のグループへ分配されたターボ符号化されたコードビットを保存し、前記ターボ符号化されたコードビットが、第２の順序に基づいてコンステレーションシンボルへと変調されるように該第２の順序へとさらにインターリーブされるよう、前記複数のグループの各々の中で前記分配されたターボ符号化されたコードビットをシャッフルするためのインタリービングバッファ、
    を備える、装置。
  36. 前記ターボ符号化されたコードビットをシャッフルすることは、前記グループの各々についてグループビット順序に従ってグループ内シャッフルすることを備えている、請求項３５に記載の装置。
  37. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項３５に記載の装置。
  38. 前記ターボ符号化されたコードビットは、前記グループの各々へと順次分配される、請求項３６に記載の装置。
  39. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、列を入れ替えることと等しい、請求項３６に記載の装置。
  40. 前記グループビット順序に従って前記グループ内シャッフルすることは、前記グループをマトリックスとして見た場合に、行を入れ替えることと等しい、請求項３６に記載の装置。
  41. 前記インタリービングバッファは、前記ターボ符号化されたビットを備えているターボパケットを受信するように構成されており、前記分配することは、前記グループの異なるものに、前記ターボパケットにおける、隣接するターボ符号化されたコードビットを入れることを備える、請求項３５に記載の装置。
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