JP2014229893A - 積層セラミックキャパシタ及び積層セラミックキャパシタの実装基板 - Google Patents
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Abstract
【解決手段】誘電体層111を含み、幅をW、厚さをTとするとき、T/W>1.1を満たすセラミック本体110と、第1リード部を有する第1内部電極121と、誘電体層111を介して第1内部電極121に対向配置され、第2リード部を有する第2内部電極122と、第1リード部と電気的に接続され、第1リード部が露出した側面から第1及び第2主面のうち少なくとも一面に延長形成される第1外部電極131と、第2リード部と電気的に接続され、第2リード部が露出した側面から第1及び第2主面のうち少なくとも一面に延長形成される第2外部電極132と、第1及び第2リード部の露出した領域と第1及び第2外部電極131,132とを覆うように形成された絶縁層と、を含む。
【選択図】図1
Description
110 セラミック本体
111 誘電体層
121、122 第1及び第2内部電極
131、132 外部電極
200 実装基板
210 印刷回路基板
221、222 第1及び第2電極パッド
230 はんだ
Claims (26)
- 誘電体層を含み、幅をW、厚さをTとするとき、T/W>1.1を満たし、厚さ方向に相対する第1及び第2主面、長さ方向に相対する第1及び第2端面及び幅方向に相対する第1及び第2側面を有するセラミック本体と、
前記セラミック本体の少なくとも一つ以上の側面に露出する第1リード部を有する第1内部電極と、
前記誘電体層を介して前記第1内部電極に対向配置され、前記セラミック本体の少なくとも一つ以上の側面に露出する第2リード部を有する第2内部電極と、
前記セラミック本体の側面に露出した第1リード部と電気的に接続され、前記第1リード部が露出した側面から前記第1及び第2主面のうち少なくとも一面に延長形成される第1外部電極と、
前記セラミック本体の側面に露出した第2リード部と電気的に接続され、前記第2リード部が露出した側面から前記第1及び第2主面のうち少なくとも一面に延長形成される第2外部電極と、
前記第1及び第2リード部の露出した領域と前記第1及び第2側面上に形成された第1及び第2外部電極とを覆うように形成された絶縁層と
を含む、積層セラミックキャパシタ。 - 前記第1リード部及び第2リード部において、前記セラミック本体の第1または第2側面に露出した領域は互いに重なり合う、請求項1に記載の積層セラミックキャパシタ。
- 前記第1リード部及び第2リード部において、前記セラミック本体の第1または第2側面に露出した領域は互いに重なり合わない、請求項1に記載の積層セラミックキャパシタ。
- 前記第1リード部及び第2リード部において、前記セラミック本体の第1または第2側面に露出した領域の幅は、第1または第2側面に形成された第1及び第2外部電極の幅より狭い、請求項1に記載の積層セラミックキャパシタ。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面のうちいずれか一面に延長形成される、請求項1に記載の積層セラミックキャパシタ。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面に延長形成される、請求項1に記載の積層セラミックキャパシタ。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面のうちいずれか一面と第2側面に延長形成される、請求項1に記載の積層セラミックキャパシタ。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面と第2側面に延長形成される、請求項1に記載の積層セラミックキャパシタ。
- 前記絶縁層は、有機樹脂、セラミック、無機フィラー、ガラスまたはこれらの混合物を含む、請求項1に記載の積層セラミックキャパシタ。
- 前記第1及び第2内部電極は、前記セラミック本体の実装面に対して水平に配置される、請求項1に記載の積層セラミックキャパシタ。
- 前記誘電体層の平均厚さをtdとすると、0.1μm≦td≦2.0μmを満たす、請求項1に記載の積層セラミックキャパシタ。
- 前記第1及び第2内部電極の厚さは1.5μm以下である、請求項1に記載の積層セラミックキャパシタ。
- 前記誘電体層の積層数は200層以上である、請求項1に記載の積層セラミックキャパシタ。
- 上部に第1及び第2電極パッドを有する印刷回路基板と、
前記印刷回路基板上に設置された積層セラミックキャパシタと、を含み、
前記積層セラミックキャパシタは、誘電体層を含み、幅をW、厚さをTとするとき、T/W>1.1を満たし、厚さ方向に相対する第1及び第2主面、長さ方向に相対する第1及び第2端面及び幅方向に相対する第1及び第2側面を有するセラミック本体、前記セラミック本体の少なくとも一つ以上の側面に露出する第1リード部を有する第1内部電極、前記誘電体層を介して前記第1内部電極に対向配置され、前記セラミック本体の少なくとも一つ以上の側面に露出する第2リード部を有する第2内部電極、前記セラミック本体の側面に露出した第1リード部と電気的に接続され、前記第1リード部が露出した側面から前記第1及び第2主面のうち少なくとも一面に延長形成される第1外部電極、前記セラミック本体の側面に露出した第2リード部と電気的に接続され、前記第2リード部が露出した側面から前記第1及び第2主面のうち少なくとも一面に延長形成される第2外部電極及び前記第1及び第2リード部の露出した領域と前記第1及び第2側面上に形成された第1及び第2外部電極とを覆うように形成された絶縁層を含む、積層セラミックキャパシタの実装基板。 - 前記第1リード部及び第2リード部において、前記セラミック本体の第1または第2側面に露出した領域は互いに重なり合う、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1リード部及び第2リード部において、前記セラミック本体の第1または第2側面に露出した領域は互いに重なり合わない、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1リード部及び第2リード部において、前記セラミック本体の第1または第2側面に露出した領域の幅は、第1または第2側面に形成された第1及び第2外部電極の幅より狭い、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面のうちいずれか一面に延長形成される、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面に延長形成される、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面のうちいずれか一面と第2側面に延長形成される、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1及び第2外部電極は、前記第1側面から前記第1及び第2主面と第2側面に延長形成される、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記絶縁層は、有機樹脂、セラミック、無機フィラー、ガラスまたはこれらの混合物を含む、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1及び第2内部電極は、前記セラミック本体の実装面に対して水平に配置される、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記誘電体層の平均厚さをtdとすると、0.1μm≦td≦2.0μmを満たす、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記第1及び第2内部電極の厚さは1.5μm以下である、請求項14に記載の積層セラミックキャパシタの実装基板。
- 前記誘電体層の積層数は200層以上である、請求項14に記載の積層セラミックキャパシタの実装基板。
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