JP2006140988A - 半導体装置のクロック発振器 - Google Patents
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Abstract
半導体装置用のクロック発信器として、電源電圧の変化と関係なく一定のクロック周期を有する基準クロックを生成し、半導体装置の各内部制御信号の持続時間を電源電圧の変動と関係なく一定に維持させることができるクロック発信器を提供する。
【解決手段】
基準電圧と予め設定されたRC遅延値に応じて生成される徐々に遷移する第一及び第二の電圧とを比較し、その比較結果に基づいて論理回路を反転させることにより基準クロックを生成するタイプの半導体装置用クロック発信器において、前記基準電圧を電源電圧の変化に比例して変化させる基準電圧生成部を設ける。
【選択図】図1
Description
12 … 第二電圧生成部
13 … 基準電圧生成部
14 … 第一比較部
15 … 第二比較部
16 … 論理演算部
Claims (9)
- 基準電圧と、予め設定されたRC遅延値に応じて生成された電圧とを比較し、その比較結果に基づいて基準クロックを生成する半導体装置のクロック発振器において、
前記基準電圧が電源電圧の変動に対応して変化するように生成する基準電圧生成部を含んでなることを特徴とする半導体装置のクロック発振器。 - 第1RC遅延値に応じて第一電圧を生成する第一電圧生成部と、
第2RC遅延値に応じて第二電圧を生成する第二電圧生成部と、
電源電圧の変動に対応して変化する基準電圧を生成する基準電圧生成部と、
前記第一電圧と前記基準電圧とを比較する第一比較部と、
前記第二電圧と前記基準電圧とを比較する第二比較部と、
前記第一及び第二比較部の出力信号をラッチして基準クロックを生成する論理演算部とを含んでなる半導体装置のクロック発振器。 - 請求項1または2に記載の半導体装置のクロック発振器において、
前記基準電圧生成部は、イネーブルバー信号によってイネーブルされる
ことを特徴とするクロック発振器。 - 請求項1または2に記載の半導体装置のクロック発振器において、
前記基準電圧生成部は、前記電源電圧を分圧して前記基準電圧を生成する
ことを特徴とするクロック発振器。 - 請求項1または2に記載の半導体装置のクロック発振器において、
前記基準電圧生成部は、
イネーブルバー信号に応じて動作するPMOSトランジスタと、
前記PMOSトランジスタを介して伝達される前記電源電圧を分圧して前記基準電圧を生成する第一及び第二の抵抗とを含む
ことを特徴とするクロック発振器。 - 請求項2に記載の半導体装置のクロック発振器において、
前記第一電圧生成部は、
前記論理演算部の第一出力端の出力信号を反転させて出力するインバータと、
前記インバータのPMOSトランジスタと前記第一電圧が出力される出力端との間に接続された抵抗と、
前記出力端と接地電圧源との間に接続されたキャパシタとを含む
ことを特徴とするクロック発振器。 - 請求項2に記載の半導体装置のクロック発振器において、
前記第2電圧生成部は、
前記論理演算部の第二出力端の出力信号を反転させて出力するインバータと、
前記インバータのPMOSトランジスタと前記第二電圧が出力される出力端との間に接続された抵抗と、
前記出力端と接地電圧源との間に接続されたキャパシタとを含む
ことを特徴とするクロック発振器。 - 請求項2に記載の半導体装置のクロック発振器において、
前記第一比較部及び第二比較部は、イネーブルバー信号によってイネーブルされる
ことを特徴とするクロック発振器。 - 請求項2に記載の半導体装置のクロック発振器において、
前記論理演算部は、SRラッチで構成される
ことを特徴とするクロック発振器。
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