KR910017773A - 버퍼 회로 - Google Patents

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Abstract

내용 없음

Description

버퍼 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 직접 회로의 칩상에 조정된 드라이버 시스템을 블럭 형태로 도시한 회로도, 제2도는 본 발명의 양호한 실시예에 따른 버퍼의 부분 블럭 형태 및 부분 개략적인 형태를 도시한 회로도.

Claims (14)

  1. 제1제어 신호 및 제2제어 신호를 수신하고 출력 전압을 생성하기 위한 전압 발생기 회로, 출력 전압 및 입력 전압을 수신하고 제1제어 신호를 생성하기 위한 제1제어 회로, 및 출력 전압 및 입력 전압을 수신하고 제2제어 신호를 생성하기 위한 제2 제어 회로를 포함하는 것을 특징으로 하는 집적 회로.
  2. 제1항에 있어서, 상기 전압 발생기 회로가 전압 드라이버를 포함하는 것을 특징으로 하는 집적 회로.
  3. 제2항에 있어서, 상기 제1제어 회로가 제1비교기 회로를 포함하는 것을 특징으로 하는 집적 회로.
  4. 제3항에 있어서, 상기 제2제어 회로가, 입력 전압을 시프트하기 위한 입력 전압 시프터 회로, 출력 전압을 시프트하기 위한 출력 전압 시프터 회로, 및 시프트된 입력 전압을 시프트된 출력 전압과 비교하기 위한 제2전압 비교기 회로를 포함하는 것을 특징으로 하는 집적 회로.
  5. 제1항에 있어서, 상기 출력 전압이 제1 및 제2제어 회로에 의해 수신되기 전에 출력 전압에 접속된 커패시터를 포함하는 것을 특징으로 하는 집적 회로.
  6. 제4항에 있어서, 상기 출력 전압이 제1 및 제2제어 회로에 의해 수신되기 전에 출력 전압에 접속된 커패시터를 포함하는 것을 특징으로 하는 집적 회로.
  7. 제6항에 있어서, 바이어스 전압을 수신하고, 제1비교 회로, 제1전압 시프터 회로, 및 제2전압 시프터 회로를 바이어스 시키는 전류를 생성하기 위한 바이어스 전류 발생기 회로를 포함하는 것을 특징으로 하는 집적 회로.
  8. 제7항에 있어서, 제2비교기가 전압을 수신하는 것을 특징으로 하는 집적 회로.
  9. 제6항에 있어서, 전압 드라이버가 직렬로 접속된 풀업 트랜지스터 및 풀다운 트랜지스터, 풀다운 트랜지스터보다 높은 전위에서 바이어스되어 있는 풀업 트랜지스터, 제1제어 신호를 수신하고 있는 풀업 트랜지스터, 및 제2제어 수신을 수신하고 있는 풀다운 트랜지스터를 포함하는 것을 특징으로 하는 집적 회로.
  10. 제9항에 있어서, 제1비교기가, n채널 MOS 차동 증폭기, n채널 MOS 차동 증폭기에 접속된 p채널 트랜지스터의 전류 미러 능동 부하, 및 n채널 MOS차동 증폭기에 접속된 n채널 전류원 트랜지스터를 포함하는 것을 특징으로 하는 집적 회로.
  11. 제10항에 있어서, 제2비교기가, P 채널 MOS 차동 증폭기, P 채널 MOS 차동 증촉기에 접속된 n채널 트랜지스터의 전류 미러 능동 부하, 및 P 채널 MOS 차동 증폭기에 접속된 p채널 전류원 트랜지스터를 포함하는 것을 특징으로 하는 집적 회로.
  12. 입력 전압을 시프트 하기 위한 입력 전압 시프터 회로, 출력 전압을 시프트하기 위한 출력 전압 시프터 회로, 입력 전압을 출력 전압과 비교하여 제1제어 신호를 생성하기 위한 제1비교기 회로, 시프트된 입력 전압을 시프트된 출력 전압과 비교하고 제2제어 신호를 생성하기 위한 제2비교기 회로, 및 상기 제1제어 신호 및 상기 제2제어 신호를 수신하고 출력 전압을 생성하기 위한 전압 드라이버 회로를 포함하는 것을 특징으로 하는 버퍼 회로.
  13. 제12항에 있어서, 출력 전압, 제1비교기, 및 출력 전압 시프터 회로에 접속된 커패시터를 포함하는 것을 특징으로 하는 버퍼 회로.
  14. 제13항에 있어서, 입력 전압 시프터가 시프트된 입력 전압을 감소시키기 위해 끊어질 수 있는 퓨즈를 갖고 있으며, 출력 전압 시프터가 시프트된 출력 전압을 감소기키기 위해 끊어질 수 있는 퓨즈를 갖고 있는 것을 특징으로 하는 버퍼 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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