JPS61234153A - デイジタル変調器 - Google Patents
デイジタル変調器Info
- Publication number
- JPS61234153A JPS61234153A JP60074215A JP7421585A JPS61234153A JP S61234153 A JPS61234153 A JP S61234153A JP 60074215 A JP60074215 A JP 60074215A JP 7421585 A JP7421585 A JP 7421585A JP S61234153 A JPS61234153 A JP S61234153A
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- JP
- Japan
- Prior art keywords
- sampling
- digital modulator
- rom
- input data
- multiplexer
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L27/00—Modulated-carrier systems
- H04L27/18—Phase-modulated carrier systems, i.e. using phase-shift keying
- H04L27/20—Modulator circuits; Transmitter circuits
- H04L27/2032—Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner
- H04L27/2092—Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner with digital generation of the modulated carrier (does not include the modulation of a digitally generated carrier)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、ディジタル信号処理を用いて形成し几ディジ
タル変調器に係シ、特に４相位相変調に好適なディジタ
ル変調器に関する。
タル変調器に係シ、特に４相位相変調に好適なディジタ
ル変調器に関する。
４相位相変調器のように伝送すべきデータを直交する搬
送波で変調する位相変調器をディジタル技術によって構
成するものとしては変調波の波形整形のみをディジタル
的に行な埴、搬送波を変調するにはアナログ回路を用い
る方式が主である。
送波で変調する位相変調器をディジタル技術によって構
成するものとしては変調波の波形整形のみをディジタル
的に行な埴、搬送波を変調するにはアナログ回路を用い
る方式が主である。
又、ディジタル的に搬送波を変調する回路も・知られて
いるが、特開昭５３−２４７６３号（データ送信方式）
に記載のように、複数個のＲＯＭと加算器が必要であり
、回路構成の複雑さの点については配慮されていなかっ
た。
いるが、特開昭５３−２４７６３号（データ送信方式）
に記載のように、複数個のＲＯＭと加算器が必要であり
、回路構成の複雑さの点については配慮されていなかっ
た。
本発明の目的は、従来の欠点を除去する九めになされた
もので、加算器は一切使用せず、読出し専用メモリ（Ｒ
ＯＭ）１個で４相位相変調回路を実現し、波形整形フィ
ルタリング操作とキャリア変調の処理を全てディジタル
回路にて実現するディジタル位相変調器を提供すること
を目的とする。
もので、加算器は一切使用せず、読出し専用メモリ（Ｒ
ＯＭ）１個で４相位相変調回路を実現し、波形整形フィ
ルタリング操作とキャリア変調の処理を全てディジタル
回路にて実現するディジタル位相変調器を提供すること
を目的とする。
本発明の概要を第４図に従って説明する。図中に示す上
側の波形は波形整形フィルタの単位インパルス応答波形
である。ここで変調搬送波の周波数をｆｃとした場合そ
の周期Ｔｃに対してサンプリング周期Ｔａを４分の１に
とる。このサンプリングポイントをＰ、Ｑ交互の入力デ
ータの時間応答サンプリング値と考えちると、周期Ｔｇ
Ｘ２でこのサンプリング値を正負へ置きかえ几場合、Ｐ
相に出力がある時刻ではＱ相の出力はゼロ、この逆も成
り立つ。この原理を用いて、入力データのあるピット長
に着目して、これらのデータに対応した波形整形フィル
タの時間応答のサンプリング値を時間軸で重ねあわせて
計算し、あらかじめＲＯＭに書き込んでおく。よって入
力データのあるデータ長のビットパターンと、サンプリ
ング周期カウンタからＲＯＭのアドレスを決定し、その
内容を取シ出すことによって、入力データの変調波の量
子化された値が離散的に求まる。この値をＤ／Ａ変換す
ることによシ４相位相変調波形が得られるようになって
いる。
側の波形は波形整形フィルタの単位インパルス応答波形
である。ここで変調搬送波の周波数をｆｃとした場合そ
の周期Ｔｃに対してサンプリング周期Ｔａを４分の１に
とる。このサンプリングポイントをＰ、Ｑ交互の入力デ
ータの時間応答サンプリング値と考えちると、周期Ｔｇ
Ｘ２でこのサンプリング値を正負へ置きかえ几場合、Ｐ
相に出力がある時刻ではＱ相の出力はゼロ、この逆も成
り立つ。この原理を用いて、入力データのあるピット長
に着目して、これらのデータに対応した波形整形フィル
タの時間応答のサンプリング値を時間軸で重ねあわせて
計算し、あらかじめＲＯＭに書き込んでおく。よって入
力データのあるデータ長のビットパターンと、サンプリ
ング周期カウンタからＲＯＭのアドレスを決定し、その
内容を取シ出すことによって、入力データの変調波の量
子化された値が離散的に求まる。この値をＤ／Ａ変換す
ることによシ４相位相変調波形が得られるようになって
いる。
上述の如く、本発明によればサンプリングポイントを示
すカウンタの値に対応してＲＯＭのアドレスを指定して
ＲＯＭの内容を読出すことによって直ちに波形フィルタ
リングされかつキャリア変調された信号をディジタル処
理によって得ることができ、複数個のＲＯＭや加算器を
必要とせず、簡易なディジタル回路で構成できる。
すカウンタの値に対応してＲＯＭのアドレスを指定して
ＲＯＭの内容を読出すことによって直ちに波形フィルタ
リングされかつキャリア変調された信号をディジタル処
理によって得ることができ、複数個のＲＯＭや加算器を
必要とせず、簡易なディジタル回路で構成できる。
以下、本発明を図面を用いて詳細に説明する。
第１図は、従来のアナログ処理で行なわれる４相位相変
調器のブロック構成である。図中１は入力シリアルデー
タをシリアル−パラレル変換する直並列変換器、２およ
び３は送信スペクトル制御用ロールオフフィルタ、４は
搬送波または中間周波局発、５は９０６位相シック、６
および７は平衡変調器、８は加算器、９は帯域制限フィ
ルタである。これらの構成動作は一般によく知られてい
るので説明を省く。
調器のブロック構成である。図中１は入力シリアルデー
タをシリアル−パラレル変換する直並列変換器、２およ
び３は送信スペクトル制御用ロールオフフィルタ、４は
搬送波または中間周波局発、５は９０６位相シック、６
および７は平衡変調器、８は加算器、９は帯域制限フィ
ルタである。これらの構成動作は一般によく知られてい
るので説明を省く。
第２図は本発明によるディジタル変調器の一実施例の構
成を示すブロック図で、第１図の１０で囲まれ友部分の
機能を行う部分である。１１および１２はｎ段のシフト
レジスタであシ、１３はカウンタ、１４はマルチプレク
サ、１５は読出し専用メモリ（ＲＯＭ）、１６はＤ／人
変換器である。
成を示すブロック図で、第１図の１０で囲まれ友部分の
機能を行う部分である。１１および１２はｎ段のシフト
レジスタであシ、１３はカウンタ、１４はマルチプレク
サ、１５は読出し専用メモリ（ＲＯＭ）、１６はＤ／人
変換器である。
以下、第３図、第４図の波形図を用いて、本実施例の動
作を説明する。
作を説明する。
第３図は、第１図の波形整形フィルタ２および３が持つ
べき単位インパルス応答を表わし文ものでアシ、ここで
ｆＤとは入力データのデータレートである。例えば変調
すべき入力データを６４５Ｋｂｐｓとすれば、ｆＤはそ
の半分の１Ｌ２５となることが必要である。
べき単位インパルス応答を表わし文ものでアシ、ここで
ｆＤとは入力データのデータレートである。例えば変調
すべき入力データを６４５Ｋｂｐｓとすれば、ｆＤはそ
の半分の１Ｌ２５となることが必要である。
第４図は、第３図の時間拡大したものである。
搬送波周波数ｆｃ （例えば５１６ＫＨｚ）の周期Ｔｃ
に対して動作サンプリング周期Ｔ８を周期Ｔｃの４分の
１に設定する。すなわち搬送周波数ｆｃの４倍で標本化
する。そしてさらに、これらのサンプリングポイントが
Ｐ、Ｑ両相の時間応答が離散的に交互に並んでいるもの
と考え、Ｔｌｌの２倍の周期でＰ、Ｑ各々のサンプリン
グ値を正負に置きかえる。この場合、搬送波Ｐ、Ｑは互
に９０’位相差を持つからＰ相の出力が存在する（ゼロ
でない）時刻ではＱ相の出力はゼロとなシ、またＱ相の
出力が存在する時刻ではＰ相の出力はゼロとなる。しか
もサンプリング周期は標本化定理（信号の最高周波数の
２倍以上の標本化周波数を持つ）を満足している。
に対して動作サンプリング周期Ｔ８を周期Ｔｃの４分の
１に設定する。すなわち搬送周波数ｆｃの４倍で標本化
する。そしてさらに、これらのサンプリングポイントが
Ｐ、Ｑ両相の時間応答が離散的に交互に並んでいるもの
と考え、Ｔｌｌの２倍の周期でＰ、Ｑ各々のサンプリン
グ値を正負に置きかえる。この場合、搬送波Ｐ、Ｑは互
に９０’位相差を持つからＰ相の出力が存在する（ゼロ
でない）時刻ではＱ相の出力はゼロとなシ、またＱ相の
出力が存在する時刻ではＰ相の出力はゼロとなる。しか
もサンプリング周期は標本化定理（信号の最高周波数の
２倍以上の標本化周波数を持つ）を満足している。
従って、以上の関係の下で波形整形フィルタの時間応答
のサンプリング値を置きかえる操作によって求まる値か
ら４相位相変調され九波形の離散的に量子化された値を
得ることが出来る。
のサンプリング値を置きかえる操作によって求まる値か
ら４相位相変調され九波形の離散的に量子化された値を
得ることが出来る。
以上の原理を用いて、入力データをＰチャンネル、Ｑチ
ャンネルに直並列変換された両相データがともにあるデ
ータ長だけシフトレジスタ１１゜１２に書き込まれる。
ャンネルに直並列変換された両相データがともにあるデ
ータ長だけシフトレジスタ１１゜１２に書き込まれる。
読み出専用メモリ（ＲＯＭ）１５には、上記シフトレジ
スタ１１．１２のデーターパターンのあらゆる組み合わ
せについて上記で求められるフィルタ時間応答をサンプ
リング周期に従い時間的に重ねあわせて計算し几ものが
あらかじめ書き込まれている。
スタ１１．１２のデーターパターンのあらゆる組み合わ
せについて上記で求められるフィルタ時間応答をサンプ
リング周期に従い時間的に重ねあわせて計算し几ものが
あらかじめ書き込まれている。
Ｐ、Ｑ２つのシフトレジスタ１１および１２の各々の状
態をサンプリング周期Ｔａの２倍の周期でＴｉだけシフ
トし九クロックに同期して、交互にマルチプレクサ１４
よシ取シ出す。入力データのデータレートの周期に対し
てサンプリング周期Ｔｓは３２分の１であるからマルチ
プレクサ１４の出力は３２回同じ状態がＰ、Ｑ交互に合
計６４回保持されている。このひとつの状態のビットパ
ターンに対して、カウンタ１３はデータレートの１６分
の１の周期をもつクロックＣＫを計数して、サンプリン
グポイントを決定する。
態をサンプリング周期Ｔａの２倍の周期でＴｉだけシフ
トし九クロックに同期して、交互にマルチプレクサ１４
よシ取シ出す。入力データのデータレートの周期に対し
てサンプリング周期Ｔｓは３２分の１であるからマルチ
プレクサ１４の出力は３２回同じ状態がＰ、Ｑ交互に合
計６４回保持されている。このひとつの状態のビットパ
ターンに対して、カウンタ１３はデータレートの１６分
の１の周期をもつクロックＣＫを計数して、サンプリン
グポイントを決定する。
従って、マルチプレクサ１４より得られるビットパター
ンとカウンタ１３よシ得られる計数情報からＲＯＭ１５
内の情報に対応したアドレスを１対１で決めることが出
来る。Ｒ，ＯＭＩ ５には上述の原理に基づいて計算し
たフィルタ時間応答のサンプリング値が格納されている
ｔめに、この値を読み出すことにより、４相位相変調さ
れた波形の離散的に量子化された値を得ることが出来る
。
ンとカウンタ１３よシ得られる計数情報からＲＯＭ１５
内の情報に対応したアドレスを１対１で決めることが出
来る。Ｒ，ＯＭＩ ５には上述の原理に基づいて計算し
たフィルタ時間応答のサンプリング値が格納されている
ｔめに、この値を読み出すことにより、４相位相変調さ
れた波形の離散的に量子化された値を得ることが出来る
。
従ってこの値をＤ／Ａ変換器１６でＤ／Ａ変換すること
により、動作サンプリング周波数の４倍の搬送波の位相
変調され九波形を得ることが出来る。
により、動作サンプリング周波数の４倍の搬送波の位相
変調され九波形を得ることが出来る。
本発明によれば、あらかじめフィルタの時間応答を計算
機等で求めた値をもとに計算してＲＯＭに書き込まれて
いる変調波形を入力データおよびサンプリングポイント
を示すカウンタの直に応じて読み出し、Ｄ／Ａ変換器へ
出力するという方式をとっているｔめに、簡単な回路で
高速な位相変調を乗算器、加算器を必要とせずに行なえ
る。従って性能向上、調整の省略、回路規模の縮少、消
と電力の低下等多くの効果がある。
機等で求めた値をもとに計算してＲＯＭに書き込まれて
いる変調波形を入力データおよびサンプリングポイント
を示すカウンタの直に応じて読み出し、Ｄ／Ａ変換器へ
出力するという方式をとっているｔめに、簡単な回路で
高速な位相変調を乗算器、加算器を必要とせずに行なえ
る。従って性能向上、調整の省略、回路規模の縮少、消
と電力の低下等多くの効果がある。
第１図は従来のアナログで処理されていた４相位相変調
器の一般的構成を示すブロック構成図、第２図は本発明
によるディジタル位相変調器の一実施例の構成を示すブ
ロック構成図、第３図は波形整形フィルタの単位インパ
ルス応答波形図、第４図は第３図を時間拡大した波形整
形フィルタの単位インパルス応答波形図である。 １・・・直並列変換回路、２・・・低域Ｆ波器、３・・
・低域Ｆ波器、４・・・中間周波数局部発振器、５・・
・９０″移相器、６・・・平衡ミクサ、７・・・平衡ミ
クサ、８・・・加算器、９・・・帯域制限Ｆ波器、１０
・・・変調部、１１・・・Ｑチャンネル・シフトレジス
タ、１２・・・Ｐチャンネル・シフトレジスタ、１３・
・・カウンタ、１４・・・マルチプレクサ、１５・・・
読み出し専用記憶Ｍ １ 目 第 ２ 口 Ｙ３ 口 Ｄ 第４ 口 手続補正書 事件の表示 昭和６０年特許願第７４２１５ 号 発明の名称 ディジタル変調器 補正をする者 ・ｌｌ町帳係 特許出願人 名 称 （５１０１株式会＞１． 日 立
製 作 所代 理 人 補正の対象 明細書の「発明の詳細な説明」の欄および図面補正の内
容 １、本願明細書第４頁第２〜第５行の文章「例えば変調
すべき・・・・・・となることが必要である。」を削除
する。 ２、図面、第４図を別添の補正図面の通り補正する。
器の一般的構成を示すブロック構成図、第２図は本発明
によるディジタル位相変調器の一実施例の構成を示すブ
ロック構成図、第３図は波形整形フィルタの単位インパ
ルス応答波形図、第４図は第３図を時間拡大した波形整
形フィルタの単位インパルス応答波形図である。 １・・・直並列変換回路、２・・・低域Ｆ波器、３・・
・低域Ｆ波器、４・・・中間周波数局部発振器、５・・
・９０″移相器、６・・・平衡ミクサ、７・・・平衡ミ
クサ、８・・・加算器、９・・・帯域制限Ｆ波器、１０
・・・変調部、１１・・・Ｑチャンネル・シフトレジス
タ、１２・・・Ｐチャンネル・シフトレジスタ、１３・
・・カウンタ、１４・・・マルチプレクサ、１５・・・
読み出し専用記憶Ｍ １ 目 第 ２ 口 Ｙ３ 口 Ｄ 第４ 口 手続補正書 事件の表示 昭和６０年特許願第７４２１５ 号 発明の名称 ディジタル変調器 補正をする者 ・ｌｌ町帳係 特許出願人 名 称 （５１０１株式会＞１． 日 立
製 作 所代 理 人 補正の対象 明細書の「発明の詳細な説明」の欄および図面補正の内
容 １、本願明細書第４頁第２〜第５行の文章「例えば変調
すべき・・・・・・となることが必要である。」を削除
する。 ２、図面、第４図を別添の補正図面の通り補正する。
Claims (1)
- 【特許請求の範囲】 １、波形整形フィルタの単位インパルス応答から、変調
搬送波の周波数に対して動作標本化周波数を４倍に設定
することにより、入力データの連続したあるビット長に
わたり重ねあわせた値を計算し、その量子化値をあらか
じめ記憶素子に格納しておく第１手段と、入力データの
あるビット長にわたつてのビットパターンに対し、上記
記憶素子に格納された内容を示す番地を決定する第２手
段と、この第２手段より得られる量子化値をＤ／Ａ変換
する第３手段とを設けて構成されたことを特徴とするデ
ィジタル変調器。 ２、第１項記載のディジタル変調器において、上記第１
手段の記憶手段が読み出し専用メモリ（ＲＯＭ）で構成
されたディジタル変調器。 ３、第１項記載のディジタル変調器において、上記２手
段は、入力データのＰチャンネル及びＱチャンネルのそ
れぞれに対応して設けられた第１及び第２のシフトレジ
スタと、上記第１及び第２のシフトレジスタの状態を、
サンプリング周期の２倍の周期でサンプリング周期シフ
トしたクロックに同期して交互にマルチプレクサにとり
込む手段と、クロックを計数するカウンタと、上記カウ
ンタと上記マルチプレクサによつて、上記第１手段の記
憶素子のアドレスを指定する手段とを有してなるディジ
タル変調器。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60074215A JP2510490B2 (ja) | 1985-04-10 | 1985-04-10 | デイジタル変調器 |
| US06/850,097 US4680556A (en) | 1985-04-10 | 1986-04-10 | Digital modulation apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60074215A JP2510490B2 (ja) | 1985-04-10 | 1985-04-10 | デイジタル変調器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61234153A true JPS61234153A (ja) | 1986-10-18 |
| JP2510490B2 JP2510490B2 (ja) | 1996-06-26 |
Family
ID=13540747
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60074215A Expired - Lifetime JP2510490B2 (ja) | 1985-04-10 | 1985-04-10 | デイジタル変調器 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4680556A (ja) |
| JP (1) | JP2510490B2 (ja) |
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| JPH03179954A (ja) * | 1989-12-08 | 1991-08-05 | Nippon Telegr & Teleph Corp <Ntt> | ディジタル化直交位相変調器 |
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- 1985-04-10 JP JP60074215A patent/JP2510490B2/ja not_active Expired - Lifetime
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- 1986-04-10 US US06/850,097 patent/US4680556A/en not_active Expired - Lifetime
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Also Published As
| Publication number | Publication date |
|---|---|
| JP2510490B2 (ja) | 1996-06-26 |
| US4680556A (en) | 1987-07-14 |
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| EXPY | Cancellation because of completion of term |