JPH0467271B2 - - Google Patents

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JPH0467271B2
JPH0467271B2 JP59051652A JP5165284A JPH0467271B2 JP H0467271 B2 JPH0467271 B2 JP H0467271B2 JP 59051652 A JP59051652 A JP 59051652A JP 5165284 A JP5165284 A JP 5165284A JP H0467271 B2 JPH0467271 B2 JP H0467271B2
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pulse
circuit
control signal
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Pioneer Electronic Corp
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Publication date
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Priority to US06/713,115 priority patent/US4672595A/en
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Publication of JPH0467271B2 publication Critical patent/JPH0467271B2/ja
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    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B19/00—Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
    • G11B19/20—Driving; Starting; Stopping; Control thereof
    • G11B19/24—Arrangements for providing constant relative speed between record carrier and head
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B19/00—Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
    • G11B19/20—Driving; Starting; Stopping; Control thereof
    • G11B19/28—Speed controlling, regulating, or indicating

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  • Rotational Drive Of Disk (AREA)
  • Control Of Electric Motors In General (AREA)
  • Control Of Velocity Or Acceleration (AREA)

Description

【発明の詳細な説明】 技術分野 本発明は記録デイスク回転駆動制御装置に関
し、特に記録線密度が略一定で情報が記録された
ビテオデイスクの回転駆動制御装置に関する。
背景技術 記録デイスク回転駆動制御装置の従来例を第１
図に示す。本図において、１は情報が例えば線速
度一定で螺旋状に記録されたCLV（Constant
Linear Velocity）デイスクであり、このデイス
ク１はスピンドルモータ２によつて回転駆動され
る。デイスク１の記録情報はその上方に位置する
ピツクアツプ３によつて読み出され、デイスク１
の再生に従つて図示しないスライダ等を用いた送
り機構によつてピツクアツプ３がデイスク１の半
径方向に直線移動するようになされている。
ピツクアツプ３の出力信号は信号処理回路４に
供給されて補正等が行なわれる。その信号処理回
路４の出力には再生同期信号抽出回路５が接続さ
れ、再生同期信号抽出回路５は信号処理回路４の
出力信号から再生同期信号のみを分離抽出して制
御信号発生回路６に供給する。制御信号発生回路
６は例えば再生同期信号と基準同期信号とを位相
比較してその比較結果を表わす制御信号を発生す
る。制御信号発生回路６の出力には切換スイツチ
７を介してモータ２の駆動回路８が接続されてい
る。
またピツクアツプ３の位置は位置検出器９によ
つて検出される。位置検出器９はピツクアツプ３
の基準位置からの移動距離に比例したレベルの位
置検出信号を発生する。位置検出器９には割算器
１０が接続され、割算器１０の出力には更に設定
電圧発生回路１１が接続されている。設定電圧発
生回路１１は例えば、割算器１０の出力電圧を分
圧する分圧回路からなり、各々異なる出力電圧を
得る３出力端を有する。第１出力端には電圧Va、
第２出力端には電圧Vb、第３出力端には電圧Vc
が生じ、Vb＜Va＜Vcの関係がある。第１出力
端は差動増幅器３１の負入力端に接続され、第２
出力端は比較器３２の一方の入力端に接続され、
第３出力端は比較器３３の一方の入力端に接続さ
れている。一方、モータ２の回転シヤフトには周
波数発生器１３が結合しており、周波数発生器１
３はモータ２の回転数に比例した周波数でパルス
を発生する。周波数発生器１３の出力にはＦ／Ｖ
（周波数／電圧）変換器１４が接続され、Ｆ／Ｖ
変換器１４の出力電圧が差動増幅器３１の正入力
端及び比較器３２，３３の他方の入力端に供給さ
れる。
比較器３２，３３の出力信号はOR回路３４に
供給され、OR回路３４の出力信号状態に応じて
切換スイツチ７が駆動されるようになされてい
る。切換スイツチ７は通常、制御信号発生回路６
から出力される制御信号を駆動回路８に中継供給
し、駆動時に差動増幅器３１の出力信号を駆動回
路８に中継供給する。
かかる構成の従来の記録デイスク回転駆動制御
装置においては、ピツクアツプ３から出力される
信号が信号処理回路４で所望の信号に変換され、
信号処理回路４の出力信号から同期信号が再生同
期信号抽出回路５によつて分離抽出される。この
再生同期信号を基づいて制御信号発生回路６が制
御信号を発生し、制御信号は切換スイツチ７を介
して駆動回路８に供給されてモータ２の回転数が
ループ制御される。このループ制御はデイスク１
の記録情報を通常再生するときに用いられる。
ピツクアツプ３のデイスク１の半径方向におけ
る基準位置からの移動距離に応じた電圧が位置検
出器９から出力される。この電圧は割算器１０に
よつて移動距離の逆数値を表わす電圧に変換され
る。
ここで、線速度ｖで再生すべきデイスクの中心
点からの距離ｒにおける回転数をｗとするとｖ＝
rwの関係が成立する。線速度ｖを一定とすると、
距離ｒと回転数ｗとは反比例の関係にある。よつ
て、位置検出器９の出力電圧は距離ｒに比例して
いるので割算器１０の出力電圧は１／ｒ、すなわ
ち回転数ｗに比例する。割算器１０の出力電圧を
基にして設定電圧発生回路１１において電圧Va，
Vb，Vcが各々設定される。電圧Va，Vb，Vcは
割算器１０の出力電圧に比例した電圧であり、第
２図に示すようにピツクアツプ３の位置がデイス
ク１の外周側に移動するほど減少する。電圧Va
はピツクアツプ３の移動位置におけるモータ２の
目標回転数に対応し、電圧Vbは目標回転数の下
限回転数に対応し、電圧Vcはその上限回転数に
対応する。
一方、モータ２の回転数に比例した周波数で周
波数発生器１３から出力されるパルスはＦ／Ｖ変
換器１４によつてパルスの発生周波数に比例した
電圧に変換される。この変換電圧と電圧Vaとの
差に比例した電圧が差動増幅器３１から出力され
る。変換電圧は比較器３２において電圧Vbと比
較され、変換電圧が電圧Vbより小のとき比較器
３２の出力レベルは高レベルとなる。また変換電
圧は比較器３３において電圧Vcと比較され、変
換電圧が電圧Vcより大のとき比較器３３の出力
レベルは高レベルとなる。
OR回路３４は比較器３２，３３の出力レベル
の論理和を採るので変換電圧が電圧VbとVcとの
間の電圧である場合にはOR回路３４の出力レベ
ルは低レベルとなる。変換電圧が電圧Vbより小、
又は電圧Vcより大である場合にはOR回路３４の
出力レベルは高レベルとなり、この高レベルが切
換信号として切換スイツチ７に供給されるので切
換スイツチ７が駆動される。故に、駆動回路８に
は制御信号発生回路６から出力される制御信号に
代つて差動増幅回路３１の出力電圧が供給され、
モータ２の回転数がループ制御される。このルー
プ制御はモータ２の立ち上がり状態、サーチ動作
時或いはピツクアツプ３による再生信号欠落時の
暴走防止等に用いられる。
しかしながら、かかる従来の回転駆動制御装置
においては、複雑な回路構成で高価となる割算器
を用いなければならず、またＦ／Ｖ変換器の変換
精度がある程度高精度である必要があるので装置
全体の回路も複雑となりまた高価となるという問
題点があつた。
発明の概要 本発明の目的は、割算器、Ｆ／Ｖ変換器を用い
ずに簡単な回路で構成して低コスト化を図つた記
録デイスク回転駆動制御装置を提供することであ
る。
本発明の記録デイスク回転駆動制御装置は、位
置検出手段から出力される位置検出信号に比例し
た周期の位置パルスを発生し、モータの回転数に
比例した周波数の回転パルスを発生し、回転パル
スの発生時点を基にして位置パルスを計数し該計
数値が第１所定値と第２所定値との間以外のとき
に回転パルスの発生がある場合に切換信号を発生
し、切換信号の非存在時にピツクアツプの出力信
号に基づいた第１制御信号をモータ駆動回路に供
給し切換信号の存在時に回転パルス及び位置パル
スに基づいた第２制御信号をモータ駆動回路に供
給することを特徴としている。
実施例 以下、本発明の実施例を第３図及び第６図を参
照しつつ説明する。
第３図において、第１図と同等部分は同一符号
により示されている。位置検出器９の出力には
Ａ／Ｄ（アナログ／デイジタル）変換器１６を介
して分周器１７が接続されている。分周器１７は
基準発振器１８のクロツクパルスをＡ／Ｄ変換器
１６の出力デイジタル値に比例した分周比で分周
する。分周器１７の出力には設定周期検出回路１
９が接続されている。また設定周期検出回路１９
には周波数発生器１３の出力も接続されている。
設定周期検出回路１９は第４図に示すように分
周器１７から出力される分周パルスをクロツクと
して周波数発生器１３から出力される回転パルス
を所定クロツク分、すなわち所定ビツトだけ遅延
させて出力するシフトレジスタからなる遅延回路
２０と、遅延回路２０の出力パルスの立ち上りに
応じて分周パルスを計数するカウンタ２１と、カ
ウンタ２１の計数値が第１所定値に達すると第１
設定信号を発生しかつ計数値が第１所定値より大
なる第２所定値に達すると第２設定信号を発生す
るデコーダ２２と、第１設定信号の発生時点から
第２設定信号の発生時点までの期間以外に回転パ
ルスが供給されたとき切換信号を発生する設定周
期検出ゲート回路２３とからなり、その切換信号
が切換スイツチ７に供給される。設定周期検出ゲ
ート回路２３はRSフリツプフロツプ２４，２５
及びAND回路２６，２７からなる。
また分周器１７の出力及び周波数発生器１３の
出力にはデイスク１の回転速度を検出するデイジ
タル速度検出回路２９が接続されている。デイジ
タル速度検出回路２９の出力信号はLPF（ローパ
スフイルタ）３０を介して切換スイツチ７に供給
されている。切換スイツチ７は通常、制御信号発
生回路６から出力される制御信号を駆動回路８に
中継供給し、切換信号に応じてLPF３０の出力
信号を駆動回路８に中継供給する。
かかる構成の本発明による記録デイスク回転駆
動制御装置においては、ピツクアツプ３のデイス
ク１の半径方向における基準位置からの移動距離
に応じて電圧が位置検出器９からＡ／Ｄ変換器１
６に供給される。Ａ／Ｄ変換器１６は位置検出器
９の出力電圧をデイジタル値に変換する。このデ
イジタル値によつて定まる分周比で基準発振器１
８の周波数CK0の出力クロツクパルスが分周器１
７において分周されて対５図ｃに示すような周波
数CKFの分周パルスとなる、この分周パルスの周
期はピツクアツプ３の移動距離に比例する。一
方、第５図ａに示すように周波数発生器１３から
回転パルスが出力され、回転パルスは遅延回路２
０によつて分周パルスを所定パルス数分N1だけ
遅延されてカウンタ２１に供給される。カウンタ
２１はこの遅延回路２０の出力パルスがトリガと
なつて分周パルスの計数を開始する。第５図ｂは
この計数値をアナログ的に示している。カウンタ
２１の計数値が第１所定値N4に達するとデコー
ダ２２から第１設定信号が発生する。カウンタ２
１の計数値が更に上昇して第２所定値N2に達す
るとデコーダ２２から第２設定信号が発生する。
このように発生した第１及び第２設定信号は設定
周期検出ゲート回路２３に供給される。なお、カ
ウンタ２１はNxまで計数すると自動的にリセツ
トされる。
設定周期検出ゲート回路２３においては、第１
設定信号が供給されるとフリツプフロツプ２４が
セツトされてその出力端Ｑが第５図ｄに示すよう
に高レベルとなり、第２設定信号が供給されると
フリツプフロツプ２４はリセツトされて出力端Ｑ
は低レベルとなる。この高レベル期間がゲートパ
ルスを形成する。ゲートパルスの存在中の例え
ば、計数値N3のときに回転パルスが供給される
とAND回路２７の出力レベルが高レベルとなり
フリツプフロツプ２５はリセツト状態となるので
設定周期検出ゲート回路２３の出力端であるフリ
ツプフロツプ２５の出力端Ｑは低レベルとなる。
ところが、ゲートパルスの存在中に回転パルスが
供給されず第５図ａの破線Ａ，Ｂの如くゲートパ
ルスの非存在時に回転パルスが供給されると、
AND回路２６の出力レベルが高レベルとなるの
でフリツプフロツプ２５がセツトされフリツプフ
ロツプ２５のの出力端Ｑは低レベルから高レベル
に反転する。この高レベルが切換信号として出力
される。
切換信号が切換スイツチ７に供給されると制御
信号発生回路６から出力される制御信号に代つて
LPF３０の出力信号が第２の制御信号として駆
動回路８に供給されモータ２の回転数が制御され
るのである。
かかる本発明による記録デイスク回転駆動制御
装置においては、モータ２の目標回転数に対する
上限及び下限回転数の逆数値である周期（N1＋
N4）／CKF、（N1＋N2）／CKFが設定されてい
る。カウンタ２１の計数値N1ないしN4は一定値
でも分周パルスの周波数CKFがピツクアツプ３の
移動距離に反比例するので上記各周期はピツクア
ツプ３の移動距離に比例する。よつて、周期
（N1＋Ｎ）／CKFよりも回転パルスの周期が短か
い場合、及び周期（N1＋Ｎ）／CKFよりも回転パ
ルスの周期が長い場合には暴走中或いは立ち上が
り時として上記の如く切換信号が発生する。
なお、デイジタル速度検出回路２９は例えば第
６図に示すように周波数検出器１３から出力され
る回転パルスを分周パルスに基づいて一定時間遅
延させるシフトレジスタからなる遅延回路４０
と、遅延回路４０の出力パルスに応答して分周パ
ルスの計数を開始するカウンタ４１と、カウンタ
４１の計数値を回転パルスに応じてラツチするラ
ツチ回路４２と、基準発振器１８から出力される
クロツクパルスを計数するリングカウンタ４３
と、ラツチ回路４２の出力値とリングカウンタ４
３の出力値との大小を比較する比較器４４とから
なり、比較器４４の比較出力はパルス幅変調され
た出力となる。
かかる構成においては、回転パルス（第７図
ａ）を入力とする遅延回路４０が第７図ｄに示す
分周パルスを該分周パルスの入力時点から一定数
M1計数し、第７図ｂの如くシフトパルスを出力
する。このシフトパルスに応答してカウンタ４１
が分周パルスの計数を開始し、M2まで計数を続
ける。第７図ｃはその計数をアナログ的に示して
いる。このカウンタ４１の出力計数値は回転パル
スでラツチ回路４２にラツチされる。
またリングカウンタ４３はカウンタ４１と同じ
M2まで第７図ｆに示す基準発振器１８から出力
されるクロツクパルスの計数を繰り返しており、
第７図ｅはその計数をアナログ的に示している。
リングカウンタ４３の出力計数値とラツチ回路４
２の出力値との大小が比較器４４において比較さ
れる。比較器４４はラツチ回路４２の出力値がリ
ングカウンタ４３の出力計数値より大なるとき低
レベル、小なるとき高レベルの出力を発生する。
よつて、デイスク１の回転数が高く、カウンタ４
１の計数値が少なくなると比較器４４の出力は第
７図ｇの如く低レベル区間が短かくなり、逆にデ
イスク１の回転数が低くなると、カウンタ４１の
計数値が多くなり比較器４４の出力は低レベル期
間が長くなるのである。比較器４４の出力信号は
LPF３０によつて直流電圧化されて切換スイツ
チ７に供給される。
第８図はＡ／Ｄ変換器１６の具体的構成を示し
ている。本図において、三角波発生器４５は周波
数CK1の第１クロツクパルスに応じて三角波を発
生し、その三角波は比較器４６に供給されて位置
検出器９から出力される位置検出信号と比較され
る。また第１クロツクパルスはカウンタ４７に供
給されており、カウンタ４７は第１クロツクパル
スに応じて周波数CK2の第２クロツクパルスの計
数を開始し、比較器４６からの高レベル出力に応
じて計数を停止する。カウンタ４７の計数値が
Ａ／Ｄ変換したデイジタル信号として出力され
る。なお、周波数CK1，CK2は無関係で良く、周
波数CK1はサンプリング周波数となり、周波数
CK2は分解能を決定する。
なお上記した本発明の実施例においては、設定
周期検出回路１９とデイジタル速度検出回路２９
とが個別に構成されているが、デイジタル速度検
出回路２９のカウンタ４１の出力を設定周期検出
回路１９のデコーダ２２に供給するようににして
一部回路を兼用することも可能である。
またピツクアツプ３の位置検出器９の出力は電
圧として得られるが、位置検出器９をアツプダウ
ンカウンタ等により構成すればＡ／Ｄ変換を後段
において行なう必要がなくなり、より簡単な構成
にすることができる。
また、上記した本発明の実施例においては、切
換信号の発生時にもデイスクを回転駆動するよう
にしたが、デイスクを停止するようにしても良い
のである。
更に、上記した本発明の実施例においては、
CLVデイスクに適用した場合について説明した
が、回転角速度を一定の比率で変化させつつ情報
を記録したいわゆるCAA（Constant Angular
Acceleration）デイスク等であつても良い。要は
記録線密度が略一定で情報が記録されたデイスク
に適用し得るのである。
効 果 このように、本発明の記録デイスク回転駆動制
御装置においては、ピツクアツプの位置検出手段
から出力される位置検出信号に比例した周期の位
置パルスを発生し、モータの回転数に比例した周
波数の回転パルスを発生し、回転パルスの発生時
点を基にして位置パルスを計数し該計数値が第１
所定値と第２所定値との間以外のときに回転パル
スの発生がある場合に切換信号を発生することに
より切換信号の非存在時にはピツクアツプの出力
信号に基づいた第１制御信号が駆動回路に供給さ
れ、切換信号の存在時にはピツクアツプの出力信
号に基づかずに位置パルス及び回転パルスに基づ
いた第２制御信号が駆動回路に供給される。よつ
て、従来のように複雑な回路構成で高価な割算器
及び高精度が要求されるＦ／Ｖ変換器を用いるこ
となくデイジタル的に処理できるのでバラツキを
考慮する必要がなく、また回路構成が簡単でかつ
安価な記録デイスク回転駆動制御装置が得られる
のである。
【図面の簡単な説明】
第１図は記録デイスク回転駆動制御装置の従来
例を示すブロツク図、第２図は第１図の装置中の
設定電圧発生回路の動作を示す図、第３図は本発
明の実施例を示すブロツク図、第４図は第３図の
装置中の設定周期検出回路の具体的構成を示すブ
ロツク図、第５図は第３図の装置の動作を示す波
形図、第６図は第３図の装置中のデイジタル速度
検出回路の具体的構成を示すブロツク図、第７図
は第６図の回路の動作を示す波形図、第８図は第
３図の装置中のＡ／Ｄ変換器の具体的構成を示す
ブロツク図である。 主要部分の符号の説明、１……記録デイスク、
２……スピンドルモータ、７……切換スイツチ、
１３……周波数発生器、２３……設定周期検出ゲ
ート回路。

Claims (1)

    【特許請求の範囲】
  1. １ 記録線密度が略一定で情報が記録された記録
    デイスクの回転駆動制御装置であつて、前記記録
    デイスクの記録内容を読み取るピツクアツプの半
    径方向における基準位置からの移動距離を検出し
    て該移動距離を表わす位置検出信号を発生する位
    置検出手段と、前記位置検出信号に比例した周期
    の位置パルスを発生する第１パルス発生手段と、
    前記記録デイスクを回転せしめるためのモータ
    と、該モータの回転数に比例した周波数の回転パ
    ルスを発生する第２パルス発生手段と、前記回転
    パルスの発生時点を基にして前記位置パルスを計
    数し該計数値が第１所定値と第２所定値との間以
    外のときに前記回転パルスの発生がある場合に切
    換信号を発生する切換信号発生手段と、前記ピツ
    クアツプの出力信号に応じて前記モータの回転数
    を制御するための第１制御信号を発生する第１制
    御信号発生手段と、前記位置パルス及び回転パル
    スに基づいて前記モータの回転数を制御するため
    の第２制御信号を発生する第２制御信号発生手段
    と、駆動信号に応じて前記モータを駆動する駆動
    手段と、前記切換信号の非存在時に前記第１制御
    信号を前記駆動信号として前記モータに供給し前
    記切換信号の存在時に前記第２制御信号を前記駆
    動信号として前記モータに供給する切換手段とか
    らなることを特徴とする記録デイスク回転駆動制
    御装置。
JP59051652A 1984-03-16 1984-03-16 記録ディスク回転駆動制御装置 Granted JPS60195772A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP59051652A JPS60195772A (ja) 1984-03-16 1984-03-16 記録ディスク回転駆動制御装置
DE19853509462 DE3509462A1 (de) 1984-03-16 1985-03-15 Steuersystem fuer den drehantrieb eines aufzeichnungsplattenspielers
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JP59051652A JPS60195772A (ja) 1984-03-16 1984-03-16 記録ディスク回転駆動制御装置

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JPS60195772A JPS60195772A (ja) 1985-10-04
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JP (1) JPS60195772A (ja)
DE (1) DE3509462A1 (ja)
GB (1) GB2157027B (ja)

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