JPH0234918A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPH0234918A JP63185005A JP18500588A JPH0234918A JP H0234918 A JPH0234918 A JP H0234918A JP 63185005 A JP63185005 A JP 63185005A JP 18500588 A JP18500588 A JP 18500588A JP H0234918 A JPH0234918 A JP H0234918A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔概 要〕                    
 本発明は、シリコン基板とアルミニウム薄膜型シリコ
ン基板とアルミニウム薄膜電極との間に  極との間に
介在するバリヤ層に関する。
〔従来の技術〕
高集積化3高密度化にともない、半導体装置における金
属電極および配線が微細化しつつある。
従来、シリコン基板との接続を構成する金属電極には1
〜2重景%程度のシリコンが添加されたアルミニウム薄
膜が用いられていた。このシリコンの添加は、シリコン
基板がアルミニウム電極に拡散するのを防止するために
、あらかじめアルミニウム薄膜中におけるシリコン濃度
を高くしておくことを目的として行われる。
しかしながら、アルミニウム薄膜1掻が形成された後の
種々の熱処理工程において、アルミニウム薄膜中で固溶
限界以上になったシリコンの析出がコンタクト窓内で生
じる。シリコンは高抵抗であるため、このような析出シ
リコンにより、アルミニウム薄膜と電極窓の有効接触面
積が減少し。
シリコン基板との接触抵抗が高くなる。
〔発明が解決しようとする課題〕
これに対して、シリコン基板とアルミニウム電極との間
に、相互拡散を防止するためのバリヤ層を設けることが
行われている。このようなバリヤ層として高融点金属の
窒化物や炭化物あるいは硼化物の薄膜が最近注目されて
いる。これらの薄膜は1通常、高融点金属をターゲット
とする反応性スパッタリングにより形成される。しかし
8反応性スパッタリングは、一般に1反応性ガスの分圧
ターゲットに供給する電力、基板温度、基板電位等多く
の条件によって形成される薄膜の特性が変化しやすい。
このため、バリヤ層としての特性の再現性が充分でない
欠点があった。
上記のように9反応性スパッタリングにより形成された
バリヤ層の特性を安定化させるために。
堆積後に薄膜を酸素を含有する雰囲気中で熱処理するこ
とも行われている。しかしながら、従来は薄膜堆積後、
スパッタリング装置から大気中に取り出し、これを熱処
理する方法が採用されていたため、工程数の増加や、多
数の基板を取り扱う上での工数の増加あるいは塵埃によ
る基板の汚染等が避けられない問題があった。
本発明は堆積後に特別の熱処理を行うことなくシリコン
基板とアルミニウム薄膜の相互拡散に対してすぐれた阻
止機能を有するバリヤ層を形成可能とすることを目的と
する。
〔課題を解決するための手段〕
上記目的は、アルゴン等の不活性ガスに窒素化合物、炭
素化合物または硼素化合物のガスを添加して成る雰囲気
中でシリコン基板を所定温度に加熱するとともに、該シ
リコン基板に対して該雰囲気を介して対向するように配
置された高融点金属から成るターゲットをスパッタリン
グさせることにより、該シリコン基板上に該高融点金属
の窒化物、炭化物または硼化物から成るバリヤ層を堆積
する工程と、該バリヤ層が形成された該シリコン基板上
にアルミニウム薄膜を堆積する工程とを含むことを特徴
とする本発明に係る半導体装置の製造方法によって達成
される。
〔作 用〕
反応性スパッタリングにより該高融点金属の窒化物、炭
化物または硼化物から成るバリヤ層をシリコン基板上に
堆積するに際して、シリコン基板をあらかじめ350℃
程度以上の温度に加熱しておき1反応性ガスに酸素を副
成分として添加することによって、膜形成後の熱処理を
施さなくとも良好な特性を有するバリヤ層が得られる。
〔実施例〕
以下本発明の実施例を図面を参照して説明する。
第1図は本発明を実施するために用いた反応性スパッタ
リング装置の概要構成を示す模式図であって1例えばス
テンレスから成る真空容器1の内部には、電極2と試料
台4が設置されている。電極2には1例えば金属チタン
(Ti)等の高融点金属から成るターゲラ1−2Aが固
定して取り付けられている。2Bは真空容器1と同電位
にされたシールドである。一方、試料台4にはバリヤ層
を構成する薄膜が堆積されるシリコン基板3が、ターゲ
・71−2Aと所定距離の空間を隔てそ対向するように
取り付けられている。シリコン基板3は1例えばその背
後からヒータ5によって加熱され、所定温度に保持され
る。
真空容器1内部は排気管8を通じて1図示しない排気装
置により高真空に排気可能とされている。
また、真空容器1にはガス導入管6A、 6B、 6C
が取り付けられている。ガス導入管6Aからは9例えば
アルゴン(Ar)ガスのような不活性ガスが、ガス導入
管6Bからは1例えばバリヤ層として窒化物薄膜を形成
する場合には窒素(N2)が、ガス4入管6Cからは酸
素(0□)がそれぞれ導入される。
真空容器1内に所定の各ガスを導入し、直流電源7から
電極2に約5〜7KVの直流の負電圧を印加することに
よりガスプラズマが発生し、ターゲット静がスパッタさ
れるとともに、前記導入ガス等と反応して窒化膜等がシ
リコン基板3に堆積する。
次に、窒化チタン(TiN)膜を形成する場合を例とし
て、上記の反応性スパッタリングの具体的な条件をまと
めて示す。
ターゲット2A:直径8インチ、純度99.99%の金
属チタン シリコン基板3:直径4インチ ターゲット2A−シリコン基板3間距離: 55cm導
入ガス:アルゴン、窒素、酸素 窒素分圧(流量比):50〜75% 酸素分圧(流量比)=2〜5% 導入ガス全圧: 1〜5 mmTorrターゲット2A
供給電力;3〜7KW シリコン基板3温度:350℃ TiN膜厚;500〜2000人 なお、窒化チタン以外のバリヤ層として用い得る材料と
しては次表の組合せが挙げられる。
ターゲット 窒化物  炭化物  硼化物Ti    
(TiN)    TiCTiBTa     TaN
    TaCTaflZr       ZrN  
     ZrCZrBHf     HfN    
HfCHfBW        WN       W
CWBTa: タンタル、 Zr: ジルコニウム、 
Hf:ハフニウム、W:タングステン 炭化物および硼化物を形成する場合には、窒素を、それ
ぞれ、気体状の炭素化合物9例えばメタン(CI+4.
)および気体状の硼素化合物2例えばジボラン(B2H
6)で置き換えればよい。
第2図は本発明によって形成されたバリヤ層を介して接
続されたシリコン基板とアルミニウム電極とを示す断面
図である。シリコン基板11上にはSiO□またはPS
に (i珪酸ガラス)から成る絶縁層12が形成されて
おり、絶縁層12の所定位置に開口13が設けられてい
る。絶縁層12上および開口13内には3例えば純アル
ミニウム、チタンまたは多結晶シリコン薄膜から成るコ
ンタクト層14と、前記高融点金属の窒化物等から成る
バリヤ層15と、アルミニウムから成る電極層16が堆
積されている。コンタクト層14ないし電極層16は所
定の電極および配線形状をなすようにパターンニングさ
れている。
このようにして、アルミニウム電極層16は前記条件で
形成された本発明に係るバリヤ層15を介してシリコン
基板11と接続されている。なお、コンタクト層14は
、シリコン基板内に設けられた拡散層に対してオーミッ
ク接触を形成するために設けられたものであって1本発
明者によりすでに開示されている(特願昭62−165
795.昭和62年年子7月0日付)。
上記のように1本発明においては、加熱されたシリコン
基板上にバリヤ層を堆積することにより。
すぐれた特性を有するバリヤ層が得られる。この場合、
バリヤ層形成後の熱処理を必要としない。
高温に加熱されたシリコン基板に窒化物等の薄膜を堆積
すると、膜の結晶化が進み緻密化するため。
シリコン基板とアルミニウム電極との相互拡散が起こり
難くなることは、上記出願においてすでに示唆されてい
る。本発明においては、基板温度を350℃以上とし1
反応性スパッタリングを行う雰囲気に副成分として酸素
を添加することにより。
シリコン基板−アルミニウム電極間の相互拡散をより起
こり難くシ、バリヤ性を一層向上可能とした。
本発明によるバリヤ層を備えたシリコン基板−アルミニ
ウム電極の熱的安定性を試験したところ。
480℃で90分間の加熱後においても相互拡散は認め
られなかった。これは、バリヤ層を構成する窒化物等の
薄膜中の結晶粒界や結晶欠陥に酸素が捕捉されているた
め、シリコン原子やアルミニウム原子の移動が妨げられ
、シリコン基板−アルミニウム電極間の相互拡散がより
起こり難くなったことを示すものと考えられる。
なお、一般に、薄膜中に酸素が多く取り込まれると膜抵
抗が増加する。第3図は1反応性スパッタリングにおけ
るガスに添加する酸素の流量と堆積される膜の比抵抗の
関係を示すグラフであって。
添加する酸素の流量、すなわち、スパッタリング雰囲気
中における酸素濃度が増すにしたがって膜抵抗が増加す
る傾向を示している。同図においてパラメータは基板温
度であり1高温度の基板に堆積する膜はど比抵抗が小さ
い。本発明のように、350℃以上の高温のシリコン基
板にバリヤ層を堆積することによって、酸素添加による
膜抵抗の増加は充分に補償できることが分かる。
〔発明の効果〕
本発明によれば9層堆積後の熱処理を行うことなくすぐ
れたバリヤ性と低抵抗性を有するバリヤ層を形成するこ
とができ、高集積度・高密度の半導体装置の製造工程の
簡略化を可能とするとともに、装置の信頼性ならびに性
能の向上を可能とする効果がある。
【図面の簡単な説明】
第1図は本発明を実施するために用いた反応性スパッタ
リング装置の概要構成を示す模式図。 第2図は本発明によるバリヤ層を備えたシリコン基板と
アルミニウム電極構造を示す断面図。 第3図は反応性スパッタリング雰囲気に対する添加酸素
流量と堆積膜の比抵抗の関係を示すグラフ である。 図において。 ■は真空容器。 2は電極。 2Aはターゲット 2Bはシールド。 3と11はシリコン基板。 4は試料台。 5はヒータ。 6A、 6B、 6Gはガス忠入管。 7は直流電源。 8は排気管。 12は絶縁層。 13ば開口。 14はコンタクト層。 15はバリヤ層。 16は電極層 である。 伴入先へ 14し6月のT□力1ジ(二用いに反1八シ′ロスバ・
ンクリンク′茨!寡 13 ¥J 2 図

Claims (1)

  1. 【特許請求の範囲】 不活性ガスに窒素化合物、炭素化合物または硼素化合物
    のガスと酸素が添加されて成る雰囲気中でシリコン基板
    を所定温度に加熱するとともに、該シリコン基板に対し
    て該雰囲気を介して対向するように配置された高融点金
    属から成るターゲットをスパッタリングさせることによ
    り、該シリコン基板上に該高融点金属の窒化物、炭化物
    または硼化物から成るバリヤ層を堆積する工程と、該バ
    リヤ層が形成された該シリコン基板上にアルミニウム薄
    膜を堆積する工程 とを含むことを特徴とする半導体装置の製造方法。
JP63185005A 1988-07-25 1988-07-25 半導体装置の製造方法 Expired - Lifetime JPH0666287B2 (ja)

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EP89401978A EP0353120A1 (en) 1988-07-25 1989-07-10 A method of forming a barrier layer between a silicon substrate and an aluminium electrode of a semiconductor device
KR1019890010029A KR920005805B1 (ko) 1988-07-25 1989-07-14 반도체 장치의 실리콘 기판과 알루미늄 전극 사이에 장벽층을 형성하는 방법
US07/383,511 US4976839A (en) 1988-07-25 1989-07-24 Method of forming a barrier layer between a silicon substrate and an aluminum electrode of a semiconductor device

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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04368126A (ja) * 1991-06-10 1992-12-21 Kaho Denshi Kofun Yugenkoshi 金属障壁層の酸素プラズマ充填法
JPH05109656A (ja) * 1990-06-29 1993-04-30 Samsung Electron Co Ltd 非晶質窒化チタン膜を用いた金属配線形成方法
JP2008098522A (ja) * 2006-10-13 2008-04-24 Ulvac Japan Ltd 半導体装置の製造方法及び半導体装置の製造装置
JP2011153374A (ja) * 2009-12-29 2011-08-11 Canon Anelva Corp 金属膜を埋め込む工程を有する電子部品の製造方法
US8835296B2 (en) 2009-12-29 2014-09-16 Canon Anelva Corporation Electronic component manufacturing method including step of embedding metal film

Families Citing this family (66)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5108951A (en) * 1990-11-05 1992-04-28 Sgs-Thomson Microelectronics, Inc. Method for forming a metal contact
US5472912A (en) * 1989-11-30 1995-12-05 Sgs-Thomson Microelectronics, Inc. Method of making an integrated circuit structure by using a non-conductive plug
US6271137B1 (en) 1989-11-30 2001-08-07 Stmicroelectronics, Inc. Method of producing an aluminum stacked contact/via for multilayer
EP0430403B1 (en) * 1989-11-30 1998-01-07 STMicroelectronics, Inc. Method for fabricating interlevel contacts
US6242811B1 (en) 1989-11-30 2001-06-05 Stmicroelectronics, Inc. Interlevel contact including aluminum-refractory metal alloy formed during aluminum deposition at an elevated temperature
US5658828A (en) * 1989-11-30 1997-08-19 Sgs-Thomson Microelectronics, Inc. Method for forming an aluminum contact through an insulating layer
US5094981A (en) * 1990-04-17 1992-03-10 North American Philips Corporation, Signetics Div. Technique for manufacturing interconnections for a semiconductor device by annealing layers of titanium and a barrier material above 550° C.
US5268329A (en) * 1990-05-31 1993-12-07 At&T Bell Laboratories Method of fabricating an integrated circuit interconnection
EP0459690A1 (en) * 1990-05-31 1991-12-04 AT&T Corp. Integrated circuit interconnection
US7335570B1 (en) * 1990-07-24 2008-02-26 Semiconductor Energy Laboratory Co., Ltd. Method of forming insulating films, capacitances, and semiconductor devices
US5086016A (en) * 1990-10-31 1992-02-04 International Business Machines Corporation Method of making semiconductor device contact including transition metal-compound dopant source
US6287963B1 (en) 1990-11-05 2001-09-11 Stmicroelectronics, Inc. Method for forming a metal contact
US5232871A (en) * 1990-12-27 1993-08-03 Intel Corporation Method for forming a titanium nitride barrier layer
US5250465A (en) * 1991-01-28 1993-10-05 Fujitsu Limited Method of manufacturing semiconductor devices
JP2946978B2 (ja) * 1991-11-29 1999-09-13 ソニー株式会社 配線形成方法
US6051490A (en) * 1991-11-29 2000-04-18 Sony Corporation Method of forming wirings
US5231306A (en) * 1992-01-31 1993-07-27 Micron Technology, Inc. Titanium/aluminum/nitrogen material for semiconductor devices
DE69327600T2 (de) * 1992-02-28 2000-06-21 St Microelectronics Inc Herstellungsverfahren von Submikronkontakten
US5240880A (en) * 1992-05-05 1993-08-31 Zilog, Inc. Ti/TiN/Ti contact metallization
US5329161A (en) * 1992-07-22 1994-07-12 Vlsi Technology, Inc. Molybdenum boride barrier layers between aluminum and silicon at contact points in semiconductor devices
DE69319993T2 (de) * 1992-09-22 1998-12-10 Sgs Thomson Microelectronics Methode zur Herstellung eines Metallkontaktes
JP3587537B2 (ja) * 1992-12-09 2004-11-10 株式会社半導体エネルギー研究所 半導体装置
KR970001883B1 (ko) * 1992-12-30 1997-02-18 삼성전자 주식회사 반도체장치 및 그 제조방법
JPH0730095A (ja) * 1993-06-25 1995-01-31 Mitsubishi Electric Corp 半導体装置及びその製造方法
US5514908A (en) * 1994-04-29 1996-05-07 Sgs-Thomson Microelectronics, Inc. Integrated circuit with a titanium nitride contact barrier having oxygen stuffed grain boundaries
CN1062978C (zh) * 1994-07-07 2001-03-07 现代电子产业株式会社 半导体器件中制作金属阻挡层的方法
US5962923A (en) * 1995-08-07 1999-10-05 Applied Materials, Inc. Semiconductor device having a low thermal budget metal filling and planarization of contacts, vias and trenches
US5895266A (en) 1996-02-26 1999-04-20 Applied Materials, Inc. Titanium nitride barrier layers
US6204171B1 (en) 1996-05-24 2001-03-20 Micron Technology, Inc. Process for forming a film composed of a nitride of a diffusion barrier material
US5633200A (en) * 1996-05-24 1997-05-27 Micron Technology, Inc. Process for manufacturing a large grain tungsten nitride film and process for manufacturing a lightly nitrided titanium salicide diffusion barrier with a large grain tungsten nitride cover layer
US5858873A (en) * 1997-03-12 1999-01-12 Lucent Technologies Inc. Integrated circuit having amorphous silicide layer in contacts and vias and method of manufacture thereof
US7943505B2 (en) * 1997-03-14 2011-05-17 Micron Technology, Inc. Advanced VLSI metallization
US5925225A (en) * 1997-03-27 1999-07-20 Applied Materials, Inc. Method of producing smooth titanium nitride films having low resistivity
US6139699A (en) * 1997-05-27 2000-10-31 Applied Materials, Inc. Sputtering methods for depositing stress tunable tantalum and tantalum nitride films
TW406317B (en) * 1997-06-27 2000-09-21 Siemens Ag Method to produce a barrier-layer in a semiconductor-body and semiconductor component with such a barrier-layer
US6010960A (en) * 1997-10-29 2000-01-04 Advanced Micro Devices, Inc. Method and system for providing an interconnect having reduced failure rates due to voids
US6346175B1 (en) 1997-11-20 2002-02-12 International Business Machines Corporation Modification of in-plate refractory metal texture by use of refractory metal/nitride layer
EP1034566A1 (en) * 1997-11-26 2000-09-13 Applied Materials, Inc. Damage-free sculptured coating deposition
US7253109B2 (en) 1997-11-26 2007-08-07 Applied Materials, Inc. Method of depositing a tantalum nitride/tantalum diffusion barrier layer system
JP3374901B2 (ja) * 1998-02-27 2003-02-10 日本電気株式会社 半導体装置
WO1999053114A1 (en) * 1998-04-10 1999-10-21 Applied Materials, Inc. Continuous process for sputtering tantalum nitride films
US6130155A (en) * 1999-07-02 2000-10-10 Promos Technologies, Inc. Method of forming metal lines in an integrated circuit having reduced reaction with an anti-reflection coating
US6337151B1 (en) 1999-08-18 2002-01-08 International Business Machines Corporation Graded composition diffusion barriers for chip wiring applications
US6620723B1 (en) * 2000-06-27 2003-09-16 Applied Materials, Inc. Formation of boride barrier layers using chemisorption techniques
US7405158B2 (en) * 2000-06-28 2008-07-29 Applied Materials, Inc. Methods for depositing tungsten layers employing atomic layer deposition techniques
US6936538B2 (en) 2001-07-16 2005-08-30 Applied Materials, Inc. Method and apparatus for depositing tungsten after surface treatment to improve film characteristics
US7964505B2 (en) 2005-01-19 2011-06-21 Applied Materials, Inc. Atomic layer deposition of tungsten materials
US7732327B2 (en) 2000-06-28 2010-06-08 Applied Materials, Inc. Vapor deposition of tungsten materials
US6583460B1 (en) * 2000-08-29 2003-06-24 Micron Technology, Inc. Method of forming a metal to polysilicon contact in oxygen environment
US6688584B2 (en) * 2001-05-16 2004-02-10 Micron Technology, Inc. Compound structure for reduced contact resistance
US6599835B1 (en) * 2001-07-13 2003-07-29 Advanced Micro Devices, Inc. Testing dielectric and barrier layers for integrated circuit interconnects
US7211144B2 (en) 2001-07-13 2007-05-01 Applied Materials, Inc. Pulsed nucleation deposition of tungsten layers
WO2003029515A2 (en) 2001-07-16 2003-04-10 Applied Materials, Inc. Formation of composite tungsten films
US20030029715A1 (en) 2001-07-25 2003-02-13 Applied Materials, Inc. An Apparatus For Annealing Substrates In Physical Vapor Deposition Systems
US20040164291A1 (en) * 2002-12-18 2004-08-26 Xingwu Wang Nanoelectrical compositions
US7162302B2 (en) 2002-03-04 2007-01-09 Nanoset Llc Magnetically shielded assembly
US7091412B2 (en) 2002-03-04 2006-08-15 Nanoset, Llc Magnetically shielded assembly
US6833161B2 (en) 2002-02-26 2004-12-21 Applied Materials, Inc. Cyclical deposition of tungsten nitride for metal oxide gate electrode
US7279432B2 (en) 2002-04-16 2007-10-09 Applied Materials, Inc. System and method for forming an integrated barrier layer
KR100564605B1 (ko) * 2004-01-14 2006-03-28 삼성전자주식회사 반도체 소자의 금속 배선 형성 방법
US20080070405A1 (en) * 2002-05-30 2008-03-20 Park Jae-Hwa Methods of forming metal wiring layers for semiconductor devices
KR100446300B1 (ko) * 2002-05-30 2004-08-30 삼성전자주식회사 반도체 소자의 금속 배선 형성 방법
JP4038485B2 (ja) * 2003-03-12 2008-01-23 三星エスディアイ株式会社 薄膜トランジスタを備えた平板表示素子
KR100669688B1 (ko) * 2003-03-12 2007-01-18 삼성에스디아이 주식회사 박막트랜지스터 및 이를 구비한 평판표시소자
WO2004113585A2 (en) 2003-06-18 2004-12-29 Applied Materials, Inc. Atomic layer deposition of barrier materials
US20060105016A1 (en) * 2004-11-12 2006-05-18 Gray Robert W Device compatible with magnetic resonance imaging

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS499972A (ja) * 1972-05-17 1974-01-29

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4783248A (en) * 1987-02-10 1988-11-08 Siemens Aktiengesellschaft Method for the production of a titanium/titanium nitride double layer

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS499972A (ja) * 1972-05-17 1974-01-29

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05109656A (ja) * 1990-06-29 1993-04-30 Samsung Electron Co Ltd 非晶質窒化チタン膜を用いた金属配線形成方法
JPH04368126A (ja) * 1991-06-10 1992-12-21 Kaho Denshi Kofun Yugenkoshi 金属障壁層の酸素プラズマ充填法
JP2008098522A (ja) * 2006-10-13 2008-04-24 Ulvac Japan Ltd 半導体装置の製造方法及び半導体装置の製造装置
JP2011153374A (ja) * 2009-12-29 2011-08-11 Canon Anelva Corp 金属膜を埋め込む工程を有する電子部品の製造方法
US8835296B2 (en) 2009-12-29 2014-09-16 Canon Anelva Corporation Electronic component manufacturing method including step of embedding metal film

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