JP3259323B2 - デ・インターリーブ回路 - Google Patents
デ・インターリーブ回路Info
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Description
路に関し、特に、いわゆるミニディスクと呼称されるデ
ィジタル・オーディオ・ディスクを再生可能なディスク
プレーヤのディジタルデータ再生装置に用いて好適なデ
・インターリーブ回路に関する。
スクとして、コンパクトディスク(以下、CDと称す
る)が広く普及している。これに対し、近時、CDより
も極端に小さく、しかもデータを圧縮して記録すること
から、CDと同程度の再生時間を持つミニディスク(以
下、MDと称する)が開発され、実用化されつつある。
このMDでは、光磁気記録方式を採っている。また、M
Dに使用されるインターリーブは、波形継ぎがし易くか
つCDと同等のインターリーブ効果を得る目的で作られ
ている。
スを図9に示す。同図で、左側はディスクより再生され
た1フレームのデータを表わす。フレームの初めにおい
てサブコードの次に再生されるのが8ビットデータW12
n , Aである。次に再生されるのは、データW12n ,B
となる。ここに、nはフレームナンバーを表し、Pn は
C1パリティー、Qn はC2パリティーをそれぞれ表わ
す。また、四角内の“1”は1フレーム遅延を表し、2
7Dは108フレーム(D=4)遅延を表わす。
のW12n , B、W12n+1 , A、1フレーム前のW1
2n+1 , B、……と続けていき、32バイトデータで1
つの符号語となる。C1訂正処理で訂正できないとき
(多重エラー)、C1の32バイトにつきC1フラグ
(C1ポインタ)をセットする。データ幅が8ビットの
RAMを使用した場合、その1ビットのみC1フラグと
して使う。
2n , A、105フレーム前のW12n ,B、……と続き、
28バイトデータで1つの符号語となる。C2訂正処理
では、C2エラー訂正の計算にC1フラグを使うことで
誤訂正を防止したり、イレージャ訂正に利用したりす
る。さらに、C2訂正でエラー訂正できなかったとき、
多くの場合は、それぞれのデータのC1フラグを使う。
つまり、C1フラグがセットしてある場合、エラーデー
タとしてC2ポインタ(C2フラグ)をセットする。こ
のC2ポインタは、それぞれの8ビットデータに対して
対となって付加されるものである。
ータに対し1つのC2ポインタ(1バイト)を割り当て
た場合、必要なエラー訂正用のバッファRAMの空間と
しては、以下のようにして求まるバイト数が必要とな
る。すなわち、 RF信号の書込みからC1訂正まで
7D=1,620バイト 但し、最後の27DはC1ポインタに関するものであ
る。 C2訂正からD/A出力まで
2}+{(27D+26D+……+2D+1D)+1
2}=2,616バイト 但し、前半の{ }の部分はデータに関し、後半の{
}の部分はC2ポインタに関するものであり、又12
D〜15DはパリティQに対応し、省略される。以上よ
り、バッファRAMの空間として、++より、
4,284バイトが必要となる。すなわち、総容量とし
て34,272ビットのバッファRAMが必要となる。
o Fourteen Modulation)復調では、エラー訂正でのC2
訂正後のデータ2バイトに対し、1バイトのC2ポイン
タを使っていた。また、C2訂正後、D/Aコンバータ
に出力する区間は、2フレーム以下であり、C2ポイン
タも2フレーム以下の時間だけ保持できる容量で済むた
め、大きな問題は無かった。
においては、上述したように、最大C2ポインタを10
9(=27D+1)フレームだけ保持する必要があり、
エラー訂正用のRAMとして34,272ビットの空間
が必要であるため、32KビットのバッファRAMで
は、容量が不足し、64KビットのバッファRAMを使
用せざるを得なくなる。
のであり、MDのデ・インターリーブにおいて、32K
ビットのバッファRAMで実現でき、しかもCDのエラ
ー訂正プログラムを共用化できるデ・インターリーブ回
路を提供することを目的とする。
ーリーブ回路は、種類が異なるディスクをそれぞれ再生
する第1、第2の動作モードを有し、並列に入力される
1フレーム分所定バイトのディジタルデータを、エラー
訂正しつつ再生処理するディジタルデータ再生装置にお
いて、第1の動作モードでは、エラー訂正用フラグを2
バイトのデータ毎に1バイトの一部のビットのみに対応
させて付加し、第2の動作モードでは、同一書込みアド
レスに4回繰返し書くことによってエラー訂正用フラグ
を8バイトのデータ毎に8ビットに対応させて付加する
構成となっている。
は、エラー訂正用フラグ(C2ポインタ)を8バイトの
データ毎に8ビットに対応させて付加することで、C2
ポインタの容量を、2バイトのデータ毎に1バイトの一
部のビットのみに対応させて付加する第1の動作モード
の場合に比較して1/4にできる。これにより、第2の
動作モードでは、最大C2ポインタを109(=27D
+1)フレームだけ保持する必要があっても、第1の動
作モードの場合と同じ32KビットのRAMでデ・イン
ターリーブを実現できる。
に説明する。図1は、本発明によるデ・インターリーブ
回路が適用されるディジタルデータ再生回路の構成を示
すブロック図である。図において、MDから読み取られ
たEFM信号はEFM復調回路1でEFM復調が行われ
る。その復調出力であるPCMオーディオデータ、即ち
8ビット(並列化された1シンボル)のデータは、外部
バス2を介して32KビットのバッファRAM3に記録
される。
Reed Solomon Code)のデ・インターリーブおよびエラー
訂正のためのバッファとしての機能を有する。このRA
M3においてデ・インターリーブされたC1,C2それ
ぞれ32シンボル,28シンボルのデータは、入力回路
4を経た後内部バス5を介してエラー訂正回路6に供給
される。この系列は、図9に示す系列となっている。
情報についてポインタが付される。C2訂正で多重エラ
ーのためエラー訂正できなかったときはC1ポインタを
コピーし、またC2訂正でC1見逃しの可能性の強いと
きは、そのC2情報全てにC2ポインタをセットする
(以下、オールポインタと称する)。C2ポインタをセ
ットするために、C2ポインタセット回路7およびポイ
ンタ処理回路8が内部バス5にそれぞれ接続されてい
る。このC2ポインタセット回路7およびポインタ処理
回路8は、マイクロプログラムシーケンサ9によって制
御されるようになっている。
9により、オールポインタ命令が実行されたとき、マイ
クロプログラムシーケンサ9からC2ポインタセット命
令が出力されることで、C2ポインタセット回路7によ
って8ビット全て“1”が内部バス5にセットされ、出
力回路10を通してRAM3に繋がる外部バス(データ
バス)2にセットされる。
うに、C2訂正後のデータ2バイトに対し、1バイトの
C2ポインタが書き込まれるようになっている。この場
合、図2からも明らかなように、上位6ビットが未使用
となる。このCDとMDを共通にするため、本発明にお
いては、マイクロプログラムを同じにしておき、C2ポ
インタのRAMアドレスのみ変えることで対応できるよ
うにしている。すなわち、図3に示すように、24バイ
トのデータに対し、CDの場合には、1バイトにつき2
ビットずつ12回C2ポインタを書くことになるに対
し、MDの場合には、同一書込みアドレスに4回、1バ
イト分繰返し書くことになり、これにより、エラー訂正
プログラムをCDとMDに共用化できることになる。
ラーのため訂正できないときで、C1訂正も正しいと判
断したとき、C2ポインタとしてC1ポインタをコピー
することになる。このコピー命令がマイクロプログラム
シーケンサ9より発せられると、マイクロプログラムシ
ーケンサ9から出力されるC1ポインタリード命令およ
びC2ポインタライト命令に応じてポインタ処理回路8
が動作する。
に示すように、8ビット分のイネーブル(E)端子付き
D‐FF(フリップフロップ)111 〜118 が縦続接
続されており、これらD‐FF111 〜118 はC1ポ
インタリード命令をイネーブル入力としている。また、
初段のD‐FF111 は、内部バス5を通して供給され
るC1ポインタのLSB(最下位ビット)をデータ
(D)入力としている。また、D‐FF111 〜118
の各出力端と内部バス5との間には、C2ポインタライ
ト命令によって能動状態となるバッファ121 〜128
がそれぞれ接続されている。
SBのみに書かれており、CDモードのポインタコピー
部のマイクロプログラムは、図5に示すようになる。す
なわち、C1ポインタを2回読み込んで1回書き込む動
作を繰り返すことになる。CDモードでは、C2ポイン
タとして、図2から明らかなように、1バイトの下位ビ
ット(2LSB)のみ使用するため、上位6ビットは何
が入っても良い。MDモードでは、C2ポインタの書込
み(Write) アドレスを4回オーバーライトすることによ
り、C2ポインタが8バイトのデータに対して8ビット
(1バイト)付加され、最後に、8ビットのC2ポイン
タが、図6に示すように、24バイトのデータに対して
3バイト完成する。
インタを8ビットまとめてRAM上に1つのデータとし
て記録することになる。つまり、W12n ,A〜W1
2n+3 ,Bの8バイトのデータに対し、1バイトのC2
ポインタを当てる。このC2ポインタは、7D区間RA
M3に記録し続ける。次に、W12n+4 ,A〜W12n+7 ,
Bを1バイトのC2ポインタにまとめ、19D区間RA
M3にデータを保持させる。最後に、W12n+8 ,A〜W
12n+11,Bを1バイトのC2ポインタにまとめ、27D
区間RAM3にデータを保持することとする。
タを8バイト情報に対し、8ビットに対応させることに
より、C2ポインタの容量は、
AM3の総容量は、数1〜数3との対応から、
=3,188バイト となる。
/4に低減できたことにより、32KビットRAMでデ
・インターリーブを実現できることになるとともに、3
2KビットRAMであっても、
ジッタマージンに使えることになる。また、図3で説明
したように、24バイトのデータに対し、CDでは12
回C2ポインタを書くのに対し、MDでは4回同じアド
レスに繰り返し書くようにしたことにより、CDのエラ
ー訂正プログラムと共用化できることになる。
は、エラー訂正された後外部バス2を介してD/Aイン
タフェース回路13に供給され、補間処理やパラレル/
シリアル変換等が行われる。データリクエスト処理回路
14は、バッファRAM3に対し読出し/書込みする回
路からの占有要求を受けるためのものである。すなわ
ち、エラー訂正回路5がバッファRAM3を使用した場
合、エラー訂正回路5からリクエストをこのデータリク
エスト処理回路14に出力する。他に、D/Aインター
フェイス回路13やEFM復調回路1からもそれぞれ読
出し要求や書込み要求がこのデータリクエスト処理回路
14に入力され、要求が重なった場合、予め設定したプ
ライオリティに沿って要求を受け付ける。そのとき、ア
ドレス発生回路15では、実際のバッファRAM3のア
ドレスが要求に対し生成される。
C2ポインタのセットされているデータは、C2訂正で
もエラー訂正できなかった誤ったデータなので、例えば
前後の正しいデータの平均値を求めて出力する補間処理
等が行われる。この補間処理を行うためには、C2ポイ
ンタを読み取る必要がある。このC2ポインタのリード
回路の構成の一例を図7に示す。
つき、図8のタイミングチャートを参照しつつ説明す
る。図7において、バッファRAM3のデータバス2に
は、データを取り込むためのタイミングパルスDABSREが
高レベルの区間、C2ポインタおよびデ・インターリー
ブ後のエラー訂正済データが乗ってくる。
は、図8から明らかなように、4個のパルスが1組とな
り、これら4個のパルスに対応してポインタPL (下
位)、PU (上位)およびデータWx ,B(下位)、W
x ,A(上位)の順にデータバス2にデータが乗る。こ
れらデータは、タイミングパルスDABSREをイネーブル
(E)入力とする4個の8ビットレジスタ21〜24に
それぞれ格納される。レジスタ21は下位のポインタP
L 用として、レジスタ22は上位のポインタPU 用とし
てそれぞれ作用する。
タイミングに同期してカウント動作を行う4ビットカウ
ンタ25が設けられており、このカウンタ25はフレー
ムの頭で発生するタイミングパルスXRFCKRS に応答して
(0,0,0,0)をロードする。このカウンタ25の
カウント内容とタイミングパルスDABSREとの関係を、図
8のタイミングチャートに示す。カウンタ25の上位2
ビット(MSB,3SB)に基づいて、ゲート回路26
によって2バイトのデータ(Wx ,B、Wx ,A)を対
とした4つの状態0〜3が作られる。
ウンタ25のカウント値により、2バイトのデータに対
応するポインタが、レジスタ21,22に格納されてい
るC2ポインタの8ビット中、どのビットであるかが選
択される。レジスタ21のC2ポインタから選択された
下位のポインタPL は、ゲート回路28を介してラッチ
回路30にラッチされ、またレジスタ22のC2ポイン
タから選択された上位のポインタPU は、ゲート回路2
9を介してラッチ回路31にラッチされる。
DABSREは3個のパルスが組となり、ゲート回路29の作
用により、レジスタ22に格納されているC2ポインタ
の下位2ビットを、Wx ,A/Wx ,B共通のポインタ
として得ることができる。このようにしてC2ポインタ
が得られると、図1のD/Aインタフェース回路13で
は、C2ポインタの内容を判別し、C2ポインタのセッ
トされているデータに関しては、誤ったデータなので、
補間処理等が行われることになる。
MDのC2訂正において、C2ポインタを8バイト(シ
ンボル)のデータ毎に8ビットに対応させて付加する構
成としたことにより、2バイトのデータに対して1バイ
トのうちの2ビットのみを使っていたCDの場合に比較
して8バイトのデータに対して8ビット(1バイト)を
使用することになり、C2ポインタの容量を1/4にで
きるので、CDの場合と同じ32KビットのRAMでデ
・インターリーブを実現できることになる。また、24
バイトのデータに対し、CDでは12回C2ポインタを
書くのに対し、MDでは4回同じアドレスに繰り返し書
くようにしたので、MDのエラー訂正プログラムをCD
のものと共用化できることになる。
タアドレスの対応関係を示す図である。
図である。
グラムを示す図である。
ロック図である。
る。
る。
Claims (1)
- 【請求項1】種類が異なるディスクをそれぞれ再生する
第1、第2の動作モードを有し、並列に入力される1フ
レーム分所定バイトのディジタルデータを、エラー訂正
しつつ再生処理するディジタルデータ再生装置におい
て、第1の動作モードでは、エラー訂正用フラグを2バイト
のデータ毎に1バイトの一部のビットのみに対応させて
付加し、 第2の動作モードでは、同一書込みアドレスに4回繰返
し書くことによって エラー訂正用フラグを8バイトのデ
ータ毎に8ビットに対応させて付加することを特徴とす
るデ・インターリーブ回路。
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