JP2019512875A - 分割ビームのレーザスクライビングプロセスとプラズマエッチングプロセスとを使用する、ハイブリッドなウエハダイシングの手法 - Google Patents

分割ビームのレーザスクライビングプロセスとプラズマエッチングプロセスとを使用する、ハイブリッドなウエハダイシングの手法 Download PDF

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Abstract

各々が複数の集積回路を有する半導体ウエハをダイシングする方法について、説明している。一例では、複数の集積回路を有する半導体ウエハをダイシングする方法は、集積回路を覆いかつ保護する層で構成されたマスクを、半導体ウエハ上に形成することを包含する。間隙を有するパターニングされたマスクを提供するために、マスクは次いで、分割レーザビームのレーザスクライビングプロセス(例えば分割型レーザビームのレーザスクライビングプロセス)を用いてパターニングされ、半導体ウエハの集積回路間の領域が露出される。半導体ウエハは次いで、集積回路を個片化するために、パターニングされたマスクの間隙を通じてプラズマエッチングされる。【選択図】図1

Description

関連出願の相互参照
[0001]本出願は、先行する、「分割ビームのレーザスクライビングプロセスとプラズマエッチングプロセスとを使用する、ハイブリッドなウエハダイシングの手法(HYBRID WAFER DICING APPROACH USING A SPLIT BEAM LASER SCRIBING PROCESS AND PLASMA ETCH PROCESS)」と題された2016年3月3日出願の米国仮特許出願第15/060,224号(その優先権は本書によって請求される)に対する、優先権を主張するものである。
[0002]本発明の実施形態は半導体処理の分野に関し、詳細には、半導体ウエハであって、各ウエハがその上に複数の集積回路を有する半導体ウエハを、ダイシングする方法に関する。
関連技術の記載
[0003]半導体ウエハの処理においては、シリコン又はその他の半導体材料で構成されたウエハ(基板とも称される)上に、集積回路が形成される。通常、集積回路を形成するには、半導体、導体、又は絶縁体のいずれかである、様々な材料の層が利用される。これらの材料は、集積回路を形成するために、様々な周知のプロセスを使用して、ドープされ、堆積され、かつエッチングされる。各ウエハは処理されて、ダイとして知られる、集積回路を包含する多数の個別領域を形成する。
[0004]集積回路形成プロセスに続いて、ウエハは、パッケージ化されるため、又は、より大型の回路内でパッケージ化されていない形態で使用されるために、「ダイシングされ(diced)」て、互いとは別個のダイに分離される。ウエハをダイシングするために使用される2つの主な技法は、スクライビングとソーイングである。スクライビングでは、先端がダイヤモンドのスクライバが、予め形成されたスクライブラインに沿って、ウエハ表面の端から端まで移動する。このようなスクライブラインは、ダイ間のスペースに沿って延在する。これらのスペースは、一般的に「ストリート(street)」と称される。ダイヤモンドのスクライバは、ストリートに沿って、ウエハ表面に浅いキズ(scratch)を形成する。ローラなどで圧力が印加されると、ウエハはスクライブラインに沿って分離する。このウエハの割れは、ウエハ基板の結晶格子構造に沿ったものになる。スクライビングは、厚さが約10ミル(千分の1インチ)以下のウエハに使用されうる。もっと厚いウエハをダイシングするには、現時点では、ソーイングが好ましい方法である。
[0005]ソーイングでは、高い毎分回転数で回転する、先端がダイヤモンドの切断ソーが、ウエハ表面に接触し、ストリートに沿ってウエハを切断する。ウエハは膜フレーム全体に広がった接着膜などの支持部材に装着され、切断ソーが、垂直ストリートと水平ストリートの両方に繰り返し当てられる。スクライビングとソーイングのいずれにおいても問題となるのは、ダイの切断エッジに沿って、チップ及び溝が形成されうることである。加えて、亀裂が形成され、ダイのエッジから基板の中まで伝播して、集積回路が動作不能になる可能性もある。結晶構造の<110>方向においては、正方形又は長方形のダイの片側しかスクライブできないので、スクライビングに関しては、チップ形成と亀裂形成が特に問題となる。結果として、ダイの別の側の割れ(cleaving)により、ぎざぎざの分離線がもたらされる。チップ及び亀裂が形成されることから、集積回路の損傷を防ぐためには、ウエハのダイ間が更に離間することが必要となる(例えば、チップ及び亀裂が実際の集積回路から一定の距離を保つことになる)。この離間要件の結果として、標準サイズのウエハにあまり多くのダイを形成することができなくなり、回路のために使用できるはずであったウエハの面積が無駄になる。切断ソーを使用することで、半導体ウエハの面積の無駄は悪化する。切断ソーの刃の厚さは、およそ15ミクロンである。そのため、切断ソーによって生じた切断部の周囲の亀裂及びその他の損傷が、集積回路に悪影響を与えないことを確実にするためには、ダイの各々の回路を分離するのに、多くの場合、300〜500ミクロンが必要になる。更に切断後、ソーイングプロセスで生じた粒子及びその他の汚染物質を除去するために、各ダイをしっかりと洗浄することが必要になる。
[0006]プラズマダイシングも使用されてきたが、これにも制約がありうる。例えば、プラズマダイシングの実装を妨げる制約の1つは、コストでありうる。レジストをパターニングするための標準的なリソグラフィ工程により、実装費用は大変高額になりうる。プラズマダイシングの実装を妨げる可能性がある別の制約は、ストリートに沿ったダイシングにおける、よくある金属(銅など)のプラズマ処理が、製造上の問題又はスループット限界を引き起こしうることである。
[0007]本発明の実施形態は、半導体ウエハをダイシングする方法、及び、ダイシングするための装置を含む。
[0008]一実施形態では、複数の集積回路を有する半導体ウエハをダイシングする方法は、集積回路を覆いかつ保護する層で構成されるマスクを、半導体ウエハ上に形成することを包含する。間隙を有するパターニングされたマスクを提供するために、マスクは次いで、分割型レーザビームのレーザスクライビングプロセスを用いてパターニングされ、半導体ウエハの集積回路間の領域が露出される。半導体ウエハは次いで、集積回路を個片化するために、パターニングされたマスクの間隙を通じてプラズマエッチングされる。
[0009]別の実施形態では、複数の集積回路を含む半導体ウエハをダイシングする方法は、集積回路を個片化するために、分割型レーザビームのレーザスクライビングスプロセスを用いて半導体ウエハをレーザスクライブすることを包含する。方法は、半導体ウエハをレーザスクライブすることに続いて、個片化された複数の集積回路の側壁を洗浄するための、プラズマベースの洗浄工程を実施することも包含する。
[0010]別の実施形態では、複数の集積回路を有する半導体ウエハをダイシングするためのシステムは、ファクトリインターフェースを含む。システムは、ファクトリインターフェースに連結され、かつ、分割型レーザビームを提供するよう構成されたレーザアセンブリを有する、レーザスクライビング装置も含む。システムは、ファクトリインターフェースに連結されたプラズマエッチングチャンバも含む。
[0011]本発明の一実施形態による、複数の集積回路を含む半導体ウエハをダイシングする方法の工程を表わすフロー図である。 [0012]本発明の一実施形態による、図1のフロー図の工程102に対応する、半導体ウエハをダイシングする方法を実行中の、複数の集積回路を含む半導体ウエハの断面図を示す。 [0013]本発明の一実施形態による、図1のフロー図の工程104に対応する、半導体ウエハをダイシングする方法を実行中の、複数の集積回路を含む半導体ウエハの断面図を示す。 [0014]本発明の一実施形態による、図1のフロー図の工程108に対応する、半導体ウエハをダイシングする方法を実施中の、複数の集積回路を含む半導体ウエハの断面図を示す。 [0015]本発明の一実施形態による、非対称ビーム分割の3つの異なる状況を示す。 [0016]本発明の一実施形態による、分割ビームの強度制御を伴うレーザスクライビングプロセスの工程を表わすフロー図である。 [0017]本発明の一実施形態による、レーザビーム分割プロセスのためのガウスレーザビームプロファイル410を示す。 [0018]本発明の一実施形態による、ビーム経路420におけるガウスビーム伝搬を示す。 [0019]本発明の一実施形態による、線形ビームの分割強度制御を伴うレーザスクライビングプロセスの工程を表わすフロー図である。 [0020]本発明の一実施形態による、レーザビーム分割プロセスのためのガウスレーザビームプロファイルを示す。 [0021]本発明の一実施形態による、線形平坦頂部のビームプロファイルを示す。 [0022]本発明の一実施形態による、フェムト秒範囲、ピコ秒範囲、及びナノ秒範囲のレーザパルス幅を使用することの影響を示す。 [0023]本発明の一実施形態による、半導体ウエハ又は基板のストリート領域に使用されうる材料の積層体の断面図を示す。 [0024]本発明の一実施形態による、半導体ウエハをダイシングする方法における様々な工程のうちの1つの断面図を示す。 本発明の一実施形態による、半導体ウエハをダイシングする方法における様々な工程のうちの1つの断面図を示す。 本発明の一実施形態による、半導体ウエハをダイシングする方法における様々な工程のうちの1つの断面図を示す。 本発明の一実施形態による、半導体ウエハをダイシングする方法における様々な工程のうちの1つの断面図を示す。 [0025]本発明の一実施形態による、ウエハ又は基板をレーザ及びプラズマでダイシングするためのツールレイアウトのブロック図を示す。 [0026]本発明の一実施形態による、例示的なコンピュータシステムのブロック図を示す。
[0027]各々がその上に複数の集積回路を有している半導体ウエハをダイシングする方法について、説明する。以下の説明では、本発明の実施形態の網羅的な理解を提供するために、分割ビームレーザスクライビングの手法や、プラズマエッチングの条件及び材料レジームといった、多数の具体的な詳細事項が明示される。当業者には、これらの具体的な詳細事項がなくとも本発明の実施形態は実践可能であることが、自明となろう。他の事例としては、本発明の実施形態を不必要に分かりにくくしないために、集積回路製造などの周知の態様については詳細に説明しない。更に、図に示している様々な実施形態は例示的な表現であり、必ずしも縮尺どおりには描かれていないことを、理解されたい。
[0028]初期のレーザスクライビングと後続のプラズマエッチングとを包含する、ハイブリッドなウエハ又は基板のダイシング処理が、ダイを個片化するために実装されうる。レーザスクライビングプロセスは、マスク層、有機及び無機の誘電体層、並びにデバイス層をクリーンに除去するために使用されうる。ウエハ又は基板が露出すると、又はそれらが部分的にエッチングされると、レーザエッチングプロセスは終了しうる。次いで、ウエハ又は基板のバルク(バルク単結晶シリコンなど)を貫通エッチングして、ダイ又はチップの個片化又はダイシングを引き起こすために、ダイシングプロセスのプラズマエッチング部分が用いられうる。より具体的には、一又は複数の実施形態は、例えばダイシング応用のための、分割型レーザビームのレーザスクライビングプロセスを実装することを対象とする。
[0029]背景状況を知らしめるに、分割ビームスクライビングの利点は、レーザパルスエネルギーの使用を改善し、その有効性を高めることを包含しうる。例えば、レーザスクライビングにおいて、高パルスエネルギーは、パルス当たり、相対的に大きなサイズの材料をアブレーションする傾向がある。しかし、スクライブされたトレンチの清浄度は、低エネルギーパルスでスクライブされたトレンチと比べて、ずっと低くなる。これにより、望ましいエッチング品質のためには、プラズマエッチングの前に、スクライブされたトレンチのプラズマ予洗浄をもっとずっと有効に行うことが必要になるので、プラズマエッチングプロセスがより困難になる可能性がある。このことは、プラズマダイシングのスループットに悪い影響を与える。場合によっては、プラズマ洗浄を行っても、スクライブされたトレンチにエッチングが実行できるようにならないことすらある。高エネルギーアブレーションは、望ましいものを上回る、深すぎるアブレーションを引き起こすこともある。しかし、高エネルギーアブレーションを回避すれば、レーザソースはその最大能力まで使用されることがなくなり、これにはコストがかかる。加えて、より低い(ただし、スクライビングによって引き起こされた層剥離及びその他の不具合を消去するのに十分なほど高い)パルスエネルギーによって、スクライビングのスループットが低くなる。しかし、それが実装されれば材料をより穏やかにアブレーションしうるので、トレンチは、プラズマプロセスによって、より手軽な様態で洗浄されうる。本書に記載の実施形態により、分割ビームプロセスを用いれば、ダイシングの総スループットと品質とのバランスが良好に保たれる。
[0030]背景状況を更に知らしめるに、コーティングされたウエハの初期のレーザスクライビングと後続のプラズマエッチングとを包含する、ハイブリッドなウエハ又は基板のダイシングプロセスにおいて、シリコン基板が露出するまでダイシングストリート上のマスク層及びデバイス層を除去するために、フェムト秒レーザが当てられうる。ダイ個片化を実現するためにダイが分割された後に、プラズマエッチングが行われる。典型的には、スクライビングプロセスにはガウスビームプロファイルが使用される。しかし、ガウスビームプロファイルは、(1)幅広カーフが求められる場合と、(2)典型的な狭カーフ幅に、円滑な側壁と共に高いスクライビングスループットが必要とされる場合という、2つの異なる状況では、その限界を示すものである。
[0031]本発明の一又は複数の実施形態により、ハイブリッドなレーザダイシングにおけるレーザスクライビングプロセスを改善するために、空間的に分割されたビームのレーザ強度制御が実装される。追加の実施形態では、ハイブリッドなレーザダイシングの処理方式におけるレーザスクライビングプロセスを改善するために、空間的に成型されたビームの分割レーザビーム制御が実装される。
[0032]そのため、本発明の一態様では、分割ビームのレーザスクライビングプロセスとプラズマエッチングプロセスとの組み合わせが、半導体ウエハを個片化された集積回路にダイシングするために使用されうる。図1は、本発明の一実施形態による、複数の集積回路を含む半導体ウエハをダイシングする方法の工程を表しているフロー図100である。図2Aから図2Cは、本発明の一実施形態による、フロー図100の工程に対応する、半導体ウエハをダイシングする方法を実施中の、複数の集積回路を含む半導体ウエハの断面図を示している。
[0033]フロー図100の工程102、及びそれに対応する図2Aを参照するに、半導体ウエハ又は基板204の上にマスク202が形成される。マスク202は、半導体ウエハ204の表面上に形成された集積回路206を覆いかつ保護する層で、構成される。マスク202は、集積回路206の各々の間に形成された、介在ストリート207も覆う。
[0034]本発明の一実施形態により、マスク202を形成することは、フォトレジスト層やIラインパターニング層などであるがそれらに限定されるわけではない、層を形成することを含む。例えば、フォトレジスト層などのポリマー層は、リソグラフィプロセスで使用されるのに適しているはずの材料で構成されうる。一実施形態では、フォトレジスト層は、248ナノメータ(nm)レジスト、193nmレジスト、157nmレジスト、極紫外光(EUV)レジスト、又はジアゾナフトキノン感作物質を有するフェノール樹脂マトリクスなどであるがそれらに限定されるわけではない、ポジ型フォトレジスト材料で構成される。別の実施形態では、フォトレジスト層は、ポリシスイソプレンやポリビニルシンナメートなどであるがそれらに限定されるわけではない、ネガ型フォトレジスト材料で構成される。
[0035]別の実施形態では、マスク202を形成することは、プラズマ堆積プロセスにおいて堆積される層を形成することを包含する。例えば、かかる一実施形態では、マスク202は、プラズマ堆積されたテフロン層又はテフロン様(高分子CF)層で構成される。ある具体的な実施形態では、高分子CF層は、ガスCを伴うプラズマ堆積プロセスにおいて堆積される。
[0036]別の実施形態では、マスク202を形成することは、水溶性マスク層を形成することを包含する。一実施形態では、水溶性マスク層は水性媒体に容易に溶解可能である。例えば、一実施形態では、水溶性マスク層は、アルカリ性溶液、酸性溶液、又は脱イオン水のうちの一又は複数の中で可溶性である材料で、構成される。一実施形態では、水溶性マスク層は、加熱プロセスに暴露され(例えば、おおよそ摂氏50〜160度の範囲内で加熱され)ても、その水溶性を維持する。例えば、一実施形態では、水溶性マスク層は、レーザ及びプラズマによるエッチング個片化プロセスで使用されるチャンバ条件に暴露された後も、水溶液中で可溶性である。一実施形態では、水溶性マスク層は、ポリビニルアルコール、ポリアクリル酸、デキストラン、ポリメタクリル酸、ポリエチレンイミン、又はポリエチレンオキシドなどであるがそれらに限定されるわけではない材料で、構成される。ある具体的な実施形態では、水溶性マスク層は、おおよそ毎分1〜15ミクロンの範囲内の、より詳細には、おおよそ毎分約1.3ミクロンの、水溶液中でのエッチング速度を有する。
[0037]別の実施形態では、マスク202を形成することは、UV硬化性マスク層を形成することを包含する。一実施形態では、マスク層は、UV硬化層の接着性を少なくともおよそ80%低減させる、UV光に対する感光性を有する。かかる一実施形態では、UV層は、ポリ塩化ビニル又はアクリル系材料で構成される。一実施形態では、UV硬化層は、UV光に曝露されると接着特性が弱まる材料、又はかかる材料の積層体で構成される。一実施形態では、UV硬化性接着フィルムは、およそ365nmのUV光に感応する。かかる一実施形態では、この感光性により、硬化を実施するためにLED光を使用することが可能になる。
[0038]一実施形態では、半導体ウエハ又は基板204は、製造プロセスに耐えることに適した材料で構成されており、製造プロセスにおける半導体処理の際に、層が好適に堆積されうる。例えば、一実施形態では、半導体ウエハ又は基板204は、結晶シリコン、ゲルマニウム、又はシリコン/ゲルマニウムなどであるがそれらに限定されるわけではない、IV族系材料で構成される。ある具体的な実施形態では、半導体ウエハ204を提供することは、単結晶シリコン基板を提供することを含む。ある特定の実施形態では、単結晶シリコン基板は、不純物原子でドープされる。別の実施形態では、半導体ウエハ又は基板204は、III−V材料、(例えば、発光ダイオード(LED)の製造に使用されるIII−V材料基板など)で構成される。
[0039]一実施形態では、半導体ウエハ又は基板204は、その表面上又は内部に集積回路206の一部として配置された、半導体デバイスのアレイを有する。かかる半導体デバイスの例は、シリコン基板に製造され、かつ、誘電体層内に封入される、メモリデバイスや相補型金属酸化物半導体(CMOS)トランジスタを含むが、それらに限定されるわけではない。複数の金属相互接続部が、デバイス又はトランジスタの上に、及び誘電体層の周囲に形成されてよく、デバイス又はトランジスタを電気的に連結して集積回路206を形成するために使用されうる。ストリート207を作製する材料は、集積回路206を形成するために使用される材料と類似しているか、又は同じものでありうる。例えば、ストリート207は誘電体材料、半導体材料、及びメタライゼーションの層で構成されうる。一実施形態では、ストリート207のうちの一又は複数は、集積回路206の実際のデバイスに類似した試験デバイスを含む。
[0040]フロー図100の工程104、及びそれに対応する図2Bを参照するに、間隙210を伴ってパターニングされたマスク208を提供し、半導体ウエハ又は基板204の集積回路206間の領域を露出させるために、マスク202は、分割レーザビームのレーザスクライビングプロセスを用いてパターニングされる。かかる一実施形態では、間隙210を伴ってパターニングされたマスク208を提供するために、マスク202は、分割型レーザビームのレーザスクライビングプロセスを用いてパターニングされる。そのため、レーザスクライビングプロセスは、集積回路206間に元々形成されていたストリート207の材料を除去するために、使用される。本発明の一実施形態により、図2Bに示しているように、分割レーザビームのレーザスクライビングプロセスを用いてマスク202をパターニングすることは、半導体ウエハ204の集積回路206間の領域に部分的に入り込むように、トレンチ212を形成することを含む。
[0041]一実施形態では、分割レーザビームの処理方式は、ビームが多数の場所に、各場所について同一の強度で分割されるという点で、対称でありうることを、認識されたい。しかし、他の実施形態では、ビーム分割は非対称である。かかる非対称構成は、ウエハを最終的にスクライブするために、組み合わされて使用される、ウエハに沿ったいくつかのパスのうちの1つとして、使用されるものである。一例としては、図3は、本発明の一実施形態による、非対称ビーム分割の3つの異なる状況を示している。
[0042]図3を参照するに、(a)部分は、入力レーザビーム302Aが小型レンズのアレイ304Aを通過してデバイスウエハ306Aに当たる、非対称な小型レンズのアレイの第1構成を示している。この実施形態では、小型レンズ308Aのサイズは左から右に向かって大きくなり、デバイスウエハ306A全体におけるビーム310Aの強度が左から右に向かって増大することが可能になる。図3を再度参照するに、(b)部分は、入力レーザビーム302Bが小型レンズのアレイ304Bを通過してデバイスウエハ306Bに当たる、非対称な小型レンズのアレイの第2構成を示している。この実施形態では、小型レンズ308Bのサイズは左から右に向かって小さくなり、ビーム310Bの強度が左から右に向かって減少することが可能になる。図3を再度参照するに、(c)部分は、入力レーザビーム302Cが小型レンズのアレイ304Cを通過してデバイスウエハ306Cに当たる、非対称な小型レンズのアレイの第3構成を示している。この実施形態では、小型レンズ308Cのサイズは左から右に向かって変動し、ビーム310Cの強度が左から右に向かって変動することが可能になる。
[0043]図4Aは、本発明の一実施形態による、分割ビームの強度制御を伴うレーザスクライビングプロセスの工程を表わすフロー図400である。図4Aを参照するに、工程402において、レーザビームがフェムト秒(Fs)レーザ発振器に入力されるか、又は、かかる発振器から生成される。工程404において、ビームは次いで、小型レンズのアレイなどであり、小型レンズのアレイを含む、分割ビーム光学素子を通過する。工程406において、出力ビームがウエハスクライビングプロセスで使用される。
[0044]図4Bは、本発明の一実施形態による、レーザビーム分割プロセスのためのガウスレーザビームプロファイル410を示している。図4Bを参照するに、レーザビームプロファイル410はフェムト秒レーザの空間プロファイルでありうる。図4Cは、本発明の一実施形態による、ビーム経路420におけるガウスビーム伝搬を示している。図4Cを参照するに、第1非焦点位置422と、第2非焦点位置424と、焦点位置426とが示されている。図4Aから図4Cを集合的に参照するに、ガウスビームは分割ビームプロセスにおいて使用されうる。しかし、図4Cに示しているように、かかる分割ビームプロセスを使用することで、問題が生じることがある。
[0045]別の態様では、ビーム分割プロセスのためにビーム成型が実装される。一例としては、図5Aは、本発明の一実施形態による、線形ビームの分割強度制御を伴うレーザスクライビングプロセスの工程を表わすフロー図500である。図5Aを参照するに、工程502において、レーザビームがフェムト秒(Fs)レーザ発振器に入力されるか、又は、かかる発振器から生成される。工程504において、ビームは次いで、ビーム成型光学素子を通過する。工程506において、ビームは次いで、小型レンズのアレイなどであり、小型レンズのアレイを含む、分割ビーム光学素子を通過する。工程508において、出力ビームがウエハスクライビングプロセスで使用される。
[0046]図5Bは、本発明の一実施形態による、レーザビーム分割プロセスのためのガウスレーザビームプロファイル510を示している。図5Bを参照するに、レーザビームプロファイル510はフェムト秒レーザの空間プロファイルでありうる。図5Cは、本発明の一実施形態による、線形平坦頂部のビームプロファイル520を示している。図5B及び図5Cを参照するに、ビームを、ビーム形成光学素子を通して、ガウスビームプロファイル510から線形平坦頂部プロファイル520へと変換するために、レーザビームプロファイル510が、分割レーザビーム光学素子に放射される。一実施形態では、ビーム成型光学素子は、回折光学素子、一又は複数のスリット開孔、アキシコンなどを含む。
[0047]一実施形態では、ビーム分割型の応用と比較して、単一ビームを使用すると、スクライビングプロセスは、10uJのパルスエネルギーで、1MHzで、1000mm/秒の載台スピードで、2つのパスを使用して、実行される。ウエハ全体をスクライブするには、およそ11分かかる。最終的なプラズマエッチングを可能にするためのプラズマ予洗浄を実施するには、およそ3分かかる。一実施形態では、ビーム分割型の応用に有効なパラメータは、1つから2つに分割されたビームを使用する場合、スクライビングプロセスが、800kHzで、各分割ビームあたり6uJのエネルギーパルスで(先行ビームと後続ビームとは、単一のラインをスクライブするために同軸に位置合わせされる)、かつ800mm/秒の載台スピードで、1つのパスを使用して、実行されることを含む。かかる一実施形態では、ウエハ全体をスクライブするのにおよそ5分かかる。プラズマ予洗浄を実施するには、およそ1分かかる。線形の載台移動は3つの工程(スクライビングの開始前に望ましいスピードに達するよう加速すること、望ましいスピードでスクライブすること、スクライビング後に減速すること)を経るので、実際にウエハをスクライブする時間(1000mm/秒で実行される)と比較して、加速フェーズ及び減速フェーズが時間の大部分を占めることを、認識すべきである。800mm/秒と比べると、かかる差異は、各パスあたりの全スクライビング時間を大きく低減するものではない(例えば、スクライビングスピードが速くなることで、加速時間及び/又は減速時間に要する時間が長くなり、スクライビングスピードが遅くなることで、加速時間及び/又は減速時間に必要な時間は短くなる)。
[0048]一実施形態では、フェムト秒ベースのレーザが、分割型レーザビームのスクライビングプロセスのためのソースとして使用される。例えば、一実施形態では、フェムト秒ベースのレーザパルスを提供するために、可視スペクトルに紫外線(UV)及び赤外線(IR)の範囲を加えた(三つ合わせて広帯域光学スペクトル)波長を有するレーザが使用され、フェムト秒ベースのレーザパルスは、フェムト秒(10−15秒)単位のパルス幅を有する。一実施形態では、アブレーションは、波長に依存するものではないか、又は実質的に依存するものではなく、ゆえに、マスク202、ストリート207、及び(場合によっては)半導体ウエハ又は基板204の一部分による膜などの、複合膜に適している。
[0049]図6は、本発明の一実施形態による、フェムト秒範囲、ピコ秒範囲、及びナノ秒範囲のレーザパルス幅を使用することの、影響を示している。図6を参照するに、フェムト秒範囲のレーザビームを使用することにより、より長いパルス幅の場合(例えば、ビア600Aのナノ秒処理での著しい損傷602A)と比べて、熱損傷の問題は軽減されるか、又は解消される(例えば、ビア600Cのフェムト秒処理での最小限の損傷〜損傷なし602C)。ビア600Cの形成時における損傷の解消又は軽減は、図6に示しているように、(600B/602Bのピコ秒ベースのレーザアブレーションに関して見られるような)低いエネルギー再結合も、(ナノ秒ベースのレーザアブレーションに関して見られるような)熱平衡も、ないためでありうる。
[0050] クリーンなレーザスクライビング切断を実現するために、チップ形成、微小亀裂、及び層間剥離を最小化する、良好なレーザスクライビング及びダイシングのプロセスを発現させるには、ビームプロファイルなどのレーザパラメータの選択が重要になりうる。レーザスクライビング切断がクリーンになるほど、最終的なダイ個片化のために実施されうるエッチングプロセスがより円滑になる。半導体デバイスウエハでは、典型的には、種々の材料タイプ(導体、絶縁体、半導体など)及び厚さの多くの機能層が、ウエハ上に配置される。かかる材料は、ポリマーなどの有機材料、金属、又は、二酸化ケイ素や窒化ケイ素などの無機誘電体を含みうるが、それらに限定されるわけではない。
[0051]ウエハ又は基板に配置された個々の集積回路の間のストリートは、集積回路自体と類似した又は同じ層を含みうる。例えば、図7は、本発明の一実施形態による、半導体ウエハ又は基板のストリート領域に使用されうる、材料の積層体の断面図を示している。
[0052]図7を参照するに、ストリート領域700は、シリコン基板の最上部702、第1二酸化ケイ素層704、第1エッチング停止層706、(例えば、二酸化ケイ素の誘電率4.0よりも低い誘電率を有する)第1低誘電率誘電体層708、第2エッチング停止層710、第2低誘電率誘電体層712、第3エッチング停止層714、非ドープケイ素ガラス(USG)層716、第2二酸化ケイ素層718、及びフォトレジスト720の層を含み、これらの相対的な厚さが図示されている。銅メタライゼーション722が、第1エッチング停止層706と第3エッチング停止714の間に、第2エッチング停止層710を通って配置されている。ある具体的な実施形態では、第1エッチング停止層706、第2エッチング停止層710、及び第3のエッチング停止層714は窒化ケイ素で構成される一方、低誘電率誘電体層708及び712は、炭素がドープされた酸化ケイ素材料で構成される。
[0053] 従来型のレーザ照射(例えばナノ秒ベースの照射)のもとでは、ストリート700の材料は、光吸収及びアブレーションの機序という点で、かなり異なる挙動を示す。例えば、二酸化ケイ素などの誘電体層は、通常条件下では、商業的に利用可能な全てのレーザ波長に対して実質的に透過性である。対照的に、金属、有機物(例えば低誘電率材料)、及びシリコンは、特にナノ秒ベースの照射に応答して、きわめて容易に光子を結合させうる。一実施形態では、低誘電率材料の層及び銅の層のアブレーションに先立って二酸化ケイ素の層をアブレーションすることによって、二酸化ケイ素の層、低誘電率材料の層、及び銅の層をパターニングするために、線形プロファイルのレーザビームのレーザスクライビングプロセスが使用される。
[0054]分割型レーザビームがフェムト秒ベースのレーザビームである場合、一実施形態では、好適なフェムト秒ベースのレーザプロセスは、通常様々な材料における非線形相互作用をもたらす、高いピーク強度(放射照度)を特徴とする。かかる一実施形態では、フェムト秒レーザソースは、おおよそ10フェムト秒〜500フェムト秒の範囲内、ただし好ましくは100フェムト秒〜400フェムト秒の範囲内のパルス幅を有する。一実施形態では、フェムト秒レーザソースは、おおよそ1570ナノメートル〜200ナノメートルの範囲内、ただし好ましくは540ナノメートル〜250ナノメートルの範囲内の波長を有する。一実施形態では、レーザ及びそれに対応する光学システムは、加工面に、おおよそ3ミクロン〜15ミクロンの範囲内、ただし好ましくはおおよそ5ミクロン〜10ミクロンの範囲内、又は10〜15ミクロンの範囲内の焦点(focal spot)を提供する。
[0055]一実施形態では、レーザソースは、おおよそ200kHz〜10MHzの範囲内、ただし好ましくはおおよそ500kHz〜5MHzの範囲内のパルス繰り返し率を有する。一実施形態では、レーザソースは、加工面におおよそ0.5uJ〜100uJの範囲内、ただし好ましくはおおよそ1uJ〜5uJの範囲内のパルスエネルギーを供給する。一実施形態では、レーザスクライビングプロセスは、被加工物の表面に沿って、おおよそ500mm/秒〜5m/秒の範囲内、ただし好ましくはおおよそ600mm/秒〜2m/秒の範囲内のスピードで実行される。
[0056]スクライビングプロセスは、単一パスのみで、又は複数のパスで実行されうるが、一実施形態では1〜2パスが好ましい。一実施形態では、被加工物のスクライビング深さは、おおよそ5ミクロン〜50ミクロンの範囲内、好ましくはおおよそ10ミクロン〜20ミクロンの範囲内の深さである一実施形態では、生成されたレーザビームのカーフ幅はおおよそ2ミクロン〜15ミクロンの範囲内であるが、シリコンウエハのスクライビング/ダイシングにおいては、(デバイス/シリコンのインターフェースで測定されると)好ましくはおおよそ6ミクロン〜10ミクロンの範囲内である。
[0057] レーザパラメータは、無機誘電体(例えば二酸化ケイ素)のイオン化を実現し、かつ、無機誘電体の直接アブレーションの前の下層の損傷によって引き起こされる層間剥離及びチップ形成を最小限に抑えるのに十分なほど、高いレーザ強度を提供することなどの、メリット及び利点によって選択されうる。また、パラメータは、正確に制御されたアブレーションの幅(例えばカーフ幅)及び深さを伴う工業的応用に関して、有意なプロセススループットをもたらすよう、選択されうる。一実施形態では、かかる利点を提供するには、線形プロファイルレーザビームのレーザスクライビングプロセスが適している。
[0058]レーザスクライビングが、マスクをパターニングすることだけでなく、ダイを個片化するためにウエハ又は基板を貫通するようにスクラビングを行うことのために使用される場合、ダイシング又は個片化のプロセスは、上述のレーザスクライビングの後に停止される可能性があることを、認識されたい。したがって、かかる場合には、更なる個片化処理が必要なくなる。しかし、総合的な個片化のためにレーザスクライビングだけが実装されるわけではない場合には、以下の実施形態が検討されうる。
[0059]ここでフロー図100のオプション工程106を参照するに、中間的な、マスク開口後の洗浄工程が実施される。一実施形態では、マスク開口後の洗浄工程は、プラズマベースの洗浄プロセスである。第1の例では、後述するように、プラズマベースの洗浄プロセスは、基板204の間隙210によって露出された領域と反応する。反応性プラズマベースの洗浄プロセスの場合、洗浄プロセス自体が、基板204にトレンチ212を形成しうるか、又は延伸させうる。反応性プラズマベースの洗浄工程が、少なくとも幾分、基板204をエッチングするものであるからである。別の第2の例では、同じく後述するように、プラズマベースの洗浄プロセスは、基板204の間隙210によって露出された領域と反応しない。
[0060]第1の実施形態により、プラズマベースの洗浄プロセスは、基板204の露出された領域と反応し、露出した領域は、洗浄プロセスにおいて部分的にエッチングされる。かかる一実施形態では、Ar又は別の非反応性ガス(又はその混合物)は、スクライブされた開口部を洗浄するための高バイアスプラズマ処理のために、SFと結合する。マスクに露出された領域をボンバードして、マスクに露出された領域の洗浄を実現するために、高バイアス電力のもとで混合ガス(Ar+SF)を使用するプラズマ処理が実施される。反応性貫通(breakthrough)プロセスにおいては、Ar及びSFによる物理ボンバードと、SF及びFイオンによる化学エッチングの両方が、マスクに露出された領域の洗浄に寄与する。この手法は、貫通処理により、かなり均一なマスク厚の減少、及び穏やかなSiエッチングがもたらされる、フォトレジスト又はプラズマ堆積されたテフロンマスク202に適していることがある。しかし、かかる貫通エッチングプロセスは、水溶性マスク材料には、最も適しているわけではないことがある。
[0061]第2の実施形態により、プラズマベースの洗浄プロセスは、基板204の露出した領域と反応せず、露出した領域は、洗浄プロセスにおいてエッチングされないか、又は、無視できる程度にしかエッチングされない。かかる一実施形態では、非反応性ガスのプラズマ洗浄のみが使用される。例えば、Ar又は別の非反応性ガス(又はその混合物)が、マスクの凝集(condensation)とスクライブされた開口部の洗浄の両方のための、高バイアスプラズマ処理を実施するために使用される。この手法は、水溶性マスク又は薄型のプラズマ堆積されたテフロン202に適していることがある。別のかかる実施形態では、別個の、マスクの凝集工程とスクライブされたトレンチの洗浄工程が使用される。例えば、マスク凝集のための、Ar又は非反応性ガス(又はその混合物)による高バイアスプラズマ処理が最初に実施され、次いで、Ar+SFによる、レーザスクライブされたトレンチのプラズマ洗浄が実施される。この実施形態は、マスク材料が厚すぎるために、Ar洗浄がトレンチ洗浄には不十分である場合に、適していることがある。薄型のマスクでは、洗浄効率は向上するが、マスクエッチング速度は大幅に低下し、後続のディープシリコンエッチングプロセスにおける消費量がほとんどなくなる。更に別のかかる実施形態では、(a)マスク凝集のための、Ar又は非反応性ガス(又はその混合物)による高バイアスプラズマ処理(b)Ar+SFによる、レーザスクライブされたトレンチの高バイアスプラズマ洗浄、及び、(c)マスク凝集のための、Ar又は非反応性ガス(又はその混合物)による高バイアスプラズマ処理、という三工程洗浄が実施される。本発明の別の実施形態により、プラズマ洗浄工程は、工程106の第1態様で上述したような、反応性プラズマ洗浄処理の先行使用を包含する。次いで、反応性プラズマ洗浄処理に続いて、工程106の第2態様により説明したような、非反応性プラズマ洗浄処理が行われる。
[0062]フロー図100の工程108、及びそれに対応する図2Cを参照するに、半導体ウエハ204は、集積回路206を個片化するために、パターニングされたマスク208の間隙210を通じてエッチングされる。本発明の一実施形態により、半導体ウエハ204をエッチングすることは、分割型レーザビームのレーザスクライビングプロセスを用いて初期に形成されたトレンチ212をエッチングすることよって、最終的に、図2Cに示しているように、半導体ウエハ204を貫通するようにエッチングを行うことを含む。
[0063]一実施形態では、レーザスクライビングプロセスを用いてマスクをパターニングすることは、半導体ウエハの集積回路間の領域内にトレンチを形成することを包含し、半導体ウエハをプラズマエッチングすることは、トレンチを延伸させて、対応するトレンチ延伸部を形成することを包含する。かかる一実施形態では、トレンチの各々は一定の幅を有し、対応するトレンチ延伸部の各々もその幅を有する。
[0064]本発明の一実施形態により、レーザスクライビングにより生じるマスク開口部の粗さは、後続のプラズマエッチングされたトレンチの形成によってもたらされるダイ側壁の品質に影響を与えうる。リソグラフィにより開口されたマスクは、円滑なプロファイルを有することが多く、それに対応する、プラズマエッチングされたトレンチの円滑な側壁につながる。対照的に、従来型のレーザで開口されたマスクは、不適切なレーザプロセスパラメータ(例えば、プラズマエッチングされたトレンチの側壁の水平方向の粗さにつながるスポット重複)が選択された場合、スクライビング方向に沿って、非常に粗いプロファイルを有しうる。追加のプラズマプロセスによって表面粗さは円滑化されうるが、かかる問題を解決することと、コスト及びスループットとの相克が生じる。したがって、本書に記載の実施形態は、個片化プロセスのレーザスクライビング部分による、より円滑なスクライビングプロセスを提供する上で、有利でありうる。
[0065]一実施形態では、半導体ウエハ204をエッチングすることは、プラズマエッチングプロセスを使用することを含む。一実施形態では、シリコン貫通ビア式のエッチングプロセスが使用される。例えば、ある具体的な実施形態では、半導体ウエハ204の材料のエッチング速度は、毎分25ミクロンを上回る。超高密度プラズマソースが、ダイ個片化プロセスのプラズマエッチング部分に使用されうる。かかるプラズマエッチングプロセスを実施するのに適したプロセスチャンバの一例は、米国カリフォルニア州SunnyvaleのApplied Materialsから入手可能な、Applied Centura(登録商標)Silvia(商標)エッチングシステムである。Applied Centura(登録商標)Silvia(商標)エッチングシステムは、容量性と誘導性のRF結合を組み合わせるものであり、これにより、イオン密度とイオンエネルギーとの(たとえ磁気強化によって改善されても容量性結合のみで可能であった以前の独立制御よりも)ずっと良好な独立制御が得られる。この組み合わせにより、たとえ非常な低圧においても、損傷を与える可能性がある高いDCバイアスレベルを伴わずに、相対的に高密度のプラズマを実現するように、イオン密度をイオンエネルギーから有効に切り離すことが、可能になる。これにより、極めて広い処プロセスウィンドウがもたらされる。しかし、シリコンをエッチングすることが可能な任意のプラズマエッチングチャンバが使用されうる。例示的な一実施形態では、実質的に正確なプロファイル制御と、事実上スカロップ(scallop)を有しない側壁とを維持しつつ、単結晶シリコンの基板又はウエハ204を、従来的なシリコンエッチング速度のおよそ40%を上回るエッチング速度でエッチングするために、ディープシリコンエッチングが使用される。ある具体的な実施形態では、シリコン貫通ビア式のエッチングプロセスが使用される。このエッチングプロセスは、通常、SF、C、CHF、XeFなどのフッ素系ガスか、又は、その他の、相対的に速いエッチング速度でシリコンをエッチングすることが可能な任意の反応ガスである、反応性ガスから生成される、プラズマに基づくものである。一実施形態では、マスク層208は、図2Cに示しているように、個片化プロセスの後に除去される。別の実施形態では、図2Cに関連して説明しているプラズマエッチング工程は、基板204を貫通エッチングするために、従来型のボッシュ式堆積/エッチング/堆積プロセスを用いる。通常、ボッシュ式プロセスは、堆積、方向性ボンバードエッチング、及び等方性化学エッチングという3つのサブ工程で構成され、等方性化学エッチングは、シリコンが貫通エッチングされるまで、多数回の繰り返し(サイクル)で実施される。
[0066]したがって、フロー図100及び2Aから2Cを再度参照するに、マスク層を貫通し、ウエハのストリート(メタライゼーションを含む)を貫通し、かつシリコン基板に部分的に入り込むように、アブレーションを行うために、分割型レーザビームのレーザスクライビングプロセスを使用する初期アブレーションによって、ウエハダイシングが実施されうる。次いで、後続のシリコン貫通ディーププラズマエッチングによって、ダイ個片化が完遂されうる。ダイシングされる材料積層体のある具体的な実施形態について、本発明の一実施形態により、図8Aから図8Dに関連して後述する。
[0067]図8Aを参照するに、ハイブリッドな、レーザアブレーション及びプラズマエッチングによるダイシング向けの材料積層体は、マスク層802と、デバイス層804と、基板806とを含む。マスク層、デバイス層、及び基板は、支持テープ810に付着しているダイ付着膜808の上に配置される。一実施形態では、マスク層802は、水溶性の層(マスク202に関連して上述した水溶性の層など)である。デバイス層804は、一又は複数の金属層(銅層など)の上に配置された無機誘電体層(二酸化ケイ素など)、及び、一又は複数の低誘電率誘電体層(炭素がドープされた酸化物層など)を含む。デバイス層804は、集積回路間に配置されたストリートも含み、ストリートは、集積回路と同じか又は類似した層を含む。基板806はバルク単結晶シリコン基板である。
[0068]一実施形態では、バルク単結晶シリコン基板806は、ダイ付着膜808に固定される前に、裏側から薄化(thinning)される。薄化は、裏側研削プロセスによって実施されうる。一実施形態では、バルク単結晶シリコン基板806は、おおよそ50〜100ミクロンの範囲内の厚さまで薄化される。一実施形態では、レーザアブレーション及びプラズマエッチングによるダイシングプロセスの前に薄化が実施されることに、留意することが重要である。一実施形態では、フォトレジスト層802はおよそ5ミクロンの厚さを有し、デバイス層804は、おおよそ2〜3ミクロンの範囲内の厚さを有する。一実施形態では、ダイ付着膜808(又は、薄化された又は薄型のウエハ又は基板を支持テープ810に接合可能な、任意の好適な代替物)は、およそ20ミクロンの厚さを有する。
[0069]図8Bを参照するに、基板806にトレンチ814を形成するために、マスク802、デバイス層804、及び基板806の一部分が、分割型レーザビームのレーザスクライビングプロセス812を用いてパターニングされる。図8Cを参照するに、トレンチ814をダイ付着膜808に至るまで延伸させ、ダイ付着膜808の上部を露出させ、かつ、シリコン基板806を個片化するために、シリコン貫通ディーププラズマエッチングプロセス816が使用される。シリコン貫通ディーププラズマエッチングプロセス816において、デバイス層804はマスク層802によって保護される。
[0070]図8Dを参照するに、個片化プロセスは、ダイ付着膜808をパターニングすることと、支持テープ810の上部を露出させることと、ダイ付着膜808を個片化することとを、更に含みうる。一実施形態では、ダイ付着膜は、レーザプロセス又はエッチングプロセスによって個片化される。更なる実施形態は、その後に、支持テープ810から、基板806の個片化された部分を(例えば個々の集積回路として)取り外すことを含みうる。一実施形態では、個片化されたダイ付着膜は、基板806の個片化された部分の裏側に保持される。他の実施形態は、マスク層802をデバイス層804から除去することを含みうる。代替的な実施形態では、基板806がおよそ50ミクロンよりも薄い場合、追加のプラズマプロセスを使用せずに基板806を完全に個片化するために、分割型レーザビームのレーザスクライビングプロセス812が使用される。
[0071]単一のプロセスツールが、ハイブリッドな、線形プロファイルのレーザビームアブレーション及びプラズマエッチングによる個片化プロセスにおける、多数の又は全ての工程を実施するよう、構成されうる。例えば、図9は、本発明の実施形態による、ウエハ又は基板をレーザ及びプラズマでダイシングするための、ツールレイアウトのブロック図を示している。
[0072]図9を参照するに、プロセスツール900は、ファクトリインターフェース902(FI)であって、複数のロードロック904がそれに結合されている、ファクトリインターフェース902を含む。クラスタツール906が、ファクトリインターフェース902に連結される。クラスタツール906は、一又は複数のプラズマエッチングチャンバ(プラズマエッチングチャンバ908など)を含む。レーザスクライビング装置910も、ファクトリインターフェース902に連結される。プロセスツール900の全設置面積は、一実施形態では、図9に示しているように、およそ3500ミリメートル(3.5メートル)×およそ3800ミリメートル(3.8メートル)でありうる。
[0073]一実施形態では、レーザスクライビング装置910は、分割レーザビームを提供するよう構成されたレーザアセンブリを収納する。かかる一実施形態では、レーザアセンブリは、分割型レーザビームを提供するよう構成される。ある特定のかかる実施形態では、レーザビームはフェムト秒ベースのレーザビームである。
[0074]一実施形態では、レーザアセンブリは、分割型レーザビームを対称に分割されたレーザビームとして提供するよう、構成される。一実施形態では、レーザアセンブリは、分割型レーザビームを非対称に分割されたレーザビームとして提供するよう、構成される。一実施形態では、レーザアセンブリは、分割型レーザビームを線形平坦頂部のビームプロファイルとして提供するよう、構成される。
[0075]一実施形態では、レーザは、ハイブリッドなレーザ及びエッチングによる個片化プロセスのうちのレーザアブレーション部分(例えば、上述のレーザアブレーションプロセス)を実施するのに好適である。一実施形態では、移動可能な載台であって、レーザに対してウエハ又は基板(又はそのキャリア)を動かすよう構成された、移動可能な載台も、レーザスクライビング装置910に含まれる。ある具体的な実施形態では、レーザも移動可能である。レーザスクライビング装置910の全設置面積は、一実施形態では、図9に示しているように、およそ2240ミリメートル×およそ1270ミリメートルでありうる。
[0076]一実施形態では、一又は複数のプラズマエッチングチャンバ908は、複数の集積回路を個片化するために、パターニングされたマスクのギャップを通してウエハ又は基板をエッチングするよう、構成される。かかる一実施形態では、一又は複数のプラズマエッチングチャンバ908は、ディープシリコンエッチングプロセスを実施するよう構成される。ある具体的な実施形態にでは、一又は複数のプラズマエッチングチャンバ808は、米国カリフォルニア州SunnyvaleのApplied Materialsから入手可能なApplied Centura(登録商標) Silvia(商標) エッチングシステムである。このエッチングチャンバは、単結晶シリコンの基板又はウエハの上又は内部に収納された個片化された集積回路を作り出すために使用されるディープシリコンエッチング向けに、特に設計されうる。一実施形態では、シリコンエッチング速度を速めるために、プラズマエッチングチャンバ908には、高密度プラズマソースが含まれる。一実施形態では、個片化又はダイシングのプロセスの製造スループットを高めることを可能にするために、プロセスツール900のクラスタツール906の部分に、2つ以上のエッチングチャンバが含まれる。
[0077]ファクトリインターフェース902は、レーザスクライビング装置910を伴う外部の製造設備とクラスタツール906との間の界面となる、好適な大気ポートでありうる。ファクトリインターフェース902は、ウエハ(又はそのキャリア)を保管ユニット(前面開口型統一ポッドなど)から、クラスタツール906とレーザスクライビング装置910のいずれか、又はその両方に移送するための、アーム又はブレードを有するロボットを含みうる。
[0078]クラスタツール906は、その他の、個片化方法における機能を実施するのに好適なチャンバを含みうる。例えば、一実施形態では、追加のエッチングチャンバの代わりに堆積チャンバ912が含まれる。堆積チャンバ912は、ウエハ又は基板のレーザスクライビングに先立って、ウエハ又は基板のデバイス層の上又は上方にマスクを堆積させるよう、構成されうる。かかる一実施形態では、堆積チャンバ912は、フォトレジスト層の堆積に適している。別の実施形態では、追加のエッチングチャンバの代わりに湿式/乾式ステーション914が含まれる。湿式/乾式ステーションは、基板又はウエハのレーザスクライビング及びプラズマエッチングによる個片化プロセスの後に、残留物及び断片を洗浄すること、又は、マスクを除去することに、適していることがある。更に別の実施形態では、追加のディープシリコンエッチングチャンバの代わりに、プラズマエッチングチャンバが含まれ、このプラズマエッチングチャンバは、プラズマベースの洗浄プロセスを実施するよう構成される。一実施形態では、プロセスツール900の構成要素として、計測ステーションも含まれる。
[0079]本発明の実施形態は、指令が記憶されているマシン可読媒体を含みうるコンピュータプログラム製品又はソフトウェアであって、本発明の実施形態によるプロセスを実施するよう、コンピュータシステム(又はその他の電子デバイス)をプログラムするために使用されうる、コンピュータプログラム製品又はソフトウェアとして、提供されうる。一実施形態では、コンピュータシステムは、図9に関連して説明しているプロセスツール900に連結される。マシン可読媒体は、マシン(例えばコンピュータ)によって可読な形態で情報を記憶又は送信するための、任意の機構を含む。例えば、マシン可読(例えばコンピュータ可読)媒体は、マシン(例えばコンピュータ)可読記憶媒体(例えば、読み出し専用メモリ(ROM)、ランダムアクセスメモリ(RAM)、磁気ディスク記憶媒体、光記憶媒体、フラッシュメモリデバイスなど)や、マシン(例えばコンピュータ)可読伝送媒体(伝播される信号(例えば赤外信号やデジタル信号など)の電気的形態、光学的形態、音響的形態、又はその他の形態)等を、含む。
[0080]図10は、コンピュータシステム1000の例示的な形態におけるマシンの概略図を示しており、コンピュータシステム1000において、本書に記載の方法のうちの一又は複数の任意のものをマシンに実行させるための、指令のセットが実行されうる。代替的な実施形態では、マシンは、ローカルエリアネットワーク(LAN)、イントラネット、エクストラネット、又はインターネットで、他のマシンに接続され(例えば、他のマシンとネットワーク化され)うる。マシンは、クライアント−サーバネットワーク環境においてはサーバ若しくはクライアントマシンの役割で、又は、ピアツーピア(又は分散)ネットワーク環境においてはピアマシンとして、動作しうる。マシンは、パーソナルコンピュータ(PC)、タブレットPC、セットトップボックス(STB)、パーソナルデジタルアシスタント(PDA)、携帯電話、ウェブアプライアンス、サーバ、ネットワークルータ、スイッチ若しくはブリッジ、又は、このマシンによって行われる動作を特定する(連続した若しくは連続していない)指令のセットを実行可能な任意のマシンでありうる。更に、単一のマシンのみを図示しているが、「マシン(machine)」という語は、本書に記載の方法のうちの一又は複数の任意のものを実施するために、指令のセット(又は複数のセット)を個別に又は連携的に実行する、マシン(コンピュータなど)の任意の集合体を含むとも、解釈すべきである。
[0081]例示的なコンピュータシステム1000は、バス1030を介して互いに通信する、プロセッサ1002、メインメモリ1004(例えば、読み出し専用メモリ(ROM)、フラッシュメモリ、同期DRAM(SDRAM)又はランバスDRAM(RDRAM)といったダイナミックランダムアクセスメモリ(DRAM)など)、スタティックメモリ1006(例えば、フラッシュメモリ、スタティックランダムアクセスメモリ(SRAM)、MRAMなど)、及び、二次記憶装置1018(データ記憶デバイスなど)を、含む。
[0082]プロセッサ1002は、マイクロプロセッサや中央処理装置などといった、一又は複数の汎用処理デバイスを表わしている。より詳細には、プロセッサ1002は、複雑指令セットコンピューティング(CISC)マイクロプロセッサ、縮小指令セットコンピューティング(RISC)マイクロプロセッサ、超長指令語(VLIW)マイクロプロセッサ、他の指令セットを実装するプロセッサ、又は、指令セットの組み合わせを実装するプロセッサでありうる。プロセッサ1002は、特定用途向け集積回路(ASIC)、フィールドプログラマブルゲートアレイ(FPGA)、デジタル信号プロセッサ(DSP)、ネットワークプロセッサなどといった、一又は複数の特殊用途処理デバイスであることもある。プロセッサ1002は、本書に記載の工程を実施するための処理論理1026を実行するよう、設定される。
[0083]コンピュータシステム1000は、ネットワークインターフェースデバイス1008を更に含みうる。コンピュータシステム1000は、ビデオディスプレイユニット1010(液晶ディスプレイ(LCD)、発光ダイオードディスプレイ(LED)、又は陰極線管(CRT)など)、英数字入力デバイス1012(例えばキーボード)、カーソル制御デバイス1014(例えばマウス)、及び、信号生成デバイス1016(例えばスピーカー)も含みうる。
[0084]二次メモリ1018は、本書に記載の方法又は機能のうちの一又は複数の任意ものを具現化する、一又は複数の指令セット(例えば、ソフトウェア1022)が記憶される、マシンアクセス可能記憶媒体(又は、より具体的には、コンピュータ可読記憶媒体)1032を含みうる。ソフトウェア1022は、それがコンピュータシステム1000によって実行されている間、メインメモリ1004及び/又はプロセッサ1002の中に、完全に又は少なくとも部分的に常駐してもよく、メインメモリ1004及びプロセッサ1002も、マシン可読記憶媒体を構成する。ソフトウェア1022は更に、ネットワークインターフェースデバイス1008を介して、ネットワーク1020上で送受信されうる。
[0085]例示的な実施形態では、マシンアクセス可能記憶媒体1032を単一の媒体として示しているが、「マシン可読記憶媒体(machine−readable storage medium)」という語は、一又は複数の指令セットを記憶する単一の媒体又は複数の媒体(例えば、集中データベース若しくは分散データベース、並びに/又は、関連キャッシュ及びサーバ)を含むと、解釈すべきである。「マシン可読記憶媒体」という語は、マシンによって実行される指令のセットを記憶又は符号化することが可能であり、かつ、マシンに、本発明の方法のうちの一又は複数の任意のものを実施させる、任意の媒体を含むとも、解釈すべきである。したがって、「マシン可読記憶媒体」という語は、固体メモリと、光媒体及び磁気媒体とを含むがそれらに限定されるわけではないと、解釈すべきである。
[0086]本発明の一実施形態により、マシンアクセス可能記憶媒体には、複数の集積回路を有する半導体ウエハをダイシングする方法をデータ処理システムに実施させる指令が、記憶されている。方法は、集積回路を覆い、保護する層で構成されたマスクを、半導体ウエハ上に形成することを含む。間隙を有するパターニングされたマスクを提供するために、マスクは次いで、分割型レーザビームのレーザスクライビングプロセスを用いてパターニングされ、半導体ウエハの集積回路間の領域が露出される。半導体ウエハは次いで、集積回路を個片化するために、パターニングされたマスクの間隙を通じてプラズマエッチングされる。
[0087]ゆえに、分割レーザビームのレーザスクライビングプロセス及びプラズマエッチングプロセスを使用する、ハイブリッドウエハダイシングの手法が開示されている。

Claims (15)

  1. 複数の集積回路を備える半導体ウエハをダイシングする方法であって、
    前記集積回路を覆いかつ保護する層を備えるマスクを、前記半導体ウエハ上に形成することと、
    間隙を有するパターニングされたマスクを提供するために、分割型レーザビームのレーザスクライビングプロセスを用いて前記マスクをパターニングし、前記半導体ウエハの前記集積回路間の領域を露出させることと、
    前記集積回路を個片化するために、前記パターニングされたマスクの前記間隙を通じて、前記半導体ウエハをプラズマエッチングすることとを含む、方法。
  2. 前記分割型レーザビームのレーザスクライビングプロセスを用いてスクライブすることが、対称に分割されたレーザビームを用いてスクライブすることを含む、請求項1に記載の方法。
  3. 前記分割型レーザビームのレーザスクライビングプロセスを用いてスクライブすることが、非対称に分割されたレーザビームを用いてスクライブすることを含む、請求項1に記載の方法。
  4. 前記分割型レーザビームのレーザスクライビングプロセスを用いてスクライブすることが、線形平坦頂部のビームプロファイルを伴ってスクライブすることを含む、請求項1に記載の方法。
  5. 前記分割型レーザビームのレーザスクライビングプロセスを用いてスクライブすることが、フェムト秒ベースのレーザビームを用いてスクライブすることを含む、請求項1に記載の方法。
  6. 前記レーザスクライビングプロセスを用いて前記マスクをパターニングすることが、前記半導体ウエハの前記集積回路間の前記領域内にトレンチを形成することを含み、前記半導体ウエハをプラズマエッチングすることが、前記トレンチを延伸させて、対応するトレンチ延伸部を形成することを含む、請求項1に記載の方法。
  7. 前記トレンチの各々が一定の幅を有し、前記対応するトレンチ延伸部の各々も前記幅を有する、請求項6に記載の方法。
  8. 前記分割型レーザビームのレーザスクライビングプロセスを用いて前記マスクをパターニングした後の、前記間隙を通じて前記半導体ウエハをプラズマエッチングする前に、プラズマプロセスを用いて前記半導体ウエハの露出した前記領域を洗浄することを更に含む、請求項1に記載の方法。
  9. 複数の集積回路を備える半導体ウエハをダイシングするためのシステムであって、
    ファクトリインターフェースと、
    前記ファクトリインターフェースに連結され、かつ、分割型レーザビームを提供するよう構成されたレーザアセンブリを備える、レーザスクライビング装置と、
    前記ファクトリインターフェースに連結されたプラズマエッチングチャンバとを備える、システム。
  10. 前記レーザアセンブリが、前記分割型レーザビームを対称に分割されたレーザビームとして提供するよう構成される、請求項9に記載のシステム。
  11. 前記レーザビームがフェムト秒ベースのレーザビームである、請求項10に記載のシステム。
  12. 前記レーザアセンブリが、前記分割型レーザビームを非対称に分割されたレーザビームとして提供するよう構成される、請求項9に記載のシステム。
  13. 前記レーザビームがフェムト秒ベースのレーザビームである、請求項12に記載のシステム。
  14. 前記レーザアセンブリが、前記分割型レーザビームを線形平坦頂部のプロファイルとして提供するよう構成される、請求項9に記載のシステム。
  15. 前記プラズマエッチングチャンバが、ディープシリコンエッチングを実施するよう構成されており、
    前記ファクトリインターフェースに連結された第2プラズマエッチングチャンバであって、プラズマベースの洗浄プロセスを実施するよう構成された、第2プラズマエッチングチャンバを更に備える、請求項9に記載のシステム。
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2021057404A (ja) * 2019-09-27 2021-04-08 株式会社ディスコ ウエーハの加工方法
JP2022544148A (ja) * 2019-08-06 2022-10-17 アプライド マテリアルズ インコーポレイテッド 空間的に複数の焦点を合わせるレーザビームのレーザスクライビング処理およびプラズマエッチング処理を用いるハイブリッドウエハダイシング手法
JP7399565B2 (ja) 2019-12-23 2023-12-18 株式会社ディスコ 被加工物の加工方法

Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10410924B2 (en) * 2017-01-12 2019-09-10 Panasonic Intellectual Property Management Co., Ltd. Manufacturing process of element chip
CN108388735B (zh) * 2018-02-28 2022-04-22 深圳市恒凯微电子科技有限公司 一种设计具有多孔介质层的集成电路的方法
AU2018203169B1 (en) 2018-05-07 2018-11-08 B.Box For Kids Developments Pty Ltd Drinking vessel and ventilation members
US10720337B2 (en) * 2018-07-20 2020-07-21 Asm Ip Holding B.V. Pre-cleaning for etching of dielectric materials
US10720334B2 (en) 2018-07-20 2020-07-21 Asm Ip Holding B.V. Selective cyclic dry etching process of dielectric materials using plasma modification
US11469141B2 (en) * 2018-08-07 2022-10-11 Texas Instruments Incorporated Laser dicing for singulation
US11355394B2 (en) 2018-09-13 2022-06-07 Applied Materials, Inc. Wafer dicing using hybrid laser scribing and plasma etch approach with intermediate breakthrough treatment
KR20200034503A (ko) 2018-09-21 2020-03-31 삼성전자주식회사 기판 쏘잉 방법 및 반도체 칩의 싱귤레이션 방법
JP2021136248A (ja) * 2020-02-21 2021-09-13 株式会社ディスコ デバイスウェーハの加工方法
DE102022204685B3 (de) * 2022-05-13 2023-10-05 Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung eingetragener Verein Optik zur Erzeugung eines linearen Fokus, Vorrichtung und Verfahren zur Bearbeitung eines Werkstücks

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004055684A (ja) * 2002-07-17 2004-02-19 Shinko Electric Ind Co Ltd 半導体装置及びその製造方法
JP2005191039A (ja) * 2003-12-24 2005-07-14 Matsushita Electric Ind Co Ltd 半導体ウェハの処理方法
JP2008193034A (ja) * 2007-02-08 2008-08-21 Matsushita Electric Ind Co Ltd 半導体チップの製造方法
JP2014523113A (ja) * 2011-06-15 2014-09-08 アプライド マテリアルズ インコーポレイテッド マルチステップ・非対称形状レーザビームスクライビング
JP2014526146A (ja) * 2011-07-11 2014-10-02 アプライド マテリアルズ インコーポレイテッド プラズマエッチングを伴うハイブリッド分割ビームレーザスクライビングプロセスを用いたウェハダイシング
JP2015519732A (ja) * 2012-04-10 2015-07-09 アプライド マテリアルズ インコーポレイテッドApplied Materials,Incorporated プラズマエッチングによるハイブリッドマルチステップレーザスクライビングプロセスを用いたウェハダイシング
US20150214109A1 (en) * 2014-01-29 2015-07-30 Wei-Sheng Lei Wafer dicing using hybrid laser scribing and plasma etch approach with mask plasma treatment for improved mask etch resistance

Family Cites Families (99)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4049944A (en) 1973-02-28 1977-09-20 Hughes Aircraft Company Process for fabricating small geometry semiconductive devices including integrated components
US4171060A (en) * 1978-12-11 1979-10-16 Spil-Les Covered drinking cup
US4339528A (en) 1981-05-19 1982-07-13 Rca Corporation Etching method using a hardened PVA stencil
US4684437A (en) 1985-10-31 1987-08-04 International Business Machines Corporation Selective metal etching in metal/polymer structures
JP2761579B2 (ja) * 1991-02-18 1998-06-04 株式会社 半導体エネルギー研究所 基板処理装置
KR100215338B1 (ko) 1991-03-06 1999-08-16 가나이 쓰도무 반도체 장치의 제조방법
US5691794A (en) 1993-02-01 1997-11-25 Canon Kabushiki Kaisha Liquid crystal display device
US5593606A (en) 1994-07-18 1997-01-14 Electro Scientific Industries, Inc. Ultraviolet laser system and method for forming vias in multi-layered targets
JPH09216085A (ja) 1996-02-07 1997-08-19 Canon Inc 基板の切断方法及び切断装置
EP0820640B1 (en) * 1996-02-09 2011-07-13 Advanced Laser Separation International (ALSI) B.V. Laser separation of semiconductor elements formed in a wafer of semiconductor material
US6028722A (en) * 1996-03-08 2000-02-22 Sdl, Inc. Optical beam reconfiguring device and optical handling system for device utilization
EP1357584A3 (en) 1996-08-01 2005-01-12 Surface Technology Systems Plc Method of surface treatment of semiconductor substrates
US6426484B1 (en) 1996-09-10 2002-07-30 Micron Technology, Inc. Circuit and method for heating an adhesive to package or rework a semiconductor die
US5920973A (en) 1997-03-09 1999-07-13 Electro Scientific Industries, Inc. Hole forming system with multiple spindles per station
JP3230572B2 (ja) 1997-05-19 2001-11-19 日亜化学工業株式会社 窒化物系化合物半導体素子の製造方法及び半導体発光素子
US6057180A (en) 1998-06-05 2000-05-02 Electro Scientific Industries, Inc. Method of severing electrically conductive links with ultraviolet laser output
US6211488B1 (en) * 1998-12-01 2001-04-03 Accudyne Display And Semiconductor Systems, Inc. Method and apparatus for separating non-metallic substrates utilizing a laser initiated scribe
JP2001044144A (ja) 1999-08-03 2001-02-16 Tokyo Seimitsu Co Ltd 半導体チップの製造プロセス
JP2001110811A (ja) 1999-10-08 2001-04-20 Oki Electric Ind Co Ltd 半導体装置の製造方法
JP4387007B2 (ja) 1999-10-26 2009-12-16 株式会社ディスコ 半導体ウェーハの分割方法
JP2001144126A (ja) 1999-11-12 2001-05-25 Matsushita Electric Ind Co Ltd 半導体装置の製造方法および半導体装置
JP2001148358A (ja) 1999-11-19 2001-05-29 Disco Abrasive Syst Ltd 半導体ウェーハ及び該半導体ウェーハの分割方法
US6300593B1 (en) 1999-12-07 2001-10-09 First Solar, Llc Apparatus and method for laser scribing a coated substrate
US6887804B2 (en) 2000-01-10 2005-05-03 Electro Scientific Industries, Inc. Passivation processing over a memory link
CN1276495C (zh) 2000-01-10 2006-09-20 电子科学工业公司 以具超短脉冲宽度的激光脉冲的脉冲串处理存储器链路的激光器系统及方法
AU2001251172A1 (en) 2000-03-30 2001-10-15 Electro Scientific Industries, Inc. Laser system and method for single pass micromachining of multilayer workpieces
KR100773070B1 (ko) 2000-07-12 2007-11-02 일렉트로 싸이언티픽 인더스트리이즈 인코포레이티드 Ic 퓨즈를 하나의 펄스로 절단하기 위한 uv 레이저시스템 및 방법
US6676878B2 (en) 2001-01-31 2004-01-13 Electro Scientific Industries, Inc. Laser segmented cutting
US6759275B1 (en) 2001-09-04 2004-07-06 Megic Corporation Method for making high-performance RF integrated circuits
US6642127B2 (en) 2001-10-19 2003-11-04 Applied Materials, Inc. Method for dicing a semiconductor wafer
JP3612317B2 (ja) * 2001-11-30 2005-01-19 株式会社東芝 半導体装置の製造方法
JP3910843B2 (ja) 2001-12-13 2007-04-25 東京エレクトロン株式会社 半導体素子分離方法及び半導体素子分離装置
US6706998B2 (en) 2002-01-11 2004-03-16 Electro Scientific Industries, Inc. Simulated laser spot enlargement
CN1515025A (zh) 2002-02-25 2004-07-21 ������������ʽ���� 半导体片的分割方法
KR100451950B1 (ko) 2002-02-25 2004-10-08 삼성전자주식회사 이미지 센서 소자 웨이퍼 소잉 방법
JP2003257896A (ja) 2002-02-28 2003-09-12 Disco Abrasive Syst Ltd 半導体ウェーハの分割方法
EP1497851B1 (en) 2002-04-19 2006-01-25 Xsil Technology Limited Program-controlled dicing of a substrate using a pulsed laser
JP2004031526A (ja) 2002-06-24 2004-01-29 Toyoda Gosei Co Ltd 3族窒化物系化合物半導体素子の製造方法
US6582983B1 (en) 2002-07-12 2003-06-24 Keteca Singapore Singapore Method and wafer for maintaining ultra clean bonding pads on a wafer
JP3908148B2 (ja) 2002-10-28 2007-04-25 シャープ株式会社 積層型半導体装置
US20040157457A1 (en) 2003-02-12 2004-08-12 Songlin Xu Methods of using polymer films to form micro-structures
JP2004273895A (ja) 2003-03-11 2004-09-30 Disco Abrasive Syst Ltd 半導体ウエーハの分割方法
US7087452B2 (en) 2003-04-22 2006-08-08 Intel Corporation Edge arrangements for integrated circuit chips
JP2004322168A (ja) 2003-04-25 2004-11-18 Disco Abrasive Syst Ltd レーザー加工装置
JP4231349B2 (ja) 2003-07-02 2009-02-25 株式会社ディスコ レーザー加工方法およびレーザー加工装置
JP4408361B2 (ja) 2003-09-26 2010-02-03 株式会社ディスコ ウエーハの分割方法
US7128806B2 (en) 2003-10-21 2006-10-31 Applied Materials, Inc. Mask etch processing apparatus
JP4471632B2 (ja) 2003-11-18 2010-06-02 株式会社ディスコ ウエーハの加工方法
JP2005203541A (ja) 2004-01-15 2005-07-28 Disco Abrasive Syst Ltd ウエーハのレーザー加工方法
NL1027881C1 (nl) * 2004-05-25 2005-11-30 Swilion B V Afsluitbare drinkbeker.
US7459377B2 (en) 2004-06-08 2008-12-02 Panasonic Corporation Method for dividing substrate
US7804043B2 (en) 2004-06-15 2010-09-28 Laserfacturing Inc. Method and apparatus for dicing of thin and ultra thin semiconductor wafer using ultrafast pulse laser
US7687740B2 (en) 2004-06-18 2010-03-30 Electro Scientific Industries, Inc. Semiconductor structure processing using multiple laterally spaced laser beam spots delivering multiple blows
US7507638B2 (en) 2004-06-30 2009-03-24 Freescale Semiconductor, Inc. Ultra-thin die and method of fabricating same
JP4018088B2 (ja) 2004-08-02 2007-12-05 松下電器産業株式会社 半導体ウェハの分割方法及び半導体素子の製造方法
US7199050B2 (en) 2004-08-24 2007-04-03 Micron Technology, Inc. Pass through via technology for use during the manufacture of a semiconductor device
JP4018096B2 (ja) 2004-10-05 2007-12-05 松下電器産業株式会社 半導体ウェハの分割方法、及び半導体素子の製造方法
US20060088984A1 (en) 2004-10-21 2006-04-27 Intel Corporation Laser ablation method
US20060086898A1 (en) 2004-10-26 2006-04-27 Matsushita Electric Industrial Co., Ltd. Method and apparatus of making highly repetitive micro-pattern using laser writer
US20060146910A1 (en) 2004-11-23 2006-07-06 Manoochehr Koochesfahani Method and apparatus for simultaneous velocity and temperature measurements in fluid flow
JP4288229B2 (ja) 2004-12-24 2009-07-01 パナソニック株式会社 半導体チップの製造方法
US7875898B2 (en) 2005-01-24 2011-01-25 Panasonic Corporation Semiconductor device
JP2006253402A (ja) 2005-03-10 2006-09-21 Nec Electronics Corp 半導体装置の製造方法
US7361990B2 (en) 2005-03-17 2008-04-22 Taiwan Semiconductor Manufacturing Company, Ltd. Reducing cracking of high-lead or lead-free bumps by matching sizes of contact pads and bump pads
JP4478053B2 (ja) 2005-03-29 2010-06-09 株式会社ディスコ 半導体ウエーハ処理方法
JP4285455B2 (ja) 2005-07-11 2009-06-24 パナソニック株式会社 半導体チップの製造方法
JP4599243B2 (ja) 2005-07-12 2010-12-15 株式会社ディスコ レーザー加工装置
JP4769560B2 (ja) 2005-12-06 2011-09-07 株式会社ディスコ ウエーハの分割方法
JP4372115B2 (ja) 2006-05-12 2009-11-25 パナソニック株式会社 半導体装置の製造方法、および半導体モジュールの製造方法
JP4480728B2 (ja) 2006-06-09 2010-06-16 パナソニック株式会社 Memsマイクの製造方法
JP4544231B2 (ja) 2006-10-06 2010-09-15 パナソニック株式会社 半導体チップの製造方法
JP4840200B2 (ja) 2007-03-09 2011-12-21 パナソニック株式会社 半導体チップの製造方法
US7926410B2 (en) 2007-05-01 2011-04-19 J.R. Automation Technologies, L.L.C. Hydraulic circuit for synchronized horizontal extension of cylinders
JP5205012B2 (ja) 2007-08-29 2013-06-05 株式会社半導体エネルギー研究所 表示装置及び当該表示装置を具備する電子機器
JP4858395B2 (ja) 2007-10-12 2012-01-18 パナソニック株式会社 プラズマ処理装置
US7891821B2 (en) * 2007-12-17 2011-02-22 Coherent, Inc. Laser beam transformer and projector having stacked plates
US7859084B2 (en) 2008-02-28 2010-12-28 Panasonic Corporation Semiconductor substrate
JP2009260272A (ja) 2008-03-25 2009-11-05 Panasonic Corp 基板の加工方法および半導体チップの製造方法ならびに樹脂接着層付き半導体チップの製造方法
US20090255911A1 (en) 2008-04-10 2009-10-15 Applied Materials, Inc. Laser scribing platform and hybrid writing strategy
KR20090130701A (ko) * 2008-06-16 2009-12-24 삼성전자주식회사 반도체 패키지 및 그의 제조 방법
US20100013036A1 (en) 2008-07-16 2010-01-21 Carey James E Thin Sacrificial Masking Films for Protecting Semiconductors From Pulsed Laser Process
US7891091B2 (en) * 2008-11-25 2011-02-22 Yonggang Li Method of enabling selective area plating on a substrate
US8609512B2 (en) 2009-03-27 2013-12-17 Electro Scientific Industries, Inc. Method for laser singulation of chip scale packages on glass substrates
CA2782560A1 (en) * 2009-11-30 2011-06-03 Mathew Rekow Method and apparatus for scribing a line in a thin film using a series of laser pulses
US8642448B2 (en) 2010-06-22 2014-02-04 Applied Materials, Inc. Wafer dicing using femtosecond-based laser and plasma etch
US8483571B2 (en) * 2010-06-30 2013-07-09 Avago Technologies General Ip (Singapore) Pte. Ltd. Optical beam splitter for use in an optoelectronic module, and a method for performing optical beam splitting in an optoelectronic module
US8809120B2 (en) * 2011-02-17 2014-08-19 Infineon Technologies Ag Method of dicing a wafer
US8802545B2 (en) 2011-03-14 2014-08-12 Plasma-Therm Llc Method and apparatus for plasma dicing a semi-conductor wafer
US8759197B2 (en) 2011-06-15 2014-06-24 Applied Materials, Inc. Multi-step and asymmetrically shaped laser beam scribing
US8703581B2 (en) * 2011-06-15 2014-04-22 Applied Materials, Inc. Water soluble mask for substrate dicing by laser and plasma etch
US8912077B2 (en) * 2011-06-15 2014-12-16 Applied Materials, Inc. Hybrid laser and plasma etch wafer dicing using substrate carrier
US8557682B2 (en) * 2011-06-15 2013-10-15 Applied Materials, Inc. Multi-layer mask for substrate dicing by laser and plasma etch
US9908687B2 (en) * 2011-11-15 2018-03-06 Ignite Usa, Llc Travel beverage container
US8883614B1 (en) * 2013-05-22 2014-11-11 Applied Materials, Inc. Wafer dicing with wide kerf by laser scribing and plasma etching hybrid approach
US9464778B2 (en) * 2014-01-21 2016-10-11 Cree, Inc. Lighting device utilizing a double fresnel lens
US9012305B1 (en) * 2014-01-29 2015-04-21 Applied Materials, Inc. Wafer dicing using hybrid laser scribing and plasma etch approach with intermediate non-reactive post mask-opening clean
US9610543B2 (en) * 2014-01-31 2017-04-04 Infineon Technologies Ag Method for simultaneous structuring and chip singulation
US9418894B2 (en) * 2014-03-21 2016-08-16 Semiconductor Components Industries, Llc Electronic die singulation method
CN104979187A (zh) * 2014-04-02 2015-10-14 中芯国际集成电路制造(上海)有限公司 晶圆的分割方法

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004055684A (ja) * 2002-07-17 2004-02-19 Shinko Electric Ind Co Ltd 半導体装置及びその製造方法
JP2005191039A (ja) * 2003-12-24 2005-07-14 Matsushita Electric Ind Co Ltd 半導体ウェハの処理方法
JP2008193034A (ja) * 2007-02-08 2008-08-21 Matsushita Electric Ind Co Ltd 半導体チップの製造方法
JP2014523113A (ja) * 2011-06-15 2014-09-08 アプライド マテリアルズ インコーポレイテッド マルチステップ・非対称形状レーザビームスクライビング
JP2014526146A (ja) * 2011-07-11 2014-10-02 アプライド マテリアルズ インコーポレイテッド プラズマエッチングを伴うハイブリッド分割ビームレーザスクライビングプロセスを用いたウェハダイシング
JP2015519732A (ja) * 2012-04-10 2015-07-09 アプライド マテリアルズ インコーポレイテッドApplied Materials,Incorporated プラズマエッチングによるハイブリッドマルチステップレーザスクライビングプロセスを用いたウェハダイシング
US20150214109A1 (en) * 2014-01-29 2015-07-30 Wei-Sheng Lei Wafer dicing using hybrid laser scribing and plasma etch approach with mask plasma treatment for improved mask etch resistance

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2022544148A (ja) * 2019-08-06 2022-10-17 アプライド マテリアルズ インコーポレイテッド 空間的に複数の焦点を合わせるレーザビームのレーザスクライビング処理およびプラズマエッチング処理を用いるハイブリッドウエハダイシング手法
JP2021057404A (ja) * 2019-09-27 2021-04-08 株式会社ディスコ ウエーハの加工方法
JP7300953B2 (ja) 2019-09-27 2023-06-30 株式会社ディスコ ウエーハの加工方法
JP7399565B2 (ja) 2019-12-23 2023-12-18 株式会社ディスコ 被加工物の加工方法

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