JP2012038996A5 - - Google Patents

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  1. 半導体基板の表面に半導体素子を集積させて回路の少なくとも一部を形成する工程（ａ）と、
    前記半導体基板の表面から穴を開ける工程（ｂ）と、
    前記穴の内表面に絶縁膜およびバリア膜を形成する工程（ｃ）と、
    前記バリア膜の内表面に、前記穴を埋めるように導電性金属を形成する工程（ｄ）と、
    その後前記半導体基板の裏面を加工して前記半導体基板の厚さを減少させ、前記導電性金属、前記バリア膜、および前記絶縁膜を前記裏面から突出させる工程（ｅ）と、
    その後、前記半導体基板の裏面にＳｉＣＮ膜を設ける工程（ｆ）と、
    を有することを特徴とする半導体装置の製造方法。
  2. 前記工程（ｆ）は、Ｓｉ３Ｎ４にＣを２原子％〜４０原子％添加した組成のＳｉＣＮ膜を形成する工程であることを特徴とする請求項１に記載の半導体装置の製造方法。
  3. 表面に回路が形成された半導体基板と、
    前記半導体基板を貫通して一部が裏面から突出するように設けられた貫通電極と、
    前記裏面を覆うように設けられたＳｉＣＮ膜と、
    を有することを特徴とする半導体装置。
  4. 前記ＳｉＣＮ膜は、Ｓｉ３Ｎ４にＣを２原子％〜４０原子％添加させた組成を有することを特徴とする請求項３に記載の半導体装置。
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